CN1691304B - 一种抑制多晶硅针孔的多晶硅层缓冲局部场氧化硅结构工艺方法 - Google Patents
一种抑制多晶硅针孔的多晶硅层缓冲局部场氧化硅结构工艺方法 Download PDFInfo
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Abstract
本发明公开了一种抑制多晶硅针孔的PBL工艺方法,它与现有的PBL工艺方法的主要区别是,取消现有工艺方法中的原第10步骤湿法表面二氧化硅去除,将原第11步骤的等离子体多晶硅刻蚀改为两步刻蚀工艺,首先采用低选择比的干法等离子体刻蚀条件去除多晶硅表面二氧化硅,然后再采用高选择比的干法等离子体刻蚀条件回刻多晶硅。本发明可以有效避免多晶硅回刻时造成硅表面的缺陷,保证超快闪存储器/嵌入式超快闪存储器的性能。
Description
技术领域
本发明涉及半导体器件制造技术,特别是涉及一种用于超快闪存储器/嵌入式超快闪存储器的抑制多晶硅针孔的PBL工艺方法。
背景技术
对于0.30um以上CMOS(complementary metai-oxide-semic-onductor互补金属氧化物半导体)制作工艺,其场隔离基本采用LOCOS(locally oxidized silicon,局部场氧化硅)隔离技术。但是,由于各种产品性能要求不同、应用不同,LOCOS工艺出现了很多分支,PBL(polybuffered LOCOS,多晶硅层缓冲局部场氧化硅结构)工艺便是其中之一。
较为先进的超快闪存储器/嵌入式超快闪存储器制作工艺中采用了较为复杂的PBL场隔离工艺。随着超快闪存储器在各个领域的应用日益广泛,它对耐久性及数据保持性有很高的要求。超快闪存储器对耐久性最基本的要求是能擦写1万次以上,对数据保持性最基本的要求是能保持数据10年以上。PBL场隔离工艺的稳定性对超快闪存储器/嵌入式超快闪存储器的耐久性和数据保持性都是至关重要的。
现有技术中PBL简易工艺流程如图1所示。这里要特别说明第10、11两个步骤。进行第8步骤场氧化时,在缓冲多晶硅的末端和上层的氮化硅之间会形成一层较薄的二氧化硅。所以,在完成第9步骤氮化硅热磷酸去除后,要进行第10步骤的湿法表面二氧化硅去除。如果不有效去除这层薄二氧化硅层,进行第11步骤等离子体多晶硅刻蚀时就会造成这层薄二氧化硅层下面的多晶硅残留(这是因为等离子体多晶硅刻蚀对二氧化硅刻蚀率很低)。而多晶硅残留通常会极大地影响产品合格率,是完全不可接受的。
发明内容
本发明解决的技术问题是提供一种抑制多晶硅针孔的PBL工艺方法,它可以有效避免多晶硅回刻时造成硅表面的缺陷,保证超快闪存储器/嵌入式超快闪存储器的性能。
为解决上述技术问题,本发明所述的抑制多晶硅针孔的PBL工艺方法是,取消现有工艺方法中的原第10步骤湿法表面二氧化硅去除,将原第11步骤的等离子体多晶硅刻蚀改为两步刻蚀工艺,首先采用低选择比的干法等离子体刻蚀条件去除多晶硅表面二氧化硅,然后再采用高选择比的干法等离子体刻蚀条件回刻多晶硅。
本发明所述的抑制多晶硅针孔的PBL工艺方法,采用干法等离子体刻蚀技术去除表面二氧化硅.由于等离子体刻蚀的微负载效应,即使多晶硅有针孔,等离子体对针孔底部的二氧化硅刻蚀基本可以忽略.所以,多晶硅回刻时也就不会造成硅表面缺陷.
附图说明
图1是现有的PBL工艺方法流程图:
图2是本发明抑制多晶硅针孔的PBL工艺方法流程图。
具体实施方式
如图2所示,本发明所述的一种抑制多晶硅针孔的PBL工艺方法,包括如下步骤:1、硅衬底投入,2、热二氧化硅成长,3、多晶硅成长,4、氮化硅成长,5、场隔离光刻,6、等离子体氮化硅刻蚀,7、湿法去除光刻胶,8、场氧化,9、氮化硅热磷酸去除,1O、首先采用低选择比的干法等离子体刻蚀条件去除多晶硅表面二氧化硅,然后再采用高选择比的干法等离子体刻蚀条件回刻多晶硅。
所述低选择比或高选择比的干法等离子体刻蚀条件是指多晶硅相对二氧化硅刻蚀速率比。
本发明采取干法等离子体刻蚀技术去除氧化过成中产生的一层介于氮化硅层和缓冲多晶硅层之间的薄二氧化硅(SiO2)层。对于保证超快闪存储器/嵌入式超快闪存储器的性能(如数据保持性)及整个制作工艺可生产性十分重要。
Claims (1)
1.一种抑制多晶硅针孔的多晶硅层缓冲局部场氧化硅工艺方法,包括如下步骤:
步骤一、硅衬底投入;
步骤二、热二氧化硅成长;
步骤三、多晶硅成长;
步骤四、氮化硅成长;
步骤五、场隔离光刻;
步骤六、等离子体氮化硅刻蚀;
步骤七、湿法去除光刻胶;
步骤八、场氧化;
步骤九、氮化硅热磷酸去除;其特征在于:还包括,
步骤十、首先采用低选择比的干法等离子体刻蚀条件去除多晶硅表面的二氧化硅,然后再采用高选择比的干法等离子体刻蚀条件回刻多晶硅。
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