CN117561566A - 显示设备 - Google Patents

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Abstract

像素阵列单元(10)由包括发光元件和使发光元件发光的像素电路并且按二维矩阵布置的多个像素构成。数据线(70)被布置用于像素阵列单元(10)中的每一列，并且传输像素的图像信号。第一像素组(121)由布置在多个相邻行中的像素构成。第二像素组(122)由布置在多个相邻行中的像素构成，并且与第一像素组(122)相邻地被布置。在第一像素组(121)的各像素中，图像信号经由数据线(70)对于每个列被共同地传输，并且在第二像素组的像素(122)中，图像信号经由与将图像信号传输到第一像素组(121)的数据线不同的数据线对于每个列被共同地传输。

Description

显示设备
技术领域
本公开涉及显示设备。
背景技术
使用了一种显示设备，其中包括有机电致发光(EL)显示元件的像素被布置成二维矩阵。该有机EL显示元件是自发光显示元件，具有比液晶面板更高的画质和更高的响应速度之类的优点。作为这种显示设备，已经提出了一种显示面板，其中，对于以二维矩阵布置的像素中的每两个像素行布置用于传输控制信号的信号线，并且在这两行中布置的两个像素作为一个像素被驱动(例如，参见专利文献1)。在该显示面板中，图像信号被分别输入到两个像素，从而执行高灰度级显示。
引文列表
专利文献
专利文献1：JP 2011-128442A
发明内容
技术问题
然而，在上述现有技术中，由于一行的图像由两行中的像素显示，因此存在显示设备的配置复杂的问题。
因此，本公开提出了一种具有简化配置的显示设备。
针对问题的解决方案
根据本公开的显示设备包括：一种显示设备，包括：像素阵列单元，由包括发光元件和使发光元件发光的像素电路并且按二维矩阵布置的多个像素构成；多条数据线，针对像素阵列单元中的每列布置所述多条数据线，并且所述多条数据线传输像素的图像信号；由布置在多个相邻行中的像素构成的第一像素组；以及由布置在多个相邻行中的像素构成并且与第一像素组相邻布置的第二像素组；其中在第一像素组的各像素中，经由数据线对于每列共同地传输图像信号，并且在第二像素组的各像素中，经由与将图像信号传输到第一像素组的数据线不同的数据线，对于每列共同地传输图像信号。
附图说明
图1是示出根据本公开的第一实施例的显示设备的配置示例的图。
图2是示出根据本公开第一实施例的像素的配置示例的图。
图3是示出根据本公开第一实施例的驱动像素的方法的示例的图。
图4是示出根据本公开第一实施例的像素阵列单元的配置示例的图。
图5A为示出根据本公开第一实施例的显示方法示例的图。
图5B为示出根据本公开第一实施例的显示方法示例的图。
图6A为示出根据本公开第一实施例的显示方法的另一示例的图。
图6B为示出根据本公开第一实施例的显示方法的另一示例的图。
图7是示出根据本公开的第二实施例的像素阵列单元的配置示例的图。
图8是示出根据本公开第二实施例的像素阵列单元的配置示例的图。
图9是示出根据本公开第二实施例的像素阵列单元的配置示例的图。
图10为根据本公开第二实施例的显示方法示例的图。
图11是示出根据本公开第三实施例的像素的配置示例的图。
图12是示出根据本公开第三实施例的像素阵列单元的配置示例的图。
图13是示出根据本公开第四实施例的水平驱动单元的配置示例的图。
图14是示出根据本公开实施例的修改的像素的配置示例的图。
图15是示出根据本公开实施例的修改的像素的配置示例的图。
图16是示出根据本公开实施例的修改的像素的配置示例的图。
图17是示出根据本公开实施例的修改的像素的配置示例的图。
图18是示出根据本公开实施例的修改的像素的配置示例的图。
图19是示出根据本公开实施例的修改的像素的配置示例的图。
图20是示出根据本公开实施例的显示设备的水平驱动单元的配置示例的图。
图21是示出根据本公开实施例的显示设备的水平驱动单元的另一配置示例的图。
图22是示出根据本公开实施例的显示设备的水平驱动单元的另一配置示例的图。
图23是示出根据本公开实施例的显示设备的水平驱动单元的操作示例的图。
具体实施方式
以下，参照附图对本公开的实施例进行详细说明。按照以下顺序进行解释。注意，在下面说明的实施例中，通过用相同的附图标记表示相同的部分，省略了冗余的说明。
1.第一实施例
2.第二实施例
3.第三实施例
4.第四实施例
5.修改
6.水平驱动单元的配置示例
(1.第一实施例)
[显示设备的配置]
图1是示出根据本公开的第一实施例的显示设备的配置示例的图。图1是示出显示设备1的配置示例的框图。显示设备1是基于从外部设备输入的图像数据来显示图像的设备。显示设备1包括像素阵列单元10、垂直驱动单元20和水平驱动单元30。
通过布置多个像素100来配置像素阵列单元10。图中的像素阵列单元10示出了其中多个像素100以二维矩阵的形状排列的示例。这里，像素100包括发光元件和像素电路，该像素电路使发光元件发光并以与输入图像信号相对应的亮度发光。对于这种发光元件，例如，可以使用有机EL元件。像素100可被配置为照射具有红光、绿光和蓝光的波长的光。图中的像素100的“R”、“G”和“B”表示由各个像素100发射的光的波长。
行信号线60和数据线70(70a和70b)被布线到各个像素100。行信号线60传输像素电路的控制信号。数据线70传输图像信号。注意，行信号线60针对具有二维矩阵形状的各行而布置，并且对于布置在一行中的多个像素100被共同布线。数据线70针对二维矩阵的形状的每列布置，并且对于布置在一列中的多个像素100被共同地布线。注意，在图中的显示设备1中，数据线70被布线为对于包括在一列中布置的多个像素100中的同一像素组中的像素100是公共的。下面说明数据线70和像素组。
垂直驱动单元20产生用于上述像素100的控制信号。图中的垂直驱动单元20为像素阵列单元10的二维矩阵的每行产生控制信号，并经由行信号线60顺序地输出控制信号。
水平驱动单元30生成用于像素100的图像信号，并将生成的图像信号输出到像素100。图中的水平驱动单元30经由数据线70输出像素阵列单元10的每一列的图像信号。注意，图像信号也被称为视频信号或亮度信号。注意，水平驱动单元30是图像信号生成单元的示例。
[像素的配置]
图2是示出根据本公开第一实施例的像素的配置示例的图。该图是示出像素100的配置示例的电路图。像素100包括发光元件101、驱动晶体管103、采样晶体管102、发光控制晶体管104、开关晶体管105、保持电容器107和辅助电容器108。p沟道MOS晶体管可以用作驱动晶体管103、采样晶体管102、发光控制晶体管104和开关晶体管105。作为p沟道MOS晶体管，可以使用包括背栅的MOS晶体管。在这种情况下，背栅可以连接到下面解释的电源线Vccp。注意，可以通过向栅极施加超过阈值电压Vth的栅极-源极电压Vgs来使MOS晶体管导通。用于使MOS晶体管进入导通状态的栅极-源极电压Vgs被称为ON电压。在p沟道MOS晶体管中，施加于栅极的ON电压为源极的低电压。
信号线WS、信号线AZ、信号线DS和信号线Data(数据)被布线到像素100。信号线WS、信号线AZ和信号线DS构成了上述行信号线60。信号线Data构成上述数据线70。电源线Vccp、电源线Vss和电源线Vcath进一步被布线到像素100。
发光元件101的阴极连接到电源线Vcath，发光元件101的阳极连接到驱动晶体管103的漏极和开关晶体管105的漏极。开关晶体管105的源极连接到电源线Vss，并且开关晶体管105的栅极连接到信号线AZ。驱动晶体管103的栅极连接到采样晶体管102的漏极和保持电容器107的一端。保持电容器的另一端连接到驱动晶体管103的源极、发光控制晶体管104的漏极和辅助电容器108的一端。辅助电容器108的另一端连接到电源线Vccp。发光控制晶体管104的源极连接到电源线Vccp，发光控制晶体管104的栅极连接到信号线DS。采样晶体管102的源极连接到信号线Data，采样晶体管102的栅极连接到信号线WS。
注意，由像素100的驱动晶体管103、采样晶体管102、发光控制晶体管104、开关晶体管105、保持电容器107和辅助电容器108构成的电路构成像素电路。也就是说，像素100中除发光元件101之外的电路构成像素电路。该像素电路是通过向发光元件101施加电流来驱动发光元件101的电路。
作为发光元件101，例如，可以使用有机EL元件。发光元件101照射具有与流动的电流对应的亮度的光。
驱动晶体管103是向发光元件101馈送电流并驱动发光元件101的晶体管。
采样晶体管102对由信号线Data传输的图像信号进行采样，从而将图像信号写入驱动晶体管103的栅极节点(栅电极)。注意，这里的表述“写入”表示图像信号电压被施加到栅极节点，并且栅极节点的电势被保持在基于图像信号电压的电势。采样晶体管102由信号线WS所传输的控制信号控制。
发光控制晶体管104是控制发光元件101的发光和不发光的晶体管。发光控制晶体管104由信号线DS传输的发光控制信号控制。
开关晶体管105是控制发光元件101在发光元件101的非发光时段期间不发光的晶体管。开关晶体管105由信号线AZ传输的控制信号控制。当开关晶体管105进入导通状态时，形成绕过发光元件101的路径，并且停止发光元件101的发光。
保持电容器107是保持通过采样晶体管102的采样而写入的图像信号电压Vsig的电容器。驱动晶体管103通过将与保持电容器107的保持电压对应的驱动电流馈送到发光元件101来驱动发光元件101。
辅助电容器108防止驱动晶体管103的源极电压在图像信号电压Vsig被写入时波动。辅助电容器108具有将驱动晶体管103的栅极-源极电压Vgs设置为驱动晶体管103的阈值电压Vth的动作。
[驱动方法]
图3为示出根据本公开第一实施例的像素驱动方法的图。图3是示出驱动像素100中的发光元件101的方法的示例的时序图。图中的“DS”、“WS”和“AZ”分别表示通过信号线DS、信号线WS和信号线AZ传输的控制信号。这些二元化的控制信号的值“0”的部分表示上述ON电压。另一方面，值“1”的部分表示OFF电压。图中的“数据”表示由信号线Data传输的图像信号电压Vsig和参考电压Vofs。图中的“Vsig”和“Vofs”表示施加了图像信号电压Vsig、基准电压Vofs的部分。图中的“Vs”和“Vg”表示驱动晶体管103的源极电压和栅极电压Vg。
在初始状态中，导通电压被施加到信号线DS，并且发光控制晶体管104进入导通状态。另一方面，OFF电压被施加到信号线WS和信号线AZ。参考电压Vofs被施加到信号线Data。
在T11，导通电压被施加到信号线AZ，开关晶体管105进入导通状态。因此，流到驱动晶体管103的电流经由开关晶体管105流入电源线Vss。
在T12，导通电压被施加到信号线WS，并且采样晶体管102进入导通状态。此时，由于发光控制晶体管104处于导通状态，所以电源电压Vccp被施加到驱动晶体管103的源极节点。参考电压Vofs经由采样晶体管102被写入驱动晶体管103的栅极节点。
在T13，停止向信号线WS施加ON电压，并且采样晶体管102进入非导通状态。因此，参考电压Vofs的写入结束。通过写入参考电压Vofs，电流流到驱动晶体管103。该电流经由开关晶体管105流入电源线Vss。因此，发光元件101不发光。
在T14，停止向信号线DS施加ON(导通)电压，并且发光控制晶体管Tr3进入非导通状态。因此，驱动晶体管103的源极节点进入浮置状态。即，在驱动晶体管103的栅极节点中写入基准电压Vofs之后，驱动晶体管103的栅极节点然后源极节点依次进入浮置状态。图像信号电压Vsig被施加到信号线Data。
然后，由于驱动晶体管103的栅极节点和源极节点都进入浮置状态，所以执行自放电操作。自放电操作中的节点的电位的放电通过驱动晶体管103、开关晶体管105以及电流放电目的地节点Vini的路径进行。然后，驱动晶体管103的源极电压Vs和栅极电压Vg两者根据自放电操作逐渐减小。在自放电操作中，基本上，驱动晶体管103的源极电压Vs和栅极电压Vg降低，同时保持栅极-源极电压Vgs。
在T16，ON电压被施加到信号线WS，并且采样晶体管102进入导通状态。因此，在驱动晶体管103的源极节点保持在浮置状态的同时，通过采样晶体管102的采样写入信号电压Vsig＝Vccp。注意，电位Vccp表示电源电压Vcc的电位。
在T17，完成对图像信号电压Vsig的写入操作。因此，驱动晶体管103的源极电压Vs被固定为电源电压Vccp(非浮置状态)。此时，驱动晶体管103的栅极电压Vg根据自举操作而上升。
在T18，ON电压被施加到信号线DS，并且发光控制晶体管104进入导通状态。发光控制晶体管104的栅极电压Vg下降，并且驱动晶体管103的栅极电压Vg变得低于源极电压Vs。
在T19，停止向信号线AZ施加ON电压，开关晶体管105进入非导通状态。因此，驱动电流流到发光元件101，并且发光元件101开始发光。此后，在T20，停止向信号线Data施加图像信号电压Vsig。
[像素阵列单元的配置]
图4是示出根据本公开第一实施例的像素阵列单元的配置示例的图。该图是示出像素阵列单元10的配置示例的图。在该图中，没有示出行信号线60。注意，在图中示出了水平驱动单元31和32。水平驱动单元31生成用于在图中布置在像素阵列单元10的上侧并且布置在以下说明的第一像素组121中的像素100的图像信号。水平驱动单元32为布置在像素阵列单元10的相对于水平驱动单元31的相反侧并且布置在下面说明的第二像素组122中的像素100产生图像信号。像素阵列单元10的像素100被布置在第一像素组121或第二像素组122中。注意，水平驱动单元31是第一图像信号生成单元的示例。水平驱动单元32是第二图像信号生成单元的示例。
第一像素组121由布置在像素阵列单元10的多个行中的像素100构成。图像信号经由数据线70a传输到图中的第一像素组121的像素100。图中的数据线70a连接到水平驱动单元31，并且传输由水平驱动单元31产生的图像信号。
第二像素组122由与第一像素组121相邻的布置在多个行中的像素100构成。图像信号经由不同于数据线70a的数据线70b传输到图中的第二像素组122的像素100。图中的数据线70b连接到水平驱动单元32，并且传输由水平驱动单元32生成的图像信号。
示出了其中图中的第一像素组121和第二像素组122分别由像素阵列单元10中的布置成两行的像素100构成的示例。图中的第一像素组121和第二像素组122表示其中第一像素组121和第二像素组122由像素阵列单元10的布置成多个相邻行的像素100构成的示例。
图中的像素阵列单元10示出第一像素组121和第二像素组122交替布置的示例。数据线70a共同连接到多个第一像素组121的像素100，数据线70b共同连接到多个第二像素组122的像素100。
[图像显示示例]
图5A为示出根据本公开第一实施例的显示方法示例的图。该图是示出在显示设备1中显示图像的方法的示例的图，并且是示出帧的配置的视图。这里，帧表示由像素阵列单元10显示的图像的单位。图中的帧300由多个行中的每一行的图像构成。图中的矩形表示每一行的图像。图中加到矩形上的数字表示输入到显示设备1的图像数据的行号，图中诸如“第一行”之类的描述对应于像素阵列单元10中的行。图中的帧300表示输入图像数据和在像素阵列单元10的像素100上显示的图像以行为单位一致的示例。这种显示方法被称为行顺序方法。
图5B为示出根据本公开第一示例性实施例的显示方法示例的图。该图是示出在显示设备1中显示图像的方法的示例的图，并且是示出图像信号和驱动信号的时序图。参照图5解释用于显示图5A中的帧300的过程。
在图中，“水平同步信号”表示作为指示一行的图像的定界符的信号的水平同步信号的波形。时间序列中的水平同步信号的时段由诸如“H1”之类的描述来标识。“水平驱动单元31”和“水平驱动单元32”分别表示从水平驱动单元31和水平驱动单元32输出的图像信号。“水平驱动单元31”和“水平驱动单元32”中的矩形区域表示图像信号。添加到矩形的数字表示图像数据的行号。“WS”表示信号线WS的控制信号的波形。注意，括号中的数字表示像素阵列单元10的行号。“数据”表示经由信号线Data在像素100的像素电路中捕获的图像信号。“数据”中的矩形区域表示图像信号。添加到矩形的数字表示图像数据的行号。括号中的数字表示像素阵列单元10的行号。注意，没有示出除了信号线WS的控制信号之外的控制信号。
首先，在H1和H2的时段中，从水平驱动单元31输出第一行的图像数据的图像信号。该图像信号经由数据线70a被传输到像素阵列单元10的第一行的像素100。在H2时段中该图像信号被写入驱动晶体管103中。
接着，在H3和H4时段中，从水平驱动单元31输出第二行图像数据的图像信号，从水平驱动单元32输出第三行图像数据的图像信号。这些图像信号分别通过数据线70a和70b传输到像素阵列单元10的第二行中的像素100和第三行中的像素100。这些图像信号在H4时段期间分别写入驱动晶体管103。
接着，在H5和H6时段中，从水平驱动单元31输出第五行图像数据的图像信号，从水平驱动单元32输出第四行图像数据的图像信号。这些图像信号经由数据线70a和70b传输到像素阵列单元10的第五行中的像素100和第四行中的像素100。在H6时段期间，这些图像信号被写入驱动晶体管103中。
接着，在H7和H8时段中，从水平驱动单元31输出第六行图像数据的图像信号，从水平驱动单元32输出第七行图像数据的图像信号。这些图像信号分别经由数据线70a和70b传输到像素阵列单元10的第六行中的像素100和第七行中的像素100。这些图像信号在H8时段中分别被写入驱动晶体管103。
此后，以相同的过程从水平驱动单元31和32输出图像信号并将其发送到像素100。因此，可以显示图5A中所示的帧300。
[图像显示的另一示例]
图6A为示出根据本公开第一实施例的显示方法的另一示例的图。如同图5A，此图是示出在显示设备1中显示图像的方法的示例的图。图6A中的显示方法与图5A中的显示方法的不同在于帧300被分割为两个子帧。
在图中所示的方法中，帧300被分割为子帧310和子帧320。在子帧310中，帧300的奇数行中的图像分别被布置在两行中。具体地，帧300的第一行中的图像被布置在子帧310的第一行和第二行中，并且帧300的第三行中的图像被布置在子帧310的第三行和第四行中。在子帧320中，帧300的偶数行中的图像数据分别被布置在两行中。具体地，帧300的第二行中的图像被布置在子帧320的第一行和第二行中，并且帧300的第四行中的图像被布置在子帧320的第三行和第四行中。可以通过在显示设备1上交替显示子帧310和320来显示输入图像数据。
帧平均值330是人在视觉上识别的帧，是由子帧310和320的同一行中排列的图像的平均值构成的图像。图中的方法是这样的显示方法，即，尽管分辨率减半，但是与图5A中的线顺序方法相比，可以提高运动图像的显示的响应速度。
图6B为示出根据本公开第一实施例的显示方法的另一示例的图。与图5B相同，该图是示出显示设备1中的图像显示方法的示例的图，并且是示出图像信号和驱动信号的时序图。注意，在图中，信号线WS的波形没有进一步示出。参考附图解释用于显示图6A中的子帧310的过程。
首先，在H1和H2时段中，从水平驱动单元31输出第一行的图像数据的图像信号。该图像信号经由数据线70a被传输到像素阵列单元10的第一行和第二行的像素100。在H2时段中该图像信号被写入驱动晶体管103。
接着，在H2和H3时段中，从水平驱动单元32输出第三行图像数据中的图像信号。该图像信号经由数据线70b传输到像素阵列单元10的第三行和第四行中的像素100。在H3时段期间，该图像信号被写入驱动晶体管103。
接着，在H3和H4时段期间，从水平驱动单元31输出图像数据的第五行中的图像信号。该图像信号经由数据线70a传输到像素阵列单元10的第五行和第六行中的像素100。在H2时段中，该图像信号被写入驱动晶体管103。
接着，在H4和H5时段中，从水平驱动单元32输出图像数据的第七行中的图像信号。该图像信号经由数据线70b传输到像素阵列单元10的第三行和第四行中的像素100。在H3时段期间，该图像信号被写入驱动晶体管103。
此后，以相同的过程从水平驱动单元31和32输出图像信号并将其传输到像素100。因此，可以显示图6A中所示的子帧310。
同样在子帧320中，图像数据的偶数行中的图像信号可以交替地从水平驱动单元31和32输出，并且通过与图6B中的过程相同的过程产生。通过交替地生成和显示子帧310和320，可以执行图6A中所示的显示。
如图4所示，在根据本公开第一实施例的显示设备1中，像素阵列单元10的像素100被布置为被分割为第一像素组121和第二像素组122，并且针对每个像素组传输图像信号。因此，图像信号可以同时传输到布置在同一像素组中的多个行中的像素100。在根据本公开第一实施例的显示设备1中，数据线70a和70b分别用于第一像素组121和第二像素组122以传输图像信号。因此，图像信号可以同时传输到第一像素组121和第二像素组122。因此，在图6A所示的显示方法中，可以高速传输图像信号，并且可以提高帧速率。
如上所述，根据本公开第一实施例的显示设备1利用像素阵列单元10的一行中的像素100显示一行的图像。因此，可以简化显示设备1的配置。在根据本公开的第一实施例的显示设备1中，像素阵列单元10的像素100被布置为被分割成第一像素组121和第二像素组122，并且数据线70a和70b被布置为针对每个像素组分别传输图像信号。因此，除了线顺序方法之外，可以应用用于交替地重复包括图像数据的奇数行的图像的子帧310和包括图像数据的偶数行的图像的子帧320的显示方法。在交替重复子帧310和子帧320的显示方法中，可以高速地将图像信号传输到像素100。
(2.第二实施例)
在上述第一实施例的显示设备1中，数据线70a和70b分别连接到第一像素组121的像素100和第二像素组122的像素100。相对照，根据本公开第二实施例的显示设备1与上述第一实施例的不同之处在于，选择用于传输图像信号的信号线，并且将图像信号传输到第一像素组121的像素100和第二像素组122的像素100。
[像素阵列单元的配置]
图7是示出根据本公开的第二实施例的像素阵列单元的配置示例的图。与图4相同，该图是示出像素阵列单元10的配置示例的图。该图中的像素阵列单元10与图4中的像素阵列单元10的不同之处在于，还包括第二数据线71至74以及开关元件201至204和211至214。
第二数据线71至74是分别连接到第一像素组121和第二像素组122这两个像素组的行的数据线。在图中的像素阵列单元10中，第二数据线71连接到第一行中的像素100，第二数据线72连接到第二行中的像素100，第二数据线73连接到第三行中的像素100，并且第二数据线74连接到第四行中的像素100。随后，第二数据线71至74周期性地连接到第一像素组121和第二像素组122的每个行数(图中为4行)的像素100。
开关元件201至204和开关元件211至214设置在第二数据线71至74的两端处。这些开关元件可由例如MOS晶体管构成。开关元件201连接于数据线70a与第二数据线71之间，开关元件202连接于数据线70a与第二数据线72之间。开关元件203连接于数据线70a与第二数据线73之间，开关元件204连接于数据线70a与第二数据线74之间。开关元件211连接于数据线70b与第二数据线71之间，开关元件212连接于数据线70b与第二数据线72之间。开关元件213连接于数据线70b与第二数据线73之间，开关元件214连接于数据线70b与第二数据线74之间。
通过切换开关元件201至204的导通和不导通，可以选择第二数据线71至74中的任何一个并连接到数据线70a。通过切换开关元件211至214的导通和不导通，可以选择第二数据线71至74中的任何一个并连接到数据线70b。在以下说明中，开关元件201至204被称为第二数据线选择单元200。开关元件211至214被称为第二数据线选择单元210。第一像素组121和第二像素组122的布置可以通过改变第二数据线选择单元200和210中的第二数据线的选择来切换。这将参照图8和图9进行解释。
图8是示出根据本公开第二实施例的像素阵列单元的配置示例的图。图8是示出像素阵列单元10中的第二数据线选择单元200和210的选择状态的示例的图。在该图中的像素阵列单元10中，假定连接到第二数据线71和72的像素100为包括在第一像素组121中的像素100。假定连接到第二数据线73和74的像素100是包括在第二像素组122中的像素100。
在这种情况下，第二数据线选择单元200的开关元件201和202进入导通状态，并且第二数据线选择单元200的开关元件203和204进入非导通状态。开关元件213和214进入导通状态，并且第二数据线选择单元210的开关元件211和212进入非导通状态。因此，像素阵列单元10的第一行和第二行中的像素100可以布置在第一像素组121中，并且像素阵列单元10的第三行和第四行中的像素100可以布置在第二像素组122中。
图9是示出根据本公开第二实施例的像素阵列单元的配置示例的图。该图是用于说明像素阵列单元10中的第二数据线选择单元200和210的选择状态的另一示例的图。在该图中的像素阵列单元10中，假定连接到第二数据线71和74的像素100为包括在第一像素组121中的像素100。假定连接到第二数据线72和73的像素100是包括在第二像素组122中的像素100。
在这种情况下，第二数据线选择单元200的开关元件201和204进入导通状态，并且第二数据线选择单元200的开关元件202和203进入非导通状态。第二数据线选择单元210的开关元件212和213进入导通状态，并且第二数据线选择单元210的开关元件211和214进入非导通状态。因此，像素阵列单元10的第一行和第四行中的像素100可以被布置在第一像素组121中，并且像素阵列单元10的第二行和第三行中的像素100可以被布置在第二像素组122中。
在图8和图9的像素阵列单元10中，可以应用用于交替重复参照图6A解释的子帧310和子帧320的显示方法。
通过以这种方式改变第二数据线选择单元200和210中的第二数据线71至74的选择，可以改变第一像素组121和第二像素组122的布置。
还可以使用交替地重复图8中的第二数据线选择单元200和210中的第二数据线的选择和图9中的第二数据线选择单元200和210中的第二数据线的选择的显示方法。参照图10说明这种情况下的显示方法。
[图像显示示例]
图10为示出根据本公开第二实施例的显示方法的示例的图。与图5A相似，该图是示出在显示设备1中显示图像的方法的示例的图。图10中的显示方法与图6A中的显示方法的不同之处在于，构成子帧320的偶数行中的图像的排列位置偏移一行。
该图中的子帧310可以通过采用图8中所示的第二数据线选择单元200和210中的第二数据线的选择来显示。该图中的子帧320可以通过采用图9中所示的第二数据线选择单元200和210中的第二数据线的选择来显示。在这种情况下，子帧320由偶数行中的图像构成，除了奇数行中的图像被布置在第一行中。
帧平均值330是除了第一行之外具有不同组合的行的平均值。与图6A所示的显示方法相比，可以获得具有高分辨率的图像。
注意，当应用参考图5A解释的线顺序方法时，第二数据线选择单元200的开关元件201和203进入导通状态，并且第二数据线选择单元200的开关元件202和204进入非导通状态。第二数据线选择单元210的开关元件212和214进入导通状态，第二数据线选择单元210的开关元件211和213进入非导通状态。
除此之外的显示设备1的配置类似于本公开的第一实施例中的显示设备1的配置。因此，省略对配置的解释。
如上所述，在根据本公开第二实施例的显示设备1中，设置第二数据线选择单元200和210，并且选择连接到第一像素组121和第二像素组122的像素100的第二数据线71至74。因此，用于交替地重复子帧310和子帧320的线顺序方法和显示方法可以应用于像素阵列单元10中。也可以应用用于在子帧310和子帧320中切换布置在第一像素组121和第二像素组122中的行的显示方法。因此，可以提高显示设备1的便利性。
(3.第三实施例)
在上述第二实施例的显示设备1中，设置了第二数据线选择单元200和210。相对照，根据本公开的第三实施例的显示设备1与上述第二实施例的不同之处在于，显示设备1包括选择用于像素100中的每一个的数据线的选择单元(像素输入信号选择单元)。
[像素的配置]
图11是示出根据本公开第三实施例的像素的配置示例的图。与图2类似，该图是示出像素100的配置示例的电路图。图中的像素100与图2中的像素100的不同之处在于还设置了采样晶体管106。采样晶体管106可以由p沟道MOS晶体管配置。在图中，信号线Data1和信号线Data2被布线到像素100。信号线Data1连接至数据线70a，而信号线Data2连接至数据线70b。采样晶体管106的漏极连接到采样晶体管102的漏极。采样晶体管106的源极连接到信号线Data2。采样晶体管106的栅极连接到信号线WS2。注意，采样晶体管102的源极连接到信号线Data1，采样晶体管102的栅极连接到信号线WS1。由于除了上述之外的电路的连接与图2中的电路的连接类似，因此省略对连接的解释。
通过将控制信号施加到信号线WS1和WS2之一，可以选择用于采样图像信号的采样晶体管102和106。当选择采样晶体管102时，对由数据线70a传输的图像信号进行采样并将其写入驱动晶体管103。在这种情况下的像素100被包括在第一像素组121中。另一方面，当选择采样晶体管106时，由数据线70b传输的图像信号被采样并写入驱动晶体管103中。在这种情况下的像素100被包括在第二像素组122中。注意，采样晶体管102和106是像素输入信号选择单元的示例。图中的数据线70a是第一像素组数据线的示例。图中的数据线70b是第二像素组数据线的示例。
[像素阵列单元的配置]
图12是示出根据本公开第三实施例的像素阵列单元的配置示例的图。与图4相同，该图是示出像素阵列单元10的配置示例的图。该图中的像素阵列单元10与图4中的像素阵列单元10的不同之处在于，布置了图11中的像素100。
在图中的像素100中，简化并示出了采样晶体管102和106。如图所示，图像信号经由数据线70a从水平驱动单元31传输到第一行和第二行中的像素100，其使得采样晶体管102在采样时导通。第一行和第二行中的像素100被包括在第一像素组121中。图像信号经由数据线70b从水平驱动单元32传输到第三行和第四行中的像素100，其使得采样晶体管102在采样时导通。第三行和第四行中的像素100被包括在第二像素组122中。
如上所述，图中的像素100可以通过切换采样晶体管102和106的导通和非导通状态来选择数据线70a和数据线70b之一。因此，可以选择第一像素组121的图像信号或第二像素组122的图像信号中的一个。
除此之外的显示设备1的配置类似于本公开的第一实施例中的显示设备1的配置。因此，省略对配置的解释。
如上所述，根据本公开第三示例性实施例的显示设备1可为像素100选择数据线70a和70b。可以提高显示设备1的便利性。
(4.第四实施例)
在上述第一实施例的显示设备1中，水平驱动单元31和32分别设置在像素阵列单元10的不同侧。相对照，根据本公开第四实施例的显示设备1与上述第一实施例的不同之处在于，水平驱动单元31和32设置在像素阵列单元10的同一侧。
[水平驱动单元的配置]
图13是示出根据本公开第四实施例的水平驱动单元的配置示例的图。该图是示出水平驱动单元31和32的设置示例的图。该图中的水平驱动单元31和32与图4中的水平驱动单元31和32的不同之处在于，该图中的水平驱动单元31和32被设置在像素阵列单元10的同一侧。
除此之外的显示设备1的配置类似于本公开的第一实施例中的显示设备1的配置。因此，省略对配置的解释。
(5.修改)
上述第一实施例中的显示设备1包括具有四个晶体管的像素100。然而，也可以应用具有其它配置的像素100。
[像素的配置]
图14至图19是示出根据本公开实施例的修改示例的像素的配置示例的图。图14中的像素100表示省略了图2中的像素100中的发光控制晶体管104、开关晶体管105和辅助电容器108的情况下的示例。图中的采样晶体管102和驱动晶体管103由n沟道MOS晶体管构成。
图15中的像素100是其中图2中的像素100的p沟道MOS晶体管被改变为n沟道MOS晶体管的示例。注意，在图中的像素100中，辅助电容器108可以省略。
图16中的像素100表示其中由p沟道MOS晶体管构成的采样晶体管401并联连接到由n沟道MOS晶体管构成的采样晶体管102的情况下的示例。
图17中的像素100表示使用两个开关晶体管的情况下的示例。
图18中的像素100表示使用两个开关晶体管和两个采样晶体管的情况下的示例。
图19中的像素100示出了通过设置在驱动晶体管103的栅极和漏极之间的MOS晶体管407和408、发光控制晶体管409和开关晶体管105将电压施加到保持电容器107的情况下的示例。
如上所述，各种像素100(像素电路)可以应用于显示设备1。
(6.水平驱动单元的配置示例)
说明可应用于第一实施例中的显示设备1的水平驱动单元31的配置。
[水平驱动单元的配置]
图20是示出根据本公开的实施例中的显示设备的水平驱动单元的配置示例的图。该图是示出参考图4说明的水平驱动单元31的配置示例的框图。水平驱动单元31基于从主机设备输入的图像数据产生图像信号，并将图像信号输出到像素阵列单元10。如参照图5B所解释的，水平驱动单元31顺序地输出一行的图像信号。从主机设备输入的图像数据由数字图像信号构成。水平驱动单元31将数字图像信号转换成模拟图像信号，并输出该模拟图像信号。图中的水平驱动单元31包括用于每一列的DAC 39和放大器电路38。
DAC 39执行数模转换。图中的DAC 39将数字图像信号转换成模拟图像信号，并将模拟图像信号输出到放大器电路38。
放大器电路38是放大从DAC 39输出的模拟图像信号的电路。图中的放大器电路38被配置在电压跟随器电路中，并且执行模拟图像信号的电流放大。放大器电路38将放大的模拟图像信号输出到数据线70a。注意，水平驱动单元32也可以采用与水平驱动单元31相同的配置。
[水平驱动单元的另一配置]
图21是示出根据本公开实施例的显示设备的水平驱动单元的另一配置示例的图。该图是示出水平驱动单元31和32的配置示例的图。在图中进一步示出了斜坡信号生成电路34以及放大器电路35a和35b。
斜坡信号生成电路34是生成斜坡信号的电路。斜坡信号生成电路34将生成的斜坡信号输出到放大器电路35a和放大器电路38b。
放大器电路35a和35b等效于缓冲放大器，并且分别向水平驱动单元31和32输出输入斜坡信号。
水平驱动单元31和32分别包括用于每一列的PWM 37和开关元件36。
PWM 37从数字图像信号产生PWM(脉冲宽度调制)信号。PWM信号是具有恒定周期的脉冲信号，并且是具有与数字图像信号相对应的脉冲宽度的信号。PWM信号是具有与数字图像信号对应的占用比的脉冲信号。
开关元件36基于从PWM 37输出的PWM信号，开闭放大器电路35a的输出信号线和数据线70(数据线70a)。开关元件36在施加PWM信号的脉冲的时段中，将从放大器电路35a输入的斜坡信号输出到数据线70a。对于开关元件36，例如，可以使用MOS晶体管。
如图4所示，图中所示的水平驱动单元31和32可以应用于分别布置在像素阵列单元10上方和下方的水平驱动单元31和32。
图22是示出根据本公开实施例的显示设备的水平驱动单元的另一配置示例的图。与图21类似，该图是示出水平驱动单元31和32的配置示例的图。图中的电路与图21中的电路的不同之处在于包括一个放大器电路35。图中的放大器电路35将放大的斜坡信号提供给水平驱动单元31和32。
如图13所示，图中所示的水平驱动单元31和32可应用于设置在像素阵列单元10的一侧的水平驱动单元31和32。
[水平驱动单元的操作]
图23是示出根据本公开实施例的显示设备的水平驱动单元的操作示例的图。该图是示出图21和图22中的水平驱动单元31和32的操作示例的时序图。图中的“斜坡信号”表示从斜坡信号生成电路34输出的斜坡信号的波形。“PWM 31”和“PWM 32”分别表示水平驱动单元31的PWM信号和水平驱动单元32的PWM信号。除此以外，使用与图5B共同的描述。
斜坡信号生成电路34以两个水平同步信号为周期重复输出电压以斜坡形状降低的斜坡信号。水平驱动单元31和水平驱动单元32中的每一个的PWM 37输出与斜坡信号同步的PWM信号。如“PWM 31”和“PWM 32”的波形所示，这些PWM信号是具有与PWM信号的模拟图像信号相对应的脉冲宽度(图中的值“1”的时段)的信号。在PWM信号的值为“1”的时段中，开关元件36导通，且斜波信号被输出至数据线70。输出至数据线70的斜波信号为输入至像素100的图像信号。当PWM信号的脉冲宽度较宽时，具有较低电压的斜坡信号被输出作为图像信号。
如图所示，水平驱动单元31和水平驱动单元32中的每一个的PWM 37单独地输出PWM信号以控制开关元件36，并且输出水平驱动单元31和水平驱动单元32中的每一个的图像信号。因此，可以在水平驱动单元31和水平驱动单元32中使用公共斜坡信号。斜坡信号生成电路34可以由水平驱动单元31和水平驱动单元32共用。
注意，图20至22等中的多条数据线70合意地被布置在同一布线层中，并且合意地以平移对称或点对称的方式布置。这是为了减少寄生电容和寄生电阻的变化，并防止图像质量的劣化。
注意，图1中所示的水平驱动单元30和垂直驱动单元20可以由专用硬件配置。水平驱动单元30和垂直驱动单元20还可以由配备有固件的微型计算机等构成。在这种情况下，水平驱动单元30和垂直驱动单元20的功能由固件执行。
注意，本说明书中描述的效果仅是说明性的而不是限制性的。可能存在其它效果。
注意，本技术也可以采用以下配置。
(1)一种显示设备，包括：
像素阵列单元，由包括发光元件和使发光元件发光的像素电路并且按二维矩阵布置的多个像素构成；
多条数据线，针对像素阵列单元中的每列布置所述多条数据线，并且所述多条数据线传输像素的图像信号；
由布置在多个相邻行中的像素构成的第一像素组；以及
由布置在多个相邻行中的像素构成并且与第一像素组相邻布置的第二像素组；其中
在第一像素组的各像素中，经由数据线对于每列共同地传输图像信号，并且
在第二像素组的各像素中，经由与将图像信号传输到第一像素组的数据线不同的数据线，对于每列共同地传输图像信号。
(2)根据上述(1)所述的显示设备，其中
在像素阵列单元中，交替地布置多个第一像素组和多个第二像素组，
图像信号经由公共数据线被传输到所述多个第一像素组的像素，以及
图像信号经由公共数据线被传输到所述多个第二像素组的像素。
(3)根据上述(1)或(2)所述的显示设备，其中，所述多条数据线包括将图像信号传输到第一像素组的像素的第一像素组数据线和将图像信号传输到第二像素组的像素的第二像素组数据线。
(4)根据上述(3)所述的显示设备，还包括
像素输入信号线选择单元，其针对每个像素被设置，选择第一像素组数据线和第二像素组数据线之一，并传输图像信号。
(5)根据上述(1)至(4)中的任何一项的显示设备，还包括
第二数据线选择单元，其在作为针对第一像素组和第二像素组中的每个行布置的以及针对每个列布置的数据线的多条第二数据线中，选择与第一像素组的像素连接的第二数据线和与第二像素组的像素连接的第二数据线中的一个，并且传输图像信号。
(6)根据上述(5)所述的显示设备，其中
在像素阵列单元中，交替地布置多个第一像素组和多个第二像素组，并且
所述多条第二数据线由共同连接到所述多个第一像素组中的对应行中的像素的多条第二数据线和共同连接到所述多个第二像素组中的对应行中的像素的多条第二数据线构成。
(7)根据上述(1)至(6)中的任何一项的显示设备，还包括
生成图像信号并将图像信号输出到所述多条数据线的图像信号生成单元。
(8)根据上述(7)的显示设备，其中图像信号生成单元包括生成并输出第一像素组的像素的图像信号的第一图像信号生成单元和生成并输出第二像素组的像素的图像信号的第二图像信号生成单元。
附图标记列表
1显示设备
10像素阵列单元
30～32水平驱动单元
70，70a，70b数据线
71到74第二数据线
100像素
101发光元件
121第一像素组
122第二像素组
200，210第二数据线选择单元
201至204，211至214开关元件

Claims (8)

1.一种显示设备，包括：
像素阵列单元，由包括发光元件和使发光元件发光的像素电路并且按二维矩阵布置的多个像素构成；
多条数据线，针对像素阵列单元中的每列布置所述多条数据线，并且所述多条数据线传输像素的图像信号；
由布置在多个相邻行中的像素构成的第一像素组；以及
由布置在多个相邻行中的像素构成并且与第一像素组相邻布置的第二像素组；其中
在第一像素组的各像素中，经由数据线对于每列共同地传输图像信号，并且
在第二像素组的各像素中，经由与将图像信号传输到第一像素组的数据线不同的数据线，对于每列共同地传输图像信号。
2.根据权利要求1所述的显示设备，其中
在像素阵列单元中，交替地布置多个第一像素组和多个第二像素组，
图像信号经由公共数据线被传输到所述多个第一像素组的像素，以及
图像信号经由公共数据线被传输到所述多个第二像素组的像素。
3.根据权利要求1所述的显示设备，其中所述多条数据线包括将图像信号传输到第一像素组的像素的第一像素组数据线和将图像信号传输到第二像素组的像素的第二像素组数据线。
4.根据权利要求3所述的显示设备，还包括
像素输入信号线选择单元，其针对每个像素被设置，选择第一像素组数据线和第二像素组数据线之一，并传输图像信号。
5.根据权利要求1所述的显示设备，还包括
第二数据线选择单元，其在作为针对第一像素组和第二像素组中的每个行布置的以及针对每个列布置的数据线的多条第二数据线中，选择与第一像素组的像素连接的第二数据线和与第二像素组的像素连接的第二数据线中的一个，并且传输图像信号。
6.根据权利要求5所述的显示设备，其中
在像素阵列单元中，交替地布置多个第一像素组和多个第二像素组，并且
所述多条第二数据线由共同连接到所述多个第一像素组中的对应行中的像素的多条第二数据线和共同连接到所述多个第二像素组中的对应行中的像素的多条第二数据线构成。
7.根据权利要求1所述的显示设备，还包括
生成图像信号并将图像信号输出到所述多条数据线的图像信号生成单元。
8.根据权利要求7所述的显示设备，其中图像信号生成单元包括生成并输出第一像素组的像素的图像信号的第一图像信号生成单元和生成并输出第二像素组的像素的图像信号的第二图像信号生成单元。
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