CN115145082A - 像素结构、阵列基板及显示面板 - Google Patents

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Chuzhou HKC Optoelectronics Technology Co Ltd
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HKC Co Ltd
Chuzhou HKC Optoelectronics Technology Co Ltd
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Abstract

本申请公开一种像素结构、阵列基板及显示面板，该像素结构包括：第一数据线、第二数据线及第一扫描线，第一扫描线与第一数据线及第二数据线交叉延伸；公共电极线，靠近第二数据线且与第二数据线平行设置；子像素，设置于第一数据线及第二数据线之间，包括：主像素电极及次像素电极，沿列方向且分设于第一扫描线的两侧；第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管，第一薄膜晶体管的漏极与主像素电极连接，第二薄膜晶体管的漏极与次像素电极连接，第三薄膜晶体管的源极与第一薄膜晶体管的漏极连接，第三薄膜晶体管的漏极与公共电极线连接。本申请可以解决现有的8Domain像素结构使用效果较差的问题。

Description

像素结构、阵列基板及显示面板
技术领域
本申请涉及液晶显示技术领域，特别涉及一种像素结构、阵列基板及显示面板。
背景技术
液晶显示面板通常由彩色滤光片基板、薄膜晶体管阵列基板以及配置于两基板间的液晶层所构成，并分别在两基板的相对内侧设置像素电极、公共电极，通过施加电压控制液晶分子改变方向，将背光模组的光线折射出来产生画面。在基板尺寸不断从32寸到100寸变大的过程中，大视角的必要性也越来越重要，通常在设计中会使用8Domain设计，使主像素电极的电压与次像素电极的电压产生差异，从而使两个像素的液晶偏转出现差异形成大视角效果，然而现有的8Domain像素的结构设计并不理想，用于对次像素电极进行放电的公共电极线通常会影响开口率或具有修复困难等问题。
发明内容
本申请的主要目的是提出一种像素结构，旨在解决现有的8Domain像素结构使用效果较差的问题。
为实现上述目的，本申请提出的像素结构，包括：
沿第一预设方向延伸的第一数据线及第二数据线；
沿第二预设方向延伸的第一扫描线，所述第一扫描线与所述第一数据线及第二数据线交叉延伸；
沿第一预设方向延伸的公共电极线，与所述第二数据线平行设置，且所述公共电极线的正投影与所述第二数据线至少部分重叠；
子像素，设置于所述第一数据线及第二数据线之间，所述子像素包括：
主像素电极及次像素电极，沿第一预设方向设置，且分设于所述第一扫描线的两侧；
第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管，所述第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管的栅极均与所述第一扫描线连接，所述第一薄膜晶体管及第二薄膜晶体管的源极均与所述第一数据线连接；所述第一薄膜晶体管的漏极与主像素电极连接，第二薄膜晶体管的漏极与次像素电极连接，所述第三薄膜晶体管的源极与所述第一薄膜晶体管的漏极连接，所述第三薄膜晶体管的漏极与所述公共电极线连接。
可选地，所述第三薄膜晶体管的漏极与所述公共电极线通过第三连接走线连接。
可选地，所述第三连接走线的正投影位于所述第一扫描线的边缘内。
可选地，所述第三连接走线的正投影与所述第二数据线至少部分重叠。
可选地，所述公共电极线的线宽大于所述第二数据线的线宽。
可选地，所述公共电极线的数量为多个，每相邻的两条所述公共电极线之间通过DBS连接走线连接。
可选地，所述第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管沿所述第一扫描线方向依次设置；其中，
所述第一薄膜晶体管设置于靠近所述第一数据线的一侧，所述第三薄膜晶体管设置于靠近所述公共电极线的一侧。
本申请还提出一种阵列基板，包括衬底基板以及如上述的像素结构；
所述衬底基板上形成有：
第一金属层，所述第一金属层形成第一扫描线、第一薄膜晶体管的栅极、第二薄膜晶体管的栅极，以及第三薄膜晶体管的栅极；
第一绝缘层，设置于所述第一金属层上；
第二金属层，设置于所述第一绝缘层上，所述第二金属层形成第一数据线、第二数据线、第一薄膜晶体管的源极与漏极、第二薄膜晶体管的源极与漏极，以及第三薄膜晶体管的源极与漏极；
第二绝缘层，设置于所述第二金属层上；
透明导电层，分别形成主像素电极、次像素电极，以及公共电极线；其中，第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、主像素电极和次像素电极构成一个子像素。
可选地，所述第一薄膜晶体管的漏极与所述主像素电极通过第一连接走线连接，所述第二薄膜晶体管的漏极与所述次像素电极通过第二连接走线连接；
所述第一连接走线包括由所述第二金属层形成的第一金属走线段，以及设置于所述透明导电层和所述第一金属走线段之间且贯穿所述第二绝缘层的第一过孔连接段，所述第一过孔连接段设置于所述主像素电极上；
所述第二连接走线包括由所述第二金属层形成的第二金属走线段，以及设置于所述透明导电层和所述第二金属走线段之间且贯穿所述第二绝缘层的第二过孔连接段，所述第二过孔连接段设置于所述次像素电极上。
可选地，所述第三连接走线包括由第二金属层形成的第三金属走线段、由所述透明导电层形成的透明走线段，以及设置于所述透明走线段和第三金属走线段之间且贯穿所述第二绝缘层的第三过孔连接段；其中，
所述第三金属走线段、透明走线段及第三过孔连接段的正投影位于所述第一扫描线的边缘内。
本申请还提出一种显示面板，包括如上述的像素结构；或者，
包括如上述的阵列基板以及与所述阵列基板相对设置的彩膜基板。
本申请技术方案中，像素结构博包括第一扫描线、第一数据线、第二数据线、公共电极线及子像素，其中，第一扫描线与第一数据线及第二数据线交叉延伸，子像素设置于第一数据线及第二数据线之间，子像素包括沿列方向设置且分设于第一扫描线的两侧的主像素电极及次像素电极，子像素还包括与主像素电极连接的第一薄膜晶体管、与次像素电极连接的第二薄膜晶体管，以及与公共电极线连接的第三薄膜晶体管。本申请通过设置公共电极线以及使公共电极线与第三薄膜晶体管连接，使得对次像素电极的充电电流会由第三薄膜晶体管传导至公共电极线，以对次像素电极进行分压，从而使得次像素电极的电压与主像素电极的电压电压产生差异，进而使两个像素电极的液晶偏转出现差异而形成大视角效果。本申请通过设置公共电极线对次像素电极进行分压，不需要在次像素电极区域内做转层孔或走线，不会形成寄生电容，也不会对开口率造成损失，解决了现有的8Domain像素结构使用效果较差的问题。
附图说明
为了更清楚地说明本申请实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图示出的结构获得其他的附图。
图1为本申请像素结构一实施例的结构示意图；
图2为现有技术中像素结构一实施例的结构示意图；
图3为现有技术中像素结构另一实施例的结构示意图；
图4为本申请像素结构中第三薄膜晶体管的剖面结构示意图。
附图标号说明：
名称 标号 名称 标号
第一数据线 D1 第二薄膜晶体管 T2
第二数据线 D2 第三薄膜晶体管 T3
第一扫描线 G1 第一过孔连接段 Q1
主像素电极 Main pixel 第二过孔连接段 Q2
次像素电极 Sub pixel 第三过孔连接段 Q3
公共电极线 DS 第一公共电极线 M1
第一薄膜晶体管 T1 第二公共电极线 M2
本申请目的的实现、功能特点及优点将结合实施例，参照附图做进一步说明。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请的一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
需要说明，若本申请实施例中有涉及方向性指示(诸如上、下、左、右、前、后……)，则该方向性指示仅用于解释在某一特定姿态(如附图所示)下各部件之间的相对位置关系、运动情况等，如果该特定姿态发生改变时，则该方向性指示也相应地随之改变。
另外，若本申请实施例中有涉及“第一”、“第二”等的描述，则该“第一”、“第二”等的描述仅用于描述目的，而不能理解为指示或暗示其相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。另外，各个实施例之间的技术方案可以相互结合，但是必须是以本领域普通技术人员能够实现为基础，当技术方案的结合出现相互矛盾或无法实现时应当认为这种技术方案的结合不存在，也不在本申请要求的保护范围之内。
目前，在基板尺寸不断从32寸到100寸变大的过程中，大视角的必要性也越来越重要，通常在设计中会使用8Domain设计，使主像素电极Main pixel的电压与次像素电极Subpixel的电压产生差异，从而使两个像素的液晶偏转出现差异形成大视角效果。目前常见8Domain设计有两种，一种是第三薄膜晶体管T3与第一金属层上形成的第一公共电极线M1连接，如图2所示，图2为现有技术中像素结构一实施例的结构示意图，第一公共电极线M1环绕像素电极设置，且与像素电极部分重叠，因此在第三薄膜晶体管T3与第一公共电极线M1连接时，需要在像素电极内设置转层孔，对开口率存在影响。另一种是第三薄膜晶体管T3与第二金属层上形成的第二公共电极线M2连接，如图3所示，图3为现有技术中像素结构另一实施例的结构示意图，第二公共电极线M2跨越像素电极设置，第二公共电极线M2的正投影落在像素电极区域内的，对开口率依旧存在影响，同时，第二金属层上的第二公共电极线M2断线存在良率问题，检出能力较差(公共电极线为公共低电压，对于电测机台较难检出)，且维修操作难度较大，需进行镭射断开线路并进行长线操作。
为此，本申请提出一种像素结构，参照图1，在一实施例中，所述像素结构包括：
沿第一预设方向延伸的第一数据线D1及第二数据线D2；
沿第二预设方向延伸的第一扫描线G1，所述第一扫描线G1与所述第一数据线D1及第二数据线D2交叉延伸；
沿第一预设方向延伸的公共电极线DS，靠近所述第二数据线D2设置，且与所述第二数据线D2平行设置；
子像素，设置于所述第一数据线D1及第二数据线D2之间，所述子像素包括：
主像素电极Main pixel及次像素电极Sub pixel，沿第一预设方向设置，且分设于所述第一扫描线G1的两侧；
第一薄膜晶体管T1、第二薄膜晶体管T2及第三薄膜晶体管T3，所述第一薄膜晶体管T1、第二薄膜晶体管T2及第三薄膜晶体管T3的栅极均与所述第一扫描线G1连接，所述第一薄膜晶体管T1及第二薄膜晶体管T2的源极均与所述第一数据线D1连接；所述第一薄膜晶体管T1的漏极与主像素电极Main pixel连接，第二薄膜晶体管T2的漏极与次像素电极Subpixel连接，所述第三薄膜晶体管T3的源极与所述第一薄膜晶体管T1的漏极连接，所述第三薄膜晶体管T3的漏极与所述公共电极线DS连接。
像素结构中通常包括多个像素，多条数据线及多条扫描线，其中，数据线通常沿列方向设置，即第一预设方向，数据线通常沿行方向设置，即第二预设方向。像素包括至少三种子像素，不同的子像素可显示不同的原色光，根据空间混色原理，不同的原色光按照一定的比例混合可显示出多种颜色。通常，一个像素至少包括R子像素，G子像素和B子像素，后文中将这三种子像素都归为子像素，以详细阐述本申请的技术方案。当然，本领域技术人员也可以在不付出创造性劳动的前提下，选择其它的原色进行组合，并相应调整本申请的方案以改善显示设备的色彩显示效果，在此不再赘述。多个子像素呈矩形阵列状排布，每一子像素分别与数据线和扫描线电连接，在扫描线上的扫描信号作用下，相应的子像素被分别打开，当子像素处于打开状态时，在数据线上的驱动信号的驱动作用下，子像素被充电，从而显示出一定的亮度，并在相应光阻的滤光作用下，显示出不同的颜色。其中，驱动信号可以根据待显示的画面中各像素或子像素的灰阶等得到。
本申请中将以多个子像素中的任意一个子像素为例详细阐述本申请的技术方案。在本实施例中，将子像素一分为二，分为沿列方向设置的一个主像素和一个次像素，并采用多畴垂直配向技术，将每一个主像素和子像素都划分成四个区域，也即将一个子像素划分成了八个区域，并使每个区域中的液晶在施加电压后倒伏向不同的方向，从而使各个方向看到的效果趋于平均一致，以实现8domain的显示效果。
在本实施例中，像素可以采用3T-8畴像素结构以实现8domain的显示效果，具体而言，子像素包括第一薄膜晶体管T1、第二薄膜晶体管T2及第三薄膜晶体管T3三个薄膜晶体管，其中，第一薄膜晶体管T1及第二薄膜晶体管T2分别与主像素电极Main pixel及次像素电极Sub pixel连接，在第一扫描线G1上的扫描信号作用下，相应的第一薄膜晶体管T1及第二薄膜晶体管T2被分别打开，当第一薄膜晶体管T1及第二薄膜晶体管T2处于打开状态时，在数据线上的驱动信号的驱动作用下，主像素电极Main pixel及次像素电极Sub pixel被充电，从而显示出一定的亮度，并在相应光阻的滤光作用下，显示出不同的颜色。同时，第三薄膜晶体管T3分别与所述次像素电极Sub pixel及公共电极线DS连接，在次像素电极Subpixel被充电时，第三薄膜晶体管T3被打开，而当第三薄膜晶体管T3处于打开状态时，由于公共电极线DS的电位会设置为低电压，因此，对次像素电极Sub pixel的充电电流会由第三薄膜晶体管T3分流至公共电极线DS，从而达到对次像素电极Sub pixel进行分压的效果，从而使得次像素电极Sub pixel的电压与主像素电极Main pixel的电压产生差异，进而使两个像素电极的液晶偏转出现差异而形成大视角效果。其中，公共电极线DS为利用DBS设计形成的公共电极线，DBS设计指数据线上方无黑色矩阵(Data Line BM Less，DBS)设计，公共电极线DS的正投影与第二数据线至少部分重叠，如此设置，在面板正常工作时，公共电极线DS与公共电极形成的电场可以使液晶分子保持不偏转的状态，起到相当于黑矩阵的作用，达到遮光的目的，能够减少黑矩阵的面积，进而能够增大像素的显示区域，增大了穿透率及开口率。
可以理解的是，现有技术中的次像素通常通过第一金属层上形成的公共电极线或第二金属层上形成的公共电极线对次像素电极Sub pixel进行分压，而在本申请技术方案中，通过设置公共电极线DS以及使公共电极线DS与第三薄膜晶体管T3连接，使得次像素电极Sub pixel与主像素电极Main pixel的电压能够在充电时产生差异，进而使两个像素电极的液晶偏转出现差异而形成大视角效果。本申请的像素结构利用可形成于透明导电层的公共电极线DS对次像素电极Sub pixel进行分压，且公共电极线DS靠近第二数据线D2设置，使得第三薄膜晶体管T3连接公共电极线DS的连接走线可以设置在次像素电极Sub pixel区域外。因此，本申请的像素结构无需在次像素电极Sub pixel的区域内做转层孔或走线，不会形成寄生电容，也不会对开口率造成损失。同时，公共电极线DS可形成于透明导电层，可以与像素电极一体化形成，一方面能够提高公共电极线DS的良率，在公共电极线DS断线时也易于修复。另一方面能够降低生产工艺的难度，不会增加生产工序，有利于保证生产效率，进而降低批量化生产的生产成本。
参照图1，在一实施例中，所述第三薄膜晶体管T3的漏极与所述公共电极线DS通过第三连接走线连接。
在本实施例中，第三薄膜晶体管T3的漏极通过第三连接走线与公共电极线DS连接，可以理解的是，在阵列基板上，第三连接走线可以与公共电极线DS处于不同层，也可以与公共电极线DS处于相同层。例如，第三连接走线可以在透明导电层层上形成透明走线，并通过导电孔与处于第二金属层的第三薄膜晶体管T3的漏极连接。如此设置，一方面降低了第三连接走线的布置难度，使得第三连接走线及公共电极线DS可以与像素电极一体化形成，降低了生产工艺的难度，不会增加生产工序，有利于保证生产效率，进而降低批量化生产的生产成本。另一方面，由于第三连接走线在透明导电层层上形成透明走线，能够提高公共电极线DS的良率，在公共电极线DS断线时也易于修复。
可选地，所述第三连接走线的正投影位于所述第一扫描线G1的边缘内。
可以理解的是，第三薄膜晶体管T3通过第三连接走线与公共电极线DS连接，若第三连接走线与次像素电极有重叠部分，则会产生寄生电容，同时还会影响穿透率及开口率。因此，在一实施例中，将第三连接走线的正投影设置在第一扫描线G1的区域内，也即使得第三连接走线设置于次像素电极Sub pixel区域外。如此设置，不需要在次像素电极Subpixel区域内做转层孔或走线，能够增大像素的显示区域，不会对开口率造成损失，减少了与像素电极的重叠部分，从而降低了寄生电容的产生，增大了穿透率及开口率，进而改善了显示面板的显示效果，降低了显示所需的能耗。
可选地，所述第三连接走线的正投影与所述第二数据线D2至少部分重叠。
在另一实施例中，第二数据线D2上方部分覆盖有第三连接走线，此时，可以将公共电极线DS与公共电极在电位上设置成等电位，如此设置，在面板正常工作时，第三连接走线及公共电极线DS与公共电极形成的电场可以使液晶分子保持不偏转的状态，从而起到遮光的目的，从而能够减少黑矩阵的面积，进而能够增大像素的显示区域，增大了穿透率及开口率，进而改善了显示面板的显示效果，降低了显示所需的能耗。
参照图1，在一实施例中，所述公共电极线DS的线宽大于所述第二数据线D2的线宽。
在本实施例中，将公共电极线DS的线宽设置得大于第二数据线D2的线宽，使得公共电极线DS与第二数据线D2的正投影可以完全重叠，或是部分重叠，并将公共电极线DS与公共电极在电位上设置成等电位。如此设置，在面板正常工作时，公共电极线DS与公共电极形成的电场可以使液晶分子保持不偏转的状态，从而起到遮光的目的。具体地，由于公共电极线DS电位和对侧基板的公共电极电位都是相同的公共电位，所以无论像素电极给的是什么信号，夹在公共电极线DS与公共电极之间的液晶都不会产生转动。液晶不转动，意味着偏振光的相位不改变，穿过第一层偏光片的偏振光，在常黑模式的液晶显示器中，相位如果没有改变是无法穿过第二层偏光片的，起到相当于黑矩阵的作用，达到遮光的目的。如此设置，能够减少黑矩阵的面积，进而能够增大像素的显示区域，增大了穿透率及开口率，进而改善了显示面板的显示效果，降低了显示所需的能耗。同时，将公共电极线DS的线宽增大，使得透明导电层整体制程的均一性较好，从而使得大板的分压效果更加平均。
参照图1，在一实施例中，所述公共电极线DS的数量为多个，每相邻的两条所述公共电极线DS之间通过DBS连接走线连接。
在一实施例中，公共电极线DS的数量为多个，对应地，第一扫描线G1、第一数据线D1、第二数据线D2及子像素的数量为多个，以组成完整的像素阵列。公共电极线DS的数量为多个，以供多列子像素连接，同时，每相邻的两条公共电极线DS之间通过DBS连接走线连接，DBS连接走线的数量可以为一条或者为多条。DBS连接走线可以设置在扫描线的边缘内，避免与像素电极重叠以产生寄生电容，当DBS连接走线的数量为一条时，DBS连接走线可以设置在相邻两条公共电极线DS之间的任一扫描线的区域内。同理，可以在相邻两条公共电极线DS之间的多条扫描线区域内均设置一条DBS连接走线，或者，还可以在相邻两条公共电极线DS之间的每条扫描线区域内均设置一条DBS连接走线，此时DBS连接走线的数量为多条。如此设置，使得两条公共电极线DS之间可以通过DBS连接走线相互连通，当任意一公共电极线DS上局部断开时，不会影响其他位置的公共电极线DS导通，使得因公共电极线DS局部断开而导致第三薄膜晶体管T3分压失效的现象得到改善。
参照图1，在一实施例中，所述第一薄膜晶体管T1、第二薄膜晶体管T2及第三薄膜晶体管T3沿所述第一扫描线G1方向依次设置；其中，
所述第一薄膜晶体管T1设置于靠近所述第一数据线D1的一侧，所述第三薄膜晶体管T3设置于靠近所述公共电极线DS的一侧。
在本实施例中，具体如图1所示，图1为像素结构一实施例的结构示意图，其中，第一薄膜晶体管T1设置于靠近第一数据线D1的一侧，第三薄膜晶体管T3设置于靠近公共电极线DS的一侧，而第二薄膜晶体管T2则设置于第一薄膜晶体管T1与第三薄膜晶体管T3之间。如此设置，使得第一薄膜晶体管T1、第二薄膜晶体管T2及第三薄膜晶体管T3在与对应的像素电极及公共电极线DS连接时的连接走线不会交错或产生重叠，能够降低走线的布置难度，减少信号串扰，进而提升显示面板的显示效果。
本申请还提出一种阵列基板，包括衬底基板以及如上述的像素结构；
所述衬底基板上形成有：
第一金属层，所述第一金属层形成第一扫描线G1、第一薄膜晶体管T1的栅极、第二薄膜晶体管T2的栅极，以及第三薄膜晶体管T3的栅极；
第一绝缘层，设置于所述第一金属层上；
第二金属层，设置于所述第一绝缘层上，所述第二金属层形成第一数据线D1、第二数据线D2、第一薄膜晶体管T1的源极与漏极、第二薄膜晶体管T2的源极与漏极，以及第三薄膜晶体管T3的源极与漏极；
第二绝缘层，设置于所述第二金属层上；
透明导电层，分别形成主像素电极Main pixel、次像素电极Sub pixel，以及公共电极线DS；其中，第一薄膜晶体管T1、第二薄膜晶体管T2、第三薄膜晶体管T3、主像素电极Main pixel和次像素电极Sub pixel构成一个子像素。
在本实施例中，第一薄膜晶体管T1和第二薄膜晶体管T2均包括两层金属层、两层绝缘层、有源层及欧姆接触层。其中，两层金属层的材质可以相同也可以不同，例如可以采用铝或者铜来实现。第一扫描线G1及薄膜晶体管的栅极可以采用同一金属层来实现，具体可以采用第一金属层图形化形成第一扫描线G1及薄膜晶体管的栅极。同理，第一数据线D1、第二数据线D2及薄膜晶体管的漏极和源极可以采用同一金属层来实现，具体可以采用第二金属层图形化形成第一数据线D1、第二数据线D2及薄膜晶体管的漏极和源极。在本实施例中，第一绝缘层为栅绝缘层，第二绝缘层为钝化层。透明导电层可以形成公共电极线DS、主像素电极Main pixel和次像素电极Sub pixel，透明导电层ITO可以是ITO薄膜层。
在本实施例中，第一薄膜晶体管T1、第二薄膜晶体管T2、第三薄膜晶体管T3、主像素电极Main pixel和次像素电极Sub pixel构成一个子像素，而多个子像素与多条数据线、扫描线及公共电极线DS可以形成像素阵列，多个子像素呈矩形阵列状排布，每一子像素分别与数据线和扫描线电连接，在扫描线上的扫描信号作用下，相应的子像素被分别打开，当子像素处于打开状态时，在数据线上的驱动信号的驱动作用下，子像素被充电，从而显示出一定的亮度，并在相应光阻的滤光作用下，显示出不同的颜色。
此外，该阵列基板包括上述的像素结构，该像素结构的具体结构参照上述实施例，由于本阵列基板采用了上述所有实施例的全部技术方案，因此至少具有上述实施例的技术方案所带来的所有有益效果，在此不再一一赘述。
参照图1，在一实施例中，所述第一薄膜晶体管T1的漏极与所述主像素电极Mainpixel通过第一连接走线连接，所述第二薄膜晶体管T2的漏极与所述次像素电极Sub pixel通过第二连接走线连接；
所述第一连接走线包括由所述第二金属层形成的第一金属走线段，以及设置于所述透明导电层和所述第一金属走线段之间且贯穿所述第二绝缘层的第一过孔连接段Q1，所述第一过孔连接段Q1设置于所述主像素电极Main pixel上；
所述第二连接走线包括由所述第二金属层形成的第二金属走线段，以及设置于所述透明导电层和所述第二金属走线段之间且贯穿所述第二绝缘层的第二过孔连接段Q2，所述第二过孔连接段Q2设置于所述次像素电极Sub pixel上。
在本实施例中，第一薄膜晶体管T1的漏极与主像素电极Main pixel之间可以是通过过孔实现不同层之间的导电连接的。同理，第二薄膜晶体管T2的漏极与次像素电极Subpixel之间也可以是通过过孔实现不同层之间的导电连接的，具体如图1所示，图1为像素结构一实施例的结构示意图，其中，第一连接走线中形成的第一过孔连接段Q1设置于主像素电极Main pixel上，第二连接走线中形成的第二过孔连接段Q2设置次像素电极Sub pixel上。如此设置，减少了第一连接走线及第二连接走线中由第二金属层形成的金属走线段的长度，从而减少寄生电容的产生。
参照图1，在一实施例中，所述第三连接走线包括由第二金属层形成的第三金属走线段、由所述透明导电层形成的透明走线段，以及设置于所述透明走线段和第三金属走线段之间且贯穿所述第二绝缘层的第三过孔连接段Q3；其中，
所述第三金属走线段、透明走线段及第三过孔连接段Q3的正投影位于所述第一扫描线G1的边缘内。
在本实施例中，第三薄膜晶体管T3的漏极与公共电极线DS之间可以是通过过孔实现不同层之间的导电连接的，如图4所示，图4为第三薄膜晶体管的剖面结构示意图，在第二金属层上开设有第三孔连接段Q3，以使第三薄膜晶体管T3的漏极与公共电极线DS通过第三孔连接段Q3及透明走线段电连接。第三连接走线具体如图1所示，图1为像素结构一实施例的结构示意图，其中，第三金属走线段、透明走线段及第三过孔连接段Q3均设置设计在像素区外，可加大像素区的显示区域，减少寄生电容的产生，增大了穿透率及开口率，进而改善了显示面板的显示效果，降低了显示所需的能耗。另一方面，第三金属走线段、透明走线段及第三过孔连接段Q3均设置在像素区外，降低了第三连接走线的布置难度，其中，透明走线段及公共电极线DS可以与次像素电极Sub pixel一体化形成，降低了生产工艺的难度，不会增加生产工序，有利于保证生产效率，进而降低批量化生产的生产成本。
本申请还提出一种显示面板，该显示装置包括上述的像素结构，或者，包括上述的阵列基板以及与所述阵列基板相对设置的彩膜基板。
其中，该像素结构及阵列基板的具体结构参照上述实施例，由于本显示面板采用了上述所有实施例的全部技术方案，因此至少具有上述实施例的技术方案所带来的所有有益效果，在此不再一一赘述。
以上所述仅为本申请的优选实施例，并非因此限制本申请的专利范围，凡是在本申请的申请构思下，利用本申请说明书及附图内容所作的等效结构变换，或直接/间接运用在其他相关的技术领域均包括在本申请的专利保护范围内。

Claims (10)

1.一种像素结构，其特征在于，包括：
沿第一预设方向延伸的第一数据线及第二数据线；
沿第二预设方向延伸的第一扫描线，所述第一扫描线与所述第一数据线及第二数据线交叉延伸；
沿第一预设方向延伸的公共电极线，与所述第二数据线平行设置，且所述公共电极线的正投影与所述第二数据线至少部分重叠；
子像素，设置于所述第一数据线及第二数据线之间，所述子像素包括：
主像素电极及次像素电极，沿第一预设方向设置，且分设于所述第一扫描线的两侧；
第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管，所述第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管的栅极均与所述第一扫描线连接，所述第一薄膜晶体管及第二薄膜晶体管的源极均与所述第一数据线连接；所述第一薄膜晶体管的漏极与主像素电极连接，第二薄膜晶体管的漏极与次像素电极连接，所述第三薄膜晶体管的源极与所述第一薄膜晶体管的漏极连接，所述第三薄膜晶体管的漏极与所述公共电极线连接。
2.如权利要求1所述的像素结构，其特征在于，所述第三薄膜晶体管的漏极与所述公共电极线通过第三连接走线连接。
3.如权利要求2所述的像素结构，其特征在于，所述第三连接走线的正投影位于所述第一扫描线的边缘内。
4.如权利要求2所述的像素结构，其特征在于，所述第三连接走线的正投影与所述第二数据线至少部分重叠。
5.如权利要求1所述的像素结构，其特征在于，所述公共电极线的线宽大于所述第二数据线的线宽。
6.如权利要求1所述的像素结构，其特征在于，所述第一薄膜晶体管、第二薄膜晶体管及第三薄膜晶体管沿所述第一扫描线方向依次设置；其中，
所述第一薄膜晶体管设置于靠近所述第一数据线的一侧，所述第三薄膜晶体管设置于靠近所述公共电极线的一侧。
7.一种阵列基板，其特征在于，包括衬底基板以及如权利要求1-6任一项所述的像素结构；
所述衬底基板上形成有：
第一金属层，所述第一金属层形成第一扫描线、第一薄膜晶体管的栅极、第二薄膜晶体管的栅极，以及第三薄膜晶体管的栅极；
第一绝缘层，设置于所述第一金属层上；
第二金属层，设置于所述第一绝缘层上，所述第二金属层形成第一数据线、第二数据线、第一薄膜晶体管的源极与漏极、第二薄膜晶体管的源极与漏极，以及第三薄膜晶体管的源极与漏极；
第二绝缘层，设置于所述第二金属层上；
透明导电层，分别形成主像素电极、次像素电极，以及公共电极线；其中，第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、主像素电极和次像素电极构成一个子像素。
8.如权利要求7所述的阵列基板，其特征在于，所述第一薄膜晶体管的漏极与所述主像素电极通过第一连接走线连接，所述第二薄膜晶体管的漏极与所述次像素电极通过第二连接走线连接；
所述第一连接走线包括由所述第二金属层形成的第一金属走线段，以及设置于所述透明导电层和所述第一金属走线段之间且贯穿所述第二绝缘层的第一过孔连接段，所述第一过孔连接段设置于所述主像素电极上；
所述第二连接走线包括由所述第二金属层形成的第二金属走线段，以及设置于所述透明导电层和所述第二金属走线段之间且贯穿所述第二绝缘层的第二过孔连接段，所述第二过孔连接段设置于所述次像素电极上。
9.如权利要求7所述的阵列基板，其特征在于，所述第三连接走线包括由第二金属层形成的第三金属走线段、由所述透明导电层形成的透明走线段，以及设置于所述透明走线段和第三金属走线段之间且贯穿所述第二绝缘层的第三过孔连接段；其中，
所述第三金属走线段、透明走线段及第三过孔连接段的正投影位于所述第一扫描线的边缘内。
10.一种显示面板，其特征在于，包括如权利要求1-6任一项所述的像素结构；或者，
包括如权利要求7-9任一项所述的阵列基板以及与所述阵列基板相对设置的彩膜基板。
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