CN114664261A - 选通驱动器和包括该选通驱动器的显示装置 - Google Patents

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Abstract

提出了一种选通驱动器和包括该选通驱动器的显示装置。选通驱动器包括：其上具有电路元件的多个电路部。电路部彼此间隔开。透明部在电路部之间。外部光可以穿过透明部。电路部中的每一个可以包括至少一个电路块。电路块中的每一个可以被配置为与其它电路块执行相同的功能。

Description

选通驱动器和包括该选通驱动器的显示装置
技术领域
本公开涉及一种选通驱动器和包括该选通驱动器的显示装置。更具体地，本公开涉及一种具有透明部的选通驱动器，并且涉及一种包括该选通驱动器的显示装置。
背景技术
有机发光显示装置使用通过电子-空穴复合而生成光的有机发光二极管来显示图像。有机发光显示装置是自发光的显示装置，并且具有较快的响应速度和较低的功耗，使得有机发光显示装置作为下一代显示器受到关注。
通过使有机发光显示装置内部的晶体管或发光元件处于透明形式，或者通过使电路区域和透射区域彼此分离，可以将有机发光显示装置配置为透明显示装置。然而，现有的透明显示装置具有诸如边框的非显示区域，使得透明图像的视觉感受特性可能劣化。
发明内容
本公开的目的是提供一种其中在透明显示装置中使显示区域和非显示区域之间的视觉差异最小化的显示装置。
根据本公开的一个实施方式，一种选通驱动器包括：多个电路部，多个电路部具有布置在其上的电路元件。多个电路部彼此间隔开。多个透明部被布置在电路部之间。外部光穿过多个透明部。多个电路部中的每一个可以包括多个电路块的至少一个电路块。多个电路块中的每一个可以被配置为执行与多个电路块中的其它电路块相同的功能。
多个电路部可以包括沿第一方向延伸的第一延伸部。电路部的电路元件在第一延伸部上。多个电路部中的每一个的第二延伸部沿与第一方向垂直的第二方向延伸。第二布线被布置在第二电路部上方。第二布线可以提供彼此间隔开的电路部之间的联接。
第一延伸部在第二方向上的宽度可以大于第二延伸部在第一方向上的宽度。
选通驱动器还可以包括被配置为向电路部中的每一个施加全局信号的多条第一布线，其中，全局信号可以包括扫描时钟信号、进位时钟信号、开始信号、复位信号、感测选择信号、第一电源、第二电源和第三电源中的至少一个。
多个电路部可以包括：第一电路部，第一电路部被配置为控制提供给像素以用于像素感测的第二选通信号的输出；第二电路部，第二电路部被配置为设置布置在选通驱动器上方的Q节点(或者“第一节点”)的电压；第三电路部，第三电路部被配置为控制提供给布置在对应级之后的另一级的进位信号的输出；第四电路部，第四电路部被配置为响应于从布置在对应级之前的另一级接收的进位信号而对Q节点的电压和选通驱动器上布置的QB节点(或者“第二节点”)的电压进行复位；第五电路部，第五电路部被配置为反转并且输出施加到Q节点和QB节点的信号；第六电路部，第六电路部被配置为通过响应于QB节点的电压而导通的至少一个下拉晶体管来输出处于栅极截止电压的第一选通信号；以及第七电路部，第七电路部被配置为通过响应于Q节点的电压而导通的至少一个上拉晶体管来输出处于栅极导通电压的第一选通信号。
第一电路部可以与选通驱动器的第一侧的边缘相邻布置。
第四电路部可以与被配置为输出进位信号的第三电路部相邻布置。
第六电路部和第七电路部可以与选通驱动器的第二侧的边缘相邻布置。
第七电路部可以包括：布置成彼此间隔开的多个子电路部；以及布置在子电路部之间的透明部。多个子电路部可以包括：第一子电路部，第一子电路部中的每一个被配置为上拉晶体管的一部分；以及第二子电路部，第二子电路部上方布置有被配置为将扫描时钟信号施加到上拉晶体管的第一布线。
第一电路部、第二电路部、第三电路部、第四电路部、第五电路部、第六电路部和第七电路部可以被统称为第一电路部至第七电路部。
第一电路部至第七电路部的至少一个可以被配置为生成对于操作第一电路部至第七电路部的至少一个有益的本地信号，并且本地信号可以包括用于控制上拉晶体管的导通/截止的Q节点信号、用于控制下拉晶体管的导通/截止的QB节点信号、进位信号CR、第一选通信号和第二选通信号、用于对Q节点充电/放电的M_o信号和用于像素感测的QB节点中的至少一个。
电路部可以包括：基板；电路元件层(或者“第一层”)，电路元件层布置在基板上方，并且电路元件布置在电路元件层上方；平坦化层(或者“第二层”)，平坦化层被配置为覆盖布置在电路元件层上方的电路元件；虚设反射层(或者“第三层”)，虚设反射层布置在平坦化层上方；以及封装层(或者“第四层”)，封装层被配置为覆盖虚设反射层，其中，虚设反射层可以包括反射电极。
电路部还可以包括：基板；电路元件层，电路元件层布置在基板上方，并且其上具有电路元件；平坦化层，平坦化层被配置为覆盖电路元件层上布置的电路元件；封装层，封装层形成在平坦化层上；覆盖基板，覆盖基板布置在封装层的上部上方；以及虚设滤色器，虚设滤色器布置在封装层和覆盖基板之间，其中，虚设滤色器可以包括包含着色剂的光敏树脂。
根据本公开的一个实施方式，提供了一种显示装置，该显示装置包括：显示面板，显示面板包括其上具有像素的显示区域和围绕显示区域的非显示区域；以及选通驱动器，选通驱动器布置在非显示区域上方。选通驱动器被配置为通过选通线向像素施加选通信号。显示区域和非显示区域中的每一个可以包括：电路部，电路部上具有电路元件。电路部彼此间隔开。透明部，透明部在电路部之间，并且外部光穿过透明部。
电路部可以包括：第一延伸部，第一延伸部沿第一方向延伸，并且其上具有电路元件；以及第二延伸部，第二延伸部沿与第一方向垂直的第二方向延伸，并且其上具有第二布线。第二布线提供彼此间隔开的电路部之间联接。第一延伸部在第二方向上的宽度可以大于第二延伸部在第一方向上的宽度。
选通驱动器可以包括：第一电路部，第一电路部被配置为控制提供给像素以用于像素感测的第二选通信号的输出；第二电路部，第二电路部被配置为设置布置在选通驱动器上方的Q节点的电压；第三电路部，第三电路部被配置为控制对设置在对应级之后的另一级的提供的进位信号的输出；第四电路部，第四电路部被配置为响应于从设置在对应级之前的另一级接收的进位信号而对Q节点的电压和设置在选通驱动器上方的QB节点的电压进行复位；第五电路部，第五电路部被配置为反转并且输出施加到Q节点和QB节点的信号；第六电路部，第六电路部被配置为通过响应于QB节点的电压而导通的至少一个下拉晶体管来输出处于栅极截止电压的第一选通信号；以及第七电路部，第七电路部被配置为通过响应于Q节点的电压而导通的至少一个上拉晶体管来输出处于栅极导通电压的第一选通信号。
第一电路部可以与非显示区域中的显示面板的边缘相邻布置，并且第六电路部和第七电路部可以与显示区域相邻布置。
第四电路部可以与被配置为输出进位信号的第三电路部相邻布置。
第七电路部可以包括：布置成彼此间隔开的多个子电路部；以及布置在子电路部之间的透明部，其中，多个子电路部可以包括：第一子电路部，第一子电路部中的每一个被配置为上拉晶体管的一部分；以及第二子电路部，第二子电路部上方布置有被配置为将扫描时钟信号施加到上拉晶体管的第一布线。
显示区域中的电路部可以包括：基板；电路元件层，电路元件层布置在基板上方，并且其上具有电路元件；平坦化层，平坦化层被配置为覆盖布置在电路元件层上方的电路元件；发光元件层，发光元件层布置在平坦化层上方，并且布置有发光元件，发光元件包括阳极电极、阴极电极和布置在阳极电极和阴极电极之间的发光层；封装层，封装层被配置为覆盖发光元件层；覆盖基板，覆盖基板布置在封装层的上部上方；以及滤色器，滤色器布置在封装层和覆盖基板之间，并且其中，非显示区域中的电路部可以包括：基板；电路元件层；平坦化层；虚设反射层，虚设反射层布置在平坦化层上方；以及封装层，虚设反射层被配置为覆盖虚设反射层，其中，虚设反射层可以由与阳极电极相同的材料形成。
显示区域中的电路部可以包括：基板；电路元件层，电路元件层布置在基板上方，并且电路元件布置在电路元件层上方；平坦化层，平坦化层被配置为覆盖布置在电路元件层上方的电路元件；发光元件层，发光元件层布置在平坦化层上方，并且布置有发光元件，发光元件包括阳极电极、阴极电极和布置在阳极电极和阴极电极之间的发光层；封装层，封装层被配置为覆盖发光元件层；覆盖基板，覆盖基板布置在封装层的上部；以及滤色器，滤色器布置在封装层和覆盖基板之间，并且其中，非显示区域中的电路部可以包括：基板；电路元件层；平坦化层；封装层，封装层布置在平坦化层上方；覆盖基板；以及虚设滤色器，虚设滤色器布置在封装层和覆盖基板之间，其中，虚设滤色器可以由与滤色器相同的材料形成。
像素可以包括红色(R)像素、绿色(G)像素和蓝色(B)像素，并且选通驱动器的电路部可以具有与R像素、G像素和B像素基本相同的尺寸和形状。
布置在显示区域上的透明部和布置在非显示区域上方的透明部可以具有相同的形状。
在根据本公开的一个实施方式的显示装置中，设置在非显示区域上方的选通驱动器以与显示区域中相同的方式由电路部和透明部形成，从而可以减小显示区域和非显示区域之间的视觉差异。
附图说明
当结合附图时，从下面的详细描述中将更会清楚地理解本公开的上述和其它技术优势、特征和其它优点，其中：
图1是示出根据本公开的一个实施方式的显示装置的配置的框图；
图2是示意性示出图1所示的显示装置的立体图；
图3是示出图1所示的像素的一个实施方式的电路图；
图4是示意性示出图1所示的选通驱动器的图；
图5是示出图4所示的阶段的操作的电路图；
图6是图2所示的区域的一个实施方式的放大图；
图7是图2所示的区域的另一实施方式的放大图；
图8是图7所示的电路部的放大图；
图9是示意性示出图8所示的构成级的电路部的框图；
图10是示意性示出第一上拉晶体管的示例的图；
图11是示出根据本公开的一个实施方式的显示区域的截面图；
图12是示出根据本公开的一个实施方式的非显示区域的截面图；以及
图13是示出图12中的虚设反射图案和虚设滤色器的布置状态的平面图。
具体实施方式
在下文中，将参照附图详细描述本公开的实施方式。在本说明书中，应当理解，当一个组件(或区域、层、部分)被称为位于另一组件“上”、“连接到”另一组件或“联接到”另一组件时，它可以直接设置在该另一组件上/连接到该另一组件/联接到该另一组件，或者也可以存在居间的第三组件。
相同的附图标记始终指代相同的元件。此外，在附图中，为了图示清楚，将组件的厚度、比例和尺寸放大。术语“和/或”包括一个或更多个相关列出项目的任何和全部组合。
应当理解，尽管本文使用诸如“第一”和“第二”的术语来描述各种元件，但是这些元件不应受到这些术语限制。这些术语仅用于区分一个组件和其它组件。例如，在不脱离所附权利要求的范围的前提下，在一个实施方式中被称为第一元件的第一元件可以在另一个实施方式中被称为第二元件。单数形式的术语可以包括复数形式，除非另有说明。
此外，“在…之下”、“在…下方”，“在…上方”，“在…之上”等用于解释附图中所示组件的关系关联。这些术语可以是相对概念，并基于附图中表达的方向进行描述。
术语“包括”或“包含”的含义指定性质、固定数量、步骤、操作、元件、组件或其组合，但不排除其它性质、固定数量、步骤、操作、元件、组件或其组合。
图1是示出根据本公开的一个实施方式的显示装置的配置的框图。
参照图1，显示装置1包括定时控制器10、选通驱动器20、数据驱动器30、电源40和显示面板50。
定时控制器10可以从外部接收图像信号RGB和控制信号CS。图像信号RGB可以包括多个灰度数据。定时控制器10可以处理图像信号RGB和控制信号CS，以使信号适合于显示面板50的操作条件，使得定时控制器10可以生成并且输出图像数据DATA、选通驱动控制信号CONT1、数据驱动控制信号CONT2和电源控制信号CONT3。
选通驱动器20可以通过多条第一选通线GL11至GL1n联接到显示面板50的像素PX。选通驱动器20可以基于从定时控制器10输出的选通驱动控制信号CONT1来生成选通信号。选通驱动器20可以通过多条第一选通线GL11至GL1n向像素PX提供所生成的选通信号。
在各个实施方式中，选通驱动器20还可以通过多条第二选通线GL21至GL2n联接到显示面板50的像素PX。选通驱动器20可以通过多条第二选通线GL21至GL2n向像素PX提供感测信号。
数据驱动器30可以通过多条数据线DL1至DLm联接到显示面板50的像素PX。数据驱动器30可以基于从定时控制器10输出的图像数据DATA和数据驱动控制信号CONT2来生成数据信号。数据驱动器30可以通过多条数据线DL1至DLm向像素PX提供所生成的数据信号。
在各个实施方式中，数据驱动器30还可以通过多条感测线(或参考线)SL1至SLm联接到显示面板50的像素PX。数据驱动器30可以通过多条感测线SL1至SLm向像素PX提供参考电压(感测电压或初始化电压)，或者可以基于从像素PX反馈的电信号来感测像素PX的状态。
电源40可以通过多条电源线PL1和PL2联接到显示面板50的像素PX。电源40可以基于电源控制信号CONT3来生成将要提供给显示面板50的驱动电压(例如，高电位驱动电压ELVDD和低电位驱动电压ELVSS)。电源40可以通过对应的电源线PL1和PL2向像素PX提供所生成的驱动电压ELVDD和ELVSS。
在显示面板50中，设置有多个像素PX(或称为子像素)。像素PX可以例如以矩阵形式排列在显示面板50上方。像素PX可以发出亮度与分别通过第一选通线GL11至GL1n和数据线DL1至DLm提供的选通信号和数据信号相对应的光。每个像素PX可以显示红色、绿色、蓝色和白色当中的任何一种。
图2是示意性示出图1所示的显示装置的立体图。
显示装置1可以以各种形状实现。例如，显示装置1可以以矩形板的形状实现。
显示面板50包括显示区域AA和非显示区域NAA。显示区域AA是其上方设置有像素PX的区域，并且可以被称为有源区。非显示区域NAA可以与显示区域AA相邻设置。
在非显示区域NAA中，例如，可以设置选通驱动器20作为用于驱动像素PX的驱动器。选通驱动器20可以以如图2所示的面板内栅极的方式形成在显示面板50的非显示区域NAA中。
在非显示区域NAA中，可以设置有多个焊盘(未示出)。焊盘可以不被绝缘层覆盖，但是可以暴露于显示面板50的外部，并且可以电联接到数据驱动器30、电路板70等。
柔性膜60设置有附接到显示面板50的焊盘区域PA的第一端，并且设置有附接到电路板70的第二端，使得显示面板50和电路板70可以电联接。柔性膜60可以包括用于电连接形成在焊盘区域PA中的焊盘和电路板70的布线的多条布线。
电路板70可以是印刷电路板或柔性印刷电路板。电路板70可以包括以集成电路的形式安装的定时控制器10和电源40。
图3是例示图1所示的像素的一个实施方式的电路图。作为示例，图3例示了联接到第i选通线GL1i和GL2i与第j数据线DLj的像素PXij。
参照图3，像素PX包括开关晶体管SST1、驱动晶体管DT、感测晶体管SST2、存储电容器Cst和发光元件LD。
开关晶体管SST1的第一电极(例如，漏极电极)电联接到第j数据线DLj，并且开关晶体管SST1的第二电极(例如，源极电极)电联接到第一节点N1。开关晶体管SST1的栅极电极电联接到第i条第一选通线GL1i。当通过第i条第一选通线GL1i施加处于栅极导通电平的选通信号时，开关晶体管SST1导通，并且将通过第j数据线DLj施加的数据信号发送到第一节点N1。
存储电容器Cst的第一电极电联接到第一节点N1，并且存储电容器Cst的第二电极联接到发光元件LD的第一电极。可以采用与施加到第一节点N1的电压和施加到发光元件LD的第一电极的电压之间的差相对应的电压对存储电容器Cst进行充电。
驱动晶体管DT的第一电极(例如，漏极电极)接收高电位驱动电压ELVDD，并且驱动晶体管DT的第二电极(例如，源极电极)电联接到发光元件LD的第一电极(例如，阳极电极)。驱动晶体管DT的栅极电极电联接到第一节点N1。当通过第一节点N1施加处于栅极导通电平的电压时，驱动晶体管DT导通并且可以根据提供给栅极电极的电压来控制流向发光元件LD的驱动电流的量。
感测晶体管SST2的第一电极(例如，漏极电极)电联接到第j感测线SLj，并且感测晶体管SST2的第二电极(例如，源极电极)电联接到发光元件LD的第一电极(例如，阳极电极)。感测晶体管SST2的栅极电极电联接到第i条第二选通线GL2i。当通过第i条第二选通线GL2i施加处于栅极导通电平的感测信号时，感测晶体管SST2导通，并且将通过第j感测线SLj施加的参考电压发送到发光元件LD的第一电极。
发光元件LD输出与驱动电流相对应的光。发光元件LD可以输出与红色、绿色、蓝色和白色当中的任何一种颜色相对应的光。发光元件LD可以是有机发光二极管(OLED)。
图4是示意性例示图1所示的选通驱动器的图，并且图5是例示图4所示的级的操作的电路图。
参照图4，选通驱动器20包括多个级ST1至STn。级ST1至STn包括用于分别接收可以作为全局信号施加的扫描时钟信号SCLK、进位时钟信号CCLK、来自前一级的开始信号Vst/进位信号CR、复位信号Rst、感测选择信号LSP、第一电源Vdd、第二电源Vdd_even/Vdd_odd和第三电源Vss的多个输入端子。另外，级ST1至STn包括用于分别联接第一选通线GL11至GL1n当中的任意一条和第二选通线GL21至GL2n当中的任意一条的多个输出端子。这种级ST1至STn可以响应于输入的全局信号和在级ST1至STn内部生成的本地信号而将第一选通信号GS11至GS1n提供给第一选通线GL11至GL1n并且可以将第二选通信号GS21至GS2n提供给第二选通线GL21至GL2n。
对级ST1至STn提供有扫描时钟信号SCLK和进位时钟信号CCLK。扫描时钟信号SCLK和进位时钟信号CCLK各自例示为单个信号，但是可以由多个时钟信号形成。例如，扫描时钟信号SCLK可以由第一扫描时钟信号至第i扫描时钟信号形成，并且进位时钟信号CCLK可以由第一进位时钟信号至第i进位时钟信号形成。
扫描时钟信号SCLK和进位时钟信号CCLK可以是其中重复高电压和低电压的方波信号。高电压可以大于低电压。这里，高电压时段与选通信号的宽度相对应，并且可以根据像素PX的电路结构和像素PX的操作方式而不同地设置。
在各个实施方式中，扫描时钟信号SCLK可以被设置为具有相同周期的信号，并且可以具有彼此偏移的相位。例如，第一扫描时钟信号至第i扫描时钟信号可以是具有从前一个扫描时钟信号偏移了1/i周期的形式的信号。类似地，进位时钟信号CCLK可以设置为具有相同周期的信号，并且可以具有彼此偏移的相位。例如，第一进位时钟信号至第i进位时钟信号可以是具有从前一个进位时钟信号偏移了1/i周期的形式的信号。在各个实施方式中，进位时钟信号CCLK可以是分别与对应扫描时钟信号SCLK同步的信号。然而，实施方式不限于此。
参照图5，每个级ST可以包括上拉晶体管Tup1、Tup2和Tup3，并且可以包括用于控制上拉晶体管Tup1、Tup2和Tup3的操作状态的控制电路CC。第一上拉晶体管Tup1的栅极联接到Q节点Q，并且在Q节点Q被设置为栅极导通电压时导通，使得处于栅极导通电平的扫描时钟信号SCLK可以作为第一选通信号GS1输出到第一选通线G11至G1n。第二上拉晶体管Tup2的栅极联接到Q节点Q，并且在Q节点Q被设置为栅极导通电压时导通，使得处于栅极导通电平的扫描时钟信号SCLK可以作为第二选通信号GS2输出到第二选通线G21至G2n。第三上拉晶体管Tup3响应于施加到第三上拉晶体管Tup3的栅极的电压而导通，并且可以输出处于栅极导通电平的进位时钟信号CCLK作为进位信号CR。
级ST1至STn可以接收开始信号Vst或从前一级输出的进位信号CR。开始信号Vst可以输入到第一级ST1的输入端子，并且来自前一级的进位信号CR可以输入到除了第一级ST1之外的级。这里，进位信号CR可以是从在该级之前布置的任一级输出的进位信号CR。可以通过从前一级向级ST1至STn提供处于栅极导通电平的开始信号Vst或进位信号CR来控制第一选通信号GS11至GS1n和第二选通信号GS21至GS2n的生成定时和输出定时。
级ST1至STn可以接收复位信号Rst。在一帧中的复位时段期间将复位信号Rst提供给级ST1至STn，使得图5所示的Q节点Q和QB节点QB的电压可以被初始化。在一个实施方式中，通过复位信号Rst，可以对Q节点Q进行充电，并且可以对QB节点QB进行放电。在一个实施方式中，复位时段可以包括在一帧的垂直消隐时段中。更具体地，复位时段可以被布置在感测时段之后。
级ST1至STn可以接收感测选择信号LSP。感测选择信号LSP是用于在一帧中的感测时段期间控制第二选通信号GS21至GS2n的输出的信号。在一个实施方式中只有接收处于栅极导通电平的感测选择信号LSP的级可以被控制为在感测时段期间输出第二选通信号GS21至GS2n。在感测时段期间，可以针对施加了第二选通信号GS21至GS2n的像素PX来感测驱动晶体管DT的移动性、阈值电压和发光元件LD的电流特性。在一个实施方式中，感测时段可以包括在一帧中的垂直消隐时段中。
第一电源Vdd是被施加以对Q节点Q进行充电的电压，并且可以电联接到Q节点Q。这种第一电源Vdd可以被设置为足以导通联接到Q节点Q的上拉晶体管Tup1、Tup2和Tup3的栅极导通电平。
第二电源Vdd_even/Vdd_odd是被施加以对QB节点QB进行充电的电压，并且可以电联接到QB节点QB。这种第二电源Vdd_even/Vdd_odd可以设置为足以导通联接到QB节点QB的下拉晶体管Tdown1、Tdown2和Tdown3的栅极导通电平。
第三电源Vss可以是用于将级ST1至STn接地并且用于生成处于栅极截止电平的选通信号GS11至GS1n和GS21至GS2n以及进位信号CR二者的电压。
参照图5，级ST1至STn可以包括下拉晶体管Tdown1、Tdown2和Tdown3，并且可以包括用于控制下拉晶体管Tdown1、Tdown2和Tdown3的操作状态的控制电路CC。第一下拉晶体管Tdown1的栅极联接到QB节点QB，并且在QB节点QB被设置为栅极导通电压时导通，使得处于栅极截止电平的第三电源Vss可以作为第一选通信号输出到第一选通线G11至G1n。第二下拉晶体管Tdown2的栅极联接到QB节点QB，并且在QB节点QB被设置为栅极导通电压时导通，使得处于栅极截止电平的第三电源Vss可以作为第二选通信号输出到第二选通线G21至G2n。第三下拉晶体管Tdown3响应于施加到第三下拉晶体管Tdown3的栅极的电压而导通，并且可以输出处于栅极截止电平的第三电源Vss作为进位信号CR。
在图4和图5中，全部的级ST1至STn都联接到单个第三电源Vss。然而，实施方式不限于此，并且级ST1至STn可以联接到多个低电位电源。例如，考虑构成选通驱动器20的电路元件的特性，并且考虑构成像素PX的电路元件，而且考虑显示装置1的功耗，第一下拉晶体管Tdown1、第二下拉晶体管Tdown2和第三下拉晶体管Tdown3可以联接到不同的低电位电源。
在各个实施方式中，图5所示的级ST1至STn可以由彼此分离的多个电路部形成。在下文中，将描述级ST1至STn的详细实施方式。
图6是图2所示的区域A1的一个实施方式的放大图。图7是图2所示的区域A1的另一个实施方式的放大图。
参照图6和图7，根据本公开的一个实施方式的显示面板50包括显示区域AA和非显示区域NAA。显示区域AA和非显示区域NAA中的每一个包括电路部CA和透明部TA。透明部TA和电路部CA可以彼此相邻并且以连续而不是物理分离的方式设置。电路部CA所在的区可以被称为电路区域CA(即，电路所在区域的面积)。该电路本身可以位于不同的层中，因此可以在X平面、Y平面和/或Z平面中。这将参照图11和图12更详细地描述。电路区在X平面和Y平面中的延伸是电路区域并且可以被认为是由电路部CA占用的面积。类似地，透明部TA所在的区域为透明部所占的面积。
在显示区域AA和非显示区域NAA中，电路部CA和透明部TA通常具有相同的尺寸和形状，并且可以以相同的方式布置。因此，显示区域AA和非显示区域NAA可以具有相同的视觉感受，并且显示装置1可以有效地用作透明显示装置。
这里，术语“相同”的含义包括考虑工艺余量的偏差。例如，在显示区域AA和非显示区域NAA中，电路部CA和透明部TA都可以包括在其第一侧的数μm内的尺寸改变(工艺余量)。例如，针对显示区域AA中的透明部TA的第一侧，非显示区域NAA中的透明部TA的第一侧可以被布置为在5μm的范围内在左/右方向和上/下方向上更大或更小。另外，针对显示区域AA中的电路部CA的第一侧，非显示区域NAA中的电路部CA的第一侧可以被布置为在5μm的范围内在左/右方向和上/下方向上更大或更小。在下面的实施方式中将应用相同的方式。
在显示区域AA中，构成像素PX的至少一个电路元件、联接到电路元件的发光元件以及连接其间的布线可以被设置在电路部CA上方。在一个实施方式中，一个单位像素PXU可以被设置在一个电路部CA上方。例如，单位像素PXU可以由分别以红色、绿色、蓝色和白色照明的全部或部分像素PX形成。在一个实施方式中，单位像素PXU的不同颜色组合可以被设置在电路部CA上方。
在非显示区域NAA中，用于驱动像素PX的电路元件可以被设置在电路部CA上方。例如，在非显示区域NAA中，构成选通驱动器20的电路元件可以被设置在电路部CA上方。如上所述，显示区域AA中的电路部CA和非显示区域NAA中的电路部CA通常在尺寸和形状上相似。通常，构成选通驱动器20的选通驱动器包括比单位像素PXU更多的电路元件，并且具有更大的面积。因此，为了使显示区域AA和非显示区域NAA中的电路部CA的尺寸和形状形成为大致相同，可以跨多个电路部CA实现一个级ST。此时，电路部CA可以通过将透明部TA定位在其间而彼此分离。
在图6的实施方式中，电路部CA具有矩形形状。也就是说，电路区域为矩形形状。本文所述的电路部的形状是指电路区域(也可以被称为电路区域面积)的形状。类似地，本文所述的透明部的形状是指透明区域的形状。在图6和其它平面图中，X维度是水平的(即，从左到右)并且Y维度是垂直的、从上到下的维度。这是构成该区域的两个维度，该区域也可以被视为电路部CA的封装外形。如图11和图12所示，Z维度在页中。在图7的实施方式中，由电路部CA覆盖的区域具有十字形状或风车形状。在这些实施方式中，如图6中的一个单位像素PXU中所例示，可以从上到下依次布置红色像素R、绿色像素G、蓝色像素B和白色像素W。此外，可以如图7中的一个单位像素PXU中所例示的那样布置红色像素R、绿色像素G、蓝色像素B和白色像素W，但是实施方式不限于此。
另外，在该实施方式中，电路部CA的形状和布置在电路部CA处的像素PX的布置状态可以进行不同修改。在下文中，以具有形成为十字形状或风车形状的电路部CA的显示面板50为例来描述实施方式。
透明部TA是除了电路部CA之外的区域，并且是没有设置电路部CA和发光元件LD的区域。透明部TA具有透光性质，并且可以被形成为是透明或半透明的，以使入射光穿过其中。为此，层叠在透明部TA上方的层可以是具有透明性质或半透明性质的材料。由于电路部CA和透明部TA被设置在显示区域AA处，所以显示面板50被实现为不仅显示图像，而且能够观看在显示面板50的相对侧的背景图像的透明显示器。
图8是图7所示的电路部的放大图。图8所示的电路部CA可以是布置在显示区域AA或非显示区域NAA处的电路部CA。
参照图8，根据本公开的一个实施方式的电路部CA可以具有十字的形状。具体地，电路部CA可以包括：第一延伸部A，其沿第一方向DR1延伸；以及第二延伸部B，其沿与第一方向DR1大致垂直的第二方向DR2延伸，并且与第一延伸部A交叠。交叠部C形成在第一延伸部A和第二延伸部B彼此交叠的区域中。第一方向DR1可以被认为是Y维度并且第二方向DR2可以被认为是X方向。
在显示区域AA中，构成至少一个像素PX的电路元件可以设置在第一延伸部A上方。电路元件可以包括晶体管、电容器等。另外，在显示区域AA中，用于将电路元件连接在一起并且用于向电路元件施加信号的布线可以设置在第二延伸部B上方。通常，布线比电路元件占用更少的面积，使得第一延伸部A的宽度W大于第二延伸部B的宽度W2。以此方式，通过将具有较大面积的电路元件布置在第一延伸部A上方并且将具有较小面积的布线布置在第二延伸部B上方，电路部CA周围的透明部TA的面积增大，并且可以增大显示面板50的透明度。
在非显示区域NAA中，构成一部分级ST的电路元件可以被设置在第一延伸部A上方。此时，构成级ST的电路元件当中执行相同功能的电路元件可以被设置在单个第一延伸部A上方以形成电路块。多个电路块可以被设置在单个第一延伸部A上方。
在非显示区域NAA中，用于将全局信号施加到级ST的第一布线还可以被设置在第一延伸部A上方。全局信号的类型和数量比后面描述的本地信号更多，并且针对设置在非显示区域NAA上方的电路部CA中的每一个独立地施加全局信号是有益的。因此，由于用于提供全局信号的第一布线的数量很大，所以第一布线设置在具有较大面积的第一延伸部A上方。
在非显示区域NAA中，用于在电路部CA之间发送和接收本地信号的第二布线可以设置在第二延伸部B上方。本地信号是从电路块中的每一个生成的信号，并且可以包括：用于控制图5所示的上拉晶体管Tup1、Tup2和Tup3的导通/截止的Q节点信号；用于控制下拉晶体管Tdown1、Tdown2和Tdown3的导通/截止的QB节点信号；第一选通信号和第二选通信号；进位信号CR；以及用于对用于像素感测的Q节点Q和QB节点QB进行充电/放电的M_o信号。本地信号可以通过设置在第二延伸部B上方的第二布线发送到彼此间隔开的其它电路块，或者可以输出到级ST外部。
本地信号的数量和类型通常少于全局信号。因此，通过将用于全局信号的第一布线布置在第一延伸部A上方并且将用于本地信号的第二布线布置在第二延伸部B上方，第二延伸部B的宽度W2可以比第一延伸部A的宽度W1更窄。
以此方式，显示区域AA中的第一延伸部A和第二延伸部B之间的面积比通常与非显示区域NAA中的第一延伸部A和第二延伸部B之间的面积比相同。因此，显示区域AA和非显示区域NAA可以具有基本相同的视觉表现。
在交叠部C中，从第一延伸部A沿第一方向DR1延伸的第一布线和从第二延伸部B沿第二方向DR2延伸的第二布线可以彼此交叠。至少一个绝缘层可以设置在第一布线和第二布线之间，使得第一布线和第二布线之间的空间可以绝缘。第一布线和第二布线可以通过形成在交叠部C处的接触孔而电联接。
图9是示意性示出构成图8所示的级的电路部的框图。图10是示意性示出第一上拉晶体管的示例的图。
参照图9和图10，在一个实施方式中，单级ST可以跨多个电路部CA1至CA7实现。电路部CA中的每一个可以包括作为执行相同或相似功能的一组电路元件的第一电路块至第十四电路块。通过在单个电路部CA内设置执行类似功能的电路块，可以减少联接彼此间隔开的电路部CA的第二布线的数量。为了减少第二布线的数量，每个电路部CA可以被配置为直接生成对操作电路部CA有益的本地信号。在各个实施方式中，联接彼此间隔开的电路部CA的第二布线的数量可以是三条或四条，但是实施方式不限于此。
第一电路部CA1可以控制用于像素感测的第二选通信号GS21至GS2n的输出。例如，第一电路部CA1可以在一帧中的感测时段期间将第二选通信号GS21至GS2n输出到第二选通线GL21至GL2n。
在一个实施方式中，第一电路部CA1可以包括：第一电路块，其被配置为生成用于在像素感测期间对Q节点Q充电/放电的M_o信号；第二电路块，其被配置为在像素感测期间复位QB节点QB；以及第三电路块，其被配置为在像素感测期间对Q节点Q进行充电。第一电路块可以响应于来自前一级的感测选择信号LSP和进位信号CR而输出M_o信号。第二电路块可以响应于从第一电路块输出的M_o信号、来自前一级的进位信号CR和复位信号Rst而将QB节点QB设置为栅极截止电压。第三电路块可以响应于复位信号Rst而将Q节点Q设置为栅极导通电压。
在一个实施方式中，第一电路部CA1可以设置在级ST的第一侧的边缘上方(例如，非显示区域NAA的最外面的区域)，以减少来自在操作选通驱动器20时生成的电压变化的电效应。由于第一电路部CA1设置在非显示区域NAA的最外面的区域上方，所以可以更容易地实现在第一电路部CA1内形成电容器。
第二电路部CA2被配置为设置Q节点Q的电压。由于第二电路部CA2设置Q节点Q的电压，所以可以控制选通信号GS21至GS2n的输出。第二电路部CA2可以包括被配置为对将要输出选通信号GS21至GS2n的级ST的Q节点Q进行充电的第四电路块。第四电路块可以响应于来自前一级的进位信号CR而将Q节点Q设置为栅极导通电压或栅极截止电压。
第三电路部CA3可以控制进位信号CR的输出。在一个实施方式中，第三电路部CA3可以包括：第五电路块，其被配置为控制第三上拉晶体管Tup3的导通/截止；以及第六电路块，其被配置为控制第三下拉晶体管Tdown3的导通/截止。
第五电路块可以响应于进位时钟信号CCLK而控制第三上拉晶体管Tup3的导通/截止。当第三上拉晶体管Tup3导通时，可以输出栅极导通电压的进位信号。
第六电路块可以基于第二电源Vdd_even/Vdd_odd来控制第三下拉晶体管Tdown3的导通/截止。当第三下拉晶体管Tdown3导通时，可以输出栅极截止电压的进位信号。
第四电路部CA4可以复位Q节点Q和QB节点QB的电压。在一帧的垂直消隐时段中，可以通过第四电路部CA4将Q节点Q复位到栅极低电压，并且可以将QB节点QB复位到栅极导通电压。
在一个实施方式中，第四电路部CA4可以包括：第七电路块和第八电路块，其被配置为复位Q节点Q的电压；以及第九电路块和第十电路块，其被配置为复位QB节点QB的电压。
响应于来自前一级的进位信号，第七电路块和第八电路块可以通过使用第二电源Vdd_even/Vdd_odd和第三电源Vss将Q节点Q复位到栅极截止电压。第九电路块和第十电路块可以通过使用第二电源Vdd_even/Vdd_odd和第三电源Vss将QB节点QB复位到栅极导通电压。
在一个实施方式中，由于第四电路部CA4接收到来自前一级的进位信号，所以第四电路部CA4可以被设置为与输出进位信号CR的第三电路部CA3相邻。尽管在图9中示出了第四电路部CA4设置在第三电路部CA3的右侧，但是第四电路部CA4可以设置在第三电路部CA3的左侧。以此方式，由于输出进位信号的第三电路部CA3和响应于从第三电路部CA3输出的进位信号CR而操作的第四电路部CA4彼此相邻设置，因此可以减少第二布线的数量和长度。
第五电路部CA5可以执行逆变器操作。第五电路部CA5可以包括被配置为输出信号的第十一电路块，该信号是通过反转Q节点Q和QB节点QB的电压而形成的信号。除了第一电路部CA1之外，第五电路部CA5可以与设置/复位Q节点Q和QB节点QB的电压的任何其它电路部相邻设置。也就是说，第五电路部CA5可以设置在第一电路部CA1和第六电路部CA6之间的任何地方。尽管在图9中示出了第五电路部CA5被设置在第四电路部CA4和第六电路部CA6之间，但是实施方式不限于此，并且第五电路部CA5在布置中可以相对自由。
第六电路部CA6可以包括第十二电路块和第十三电路块。第十二电路块和第十三电路块中的每一个可以包括至少一个第一下拉晶体管Tdown1，并且可以响应于QB节点QB的电压向第一选通线GL11至GL1n输出处于栅极截止电压的第一选通信号GS11至GS1n。
第七电路部CA7可以包括第十四电路块。第十四电路块可以包括至少一个第一上拉晶体管Tup1，并且可以响应于Q节点Q的电压向第一选通线GL11至GL1n输出处于栅极截止电压的第一选通信号GS11至GS1n。
通常，第一上拉晶体管Tup1在构成选通驱动器20的晶体管当中具有最大的面积，使得第一上拉晶体管Tup1可以被配置为多个子电路部。例如，如图10所示，第一上拉晶体管Tup1可以由多个第七子电路部CA7-1和CA7-2形成。多个第七子电路部CA7-1和CA7-2中的每一个可以被配置为第一上拉晶体管Tup1的一部分。当第一上拉晶体管Tup1由多个第七子电路部CA7-1和CA7-2形成时，由于第一上拉晶体管Tup1联接到扫描时钟信号SCLK，所以可以增大将扫描时钟信号SCLK施加到第一上拉晶体管Tup1的布线的长度。随着布线的长度增大，图8所示的第二延伸部B的面积增大。因此，可能降低显示面板50的透明度，并且可能增大显示区域AA和非显示区域NAA之间的视觉差异。为了避免这个问题，构成第一上拉晶体管Tup1的多个第七子电路部CA7-1和CA7-2可以被设置为与仅由扫描时钟信号布线形成的第八子电路部CA8-1和CA8-2相邻。形成第一上拉晶体管Tup1的多个第七子电路部CA7-1和CA7-2以及仅由扫描时钟信号SCLK布线形成的第八子电路部CA8-1和CA8-2二者可以沿着第二方向DR2依次设置。通过使用这种结构，可以确保足够用于第一上拉晶体管Tup1的电路面积，并且可以减少扫描时钟信号SCLK布线的阻抗。此外，可以通过防止第二延伸部B的面积增大来保证显示面板50的透明度。
为了减少在选通驱动器20内部延伸的第一选通线GL11至GL1n的长度，选通驱动器20(例如，第六电路部CA6和第七电路部CA7)的第二侧的边缘可以设置为最邻近显示区域AA。例如，第六电路部CA6和第七电路部CA7都可以设置为比第一电路部、第二电路部、第三电路部、第四电路部和第五电路部CA1-CA5更靠近显示区域AA。单独地，第七电路部CA7可以直接与显示区域AA相邻设置，并且第六电路部CA6可以与显示区域AA相邻设置(例如，第七电路部CA7设置在它们之间)。
在图9中，示出了由七个电路部CA1至CA7形成的选通驱动器20。然而，实施方式不限于此，选通驱动器20可以由多于或少于七个电路部形成。此外，电路部CA1至CA7中的每一个可以由更多或更少数量的电路块形成。
图11是示出根据本公开的一个实施方式的显示区域中的电路部CA和透明部TA的截面图。参照图11，在显示区域AA中，显示面板50包括电路部CA和透明部TA。像素PX设置在电路部CA上方，并且仅有透明绝缘层设置在透明部TA上方，以使入射光通过。
构成电路部本身的部分可以位于任何层，因此是三个维度。图11示出作为上下的Z维度，并且X维度水平延伸。例如，电路部CA可以包括：基板100；设置在基板100上方的电路元件层CEL；以及发光元件层LDL。图11的俯视图可以如图6、图7和图8所示。
作为构成像素PX的电路元件，至少一个晶体管、电容器和布线可以设置在电路元件层CEL上方。这些不同的电路元件一起构成电路部CA。透明绝缘层设置在构成电路元件的电极之间，使得电极之间的空间可以绝缘。电路元件被钝化层和/或覆盖层覆盖，从而可以保护电路元件免受外来物质的影响。另外，电路元件的不平坦上表面被保护层(平坦化层)覆盖，从而可以防止由不平坦表面引起的外部光的漫反射。
发光元件设置在发光元件层LDL上方。发光元件包括阳极电极、发光层和阴极电极。这些不同的电路元件一起也构成电路部CA。当显示面板50是顶部发射型时，阳极电极可以是反射电极，并且阴极电极可以是透射电极。然而，当显示面板50是底部发射型时，阳极电极可以是透射电极，并且阴极电极可以是反射电极。在下文中，将例示和描述顶部发射型的显示面板50的实施方式。
电路元件和发光元件可以被封装层PAC覆盖。封装层PAC用于防止外部湿气渗透到电路元件和发光元件中。封装层PAC可以由无机绝缘材料形成，或者可以形成为具有依次层叠的无机绝缘材料和有机绝缘材料的结构，但是不限于此。
覆盖基板200可以形成在封装层PAC的上部。覆盖基板200可以通过粘合剂等接合到封装层PAC
滤色器CF可以形成在封装层PAC和覆盖基板200之间。滤色器CF的一部分可以设置成与发光元件交叠。该CF和BM一起还包括电路部CA。滤色器CF是通过透射特定波长带中的光并且阻挡其它特定波长带中的光来选择性地透射入射光的部分波长带的波长选择滤光器。滤色器CF可以由包括着色剂(例如，颜料、染料等)的光敏树脂形成。从发光元件输出并且通过滤色器CF的光可以具有红色、绿色和蓝色当中的任何一种颜色。针对显示白色的像素PX，可以省略滤色器CF。黑矩阵BM形成在滤色器CF之间，从而可以防止发光区域之间的漏光现象。
图12是例示根据本公开的一个实施方式的非显示区域的截面图，并且图13是例示图12中的虚设反射图案和虚设滤色器的布置状态的平面图。
参照图12，在非显示区域NAA，显示面板50包括电路部CA和透明部TA。选通驱动器20的电路块设置在电路部CA上方，并且仅有透明绝缘层设置在透明部TA上方，使得入射光穿过其中。在图12中，属于电路部的元件包括CEL和ANO’以及CF’和BM’。
在各个实施方式中，非显示区域NAA具有与显示区域AA基本相似的层结构。也就是说，设置在非显示区域NAA上方的电路块CB可以形成为与像素PX类似的层叠层结构。例如，因为选通驱动器20并未执行发光操作，所以选通驱动器20可能不需要从滤色器CF和阳极电极受益。然而，为了提供与显示区域AA的视觉相似性，选通驱动器20可以包括虚设滤色器CF’和虚设反射图案ANO’。虚设反射图案ANO’可以是或包括虚设反射层，并且可以被称为虚设反射层ANO’。虚设反射图案ANO’也可以被称为虚设阳极电极ANO’，应理解为虚设阳极ANO’与阳极电极类似，但可以不提供阳极电极的电功能，并且可以提供阳极电极的光学功能(例如，反射率)。在下文中，将参照选通驱动器20的截面图来描述选通驱动器20的具体结构。
例如，电路部CA可以包括基板100和设置在基板100上方的电路元件层CEL。在电路元件层CEL中，至少一个晶体管、电容器和布线可以设置为构成电路块的电路元件。电路部所在的区域可以认为是电路区。透明绝缘层设置在构成电路元件的电极之间，使得电极之间的空间可以绝缘。电路元件被钝化层和/或覆盖层覆盖，从而可以保护电路元件免受外来物质的影响。另外，保护层是平坦化层，其使电路元件的上表面上方形成的不平坦表面平坦化，从而可以防止由不平坦表面漫反射的外部光所引起的与显示区域AA的视觉差异。
虚设反射图案ANO’可以形成在电路元件层CE1上方。虚设反射图案ANO’可以由设置在显示区域AA上方的阳极电极的相同材料形成。例如，虚设反射图案ANO’可以由反射电极形成。在一个实施方式中，虚设反射图案ANO’由反射层形成，并且反射层可以由铝(Al)、铜(Cu)、银(Ag)、镍(Ni)或其合金形成。
电路部CA内的虚设反射图案ANO’的平面上的布置可以与像素PX内的阳极电极的布置相对应。另外，虚设反射图案ANO’可以具有与阳极电极相同或相似的形状，但不限于此。虚设反射图案ANO’可以在与阳极电极相同的单一工艺中形成，但不限于此。
在一个实施方式中，为了防止由与周围元件的联接引起的干扰，可以将特定的DC电源施加到虚设反射图案ANO’。例如，DC电源可以是第三电源Vss，但不限于此。在另一实施方式中，虚设反射图案ANO’可以不施加电源而是可以浮置。
虚设反射图案ANO’可以反射外部光。通过虚设反射图案ANO’，设置有像素PX的显示区域AA和设置有选通驱动器20的非显示区域NAA可以具有大致相同的反射率，并且可以提高显示区域AA和非显示区域NAA之间的视觉相似性。
虚设反射图案ANO’可以被封装层PAC覆盖。
覆盖基板200可以形成在封装层PAC的上部上方。覆盖基板200可以通过粘合剂等接合到封装层PAC。
虚设滤色器CF’还可以形成在封装层PAC和覆盖基板200之间。虚设滤色器CF’的一部分可以设置成与虚设反射图案ANO’交叠。虚设滤色器CF’可以由与滤色器CF相同的材料形成。例如，虚设滤色器CF’可以由包括着色剂(例如，颜料、染料等)的光敏树脂形成。黑矩阵BM形成在虚设滤色器CF’之间。
滤色器CA内的虚设反射图案CF’的平面上的布置可以与像素PX内的滤色器CF的布置相对应。例如，当红色、绿色、蓝色和白色的像素PX以十字形状布置在显示区域AA上时，红色、绿色、蓝色的虚设滤色器CF’可以以十字形状布置在非显示区域NAA上。在与白色像素PX相对应的位置，可以省略虚设滤色器CF’。
另外，虚设滤色器CF’可以具有与滤色器CF相同或相似的形状，但不限于此。虚设滤色器CF’可以通过与滤色器CF相同的单一工艺形成，但不限于此。
通过虚设滤色器CF’，设置有像素PX的显示区域AA和设置有选通驱动器20的非显示区域NAA可以具有大致相同的视觉感受，并且可以提高显示区域AA和非显示区域NAA之间的视觉相似性。
上面已经参照附图描述了本公开的实施方式，但是应当理解，本公开所属领域的技术人员在不改变本公开的技术精神或特征的情况下，可以以其它特定形式实践本公开的技术配置。因此，上述实施方式在所有方面都应理解为例示性的而非限制性的。另外，本公开的范围由以下权利要求而非具体描述指示。另外，从权利要求及其等同构思的含义和范围得出的所有修改或变型都应被解释为包括在本公开的范围内。
相关申请的相交引用
本申请要求于2020年12月22日提交的韩国专利申请第10-2020-0180990号的优先权，出于所有目的，其全部内容通过引用结合于此。

Claims (22)

1.一种选通驱动器，所述选通驱动器包括：
多个电路部，所述多个电路部具有布置在所述多个电路部上的电路元件，所述多个电路部彼此间隔开；以及
多个透明部，所述多个透明部布置在所述电路部之间，所述多个透明部允许外部光从中穿过，
其中，所述多个电路部中的每一个包括多个电路块，所述多个电路块中的每一个被配置为执行与所述多个电路块中的其它电路块相同的功能。
2.根据权利要求1所述的选通驱动器，其中，所述多个电路部中的每一个包括：
第一延伸部，所述第一延伸部沿第一方向延伸，其中，所述电路部的电路元件在所述第一延伸部上；以及
第二延伸部，所述第二延伸部沿与所述第一方向垂直的第二方向延伸，其中，第二布线在所述第二延伸部上，所述第二布线被配置为将所述多个电路部的彼此间隔开的电路部彼此联接。
3.根据权利要求2所述的选通驱动器，其中，所述第一延伸部在所述第二方向上的宽度大于所述第二延伸部在所述第一方向上的宽度。
4.根据权利要求3所述的选通驱动器，所述选通驱动器还包括被配置为向所述电路部中的每一个施加全局信号的多条第一布线，其中，所述全局信号包括扫描时钟信号、进位时钟信号、开始信号、复位信号、感测选择信号、第一电源、第二电源和第三电源中的至少一个。
5.根据权利要求4所述的选通驱动器，其中，所述多个电路部包括：
第一电路部，所述第一电路部被配置为控制提供给像素以用于像素感测的第二选通信号的输出；
第二电路部，所述第二电路部被配置为设置布置在所述选通驱动器上方的第一节点的电压；
第三电路部，所述第三电路部被配置为控制提供给布置在对应级之后的另一级的进位信号的输出；
第四电路部，所述第四电路部被配置为响应于从布置在所述对应级之前的另一级接收的进位信号而对所述第一节点的电压和布置在所述选通驱动器上方的第二节点的电压进行复位；
第五电路部，所述第五电路部被配置为反转并且输出施加到所述第一节点和所述第二节点的信号；
第六电路部，所述第六电路部被配置为通过响应于所述第二节点的电压而导通的至少一个下拉晶体管来输出处于栅极截止电压的第一选通信号；以及
第七电路部，所述第七电路部被配置为通过响应于所述第一节点的电压而导通的至少一个上拉晶体管来输出处于栅极导通电压的第一选通信号。
6.根据权利要求5所述的选通驱动器，其中，所述第一电路部与所述选通驱动器的第一侧的边缘相邻布置。
7.根据权利要求5所述的选通驱动器，其中，所述第四电路部与被配置为输出进位信号的所述第三电路部相邻布置。
8.根据权利要求5所述的选通驱动器，其中，所述第六电路部和所述第七电路部与所述选通驱动器的第二侧的边缘相邻布置。
9.根据权利要求5所述的选通驱动器，其中，所述第七电路部包括：
多个子电路部，每个所述多个子电路部与多个子电路部中的其它子电路部彼此间隔开；以及
所述多个透明部的所述透明部，所述多个透明部的所述透明部布置在所述子电路部之间，
其中，所述多个子电路部包括：
第一子电路部，所述第一子电路部中的每一个被配置为所述上拉晶体管的一部分；以及
第二子电路部，所述第二子电路部上具有所述第一布线，所述第一布线被配置为将扫描时钟信号施加到所述上拉晶体管。
10.根据权利要求9所述的选通驱动器，其中，
所述第一电路部、所述第二电路部、所述第三电路部、所述第四电路部、所述第五电路部、所述第六电路部和所述第七电路部的至少一个被配置为生成用于操作所述第一电路部、所述第二电路部、所述第三电路部、所述第四电路部、所述第五电路部、所述第六电路部和所述第七电路部的至少另一个的本地信号，并且
所述本地信号包括以下中的至少一个：
用于控制所述上拉晶体管的导通/截止的第一信号，
用于控制所述下拉晶体管的导通/截止的第二信号，
所述进位信号，
所述第一选通信号和所述第二选通信号，以及
用于对用于像素感测的所述第一节点和所述第二节点进行充电/放电的第三信号。
11.根据权利要求1所述的选通驱动器，其中，所述电路部还包括：
基板；
电路元件层，所述电路元件层布置在所述基板上方，并且所述电路元件布置在所述电路元件层上；
平坦化层，所述平坦化层被配置为覆盖布置在所述电路元件层上方的所述电路元件；
虚设反射层，所述虚设反射层布置在所述平坦化层上方；以及
封装层，所述封装层被配置为覆盖所述虚设反射层，
其中，所述虚设反射层由反射电极形成。
12.根据权利要求1所述的选通驱动器，其中，所述电路部还包括：
基板；
电路元件层，所述电路元件层布置在所述基板上方，并且所述电路元件布置在所述电路元件层上；
平坦化层，所述平坦化层被配置为覆盖布置在所述电路元件层上的所述电路元件；
封装层，所述封装层形成在所述平坦化层上方；
覆盖基板，所述覆盖基板布置在所述封装层的上部上方；以及
虚设滤色器，所述虚设滤色器布置在所述封装层和所述覆盖基板之间，
其中，所述虚设滤色器由包含着色剂的光敏树脂形成。
13.一种显示装置，所述显示装置包括：
显示面板，所述显示面板包括其上具有像素的显示区域和围绕所述显示区域的非显示区域；以及
选通驱动器，所述选通驱动器布置在所述非显示区域上方并且被配置为通过选通线向所述像素施加选通信号，
其中，所述显示区域和所述非显示区域中的每一个包括：
电路部，电路元件布置在所述电路部上方，所述电路部布置成彼此间隔开；以及
透明部，所述透明部布置在所述电路部之间，所述透明部使外部光从中穿过。
14.根据权利要求13所述的显示装置，其中，所述电路部中的每一个包括：
第一延伸部，所述第一延伸部沿第一方向延伸，所述第一延伸部上具有所述电路元件；以及
第二延伸部，所述第二延伸部沿与所述第一方向垂直的第二方向延伸，所述第二延伸部上具有第二布线，其中，所述第二布线将所述电路部彼此联接，
其中，所述第一延伸部在所述第二方向上的宽度大于所述第二延伸部在所述第一方向上的宽度。
15.根据权利要求13所述的显示装置，其中，所述选通驱动器包括：
第一电路部，所述第一电路部被配置为控制提供给像素以用于像素感测的第二选通信号的输出；
第二电路部，所述第二电路部被配置为设置联接到所述选通驱动器的第一节点的电压；
第三电路部，所述第三电路部被配置为控制向对应级之后的另一级的提供的进位信号的输出；
第四电路部，所述第四电路部被配置为响应于从设置在所述对应级之前的另一级接收的进位信号而对所述第一节点的电压和联接到所述选通驱动器的第二节点的电压进行复位；
第五电路部，所述第五电路部被配置为反转并且输出施加到所述第一节点和所述第二节点的信号；
第六电路部，所述第六电路部被配置为通过响应于所述第二节点的电压而导通的至少一个下拉晶体管来输出处于栅极截止电压的第一选通信号；以及
第七电路部，所述第七电路部被配置为通过响应于所述第一节点的电压而导通的至少一个上拉晶体管来输出处于栅极导通电压的第一选通信号。
16.根据权利要求15所述的显示装置，其中，所述第一电路部与所述非显示区域中的所述显示面板的边缘相邻布置，并且所述第六电路部和所述第七电路部被布置为比所述第一电路部、所述第二电路部、所述第三电路部、所述第四电路部和所述第五电路部更靠近所述显示区域。
17.根据权利要求15所述的显示装置，其中，所述第四电路部与被配置为输出进位信号的所述第三电路部相邻布置。
18.根据权利要求15所述的显示装置，其中，所述第七电路部包括：
布置成彼此间隔开的多个子电路部；以及
布置在所述子电路部之间的所述透明部，
其中，所述多个子电路部包括：
第一子电路部，所述第一子电路部中的每一个被配置为所述上拉晶体管的一部分；以及
第二子电路部，所述第二子电路部上具有第一布线，所述第一布线被配置为将扫描时钟信号施加到所述上拉晶体管。
19.根据权利要求13所述的显示装置，其中，所述显示区域中的所述电路部包括：
基板的第一区域；
电路元件层的第一区域，所述电路元件层的所述第一区域布置在所述基板上方，所述电路元件层上具有所述电路元件；
平坦化层的第一区域，所述平坦化层的所述第一区域被配置为覆盖所述电路元件层上布置的所述电路元件；
发光元件层的第一区域，所述发光元件层的所述第一区域布置在所述平坦化层上，并且包括发光元件，所述发光元件中的每一个包括：
阳极电极，
阴极电极，以及
布置在所述阳极电极和所述阴极电极之间的发光层；
封装层的第一区域，所述封装层的所述第一区域被配置为覆盖所述发光元件层；覆盖基板的第一区域，所述覆盖基板的所述第一区域布置在所述封装层的上部上方；以及
滤色器，所述滤色器布置在所述封装层和所述覆盖基板之间，
其中，所述非显示区域中的所述电路部中的每一个包括：
所述基板的第二区域；
所述电路元件层的第二区域；
所述平坦化层的第二区域；
虚设反射层，所述虚设反射层布置在所述平坦化层的所述第二区域上方；以及
所述封装层的第二区域，所述封装层的第二区域被配置为覆盖所述虚设反射层，
其中，所述虚设反射层包括与所述阳极电极基本相同的材料。
20.根据权利要求13所述的显示装置，其中，所述显示区域中的所述电路部包括：
基板的第一区域；
电路元件层的第一区域，所述电路元件层的所述第一区域布置在所述基板上，所述电路元件层的第一区域上具有所述电路元件；
平坦化层的第一区域，所述平坦化层的所述第一区域被配置为覆盖布置在所述电路元件层上方的所述电路元件；
发光元件层的第一区域，所述发光元件层的所述第一区域布置在所述平坦化层上方并且设置有发光元件，所述发光元件中的每一个包括：
阳极电极，
阴极电极，以及
布置在所述阳极电极和所述阴极电极之间的发光层；
封装层的第一区域，所述封装层的所述第一区域被配置为覆盖所述发光元件层；覆盖基板的第一区域，所述覆盖基板的所述第一区域布置在所述封装层的上部上方；以及
滤色器，所述滤色器布置在所述封装层和所述覆盖基板之间，并且
其中，所述非显示区域中的所述电路部包括：
所述基板的第二区域；
所述电路元件层的第二区域；
所述平坦化层的第二区域；
所述封装层的第二区域，所述封装层的所述第二区域布置在所述平坦化层的所述第二区域上方；
所述覆盖基板的第二区域；以及
虚设滤色器，所述虚设滤色器布置在所述封装层的所述第二区域和所述覆盖基板的所述第二区域之间，
其中，所述虚设滤色器包括与所述滤色器基本相同的材料。
21.根据权利要求13所述的显示装置，其中，像素包括红色像素、绿色像素和蓝色像素，并且所述选通驱动器的所述电路部具有与红色像素、绿色像素和蓝色像素基本相同的尺寸和形状。
22.根据权利要求13所述的显示装置，其中，布置在所述显示区域上方的透明部和布置在所述非显示区域上的透明部具有基本相同的形状。
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