CN114078440A - 一种栅极驱动电路、显示基板及显示装置 - Google Patents

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Abstract

一种栅极驱动电路、显示基板及显示装置，所述栅极驱动电路被配置为，输出第一复位信号、第二复位信号、第一栅极驱动信号和第二栅极驱动信号至显示基板的像素驱动电路，所述第一复位信号和所述第一栅极驱动信号的有效电平极性相反，所述栅极驱动电路包括：独立设置的第一复位信号子电路和第一栅极驱动信号子电路，第一复位信号子电路被配置为输出所述第一复位信号至所述像素驱动电路，第一栅极驱动信号子电路被配置为输出所述第一栅极驱动信号至所述像素驱动电路。本实施例提供的方案，可以提供有效电平极性相同的独立的复位信号和栅极驱动信号，从而可以根据显示需要自由调节复位信号和栅极驱动信号，提高显示效果。

Description

一种栅极驱动电路、显示基板及显示装置
技术领域
本公开实施例涉及但不限于显示技术，尤指一种栅极驱动电路、显示基板及显示装置。
背景技术
随着AMOLED(Active Matrix Organic Light Emitting Diode，有源矩阵有机发光二极管)显示技术的不断发展，人们对显示技术的要求逐渐提升。随着这两年LTPO(LTPS+Oxide，低温多晶硅+氧化物)像素屏幕的兴起，已经受到越来越多的关注。目前，LTPO GOA(Gate on array，阵列基板栅极驱动)主要包括N-GOA(输出N型驱动信号的GOA，包括N_Reset和N_Gate)、P-GOA(输出P型驱动信号的GOA)和EM GOA(输出发光驱动信号的GOA)，其中N_Reset和N_Gate可以使用相同GOA电路采用推移方式生成。
发明内容
以下是对本文详细描述的主题的概述。本概述并非是为了限制权利要求的保护范围。
本公开实施例提供了一种栅极驱动电路、显示基板及显示装置，提高显示效果。
本公开实施例提供了一种栅极驱动电路，所述栅极驱动电路被配置为，输出第一复位信号、第二复位信号、第一栅极驱动信号和第二栅极驱动信号至显示基板的像素驱动电路，其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且第一电平和第二电平极性相反，所述栅极驱动电路包括：独立设置的第一复位信号子电路和第一栅极驱动信号子电路，所述第一复位信号子电路被配置为输出所述第一复位信号至所述像素驱动电路，所述第一栅极驱动信号子电路被配置为输出所述第一栅极驱动信号至所述像素驱动电路。
在一示例性实施例中，所述第一电平为高电平；或者，所述第一电平为低电平。
在一示例性实施例中，所述第一电平为高电平，所述栅极驱动电路还包括：发光驱动信号子电路和P型驱动信号子电路，其中：
所述发光驱动信号子电路被配置为，输出发光驱动信号至所述像素驱动电路；所述P型驱动信号子电路被配置为，输出所述第二复位信号和所述第二栅极驱动信号至所述像素驱动电路；
所述发光驱动信号子电路设置在所述显示基板的第一侧和第二侧；所述P型驱动信号子电路设置在所述显示基板的第一侧和第二侧；所述第一复位信号子电路设置在所述显示基板的第一侧，所述第一栅极驱动信号子电路设置在所述显示基板的第二侧；其中，所述第一侧和第二侧彼此相对。
在一示例性实施例中，所述栅极驱动电路还包括：独立设置的第二复位信号子电路和第二栅极驱动信号子电路，所述第二复位信号子电路被配置为输出所述第二复位信号至所述像素驱动电路，所述第二栅极驱动信号子电路被配置为输出所述第二栅极驱动信号至所述像素驱动电路。
在一示例性实施例中，所述第一电平为高电平，所述第二电平为低电平；
所述第一复位信号子电路设置在所述显示基板的第一侧，所述第一栅极驱动信号子电路设置在所述显示基板的第二侧；
所述第二栅极驱动信号子电路设置在所述显示基板的第一侧和第二侧；所述第二复位信号子电路设置在所述显示基板的第二侧，其中，所述第一侧和所述第二侧彼此相对。
在一示例性实施例中，所述栅极驱动电路还包括：设置在所述显示基板第一侧的发光驱动信号子电路；所述发光驱动信号子电路被配置为，输出发光驱动信号至所述像素驱动电路。
在一示例性实施例中，所述第二复位信号的有效电平时段与所述发光驱动信号的无效电平时段一一对应，所述第二复位信号的有效电平的开始时间与所述发光驱动信号的无效电平的开始时间同步。
在一示例性实施例中，在一帧时间内，所述第一栅极驱动信号的有效电平的持续时间大于所述第一复位信号的有效电平的持续时间。
本公开实施例提供一种栅极驱动电路，所述栅极驱动电路包括：发光驱动信号子电路、第一驱动信号子电路和第二驱动信号子电路，其中：
所述发光驱动信号子电路被配置为，输出发光驱动信号至显示基板的像素驱动电路；
所述第一驱动信号子电路被配置为，输出第一复位信号和第一栅极驱动信号至所述像素驱动电路；
所述第二驱动信号子电路被配置为，输出第二复位信号和第二栅极驱动信号至所述像素驱动电路；
其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且所述第一电平和所述第二电平极性相反；
所述发光驱动信号子电路设置在所述显示基板的第一侧；所述第一驱动信号子电路设置在所述显示基板的第二侧；所述第二驱动信号子电路设置在所述显示基板的第一侧和第二侧。
在一示例性实施例中，所述第一电平为高电平，所述第二电平为低电平。
本公开实施例提供一种显示基板，所述显示基板包括显示区域和位于所述显示区域周边的外围区域；所述外围区域设置有上述任一实施例所述的栅极驱动电路。
本公开实施例提供一种显示装置，包括上述显示基板。
本公开实施例包括一种栅极驱动电路、显示基板及显示装置，所述栅极驱动电路被配置为，输出第一复位信号、第二复位信号、第一栅极驱动信号和第二栅极驱动信号至显示基板的像素驱动电路，其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且第一电平和第二电平极性相反，所述栅极驱动电路包括：独立设置的第一复位信号子电路和第一栅极驱动信号子电路，所述第一复位信号子电路被配置为输出所述第一复位信号至所述像素驱动电路，所述第一栅极驱动信号子电路被配置为输出所述第一栅极驱动信号至所述像素驱动电路。本实施例提供的方案，可以提供有效电平极性相同的独立的复位信号和栅极驱动信号，从而可以根据显示需要自由调节复位信号和栅极驱动信号的持续时间及间隔时间，提高显示效果。
本发明的其它特征和优点将在随后的说明书中阐述，并且，部分地从说明书中变得显而易见，或者通过实施本发明而了解。本发明的目的和其他优点可通过在说明书以及附图中所特别指出的结构来实现和获得。
在阅读并理解了附图和详细描述后，可以明白其他方面。
附图说明
附图用来提供对本公开技术方案的进一步理解，并且构成说明书的一部分，与本公开实施例一起用于解释本发明的技术方案，并不构成对技术方案的限制。
图1为一技术方案提供的像素驱动电路示意图；
图2为一技术方案提供的GOA电路平面分布图；
图3为一示例性实施例提供的栅极驱动电路平面分布图；
图4为另一示例性实施例提供的栅极驱动电路平面分布图；
图5为一示例性实施例提供的栅极驱动电路时序示意图(应用于图4所示栅极驱动电路)；
图6为又一示例性实施例提供的栅极驱动电路平面分布图；
图7为一示例性实施例提供的栅极驱动电路时序示意图(应用于图6所示栅极驱动电路)；
图8为另一示例性实施例提供的栅极驱动电路平面分布图；
图9为又一示例性实施例提供的栅极驱动电路平面分布图。
具体实施方式
下文中将结合附图对本公开实施例进行详细说明。在不冲突的情况下，本公开实施例及实施例中的特征可以相互任意组合。
在附图的流程图示出的步骤可以在诸如一组计算机可执行指令的计算机系统中执行。并且，虽然在流程图中示出了逻辑顺序，但是在某些情况下，可以以不同于此处的顺序执行所示出或描述的步骤。
除非另外定义，本公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。
在附图中，有时为了明确起见，夸大表示了各构成要素的大小、层的厚度或区域。因此，本公开的实施方式并不一定限定于该尺寸，附图中各部件的形状和大小不反映真实比例。此外，附图示意性地示出了理想的例子，本公开的实施方式不局限于附图所示的形状或数值。
本公开中的“第一”、“第二”、“第三”等序数词是为了避免构成要素的混同而设置，并不表示任何顺序、数量或者重要性。
在本公开中，为了方便起见，使用“中部”、“上”、“下”、“前”、“后”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示方位或位置关系的词句以参照附图说明构成要素的位置关系，仅是为了便于描述本说明书和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本公开的限制。构成要素的位置关系根据描述各构成要素的方向适当地改变。因此，不局限于在公开中说明的词句，根据情况可以适当地更换。
在本公开中，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解。例如，可以是固定连接，或可拆卸连接，或一体地连接；可以是机械连接，或电连接；可以是直接相连，或通过中间件间接相连，或两个元件内部的连通。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本公开中的具体含义。
在本公开中，晶体管是指至少包括栅电极、漏电极以及源电极这三个端子的元件。晶体管在漏电极(漏电极端子、漏区域或漏电极)与源电极(源电极端子、源区域或源电极)之间具有沟道区域，并且电流能够流过漏电极、沟道区域以及源电极。在本公开中，沟道区域是指电流主要流过的区域。
在本公开中，可以是第一极为漏电极、第二极为源电极，或者可以是第一极为源电极、第二极为漏电极。在使用极性相反的晶体管的情况或电路工作中的电流方向变化的情况等下，“源电极”及“漏电极”的功能有时互相调换。因此，在本公开中，“源电极”和“漏电极”可以互相调换。
在本公开中，“电连接”包括构成要素通过具有某种电作用的元件连接在一起的情况。“具有某种电作用的元件”只要可以进行连接的构成要素间的电信号的授受，就对其没有特别的限制。“具有某种电作用的元件”的例子不仅包括电极和布线，而且还包括晶体管等开关元件、电阻器、电感器、电容器、其它具有各种功能的元件等。
图1为一技术方案提供的LTPO显示基板的像素驱动电路图。如图1所示，像素驱动电路可以包括7个晶体管(第一晶体管T1至第七晶体管T7)、1个存储电容C和多个信号线(数据信号线Data、N型栅极驱动信号线N_Gate、P型栅极驱动信号线P_Gate、N型复位信号线N_Reset，P型复位信号线P_Reset，发光信号线EM、第一初始信号线Vinit1、第二初始信号线Vinit2，第一电源线VDD和第二电源线VSS)。
在示例性实施方式中，存储电容C的第一端与第一电源线VDD连接，存储电容C的第二端与第二节点N2连接，即存储电容C的第二端与第三晶体管T3的控制极连接。
第一晶体管T1的控制极与N型复位信号线N_Reset连接，第一晶体管T1的第一极与第一初始信号线Vinit1连接，第一晶体管T1的第二极与第二节点N2连接。当导通电平复位信号施加到N型复位信号线N_Reset时，第一晶体管T1将第一初始化电压传输到第三晶体管T3的控制极，以使第三晶体管T3的控制极的电荷量初始化。
第二晶体管T2的控制极与N型栅极驱动信号线N_Gate连接，第二晶体管T2的第一极与第二节点N2连接，第二晶体管T2的第二极与第三节点N3连接。当导通电平驱动信号施加到N型栅极驱动信号线N_Gate时，第二晶体管T2使第三晶体管T3的控制极与第二极连接。
第三晶体管T3的控制极与第二节点N2连接，即第三晶体管T3的控制极与存储电容C的第二端连接，第三晶体管T3的第一极与第一节点N1连接，第三晶体管T3的第二极与第三节点N3连接。第三晶体管T3可以称为驱动晶体管，第三晶体管T3根据其控制极与第一极之间的电位差来确定在第一电源线VDD与第二电源线VSS之间流动的驱动电流的量。
第四晶体管T4的控制极与P型栅极驱动信号线P_Gate连接，第四晶体管T4的第一极与数据信号线Data连接，第四晶体管T4的第二极与第一节点N1连接。第四晶体管T4可以称为开关晶体管或者扫描晶体管等，当导通电平驱动信号施加到P型栅极驱动信号线P_Gate时，第四晶体管T4使数据信号线Data的数据电压输入到像素驱动电路。
第五晶体管T5的控制极与发光信号线EM连接，第五晶体管T5的第一极与第一电源线VDD连接，第五晶体管T5的第二极与第一节点N1连接。第六晶体管T6的控制极与发光信号线EM连接，第六晶体管T6的第一极与第三节点N3连接，第六晶体管T6的第二极与发光器件的第一极连接(即与第四节点N4连接)。第五晶体管T5和第六晶体管T6可以称为发光晶体管。当导通电平发光信号施加到发光信号线EM时，第五晶体管T5和第六晶体管T6通过在第一电源线VDD与第二电源线VSS之间形成驱动电流路径而使发光器件发光。
第七晶体管T7的控制极与P型复位信号线P_Reset连接，第七晶体管T7的第一极与第二初始信号线Vinit2连接，第七晶体管T7的第二极与第四节点N4连接。当导通电平复位信号施加到P型复位信号线P_Reset时，第七晶体管T7将第二初始化电压传输到发光器件的第一极，以使发光器件的第一极中累积的电荷量初始化或释放发光器件的第一极中累积的电荷量。
在示例性实施方式中，发光器件的第二极与第二电源线VSS连接，第二电源线VSS的信号可以为低电平信号，第一电源线VDD的信号可以为持续提供的高电平信号。
图2为一技术方案提供的栅极驱动电路示意图。如图2所示，栅极驱动电路包括设置在显示基板的第一侧和第二侧的发光驱动信号子电路EM GOA、N型驱动信号子电路N_GOA、P型驱动信号子电路P_GOA。发光驱动信号子电路EM GOA输出发光驱动信号至发光信号线EM，N型驱动信号子电路N_GOA输出N型复位信号至N型复位信号线N_Reset以及输出N型栅极驱动信号至N型栅极驱动信号线N_Gate，P型驱动信号子电路P_GOA输出P型复位信号至P型复位信号线P_Reset以及输出P型栅极驱动信号至P型栅极驱动信号线P_Gate。本方案中，栅极驱动电路对于边框占用较多，且N型复位信号和N型栅极驱动信号使用同一GOA电路生成，P型复位信号和P型栅极驱动信号使用同一GOA电路生成，无法独立调整，不利于LTPO优质显示。
本公开实施例中，可以使用独立的驱动电路生成N型复位信号和N型栅极驱动信号，或者，使用独立的驱动电路生成P型复位信号和P型栅极驱动信号，从而可以根据显示需要单独调节N型复位信号和N型栅极驱动信号，或者，P型复位信号和P型栅极驱动信号，从而提高显示效果。
本公开实施例提供一种栅极驱动电路，所述栅极驱动电路包括：发光驱动信号子电路、第一驱动信号子电路和第二驱动信号子电路，其中：
所述发光驱动信号子电路被配置为，输出发光驱动信号至显示基板的像素驱动电路；
所述第一驱动信号子电路被配置为，输出第一复位信号和第一栅极驱动信号至所述像素驱动电路；
所述第二驱动信号子电路被配置为，输出第二复位信号和第二栅极驱动信号至所述像素驱动电路；
其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且所述第一电平和所述第二电平极性相反；
所述发光驱动信号子电路设置在所述显示基板的第一侧；所述第一驱动信号子电路设置在所述显示基板的第二侧；所述第二驱动信号子电路设置在所述显示基板的第一侧和第二侧。本实施例提供的方案，所述发光驱动信号子电路和所述第一驱动信号子电路采用单边驱动方式，可以缩减边框。
第一电平和第二电平极性相反包括，第一电平为高电平，则第二电平为低电平；第一电平为低电平，则第二电平为高电平。
在一示例性实施例中，所述第一电平可以为高电平，所述第二电平可以为低电平。
图3为一示例性实施例提供的栅极驱动电路平面分布示意图。显示基板可以包括显示区和设置在显示区周边的外围区，所述显示区设置有多个子像素，至少一个子像素包括发光元件以及用于驱动所述发光元件发光的像素驱动电路。栅极驱动电路为像素驱动电路提供相应的驱动信号。如图3所示，本实施例提供的栅极驱动电路包括设置在显示基板的第一侧的发光驱动信号子电路EM GOA，设置在显示基板的第二侧的N型驱动信号子电路N_GOA，以及，设置在所述显示基板的第一侧和第二侧的P型驱动信号子电路P_GOA。其中，发光驱动信号子电路EM GOA输出发光驱动信号至发光信号线EM，N型驱动信号子电路N_GOA输出N型复位信号至N型复位信号线N_Reset以及输出N型栅极驱动信号至N型栅极驱动信号线N_Gate，P型驱动信号子电路P_GOA输出P型复位信号至P型复位信号线P_Reset以及输出P型栅极驱动信号至P型栅极驱动信号线P_Gate。发光信号线EM将发光驱动信号传输至像素驱动电路，N型复位信号线N_Reset将N型复位信号传输至像素驱动电路，N型栅极驱动信号线N_Gate将N型栅极驱动信号传输至像素驱动电路，P型复位信号线P_Reset将P型复位信号传输至像素驱动电路，P型栅极驱动信号线P_Gate将P型栅极驱动信号传输至像素驱动电路。
其中，N型复位信号和N型栅极驱动信号为有效电平为高电平的信号，P型复位信号和P型栅极驱动信号为有效电平为低电平的信号，有效电平是指将信号加载到开关管时，开启开关管的电平。
N型驱动信号子电路N_GOA可以包括多个级联的第一移位寄存器单元，同一第一移位寄存器单元可以输出N型复位信号和N型栅极驱动信号，比如，第n级第一移位寄存器单元输出N型复位信号和N型栅极驱动信号至第n行的子像素的像素驱动电路；N型复位信号可以比N型栅极驱动信号提前多行。
P型驱动信号子电路可以包括多个级联的第二移位寄存器单元，同一移位寄存器单元输出P型复位信号和P型栅极驱动信号，比如，第n级第二移位寄存器单元输出P型复位信号和P型栅极驱动信号至第n行的子像素的像素驱动电路；但本公开实施例不限于此，第n级第二移位寄存器单元可以给第n行子像素的像素驱动电路提供P型复位信号，以及给第n-2行子像素的像素驱动电路提供P型栅极驱动信号。
发光驱动信号子电路EM GOA可以包括多个级联的第三移位寄存器单元，第三移位寄存器单元输出发光驱动信号至像素驱动电路，比如，第n级第三移位寄存器单元输出发光驱动信号至第n行的子像素的像素驱动电路。
本实施例提供的方案，发光驱动信号子电路EM GOA和N型驱动信号子电路N_GOA只设置在显示基板的单侧，可以减小边框，应用在LTPO显示基板时，可以使得LTPO显示基板和LTPS显示基板近似的边框大小，便于刘海屏(Notch屏)和孔屏布线。
本公开实施例提供一种栅极驱动电路，所述栅极驱动电路被配置为，输出第一复位信号、第二复位信号、第一栅极驱动信号和第二栅极驱动信号至显示基板的像素驱动电路，其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且第一电平和第二电平极性相反，所述栅极驱动电路包括：独立设置的第一复位信号子电路和第一栅极驱动信号子电路，所述第一复位信号子电路被配置为输出所述第一复位信号至所述像素驱动电路，所述第一栅极驱动信号子电路被配置为输出所述第一栅极驱动信号至所述像素驱动电路。
本实施例提供的方案，可以提供有效电平极性相同的独立的复位信号和栅极驱动信号，从而可以根据显示需要自由调节复位信号和栅极驱动信号的持续时间及间隔时间，提高显示效果。
在一示例性实施例中，所述第一电平可以为高电平；或者，所述第一电平可以为低电平。即，可以提供独立的N_Reset GOA和N_Gate GOA，分别输出有效电平为高电平的第一复位信号和第一栅极驱动信号，或者，提供独立的P_Reset GOA和P_Gate GOA，分别输出有效电平为低电平的第二复位信号和第二栅极驱动信号。
在一示例性实施例中，可以在显示基板的两侧设置N_Gate GOA(即N_Gate GOA双边驱动)，一侧设置N_Reset GOA(即N_Reset GOA单边驱动)，此时，EM GOA单边驱动。
在一示例性实施例中，可以在显示基板的两侧分别设置N_Gate GOA和N_ResetGOA(即N_Gate GOA和N_Reset GOA单边驱动)，此时，EM GOA双边驱动。
在一示例性实施例中，可以在显示基板的两侧分别设置P_Gate GOA和P_ResetGOA(即P_Gate GOA和P_Reset GOA单边驱动)，此时，EM GOA双边驱动。
在一示例性实施例中，可以在显示基板的两侧设置P_Gate GOA(即P_Gate GOA双边驱动)，一侧设置P_Reset GOA(即P_Reset GOA单边驱动)，此时，EM GOA单边驱动。
在一示例性实施例中，所述栅极驱动电路还可以包括：独立设置的第二复位信号子电路和第二栅极驱动信号子电路，所述第二复位信号子电路被配置为输出所述第二复位信号，所述第二栅极驱动信号子电路被配置为输出所述第二栅极驱动信号。比如，提供独立的N_Reset GOA和N_Gate GOA，分别输出有效电平为高电平的第一复位信号和第一栅极驱动信号，以及，提供独立的P_Reset GOA和P_Gate GOA，分别输出有效电平为低电平的第二复位信号和第二栅极驱动信号。本实施例提供的方案，可以根据显示需要自由调节复位信号和栅极驱动信号的有效电平的持续时间和间隔时间，提高显示效果，另外，可以根据不同类型的显示屏对栅极驱动电路进行调节，适应性更广。
在一示例性实施例中，所述第一复位信号子电路可以包括多个级联的第四移位寄存器单元，所述第一栅极驱动信号子电路可以包括多个级联的第五移位寄存器单元，所述第二复位信号子电路可以包括多个级联的第六移位寄存器单元，所述第二栅极驱动信号子电路可以包括多个级联的第七移位寄存器单元。比如，第n级第四移位寄存器单元输出一复位信号至第n行的子像素的像素驱动电路；第n级第五移位寄存器单元输出第一栅极驱动信号至第n行的子像素的像素驱动电路；第n级第六移位寄存器单元输出二复位信号至第n行的子像素的像素驱动电路；第n级第七移位寄存器单元输出第二栅极驱动信号至第n行的子像素的像素驱动电路。第四移位寄存器单元、第五移位寄存器单元、第六移位寄存器单元、第七移位寄存器单元、第三移位寄存器单元可以相同或不同。
在一示例性实施例中，可以在显示基板的两侧分别设置N_Gate GOA和N_ResetGOA(即N_Gate GOA和N_Reset GOA单边驱动)，以及，在显示基板的两侧分别设置P_GateGOA和P_Reset GOA(即P_Gate GOA和P_Reset GOA单边驱动)，此时，EM GOA双边驱动。
在一示例性实施例中，可以在显示基板的两侧分别设置N_Gate GOA和N_ResetGOA(即N_Gate GOA和N_Reset GOA单边驱动)，以及，在显示基板的两侧均设置P_Gate GOA，一侧设置P_Reset GOA(即P_Gate GOA双边驱动，P_Reset GOA单边驱动)，此时，EM GOA单边驱动。
在一示例性实施例中，可以在显示基板的两侧均设置N_Gate GOA，一侧设置N_Reset GOA(即N_Gate GOA双边驱动，N_Reset GOA单边驱动)，以及，在显示基板的两侧分别设置P_Gate GOA和P_Reset GOA(即P_Gate GOA和P_Reset GOA单边驱动)，此时，EM GOA单边驱动。
下面通过示例对本公开实施例技术方案进行说明。
图4为一示例性实施例提供的栅极驱动电路平面分布示意图。如图4所示，本实施例提供的栅极驱动电路包括：设置在所述显示基板的第一侧和第二侧的发光驱动信号子电路EM GOA，设置在所述显示基板的第一侧和第二侧的P型驱动信号子电路P_GOA，以及，设置在所述显示基板的第一侧的N型复位信号子电路N Reset GoA，设置在所述显示基板的第二侧的N型栅极驱动信号子电路N Gate GOA。其中，第一侧中，从靠近显示区至远离显示区方向，P型驱动信号子电路P_GOA、N型复位信号子电路N Reset GoA和发光驱动信号子电路EMGOA依次排布；第二侧中，从靠近显示区至远离显示区方向，P型驱动信号子电路P_GOA、N型栅极驱动信号子电路N_Gate GoA和发光驱动信号子电路EM GOA依次排布。本实施例中，第一侧和第二侧可以是相对的两侧，但本公开实施例不限于此，可以是其他侧。
其中，所述发光驱动信号子电路EM GOA输出发光驱动信号至像素驱动电路，可以将发光驱动信号通过发光信号线EM输出至像素驱动电路；所述P型驱动信号子电路P_GOA输出P型复位信号以及输出P型栅极驱动信号至像素驱动电路，可以将P型复位信号通过P型复位信号线P_Reset输出至像素驱动电路，以及将P型栅极驱动信号通过P型栅极驱动信号线P_Gate至像素驱动电路。
所述N型复位信号子电路N Reset GoA被配置为输出N型复位信号至像素驱动电路；可以将N型复位信号通过N型复位信号线N_Reset输出至像素驱动电路。
所述N型栅极驱动信号子电路N Gate GOA被配置为输出N型栅极驱动信号至像素驱动电路，可以将N型栅极驱动信号通过N型栅极驱动信号线N_Gate输出至像素驱动电路。
本实施例提供的方案，使用独立的驱动电路分别输出N型复位信号和N型栅极驱动信号。
图5为一示例性实施例提供的图4所示栅极驱动电路的时序图。如图5所示，其中，时序1为图2所示的栅极驱动电路提供的N型复位信号N_Reset和N型栅极驱动信号N_Gate的时序；时序2为一示例性实施例提供的N型复位信号N_Reset和N型栅极驱动信号N_Gate的时序，其中，栅极驱动电路如图4所示；时序3为另一示例性实施例提供的N型复位信号N_Reset和N型栅极驱动信号N_Gate的时序，其中，栅极驱动电路如图4所示。
像素驱动电路的工作过程通常包括复位阶段、数据写入阶段和发光阶段，其中，复位阶段下，N_Reset为有效电平(本实施例中为高电平)，第一初始信号线的电压提供给第二节点，对存储电容C进行初始化，清除存储电容C中原有数据电压。数据写入阶段下，N_Gate为有效电平(本实施例中为高电平)，数据信号线的电压写入存储电容C。
图2所示的栅极驱动电路中，使用同一个驱动电路输出N型复位信号和N型栅极驱动信号，因此，时序1中N型复位信号和N型栅极驱动信号的间隔时间以及导通电平信号的持续时间彼此关联，无法自由调节。
时序2中所示的N型复位信号和N型栅极驱动信号由图4所示的栅极驱动电路提供，N型复位信号和N型栅极驱动信号分别由独立的驱动电路提供，因此，可以根据显示需要设置二者之间的时间间隔，比如，可以设置N型复位信号的有效电平的开始时间和N型栅极驱动信号的有效电平的开始时间之间更长的时间间隔，以及，设置N型栅极驱动信号更长的有效电平持续时间，N型栅极驱动信号控制数据写入时间，更长的数据写入时间下，奇偶行之前的数据写入时间差别在占总数据写入时间的比例更小，从而可以改善奇偶行亮度差异。
时序3中所示的N型复位信号和N型栅极驱动信号由图4所示的栅极驱动电路提供，N型复位信号和N型栅极驱动信号使用独立的驱动电路分别提供，因此，可以根据需要调整N型复位信号和N型栅极驱动信号的有效电平持续时间，增加灵活度。比如，可以使得N型复位信号的有效电平持续时间小于N型栅极驱动信号的有效电平持续时间，从而减小每一帧准备时间(Black时间)，即缩小复位阶段的时间，增加每一行的数据写入时间，写入更充分，可以提高显示均一性。另外，设置N型栅极驱动信号更长的有效电平持续时间，可以改善奇偶行亮度。
图6为一示例性实施例提供的栅极驱动电路平面分布示意图。如图6所示，本实施例提供的栅极驱动电路包括：设置在所述显示基板的第一侧的发光驱动信号子电路EMGOA，设置在所述显示基板的第一侧和第二侧的P型栅极驱动信号子电路P_Gate GOA，设置在所述显示基板的第一侧的N型复位信号子电路N Reset GoA，设置在所述显示基板的第二侧的N型栅极驱动信号子电路N Gate GOA，设置在所述显示基板第二侧的P型复位信号子电路P_Reset GOA。其中，第一侧中，从靠近显示区至远离显示区方向，P型栅极驱动信号子电路P_Gate GOA、N型复位信号子电路N_Reset GoA和发光驱动信号子电路EM GOA依次排布；第二侧中，从靠近显示区至远离显示区方向，P型栅极驱动信号子电路P_Gate GOA、N型栅极驱动信号子电路N_Gate GOA和P型复位信号子电路P_Reset GOA依次排布。
其中，所述发光驱动信号子电路EM GOA输出发光驱动信号至像素驱动电路；
所述N型复位信号子电路N Reset GoA被配置为输出N型复位信号至像素驱动电路；所述N型栅极驱动信号子电路N_Gate GOA被配置为输出N型栅极驱动信号至像素驱动电路。
所述P型复位信号子电路P_Reset GOA被而配置为输出P型复位信号至像素驱动电路，可以将P型复位信号通过P型复位信号线P_Reset输出至像素驱动电路；
所述P型栅极驱动信号子电路P Gate GOA被配置为输出P型栅极驱动信号至像素驱动电路，可以将P型栅极驱动信号通过P型栅极驱动信号线P_Gate输出至像素驱动电路。
P型复位信号子电路P_Reset GOA可以使用多个移位寄存器单元级联得到，发光驱动信号子电路EM GOA可以使用多个移位寄存器单元级联得到，P型复位信号子电路可以使用多个移位寄存器单元级联得到，P型复位信号子电路P_Reset GOA可以与发光驱动信号子电路EM GOA的电路结构一致，或者，P型复位信号子电路P_Reset GOA可以与P型栅极驱动信号子电路P Gate GOA电路结构一致。但本公开实施例不限于此，可以使用不同电路结构实现。
图7为一示例性实施例提供的图6所示栅极驱动电路的时序图。如图7所示，时序4为图2所示的栅极驱动电路提供的发光驱动信号EM和P型复位信号P_Reset的时序，时序5为图6所示的栅极驱动电路的发光驱动信号EM和P型复位信号P_Reset的时序。
像素驱动电路的工作过程通常包括复位阶段、数据写入阶段和发光阶段，数据写入阶段中，P型复位信号提供有效电平，将第二初始电压提供到发光元件，对发光元件进行初始化，避免发光元件发光，造成闪屏(Flicker)。
可以看到，时序1中，P_Reset和P_Gate使用同一个驱动信号电路生成，P_Reset只在EM第一个无效电平时段输出有效电平；时序5中，P_Reset的有效电平时段与EM的无效电平时段一一对应，P_Reset的有效电平的开始时间与EM的无效电平开始时间同步，所述同步可以包括：P_Reset在EM输出无效电平同时开始输出有效电平，或者，P_Reset在EM输出无效电平稍后开始输出有效电平。本实施例提供的方案，可以在发光元件的非发光时段，及时将发光元件进行初始化，避免发光元件中的残余电压导致闪屏。
以图1所示的像素驱动电路为例，如图7所示，EM每一个阶段无效电平(本实施例中为高电平)开始的同时P_Reset打开(输出有效电平，本实施例中为低电平)，从而在非发光阶段，可以及时对OLED阳极节点(N4节点)进行初始化，维持N4节点电压在EM无效电平阶段电压稳定，较大改善闪屏。另外，P型复位信号P_Reset和P型栅极驱动信号P_Gate使用独立的驱动电路生成，可以独立设置P型复位信号P_Reset的电压，比如，可以通过测试的方式，选择使得侧向漏电较小的电压作为P型复位信号P_Reset的电压，从而改善侧向漏电。
图6所示栅极驱动电路的N型复位信号N_Reset和N型栅极驱动信号N_Gate的时序可参考图5，不再赘述。
图8为一示例性实施例提供的栅极驱动电路平面布局图。如图8所示，本实施例提供的栅极驱动电路包括：设置在所述显示基板的第一侧和第二侧的发光驱动信号子电路EMGOA，设置在所述显示基板的第一侧的P型栅极驱动信号子电路P_Gate GOA，设置在所述显示基板的第二侧的P型复位信号子电路P_Reset GoA，以及，设置在所述显示基板的第一侧的N型复位信号子电路N Reset GoA，设置在所述显示基板的第二侧的N型栅极驱动信号子电路N Gate GOA。其中，第一侧中，从靠近显示区至远离显示区方向，P型栅极驱动信号子电路P_Gate GOA、N型复位信号子电路N Reset GoA和发光驱动信号子电路EM GOA依次排布；第二侧中，从靠近显示区至远离显示区方向，P型复位信号子电路P_Reset GOA、N型栅极驱动信号子电路N_Gate GoA和发光驱动信号子电路EM GOA依次排布。该电路的时序图可参考图5中的时序2和时序3，图7中的时序5，此处不再赘述。本实施例提供的方案，可以改善奇偶行亮度差异，改善闪屏，减少漏电。
图9为另一示例性实施例提供的栅极驱动电路平面布局图。如图9所示，本实施例提供的栅极驱动电路包括：设置在所述显示基板的第一侧和第二侧的发光驱动信号子电路EM GOA，设置在所述显示基板的第一侧和第二侧的P型栅极驱动信号子电路P_Gate GOA，设置在所述显示基板的第二侧的P型复位信号子电路P_Reset GoA，以及，设置在所述显示基板的第一侧和第二侧的N型驱动信号子电路N_GoA。其中，第一侧中，从靠近显示区至远离显示区方向，P型栅极驱动信号子电路P_Gate GOA、N型驱动信号子电路N_GoA和发光驱动信号子电路EM GOA依次排布；第二侧中，从靠近显示区至远离显示区方向，P型栅极驱动信号子电路P_Gate GOA、N型驱动信号子电路N_GoA和P型复位信号子电路P_Reset GOA依次排布。该电路的时序图可参考图7中的时序5，此处不再赘述。本实施例提供的方案，可以改善闪屏，减少漏电。
本公开实施例提供一种显示基板，所述显示基板包括显示区域和位于所述显示区域周边的外围区域；所述显示区域设置有多个子像素；至少存在一个子像素包括发光元件和驱动所述发光元件的像素驱动电路，所述外围区域设置有上述任一实施例所述的栅极驱动电路。所述显示基板包括但不限于LTPO显示基板。
本公开实施例还提供了一种显示装置，包括前述实施例的显示基板。显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
虽然本发明所揭露的实施方式如上，但所述的内容仅为便于理解本发明而采用的实施方式，并非用以限定本发明。任何本发明所属领域内的技术人员，在不脱离本发明所揭露的精神和范围的前提下，可以在实施的形式及细节上进行任何的修改与变化，但本发明的专利保护范围，仍须以所附的权利要求书所界定的范围为准。

Claims (12)

1.一种栅极驱动电路，其特征在于，所述栅极驱动电路被配置为，输出第一复位信号、第二复位信号、第一栅极驱动信号和第二栅极驱动信号至显示基板的像素驱动电路，其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且第一电平和第二电平极性相反，所述栅极驱动电路包括：独立设置的第一复位信号子电路和第一栅极驱动信号子电路，所述第一复位信号子电路被配置为输出所述第一复位信号至所述像素驱动电路，所述第一栅极驱动信号子电路被配置为输出所述第一栅极驱动信号至所述像素驱动电路。
2.根据权利要求1所述的栅极驱动电路，其特征在于，所述第一电平为高电平；或者，所述第一电平为低电平。
3.根据权利要求1所述的栅极驱动电路，其特征在于，所述第一电平为高电平，所述栅极驱动电路还包括：发光驱动信号子电路和P型驱动信号子电路，其中：
所述发光驱动信号子电路被配置为，输出发光驱动信号至所述像素驱动电路；所述P型驱动信号子电路被配置为，输出所述第二复位信号和所述第二栅极驱动信号至所述像素驱动电路；
所述发光驱动信号子电路设置在所述显示基板的第一侧和第二侧；所述P型驱动信号子电路设置在所述显示基板的第一侧和第二侧；所述第一复位信号子电路设置在所述显示基板的第一侧，所述第一栅极驱动信号子电路设置在所述显示基板的第二侧；其中，所述第一侧和第二侧彼此相对。
4.根据权利要求1所述的栅极驱动电路，其特征在于，所述栅极驱动电路还包括：独立设置的第二复位信号子电路和第二栅极驱动信号子电路，所述第二复位信号子电路被配置为输出所述第二复位信号至所述像素驱动电路，所述第二栅极驱动信号子电路被配置为输出所述第二栅极驱动信号至所述像素驱动电路。
5.根据权利要求4所述的栅极驱动电路，其特征在于，所述第一电平为高电平，所述第二电平为低电平；
所述第一复位信号子电路设置在所述显示基板的第一侧，所述第一栅极驱动信号子电路设置在所述显示基板的第二侧；
所述第二栅极驱动信号子电路设置在所述显示基板的第一侧和第二侧；所述第二复位信号子电路设置在所述显示基板的第二侧，其中，所述第一侧和所述第二侧彼此相对。
6.根据权利要求5所述的栅极驱动电路，其特征在于，所述栅极驱动电路还包括：设置在所述显示基板第一侧的发光驱动信号子电路；所述发光驱动信号子电路被配置为，输出发光驱动信号至所述像素驱动电路。
7.根据权利要求6所述的栅极驱动电路，其特征在于，所述第二复位信号的有效电平时段与所述发光驱动信号的无效电平时段一一对应，所述第二复位信号的有效电平的开始时间与所述发光驱动信号的无效电平的开始时间同步。
8.根据权利要求3、5或6所述的栅极驱动电路，其特征在于，在一帧时间内，所述第一栅极驱动信号的有效电平的持续时间大于所述第一复位信号的有效电平的持续时间。
9.一种栅极驱动电路，其特征在于，所述栅极驱动电路包括：发光驱动信号子电路、第一驱动信号子电路和第二驱动信号子电路，其中：
所述发光驱动信号子电路被配置为，输出发光驱动信号至显示基板的像素驱动电路；
所述第一驱动信号子电路被配置为，输出第一复位信号和第一栅极驱动信号至所述像素驱动电路；
所述第二驱动信号子电路被配置为，输出第二复位信号和第二栅极驱动信号至所述像素驱动电路；
其中，所述第一复位信号和所述第一栅极驱动信号的有效电平为第一电平，所述第二复位信号和所述第二栅极驱动信号的有效电平为第二电平，且所述第一电平和所述第二电平极性相反；
所述发光驱动信号子电路设置在所述显示基板的第一侧；所述第一驱动信号子电路设置在所述显示基板的第二侧；所述第二驱动信号子电路设置在所述显示基板的第一侧和第二侧。
10.根据权利要求9所述的栅极驱动电路，其特征在于，所述第一电平为高电平，所述第二电平为低电平。
11.一种显示基板，其特征在于，所述显示基板包括显示区域和位于所述显示区域周边的外围区域；所述外围区域设置有如权利要求1至10任一所述的栅极驱动电路。
12.一种显示装置，其特征在于，包括如权利要求11所述的显示基板。
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SE01 Entry into force of request for substantive examination
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GR01 Patent grant
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