CN113903801B - Igbt器件及其制作方法 - Google Patents

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Abstract

本申请公开了一种IGBT器件及其制作方法,涉及半导体制造领域。该IGBT器件包括超结结构,超结结构由若干个N型柱和P型柱交替排列构成,超结结构位于N型衬底中;IGBT器件的元胞单元,元胞单元位于N型外延层中,N型外延层位于N型衬底的上方;每个元胞单元包括沟槽栅、P型体区、位于P型体区顶部的源区;N型载流子注入层,N型载流子注入层位于N型外延层中,N型载流子注入层与N型衬底之间间隔有N型外延层;P型体区的底部位于N型载流子注入层中;集电区,集电区位于N型衬底的底部;通过增加N型载流子注入层,增加了空穴浓度,降低了IGBT器件的导通压降,提升了器件性能。

Description

IGBT器件及其制作方法
技术领域
本申请涉及半导体制造领域,具体涉及一种IGBT器件及其制作方法。
背景技术
IGBT(Insulated Gate Bipolar Transistor,绝缘栅双极型晶体管)器件具有通态压降低、电流容量大、输入阻抗高、响应速度快和控制简单等特点,被广泛应用在交通、医疗、新能源等领域。
IGBT是电力电子系统能量控制和转换的重要开关元器件之一,它的性能直接影响着电力电子系统的转换效率、体积和重量。电力电子器件的性能在发展过程中追求着更高的电流密度、更小的通态压降、更低的关断损耗。
发明内容
为了解决相关技术中的问题,本申请提供了一种IGBT器件及其制作方法。该技术方案如下:
第一方面,本申请实施例提供了一种IGBT器件,包括:
超结结构,超结结构由若干个N型柱和P型柱交替排列构成,超结结构位于N型衬底中;
IGBT器件的元胞单元,元胞单元位于N型外延层中,N型外延层位于N型衬底的上方;
每个元胞单元包括沟槽栅、P型体区、位于P型体区顶部的源区;
N型载流子注入层,N型载流子注入层位于N型外延层中,N型载流子注入层与N 型衬底之间间隔有N型外延层;
P型体区的底部位于N型载流子注入层中;
集电区,集电区位于N型衬底的底部。
可选的,还包括层间介质层和正面金属层;
层间介质层位于N型外延层的上方,正面金属层位于层间介质层的表面;
层间介质层中形成有接触孔,源区和沟槽栅通过接触孔与正面金属层连接。
可选的,N型载流子注入层的掺杂杂质为磷。
第二方面,本申请实施例提供一种IGBT器件的制作方法,该方法包括:
在N型衬底中形成超结结构,超结结构由若干个N型柱和P型柱交替排列构成;
在N型衬底表面形成N型外延层;
在N型外延层中形成N型载流子注入层,N型载流子注入层与N型衬底之间间隔有N型外延层;
在N型外延层中形成IGBT器件的元胞单元,每个元胞单元包括沟槽栅、P型体区、位于P型体区顶部的源区,P型体区的底部位于N型载流子注入层中;
在N型衬底的底部形成集电区。
可选的,在N型外延层中形成N型载流子注入层包括:
通过离子注入工艺向N型外延层中注入N型掺杂离子,形成N型载流子注入层。
可选的,N型掺杂离子为磷离子。
可选的,在形成N型载流子注入层的过程中,离子注入的剂量为1E11 cm-2 -1E14cm-2,离子注入的能量为1MeV-3MeV。
可选的,在N型外延层中形成IGBT器件的元胞单元,包括:
在N型外延层中形成沟槽栅;
在沟槽栅外侧形成P型体区,P型体区的底部位于N型载流子注入层中;
在P型体区的顶部形成源区。
可选的,该方法还包括:
形成层间介质层;
在层间介质层中形成接触孔;
在层间介质层表面形成正面金属层,元胞单元中的源区和沟槽栅通过接触孔与正面金属层连接。
本申请技术方案,至少包括如下优点:
通过增加N型载流子注入层,增加了P型体区对应区域的电势,形成对集电极注入的空穴的阻挡作用。从IGBT器件背面的集电区注入到漂移区的空穴会通过漂移区向IGBT发射极附近的P型体区运动,当空穴达到N型载流子注入层时,由于势垒的阻挡作用,空穴在N型载流子注入层附近聚集;通过增加空穴的浓度,降低IGBT器件的导通压降,提升了IGBT器件的优值系数FOM。
附图说明
为了更清楚地说明本申请具体实施方式或现有技术中的技术方案,下面将对具体实施方式或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图是本申请的一些实施方式,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1是本申请实施例提供的一种IGBT器件的剖视图;
图2是本申请实施例提供的一种IGBT器件的制作方法的流程图;
图3是本申请实施例提供的形成超结结构后的器件剖视图;
图4是本申请实施例提供的形成N外延层后的器件剖视图;
图5是本申请实施例提供的N型外延层中形成N型载流子注入层之后的器件剖视图;
图6是本申请实施例提供的N型外延层中形成元胞单元之后的器件剖视图;
图7是本申请另一实施例提供的一种IGBT器件的制作方法的流程图;
图8是本申请实施例提供的形成层间介质层之后的器件剖视图;
图9是本申请实施例提供的IGBT器件的FOM(VCE*EOFF)值的比较示意图。
具体实施方式
下面将结合附图,对本申请中的技术方案进行清楚、完整的描述,显然,所描述的实施例是本申请的一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域普通技术人员在不做出创造性劳动的前提下所获得的所有其它实施例,都属于本申请保护的范围。
在本申请的描述中,需要说明的是,术语“中心”、“上”、“下”、“左”、“右”、“竖直”、“水平”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本申请和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本申请的限制。此外,术语“第一”、“第二”、“第三”仅用于描述目的,而不能理解为指示或暗示相对重要性。
在本申请的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“相连”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电气连接;可以是直接相连,也可以通过中间媒介间接相连,还可以是两个元件内部的连通,可以是无线连接,也可以是有线连接。对于本领域的普通技术人员而言,可以具体情况理解上述术语在本申请中的具体含义。
此外,下面所描述的本申请不同实施方式中所涉及的技术特征只要彼此之间未构成冲突就可以相互结合。
请参考图1,其示出了本申请实施例提供的一种IGBT器件的结构示意图。该IGBT器件包括超结结构、IGBT器件的元胞单元、N型载流子注入层14、集电区10。
超结结构位于N型衬底11中,超级结构由若干个N型柱和P型柱12交替排列构成,N型柱由相邻的P型柱12之间的N型衬底组成。
IGBT器件的每个元胞单元位于N型外延层13中,N型外延层13位于N型衬底11 的上方。
每个元胞单元包括沟槽栅15、P型体区16、位于P型体区16顶部的源区19。
源区19由N+区组成。
沟槽栅15包括栅极沟槽、覆盖栅极沟槽底部表面和侧面的栅介质层、填充栅极沟槽的多晶硅。
可选的,栅介质层为栅氧化层。
N型载流子注入层14位于N型外延层13中,N型载流子注入层14与N型衬底11 之间间隔有N型外延层13。
如图1所示,P型体区16和P型柱12之间隔了N型载流子注入层14。
集电区10位于N型衬底11的底部。
在本申请实施例提供的IGBT器件中,通过增加N型载流子注入层,增加了P型体区对应区域的电势,形成对集电极注入的空穴的阻挡作用。从IGBT器件背面的集电区注入到漂移区的空穴会通过漂移区向IGBT发射极附近的P型体区运动,当空穴达到N型载流子注入层时,由于势垒的阻挡作用,空穴在N型载流子注入层附近聚集;通过增加空穴的浓度,降低IGBT器件的导通压降,提升了IGBT器件的优值系数FOM。
如图1所示,IGBT器件还包括层间介质层17和正面金属层18。
层间介质层17位于N型外延层13的上方,正面金属层18位于层间介质层17的表面。
层间介质层17中形成有接触孔,源区19和沟槽栅通过接触孔与正面金属层18 连接。
源区通过接触孔与正面金属层连接,形成IGBT器件的发射极。
可选的,N型载流子注入层的掺杂杂质为磷。
请参考图2,其示出了本申请实施例提供的一种IGBT器件的制作方法的流程图,该方法至少包括如下步骤:
步骤201,在N型衬底中形成超结结构。
如图3所示,N型衬底11中形成有超结结构,超结结构由若干个P型柱12和N 型柱交替排列构成,N型柱由相邻的P型柱12之间的N型衬底11构成。
步骤202,在N型衬底表面形成N型外延层。
可选的,通过外延生长工艺,在N型衬底表面形成N型外延层。
如图4所示,N型衬底11表面形成N型外延层13。
步骤203,在N型外延层中形成N型载流子注入层,N型载流子注入层与N型衬底之间间隔有N型外延层。
如图5所示,N型外延层13中形成有N型载流子注入层14,N型载流子注入层 14和P型柱12之间还存在N型外延层13。
步骤204,在N型外延层中形成IGBT器件的元胞单元。
每个元胞单元包括沟槽栅、P型体区、位于P型体区顶部的源区,P型体区的底部位于N型载流子注入层中。
通过光刻和刻蚀工艺,在N型外延层中形成栅极沟槽,形成栅介质层,栅介质层覆盖栅极沟槽的底部表面和侧面,淀积多晶硅填充栅极沟槽,对衬底进行平坦化,形成沟槽栅。
通过光刻和离子注入工艺,在N型外延层中形成P型体区,P型体区的底部位于 N型载流子注入层中。
通过光刻和离子注入工艺,在P型体区的顶部形成源区。
如图6所示,N型外延层13中形成有沟槽栅15、P型体区16、P型体区16的顶部形成有源区19,P型体区16的底部位于N型载流子注入层14中。
步骤205,在N型衬底的底部形成集电区。
对衬底进行减薄,对减薄后的衬底进行离子注入,形成P型掺杂的集电区。
综上所述,本申请实施例提供的IGBT器件的制作方法,通过在N型衬底中形成超结结构,在N型衬底表面形成N型外延层,在N型外延层中形成N型载流子注入层, N型载流子注入层与N型衬底之间间隔有N形外延层,在N型外延层中形成IGBT器件的元胞单元,在N型衬底中形成集电区;达到了增加空穴浓度,降低IGBT器件的导通压降,提升器件性能的效果。
在基于图2所示实施例的可选实施例中,在N型衬底的底部形成集电区之前,即在步骤205之前,该方法中的正面工艺还包括如下步骤,如图7所示:
步骤301,形成层间介质层。
如图8所示,在N型外延层13表面形成层间介质层17。
步骤302,在层间介质层中形成接触孔。
通过光刻和刻蚀工艺,在层间介质层中形成接触孔,通过接触孔将源区、沟槽栅引出。
步骤303,在层间介质层表面形成正面金属层。
元胞单元中的源区和沟槽栅通过接触孔与正面金属层连接。
在层间介质层表面淀积正面金属,并对正面金属进行图形化,形成正面金属层,源区通过接触孔和正面金属层连接,构成IGBT器件的发射极;沟槽栅通过接触孔与正面金属层连接,构成IGBT器件的栅极。
正面工艺完成之后,继续进行背面工艺,即对衬底进行减薄,在N型衬底的背面进行离子注入,形成P型集电区10,如图1所示。
在N型衬底11的底部表面形成背面金属层,背面金属层和集电区10构成IGBT 器件的集电极。
可选的,在N型外延层中形成N型载流子注入层,可以通过如下方式实现:
通过离子注入工艺向N型外延层中注入N型掺杂离子,形成N型载流子注入层。
在一个例子中,N型掺杂离子为磷离子。
在一个例子中,在形成N型载流子注入层的过程中,离子注入的剂量为1E11 cm-2-1E14 cm-2,离子注入的能量为1MeV-3MeV。
可选的,在N型外延层中形成IGBT器件的元胞单元,即步骤204,可以由如下步骤实现,
步骤2041,在外延层中形成沟槽栅。
步骤2042,在沟槽栅外侧形成P型体区,P型体区的底部位于N型载流子注入层中。
步骤2043,在P型体区的顶部形成源区。
在一个例子中,对本申请实施例提供的IGBT器件、现有基于超级结的IGBT器件、现有的MPT型IGBT进行FOM(VCE*EOFF)检测,三种IGBT器件为同尺寸,VCE表示饱和电压,EOFF表示IGBT的开关能耗参数,如图9所示,点91表示现有MPT型IGBT 的FOM,点92表示现有基于超级结的IGBT器件的FOM,点93表示本申请实施例提供的IGBT器件的FOM,可以看出,本申请实施例提供的IGBT器件在增加N型载流子注入层后,FOM值相对现有的MPT型IGBT的FOM值提升了15%,相对现有基于超级结的 IGBT器件的FOM值提升了5%。
显然,上述实施例仅仅是为清楚地说明所作的举例,而并非对实施方式的限定。对于所属领域的普通技术人员来说,在上述说明的基础上还可以做出其它不同形式的变化或变动。这里无需也无法对所有的实施方式予以穷举。而由此所引伸出的显而易见的变化或变动仍处于本申请创造的保护范围之中。

Claims (9)

1.一种IGBT器件,其特征在于,包括:
超结结构,所述超结结构由若干个N型柱和P型柱交替排列构成,所述超结结构位于N型衬底中;
IGBT器件的元胞单元,所述元胞单元位于N型外延层中,所述N型外延层位于所述N型衬底的上方;
每个所述元胞单元包括沟槽栅、P型体区、位于P型体区顶部的源区;
N型载流子注入层,所述N型载流子注入层位于所述N型外延层中,所述N型载流子注入层与所述N型衬底之间间隔有所述N型外延层;
所述P型体区的底部位于所述N型载流子注入层中;
集电区,所述集电区位于所述N型衬底的底部。
2.根据权利要求1所述的IGBT器件,其特征在于,还包括层间介质层和正面金属层;
所述层间介质层位于所述N型外延层的上方,所述正面金属层位于所述层间介质层的表面;
所述层间介质层中形成有接触孔,所述源区和所述沟槽栅通过所述接触孔与所述正面金属层连接。
3.根据权利要求1所述IGBT器件,其特征在于,所述N型载流子注入层的掺杂杂质为磷。
4.一种IGBT器件的制作方法,其特征在于,所述方法包括:
在N型衬底中形成超结结构,所述超结结构由若干个N型柱和P型柱交替排列构成;
在所述N型衬底表面形成N型外延层;
在所述N型外延层中形成N型载流子注入层,所述N型载流子注入层与所述N型衬底之间间隔有所述N型外延层;
在所述N型外延层中形成IGBT器件的元胞单元,每个所述元胞单元包括沟槽栅、P型体区、位于P型体区顶部的源区,所述P型体区的底部位于所述N型载流子注入层中;
在所述N型衬底的底部形成集电区。
5.根据权利要求4所述的方法,其特征在于,所述在所述N型外延层中形成N型载流子注入层包括:
通过离子注入工艺向所述N型外延层中注入N型掺杂离子,形成所述N型载流子注入层。
6.根据权利要求5所述的方法,其特征在于,所述N型掺杂离子为磷离子。
7.根据权利要求5所述的方法,其特征在于,在形成N型载流子注入层的过程中,离子注入的剂量为1E11cm-2-1E14cm-2,离子注入的能量为1MeV-3MeV。
8.根据权利要求4所述的方法,其特征在于,所述在N型外延层中形成IGBT器件的元胞单元,包括:
在所述N型外延层中形成沟槽栅;
在所述沟槽栅外侧形成P型体区,所述P型体区的底部位于所述N型载流子注入层中;
在所述P型体区的顶部形成源区。
9.根据权利要求4至8任一所述的方法,其特征在于,所述方法还包括:
形成层间介质层;
在所述层间介质层中形成接触孔;
在所述层间介质层表面形成正面金属层,所述元胞单元中的源区和沟槽栅通过所述接触孔与所述正面金属层连接。
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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106098760A (zh) * 2016-06-16 2016-11-09 上海华虹宏力半导体制造有限公司 载流子存储型igbt及其制造方法
CN109887990A (zh) * 2019-01-30 2019-06-14 上海华虹宏力半导体制造有限公司 超结igbt器件及其制造方法
CN110416299A (zh) * 2018-04-28 2019-11-05 深圳尚阳通科技有限公司 超结器件及其制造方法
WO2020135464A1 (zh) * 2018-12-25 2020-07-02 无锡华润上华科技有限公司 沟槽型垂直双扩散金属氧化物半导体场效应晶体管
CN111370464A (zh) * 2018-12-26 2020-07-03 深圳尚阳通科技有限公司 沟槽栅功率器件及其制造方法
CN113241377A (zh) * 2021-05-10 2021-08-10 湖南大学 一种提升耐高温和抗辐照能力的igbt结构及其制备方法

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4363736B2 (ja) * 2000-03-01 2009-11-11 新電元工業株式会社 トランジスタ及びその製造方法
WO2016086381A1 (zh) * 2014-12-04 2016-06-09 冯淑华 沟槽栅功率半导体场效应晶体管

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106098760A (zh) * 2016-06-16 2016-11-09 上海华虹宏力半导体制造有限公司 载流子存储型igbt及其制造方法
CN110416299A (zh) * 2018-04-28 2019-11-05 深圳尚阳通科技有限公司 超结器件及其制造方法
WO2020135464A1 (zh) * 2018-12-25 2020-07-02 无锡华润上华科技有限公司 沟槽型垂直双扩散金属氧化物半导体场效应晶体管
CN111370464A (zh) * 2018-12-26 2020-07-03 深圳尚阳通科技有限公司 沟槽栅功率器件及其制造方法
CN109887990A (zh) * 2019-01-30 2019-06-14 上海华虹宏力半导体制造有限公司 超结igbt器件及其制造方法
CN113241377A (zh) * 2021-05-10 2021-08-10 湖南大学 一种提升耐高温和抗辐照能力的igbt结构及其制备方法

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