CN113540208B - 基于原位生长MIS结构的垂直GaN肖特基二极管及其制备方法 - Google Patents

基于原位生长MIS结构的垂直GaN肖特基二极管及其制备方法 Download PDF

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Abstract

本发明公开了一种基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底,其特征在于,所述衬底的底部设置有阴极,所述衬底的顶部从下至上依次设置有n+层和漂移区,漂移区顶部设置有原位生长的介质层,介质层的顶部设置有阳极。本发明还提供了上述二极管的制备方法,包括以下步骤:S1、提供衬底,对衬底进行预处理和热处理,在衬底上淀积n+层;S2、在n+层上,淀积厚度为1‑10μm的漂移区;S3、在GaN漂移区上,直接原位生长一层介质层;S4、在衬底的底部淀积阴极金属;S5、在介质层上制作掩膜,在介质层上淀积阳极金属,即得到所述肖特基二极管。本发明提供的二极管,界面质量高,利于长期可靠性。

Description

基于原位生长MIS结构的垂直GaN肖特基二极管及其制备方法
技术领域
本发明属于半导体器件领域,具体涉及一种原位生长MIS结构的垂直GaN肖特基二极管及其制备方法,可用于功率开关领域。
背景技术
以GaN、SiC等为代表的第三代宽禁带半导体材料凭借宽禁带宽度、高临界电场强度、高电子迁移率、高电子饱和速率等优点在功率开关器件领域中广受关注。GaN基肖特基势垒二极管(SBD)由于其优异的材料特性,具备低正向压降、快速反向恢复、高开关频率、高击穿电压、高功率密度等优点,是电力电子应用的理想选择。与横向肖特基二极管相比,垂直肖特基二极管导电通道更宽,功率密度更大。此外,垂直肖特基二极管只需要增加漂移区厚度即可提高器件的击穿电压,而器件横向尺寸不变。因此垂直肖特基二极管在功率应用中更受欢迎。然而肖特基二极管存在着缺陷,即反向漏电较大,导致反向耐压偏低。一般的解决方案是通过调整GaN材料的掺杂参数、添加场板终端结构、优化界面等。很少有研究者在肖特基二极管中应用MIS结构,这是因为传统生长介质的方法得到的界面质量较差,会引入较多的陷阱态,从而影响器件特性。
发明内容
本发明的目的在于克服现有技术的不足,提供一种基于原位生长MIS结构的垂直GaN肖特基二极管。
本发明的第一个目的是提供一种基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底,其特征在于,所述衬底的底部设置有阴极,所述衬底的顶部从下至上依次设置有n+层和漂移区,漂移区顶部设置有原位生长的介质层,介质层的顶部设置有阳极。
优选的,所述衬底、n+层和漂移区的材料均为氮化镓材料,且衬底为n型GaN衬底,介质层的材料为氮化硅、氧化镓、氧化铝、氮化铝中的一种。
优选的,所述n+层的厚度为0.5-5μm,掺杂元素为硅,掺杂浓度为1018cm-3-1020cm-3
优选的,所述漂移区和介质层的厚度分别为1-10μm和5-15nm。
优选的,所述阴极金属采用Ti/Al/Ni/Au组合,其中Ti金属的厚度为20-100nm,Al金属的厚度为100-300nm,Ni金属的厚度为20-200nm,Au金属的厚度为20-200nm。
优选的,所述阳极金属采用Ni/Au组合,其中Ni金属的厚度为20-100nm,Au金属的厚度为50-500nm。
本发明的第二个目的是提供一种上述垂直GaN肖特基二极管的制备方法,包括以下步骤:
S1、提供衬底,对衬底进行预处理和热处理,采用金属有机化合物化学气相淀积MOCVD工艺在衬底上淀积厚度为0.5-5μm的n+层,掺杂元素为硅,掺杂浓度为1018cm-3~1020cm-3
S2、在n+层上,采用MOCVD工艺淀积厚度为1-10μm的漂移区;
S3、在漂移区上,采用MOCVD工艺直接原位生长一层介质层;
S4、在衬底的底部采用电子束蒸发工艺淀积阴极金属,并在850℃的高温下进行退火;
S5、在介质层上制作掩膜,采用电子束蒸发工艺在介质层上淀积阳极金属,即得到所述肖特基二极管。
优选的,步骤S1中,所述衬底预处理和热处理的操作步骤为:对衬底利用丙酮、无水乙醇溶液和去离子水分别进行超声清洗,并在氢气氛围中以1050℃对衬底热处理10分钟。
优选的,步骤S1中,所述MOCVD工艺中的反应室压力为10-100Torr,Ga源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃。
优选的,步骤S2中,所述反应室压力为10~100Torr,Ga源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃;步骤S3中,所述反应室压力为10~100Torr,温度为900℃。
本发明与现有技术相比,其有益效果在于:
(1)本发明提供的基于原位生长MIS结构的垂直GaN肖特基二极管,通过在GaN材料和阳极之间插入介质层,形成MIS结构,能够抑制反向漏电。
(2)本发明提供的基于原位生长MIS结构的垂直GaN肖特基二极管,通过使用原位生长MIS结构,在抑制反向漏电同时,引入的界面态较少,界面质量高,利于长期可靠性。
附图说明
图1为本发明实施例1提供的基于原位生长MIS结构的垂直GaN肖特基二极管结构示意图;
图2为本发明实施例1提供的基于原位生长MIS结构的垂直GaN肖特基二极管制备流程图;
图3为本发明实施例1提供的基于原位生长MIS结构的垂直GaN肖特基二极管与传统结构的垂直GaN肖特基二极管反向漏电对比图;
图中:1、衬底;2、n+层;3、漂移区;4、阴极;5、介质层;6、阳极。
具体实施方式
下面将参照附图更详细地描述本公开的示例性实施例。虽然附图中显示了本公开的示例性实施例,然而应当理解,可以以各种形式实现本公开而不应被这里阐述的实施例所限制。相反,提供这些实施例是为了能够更透彻地理解本公开,并且能够将本公开的范围完整的传达给本领域的技术人员。
如图1所示,本发明提供的基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底1,衬底1的底部设置有阴极4,所述衬底1的顶部从下至上依次设置有n+层2和漂移区3,漂移区3的顶部设置有原位生长的介质层5,介质层5的顶部设置有阳极6。
衬底1、n+层2和漂移区3的材料均为氮化镓材料,且衬底1为n型GaN衬底,介质层5的材料为氮化硅、氧化镓、氧化铝、氮化铝中的一种。
n+层2的厚度为0.5-5μm,掺杂浓度为1018cm-3-1020cm-3,掺杂元素为硅。
漂移区3和介质层5的厚度分别为1-10μm和5-15nm。
阴极4金属采用Ti/Al/Ni/Au组合,其中Ti金属的厚度为20-100nm,Al金属的厚度为100-300nm,Ni金属的厚度为20-200nm,Au金属的厚度为20-200nm。
阳极6金属采用Ni/Au组合,其中Ni金属的厚度为20-100nm,Au金属的厚度为50-500nm。
如图2所示,本发明还提供了上述基于原位生长MIS结构的垂直GaN肖特基二极管的制备方法,具体包括以下步骤:
S1、提供衬底,对衬底1利用丙酮、无水乙醇溶液和去离子水分别进行超声清洗,并在氢气氛围中以1050℃对衬底1热处理10分钟,接着采用金属有机化合物化学气相淀积MOCVD工艺在衬底1上淀积厚度为0.5-5μm的n+层2,掺杂浓度为1018cm-3~1020cm-3,掺杂元素为硅,其中,MOCVD工艺中的反应室压力为10-100Torr,Ga源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃;
S2、在n+层2上,采用MOCVD工艺淀积厚度为1-10μm的漂移区3,其中MOCVD工艺中的反应室压力为10~100Torr,Ga源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃;
S3、在漂移区3上,采用MOCVD工艺直接原位生长一层介质层5,其中,以氮化铝介质和氧化镓介质为例,若所选介质为氮化铝,所述反应室压力为10~100Torr,Al源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃,若所选介质为氧化镓,所述反应室压力为10~100Torr,Ga源流量为50-100μmol/min,氧气或一氧化二氮流量为3000-6000sccm,温度为900℃。
S4、在衬底1的底部采用电子束蒸发工艺淀积阴极4金属,并在850℃的高温下进行退火;
S5、在介质层5上制作掩膜,采用电子束蒸发工艺在介质层5上淀积阳极6金属,即得到所述肖特基二极管。
实施例1
本发明实施例提供的基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底1,衬底1的底部设置有阴极4,所述衬底1的顶部从下至上依次设置有n+层2和漂移区3,漂移区3的顶部设置有原位生长的介质层5,介质层5的顶部设置有阳极6。
衬底1、n+层2和漂移区3的材料均为氮化镓材料,且衬底1为n型GaN衬底,介质层5的材料为氮化铝。
n+层2的厚度为0.5μm,掺杂浓度为1018cm-3
漂移区3和介质层5的厚度分别为1μm和5nm。
阴极4金属采用Ti/Al/Ni/Au组合,其中Ti金属的厚度为20nm,Al金属的厚度为100nm,Ni金属的厚度为20nm,Au金属的厚度为20nm。
阳极6金属采用Ni/Au组合,其中Ni金属的厚度为20nm,Au金属的厚度为50nm。
本发明实施例还提供了上述基于原位生长MIS结构的垂直GaN肖特基二极管的制备方法,具体包括以下步骤:
S1、提供氮化镓衬底,对衬底1利用丙酮、无水乙醇溶液和去离子水分别进行超声清洗10min,消除悬挂键,将清洗后的氮化镓衬底用氮气枪吹干;将清洗吹干后的氮化镓衬底在氢气氛围中以1050℃对衬底1热处理10分钟,以去除表面污染物,接着采用金属有机化合物化学气相淀积MOCVD工艺在GaN衬底1上淀积厚度为0.5μm的GaN n+层2,掺杂浓度为1018cm-3,其中,MOCVD工艺中的反应室压力为10Torr,Ga源流量为50μmol/min,氨气流量为3000sccm,氢气流量为1000sccm,温度为900℃;
S2、在n+层2上,采用MOCVD工艺淀积厚度为1μm的GaN漂移区3,其中MOCVD工艺中的反应室压力为10Torr,Ga源流量为50μmol/min,氨气流量为3000sccm,氢气流量为1000sccm,温度为900℃;
S3、将生长完漂移层的外延片继续放在MOCVD腔室内,在漂移区3上,采用MOCVD工艺直接原位生长一层厚度为5nm的AlN介质层5,其中,MOCVD工艺中的反应室压力为10Torr,Al源流量为50μmol/min,氨气流量为3000sccm,氢气流量为1000sccm;
S4、将生长完介质层的外延片放入E-Beam电子束蒸发设备中,以0.1nm/s的蒸发速率在衬底1的底部采用电子束蒸发工艺淀积阴极4金属,阴极4金属为Ti/Al/Ni/Au组合,其中Ti的厚度为20nm,Al的厚度为100nm,Ni的厚度为20nm,Au的厚度为20nm,并在850℃的高温下退火30s;
S5、在介质层5上制作掩膜,形成阳极窗口;将制作掩膜后的样品放置在E-Beam电子束蒸发设备中,以0.1nm/s的蒸发速率采用电子束蒸发工艺在阳极窗口中淀积阳极6金属,阳极6的金属采用Ni/Au组合,其中Ni的厚度为20nm,Au的厚度为50nm,即得到所述肖特基二极管。
实施例2
本发明实施例提供的基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底1,衬底1的底部设置有阴极4,所述衬底1的顶部从下至上依次设置有n+层2和漂移区3,漂移区3的顶部设置有原位生长的介质层5,介质层5的顶部设置有阳极6。
衬底1、n+层2和漂移区3的材料均为氮化镓材料,且衬底1为n型GaN衬底,介质层5的材料为氮化铝。
n+层2的厚度为3μm,掺杂浓度为1019cm-3
漂移区3和介质层5的厚度分别为5μm和10nm。
阴极4金属采用Ti/Al/Ni/Au组合,其中Ti金属的厚度为50nm,Al金属的厚度为200nm,Ni金属的厚度为100nm,Au金属的厚度为100nm。
阳极6金属采用Ni/Au组合,其中Ni金属的厚度为50nm,Au金属的厚度为250nm。
本发明实施例还提供了上述基于原位生长MIS结构的垂直GaN肖特基二极管的制备方法,具体包括以下步骤:
S1、提供氮化镓衬底,对衬底1利用丙酮、无水乙醇溶液和去离子水分别进行超声清洗10min,消除悬挂键,将清洗后的氮化镓衬底用氮气枪吹干;将清洗吹干后的氮化镓衬底在氢气氛围中以1050℃对衬底1热处理10分钟,以去除表面污染物,接着采用金属有机化合物化学气相淀积MOCVD工艺在GaN衬底1上淀积厚度为3μm的GaN n+层2,掺杂浓度为1019cm-3cm-3,其中,MOCVD工艺中的反应室压力为50Torr,Ga源流量为70μmol/min,氨气流量为4500sccm,氢气流量为1500sccm,温度为900℃;
S2、在n+层2上,采用MOCVD工艺淀积厚度为5μm的GaN漂移区3,其中MOCVD工艺中的反应室压力为50Torr,Ga源流量为70μmol/min,氨气流量为4500sccm,氢气流量为1500sccm;
S3、将生长完漂移层的外延片继续放在MOCVD腔室内,在漂移区3上,采用MOCVD工艺直接原位生长一层厚度为10nm的AlN介质层5,其中,MOCVD工艺中的反应室压力为50Torr,Al源流量为70μmol/min,氨气流量为4500sccm,氢气流量为1500sccm;
S4、将生长完介质层的外延片放入E-Beam电子束蒸发设备中,以0.1nm/s的蒸发速率在衬底1的底部采用电子束蒸发工艺淀积阴极4金属,阴极4金属为Ti/Al/Ni/Au组合,其中Ti的厚度为50nm,Al的厚度为200nm,Ni的厚度为100nm,Au的厚度为100nm,并在850℃的高温下退火30s;
S5、在介质层5上制作掩膜,形成阳极窗口;将制作掩膜后的样品放置在E-Beam电子束蒸发设备中,以0.1nm/s的蒸发速率采用电子束蒸发工艺在阳极窗口中淀积阳极6金属,阳极6的金属采用Ni/Au组合,其中Ni的厚度为50nm,Au的厚度为250nm,即得到所述肖特基二极管。
实施例3
本发明实施例提供的基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底1,衬底1的底部设置有阴极4,所述衬底1的顶部从下至上依次设置有n+层2和漂移区3,漂移区3的顶部设置有原位生长的介质层5,介质层5的顶部设置有阳极6。
衬底1、n+层2和漂移区3的材料均为氮化镓材料,且衬底1为n型GaN衬底,介质层5的材料为氧化镓。
n+层2的厚度为5μm,掺杂浓度为1020cm-3
漂移区3和介质层5的厚度分别为10μm和15nm。
阴极4金属采用Ti/Al/Ni/Au组合,其中Ti金属的厚度为100nm,Al金属的厚度为300nm,Ni金属的厚度为200nm,Au金属的厚度为200nm。
阳极6金属采用Ni/Au组合,其中Ni金属的厚度为100nm,Au金属的厚度为500nm。
本发明实施例还提供了上述基于原位生长MIS结构的垂直GaN肖特基二极管的制备方法,具体包括以下步骤:
S1、提供氮化镓衬底,对衬底1利用丙酮、无水乙醇溶液和去离子水分别进行超声清洗10min,消除悬挂键,将清洗后的氮化镓衬底用氮气枪吹干;将清洗吹干后的氮化镓衬底在氢气氛围中以1050℃对衬底1热处理10分钟,以去除表面污染物,接着采用金属有机化合物化学气相淀积MOCVD工艺在GaN衬底1上淀积厚度为5μm的GaN n+层2,掺杂浓度为1020cm-3,其中,MOCVD工艺中的反应室压力为100Torr,Ga源流量为100μmol/min,氨气流量为6000sccm,氢气流量为2000sccm,温度为900℃;
S2、在n+层2上,采用MOCVD工艺淀积厚度为10μm的GaN漂移区3,其中MOCVD工艺中的反应室压力为100Torr,Ga源流量为100μmol/min,氨气流量为6000sccm,氢气流量为2000sccm,温度为900℃;
S3、将生长完漂移层的外延片继续放在MOCVD腔室内,在漂移区3上,采用MOCVD工艺直接原位生长一层厚度为15nm的Ga2O3介质层5,其中,MOCVD工艺中的反应室压力为100Torr,Ga源流量为100μmol/min,氧气或一氧化二氮流量为6000sccm,温度为900℃;
S4、将生长完介质层的外延片放入E-Beam电子束蒸发设备中,以0.1nm/s的蒸发速率在衬底1的底部采用电子束蒸发工艺淀积阴极4金属,阴极4金属为Ti/Al/Ni/Au组合,其中Ti的厚度为100nm,Al的厚度为300nm,Ni的厚度为200nm,Au的厚度为200nm,并在850℃的高温下退火30s;
S5、在介质层5上制作掩膜,形成阳极窗口;将制作掩膜后的样品放置在E-Beam电子束蒸发设备中,以0.1nm/s的蒸发速率采用电子束蒸发工艺在阳极窗口中淀积阳极6金属,阳极6的金属采用Ni/Au组合,其中Ni的厚度为100nm,Au的厚度为500nm,即得到所述肖特基二极管。
下面对本发明实施例1提供的基于原位生长MIS结构的垂直GaN肖特基二极管与传统结构的垂直GaN肖特基二极管的性能进行研究
传统结构的垂直GaN肖特基二极管通过采用文献名称为:1kV/1.3mΩ·cm2Vertical GaN-on-GaN Schottky Barrier Diodes with High Switching Performance,文献号为10.1109/ISPSD.2018.8393655的文献中提供的方法制备得到。
图3为本发明实施例1提供的基于原位生长MIS结构的垂直GaN肖特基二极管与传统结构垂直GaN肖特基二极管的反向漏电对比图,通过图3可以看出,与传统结构的垂直GaN肖特基二极管相比,本发明实施例1通过引入原位生长的MIS结构,所制备得到的垂直GaN肖特基二极管的反向漏电相较于传统结构降低了三个数量级左右。
综上所述,本发明实施例提供的基于原位生长MIS结构的垂直GaN肖特基二极管,通过使用MIS结构,能够抑制反向漏电,而且本发明提供的基于原位生长MIS结构的垂直GaN肖特基二极管,通过使用原位生长MIS结构,在抑制反向漏电同时,引入的界面态较少,界面质量高,利于长期可靠性。
尽管已经示出和描述了本发明的实施例,本领域的普通技术人员可以理解:在不脱离本发明的原理和宗旨的情况下可以对这些实施例进行多种变化、修改、替换和变型,本发明的范围由权利要求及其等同物限定。

Claims (6)

1.一种基于原位生长MIS结构的垂直GaN肖特基二极管,包括衬底(1),其特征在于,所述衬底(1)的底部设置有阴极(4),所述衬底(1)的顶部从下至上依次设置有n+层(2)和漂移区(3),所述漂移区(3)的顶部设置有原位生长的介质层(5),所述介质层(5)的顶部设置有阳极(6);
所述n+层(2)的厚度为0.5-5μm,掺杂元素为硅,掺杂浓度为1018cm-3-1020cm-3
所述漂移区(3)和介质层(5)的厚度分别为1-10μm和5-15nm;
所述基于原位生长MIS结构的垂直GaN肖特基二极管的制备方法,包括以下步骤:
S1、提供衬底,对衬底(1)进行预处理和热处理,采用金属有机化合物化学气相淀积MOCVD工艺在衬底(1)上淀积所述n+层(2),掺杂元素为硅;
S2、在n+层(2)上,采用MOCVD工艺淀积所述漂移区(3);
反应室压力为10~100Torr,Ga源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃;
S3、在漂移区(3)上,采用MOCVD工艺直接原位生长一层所述介质层(5);
所述反应室压力为10~100Torr,温度为900℃;
S4、在衬底(1)的底部采用电子束蒸发工艺淀积阴极(4)金属,并在850℃的高温下进行退火;
S5、在介质层(5)上制作掩膜,采用电子束蒸发工艺在介质层(5)上淀积阳极(6)金属,即得到所述肖特基二极管。
2.根据权利要求1所述的基于原位生长MIS结构的垂直GaN肖特基二极管,其特征在于,所述衬底(1)、n+层(2)和漂移区(3)的材料均为氮化镓材料,且所述衬底(1)为n型GaN衬底,所述介质层(5)的材料为氮化硅、氧化镓、氧化铝、氮化铝中的一种。
3.根据权利要求1所述的基于原位生长MIS结构的垂直GaN肖特基二极管,其特征在于,所述阴极(4)金属采用Ti/Al/Ni/Au组合,其中Ti金属的厚度为20-100nm,Al金属的厚度为100-300nm,Ni金属的厚度为20-200nm,Au金属的厚度为20-200nm。
4.根据权利要求1所述的基于原位生长MIS结构的垂直GaN肖特基二极管,其特征在于,所述阳极(6)金属采用Ni/Au组合,其中Ni金属的厚度为20-100nm,Au金属的厚度为50-500nm。
5.根据权利要求1所述的基于原位生长MIS结构的垂直GaN肖特基二极管,其特征在于,所述垂直GaN肖特基二极管制备方法的步骤S1中,所述衬底(1)预处理和热处理的操作步骤为:对衬底(1)利用丙酮、无水乙醇溶液和去离子水分别进行超声清洗,并在氢气氛围中以1050℃对衬底(1)热处理10分钟。
6.根据权利要求1所述的基于原位生长MIS结构的垂直GaN肖特基二极管,其特征在于,所述垂直GaN肖特基二极管制备方法的步骤S1中,所述MOCVD工艺中的反应室压力为10-100Torr,Ga源流量为50-100μmol/min,氨气流量为3000-6000sccm,氢气流量为1000-2000sccm,温度为900℃。
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* Cited by examiner, † Cited by third party
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JPS57113290A (en) * 1980-12-29 1982-07-14 Fujitsu Ltd Manufacture of mis type schottky diode
US5070035A (en) * 1988-01-25 1991-12-03 Nippon Mining Co., Ltd. Method for producing a iii-v compound semiconductor device with a phosphoric oxide insulating layer
JPH04302172A (ja) * 1991-03-29 1992-10-26 Kobe Steel Ltd ダイヤモンドショットキーダイオード
JPH06151899A (ja) * 1992-11-09 1994-05-31 Fuji Electric Co Ltd ダイヤモンド整流素子およびその製造方法
US20060145190A1 (en) * 2004-12-31 2006-07-06 Salzman David B Surface passivation for III-V compound semiconductors
JP5800291B2 (ja) * 2011-04-13 2015-10-28 ローム株式会社 ZnO系半導体素子およびその製造方法
US8822311B2 (en) * 2011-12-22 2014-09-02 Avogy, Inc. Method of fabricating a GaN P-i-N diode using implantation
CN110676308B (zh) * 2019-10-12 2022-12-20 中国电子科技集团公司第十三研究所 肖特基二极管的制备方法

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