CN112037722A - 电压提供电路及显示设备 - Google Patents

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Abstract

本申请实施例提供了一种电压提供电路，用于显示设备中，包括：一第一输出端，其用于输出第一高电平或第一低电平至GOA单元；一第一开关单元，其输入端以及控制端接入第一高电平，以用于在其导通时输出第一高电平至所述第一输出端；一第二开关单元，其输入端以及控制端接入第一低电平，以用于在其导通时输出第一低电平至第一输出端；一第三开关单元，其输入端与第一开关单元的控制端连接，以用于在其导通时将第一开关单元的控制端电压拉低至公共电压；一第四开关单元，其输入端与第二开关单元的控制端连接，其输出端连接至公共电压节点，以用于在其导通时将所述第二开关单元的控制端电压拉升至公共电压，以使得第二开关单元截止。

Description

电压提供电路及显示设备
技术领域
本申请涉及显示技术领域，具体而言，涉及一种电压提供电路及显示设备。
背景技术
目前由于液晶面板的设计架构差异，在GOA信号新增加一路VSSQ信号，导致原有IC不支持多路VSS信号输出，导致在关机时出现关机残影的现象。因此，现有技术存在缺陷，急需改进。
发明内容
本申请实施例的目的在于提供一种电压提供电路及显示设备，可以通过一个电路在显示设备关机瞬间提供高电压，避免出现关机残影。
第一方面，本申请实施例提供了一种电压提供电路，用于显示设备中，包括：
一第一输出端，其用于输出第一高电平或第一低电平至GOA单元；
一第一开关单元，其输入端以及控制端接入第一高电平，以用于在其导通时输出第一高电平至所述第一输出端；
一第二开关单元，其输入端以及控制端接入第一低电平，以用于在其导通时输出第一低电平至所述第一输出端；
一第三开关单元，其输入端与所述第一开关单元的控制端连接，其输出端连接至公共电压，以用于在其导通时将所述第一开关单元的控制端电压拉低至所述公共电压，以使得所述第一开关单元截止；
一第四开关单元，其输入端与所述第二开关单元的控制端连接，其输出端连接至公共电压节点，以用于在其导通时将所述第二开关单元的控制端电压拉升至所述公共电压，以使得所述第二开关单元截止；
所述第三开关单元以及所述第四开关单元在外部信号的控制下具有相反的开关状态。
可选地，在本申请实施例所述的电压提供电路中，所述第一开关单元包括第二电阻以及第四PMOS管；
所述第四PMOS管的源极与所述第二电阻的一端连接并接入所述第一高电平信号；所述第四PMOS管的漏极与所述第一输出端连接；
所述第四PMOS管的栅极与所述第二电阻的另一端连接。
可选地，在本申请实施例所述的电压提供电路中，所述第一开关单元还包括第一电阻，所述第一电阻的一端与所述第二电阻与所述第四PMOS管的栅极连接，所述第一电阻的另一端与所述第三开关单元的输入端连接。
可选地，在本申请实施例所述的电压提供电路中，所述第三开关单元包括第一NMOS管，所述第一NMOS管的栅极接入外部控制信号，所述第一NMOS管的源极连接公共电压，所述第一NMOS管的漏极与所述第一电阻连接。
可选地，在本申请实施例所述的电压提供电路中，所述第二开关单元包括第二NMOS管以及第三电阻；
所述第二NMOS管的漏极与所述第一输出端连接，所述第二NMOS管的源极与所述第三电阻的一端连接并接入所述第一低电平；
所述第二NMOS管的栅极与所述第三电阻的另一端连接并与所述第四开关单元的输入端连接。
可选地，在本申请实施例所述的电压提供电路中，所述第四开关单元包括第三PMOS管，所述第三PMOS管的源极与所述第二NMOS管的栅极连接，所述第三PMOS管的漏极接入所述公共电压；
所述第三PMOS管的栅极接入外部控制电压。
可选地，在本申请实施例所述的电压提供电路中，所述第三开关单元的控制端以及所述第四开关单元的控制端连接；
所述电压提供电路还包括一第四电阻，所述第四电阻的一端与所述第三开关单元的控制端以及所述第四开关单元的控制端连接，所述第四电阻的另一端接入外部控制电压。
可选地，在本申请实施例所述的电压提供电路中，所述第一高电平为29V，所述第一低电平为-8V，所述公共电压为0V。
可选地，在本申请实施例所述的电压提供电路中，当所述显示设备开机时，所述第一输出端输出第一低电平；
当所述显示设备关机时，所述第一输出端输出第一高电平。
第二方面，本申请实施例还提供了一种显示设备，包括上述任一项任一项所述的电压提供电路。
由上可知，本申请实施例通过采用一第一输出端，其用于输出第一高电平或第一低电平至GOA单元；一第一开关单元，其输入端以及控制端接入第一高电平，以用于在其导通时输出第一高电平至所述第一输出端；一第二开关单元，其输入端以及控制端接入第一低电平，以用于在其导通时输出第一低电平至所述第一输出端；一第三开关单元，其输入端与所述第一开关单元的控制端连接，其输出端连接至公共电压，以用于在其导通时将所述第一开关单元的控制端电压拉低至所述公共电压，以使得所述第一开关单元截止；一第四开关单元，其输入端与所述第二开关单元的控制端连接，其输出端连接至公共电压节点，以用于在其导通时将所述第二开关单元的控制端电压拉升至所述公共电压，以使得所述第二开关单元截止；所述第三开关单元以及所述第四开关单元在外部信号的控制下具有相反的开关状态；从而使得系统在关机瞬间，该电压提供电路的第一输出端输出的电压被瞬间拉高至第一高电平，避免了关机残影。
本申请的其他特征和优点将在随后的说明书阐述，并且，部分地从说明书中变得显而易见，或者通过实施本申请实施例了解。本申请的目的和其他优点可通过在所写的说明书、权利要求书、以及附图中所特别指出的结构来实现和获得。
附图说明
为了更清楚地说明本申请实施例的技术方案，下面将对本申请实施例中所需要使用的附图作简单地介绍，应当理解，以下附图仅示出了本申请的某些实施例，因此不应被看作是对范围的限定，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他相关的附图。
图1为本申请实施例提供的电压提供电路的电路结构图。
图2为本申请实施例提供的电压提供电路的效果示意图。
具体实施方式
下面将结合本申请实施例中附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。通常在此处附图中描述和示出的本申请实施例的组件可以以各种不同的配置来布置和设计。因此，以下对在附图中提供的本申请的实施例的详细描述并非旨在限制要求保护的本申请的范围，而是仅仅表示本申请的选定实施例。基于本申请的实施例，本领域技术人员在没有做出创造性劳动的前提下所获得的所有其他实施例，都属于本申请保护的范围。
应注意到：相似的标号和字母在下面的附图中表示类似项，因此，一旦某一项在一个附图中被定义，则在随后的附图中不需要对其进行进一步定义和解释。同时，在本申请的描述中，术语“第一”、“第二”等仅用于区分描述，而不能理解为指示或暗示相对重要性。
请参照图1，图1是本申请一些实施例中的一种电压提供电路的结构示意图，电压提供电路用于显示设备中，电压提供电路包括：一第一输出端10、一第一开关单元20、一第二开关单元30、一第三开关单元40、一第四开关单元50。
其中，该第一输出端10用于输出第一高电平或第一低电平至GOA单元；其中，该第一开关单元20的输入端以及控制端接入第一高电平，以用于在其导通时输出第一高电平至所述第一输出端10；其中，该第二开关单元30的输入端以及控制端接入第一低电平，以用于在其导通时输出第一低电平至所述第一输出端10；其中，该第三开关单元40的输入端与所述第一开关单元20的控制端连接，其输出端连接至公共电压，以用于在其导通时将所述第一开关单元20的控制端电压拉低至所述公共电压，以使得所述第一开关单元20截止；其中，该第四开关单元50的输入端与所述第二开关单元30的控制端连接，其输出端连接至公共电压节点，以用于在其导通时将所述第二开关单元30的控制端电压拉升至所述公共电压，以使得所述第二开关单元30截止；所述第三开关单元40以及所述第四开关单元50在外部信号的控制下具有相反的开关状态。
具体地，在一些实施例中，该第一开关单元20包括第二电阻R2以及第四PMOS管Q4；第四PMOS管Q4的源极与所述第二电阻R2的一端连接并接入所述第一高电平信号；所述第四PMOS管Q4的漏极与所述第一输出端连接；所述第四PMOS管Q4的栅极与所述第二电阻R2的另一端连接。
在一些实施例中，该第一开关单元20还包括第一电阻R1，所述第一电阻R1的一端与所述第二电阻R2与所述第四PMOS管Q4的栅极连接，所述第一电阻R1的另一端与所述第三开关单元40的输入端连接。
具体地，在一些实施例中，该第三开关单元40包括第一NMOS管Q1，所述第一NMOS管Q1的栅极G接入外部控制信号，所述第一NMOS管Q1的源极S连接公共电压，所述第一NMOS管Q1的漏极D与所述第一电阻R1连接。
具体地，在一些实施例中，第二开关单元30包括第二NMOS管Q2以及第三电阻R3；第二NMOS管Q2的漏极D与所述第一输出端连接，所述第二NMOS管Q2的源极S与所述第三电阻R3的一端连接并接入所述第一低电平；所述第二NMOS管Q2的栅极G与所述第三电阻R3的另一端连接并与所述第四开关单元50的输入端连接。
具体地，在一些实施例中，该第四开关单元50包括第三PMOS管Q3，所述第三PMOS管Q3的源极与所述第二NMOS管Q2的栅极连接，所述第三PMOS管Q3的漏极接入所述公共电压；所述第三PMOS管Q3的栅极接入外部控制电压。
具体地，在一些实施例中，该第三开关单元40的控制端以及所述第四开关单元50的控制端连接；所述电压提供电路还包括一第四电阻R4，所述第四电阻R4的一端与所述第三开关单元40的控制端以及所述第四开关单元50的控制端连接，所述第四电阻R4的另一端接入外部控制电压。
其中，该第一高电平为29V，所述第一低电平为-8V，所述公共电压为0V。
具体的，请继续参照图1。当系统处于开机状态时，第一NMOS管Q1的栅极G接入VSSG(比如为-5V)电压，第一NMOS管Q1的源极S为0V，此时第一NMOS管Q1截止，则第四PMOS管Q4的栅极为VGH(比如为29V)电压，第四PMOS管Q4的源极为VGH(比如为29V)电压，此时第四PMOS管Q4截止；第三PMOS管Q3的栅极为VSSG(比如为-5V)电压，第三PMOS管Q3的源极为VGL(比如为-8V)电压，此时第三PMOS管Q3导通，则第二NMOS管Q2的栅极G为0V，第二NMOS管Q2的源极S为VGL(比如-8V)电压，此时第二NMOS管Q2导通；VSSQ输出为VGL(比如为-8V)电压。
当系统关机后，VSSG(比如为-5V)瞬间被拉到VGH(比如为29V)，第一NMOS管Q1的栅极G为VGH(比如为29V)电压，第一NMOS管Q1的源极S为0V，此时第一NMOS管Q1导通，则第四PMOS管Q4的栅极为0V，第四PMOS管Q4的源极为VGH(比如为29V)电压，此时第四PMOS管Q4导通；第三PMOS管Q3的栅极为VGH(比如为29V)电压，第三PMOS管Q3的源极为VGL(比如为-8V)电压，此时第三PMOS管Q3截止，则第二NMOS管Q2的栅极G为VGL(比如为-8V)，第二NMOS管Q2的源极S为VGL(比如为-8V)电压，此时第二NMOS管Q2截止；VSSQ输出为VGH(比如为29V)电压，此时打开放电，无关机残影。
也即，当所述显示设备开机时，所述第一输出端输出第一低电平；当所述显示设备关机时，所述第一输出端输出第一高电平；由于在关机瞬间，该第一输出端输出的电压被瞬间拉高至该第一高电平，从而避免了关机残影问题。
具体的，请参照图2，图2为本申请实施例提供的电压提供电路的效果示意图。如图2所示，其中，a为未使用申请实施例提供的电压提供电路的效果示意图；b为使用申请实施例提供的电压提供电路的效果示意图。
如图2中a所示，当VCC掉电后，VSSQ从-8V缓慢掉电到0V，显示设备中晶体管关闭，电荷无法快速释放，有关机残影。
如图2中b所示，当VCC掉电后，VSSQ从-8V瞬间拉高到VGH电压，显示面板中晶体管打开，电荷快速快速释放，无关机残影。
本申请实施例通过采用一第一输出端，其用于输出第一高电平或第一低电平至GOA单元；一第一开关单元，其输入端以及控制端接入第一高电平，以用于在其导通时输出第一高电平至所述第一输出端；一第二开关单元，其输入端以及控制端接入第一低电平，以用于在其导通时输出第一低电平至所述第一输出端；一第三开关单元，其输入端与所述第一开关单元的控制端连接，其输出端连接至公共电压，以用于在其导通时将所述第一开关单元的控制端电压拉低至所述公共电压，以使得所述第一开关单元截止；一第四开关单元，其输入端与所述第二开关单元的控制端连接，其输出端连接至公共电压节点，以用于在其导通时将所述第二开关单元的控制端电压拉升至所述公共电压，以使得所述第二开关单元截止；所述第三开关单元以及所述第四开关单元在外部信号的控制下具有相反的开关状态；从而使得系统在关机瞬间，该电压提供电路的第一输出端输出的电压被瞬间拉高至第一高电平，避免了关机残影。
在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。
以上所述仅为本申请的实施例而已，并不用于限制本申请的保护范围，对于本领域的技术人员来说，本申请可以有各种更改和变化。凡在本申请的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本申请的保护范围之内。

Claims (10)

1.一种电压提供电路，用于显示设备中，其特征在于，包括：
一第一输出端，其用于输出第一高电平或第一低电平至GOA单元；
一第一开关单元，其输入端以及控制端接入第一高电平，以用于在其导通时输出第一高电平至所述第一输出端；
一第二开关单元，其输入端以及控制端接入第一低电平，以用于在其导通时输出第一低电平至所述第一输出端；
一第三开关单元，其输入端与所述第一开关单元的控制端连接，其输出端连接至公共电压，以用于在其导通时将所述第一开关单元的控制端电压拉低至所述公共电压，以使得所述第一开关单元截止；
一第四开关单元，其输入端与所述第二开关单元的控制端连接，其输出端连接至公共电压节点，以用于在其导通时将所述第二开关单元的控制端电压拉升至所述公共电压，以使得所述第二开关单元截止；
所述第三开关单元以及所述第四开关单元在外部信号的控制下具有相反的开关状态。
2.根据权利要求1所述的电压提供电路，其特征在于，所述第一开关单元包括第二电阻以及第四PMOS管；
所述第四PMOS管的源极与所述第二电阻的一端连接并接入所述第一高电平信号；所述第四PMOS管的漏极与所述第一输出端连接；
所述第四PMOS管的栅极与所述第二电阻的另一端连接。
3.根据权利要求2所述的电压提供电路，其特征在于，所述第一开关单元还包括第一电阻，所述第一电阻的一端与所述第二电阻与所述第四PMOS管的栅极连接，所述第一电阻的另一端与所述第三开关单元的输入端连接。
4.根据权利要求3所述的电压提供电路，其特征在于，所述第三开关单元包括第一NMOS管，所述第一NMOS管的栅极接入外部控制信号，所述第一NMOS管的源极连接公共电压，所述第一NMOS管的漏极与所述第一电阻连接。
5.根据权利要求1所述的电压提供电路，其特征在于，所述第二开关单元包括第二NMOS管以及第三电阻；
所述第二NMOS管的漏极与所述第一输出端连接，所述第二NMOS管的源极与所述第三电阻的一端连接并接入所述第一低电平；
所述第二NMOS管的栅极与所述第三电阻的另一端连接并与所述第四开关单元的输入端连接。
6.根据权利要求5所述的电压提供电路，其特征在于，所述第四开关单元包括第三PMOS管，所述第三PMOS管的源极与所述第二NMOS管的栅极连接，所述第三PMOS管的漏极接入所述公共电压；
所述第三PMOS管的栅极接入外部控制电压。
7.根据权利要求1所述的电压提供电路，其特征在于，所述第三开关单元的控制端以及所述第四开关单元的控制端连接；
所述电压提供电路还包括一第四电阻，所述第四电阻的一端与所述第三开关单元的控制端以及所述第四开关单元的控制端连接，所述第四电阻的另一端接入外部控制电压。
8.根据权利要求1所述的电压提供电路，其特征在于，所述第一高电平为29V，所述第一低电平为-8V，所述公共电压为0V。
9.根据权利要求1所述的电压提供电路，其特征在于，当所述显示设备开机时，所述第一输出端输出第一低电平；
当所述显示设备关机时，所述第一输出端输出第一高电平。
10.一种显示设备，其特征在于，包括权利要求1-9任一项所述的电压提供电路。
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