CN101826309B - 具有消除关机残影功能的液晶显示器 - Google Patents
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Abstract
一种液晶显示器包含一印刷线电路板、一软性电路板及一显示面板。该印刷线电路板上包含一准位转换电路及一关机放电电路。该显示面板上包含一栅极驱动电路及一薄膜晶体管数组。该关机放电电路可于该液晶显示器关机时将一栅极高准位电压端电性连接于栅极低准位电压端以驱动该栅极驱动电路开启该薄膜晶体管数组的所有的薄膜晶体管。
Description
技术领域
本发明是相关于一种具有消除关机残影功能的液晶显示器，尤指一种具有消除关机残影功能的液晶显示器，其栅极驱动器设置于显示面板。
背景技术
目前造成液晶显示器发生关机残影的主要原因为当液晶显示器的供应电源关闭时，显示面板的像素电极放电速度太慢，使得关机后的残留电荷无法及时释放而残留于液晶电容中，产生关机后液晶显示器还有残留影像，即为关机残影。
请参考图1及图2，图1为当前技术的可消除关机残影的液晶显示器10的示意图，图2为图1的信号的波形图。液晶显示器10包含一电源供应器11、一电压侦测器12、一显示面板13、一栅极驱动器14及源极驱动器15。电源供应器11提供一输入电压VIN给源极驱动器15与门极驱动器14。同时，电源供应器11亦提供输入电压VIN给电压侦测器12，电压侦测器12可将输入电压VIN与一参考电压进行比较。当液晶显示器10关机时，输入电压VIN下降到低于该参考电压的准位，此时电压侦测器12会发出一关机信号XDON给栅极驱动器14，当关机信号XDON由高准位转为低准位时，栅极驱动器14将显示面板13上的薄膜晶体管全部打开，使残留电荷有效释放，因此可以改善关机残影。
然而，在当前技术的栅极驱动器设置于显示面板(gate in panel，GIP)的液晶显示器中，栅极驱动器是以薄膜晶体管制程在玻璃基板上形成移位缓存器的电路，由于栅极驱动器的电路就是移位缓存器，因此在液晶显示器关机的瞬间无法让所有输出栅极高准位电压VGH到所有的栅极线，使得栅极驱动器设置于显示面板的液晶显示器在关机时仍会有残影的问题产生。
发明内容
因此，本发明是提供一种具有消除关机残影功能的液晶显示器。
本发明是提供一种栅极驱动器设置于显示面板的关机放电电路。该关机放电电路包含：一第一晶体管、一第二晶体管、一第三晶体管、一第一电阻、一第二电阻、一第三电阻、一第四电阻、一第五电阻、一第六电阻、一第七电阻、一第八电阻、一第九电阻、一第一电容、一第二电容及一第三电容。该第一晶体管具有一栅极，一源极电性连接于一高电压端，及一漏极。该第二晶体管具有一栅极，一源极电性连接于一接地端，及一漏极。该第三晶体管具有一栅极，一源极电性连接于该接地端，及一漏极。该第一电阻电性连接于该第三晶体管的栅极及一电源控制端之间。该第二电阻电性连接于该第三晶体管的栅极及该接地端之间。该第三电阻电性连接于该第三晶体管的漏极及该高电压端之间。该第四电阻电性连接于该第三晶体管的漏极及该接地端之间。该第五电阻电性连接于该第一晶体管的源极及该第一晶体管的栅极之间。该第六电阻电性连接于该第三晶体管的漏极及该第二晶体管的栅极之间。该第七电阻电性连接于该第一晶体管的栅极及该第二晶体管的漏极之间。该第八电阻电性连接于该第一晶体管的漏极及该接地端之间。该第九电阻电性连接于该第一晶体管的漏极及一低电压端之间。该第一电容电性连接于该第三晶体管的漏极及该接地端之间。该第二电容电性连接于该第一晶体管的源极及该第一晶体管的栅极之间。该第三电容电性连接于该第一晶体管的漏极及该接地端之间。
本发明还提供一种液晶显示器。该液晶显示器包含一显示面板、一印刷线电路板及一软性电路板。该显示面板包含一薄膜晶体管数组及一栅极驱动电路。该栅极驱动电路用来驱动该薄膜晶体管数组。该印刷线电路板包含一电压转换电路及一关机放电电路。该电压转换电路用来产生控制该栅极驱动电路的信号。该关机放电电路用来于该液晶显示器关机时电性连接一高电压端及一低电压端。该软性电路板电性连接于该显示面板及该印刷线电路板之间，用来传输控制该栅极驱动电路的信号。
附图说明
图1为当前技术的可消除关机残影的液晶显示器10的示意图。
图2为图1的信号的波形图。
图3为本发明的栅极驱动器设置于显示面板的液晶显示器的方块图。
图4为栅极驱动电路的电路图。
图5为图4的信号的波形图。
图6为图4的SR正反器的电路图。
图7为本发明关机放电电路的电路图。
图8为本发明液晶显示器关机时的波形图。
【主要组件符号说明】
10 液晶显示器 11 电源供应器
12 电压侦测器 13 显示面板
14 栅极驱动器 15 源极驱动器
20 液晶显示器 22 印刷线电路板
24 软性电路板 26 显示面板
28 准位转换电路 30 关机放电电路
32 栅极驱动电路 34 SR正反器
38 薄膜晶体管数组
VIN 输入电压 XDON 关机信号
M1-M14薄膜晶体管 STV 启动信号
CPV 频率信号 OE 致能信号
STVP 高准位启动信号 CKV 第一频率信号
CKVB 第二频率信号 VGH 栅极高准位电压
VGL 栅极低准位电压 P1 PMOS晶体管
N1、N2NMOS晶体管 R1-R9 电阻
C1-C3电容
具体实施方式
在说明书及上述的权利要求当中使用了某些词汇来指称特定的组件。所属领域中具有通常知识者应可理解，制造商可能会用不同的名词来称呼同样的组件。本说明书及上述的权利要求并不以名称的差异来作为区别组件的方式，而是以组件在功能上的差异来作为区别的基准。在通篇说明书及上述的权利要求当中所提及的「包含」是为一开放式的用语，故应解释成「包含但不限定于」。此因此，若文中描述一第一装置电性连接于一第二装置，则代表该第一装置可直接连接于该第二装置，或透过其它装置或连接手段间接地连接至该第二装置。
请参考图3，图3为本发明的栅极驱动器设置于显示面板(gate in panel，GIP)的液晶显示器的方块图。液晶显示器20包含一印刷线电路板(PWB)22、一软性电路板(即C)24及一显示面板26。印刷线电路板22上包含一准位转换电路(level shift circuit)28及一关机放电电路30。显示面板26上包含一栅极驱动电路32及一薄膜晶体管(TFT)数组34。栅极驱动电路32是以薄膜晶体管制程在玻璃基板上形成移位缓存器的电路。准位转换电路28根据一启动信号STV、一频率信号CPV及一致能信号OE产生一高准位启动信号STVP、一第一频率信号CKV及一第二频率信号CKVB。第一频率信号CKV及第二频率信号CKVB为互补的信号。关机放电电路30根据一关机信号XDON、一栅极高准位电压VGH及一栅极低准位电压VGL来输出栅极电压。高准位启动信号信号STVP、第一频率信号CKV、第二频率信号CKVB与门极低准位电压VGL经由软性电路板24传送到栅极驱动电路32，以产生栅极控制信号来驱动薄膜晶体管数组38上的薄膜晶体管。
请参考图4及图5，图4为栅极驱动电路32的电路图，图5为图4的信号的波形图。栅极驱动电路32是为一移位缓存器，包含N个SR正反器34。栅极驱动电路32由第一频率信号CKV及第二频率信号CKVB来驱动，奇数的SR正反器34的CK1输入端及CK2输入端分别接收第一频率信号CKV及第二频率信号CKVB，偶数的SR正反器34的CK1输入端及CK2输入端分别接收第二频率信号CKVB及第一频率信号CKV。每一个SR正反器34产生的栅极控制信号将输出到薄膜晶体管数组38，另外，每一个SR正反器34的设置端S接收上一个SR正反器34产生的栅极控制信号，每一个SR正反器34的重置端R接收下一个SR正反器34产生的栅极控制信号，第一个SR正反器34的设置端S及最后一个第一个SR正反器34的重置端R接收高准位启动信号STVP。栅极低准位电压VGL使用直流准位，以提供每一个SR正反器34产生栅极控制信号的电压准位。高准位启动信号STVP、第一频率信号CKV、第二频率信号CKVB与门极低准位电压VGL由印刷线电路板22上的准位转换电路28及关机放电电路30所产生，奇数的SR正反器34产生的栅极控制信号跟随第一频率信号CKV的波形，偶数的SR正反器34产生的栅极控制信号跟随第二频率信号CKVB的波形。
请参考图6，图6为图4的第n个SR正反器34的电路图。当栅极驱动电路32开启薄膜晶体管数组38上的栅极线时，由晶体管M1将根据第一频率信号CKV将栅极高准位电压VGH传送到栅极在线。当栅极驱动电路32关闭薄膜晶体管数组38上的栅极线时，由晶体管M5和晶体管M3轮流导通，使栅极线输出栅极低准位电压VGL。当第一频率信号CKV为高准位，第二频率信号CKVB为低准位时，奇数的SR正反器34透过晶体管M3来输出栅极低准位电压VGL，偶数的SR正反器34则透过晶体管M5来输出栅极低准位电压VGL。当第一频率信号CKV为低准位，第二频率信号CKVB为高准位时，奇数的SR正反器34透过晶体管M5来输出栅极低准位电压VGL，偶数的SR正反器34则透过晶体管M3来输出栅极低准位电压VGL。若栅极驱动电路32有N条栅极线，当栅极驱动电路32在动作时，除了其中一条栅极线接收栅极高准位电压VGH，其余的N-1条栅极线都接收栅极低准位电压VGL。栅极驱动电路32在遮没(blanking)时段时，所有的栅极线都接收栅极低准位电压VGL。因此，在液晶显示器20关机的瞬间，栅极线的电压可能有其中一条为栅极高准位电压VGH，其余的栅极线为栅极低准位电压VGL，或所有的栅极线皆为栅极低准位电压VGL。本发明利用液晶显示器20关机时的关机信号XDON来触发关机放电电路30，将栅极低准位电压VGL输出为栅极高准位电压VGH，如此晶显示器20关机时将开启膜薄晶体管数组34的所有薄膜晶体管，使残留电荷释放以消除关机残影。
请参考图7，图7为本发明关机放电电路30的电路图。关机放电电路30包含一PMOS晶体管P1、一NMOS晶体管N1、一NMOS晶体管N2、九电阻R1-R9及三电容C1-C3。第一电阻R1电性连接于晶体管N2的栅极及关机信号端XDON之间，第二电阻R2电性连接于晶体管N2的栅极及接地端之间，第三电阻R3电性连接于晶体管N2的漏极与门极高准位电压端VGH之间，第四电阻R4电性连接于晶体管N2的漏极及接地端之间，第五电阻R5电性连接于晶体管P1的源极及晶体管P1的栅极之间，第六电阻R6电性连接于晶体管N2的漏极及晶体管N1的栅极之间，第七电阻R7电性连接于晶体管P1的栅极及晶体管N1的漏极之间，第八电阻R8电性连接于晶体管P1的漏极及接地端之间，第九电阻R9电性连接于晶体管P1的漏极与门极低准位电压端VGL之间。第一电容C1电性连接于晶体管N2的漏极及接地端之间，第二电容C2电性连接于晶体管P1的源极及晶体管P1的栅极之间，第三电容C3电性连接于晶体管P1的漏极及接地端之间。当关机信号XDON为高准位时，晶体管N2导通，节点A的电压为接地电压，使晶体管N1为截止的状态，因此晶体管P1的栅极电压为栅极高准位电压VGH，使晶体管P1为截止的状态，所以栅极高准位电压端VGH与栅极低准位电压端VGL被隔离。当关机信号XDON为低准位时，晶体管N2截止，节点A的电压为VGH*R4/(R3+R4)，使晶体管N1导通，晶体管P1的栅极电压将会小于VGH，因此晶体管P1导通，使栅极高准位电压端VGH电性连接于栅极低准位电压端VGL。在液晶显示器20关机的瞬间，关机信号XDON由高准位转为低准位，栅极低准位电压VGL将被拉到栅极高准位电压VGH，使膜薄晶体管数组34的所有薄膜晶体管开启。
请参考图8，图8为本发明液晶显示器20关机时的波形图。由于关机时关机信号XDON由高准位转为低准位，而触发关机放电电路30，栅极高准位电压端VGH电性连接于栅极低准位电压端VGL，由于两电压电性中和与阻抗变化的影响，使栅极低准位电压端VGL的电压最后还是低于栅极高准位电压端VGH，但是仍可以使膜薄晶体管数组34的薄膜晶体管导通，而消除关机残影。
综上所述，本发明的栅极驱动器设置于显示面板的液晶显示器具有消除关机残影功能。该液晶显示器包含一印刷线电路板、一软性电路板及一显示面板。该印刷线电路板上包含一准位转换电路及一关机放电电路。该显示面板上包含一栅极驱动电路及一薄膜晶体管数组。该关机放电电路可于该液晶显示器关机时将一栅极高准位电压端电性连接于栅极低准位电压端以驱动该栅极驱动电路开启该薄膜晶体管数组的所有的薄膜晶体管。
以上所述仅为本发明的较佳实施例，凡依本发明权利要求范围所做的均等变化与修饰，皆应属本发明的涵盖范围。
Claims (9)
1.一种栅极驱动器设置于显示面板的关机放电电路，其特征在于，包含：
一第一晶体管，具有一栅极，一源极电性连接于一高电压端，及一漏极；
一第二晶体管，具有一栅极，一源极电性连接于一接地端，及一漏极；
一第三晶体管，具有一栅极，一源极电性连接于该接地端，及一漏极；
一第一电阻，电性连接于该第三晶体管的栅极及一电源控制端之间；
一第二电阻，电性连接于该第三晶体管的栅极及该接地端之间；
一第三电阻，电性连接于该第三晶体管的漏极及该高电压端之间；
一第四电阻，电性连接于该第三晶体管的漏极及该接地端之间；
一第五电阻，电性连接于该第一晶体管的源极及该第一晶体管的栅极之间；
一第六电阻，电性连接于该第三晶体管的漏极及该第二晶体管的栅极之间；
一第七电阻，电性连接于该第一晶体管的栅极及该第二晶体管的漏极之间；
一第八电阻，电性连接于该第一晶体管的漏极及该接地端之间；
一第九电阻，电性连接于该第一晶体管的漏极及一低电压端之间；
一第一电容，电性连接于该第三晶体管的漏极及该接地端之间；
一第二电容，电性连接于该第一晶体管的源极及该第一晶体管的栅极之间；及
一第三电容，电性连接于该第一晶体管的漏极及该接地端之间。
2.如权利要求1所述的关机放电电路，其特征在于，该第一晶体管是为P型金氧半晶体管，该第二晶体管及该第三晶体管是为N型金氧半晶体管。
3.如权利要求1所述的关机放电电路，其特征在于，当该电源控制端为高准位信号时，该第一晶体管及该第二晶体管截止，该第三晶体管导通。
4.如权利要求1所述的关机放电电路，其中该当该电源控制端为低准位信号时，该第一晶体管及该第二晶体管导通，该第三晶体管截止。
5.一种液晶显示器，其特征在于，包含：
一显示面板，该显示面板进一步包含：
一薄膜晶体管数组；及
一栅极驱动电路，用来驱动该薄膜晶体管数组；
一印刷线电路板，该印刷线电路板进一步包含：
一电压转换电路，用来产生控制该栅极驱动电路的信号；及
一关机放电电路，用来于该液晶显示器关机时电性连接一高电压端及一低电压端；该关机放电电路进一步包含：
一第一晶体管，具有一栅极，一源极电性连接于该高电压端，及一漏极；
一第二晶体管，具有一栅极，一源极电性连接于一接地端，及一漏极；
一第三晶体管，具有一栅极，一源极电性连接于该接地端，及一漏极；
一第一电阻，电性连接于该第三晶体管的栅极及一电源控制端之间；
一第二电阻，电性连接于该第三晶体管的栅极及该接地端之间；
一第三电阻，电性连接于该第三晶体管的漏极及该高电压端之间；
一第四电阻，电性连接于该第三晶体管的漏极及该接地端之间；
一第五电阻，电性连接于该第一晶体管的源极及该第一晶体管的栅极之间；
一第六电阻，电性连接于该第三晶体管的漏极及该第二晶体管的栅极之间；
一第七电阻，电性连接于该第一晶体管的栅极及该第二晶体管的漏极之间；
一第八电阻，电性连接于该第一晶体管的漏极及该接地端之间；
一第九电阻，电性连接于该第一晶体管的漏极及该低电压端之间；
一第一电容，电性连接于该第三晶体管的漏极及该接地端之间；
一第二电容，电性连接于该第一晶体管的源极及该第一晶体管的栅极之间；及
一第三电容，电性连接于该第一晶体管的漏极及该接地端之间；
一软性电路板，电性连接于该显示面板及该印刷线电路板之间，用来传输控制该栅极驱动电路的信号。
6.如权利要求5所述的液晶显示器，其特征在于，该栅极驱动电路是由薄 膜晶体管所形成。
7.如权利要求5所述的液晶显示器，其特征在于，该栅极驱动电路是电性连接于该低电压端。
8.如权利要求5所述的液晶显示器，其特征在于，该第一晶体管是为P型金氧半晶体管，该第二晶体管及该第三晶体管是为N型金氧半晶体管。
9.如权利要求5所述的液晶显示器，其特征在于，当该电源控制端为高准位信号时，该第一晶体管及该第二晶体管截止，该第三晶体管导通。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| C14 | Grant of patent or utility model | ||
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| CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20111228 |
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| CF01 | Termination of patent right due to non-payment of annual fee |