CN111508421B - 像素电路及其驱动方法、显示面板及显示装置 - Google Patents

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Abstract

本发明公开了一种像素电路及其驱动方法、显示面板及显示装置。该像素电路包括发光元件；驱动模块，与发光元件电连接，用于驱动发光元件；存储模块，与驱动模块电连接，用于维持驱动模块的控制端的电位；第一数据写入模块，与数据信号端、扫描信号端及驱动模块电连接，用于将数据信号写入驱动模块的输入端；第二数据写入模块，与存储模块、驱动模块及控制信号端电连接，用于将数据信号写入存储模块；其中，在一个发光控制周期内，控制信号端输出的第一使能信号的时长大于扫描信号端输出的第二使能信号的时长。利用本申请的技术方案能够提高显示面板的显示效果。

Description

像素电路及其驱动方法、显示面板及显示装置
技术领域
本发明涉及显示领域，具体涉及一种像素电路、像素电路的驱动方法、显示面板及显示装置。
背景技术
在显示面板中，由像素电路驱动像素中的发光元件发光，以实现显示面板的显示。
随着显示技术的不断提升，显示面板的技术参数也在逐年递增。游戏对高刷新率需求最大，因此要求显示面板有更高的刷新频率，来满足用户游戏体验的提升，渐渐成为了发展趋势。然而，刷新频率越高，显示面板的每行像素分得的数据写入时间则更短，导致数据写入时间不足，降低了显示面板的显示效果。
发明内容
本发明实施例提供一种像素电路、像素电路的驱动方法、显示面板及显示装置，能够提高显示面板的显示效果。
第一方面，本发明实施例提供一种像素电路，其包括：
发光元件；
驱动模块，与发光元件电连接，用于驱动发光元件；
存储模块，与驱动模块电连接，用于维持驱动模块的控制端的电位；
第一数据写入模块，与数据信号端、扫描信号端及驱动模块电连接，用于将数据信号写入驱动模块的输入端；
第二数据写入模块，与存储模块、驱动模块及控制信号端电连接，用于将数据信号写入存储模块；
其中，在一个发光控制周期内，控制信号端输出的第一使能信号的时长大于扫描信号端输出的第二使能信号的时长。
在第一方面一种可能的实施方式中，驱动模块包括第一晶体管，第一数据写入模块包括第二晶体管，第二数据写入模块包括第三晶体管，存储模块包括第一电容；
其中，第一晶体管的控制端与第一电容的第一端及第三晶体管的第二端电连接，第一晶体管的第一端与第二晶体管的第二端及第一电源电压输入端电连接，第一晶体管的第二端与发光元件及第三晶体管的第一端电连接；
第二晶体管的控制端与扫描信号端电连接，第二晶体管的第一端与数据信号端电连；
第三晶体管的控制端与控制信号端电连接；
第一电容的第二端与第一电源电压输入端电连接。
在第一方面一种可能的实施方式中，像素电路还包括第一发光控制模块及第二电容，第一发光控制模块包括第四晶体管；
其中，第四晶体管的控制端与发光控制信号端电连接，第四晶体管的第一端与第一电源电压输入端电连接，第四晶体管的第二端与第一晶体管的第一端电连接；
第二电容的第一端与第一电源电压输入端电连接，第二电容的第二端与第一晶体管的第一端电连接。
在第一方面一种可能的实施方式中，第一数据写入模块包括第五晶体管和第六晶体管，像素电路还包括第三电容；
其中，第五晶体管的第一端与数据信号端电连接，第五晶体管的控制端与扫描信号端电连接，第五晶体管的第二端与第六晶体管的第一端电连接；
第六晶体管的控制端与控制信号端电连接，第六晶体管的第二端与驱动模块电连接；
第三电容的第一端与第一电源电压输入端电连接，第三电容的第二端与第五晶体管的第二端及第六晶体管的第一端电连接。
在第一方面一种可能的实施方式中，像素电路还包括初始化模块，初始化模块与驱动模块、发光元件电连接，用于对驱动模块的控制端及发光元件进行初始化；
和/或，
像素电路还包括第二发光控制模块，第二发光控制模块与驱动模块及发光元件电连接，用于控制发光元件发光。
在第一方面一种可能的实施方式中，初始化模块包括第七晶体管及第八晶体管；扫描信号端包括第一扫描信号端、第二扫描信号端及第三扫描信号端；第一数据写入模块与第二扫描信号端电连接；
其中，第七晶体管的控制端与第一扫描信号端电连接，第七晶体管的第一端与参考信号端电连接，第七晶体管的第二端与存储模块、驱动模块的控制端及第二数据写入模块的输出端电连接；
其中，第八晶体管的控制端与第三扫描信号端电连接，第八晶体管的第一端与参考信号端电连接，第八晶体管的第二端与发光元件电连接；
和/或，
第二发光控制模块包括第九晶体管，第九晶体管的控制端与发光控制信号端电连接，第就晶体管的第一端与驱动模块电连接，第九晶体管的第二端与发光元件电连接。
在第一方面一种可能的实施方式中，在一个发光控制周期内，第一使能信号的开始时刻与第二使能信号的开始时刻或者结束时刻相同，或者，第一使能信号的开始时刻在第二使能信号的开始时刻与结束时刻之间。
第二方面，本发明实施例提供一种像素电路的驱动方法，其用于如上述第一方面任一实施例所述的像素电路，该方法包括：
在第一数据写入阶段，第一数据写入模块在扫描信号端输出的第二使能信号的控制下，向驱动模块的输入端写入数据信号；
在第二数据写入阶段，第二数据写入模块在控制信号端输出的第一使能信号的控制下，向存储模块写入数据信号；
在发光阶段，驱动模块产生驱动信号并提供至发光元件，驱动发光元件发光显示；
其中，在一个发光控制周期内，第一使能信号的时长大于第二使能信号的时长。
第三方面，本发明实施例提供一种显示面板，其包括如上述第一方面任一实施例所述的像素电路，或者，其利用如上述第二方面任一实施例所述的像素电路的驱动方法。
第四方面，本发明实施例提供一种显示装置，其包括如上述第三方面任一实施例所述的显示面板。
在本申请实施例中，像素电路具有第一数据写入模块及第二数据写入模块，第一数据写入模块与扫描信号端电连接，第二数据写入模块与控制信号端电连接，且在一个发光控制周期内，控制信号端输出的第一使能信号的时长大于扫描信号端输出的第二使能信号的时长，从而增加了数据信号写入存储模块的时长，即增加了数据信号写入驱动模块控制端的时长，能够在高刷新频率下，提高显示面板的显示效果。
附图说明
通过阅读以下参照附图对非限制性实施例所作的详细描述，本发明的其它特征、目的和优点将会变得更明显，其中，相同或相似的附图标记表示相同或相似的特征，附图并未按照实际的比例绘制。
图1示出根据本发明一种实施例提供的像素电路的结构示意图；
图2示出根据本发明另一种实施例提供的像素电路的结构示意图；
图3示出根据本发明一种实施例提供的图2所示的像素电路的驱动时序示意图；
图4示出根据本发明又一种实施例提供的像素电路的结构示意图；
图5示出根据本发明又一种实施例提供的像素电路的结构示意图；
图6示出根据本发明又一种实施例提供的像素电路的结构示意图；
图7示出根据本发明另一种实施例提供的图6所示的像素电路的控制时序示意图；
图8示出根据本发明一种实施例提供的像素电路的驱动方法的流程示意图；
图9示出根据本发明一种实施例提供的显示装置的俯视示意图。
具体实施方式
下面将详细描述本发明的各个方面的特征和示例性实施例，为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及具体实施例，对本发明进行进一步详细描述。应理解，此处所描述的具体实施例仅被配置为解释本发明，并不被配置为限定本发明。对于本领域技术人员来说，本发明可以在不需要这些具体细节中的一些细节的情况下实施。下面对实施例的描述仅仅是为了通过示出本发明的示例来提供对本发明更好的理解。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
应当理解，在描述部件的结构时，当将一层、一个区域称为位于另一层、另一个区域“上面”或“上方”时，可以指直接位于另一层、另一个区域上面，或者在其与另一层、另一个区域之间还包含其它的层或区域。并且，如果将部件翻转，该一层、一个区域将位于另一层、另一个区域“下面”或“下方”。
本申请提供一种像素电路、像素电路的驱动方法、显示面板与显示装置。像素驱动电路用于驱动显示面板中的像素单元，从而实现显示面板的显示。采用本申请中的像素电路、像素电路的驱动方法、显示面板与显示装置，可增加数据信号写入驱动模块的时长，避免高刷新频率下，数据写入时间不足对显示面板的显示效果的不良影响。
图1为本申请一实施例提供的像素电路的结构示意图。如图1所示，该像素电路可包括发光元件D1、驱动模块P11、存储模块P12、第一数据写入模块P13和第二数据写入模块P14。
其中，发光元件D1可根据显示面板的类型选定，如发光元件D1具体可为发光二极管(Light Emitting Diode，LED)或有机发光二极管(Organic Light Emitting Diode，OLED)，在此并不限定。具体的，发光元件D1的阴极可以与第二电源电压输入端VSS连接。
驱动模块P11与发光元件D1电连接。具体的，驱动模块P11与发光元件D1的阳极电连接。驱动模块P11可用于向发光元件D1提供驱动信号。驱动信号具体可以为驱动电流。具体地，可通过控制驱动模块P11的导通和关断，以控制驱动电流是否能通过驱动模块P11流向发光元件D1。
存储模块P12与驱动模块P11连接，具有存储电能的作用。存储模块P12可用于维持驱动模块P11的控制端的电位。具体地，在像素电路对像素单元的驱动过程中的第二数据写入阶段，可对存储模块P12进行充电。在驱动过程中的发光阶段，存储模块P12可利用充电阶段中充入的电压保持驱动模块P11的控制端的电位。
第一数据写入模块P13与数据信号端VDATA、扫描信号端Scan及驱动模块P11电连接，用于将数据信号写入驱动模块P11的输入端。具体的，数据信号端VDATA用于提供数据信号。扫描信号端Scan用于提供扫描信号，扫描信号包括控制第一数据写入模块P13处于导通状态的使能信号，及控制第一数据写入模块P13处于截止状态的非使能信号。在驱动过程中的第一数据写入阶段，第一数据写入模块P13在扫描信号的控制下，将数据信号写入驱动模块P11的控制端。
第二数据写入模块P14与存储模块P12、驱动模块P11及控制信号端SW电连接，用于将数据信号写入存储模块P12。具体的，控制信号端SW用于提供控制信号，控制信号包括控制第二数据写入模块P14处于导通状态的使能信号，及控制第二数据写入模块P14处于截止状态的非使能信号。在驱动过程中的第二数据写入阶段，利用写入到驱动模块P11的数据信号，并通过驱动模块P11及第二数据写入模块P14为存储模块P12充电。在驱动过程中的发光阶段，存储模块P12利用第二数据写入阶段中充入的电压保持驱动模块P11的控制端的电位，相当于将数据信号写入到驱动模块P11的控制端。
在驱动过程的一个发光控制周期内，控制信号端SW输出的第一使能信号的时长大于扫描信号端Scan输出的第二使能信号的时长。示例性的，第一使能信号的时长可以为第二使能信号的时长的N倍，N可以为大于等于2的整数值。例如N可以为2-5中的任意一个数值，从而避免将N的数值设置的过大，导致充电时太长，显示时间损失过多，造成闪烁等问题。
另外，一个发光控制周期可以理解控制发光元件D1发光的一个完整周期。例如，针对单个发光元件D1，控制发光元件D1发光的一个完整周期可以包括第一数据写入阶段、第二数据写入阶段及发光阶段，则一个发光控制周期可以理解为包括第一数据写入阶段、第二数据写入阶段及发光阶段。又例如，针对单个发光元件D1，控制发光元件D1发光的一个完整时序可以包括第一初始化阶段、第一数据写入阶段、第二数据写入阶段、第二初始化阶段及发光阶段，则一个发光控制周期可以理解为包括第一初始化阶段、第一数据写入阶段、第二数据写入阶段、第二初始化阶段及发光阶段。
申请人发现，可以将数据信号端VDATA提供的数据信号写入驱动模块P11的控制端分为两个阶段，第一阶段是数据信号写入驱动模块P11的输入端，第一阶段将写入到驱动模块P11的数据信号通过驱动模块P11及第二数据写入模块P14写入到存储模块P12，即写入到驱动模块P11的控制端。而第一阶段的数据写入速度比较快，因此第一阶段在较短的时间内就能完成；而第二阶段要通过驱动模块P11及第二数据写入模块P14的路径写入存储模块P12，数据写入速度比较慢，因此第二阶段需要比第一阶段更长的时间。例如在高刷新频率下，刷新频率越高，显示面板的每行像素分得的数据写入时间则更短，若第一数据写入模块P13和第二数据写入模块P14的控制端均与扫描信号端Scan电连接，即为第一数据写入模块P13和第二数据写入模块P14提供的使能信号的时长是相同的，会导致第二阶段无法顺利完成，写入存储模块P12数据信号不足，即写入到驱动模块P11的控制端的数据信号不足，从而存在显示异常的问题。
根据本发明实施例，第一数据写入模块P13与扫描信号端Scan电连接，第二数据写入模块P14与控制信号端SW电连接，对第一数据写入模块P13和第二数据写入模块P14的控制端分别进行控制，且在一个发光控制周期内，控制信号端SW输出的第一使能信号的时长大于扫描信号端Scan输出的第二使能信号的时长，从而增加了第二数据写入模块P14的导通时长，进而增加数据信号写入存储模块P12的时长，即增加了数据信号写入驱动模块P11控制端的时长，从而能够在高刷新频率下，提高显示面板的显示效果。
为了便于说明，下面以一具体的像素电路为例进行说明。图2为本申请另一实施例提供的像素电路的结构示意图。图2示出了上述实施例中驱动模块P11、存储模块P12、第一数据写入模块P13和第二数据写入模块P14的具体结构。如图2所示，驱动模块P11包括第一晶体管T1，第一晶体管T1即为像素电路中的驱动晶体管；存储模块P12包括第一电容Cst；第一数据写入模块P13包括第二晶体管T2；第二数据写入模块P14包括第三晶体管T3。
第一晶体管T1的控制端与第一电容Cst的第一端及第三晶体管T3的第二端电连接，第一晶体管T1的第一端与第二晶体管T2的第二端及第一电源电压输入端VDD电连接，第一晶体管T1的第二端与发光元件D1及第三晶体管T3的第一端电连接。
第二晶体管T2的控制端与扫描信号端Scan电连接，第二晶体管T2的第一端与数据信号端VDATA电连接。
第一电容Cst的第二端与第一电源电压输入端VDD电连接。第一电源电压输入端VDD用于提供工作信号。
发光元件D1的阴极与第二电源电压输入端VSS连接。第二电源电压输入端VSS用于提供公共连接信号，在一些示例中，第二电源电压输入端可为接地端，在此并不限定。
上述实施例中的各个晶体管具体可为薄膜晶体管(Thin Film Transistor，TFT)。晶体管的控制端为栅极，晶体管的第一端为源极，晶体管的第二端为漏极。或者，晶体管的控制端为栅极，晶体管的第一端为漏极，晶体管的第二端为源极，在此并不限定。本申请实施例中以晶体管的控制端为栅极，晶体管的第一端为源极，晶体管的第二端为漏极为例进行说明。
本申请实施例中的使能信号可以是导通电平信号，非使能信号可以是截止电平信号。导通电平和截止电平可以根据晶体管的类型区分，导通电平是指能够控制晶体管导通的电平，截止电平是指能够控制晶体管截止的电平，例如，当晶体管为P型晶体管时，导通电平为低电平，截止电平为高电平；当晶体管为N型晶体管时，导通电平为高电平，截止电平为低电平。本发明实施例均以晶体管为P型晶体管为例进行描述，即在本发明实施例中，导通电平均为低电平，截止电平均为高电平。
为了更好的理解本申请，下面以一具体的像素电路的驱动时序为例进行说明。图3示出根据本发明一种实施例提供的图2所示的像素电路的驱动时序示意图。如图3所示，像素电路的驱动时序可以包括第一数据写入阶段t1、第二数据写入阶段t2及发光阶段t3，即像素电路的一个发光控制周期包括第一数据写入阶段t1、第二数据写入阶段t2及发光阶段t3。
第一使能信号的开始时刻可以与第二使能信号的开始时刻或者结束时刻相同，或者，第一使能信号的开始时刻可以在第二使能信号的开始时刻与结束时刻之间。图3中以使能信号为低电平信号，且第一使能信号的开始时刻与第二使能信号的开始时刻相同为例进行说明。由于第一使能信号的开始时刻与第二使能信号的开始时刻相同，第二数据写入阶段t2与第一数据写入阶段t1具有重合的时间段t1。
具体的，在第一数据写入阶段t1，第二晶体管T2在扫描信号端Scan输出的低电平信号的控制下，处于导通状态，数据信号端VDATA提供的数据信号通过第二晶体管T2输入到第一晶体管T1的第一端。在第二数据写入阶段t2，第三晶体管T3在控制信号端SW输出的低电平信号的控制下，处于导通状态，第一晶体管T1的控制端与其第二端连通，第一晶体管T1构成二极管，写入到第一晶体管T1的第一端的数据信号通过第一晶体管T1及第三晶体管T3充入第一电容Cst，对第一电容Cst进行充电。在发光阶段t3，第一电容Cst利用第二数据写入阶段t2中充入的电压保持第一晶体管T1的控制端的电位，第一电源电压输入端VDD的工作信号产生的驱动电流通过第一晶体管T1传输至发光元件D1，使发光元件D1发光。
申请人发现，若通过减小第一电容Cst的大小来解决高刷新频率下，数据信号写入不足的问题，则存在第一晶体管T1的栅极电位保持困难，进而导致显示面板的显示画面闪烁的问题；若通过增加数据线的数量，来达到增加数据信号写入时间，则存在走线复杂，影响显示面板的开口率等问题。
而根据本发明实施例，仅需将第二晶体管T2的控制端与扫描信号端Scan电连接，第三晶体管T3的控制端与控制信号端SW电连接，对第二晶体管T2和第三晶体管T3的控制端分别进行控制，即可简单方便的实现增加数据信号写入驱动模块P11控制端的时长，避免引起显示面板的显示画面闪烁、影响显示面板的开口率等问题。
在一些可选的实施例中，如图4所示，本发明实施例提供的像素电路还可以包括第一发光控制模块P151及第二电容C2。具体的，第一发光控制模块P1511可以包括第四晶体管T4。
第四晶体管T4的控制端与发光控制信号端EM电连接，第四晶体管T4的第一端与第一电源电压输入端VDD电连接，第四晶体管T4的第二端与第一晶体管T1的第一端电连接。第二电容C2的第一端与第一电源电压输入端VDD电连接，第二电容C2的第二端与第一晶体管T1的第一端电连接。
发光控制信号端EM用于提供发光控制信号。在驱动过程中的发光阶段，第四晶体管T4在发光控制信号的控制下导通，能够将第一电源电压输入端VDD提供的工作信号传输至第一晶体管的第一端。
申请人发现，由于第一晶体管T1的牵连电容较小，牵连电容包括第一晶体管T1的两个寄生电容和第一晶体管T1的第一端信号走线的交叠电容，在第三晶体管T3导通时，会出现第一晶体管T1的第一端的电位不稳或者流失现象。通过设置第二电容C2，在驱动过程中的第一数据写入阶段，数据信号端VDATA提供的数据信号可以充入第二电容C2，从而第二电容C2可以稳定第一晶体管T1的第一端的电位。
另外，示例性的，数据信号端VDATA提供的电压信号的电压值为V1，在驱动过程中的第一数据写入阶段，第二电容C2上充入的电荷量为C2的电容值与V1的乘积。在驱动过程中的第二数据写入阶段，第三晶体管T3打开，第二电容C2上充入的电荷量会向第一电容Cst传输，在第二电容C2与第一电容Cst的电位相等时，两者平衡，第二电容C2不再向第一电容Cst传输电荷，此时，两者符合下述公式(1)：
C2*V1＝Cst*V2+C2*(V2-Vth) (1)
在上述公式(1)中，C2表示第二电容的电容值，V1表示数据信号端VDATA提供的电压值，Cst表示第一电容的电容值，Vth表示第一晶体管T1的阈值电压，V2表示第二电容C2与第一电容Cst对应的平衡电压，即最终维持的第一晶体管T1的控制端的电压值。
由上述公式(1)可知，V2的数值越接近于V1的数值，则表示数据信号端VDATA提供的电压流失的越少，因此，第二电容C2的电容值越大，则可以使V2的数值越接近于V1的数值。但是考虑到空间的有限性，在实际制备像素电路中的第二电容C2时，将第二电容C2的电容值设置的无限大是比较困难的。在一些实施例中，可以将第二电容C2与第一电容Cst的电容大小的比值设置为6:1或者大于6:1。在一些实施例中，可以通过增加第二电容C2上下两个极板的厚度来增加第二电容C2的电容值，或者，可以通过减小第二电容C2上下两个极板的间距来增加第二电容C2的电容值。
在一些实施例中，如图5所示，第一数据写入模块P13可以包括第五晶体管T5和第六晶体管T6，像素电路还可以包括第三电容C3。
第五晶体管T5的第一端与数据信号端VDATA电连接，第五晶体管T5的控制端与扫描信号端Scan电连接，第五晶体管T5的第二端与第六晶体管T6的第一端电连接。第六晶体管T6的控制端与控制信号端SW电连接，第六晶体管T6的第二端与驱动模块P11电连接。具体的，驱动模块P11可以包括第一晶体管T1，第六晶体管T6的第二端与第一晶体管T1的第一端电连接。第二数据写入模块P14可以包括第三晶体管T3，第三晶体管T3的控制端与六晶体管T6的控制端均与控制信号端SW电连接。第三电容C3的第一端与第一电源电压输入端VDD电连接，第三电容C3的第二端与第五晶体管T5的第二端及第六晶体管T6的第一端电连接。
根据本发明实施例，可以将数据信号端VDATA提供的数据信号预存至第二电容C3，以稳定驱动模块P11的输入端的电位。且在驱动过程中的发光阶段，第六晶体管T6处于截止状态，第一电源电压输入端VDD提供的工作信号写入驱动模块P11的输入端时不会受到第二电容C3的影响，从而VDD提供的工作信号写入驱动模块P11的输入端写入速率便不会受到影响。
在一些可选的实施例中，如图6所示，本发明实施例提供的像素电路还可以包括初始化模块P16，初始化模块P16与驱动模块P11、发光元件D1电连接，用于对驱动模块P11的控制端及发光元件的进行初始化。
具体地，扫描信号端Scan可以包括第一扫描信号端Scan1、第二扫描信号端Scan2及第三扫描信号端Scan3。初始化模块P15与参考信号端VREF、第二扫描信号端S2连接。参考信号端VREF用于提供参考信号。参考信号可以为参考电压信号。在一些示例中，参考信号的电压为负。第一扫描信号端Scan1用于提供第一扫描信号，第二扫描信号端Scan2用于提供第二扫描信号，第三扫描信号端Scan3用于提供第三扫描信号。第一数据写入模块P13的控制端可以与第二扫描信号端Scan2电连接。初始化模块P16可以与第一扫描信号端Scan1及第三扫描信号端Scan3电连接。
在一些实施例中，初始化模块P16可以包括第七晶体管T7及第八晶体管T8。第七晶体管T7的控制端与第一扫描信号端Scan1电连接，第七晶体管T7的第一端与参考信号端VREF电连接，第七晶体管T7的第二端与存储模块P12、驱动模块P11的控制端及第二数据写入模块P14的输出端电连接。第八晶体管T8的控制端与第三扫描信号端Scan3电连接，第八晶体管T8的第一端与参考信号端VREF电连接，第八晶体管T8的第二端与发光元件D1电连接。
在驱动过程中的初始化阶段，初始化模块P16在第一扫描信号及第三扫描信号的控制下导通，将参考信号的电压充入存储模块P12和发光元件D1，以对存储模块P12及发光元件D1进行初始化。
根据本发明实施例，通过初始化模块P16将参考信号的负电压充入存储模块P12，从而给驱动模块P11的控制端一个负的初始电压，以方便后续数据信号端VDATA提供的数据信号通过驱动模块P11及第二数据写入模块P14充入存储模块P12。通过初始化模块P16将参考信号的负电压充入发光元件D1，发光元件D1一个负的初始电压，实现对发光元件D1的初始化。
在一些实施例中，如图6所示，本发明实施例提供的像素电路还可以包括第二发光控制模块P152，第二发光控制模块P152与驱动模块P11及发光元件D1电连接，用于控制发光元件D1发光。
具体地，发光控制模块P152与发光控制信号端EM、发光元件D1的阳极电连接。发光控制信号端EM用于提供发光控制信号。
在一些实施例中，第二发光控制模块P152包括第九晶体管T9，第九晶体管T9的控制端与发光控制信号端EM电连接，第九晶体管T9的第一端与驱动模块P11的输出端电连接，第九晶体管T9的第二端与发光元件D1的阳极电连接。具体的，驱动模块P11包括第一晶体管T1，第九晶体管T9的第一端与第一晶体管T1的第二端电连接。
根据本发明实施例，在驱动过程中的发光阶段，发光控制模块P152在发光控制信号的控制下导通，能够将工作信号产生的驱动电流传输至发光元件D1，使发光元件D1发光。
为了更好的理解本申请，下面以一具体的像素电路的驱动时序为例进行说明。图7示出根据本发明一种实施例提供的图6所示的像素电路的驱动时序示意图。如图7所示，像素电路的驱动时序可以包括第一初始化阶段t11、第一数据写入阶段t12、第二数据写入阶段t13、第二初始化阶段t14，及发光阶段t15，这里，可以理解为，一个发光控制周期包括第一初始化阶段t11、第一数据写入阶段t12、第二数据写入阶段t13、第二初始化阶段t14，及发光阶段t15。
第一使能信号的开始时刻可以与第二使能信号的开始时刻或者结束时刻相同，或者，第一使能信号的开始时刻可以在第二使能信号的开始时刻与结束时刻之间。图7中以使能信号为低电平信号，且第一使能信号的开始时刻与第二使能信号的结束时刻相同为例进行说明。
具体的，在第一初始化阶段t11，第八晶体管T8在第一扫描信号端Scan1输出的低电平信号的控制下，处于导通状态，参考信号端VREF提供的参考信号通过第八晶体管T8输入到第一电容Cst，第一电容Cst给第一晶体管T1的控制端一个负的初始电压，实现对第一晶体管T1的初始化。
在第一数据写入阶段t12，第二晶体管T2在第二扫描信号端Scan2输出的低电平信号的控制下，处于导通状态，数据信号端VDATA提供的数据信号通过第二晶体管T2输入到第一晶体管T1的第一端。
在第二数据写入阶段t13，第三晶体管T3在控制信号端SW输出的低电平信号的控制下，处于导通状态，第一晶体管T1的控制端与其第二端连通，第一晶体管T1构成二极管，写入到第一晶体管T1的第一端的数据信号通过第一晶体管T1及第三晶体管T3充入第一电容Cst，对第一电容Cst进行充电。
在第二初始化阶段t14，第七晶体管T7在第三扫描信号端Scan3输出的低电平信号的控制下，处于导通状态，参考信号端VREF提供的参考信号通过第七晶体管T7输入到发光元件D1的阳极，实现对发光元件D1的初始化。
在发光阶段t15，第一电容Cst利用第二数据写入阶段t2中充入的电压保持第一晶体管T1的控制端的电位，第五晶体管T5及第九晶体管T9在发光控制信号端EM输出的低电平信号的控制下，处于导通状态，使得第一电源电压输入端VDD的工作信号产生的驱动电流通过第一晶体管T1传输至发光元件D1，使发光元件D1发光。
本发明实施例提供一种像素电路的驱动方法，其用于如上述任一实施例所述的像素电路。如图8所示，该方法可以包括以下步骤：
步骤110，在第一数据写入阶段，第一数据写入模块在扫描信号端输出的第二使能信号的控制下，向驱动模块的输入端写入数据信号；
步骤120，在第二数据写入阶段，第二数据写入模块在控制信号端输出的第一使能信号的控制下，向存储模块写入数据信号；
步骤130，在发光阶段，驱动模块产生驱动信号并提供至发光元件，驱动发光元件发光显示；
其中，在一个发光控制周期内，第一使能信号的时长大于第二使能信号的时长。
本发明实施例提供的像素电路的驱动方法中步骤110-130的具体实施方式可以参照上述对像素电路的具体介绍，本发明实施例在此不再赘述。
根据本发明实施例提供的像素电路的驱动方法，通过将数据写入过程分为两个阶段，在第一数据写入阶段，将数据信号写入驱动模块的输入端，在第二数据写入阶段，将写入驱动模块的输入端的数据信号进一步写入到存储模块，且在一个发光控制周期内，第二数据写入阶段对应的第一使能信号的时长大于第一数据写入阶段对应的第二使能信号的时长，从而增加了数据信号写入存储模块的时长，即增加了数据信号写入驱动模块控制端的时长，能够在高刷新频率下，提高显示面板的显示效果。
本申请还提供了一种显示面板，该显示面板可包括上述实施例中的像素电路，或者该显示面板可以利用上述实施例中的像素电路的驱动方法。该显示面板具体可以为OLED显示面板，在此并不限定。
本申请还提供了一种显示装置。该显示装置可包括设备本体以及上述实施例中的显示面板，该显示面板覆盖在设备本体上。设备本体中可设置有各类器件，如传感器件、处理器件等，在此并不限定。图9为本申请实施例提供的显示装置的俯视示意图。如图9所示，在一些示例中，显示装置的显示面板具有显示区AA和非显示区NA。显示装置具体可以为手机、计算机、平板电脑、数码相框、电视机、电子纸等具有显示功能的装置，在此并不限定。
依照本发明如上文所述的实施例，这些实施例并没有详尽叙述所有的细节，也不限制该发明仅为所述的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本发明的原理和实际应用，从而使所属技术领域技术人员能很好地利用本发明以及在本发明基础上的修改使用。本发明仅受权利要求书及其全部范围和等效物的限制。

Claims (8)

1.一种像素电路，其特征在于，包括：
发光元件；
驱动模块，与所述发光元件电连接，用于驱动所述发光元件；
存储模块，与所述驱动模块电连接，用于维持所述驱动模块的控制端的电位；
第一数据写入模块，与数据信号端、扫描信号端及所述驱动模块电连接，用于将数据信号写入所述驱动模块的输入端，所述第一数据写入模块包括第五晶体管和第六晶体管，所述第五晶体管的第一端与所述数据信号端电连接，所述第五晶体管的控制端与所述扫描信号端电连接，所述第五晶体管的第二端与所述第六晶体管的第一端电连接，所述第六晶体管的控制端与控制信号端电连接，所述第六晶体管的第二端与所述驱动模块电连接；
第二数据写入模块，与所述存储模块、所述驱动模块及所述控制信号端电连接，用于将所述数据信号写入所述存储模块；
第三电容，所述第三电容的第一端与第一电源电压输入端电连接，所述第三电容的第二端与所述第五晶体管的第二端及所述第六晶体管的第一端电连接；
初始化模块，与所述驱动模块电连接，所述初始化模块用于对所述驱动模块的控制端进行初始化；
其中，所述第二数据写入模块用于在所述初始化模块对所述驱动模块的控制端进行初始化之后，将所述数据信号写入所述存储模块；
在一个发光控制周期内，所述控制信号端输出的第一使能信号的时长大于所述扫描信号端输出的第二使能信号的时长，且所述控制信号端输出的第一使能信号的时长小于或等于所述扫描信号端输出的第二使能信号的时长的5倍，所述第一使能信号的开始时刻与所述第二使能信号的开始时刻或者结束时刻相同，或者，所述第一使能信号的开始时刻在所述第二使能信号的开始时刻与结束时刻之间。
2.根据权利要求1所述的像素电路，其特征在于，所述驱动模块包括第一晶体管，所述第一数据写入模块包括第二晶体管，所述第二数据写入模块包括第三晶体管，所述存储模块包括第一电容；
其中，所述第一晶体管的控制端与所述第一电容的第一端及所述第三晶体管的第二端电连接，所述第一晶体管的第一端与所述第二晶体管的第二端及第一电源电压输入端电连接，所述第一晶体管的第二端与所述发光元件及所述第三晶体管的第一端电连接；
所述第二晶体管的控制端与所述扫描信号端电连接，所述第二晶体管的第一端与所述数据信号端电连；
所述第三晶体管的控制端与所述控制信号端电连接；
所述第一电容的第二端与所述第一电源电压输入端电连接。
3.根据权利要求2所述的像素电路，其特征在于，所述像素电路还包括第一发光控制模块及第二电容，所述第一发光控制模块包括第四晶体管；
其中，所述第四晶体管的控制端与发光控制信号端电连接，所述第四晶体管的第一端与所述第一电源电压输入端电连接，所述第四晶体管的第二端与所述第一晶体管的第一端电连接；
所述第二电容的第一端与所述第一电源电压输入端电连接，所述第二电容的第二端与所述第一晶体管的第一端电连接。
4.根据权利要求1-3任一项所述的像素电路，其特征在于，所述初始化模块与所述发光元件电连接，用于对所述发光元件进行初始化；
和/或，
所述像素电路还包括第二发光控制模块，所述第二发光控制模块与所述驱动模块及所述发光元件电连接，用于控制所述发光元件发光。
5.根据权利要求4所述的像素电路，其特征在于，所述初始化模块包括第七晶体管及第八晶体管；所述扫描信号端包括第一扫描信号端、第二扫描信号端及第三扫描信号端；所述第一数据写入模块与所述第二扫描信号端电连接；
其中，所述第七晶体管的控制端与所述第一扫描信号端电连接，所述第七晶体管的第一端与参考信号端电连接，所述第七晶体管的第二端与所述存储模块、所述驱动模块的控制端及所述第二数据写入模块的输出端电连接；
其中，所述第八晶体管的控制端与所述第三扫描信号端电连接，所述第八晶体管的第一端与所述参考信号端电连接，所述第八晶体管的第二端与所述发光元件电连接；
和/或，
所述第二发光控制模块包括第九晶体管，所述第九晶体管的控制端与发光控制信号端电连接，所述第九晶体管的第一端与所述驱动模块的输出端电连接，所述第九晶体管的第二端与所述发光元件电连接。
6.一种像素电路的驱动方法，其特征在于，用于如权利要求1-5任一项所述的像素电路，所述方法包括：
在第一数据写入阶段，所述第一数据写入模块在所述扫描信号端输出的第二使能信号的控制下，向所述驱动模块的输入端写入数据信号；
在第二数据写入阶段，所述第二数据写入模块在所述控制信号端输出的第一使能信号的控制下，向所述存储模块写入所述数据信号；
在发光阶段，所述驱动模块产生驱动信号并提供至所述发光元件，驱动所述发光元件发光显示；
其中，在所述一个发光控制周期内，所述第一使能信号的时长大于所述第二使能信号的时长。
7.一种显示面板，其特征在于，包括如权利要求1至5任一项所述的像素电路，或者利用如权利要求6所述的像素电路的驱动方法的像素电路。
8.一种显示装置，其特征在于，包括根据权利要求7所述的显示面板。
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