CN111402776A - 显示驱动电路及显示装置 - Google Patents

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CN111402776A
CN111402776A CN202010241480.6A CN202010241480A CN111402776A CN 111402776 A CN111402776 A CN 111402776A CN 202010241480 A CN202010241480 A CN 202010241480A CN 111402776 A CN111402776 A CN 111402776A
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display
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许祖钊
崔昇圭
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Wuhan China Star Optoelectronics Semiconductor Display Technology Co Ltd
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Abstract

本申请提供一种显示驱动电路及显示装置，显示驱动电路包括多个驱动单元，每一个所述驱动单元均包括多级子驱动单元，每一个所述驱动单元均电性连接一个独立的触发单元，每一个所述驱动单元内的所述子驱动单元逐级电性连接；所述显示装置包括上述显示驱动电路。上述驱动电路结构可以实现驱动电路的分区工作，应用于显示装置中时可降低显示装置的功耗。

Description

显示驱动电路及显示装置
技术领域
本申请涉及显示技术领域，尤其涉及一种显示驱动电路及显示装置。
背景技术
GOA(Gate Driver on Array，阵列基板行驱动)技术是目前显示装置中常用的一种栅极驱动电路技术，其制作工艺简单，具有良好的应用前景。GOA电路的功能主要包括：利用上一行栅极输出的高电平信号对移位寄存单元中的电容充电，以使本行栅线输出高电平信号，再利用下一行栅线输出的高电平信号实现复位。
随着显示技术的发展，柔性折叠屏已经进入我们的生活，并成为各面板厂商竞争的关键技术。目前柔性折叠屏的折叠方式有上下对折或三折、左右对折或三折，折叠后朝上的显示屏成为主显示区，朝下的显示屏保持暗态不显示。但是目前用于驱动折叠屏的GOA电路与驱动非折叠屏的GOA电路相同，即使折叠后朝下的显示屏不显示，但其对应的GOA电路仍保持工作状态，只是这部分电路的驱动信号不能传递至显示屏而已，因此造成功耗浪费。
发明内容
为了解决上述现有技术中的不足，本申请提供一种显示驱动电路及显示装置，通过将所述显示驱动电路划分为多个驱动单元，每一个驱动单元通过一个独立的触发单元来控制，可以实现驱动电路的分区工作，应用于显示装置中时可降低显示装置的功耗。
本申请提供的显示驱动电路包括多个驱动单元，每一个所述驱动单元均包括多级子驱动单元；
每一个所述驱动单元均电性连接一个独立的触发单元，每一个所述驱动单元内的所述子驱动单元逐级电性连接，所述触发单元用于激活所述驱动单元向显示装置提供信号。
根据本申请一实施例，所述显示装置包括三个显示区域，所述显示驱动电路包括三个所述驱动单元，每一个所述驱动单元分别独立驱动所述显示装置中的一个显示区域。
根据本申请一实施例，每一个所述子驱动单元包括：
上拉控制单元，与第一时钟信号输入端、第一级联信号输入端及第一节点电性连接，用于在所述第一时钟信号输入端输入的信号的控制下将所述第一级联信号输入端输入的信号传输至所述第一节点；
上拉单元，与所述第一节点、第二时钟信号输入端及第二节点电性连接，用于在所述第一节点的信号控制下将所述第二时钟信号输入端输入的信号传输至所述第二节点，所述第二节点电性连接级联信号输出端；
下拉单元，与所述第二节点、第三节点及第二低压信号输入端电性连接，用于在所述第三节点的信号控制下将所述第二低压信号输入端输入的信号传输至所述第二节点；
下拉控制单元，与所述第一节点、第二级联信号输入端及第一低压信号输入端电性连接，用于在所述第二级联信号输入端输入的信号控制下将所述第一低压信号输入端输入的信号传输至所述第一节点；
下拉维持单元，与所述第一节点、所述第三节点、高压信号输入端及所述第一低压信号输入端电性连接，用于在所述第一节点的信号控制下将所述第一低压信号输入端输入的信号或所述高压信号输入端输入的信号传输至所述第三节点。
根据本申请一实施例，
所述上拉单元包括电容和第一晶体管，所述电容的第一端电性连接所述第二时钟信号输入端，所述电容的第二端电性连接所述第一节点；所述第一晶体管的栅极电性连接所述第一节点，所述第一晶体管的源极电性连接所述第二时钟信号输入端，所述第一晶体管的漏极电性连接所述第二节点；
所述上拉控制单元包括第二晶体管，所述第二晶体管的栅极电性连接所述第一时钟信号输入端，所述第二晶体管的源极电性连接所述级联信号输入端，所述第二晶体管的漏极电性连接所述第一节点；
所述下拉单元包括第三晶体管，所述第三晶体管的栅极电性连接所述第三节点，所述第三晶体管的源极电性连接所述第二低压信号输入端，所述第三晶体管的漏极电性连接所述第二节点；
所述下拉控制单元包括第四晶体管，所述第四晶体管的栅极电性连接所述第二级联信号输入端，所述第四晶体管的源极电性连接所述第一低压信号输入端，所述第四晶体管的漏极电性连接所述第一节点；
所述下拉维持单元包括第五晶体管、第六晶体管和第七晶体管，所述第五晶体管的源极和所述第六晶体管的源极电性连接所述第一低压信号输入端，所述第五晶体管的漏极和所述第六晶体管的栅极电性连接所述第一节点，所述第五晶体管的栅极和所述第六晶体管的漏极电性连接所述第三节点，所述第七晶体管的栅极和源极电性连接所述高压信号输入端，所述第七晶体管的漏极电性连接所述第三节点。
根据本申请一实施例，第1级所述子驱动单元的所述第一级联信号输入端电性连接所述触发单元。
根据本申请一实施例，第n级子驱动单元的所述第一级联信号输入端电性连接第n-1级子驱动单元的所述级联信号输出端；第n级子驱动单元的所述第二级联信号输入端电性连接第n+1级子驱动单元的所述级联信号输出端；
其中，n为大于或等于2的整数。
根据本申请一实施例，所述第一时钟信号输入端电性连接第一时钟信号线，所述第二时钟信号输入端电性连接第二时钟信号线，所述第一低压信号输入端电性连接第一低压信号线，所述第二低压信号输入端电性连接第二低压信号线，所述高压信号输入端电性连接高压信号线。
根据本申请一实施例，所述驱动单元驱动所述显示装置时，仅一个所述驱动单元单独工作，或任意两个或任意多个所述驱动单元同时工作。
根据本申请一实施例，所述显示驱动电路应用于折叠屏显示装置中，每一个所述驱动单元对应所述折叠屏显示装置中的一个折叠显示区。
本申请提供的显示装置，包括显示屏，所述显示屏包括多个显示区域，所述显示屏通过如上所述的显示驱动电路进行驱动显示，每一个所述显示区域对应一个所述驱动单元。
本发明的有益效果是：本申请提供的显示驱动电路及显示装置，包括多个驱动单元，每一个驱动单元均包括多级子驱动单元，通过将每一个驱动单元利用一个独立的触发单元来控制，可以实现驱动电路的分区工作，应用于显示装置中时可降低显示装置的功耗。
附图说明
为了更清楚地说明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单介绍，显而易见地，下面描述中的附图仅仅是发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本申请一实施例提供的显示驱动电路的整体级联关系示意图；
图2是本申请实施例提供的显示驱动电路中的一个子驱动单元的电路结构示意图；
图3是本申请实施例提供的显示驱动电路中的第一驱动单元的级联关系示意图；
图4是本申请实施例提供的显示驱动电路中的第一驱动单元的输入/输出时序图。
具体实施方式
以下各实施例的说明是参考附加的图示，用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语，例如[上]、[下]、[前]、[后]、[左]、[右]、[内]、[外]、[侧面]等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。在图中，结构相似的单元是用以相同标号表示。
本申请实施例提供一种显示驱动电路，包括多个驱动单元，每一个驱动单元均包括多级子驱动单元，通过将每一个驱动单元利用一个独立的触发单元来控制，可以实现驱动电路的分区工作，应用于显示装置中时可降低显示装置的功耗。
如图1所示，是本申请一实施例提供的显示驱动电路的整体级联关系示意图，所述显示驱动电路包括三个驱动单元，分别是第一驱动单元U1、第二驱动单元U2和第三驱动单元U3；其中，所述第一驱动单元U1用于驱动显示装置的第一显示区A1，所述第二驱动单元U2用于驱动所述显示装置的第二显示区A2，所述第三驱动单元U3用于驱动所述显示装置的第三显示区A3。需要说明的是，在本实施例中，所述显示驱动电路分为三个驱动单元，所述显示装置分为三个显示区，但并不仅限于此，所述显示驱动电路可以包括更多或更少的驱动单元，所述显示装置也可以包括更多或更少的显示区。
所述第一驱动单元U1包括第一级子驱动单元U1(1)、第二级子驱动单元U1(2)、……、和第N级子驱动单元U1(N)；所述第二驱动单元U2包括第一级子驱动单元U2(1)、第二级子驱动单元U2(2)、……、和第N级子驱动单元U2(N)；所述第三驱动单元U3包括第一级子驱动单元U3(1)、第二级子驱动单元U3(2)、……、和第N级子驱动单元U3(N)；其中N为大于2的正整数。需要说明的是，所述第一驱动单元U1、所述第二驱动单元U2和所述第三驱动单元U3分别包含的所述子驱动单元的数量可以相同，也可以不同。
其中，所述第一驱动单元U1的所述第一级子驱动单元U1(1)电性连接第一触发单元STV1，所述第一触发单元STV1用于激活所述第一驱动单元U1向所述显示装置的第一显示区A1提供信号；所述第二驱动单元U2的所述第一级子驱动单元U2(1)电性连接第二触发单元STV2，所述第二触发单元STV2用于激活所述第二驱动单元U2向所述显示装置的第二显示区A2提供信号；所述第三驱动单元U2的所述第一级子驱动单元U3(1)电性连接第三触发单元STV3，所述第三触发单元STV3用于激活所述第三驱动单元U3向所述显示装置的第三显示区A3提供信号。
可选地，所述显示装置可以是三折叠柔性显示装置，其中所述第一显示区A1、所述第二显示区A2和所述第三显示区A3分别对应所述显示装置的三个折叠区。当所述显示装置折叠后，折叠状态感知单元会自动判断需要进行显示的上层显示区，并通过控制芯片控制相应的触发单元向所述驱动单元提供触发信号，从而实现所述显示驱动电路的分区工作，降低显示装置的能耗。需要说明的是，根据所述显示装置折叠状态的不同，所述显示驱动电路中，可以仅一个所述驱动单元单独工作，或任意两个或三个所述驱动单元同时工作。
可选地，每一个所述驱动单元中的每一级所述子驱动单元的电路结构相同，下面以所述第一驱动单元U1为例，对其内部的所述子驱动单元的结构进行说明。
如图2所示，所述子驱动单元包括上拉控制单元101、上拉单元102、下拉单元103、下拉控制单元104以及下拉维持单元105。
所述上拉控制单元101分别与第一时钟信号输入端21、第一级联信号输入端31及第一节点A电性连接。所述上拉控制单元101用于在所述第一时钟信号输入端21输入的信号的控制下将所述第一级联信号输入端31输入的信号传输至所述第一节点A。
具体地，所述上拉控制单元101包括第二晶体管T2，所述第二晶体管T2的栅极电性连接所述第一时钟信号输入端21，所述第二晶体管T2的源极电性连接所述级联信号输入端31，所述第二晶体管T2的漏极电性连接所述第一节点A。
需要说明的是，本发明实施例提供的显示驱动电路中使用的晶体管可以是n型晶体管，也可以是p型晶体管。为了便于理解本发明，在以下实施例中均以n型晶体管为例进行说明。应当理解的是，对于n型晶体管，当晶体管的栅极为高电平时，晶体管的源极与漏极导通，晶体管打开，反之晶体管关闭；对于p型晶体管，当晶体管的栅极为低电平时，晶体管的源极与漏极导通，晶体管打开，反之晶体管关闭。
所述上拉单元102分别与所述第一节点A、第二时钟信号输入端22及第二节点B电性连接。所述上拉单元102用于在所述第一节点A的信号控制下将所述第二时钟信号输入端22输入的信号传输至所述第二节点B。
具体地，所述上拉单元102包括电容Cp和第一晶体管T1。所述电容Cp的第一端电性连接所述第二时钟信号输入端22，所述电容Cp的第二端电性连接所述第一节点A。所述电容Cp用于耦合所述第一节点A和所述第二时钟信号输入端22的电位。所述第一晶体管T1的栅极电性连接所述第一节点A，所述第一晶体管T1的源极电性连接所述第二时钟信号输入端22，所述第一晶体管T1的漏极电性连接所述第二节点B。所述第一晶体管T1用于在所述第一节点A的电压信号控制下，将所述第二时钟信号输入端22输入的信号传输至所述第二节点B。
具体地，所述第二节点B电性连接级联信号输出端61。所述级联信号输出端61用于为显示面板的显示单元提供扫描信号。
在本实施例所述的子驱动单元中，所述电容Cp的两端分别连接所述第二时钟信号输入端22和所述第一节点A，所述级联信号输出端61通过所述第一晶体管T1与所述电容Cp并联设置，因此，所述第二时钟信号输入端22经所述第一晶体管T1传输至所述级联信号输出端61的信号不会被所述电容Cp损耗，可以保证所述级联信号输出端61输出的信号具有足够的强度和稳定性。
所述下拉单元103分别与所述第二节点B、第三节点C及第二低压信号输入端52电性连接。所述下拉单元103用于在所述第三节点C的信号控制下将所述第二低压信号输入端52输入的信号传输至所述第二节点B，从而下拉所述第二节点B的电位，使所述级联信号输出端61输出低电平。
具体地，所述下拉单元103包括第三晶体管T3，所述第三晶体管T3的栅极电性连接所述第三节点C，所述第三晶体管T3的源极电性连接所述第二低压信号输入端52，所述第三晶体管T3的漏极电性连接所述第二节点B。
所述下拉控制单元104分别与所述第一节点A、第二级联信号输入端32及第一低压信号输入端51电性连接。所述下拉控制单元104用于在所述第二级联信号输入端32输入的信号控制下将所述第一低压信号输入端51输入的信号传输至所述第一节点A，从而下拉所述第一节点A的电位。
具体地，所述下拉控制单元104包括第四晶体管T4，所述第四晶体管T4的栅极电性连接所述第二级联信号输入端32，所述第四晶体管T4的源极电性连接所述第一低压信号输入端51，所述第四晶体管T4的漏极电性连接所述第一节点A。
所述下拉维持单元105分别与所述第一节点A、所述第三节点C、高压信号输入端41及所述第一低压信号输入端51电性连接，用于在所述第一节点A的信号控制下将所述第一低压信号输入端51输入的信号或所述高压信号输入端41输入的信号传输至所述第三节点C，从而下拉或抬升所述第三节点C的电位。
具体地，所述下拉维持单元105包括第五晶体管T5、第六晶体管T6和第七晶体管T7。其中，所述第五晶体管T5的源极和所述第六晶体管T6的源极电性连接所述第一低压信号输入端51，所述第五晶体管T5的漏极和所述第六晶体管T6的栅极电性连接所述第一节点A，所述第五晶体管T5的栅极和所述第六晶体管T6的漏极电性连接所述第三节点C，所述第七晶体管T7的栅极和源极电性连接所述高压信号输入端41，所述第七晶体管T7的漏极电性连接所述第三节点C。
在本实施例提供的所述子驱动单元中，所述第一低压信号输入端51下拉所述第一节点A的电位，第二低压信号输入端52下拉所述第二节点B的电位，从而保证所述级联信号输出端61在无高压信号输出时维持在低压状态，防止因所述第二节点B的电位波动导致的所述级联信号输出端61输出的信号异常。
下面针对所述第一驱动单元U1中的所述子驱动单元的级联关系进行说明。
如图3所示，第n级子驱动单元U1(n)的所述第一级联信号输入端31电性连接第n-1级子驱动单元U1(n-1)的所述级联信号输出端61；第n级子驱动单元U1(n)的所述第二级联信号输入端32电性连接第n+1级子驱动单元U1(n+1)的所述级联信号输出端61；其中，n为大于或等于2，且小于N的整数。
特别地，参考图1和图3所示，当n＝2时，第1级子驱动单元U1(1)的所述第一级联信号输入端31电性连接所述第一触发单元STV1。
对于任意一级子驱动单元存在以下连接关系：所述第一时钟信号输入端21电性连接第一时钟信号线CK1，所述第一时钟信号线CK1用于向所述第一时钟信号输入端21传输第一时钟信号；所述第二时钟信号输入端22电性连接第二时钟信号线CK2，所述第二时钟信号线CK2用于向所述第二时钟信号输入端22传输第二时钟信号；所述第一低压信号输入端51电性连接第一低压信号线VL1，所述第一低压信号线VL1用于向所述第一低压信号输入端51传输第一低压信号；所述第二低压信号输入端52电性连接第二低压信号线VL2，所述第二低压信号线VL2用于向所述第二低压信号输入端52传输第二低压信号；所述高压信号输入端41电性连接高压信号线VH，所述高压信号线VH用于向所述高压信号输入端41传输高压信号。
需要说明的是，所述级联信号输出端61输出级联信号G，所述级联信号G可用于驱动显示面板的显示单元。
下面结合图2至图4对本实施例中的所述第一驱动单元U1的输入/输出时序进行分析。
在t1时间段内，所述第一时钟信号线CK1为高电平，所述第二时钟信号线CK2为低电平，第n-1级的级联信号G(n-1)为高电平。需要说明的是，当n＝2时，所述第n-1级的级联信号G(n-1)对应为所述第一触发单元STV1提供的触发信号。所述第二晶体管T2打开，所述第一节点A接收所述第n-1级的级联信号G(n-1)表现为高电平。所述第一晶体管T1和所述第六晶体管T6打开，所述第三节点C被所述第一低压信号线VL1拉低为低电平，所述第三晶体管T3关闭，所述第二节点B接收所述第二时钟信号线CK2的信号表现为低电平，第n级的级联信号G(n)表现为低电平信号。
在t2时间段内，所述第一时钟信号线CK1为低电平，所述第二时钟信号线CK2为高电平，第n-1级的级联信号G(n-1)或所述第一触发单元STV1的信号为低电平。所述第二晶体管T2关闭，在所述电容Cp的电压耦合作用下，所述第一节点A的电平被进一步拉升，表现为更高电平。所述第一晶体管T1进一步打开，所述第三晶体管T3保持关闭，所述第二时钟信号线CK2的高电平传输至所述第二节点B，第n级的级联信号G(n)表现为高电平信号。
在t3时间段内，所述第一时钟信号线CK1为高电平，所述第二时钟信号线CK2为低电平。此时随着级联信号G的传递，第n+1级的级联信号G(n+1)为高电平。所述第四晶体管T4打开，所述第一节点A被所述第一低压信号线VL1下拉至低电平。所述第一晶体管T1和所述第六晶体管T6关闭，所述第三节点C被所述高压信号线VH抬升至高电平，所述第三晶体管T3打开，所述第二节点B被所述第二低压信号线VL2下拉至低电平，第n级的级联信号G(n)表现为低电平信号。
需要说明的是，在t2时间段内，所述第二时钟信号线CK2的信号直接通过所述第一晶体管T1传输至所述级联信号输出端61，所述电容Cp不会对传输至所述级联信号输出端61的信号造成损耗，从而保证所述级联信号输出端61输出稳定的级联信号。另外，在t3时间段及t3时间段之后的时间内，所述级联信号输出端61输出的级联信号始终被所述第二低压信号线VL2维持在低电平，可以防止因所述第二时钟信号线CK2的信号波动造成所述级联信号输出端61输出的级联信号异常跳动。
综上所述，本申请实施例提供的显示驱动电路，包括多个驱动单元，每一个驱动单元均包括多级子驱动单元，通过将每一个驱动单元利用一个独立的触发单元来控制，可以实现驱动电路的分区工作，应用于显示装置中时可降低显示装置的功耗。
本申请实施例还提供一种显示装置，包括显示屏，所述显示屏包括多个显示区域，所述显示屏通过本申请实施例提供的显示驱动电路进行驱动显示，并且每一个所述显示区域对应一个所述驱动单元。
可选地，所述显示装置可以是三折叠柔性显示装置，包括第一显示区、第二显示区和第三显示区，每一个显示区分别对应所述显示装置的一个折叠区，并且每一个所述显示区通过一个所述驱动单元进行驱动。当所述显示装置折叠后，折叠状态感知单元会自动判断需要进行显示的上层显示区，并通过控制芯片控制相应的触发单元向所述驱动单元提供触发信号，从而实现所述显示驱动电路的分区工作，降低所述显示装置的能耗。
需要说明的是，虽然本发明以具体实施例揭露如上，但上述实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (10)

1.一种显示驱动电路，其特征在于，包括多个驱动单元，每一个所述驱动单元均包括多级子驱动单元；
每一个所述驱动单元均电性连接一个独立的触发单元，每一个所述驱动单元内的所述子驱动单元逐级电性连接，所述触发单元用于激活所述驱动单元向显示装置提供信号。
2.根据权利要求1所述的显示驱动电路，其特征在于，所述显示装置包括三个显示区域，所述显示驱动电路包括三个所述驱动单元，每一个所述驱动单元分别独立驱动所述显示装置中的一个显示区域。
3.根据权利要求1所述的显示驱动电路，其特征在于，每一个所述子驱动单元包括：
上拉控制单元，与第一时钟信号输入端、第一级联信号输入端及第一节点电性连接，用于在所述第一时钟信号输入端输入的信号的控制下将所述第一级联信号输入端输入的信号传输至所述第一节点；
上拉单元，与所述第一节点、第二时钟信号输入端及第二节点电性连接，用于在所述第一节点的信号控制下将所述第二时钟信号输入端输入的信号传输至所述第二节点，所述第二节点电性连接级联信号输出端；
下拉单元，与所述第二节点、第三节点及第二低压信号输入端电性连接，用于在所述第三节点的信号控制下将所述第二低压信号输入端输入的信号传输至所述第二节点；
下拉控制单元，与所述第一节点、第二级联信号输入端及第一低压信号输入端电性连接，用于在所述第二级联信号输入端输入的信号控制下将所述第一低压信号输入端输入的信号传输至所述第一节点；
下拉维持单元，与所述第一节点、所述第三节点、高压信号输入端及所述第一低压信号输入端电性连接，用于在所述第一节点的信号控制下将所述第一低压信号输入端输入的信号或所述高压信号输入端输入的信号传输至所述第三节点。
4.根据权利要求3所述的显示驱动电路，其特征在于，
所述上拉单元包括电容和第一晶体管，所述电容的第一端电性连接所述第二时钟信号输入端，所述电容的第二端电性连接所述第一节点；所述第一晶体管的栅极电性连接所述第一节点，所述第一晶体管的源极电性连接所述第二时钟信号输入端，所述第一晶体管的漏极电性连接所述第二节点；
所述上拉控制单元包括第二晶体管，所述第二晶体管的栅极电性连接所述第一时钟信号输入端，所述第二晶体管的源极电性连接所述级联信号输入端，所述第二晶体管的漏极电性连接所述第一节点；
所述下拉单元包括第三晶体管，所述第三晶体管的栅极电性连接所述第三节点，所述第三晶体管的源极电性连接所述第二低压信号输入端，所述第三晶体管的漏极电性连接所述第二节点；
所述下拉控制单元包括第四晶体管，所述第四晶体管的栅极电性连接所述第二级联信号输入端，所述第四晶体管的源极电性连接所述第一低压信号输入端，所述第四晶体管的漏极电性连接所述第一节点；
所述下拉维持单元包括第五晶体管、第六晶体管和第七晶体管，所述第五晶体管的源极和所述第六晶体管的源极电性连接所述第一低压信号输入端，所述第五晶体管的漏极和所述第六晶体管的栅极电性连接所述第一节点，所述第五晶体管的栅极和所述第六晶体管的漏极电性连接所述第三节点，所述第七晶体管的栅极和源极电性连接所述高压信号输入端，所述第七晶体管的漏极电性连接所述第三节点。
5.根据权利要求3所述的显示驱动电路，其特征在于，第1级所述子驱动单元的所述第一级联信号输入端电性连接所述触发单元。
6.根据权利要求3所述的显示驱动电路，其特征在于，第n级子驱动单元的所述第一级联信号输入端电性连接第n-1级子驱动单元的所述级联信号输出端；第n级子驱动单元的所述第二级联信号输入端电性连接第n+1级子驱动单元的所述级联信号输出端；
其中，n为大于或等于2的整数。
7.根据权利要求3所述的显示驱动电路，其特征在于，所述第一时钟信号输入端电性连接第一时钟信号线，所述第二时钟信号输入端电性连接第二时钟信号线，所述第一低压信号输入端电性连接第一低压信号线，所述第二低压信号输入端电性连接第二低压信号线，所述高压信号输入端电性连接高压信号线。
8.根据权利要求1所述的显示驱动电路，其特征在于，所述驱动单元驱动所述显示装置时，仅一个所述驱动单元单独工作，或任意两个或任意多个所述驱动单元同时工作。
9.根据权利要求1所述的显示驱动电路，其特征在于，所述显示驱动电路应用于折叠屏显示装置中，每一个所述驱动单元对应所述折叠屏显示装置中的一个折叠显示区。
10.一种显示装置，其特征在于，包括显示屏，所述显示屏包括多个显示区域，所述显示屏通过权利要求1、3-9中任一权利要求所述的显示驱动电路进行驱动显示，每一个所述显示区域对应一个所述驱动单元。
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