CN111369944A - 像素结构及其驱动方法、显示装置 - Google Patents
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Abstract
本发明提供一种像素结构及其驱动方法、显示装置,像素结构包括开关单元、驱动单元以及多个薄膜晶体管和至少一电容,在驱动过程中,其控制信号由同一个全局控制信号提供,以在一帧时间段内同时控制多个薄膜晶体管的栅极,进而实现了像素结构电路的同步发光,减小了各薄膜晶体管之间的阈值差异,提高了大尺寸显示面板显示画面的一致性,并提高了显示质量。
Description
技术领域
本揭示涉及面板显示技术领域,尤其涉及一种像素结构及其驱动方法、显示装置。
背景技术
有机发光二极管(Organic light emitting diode,OLED)作为一种发光器件,已被广泛的应用于各种显示设置中。
OLED依驱动方式可分为被动式矩阵驱动和主动式矩阵驱动两种,对于主动式矩阵驱动方式而言,具有自发光、高亮度和色彩饱和度及响应能力成为当前面板显示领域的,但是其使用寿命成为其进一步向前的发展的瓶颈。同时,对于目前的显示面板而言,大多采用低温多晶硅基板,在低温多晶硅基板上制作薄膜晶体管阵列时,由于制备工艺等原因而造成基板上各处薄膜晶体管的阈值电压(Vth)值不均匀,进而使得各薄膜晶体管在驱动或工作时所产生的驱动电路存在差异,而造成各发光二极管所发出的亮度不一致,最终导致显示面板显示效果差,尤其是对于大尺寸的OLED显示面板,影响更为显著。
综上所述,现有的发光二极管显示器件中,在制作薄膜晶体管阵列时,各处薄膜晶体管在驱动或工作时其阈值电压不均匀,驱动电路存在较大的差异,进而造成发光二极管所发出的亮度不一致,显示效果差。
发明内容
本揭示提供一种像素结构及其驱动方法及显示装置,以解决像素电路结构中,各薄膜晶体管的阈值电压不均匀,发光二极管所发出的亮度不一致,显示效果及器件稳定性较差的问题。
为解决上述技术问题,本揭示实施例提供的技术方案如下:
根据本揭示实施例的第一方面,提供了一种像素结构,所述像素结构电性连接至一数据线、一第一电压线以及一第二电压线,所述像素结构包括:
开关单元,所述开关单元包括一控制端、第一端及第二端,所述开关单元的所述第一端与所述第一电压线电连接;
第一薄膜晶体管,所述第一薄膜晶体管的漏极与所述第二电压线电连接;
第二薄膜晶体管,所述第二薄膜晶体管的漏极与所述开关单元的所述第二端电连接,所述第二薄膜晶体管的栅极与所述第一薄膜晶体管的源极电连接;
第三薄膜晶体管,所述第三薄膜晶体管的源极与所述第二薄膜晶体管的源极电连接;
第一电容,所述第一电容的一端与所述第一薄膜晶体管的源极和所述第二薄膜晶体管的栅极电连接,所述第一电容的另一端与所述第二薄膜晶体管的源极电连接;
发光二极管,所述发光二极管的一端与所述第一电容的另一端电连接,所述发光二极管的另一端接地;以及
驱动单元,所述驱动单元包括一控制端、第一端及第二端,所述驱动单元的所述第一端与所述数据线电连接,所述驱动单元的所述第二端与所述第二薄膜晶体管的栅极;
其中,所述驱动单元的控制端与扫描信号线电连接以接收扫描信号,所述开关单元的控制端、所述第一薄膜晶体管的栅极以及所述第三薄膜晶体管的栅极与相对应的栅极信号线连接,用以在一帧时间内同时控制并实现同步发光。
根据本揭示一实施例,所述像素结构还包括第二电容和第五薄膜晶体管;
所述第二电容的一端与所述驱动单元的所述第二端电连接,所述第二电容的另一端接地;
所述第五薄膜晶体管的漏极与所述驱动单元的所述第二端连接,所述第五薄膜晶体管的源极所述第一薄膜晶体管的源极、所述第二薄膜晶体管的栅极以及所述第一电容的一端电连接。
根据本揭示一实施例,所述第五薄膜晶体管的栅极与相对应的栅极信号线连接。
根据本揭示一实施例,所述驱动单元包括第四薄膜晶体管,所述驱动单元的所述第一端为所述薄膜晶体管的漏极,所述第二端为所述薄膜晶体管的源极,所述控制端为所述薄膜晶体管的栅极。
根据本揭示一实施例,所述开关单元包括一薄膜晶体管,所述开关单元的所述第一端为所述薄膜晶体管的漏极,所述第二端为所述薄膜晶体管的源极,所述控制端为所述薄膜晶体管的栅极。
根据本揭示一实施例,所述薄膜晶体管为真彩色薄膜晶体管。
根据本揭示一实施例,所述像素单元还包括全局输入信号,所述全局输入信号为所述开关单元的控制端、所述第一薄膜晶体管的栅极以及所述第三薄膜晶体管的栅极提供控制信号。
根据本揭示一实施例,所述第一电容与所述第二电容相同,所述第二电容用以存储所述驱动单元写入的数据信号。
根据本揭示的第二方面,还提供一种显示装置,所述显示装置包括本揭示实施例中的像素结构,所述像素结构中的驱动电路中各薄膜晶体管的阈值电压一致性较好,显示装置的显示效果好。
根据本揭示的第三方面,还提供一种像素结构的驱动方法,包括如下步骤:
S100:初始化阶段,向第一薄膜晶体管和第三薄膜晶体管提供高电位信号,且分别将所述第一薄膜晶体管和所述第三薄膜晶体管的栅极和源极电压复位为基准电压和初始电压,并关闭开关单元;
S101:补偿阶段,打开所述开关单元,向所述开光单元提供第一电压,并为第二薄膜晶体管的源极充电至所述第二薄膜晶体管截止;
S102:数据写入阶段,打开所述开关单元,并将数据信号电压写入所述第二薄膜晶体管的栅极;
S103:发光阶段,打开所述开关单元,所述第二薄膜晶体管导通,并驱使发光二极管发光。
综上所述,本揭示实施例的有益效果为:
本揭示实施例提供一种像素结构及其驱动方法、显示装置,通过输入全局控制信号,可实现将第五薄膜晶体管、第一薄膜晶体管以及第三薄膜晶体管在一帧时间内同时打开或关闭,进而达到像素结构中薄膜晶体管阈值电压的一致性,有效的改善显示装置尤其是大尺寸显示装置内的器件发光的一致性,减少显示面板的屏闪问题,并提高显示装置的显示效果。
附图说明
为了更清楚地说明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单介绍,显而易见地,下面描述中的附图仅仅是揭示的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本揭示实施例中像素结构的电路图;
图2为本揭示实施例提供的又一像素结构电路示意图;
图3为本揭示实施例中像素结构的驱动方法流程示意图;
图4为本揭示实施例中图2对应的像素电路时序图;
图5为本揭示实施例中图1对应的驱动电路时序图。
具体实施方式
下面将结合本揭示实施例中的附图,对本揭示实施例中的技术方案进行清楚、完整地描述。显然,所描述的实施例仅仅是本揭示一部分实施例,而不是全部的实施例。基于本揭示中的实施例,本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本揭示保护的范围。
本揭示实施例提供一种像素结构,如图1所示,图1为本揭示实施例中像素结构的电路图。像素结构包括一开关单元100以及驱动单元101。具体的,开关单元100还包括一控制端、第一端以及第二端,驱动单元101也包括所述驱动单元101的控制端、第一端以及第二端。
具体的,所述开关单元100的一端与第一电压线VDD电连接,开关单元100的第二端与第二薄膜晶体管T2的漏极电连接。
所述驱动单元101的第一端与数据线Data电连接,同时,驱动单元101的第二端与第二薄膜晶体管的栅极连接,并同时与第一薄膜晶体管T1的源极以及一第一电容Cst的一端电连接。
所述开关单元100和驱动单元101可包括薄膜晶体管,在本揭示实施例中,开关单元100以一薄膜晶体管、所述驱动单元101以第四薄膜晶体管T4为例进行说明。
具体的,开关单元100为一薄膜晶体管,开关单元100的所述第一端为所述薄膜晶体管的漏极,所述第二端为所述薄膜晶体管的源极,所述控制端为所述薄膜晶体管的栅极,两者在各连接关系上一一对应,同时,薄膜晶体管的栅极与栅极信号线G4相连接,以为其提供栅极驱动信号。
驱动单元101为第四薄膜晶体管T4,所述驱动单元101的所述第一端为所述第四薄膜晶体管T4的漏极,所述第二端为所述第四薄膜晶体管T4的源极,所述控制端为所述第四薄膜晶体管T4的栅极,同时,第四薄膜晶体管T4的栅极与扫描信号线Scan相连接,以为其提供扫描信号,在本揭示实施例中,扫描信号线采用逐行扫描的方式以打开其对应的所述第四薄膜晶体管。
进一步的,像素结构还包括第二薄膜晶体管T2,第二薄膜晶体管T2为驱动薄膜晶体管,其中,第二薄膜晶体管T2的源极与发光二极管一端连接,同时与第一电容的另一端和第三薄膜晶体管T3的源极电连接,第二薄膜晶体管T2的漏极与开关单元100中的薄膜晶体管的源极电连接。
发光二极管,发光二极管一端与第二薄膜晶体管T2的源极以及第一电容Cst的另一端和第三薄膜晶体管T3的源极连接,发光二极管的另一端接地。
第一薄膜晶体管T1,所述第一薄膜晶体管T1的漏极与第二电压线Vref电连接,所述第一薄膜晶体管T1的源极与所述驱动单元101的第二端电连接,同时,第一薄膜晶体管T1的源极与第二电容Cst的一端连接以及与第二薄膜晶体管T2的栅极连接。进一步的,第一薄膜晶体管的栅极还与其对应的栅极信号线G2相连接,以为其提供栅极信号。
以及第三薄膜晶体管T3,所述第三薄膜晶体管T3的漏极与一初始信号线Vini连接,第三薄膜晶体管T3源极与发光二极管的一端连接,同时与第一电容Cst的另一端和第二薄膜晶体管T2的源极连接,进一步的,第三薄膜晶体管T3的栅极与其对应的栅极信号线G1相连接,已为第三薄膜晶体管T3提供栅极信号。
在本揭示实施例中,开关单元100的控制端对应的薄膜晶体管的栅极、第一薄膜晶体管T1的栅极以及第三薄膜晶体管T3的栅极与其相对应的栅极信号控制线G4、G2和G1相连接,为例实现同步控制的目的,本揭示实施例中,栅极信号控制线G1与G2的控制信号由一全局信号(Global)提供,进而实现在同一帧时间内同步控制的目的,最终减少各薄膜晶体管的阈值Vth的差异,提高显示效果。
在驱动控制过程中,第一电容Cst用来存储第二薄膜晶体管T2的栅极和源极直接的电压Vgs,以保证驱动电路的正常工作。
本揭示实施例中,开关单元100对应的薄膜晶体管为真彩色型薄膜晶体管,以提高显示面板及装置的显示效果。
优选的,如图2所示,图2为本揭示实施例提供的又一像素结构电路示意图。同时结合图1中的像素结构电路示意图。像素结构还包括第二单元200。具体的,第二单元200包括第五薄膜晶体管T5以及第二电容C1,所述第二电容C1的一端与第四薄膜晶体管T4的源极电连接,所述第二电容的另一端接地;
同时,第五薄膜晶体管T5的漏极与第四薄膜晶体管T4的源极与连接,同时与第二电容C1的第一端连接。并且,第五薄膜晶体管T5的源极与第一薄膜晶体管T1的源极、第二薄膜晶体管T2的栅极以及第一电容Cst的一端电连接,其中,第一电容Cst和第二电容C1可相同。
进一步的,第五薄膜晶体管T5的栅极与其对应的栅极信号线G3连接,栅极信号线G3为其提供栅极信号。
在本揭示实施例中,通过全局信号,能在一帧时间内同时为栅极信号线G1、G2以及G3提供驱动信号,以使其各自对应的薄膜晶体管打开或者关闭,最终实现同步发光,降低像素结构电路中薄膜晶体管的阈值漂移较大,发光显示一致性较差的问题。
优选的,如图3所示,图3为本揭示实施例中,图3为本揭示实施例中像素结构的驱动方法流程示意图。具体的,驱动方法包括如下步骤:
S100:初始化阶段,向第一薄膜晶体管和第三薄膜晶体管提供高电位信号,且分别将所述第一薄膜晶体管和所述第三薄膜晶体管的栅极和源极电压复位为基准电压和初始电压,并关闭开关单元;
S101:补偿阶段,打开所述开关单元,向所述开光单元提供第一电压,并为第二薄膜晶体管的源极充电至所述第二薄膜晶体管截止;
S102:数据写入阶段,打开所述开关单元,并将数据信号电压写入所述第二薄膜晶体管的栅极;
S103:发光阶段,打开所述开关单元,所述第二薄膜晶体管导通,并驱使发光二极管发光。
上述驱动方法中,以图2中的像素结构电路图为例进行说明,图2中的像素结构电路为100%完全发光的像素结构电路。
同时,结合图4,图4为本揭示实施例中图2对应的像素电路时序图。在驱动时,首先为驱动电路的初始化阶段,即对应图4中的t0时段内,栅极控制信号线G1与G2提供高电位,同时打开其对应的第一薄膜晶体管T1和第三薄膜晶体管T3,并且,将第二薄膜晶体管T2的栅极和源极分别复位为基准电压Vref和初始信号电压Vini,此过程中,开关单元100被关闭,并且通过G3控制线将其对应的第五薄膜晶体管关闭,数据线中的Data电压被存储在第二电容C1内,为后续驱动提供基础。
当初始化完成后,像素电路进行补偿阶段即对应图4中的t1时段内,此时,开关单元100打开,第一电压VDD进而给第二薄膜晶体管T2的源极进行充电,在充电过程中,第二薄膜晶体管T2的电位不断提升,直至第二薄膜晶体管T2充电截止,此时,第二薄膜晶体管T2的源极电压为(Vref-Vth)。
进而进行数据写入阶段,即对应于图4时序图中的t2时间段。此时,开关单元100开启,第五薄膜晶体管T5打开,数据信号电压Data写入到第二薄膜晶体管T2的栅极中,同时,第二薄膜晶体管T2的源极电压发生变化,源极电压为Vs=(Vdata-Vref)(Cst/(Cst+Coled))+Vref-Vth;第二薄膜晶体管T2的栅极于源极间的电压Vgs则为:
Vgs=Vdata-[(Vdata-Vref)(Cst/(Cst+Coled))+Vref-Vth]。进而实现数据信号的写入。
当信号写入后,进而进行发光阶段,即对应图4时序图中的t3时间段。此时,开关单元100打开,发光二极管发光,在发光过程中,y由于第一电容Cst存储有电容值,使得在发光过程中,发光二极管的Vgs电压保持不变,从而使得整个像素电路发光一致性良好。
在本揭示实施例中,通过全局控制信号Global同时为G1、G2以及G3提供控制信号,进而实现了驱动电路的同步发光,减少了各薄膜晶体管之间的阈值Vth的差异,保证了显示装置的显示一致性。
进一步的,如图5所示,图5为本揭示实施例中图1对应的驱动电路时序图。与图2和图4中不同的是,本揭示实施例中,图1及图5为驱动电路71%的发光时间对应的电路图及其时序图。图2及图4为100%的发光时间对应的电路图及其时序图。其工作原理与图4中的相同,这里不再详细描述。
优选的,本揭示实施例还提供一种显示装置,显示装置包括本揭示实施例中提供的像素结构电路,所述显示装置有效的解决了在制备显示面板的驱动电路过程中,由于制备工艺等因素而造成的显示装置内的各薄膜晶体管的阈值电压差异较大,面板显示亮度一致性较差等问题,并将逐行扫描的薄膜晶体管降低为一个。有效的提高了显示装置的性能。
以上对本揭示实施例所提供的一种像素结构及其驱动方法、显示装置进行了详细的介绍,以上实施例的说明只是用于帮助理解本揭示的技术方案及其核心思想;本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改,而这些修改或者替换,并不使相应技术方案的本质脱离本揭示各实施例的技术方案的范围。
Claims (10)
1.一种像素结构,其特征在于,所述像素结构电性连接至一数据线、一第一电压线以及一第二电压线,所述像素结构包括:
开关单元,所述开关单元包括一控制端、第一端及第二端,所述开关单元的所述第一端与所述第一电压线电连接;
第一薄膜晶体管,所述第一薄膜晶体管的漏极与所述第二电压线电连接;
第二薄膜晶体管,所述第二薄膜晶体管的漏极与所述开关单元的所述第二端电连接,所述第二薄膜晶体管的栅极与所述第一薄膜晶体管的源极电连接;
第三薄膜晶体管,所述第三薄膜晶体管的源极与所述第二薄膜晶体管的源极电连接;
第一电容,所述第一电容的一端与所述第一薄膜晶体管的源极和所述第二薄膜晶体管的栅极电连接,所述第一电容的另一端与所述第二薄膜晶体管的源极电连接;
发光二极管,所述发光二极管的一端与所述第一电容的另一端电连接,所述发光二极管的另一端接地;以及驱动单元,所述驱动单元包括一控制端、第一端及第二端,所述驱动单元的所述第一端与所述数据线电连接,所述驱动单元的所述第二端与所述第二薄膜晶体管的栅极电连接;
其中,所述驱动单元的控制端与扫描信号线电连接以接收扫描信号,所述开关单元的控制端、所述第一薄膜晶体管的栅极以及所述第三薄膜晶体管的栅极与相对应的栅极信号线连接,用以在一帧时间内实现同时控制并实现同步发光。
2.根据权利要求1所述的像素结构,其特征在于,所述像素结构还包括第二电容和第五薄膜晶体管;
所述第二电容的一端与所述驱动单元的所述第二端电连接,所述第二电容的另一端接地;
所述第五薄膜晶体管的漏极与所述驱动单元的所述第二端连接,所述第五薄膜晶体管的源极所述第一薄膜晶体管的源极、所述第二薄膜晶体管的栅极以及所述第一电容的一端电连接。
3.根据权利要求2所述的像素结构,其特征在于,所述第五薄膜晶体管的栅极与相对应的栅极信号线连接。
4.根据权利要求1所述的像素结构,其特征在于,所述驱动单元包括第四薄膜晶体管,所述驱动单元的所述第一端为所述第四薄膜晶体管的漏极,所述第二端为所述第四薄膜晶体管的源极,所述控制端为所述薄膜晶体管的栅极。
5.根据权利要求1所述的像素结构,其特征在于,所述开关单元包括一薄膜晶体管,所述开关单元的所述第一端为所述薄膜晶体管的漏极,所述第二端为所述薄膜晶体管的源极,所述控制端为所述薄膜晶体管的栅极。
6.根据权利要求5所述的像素结构,其特征在于,所述薄膜晶体管为真彩色薄膜晶体管。
7.根据权利要求1所述的像素结构,其特征在于,所述像素单元还包括全局输入信号,所述全局输入信号为所述开关单元的控制端、所述第一薄膜晶体管的栅极以及所述第三薄膜晶体管的栅极提供控制信号。
8.根据权利要求2所述的像素结构,其特征在于,所述第一电容与所述第二电容相同,所述第二电容用以存储所述驱动单元写入的数据信号。
9.一种显示装置,其特征在于,包括如权利要求1-8任一项所述的像素结构。
10.一种像素结构的驱动方法,其特征在于,包括如下步骤:
S100:初始化阶段,向第一薄膜晶体管和第三薄膜晶体管提供高电位信号,且分别将所述第一薄膜晶体管和所述第三薄膜晶体管的栅极和源极电压复位为基准电压和初始电压,并关闭开关单元;
S101:补偿阶段,打开所述开关单元,向所述开光单元提供第一电压,并为第二薄膜晶体管的源极充电至所述第二薄膜晶体管截止;
S102:数据写入阶段,打开所述开关单元,并将数据信号电压写入所述第二薄膜晶体管的栅极;
S103:发光阶段,打开所述开关单元,所述第二薄膜晶体管导通,并驱使发光二极管发光。
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