CN111326093B - 显示装置 - Google Patents

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Abstract

公开了显示装置。显示装置的实施方式包括具有第一发光晶体管、第二发光晶体管和第三发光晶体管的第一像素、第二像素和第三像素、用于将包括处于关断电平的第一脉冲的第一发光信号施加到第一发光晶体管的栅电极的第一发光级、用于将包括处于关断电平的第二脉冲的第二发光信号施加到第二发光晶体管的栅电极的第二发光级和用于将包括处于关断电平的第三脉冲的第三发光信号施加到第三发光晶体管的栅电极的第三发光级，其中，第一脉冲和第二脉冲的产生时间之间的间隔与第二脉冲和第三脉冲的产生时间之间的间隔相同，并且第一脉冲和第二脉冲的消光时间之间的间隔与第二脉冲和第三脉冲的消光时间之间的间隔不同。

Description

显示装置
相关申请的交叉引用
本申请要求于2018年12月14日提交到韩国知识产权局的第10-2018-0162365号韩国专利申请的优先权及权益，该韩国专利申请的全部内容通过引用并入本文。
技术领域
本公开涉及显示装置。
背景技术
随着信息技术的发展，作为用户与信息之间的连接介质的显示装置的重要性已得到强调。因此，已在越来越多地使用诸如液晶显示装置、有机发光二极管显示装置和等离子体显示装置的显示装置。
显示装置可包括多个发光线。通过转变施加到每个发光线的发光信号的电平，可确定像素是否连接到相应的发光线以发光。
然而，当发光信号的转变时间具有恒定的周期时，可能会发生与该周期对应的频率的电磁干扰(EMI)噪声。
发明内容
本公开的实施方式提供了能够减小因转变发光信号而导致的EMI噪声的最大值的显示装置。
根据本公开的实施方式的显示装置包括第一像素、第二像素、第三像素、第一发光级、第二发光级和第三发光级，第一像素包括第一发光二极管和第一发光晶体管，当第一发光晶体管导通时，第一发光晶体管将驱动电流传输到第一发光二极管，第二像素包括第二发光二极管和第二发光晶体管，当第二发光晶体管导通时，第二发光晶体管将驱动电流传输到第二发光二极管，第三像素包括第三发光二极管和第三发光晶体管，当第三发光晶体管导通时，第三发光晶体管将驱动电流传输到第三发光二极管，第一发光级配置成将包括处于关断电平的第一脉冲的第一发光信号施加到第一发光晶体管的栅电极，第二发光级配置成将包括处于关断电平的第二脉冲的第二发光信号施加到第二发光晶体管的栅电极，并且第三发光级配置成将包括处于关断电平的第三脉冲的第三发光信号施加到第三发光晶体管的栅电极，其中，第一脉冲和第二脉冲的产生时间之间的间隔与第二脉冲和第三脉冲的产生时间之间的间隔相同，以及其中，第一脉冲和第二脉冲的消光时间之间的间隔与第二脉冲和第三脉冲的消光时间之间的间隔不同。
第一脉冲和第二脉冲的消光时间之间的间隔可短于第二脉冲和第三脉冲的消光时间之间的间隔。
第一脉冲和第二脉冲的消光时间之间的间隔可长于第二脉冲和第三脉冲的消光时间之间的间隔。
第一发光级、第二发光级和第三发光级可配置成接收第一时钟信号和第二时钟信号，其中，第一脉冲的产生时间与第二时钟信号的脉冲同步，其中，第一脉冲的消光时间与第一时钟信号的脉冲同步，其中，第二脉冲的产生时间与第一时钟信号的脉冲同步，其中，第二脉冲的消光时间与第二时钟信号的脉冲同步，其中，第三脉冲的产生时间与第二时钟信号的脉冲同步，以及其中，第三脉冲的消光时间与第一时钟信号的脉冲同步。
与第一脉冲、第二脉冲和第三脉冲的产生时间和消光时间同步的第一时钟信号和第二时钟信号的脉冲可彼此不同。
根据本公开的实施方式的显示装置包括第一像素、第二像素、第三像素、第一发光级、第二发光级和第三发光级，第一像素包括第一发光二极管和第一发光晶体管，当第一发光晶体管导通时，第一发光晶体管将驱动电流传输到第一发光二极管，第二像素包括第二发光二极管和第二发光晶体管，当第二发光晶体管导通时，第二发光晶体管将驱动电流传输到第二发光二极管，第三像素包括第三发光二极管和第三发光晶体管，当第三发光晶体管导通时，第三发光晶体管将驱动电流传输到第三发光二极管，第一发光级配置成将包括处于关断电平的第一脉冲的第一发光信号施加到第一发光晶体管的栅电极，第二发光级配置成将包括处于关断电平的第二脉冲的第二发光信号施加到第二发光晶体管的栅电极，并且第三发光级配置成将包括处于关断电平的第三脉冲的第三发光信号施加到第三发光晶体管的栅电极，其中，第一脉冲和第二脉冲的产生时间之间的间隔与第二脉冲和第三脉冲的产生时间之间的间隔不同，以及其中，第一脉冲和第二脉冲的消光时间之间的间隔与第二脉冲和第三脉冲的消光时间之间的间隔相同。
第一脉冲和第二脉冲的产生时间之间的间隔可短于第二脉冲和第三脉冲的产生时间之间的间隔。
第一脉冲和第二脉冲的产生时间之间的间隔可长于第二脉冲和第三脉冲的产生时间之间的间隔。
第一发光级、第二发光级和第三发光级配置成接收第一时钟信号和第二时钟信号，其中，第一脉冲的产生时间与第二时钟信号的脉冲同步，其中，第一脉冲的消光时间与第一时钟信号的脉冲同步，其中，第二脉冲的产生时间与第一时钟信号的脉冲同步，其中，第二脉冲的消光时间与第二时钟信号的脉冲同步，其中，第三脉冲的产生时间与第二时钟信号的脉冲同步，以及其中，第三脉冲的消光时间与第一时钟信号的脉冲同步。
分别与第一脉冲、第二脉冲和第三脉冲的产生时间和消光时间同步的第一时钟信号和第二时钟信号的脉冲可彼此不同。
根据本公开的实施方式的显示装置包括第一像素、第二像素、第三像素、第一发光级、第二发光级和第三发光级，第一像素包括第一发光二极管和第一发光晶体管，当第一发光晶体管导通时，第一发光晶体管将驱动电流传输到第一发光二极管，第二像素包括第二发光二极管和第二发光晶体管，当第二发光晶体管导通时，第二发光晶体管将驱动电流传输到第二发光二极管，第三像素包括第三发光二极管和第三发光晶体管，当第三发光晶体管导通时，第三发光晶体管将驱动电流传输到第三发光二极管，第一发光级配置成将包括处于关断电平的第一脉冲的第一发光信号施加到第一发光晶体管的栅电极，第二发光级配置成将包括处于关断电平的第二脉冲的第二发光信号施加到第二发光晶体管的栅电极，并且第三发光级配置成将包括处于关断电平的第三脉冲的第三发光信号施加到第三发光晶体管的栅电极，其中，第一脉冲和第二脉冲的产生时间之间的间隔与第二脉冲和第三脉冲的产生时间之间的间隔不同，其中，第一脉冲和第二脉冲的消光时间之间的间隔与第二脉冲和第三脉冲的消光时间之间的间隔不同，以及其中，第一发光级和第三发光级为与第二发光级最接近的发光级。
第一脉冲和第二脉冲的消光时间之间的间隔可短于第二脉冲和第三脉冲的消光时间之间的间隔。
第一脉冲和第二脉冲的产生时间之间的间隔可短于第二脉冲和第三脉冲的产生时间之间的间隔。
第一发光级、第二发光级和第三发光级可配置成接收第一时钟信号和第二时钟信号，其中，第一脉冲的产生时间与第二时钟信号的脉冲同步，其中，第一脉冲的消光时间与第一时钟信号的脉冲同步，其中，第二脉冲的产生时间与第一时钟信号的脉冲同步，其中，第二脉冲的消光时间与第二时钟信号的脉冲同步，其中，第三脉冲的产生时间与第二时钟信号的脉冲同步，以及其中，第三脉冲的消光时间与第一时钟信号的脉冲同步。
分别与第一脉冲、第二脉冲和第三脉冲的产生时间和消光时间同步的第一时钟信号和第二时钟信号的脉冲可彼此不同。
第一脉冲和第二脉冲的消光时间之间的间隔可长于第二脉冲和第三脉冲的消光时间之间的间隔。
第一脉冲和第二脉冲的产生时间之间的间隔可长于第二脉冲和第三脉冲的产生时间之间的间隔。
第一发光级、第二发光级和第三发光级配置成接收第一时钟信号和第二时钟信号，其中，第一脉冲的产生时间与第一时钟信号的脉冲同步，其中，第一脉冲的消光时间与第二时钟信号的脉冲同步，其中，第二脉冲的产生时间与第二时钟信号的脉冲同步，其中，第二脉冲的消光时间与第一时钟信号的脉冲同步，其中，第三脉冲的产生时间与第一时钟信号的脉冲同步，以及其中，第三脉冲的消光时间与第二时钟信号的脉冲同步。
分别与第一脉冲、第二脉冲和第三脉冲的产生时间和消光时间同步的第一时钟信号和第二时钟信号的脉冲可彼此不同。
第一脉冲、第二脉冲和第三脉冲中的每个的宽度可相同。
相应地，根据本公开的实施方式的显示装置可减小因发光信号的转变引起的EMI噪声的最大值。
附图说明
图1是用于示出根据本公开的实施方式的显示装置的图。
图2是用于示出根据本公开的实施方式的像素的图。
图3是用于示出根据本公开的实施方式的像素的驱动方法的图。
图4是用于示出根据本公开的实施方式的发射驱动器的图。
图5是用于示出根据本公开的实施方式的发光级的图。
图6是用于示出图5的发光级的驱动方法的图。
图7是用于示出根据本公开的第一实施方式的发光级的图。
图8是用于示出根据本公开的第一实施方式的发光级的驱动方法的图。
图9是用于示出根据本公开的另一实施方式的发光级的图。
图10是用于示出根据本公开的另一实施方式的发光级的驱动方法的图。
图11是用于示出根据本公开的另一实施方式的发光级的驱动方法的图。
具体实施方式
通过参考实施方式的详细描述和附图，可更容易地理解本发明构思的特征以及实现其的方法。在下文中，将参考附图对实施方式进行更加详细地描述。然而，所描述的实施方式可以以各种不同的形式实施，并且不应被解释为仅受限于本文中所示的实施方式。相反，提供这些实施方式作为示例，以使得本公开将是彻底和完整的，并且将向本领域技术人员全面地传达本发明构思的方面和特征。相应地，对于本领域普通技术人员完整地理解本发明构思的方面和特征而言并非必要的工艺、元件和技术可不被描述。除非另有说明，否则在整个附图和书面描述中，相同的附图标记指示相同的元件，并因此其描述将不被重复。此外，为了使描述清楚，与实施方式的描述无关的部分可能不被示出。在附图中，为了清楚起见，元件、层和区的相对尺寸可被放大。
在本文中参考作为实施方式和/或中间结构的示意性图示的剖视图对各种实施方式进行描述。由此，由例如制造技术和/或公差的结果所导致的图示的形状的变化是可预期的。此外，出于对根据本公开的构思的实施方式进行描述的目的，本文中所公开的具体结构性或功能性描述仅仅是说明性的。因此，本文中所公开的实施方式不应被解释为受限于特定所示的区形状，而是包括由例如制造导致的形状上的偏差。例如，被示为矩形的植入区将通常在其边缘处具有倒圆角或弯曲的特征和/或植入浓度梯度，而不是从植入区到非植入区的二进制变化。相似地，通过植入形成的掩埋区可在掩埋区与供进行植入的表面之间的区中产生一些植入。因此，附图中所示的区本质上是示意性的，并且它们的形状不旨在示出装置的区的实际形状，并且不旨在限制。额外地，本领域普通技术人员将理解，所描述的实施方式可以以各种不同的方式进行修改，而均不背离本公开的精神或范围。
在详细描述中，为了解释的目的，阐述了许多具体细节以提供对各种实施方式的透彻理解。然而，显而易见的是，各种实施方式可在没有这些具体细节的情况下或者用一个或更多个等同布置的情况下实践。在其它实例中，公知的结构和装置以框图形式示出以避免不必要地混淆各种实施方式。
应理解，尽管术语“第一”、“第二”、“第三”等在本文中可用于描述各种元件、部件、区、层和/或部分，但是这些元件、部件、区、层和/或部分不应受这些术语限制。这些术语用于将一个元件、部件、区、层或者部分与另一元件、部件、区、层或者部分区分开。因此，下面所描述的第一元件、部件、区、层或者部分可被称为第二元件、部件、区、层或者部分，而不背离本公开的精神和范围。
应理解，当元件、层、区或部件被称为“在”另一元件、层、区或部件“上”、“连接到”或者“耦接到”另一元件、层、区或部件时，该元件、层、区或部件可直接在另一元件、层、区或部件上、直接连接到或者耦接到另一元件、层、区或部件，或者可存在有中间元件、层、区或部件。然而，“直接连接/直接耦接”是指在没有中间部件的情况下对另一部件进行直接连接或耦接的一个部件。与此同时，描述诸如“之间”、“紧邻”或“相邻”和“直接相邻”的部件之间的关系的其它表述可被相似地解释。另外，还应理解，当元件或层被称为在两个元件或层“之间”时，该元件或层可为两个元件或层之间的唯一元件或层，或者也可存在有一个或更多个中间元件或层。
本文中所使用的术语是仅出于描述特定实施方式的目的，而不旨在对本公开的限制。除非上下文中另有明确指示，否则如本文中所使用的单数形式“一(a)”和“一(an)”也旨在包括复数形式。还应理解，当术语“包括(comprise)”、“包括有(comprising)”、“具有(have)”、“具有(having)”、“包括(include)”和“包括有(including)”在本说明书中使用时，指示所陈述的特征、整体、步骤、操作、元件和/或部件的存在，但不排除一个或者更多个其它特征、整体、步骤、操作、元件、部件和/或其集群的存在或者添加。如本文中所使用的，术语“和/或”包括相关所列项目中的一个或更多个的任何和所有组合。
如本文所使用的，术语“基本上(substantially)”、“约(about)”、“大约(approximately)”以及相似术语用作近似的术语而不是程度的术语，并且旨在考虑本领域普通技术人员将认识到的测量值或计算值的固有偏差。考虑到有关测量和与特定数量的测量相关的误差(即，测量系统的限制)，本文所用的“约(about)”或者“大约(approximately)”包括在本领域普通技术人员确定的特定值的可接受偏差范围内的所述值和均数。例如，“约(about)”可意味着在一个或者更多个标准偏差内，或者在所述值的±30％、20％、10％、5％之内。此外，当描述本公开实施方式时，“可(may)”的使用是指“本公开的一个或更多个实施方式”。
当某个实施方式可以不同地实现时，具体工艺顺序可以与所描述的顺序不同地执行。例如，两个连续描述的工艺可基本上同时执行或者以与描述的顺序相反的顺序执行。
本文中所描述的根据本公开的实施方式的电子或电气装置和/或任何其它相关装置或部件可利用任何合适的硬件、固件(例如，专用集成电路)、软件，或者软件、固件和硬件的组合来实现。例如，这些装置的各种部件可形成在一个集成电路(IC)芯片上或形成在单独的IC芯片上。此外，这些装置的各种部件可实现在柔性印刷电路膜、带载封装(TCP)、印刷电路板(PCB)上或形成在一个衬底上。此外，这些装置的各种部件可为在一个或更多个计算装置中在一个或更多个处理器上运行，从而执行计算机程序指令以及与其它系统部件交互以执行本文中所描述的各种功能的进程或线程。计算机程序指令存储在存储器中，该存储器可使用标准存储装置(诸如例如随机存取存储器(RAM))实现在计算装置中。计算机程序指令也可存储在其它非暂时性计算机可读介质(诸如例如CD-ROM、闪存驱动器等)中。而且，本领域技术人员应该认识到，各种计算装置的功能可组合或集成到单个计算装置中，或者特定计算装置的功能可分布在一个或更多个其它计算装置上，而不背离本公开的实施方式的精神和范围。
除非另有限定，否则本文中所使用的所有术语(包括技术术语和科学术语)具有与本发明构思所属技术领域的普通技术人员通常理解的含义相同的含义。还应理解，除非在本文中明确地如此限定，否则诸如常用词典中限定的那些术语应被解释为具有与它们在相关技术和/或说明书的上下文中的含义一致的含义，并且不应以理想化或过于正式的含义来解释。
图1是用于示出根据本公开的实施方式的显示装置的图。
参照图1，根据本公开的实施方式的显示装置可包括扫描驱动器10、数据驱动器20、发射驱动器30、显示器40和时序控制器60。
时序控制器60可响应于外部同步供给的信号而生成数据驱动控制信号DCS、扫描驱动控制信号SCS和发光驱动控制信号ECS。由时序控制器60生成的数据驱动控制信号DCS可供给到数据驱动器20，扫描驱动控制信号SCS可供给到扫描驱动器10，并且发光驱动控制信号ECS可供给到发射驱动器30。
扫描驱动控制信号SCS可包括起始脉冲和时钟信号。起始脉冲控制扫描信号的第一时序。时钟信号可用于将起始脉冲或扫描信号移位到下一扫描级。
发光驱动控制信号ECS可包括起始脉冲和时钟信号。起始脉冲控制发光信号的第一时序。时钟信号可用于将起始脉冲或发光信号移位到下一发光级。
数据驱动控制信号DCS可包括源起始脉冲和时钟信号。源起始脉冲控制数据的采样起始时间。时钟信号可用于控制采样操作。
扫描驱动器10可从时序控制器60接收扫描驱动控制信号SCS。接收扫描驱动控制信号SCS的扫描驱动器10可将扫描信号供给到扫描线S1至Sn，其中，n可为大于零的整数。例如，扫描驱动器10可将导通电平的扫描脉冲顺序地供给到扫描线S1至Sn。当将扫描脉冲顺序地供给到扫描线S1至Sn时，可选择连接到相应的扫描线的像素50。
发射驱动器30可从时序控制器60接收发光驱动控制信号ECS。接收发光驱动控制信号ECS的发射驱动器30可将发光信号供给到发光线E1至En。例如，发射驱动器30可将关断电平的发光脉冲顺序地供给到发光线E1至En。该发光信号可用于控制像素50的发射时间。例如，接收发光信号的像素50可在供给关断电平的发光脉冲的时段期间被设置为非发光状态，并且可在其它时段期间被设置为发光状态。
数据驱动器20从时序控制器60接收数据驱动控制信号DCS。接收数据驱动控制信号DCS的数据驱动器20将数据信号供给到数据线D1至Dm，其中，m可为大于零的整数。供给到数据线D1至Dm的数据信号被供给到由扫描信号选择的像素50。出于此目的，数据驱动器20可将数据信号供给到数据线D1至Dm以与扫描信号同步。
显示器40包括连接到扫描线S1至Sn、数据线D1至Dm和发光线E1至En的像素50。显示器40可接收第一电源ELVDD和第二电源ELVSS。
像素50中的每个可包括发光二极管和发光晶体管。当发光晶体管导通时，发光晶体管可将驱动电流传输到发光二极管。发光二极管可发射与驱动电流对应的光(例如，可以以预定亮度发光)。
尽管图1示出了n个扫描线S1至Sn和n个发光线E1至En，但是本公开不限于此。例如，对应于其它实施方式中的像素50的电路结构，可在显示器40中额外地形成至少一个虚设扫描线和/或一个虚设发光控制线。
图2是用于示出根据本公开的实施方式的像素的图。
将参考图2对连接到第n扫描线Sn和第m数据线Dm的像素50进行描述。与图2中所示的像素50基本上相同的结构和驱动方法可应用于其它像素50。
参照图2，根据本公开的实施方式的像素50可包括发光二极管LD、晶体管T1、T2和T3和存储电容器Cst。
发光二极管LD的阳极可连接到晶体管T3的第二电极，并且发光二极管LD的阴极可连接到第二电源ELVSS。发光二极管LD可生成与从晶体管T1供给的驱动电流的量对应的光(例如，预定亮度的光)。发光二极管LD可由有机发光二极管或无机发光二极管形成。
晶体管T1的第一电极可连接到第一电源ELVDD，并且晶体管T1的第二电极可连接到晶体管T3的第一电极。另外，晶体管T1的栅电极可连接到节点N10。该晶体管T1可响应于节点N10的电压来控制从第一电源ELVDD经由晶体管T3和发光二极管LD流到第二电源ELVSS的驱动电流的量。晶体管T1可被称为驱动晶体管。
晶体管T2的第一电极可连接到第m数据线Dm，并且晶体管T2的第二电极可连接到节点N10。另外，晶体管T2的栅电极可连接到第n扫描线Sn。当将导通电平的扫描脉冲供给到第n扫描线Sn时，该晶体管T2导通，并且可将来自第m数据线Dm的数据信号供给到节点N10。晶体管T2可被称为扫描晶体管、开关晶体管等。
晶体管T3的第一电极可连接到晶体管T1的第二电极，并且晶体管T3的第二电极可连接到发光二极管LD的阳极。另外，晶体管T3的栅电极可连接到发光线En。当关断电平的发光脉冲被供给到发光线En时，该晶体管T3可被关断，并且当导通电平的发光脉冲被供给到发光线En时，该晶体管T3可被导通。晶体管T3可被称为发光晶体管。
在本公开的另一实施方式中，晶体管T3的第一电极可连接到第一电源ELVDD，并且晶体管T3的第二电极可连接到晶体管T1的第一电极。
当晶体管T3关断时，晶体管T1和发光二极管LD电断开，以使得像素50可被设置为非发光状态。当晶体管T3导通时，晶体管T1和发光二极管LD电连接，以使得像素50可被设置为能够发光的状态。
存储电容器Cst可连接在第一电源ELVDD与节点N10之间。存储电容器Cst可保持节点N10的电压。
应注意，像素50不限于图2中所示的实施方式。例如，在本公开的实施方式中，可在各种类型的电路中实现像素，其中发射时段可通过发光控制信号来控制。
在本公开的图2和其它图中，晶体管被示为P型晶体管(例如，PMOS)。因此，导通电平可为逻辑低电平，并且关断电平可为逻辑高电平。然而，本领域普通技术人员可通过用N型晶体管(例如，NMOS)替换至少一个晶体管来获得执行与所公开的实施方式相同的功能的电路。在这种实施方式中，导通电平变为逻辑高电平，并且关断电平变为逻辑低电平。
图3是用于示出根据本公开的实施方式的像素的驱动方法的图。
首先，在发光线En中可能出现关断电平的发光脉冲。因此，晶体管T3可被关断，并且发光二极管LD可被关断。
接着，可在第n扫描线Sn中出现导通电平的扫描脉冲。相应地，晶体管T2可被导通，并且此时施加到第m数据线Dm的数据信号DATAnm可传输到节点N10。存储电容器Cst可保持施加到节点N10的数据信号。
接着，可暂停施加发光线En的发光脉冲(例如，关断电平的发光脉冲)。相应地，导通电平的发光信号可施加到发光线En，并且晶体管T3可被导通。相应地，包括第一电源ELVDD、晶体管T1、晶体管T3、发光二极管LD和第二电源ELVSS的驱动电流路径可允许驱动电流流动。发光二极管LD可基于由存储电容器Cst保持的节点N10的电压而(例如，以预定的亮度)发光。
图4是用于示出根据本公开的实施方式的发射驱动器的图。为了更好地理解和描述的便利，图4示出了四个发光级ST1至ST4。
参照图4，根据本公开的实施方式的发射驱动器30可包括多个发光级ST1至ST4。发光级ST1至ST4可分别连接到对应的发光线E1至E4，并且可公共地连接到时钟线CLK1和CLK2。发光级ST1至ST4可具有基本上相同的电路结构。
发光级ST1至ST4中的每个可包括第一输入端子101、第二输入端子102、第三输入端子103和输出端子104。
第一输入端子101可接收前一(例如，紧前一)发光级的起始脉冲SSP或输出信号(例如，发光信号)。例如，第一发光级ST1的第一输入端子101可接收起始脉冲SSP，而其它发光级ST2至ST4的第一输入端子101可接收相应的前一发光级的发光信号。
第j发光级STj的第二输入端子102(j可为奇数或偶数)可连接到第一时钟线CLK1，并且其第三输入端子103可连接到第二时钟线CLK2。相反，第j+1发光级STj+1的第二输入端子102可连接到第二时钟线CLK2，并且其第三输入端子103可连接到第一时钟线CLK1。也就是说，第一时钟线CLK1和第二时钟线CLK2可分别交替地连接到发光级ST1至ST4的第二输入端子102和第三输入端子103。
施加到第一时钟线CLK1的第一时钟信号的脉冲和施加到第二时钟线CLK2的第二时钟信号的脉冲在时间上彼此不重叠。脉冲中的每个可为导通电平。
发光级ST1至ST4可接收第一电源VDD和第二电源VSS。第一电源VDD可设置为关断电平的电压，并且第二电源VSS可设置为导通电平的电压。电压电平可基于第一电源VDD和第二电源VSS中的一个来确定。
图5是用于示出根据本公开的实施方式的发光级的图。为了更好地理解和描述的便利，图5示出了两个发光级ST1和ST2。
参照图5，根据本公开的实施方式的第一发光级ST1可包括输入单元210、输出单元220、第一信号处理器230、第二信号处理器240、第三信号处理器250、第一稳定单元260。
输出单元220可响应于第一节点N1和第二节点N2的电压而将第一电源VDD或第二电源VSS的电压供给到输出端子104。出于此目的，输出单元220可包括第十晶体管M10和第十一晶体管M11。
第十晶体管M10可连接在第一电源VDD与输出端子104之间。另外，第十晶体管M10的栅电极可连接到第一节点N1。第十晶体管M10可响应于第一节点N1的电压而导通或关断。此处，当第十晶体管M10导通时，供给到输出端子104的第一电源VDD的电压可通过第一发光线E1而输出作为关断电平的发光信号。
第十一晶体管M11可连接在输出端子104与第二电源VSS之间。另外，第十一晶体管M11的栅电极可连接到第二节点N2。第十一晶体管M11可响应于第二节点N2的电压而导通或关断。此处，当第十一晶体管M11导通时，供给到输出端子104的第二电源VSS的电压可通过第一发光线E1而输出作为导通电平的发光信号。
输入单元210可响应于分别供给到第一输入端子101和第二输入端子102的信号来控制第三节点N3和第四节点N4的电压。出于此目的，输入单元210可包括第七晶体管M7、第八晶体管M8和第九晶体管M9。
第七晶体管M7可连接在第一输入端子101与第四节点N4之间。另外，第七晶体管M7的栅电极可连接到第二输入端子102。当导通电平的第一时钟信号供给到第二输入端子102时，第七晶体管M7可被导通以电连接第一输入端子101和第四节点N4。
第八晶体管M8可连接在第三节点N3与第二输入端子102之间。另外，第八晶体管M8的栅电极可连接到第四节点N4。该第八晶体管M8可响应于第四节点N4的电压而导通或关断。
第九晶体管M9可连接在第三节点N3与第二电源VSS之间。第九晶体管M9的栅电极可连接到第二输入端子102。当导通电平的第一时钟信号供给到第二输入端子102时，该第九晶体管M9可被导通以将第二电源VSS的电压供给到第三节点N3。
第一信号处理器230可响应于第二节点N2的电压来控制第一节点N1的电压。出于此目的，第一信号处理器230可包括第十二晶体管M12和第三电容器C3。
第十二晶体管M12可连接在第一电源VDD与第一节点N1之间。另外，第十二晶体管M12的栅电极可连接到第二节点N2。第十二晶体管M12可响应于第二节点N2的电压而导通或关断。
第三电容器C3可连接在第一电源VDD与第一节点N1之间。第三电容器C3可保持施加到第一节点N1的电压。
第二信号处理器240可连接到第五节点N5，并且可响应于供给到第三输入端子103的信号来控制第一节点N1的电压。出于此目的，第二信号处理器240可包括第五晶体管M5、第六晶体管M6、第一电容器C1和第二电容器C2。
第一电容器C1可连接在第二节点N2与第三输入端子103之间。第一电容器C1可保持第三输入端子103与第二节点N2之间的电压差。
第二电容器C2的第一端子可连接到第五节点N5，并且第二电容器C2的第二端子可连接到第五晶体管M5。
第五晶体管M5可连接在第二电容器C2的第二端子与第一节点N1之间。另外，第五晶体管M5的栅电极可连接到第三输入端子103。当第二时钟信号供给到第三输入端子103时，第五晶体管M5可被导通以将第二电容器C2的第二端子电连接到第一节点N1。
第六晶体管M6可连接在第二电容器C2的第二端子与第三输入端子103之间。另外，第六晶体管M6的栅电极可连接到第五节点N5。
第三信号处理器250可响应于第三节点N3的电压和供给到第三输入端子103的信号来控制第四节点N4的电压。出于此目的，第三信号处理器250可包括第三晶体管M3和第四晶体管M4。
第三晶体管M3和第四晶体管M4可串联连接在第一电源VDD与第四节点N4之间。第三晶体管M3的栅电极可连接到第三节点N3。另外，第四晶体管M4的栅电极可连接到第三输入端子103。
第一稳定单元260可连接在第二信号处理器240与输入单元210之间。第一稳定单元260可限制第三节点N3和第四节点N4的电压降宽度。第一稳定单元260可包括第一晶体管M1和第二晶体管M2。
第一晶体管M1可连接在第三节点N3与第五节点N5之间。另外，第一晶体管M1的栅电极可连接到第二电源VSS。第二晶体管M2可连接在第二节点N2与第四节点N4之间。另外，第二晶体管M2的栅电极可连接到第二电源VSS。
与此同时，除了供给到第一输入端子101、第二输入端子102和第三输入端子103的信号可为不同的(例如，施加到第二输入端子102和第三输入端子103的第一时钟信号和第二时钟信号可被切换)以外，第二发光级ST2可与第一发光级ST1基本上相同。因此，第二发光级ST2的重复描述将被省略。
图6是用于示出图5的发光级的驱动方法的图。
图6示出了参考第一发光级ST1的操作过程。
参照图6，第一时钟信号的脉冲和第二时钟信号的脉冲分别具有两个水平时段的周期，并且以不同的水平时段出现。例如，第二时钟信号的脉冲可为相对于第一时钟信号的脉冲移位了半个周期(例如，移位了一个水平时段1H)的信号。
供给到第一输入端子101的高电平的起始脉冲SSP设置为与供给到第二输入端子102的第一时钟信号的低电平的脉冲至少重叠一次。出于此目的，起始脉冲SSP可供给为具有比第一时钟信号更宽的宽度。例如，起始脉冲SSP可供给长达4个水平时段4H。另外，供给到第二发光级ST2的第一输入端子101的第一发光信号的脉冲P1可与供给到第二发光级ST2的第二输入端子102的第二时钟信号的低电平的脉冲重叠至少一次。
首先，在第一时间t1处，低电平的第一时钟信号供给到第二输入端子102。也就是说，在第一时钟信号处可能出现脉冲。因此，第七晶体管M7和第九晶体管M9可被导通。
当第七晶体管M7导通时，第一输入端子101和第四节点N4可电连接。此处，因为第二晶体管M2保持在导通状态，因此第一输入端子101可经由第四节点N4电连接到第二节点N2。在第一时间t1期间，高电平的起始脉冲SSP不被供给到第一输入端子101，以使得低电平的电压(例如，VSS)可被供给到第四节点N4和第二节点N2。
当低电平的电压施加到第二节点N2和第四节点N4时，第八晶体管M8、第十一晶体管M11和第十二晶体管M12可被导通。
当第十二晶体管M12导通时，第一电源VDD的电压被供给到第一节点N1，以使得第十晶体管M10可被关断。
当第十一晶体管M11导通时，第二电源VSS的电压可供给到输出端子104。因此，在第一时间t1处，低电平的发光信号可供给到第一发光线E1。
当第八晶体管M8导通时，第一时钟信号被供给到第三节点N3。此处，因为第一晶体管M1保持在导通状态，因此第一时钟信号可经由第三节点N3供给到第五节点N5。
与此同时，当第九晶体管M9导通时，第二电源VSS的电压被供给到第三节点N3和第五节点N5。此处，第一时钟信号可为低电平，以使得第三节点N3和第五节点N5可被稳定地充电到第二电源VSS的电压。因此，第三晶体管M3和第六晶体管M6被导通。
当第六晶体管M6导通时，高电平(例如，第一电源VDD)的第二时钟信号从第三输入端子103供给到第二电容器C2的第二端子。此时，因为第五晶体管M5处于关断状态，因此不管第五节点N5和第二电容器C2的第二端子的电压如何，第一节点N1可保持第一电源VDD的电压。
当第三晶体管M3导通时，第一电源VDD的电压可供给到第四晶体管M4。此时，第四晶体管M4处于关断状态，以使得第四节点N4可保持低电平。
在第二时间t2处，高电平的第一时钟信号被供给到第二输入端子102。也就是说，第一时钟信号的脉冲可暂停。因此，第七晶体管M7和第九晶体管M9可被关断。此时，第二节点N2和第一节点N1可通过第一电容器C1和第三电容器C3保持先前的电压，并且第八晶体管M8、第十一晶体管M11和第十二晶体管M12可保持导通状态。
当第八晶体管M8导通时，高电平的第一时钟信号从第二输入端子102供给到第三节点N3和第五节点N5。因此，第三晶体管M3和第六晶体管M6设置为关断状态。
在第三时间t3处，低电平的第二时钟信号供给到第三输入端子103。也就是说，第二时钟信号的脉冲出现/开始。因此，第四晶体管M4和第五晶体管M5被导通。
当第五晶体管M5导通时，第二电容器C2的第二端子电连接到第一节点N1。此时，因为第十二晶体管M12处于导通状态，因此第一节点N1保持第一电源VDD的电压。
当第四晶体管M4导通时，第三晶体管M3的第二电极和第二节点N2被电连接。此时，因为第三晶体管M3处于关断状态，因此第一电源VDD的电压不供给到第四节点N4和第二节点N2。
当低电平的第二时钟信号被供给到第三输入端子103时，由于第一电容器C1的耦接，第二节点N2下降到比第二电源VSS更低的电压。相应地，施加到第十一晶体管M11和第十二晶体管M12的栅电极的电压低于第二电源VSS，从而改善了晶体管的驱动特性。
第四节点N4可能因第二晶体管M2而保持第二电源VSS的电压(例如，低电平的电压)，而不管第二节点N2的电压降如何。也就是说，因为第二电源VSS的电压持续地施加到第二晶体管M2的栅电极，因此与第二晶体管M2的源电极对应的第四节点N4的电压不会下降到通过将阈值电压添加到第二电源VSS的电压而获得的值以下。因此，第七晶体管M7的第一电极和第二电极之间的电压差减小或最小化，从而防止第七晶体管M7的特性改变。
在第四时间t4处，高电平的起始脉冲SSP被供给到第一输入端子101，并且低电平的第一时钟信号被供给到第二输入端子102。也就是说，在第一时钟信号中出现新的脉冲。因此，第七晶体管M7和第九晶体管M9被导通。
当第七晶体管M7导通时，第一输入端子101电连接到第四节点N4和第二节点N2。因此，第四节点N4和第二节点N2被充电到高电平的电压，并且第八晶体管M8、第十一晶体管M11和第十二晶体管M12被关断。
当第九晶体管M9导通时，第二电源VSS的电压被供给到第三节点N3和第五节点N5，并且第三晶体管M3和第六晶体管M6被导通。此时，即使第三晶体管M3导通，因为第四晶体管M4处于关断状态，因此第四节点N4的电压被保持。
当第六晶体管M6导通时，第二电容器C2的第二端子和第三输入端子103电连接。此时，因为第五晶体管M5处于关断状态，因此第一节点N1保持高电平。
在第五时间t5处，低电平的第二时钟信号被供给到第三输入端子103。也就是说，在第二时钟信号中出现新的脉冲P1s。因此，第四晶体管M4和第五晶体管M5被导通。此时，第三节点N3和第五节点N5用第二电源VSS的电压充电，以使得第三晶体管M3和第六晶体管M6被导通。
低电平的第二时钟信号经由导通的第五晶体管M5和第六晶体管M6被施加到第一节点N1，且然后第十晶体管M10被导通。当第十晶体管M10导通时，第一电源VDD的电压作为发光信号而被供给到输出端子104。因此，高电平的发光信号可供给到第一发光线E1。
当第三晶体管M3和第四晶体管M4被导通时，第二电源VDD的电压被供给到第四节点N4和第二节点N2。因此，第八晶体管M8和第十一晶体管M11可稳定地保持关断状态。
与此同时，当低电平的第二时钟信号被供给到第二电容器C2的第二端子时，由于第二电容器C2的耦接，第五节点N5的电压下降到比第二电源VSS更低的电压。相应地，施加到第六晶体管M6的栅电极的电压下降到比第二电源VSS更低的电压，并且可改善第六晶体管M6的驱动特性。
不管由于第一晶体管M1导致的第五节点N5的电压如何，第三节点N3的电压都可大致保持第二电源VSS的电压。也就是说，因为第二电源VSS的电压持续地施加到第一晶体管M1的栅电极，因此与第一晶体管M1的源电极对应的第三节点N3的电压不会下降到通过将阈值电压添加到第二电源VSS的电压而获得的值以下。因此，不管第五节点N5的电压降如何，第三节点N3均可大致保持第二电源VSS的电压。在这种情况下，第八晶体管M8的源电极和漏电极之间的电压差减小或最小化，从而防止第八晶体管M8的特性改变。
在第六时间t6处，低电平的第一时钟信号被供给到第二输入端子102。也就是说，在第一时钟信号中可能出现新的脉冲P1e。因此，第七晶体管M7和第九晶体管M9被导通。
当第七晶体管M7导通时，第四节点N4和第二节点N2电连接到第一输入端子101，以使得第一输入端子101的低电平的电压被供给到第四节点N4和第二节点N2。因此，第八晶体管M8、第十一晶体管M11和第十二晶体管M12被导通。
当第八晶体管M8导通时，低电平的第一时钟信号被供给到第三节点N3和第五节点N5。
当第十二晶体管M12导通时，第一电源VDD的电压被供给到第一节点N1，且然后第十晶体管M10被关断。
当第十一晶体管M11导通时，第二电源VSS的电压被供给到输出端子104。因此，低电平的发光信号可被供给到第一发光线E1。
与此同时，从第一发光级ST1的输出端子104接收发光信号的第二发光级ST2在重复上述步骤期间将发光信号供给到第二发光线E2。也就是说，根据本公开的实施方式的发光级ST可在重复上述过程期间将发光信号供给到发光线E1至En。
如上所述，施加到第一发光线E1的发光信号的第一脉冲P1的产生时间与施加到第三输入端子103的第二时钟信号的脉冲P1s同步，并且发光信号的第一脉冲P1的消光时间与施加到第二输入端子102的第一时钟信号的脉冲P1e同步。
相似地，施加到第二发光线E2的发光信号的第二脉冲P2的产生时间与施加到第三输入端子103的第一时钟信号的脉冲P2s同步，并且施加到第二发光线E2的发光信号的第二脉冲P2的消光时间与施加到第二输入端子102的第二时钟信号的脉冲P2e同步。
另外，施加到第三发光线E3的发光信号的第三脉冲P3的产生时间与施加到第三输入端子103的第二时钟信号的脉冲P3s同步，并且施加到第三发光线E3的发光信号的第三脉冲P3的消光时间与施加到第二输入端子102的第一时钟信号的脉冲P3e同步。
也就是说，如上所述，因为限定发光信号的脉冲P1、P2和P3的产生时间和消光时间的时钟信号的脉冲彼此不同，因此可看出发光信号的脉冲P1、P2和P3的产生时间和消光时间可通过控制时钟信号的脉冲的时序来独立地控制。
第一脉冲P1和第二脉冲P2的产生时间之间的间隔可与第二脉冲P2和第三脉冲P3的产生时间之间的间隔相同。例如，第一脉冲P1和第二脉冲P2的产生时间之间的间隔可为1个水平时段1H，并且第二脉冲P2和第三脉冲P3的产生时间之间的间隔也可为1个水平时段1H。
另外，第一脉冲P1和第二脉冲P2的消光时间之间的间隔可与第二脉冲P2和第三脉冲P3的消光时间之间的间隔相同。例如，第一脉冲P1和第二脉冲P2的消光时间之间的间隔可为1个水平时段1H，第二脉冲P2和第三脉冲P3的消光时间之间的间隔可为1个水平时段1H。
在这种情况下，发光信号的转变点具有特定时段(例如，1个水平时段)，并且产生与该时段对应的频率的电磁干扰(EMI)噪声。例如，在以60Hz的频率驱动具有2160个像素行的超高清(UHD)显示装置的情况下，在每个发光线中以1/60*(1/2160)秒的周期出现从高电平到低电平的转变，并且显示装置可能在作为周期的倒数的129.6KHz的频率处具有噪声峰值。
图7是用于示出根据本公开的第一实施方式的发光级的图。
参照图7，图7的发光级与图5的发光级ST1和ST2的不同之处在于第一时钟线CLK1'和第二时钟线CLK2'分别连接到发光级ST11和ST12的第二输入端子102。
也就是说，图7的发射驱动器30使用四个时钟线CLK1、CLK2、CLK1'和CLK2'。如图6中所示，施加到每个发光级的第三输入端子103的时钟信号限定了对应的发光信号的脉冲的产生时间，并且施加到第二输入端子102的时钟信号限定了对应的发光信号的脉冲的消光或结束。
在本公开的实施方式中，施加到与相应的第三输入端子103连接的时钟线CLK1和CLK2的时钟信号的脉冲的时序可与图6中所示的时序相同。因此，发光信号的脉冲的产生时间可与图6中所示的产生时间相同。
然而，根据本公开的实施方式，通过控制施加到与相应的第二输入端子102连接的时钟线CLK1'和CLK2'的时钟信号的脉冲的时序，发光信号的脉冲的消光时间可被控制。
图8是用于示出根据本公开的第一实施方式的发光级的驱动方法的图。
在第一实施方式中，第一脉冲P11和第二脉冲P12的产生时间之间的间隔与第二脉冲P12和第三脉冲P13的产生时间之间的间隔相同。例如，第一脉冲P11和第二脉冲P12的产生时间之间的间隔以及第二脉冲P12和第三脉冲P13的产生时间之间的间隔可为一个水平时段1H。
另外，第一脉冲P11和第二脉冲P12的消光时间之间的间隔“a”不同于第二脉冲P12和第三脉冲P13的消光时间之间的间隔“b”。例如，第一脉冲P11和第二脉冲P12的消光时间之间的间隔“a”可比第二脉冲P12和第三脉冲P13的消光时间之间的间隔“b”更短。例如，第一脉冲P11和第二脉冲P12的消光时间之间的间隔“a”可小于一个水平时段1H。此时，第二脉冲P12和第三脉冲P13的消光时间之间的间隔“b”可大于一个水平时段1H。
然而，如在图6的驱动方法中所描述的，在控制第一时钟信号和第二时钟信号的脉冲的时序方面可能存在一些限制。例如，第一时钟信号的脉冲不能与在时间上最接近的第二时钟信号的脉冲重叠。另外，第二时钟信号的脉冲不能与在时间上最接近的第一时钟信号的脉冲重叠。当重叠时，高电压和低电压可同时施加到相同的节点。
因此，如果第一时钟信号和第二时钟信号的脉冲具有恒定的宽度PW，则间隔“a”可在PW＜a＜1H的范围内。例如，限定间隔“a”的脉冲P2e可出现得比图6的实施方式中的更早，然而间隔“a”大于脉冲P1e的宽度PW，以使得脉冲P2e不与脉冲P1e重叠。
此外，间隔“b”可确定在1H＜b＜2H-PW+(1H-a)的范围内。例如，限定间隔“b”的脉冲P3e可出现得比图6的实施方式中的更晚，然而间隔“b”小于2H-PW，由此使得脉冲P3e不与第二时钟信号的下一个最相邻的脉冲重叠。然而，随着第二脉冲P12的消光时间变得更快，余量值(1H-a)可进一步添加到间隔“b”。
因为第四发光线E4、第五发光线E5和第六发光线E6的发光信号的脉冲P14、P15和P16可调节为分别具有与第一发光线E1、第二发光线E2和第三发光线E3的脉冲P11、P12和P13相同的形状，因此重复的描述将被省略。
通过与间隔“a”的情况相似的方式，第三脉冲P13和第四脉冲P14的消光时间之间的间隔“c”可在PW＜c＜1H的范围内。
根据本公开的实施方式，因为发光信号的下降转变时间的周期不为恒定的，因此可能具有EMI噪声被分散在各种频率处并且噪声峰值被降低的优点。
在本公开的另一实施方式中，第一脉冲P11和第二脉冲P12的消光时间之间的间隔可比第二脉冲P12和第三脉冲P13的消光时间之间的间隔更长。本公开的另一实施方式也可通过控制施加到时钟线CLK1'和CLK2'的时钟信号的脉冲的时序来实现，并且可实现与上述效果基本上相同的效果。
图9是用于示出根据本公开的另一实施方式的发光级的图。
参照图9，发光级ST21和ST22与图5的发光级ST1和ST2的不同之处在于第一时钟线CLK1'和第二时钟线CLK2'分别连接到发光级ST21和ST22的第三输入端子103。
也就是说，图9的发射驱动器30使用四个时钟线CLK1、CLK2、CLK1'和CLK2'。如图6中所示，施加到每个发光级的第三输入端子103的时钟信号限定了对应的发光信号的脉冲的产生时间，并且施加到第二输入端子102的时钟信号限定了对应的发光信号的脉冲的消光。
在本公开的实施方式中，施加到与第二输入端子102连接的时钟线CLK1和CLK2的时钟信号的脉冲的时序可与图6中所示的时序相同。因此，发光信号的脉冲的产生时间可与图6中所示的消光时间相同。
然而，通过控制施加到与第三输入端子103连接的时钟线CLK1'和CLK2'的时钟信号的脉冲的时序，发光信号的脉冲的产生时间可被控制。
图10是用于示出根据本公开的另一实施方式的发光级的驱动方法的图。
参照图10，第一脉冲P21和第二脉冲P22的消光时间之间的间隔与第二脉冲P22和第三脉冲P23的消光时间之间的间隔相同。例如，第一脉冲P21和第二脉冲P22的消光时间之间的间隔以及第二脉冲P22和第三脉冲P23的消光时间之间的间隔可为一个水平时段1H。
然而，在本实施方式中，第一脉冲P21和第二脉冲P22的产生时间之间的间隔不同于第二脉冲P22和第三脉冲P23的产生时间之间的间隔。例如，第一脉冲P21和第二脉冲P22的产生时间之间的间隔可比第二脉冲P22和第三脉冲P23的产生时间之间的间隔更短。例如，第一脉冲P21和第二脉冲P22的产生时间之间的间隔“d”可小于一个水平时段1H。此时，第二脉冲P22和第三脉冲P23的产生时间之间的间隔“e”可大于一个水平时段1H。
然而，如在图6的驱动方法中所描述的，在控制第一时钟信号和第二时钟信号的脉冲的时序方面可能存在一些限制。例如，间隔“d”可在PW＜d＜1H的范围内，间隔“e”可在1H＜e＜2H-PW+(1H-d)的范围内，并且间隔“f”可在PW＜f＜1H的范围内。其重复描述将被省略。
因为第四发光线E4、第五发光线E5和第六发光线E6的发光信号的脉冲P24、P25和P26可调节为分别具有与第一发光线E1、第二发光线E2和第三发光线E3的脉冲P21、P22和P23相同的形状，因此重复的描述将被省略。
根据本公开的实施方式，因为发光信号的上升转变时间的周期不为恒定的，因此具有EMI噪声被分散在各种频率处并且噪声峰值被降低的优点。
相反，在本公开的另一实施方式中，第一脉冲P21和第二脉冲P22的消光时间之间的间隔可比第二脉冲P22和第三脉冲P23的消光时间之间的间隔更长。本公开的另一实施方式也可通过控制施加到时钟线CLK1'和CLK2'的时钟信号的脉冲的时序来实现，并且可实现与上述效果基本上相同的效果。
图11是用于示出根据本公开的另一实施方式的发光级的驱动方法的图。
在本实施方式中，第一脉冲P31和第二脉冲P32的产生时间之间的间隔不同于第二脉冲P32和第三脉冲P33的产生时间之间的间隔。另外，第一脉冲P31和第二脉冲P32的消光时间之间的间隔不同于第二脉冲P32和第三脉冲P33的消光时间之间的间隔。此时，第一发光级和第三发光级可为与第二发光级最接近的发光级。
在本实施方式中，脉冲P31至P36的消光时间与关于图8描述的消光时间相似，并且脉冲P31至P36的产生时间与关于图10描述的产生时间相似。
根据本公开的实施方式，因为发光信号的上升转变时间和下降转变时间的周期不为恒定的，因此具有EMI噪声被分散在各种频率处并且噪声峰值可被降低的优点。
本公开的附图和描述旨在是说明性的，它们并不用于限制权利要求书中描述的本公开的含义或范围，而仅用于解释本公开。相应地，本领域普通技术人员将从以上将理解到，各种修改和其它等效实施方式也是可能的。因此，本公开的真实保护范围应由所附的权利要求书的技术范围来确定，并且其功能等同物也应包括在其中。
附图标记说明
10：扫描驱动器 20：数据驱动器 30：发射驱动器
40：显示器 50：像素 60：时序控制器

Claims (20)

1.一种显示装置，包括：
第一像素，所述第一像素包括第一发光二极管和第一发光晶体管，当所述第一发光晶体管导通时，所述第一发光晶体管将驱动电流传输到所述第一发光二极管；
第二像素，所述第二像素包括第二发光二极管和第二发光晶体管，当所述第二发光晶体管导通时，所述第二发光晶体管将驱动电流传输到所述第二发光二极管；
第三像素，所述第三像素包括第三发光二极管和第三发光晶体管，当所述第三发光晶体管导通时，所述第三发光晶体管将驱动电流传输到所述第三发光二极管；
第一发光级，所述第一发光级配置成将包括处于关断电平的第一脉冲的第一发光信号施加到所述第一发光晶体管的栅电极；
第二发光级，所述第二发光级配置成将包括处于关断电平的第二脉冲的第二发光信号施加到所述第二发光晶体管的栅电极；以及
第三发光级，所述第三发光级配置成将包括处于关断电平的第三脉冲的第三发光信号施加到所述第三发光晶体管的栅电极，
其中，所述第一脉冲和所述第二脉冲的产生时间之间的间隔与所述第二脉冲和所述第三脉冲的产生时间之间的间隔相同，以及
其中，所述第一脉冲和所述第二脉冲的消光时间之间的间隔与所述第二脉冲和所述第三脉冲的消光时间之间的间隔不同。
2.如权利要求1所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述消光时间之间的所述间隔短于所述第二脉冲和所述第三脉冲的所述消光时间之间的所述间隔。
3.如权利要求1所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述消光时间之间的所述间隔长于所述第二脉冲和所述第三脉冲的所述消光时间之间的所述间隔。
4.如权利要求2所述的显示装置，其中，所述第一发光级、所述第二发光级和所述第三发光级配置成接收第一时钟信号和第二时钟信号，
其中，所述第一脉冲的所述产生时间与所述第二时钟信号的脉冲同步，
其中，所述第一脉冲的所述消光时间与所述第一时钟信号的脉冲同步，
其中，所述第二脉冲的所述产生时间与所述第一时钟信号的脉冲同步，
其中，所述第二脉冲的所述消光时间与所述第二时钟信号的脉冲同步，
其中，所述第三脉冲的所述产生时间与所述第二时钟信号的脉冲同步，以及
其中，所述第三脉冲的所述消光时间与所述第一时钟信号的脉冲同步。
5.如权利要求4所述的显示装置，其中，与所述第一脉冲、所述第二脉冲和所述第三脉冲的所述产生时间和所述消光时间同步的所述第一时钟信号和所述第二时钟信号的所述脉冲彼此不同。
6.一种显示装置，包括：
第一像素，所述第一像素包括第一发光二极管和第一发光晶体管，当所述第一发光晶体管导通时，所述第一发光晶体管将驱动电流传输到所述第一发光二极管；
第二像素，所述第二像素包括第二发光二极管和第二发光晶体管，当所述第二发光晶体管导通时，所述第二发光晶体管将驱动电流传输到所述第二发光二极管；
第三像素，所述第三像素包括第三发光二极管和第三发光晶体管，当所述第三发光晶体管导通时，所述第三发光晶体管将驱动电流传输到所述第三发光二极管；
第一发光级，所述第一发光级配置成将包括处于关断电平的第一脉冲的第一发光信号施加到所述第一发光晶体管的栅电极；
第二发光级，所述第二发光级配置成将包括处于关断电平的第二脉冲的第二发光信号施加到所述第二发光晶体管的栅电极；以及
第三发光级，所述第三发光级配置成将包括处于关断电平的第三脉冲的第三发光信号施加到所述第三发光晶体管的栅电极，
其中，所述第一脉冲和所述第二脉冲的产生时间之间的间隔与所述第二脉冲和所述第三脉冲的产生时间之间的间隔不同，以及
其中，所述第一脉冲和所述第二脉冲的消光时间之间的间隔与所述第二脉冲和所述第三脉冲的消光时间之间的间隔相同。
7.如权利要求6所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述产生时间之间的所述间隔短于所述第二脉冲和所述第三脉冲的所述产生时间之间的所述间隔。
8.如权利要求6所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述产生时间之间的所述间隔长于所述第二脉冲和所述第三脉冲的所述产生时间之间的所述间隔。
9.如权利要求7所述的显示装置，其中，所述第一发光级、所述第二发光级和所述第三发光级配置成接收第一时钟信号和第二时钟信号，
其中，所述第一脉冲的所述产生时间与所述第二时钟信号的脉冲同步，
其中，所述第一脉冲的所述消光时间与所述第一时钟信号的脉冲同步，
其中，所述第二脉冲的所述产生时间与所述第一时钟信号的脉冲同步，
其中，所述第二脉冲的所述消光时间与所述第二时钟信号的脉冲同步，
其中，所述第三脉冲的所述产生时间与所述第二时钟信号的脉冲同步，以及
其中，所述第三脉冲的所述消光时间与所述第一时钟信号的脉冲同步。
10.如权利要求9所述的显示装置，其中，分别与所述第一脉冲、所述第二脉冲和所述第三脉冲的所述产生时间和所述消光时间同步的所述第一时钟信号和所述第二时钟信号的所述脉冲彼此不同。
11.一种显示装置，包括：
第一像素，所述第一像素包括第一发光二极管和第一发光晶体管，当所述第一发光晶体管导通时，所述第一发光晶体管将驱动电流传输到所述第一发光二极管；
第二像素，所述第二像素包括第二发光二极管和第二发光晶体管，当所述第二发光晶体管导通时，所述第二发光晶体管将驱动电流传输到所述第二发光二极管；
第三像素，所述第三像素包括第三发光二极管和第三发光晶体管，当所述第三发光晶体管导通时，所述第三发光晶体管将驱动电流传输到所述第三发光二极管；
第一发光级，所述第一发光级配置成将包括处于关断电平的第一脉冲的第一发光信号施加到所述第一发光晶体管的栅电极；
第二发光级，所述第二发光级配置成将包括处于关断电平的第二脉冲的第二发光信号施加到所述第二发光晶体管的栅电极；以及
第三发光级，所述第三发光级配置成将包括处于关断电平的第三脉冲的第三发光信号施加到所述第三发光晶体管的栅电极，
其中，所述第一脉冲和所述第二脉冲的产生时间之间的间隔与所述第二脉冲和所述第三脉冲的产生时间之间的间隔不同，
其中，所述第一脉冲和所述第二脉冲的消光时间之间的间隔与所述第二脉冲和所述第三脉冲的消光时间之间的间隔不同，以及
其中，所述第一发光级和所述第三发光级为与所述第二发光级最接近的发光级。
12.如权利要求11所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述消光时间之间的所述间隔短于所述第二脉冲和所述第三脉冲的所述消光时间之间的所述间隔。
13.如权利要求12所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述产生时间之间的所述间隔短于所述第二脉冲和所述第三脉冲的所述产生时间之间的所述间隔。
14.如权利要求13所述的显示装置，其中，所述第一发光级、所述第二发光级和所述第三发光级配置成接收第一时钟信号和第二时钟信号，
其中，所述第一脉冲的所述产生时间与所述第二时钟信号的脉冲同步，
其中，所述第一脉冲的所述消光时间与所述第一时钟信号的脉冲同步，
其中，所述第二脉冲的所述产生时间与所述第一时钟信号的脉冲同步，
其中，所述第二脉冲的所述消光时间与所述第二时钟信号的脉冲同步，
其中，所述第三脉冲的所述产生时间与所述第二时钟信号的脉冲同步，以及
其中，所述第三脉冲的所述消光时间与所述第一时钟信号的脉冲同步。
15.如权利要求14所述的显示装置，其中，分别与所述第一脉冲、所述第二脉冲和所述第三脉冲的所述产生时间和所述消光时间同步的所述第一时钟信号和所述第二时钟信号的所述脉冲彼此不同。
16.如权利要求11所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述消光时间之间的所述间隔长于所述第二脉冲和所述第三脉冲的所述消光时间之间的所述间隔。
17.如权利要求16所述的显示装置，其中，所述第一脉冲和所述第二脉冲的所述产生时间之间的所述间隔长于所述第二脉冲和所述第三脉冲的所述产生时间之间的所述间隔。
18.如权利要求17所述的显示装置，其中，所述第一发光级、所述第二发光级和所述第三发光级配置成接收第一时钟信号和第二时钟信号，
其中，所述第一脉冲的所述产生时间与所述第一时钟信号的脉冲同步，
其中，所述第一脉冲的所述消光时间与所述第二时钟信号的脉冲同步，
其中，所述第二脉冲的所述产生时间与所述第二时钟信号的脉冲同步，
其中，所述第二脉冲的所述消光时间与所述第一时钟信号的脉冲同步，
其中，所述第三脉冲的所述产生时间与所述第一时钟信号的脉冲同步，以及
其中，所述第三脉冲的所述消光时间与所述第二时钟信号的脉冲同步。
19.如权利要求18所述的显示装置，其中，分别与所述第一脉冲、所述第二脉冲和所述第三脉冲的所述产生时间和所述消光时间同步的所述第一时钟信号和所述第二时钟信号的所述脉冲彼此不同。
20.如权利要求17所述的显示装置，其中，所述第一脉冲、所述第二脉冲和所述第三脉冲中的每个的宽度相同。
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