CN111211783B - 双反馈回路噪声整形过采样逐次逼近模数转换器及方法 - Google Patents
双反馈回路噪声整形过采样逐次逼近模数转换器及方法 Download PDFInfo
- Publication number
- CN111211783B CN111211783B CN202010098117.3A CN202010098117A CN111211783B CN 111211783 B CN111211783 B CN 111211783B CN 202010098117 A CN202010098117 A CN 202010098117A CN 111211783 B CN111211783 B CN 111211783B
- Authority
- CN
- China
- Prior art keywords
- digital
- voltage
- capacitor
- analog converter
- converter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/34—Analogue value compared with reference values
- H03M1/38—Analogue value compared with reference values sequentially only, e.g. successive approximation type
- H03M1/46—Analogue value compared with reference values sequentially only, e.g. successive approximation type with digital/analogue converter for supplying reference values to converter
- H03M1/462—Details of the control circuitry, e.g. of the successive approximation register
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/06—Continuously compensating for, or preventing, undesired influence of physical parameters
- H03M1/0617—Continuously compensating for, or preventing, undesired influence of physical parameters characterised by the use of methods or means not specific to a particular type of detrimental influence
- H03M1/0626—Continuously compensating for, or preventing, undesired influence of physical parameters characterised by the use of methods or means not specific to a particular type of detrimental influence by filtering
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/124—Sampling or signal conditioning arrangements specially adapted for A/D converters
- H03M1/1245—Details of sampling arrangements or methods
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
公开了双反馈回路的噪声整形过采样逐次逼近模数转换器及控制方法,逐次逼近模数转换器中,电容型数模转换器经由切换在其上极板产生余量电压,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,无源环路滤波器经由电压缓冲器连接电容型数模转换器的下极板,电容型数模转换器的上极板通过积分电容连接比较器形成双回路反馈结构,比较器将输入电压信号与无源环路滤波器的输出电压信号的加和信号量化成数字码,基于数字码控制电容型数模转换器切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束。
Description
技术领域
本发明涉及集成电路技术领域,特别是一种具有双反馈回路的噪声整形过采样逐次逼近模数转换器及控制方法。
背景技术
现实世界中绝大多数信号都是模拟信号,模数转换器(ADC)用于将自然界中的模拟信号转换为数字信号。随着集成电路工艺节点飞速进步,逐次逼近(SAR)ADC凭借着结构简单以及与工艺适配性优良等优势逐渐成为ADC研究领域近些年来的研究热点。但随着对ADC有效位数需求的日渐提高,传统SAR ADC由于受到比较器噪声以及内部模数转换器(DAC)噪声的限制,精度往往很难超过12位。因此,高精度、低成本的噪声整形SAR ADC是近年来发展出的一种新型混合ADC结构。通过将∑ΔADC中的噪声整形技术和过采样技术应用在SAR ADC中,从而提高SAR ADC的有效位数。
目前的噪声整形SAR ADC有些使用的是基于运放的有源积分器,因此功耗较高而且运放的性能随工艺、电压和温度(PVT)变化较大。而纯无源的噪声整形结构虽然功耗大大降低,但是因为无源积分器以及多输入比较器的使用,增加了噪声源的数量并会带来额外的信号衰减,因此噪声整形效果往往有限。
在背景技术部分中公开的上述信息仅仅用于增强对本发明背景的理解,因此可能包含不构成本领域普通技术人员公知的现有技术的信息。
发明内容
鉴于上述问题,本发明的目的就是为了克服上述现有技术存在的缺陷而提供一种双反馈回路噪声整形过采样逐次逼近模数转换器及控制方法,其通过多环路反馈,从而实现更加优化的噪声整形效果。其次,该结构避免了使用多输入比较器所带来的额外噪声,利用两个余量采集电容的乒乓切换,在实现噪声整形的同时,相较于传统SAR ADC不增加额外的时钟周期,从而在保证SAR ADC信噪比的同时,加快了ADC的工作速度。
本发明的目的是通过以下技术方案予以实现。
一种双反馈回路噪声整形过采样逐次逼近模数转换器包括,
电容型数模转换器,其经由切换在其上极板产生余量电压,
无源环路滤波器,其配置成对所述余量电压噪声整形,其中,其包括存储余量电压的第一余量采集电容和第二余量采集电容以及用于实现无源增益的积分电容,其中,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连所述电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,第一余量采集电容和第二余量采集电容与积分电容相连形成无源积分器输出无源环路滤波器的输出电压,
电压缓冲器,其分别连接所述无源环路滤波器和电容型数模转换器以将所述输出电压连接到电容型数模转换器的下极板,
比较器,比较器的输入端经由所述积分电容与电容型数模转换器的上极板相连,其中,无源环路滤波器经由电压缓冲器连接电容型数模转换器的下极板,电容型数模转换器的上极板通过积分电容连接比较器形成双回路反馈结构,比较器将输入电压的信号与来自无源环路滤波器输出的电压信号的加和信号量化成数字码,
SAR逻辑数字电路,其输入端连接所述比较器的输出端,基于所述数字码控制电容型数模转换器切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,第一余量采集电容和第二余量采集电容进行乒乓操作,以在下一次采样周期内完成无源积分器积分。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,电压缓冲器包括全差分电压缓冲器或电压源随器。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,电压缓冲器包括由晶体管M0、M1、M2、M3构成一个二极管作负载的五管单元、M4、M5、M6、M7作为运放的第二级放大器和用于确定第二级放大器的输出共模电压的电阻R0,其中M4、M5和前级M2、M3构成比例为1:M的电流镜。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,逐次逼近模数转换器的每个周期分为采样阶段φs和转换阶段φr,第一余量采集电容和第二余量采集电容响应于φ1和φ2交替轮转,第n个转换周期,当φs、φ1为高时,开关S1导通,电容型数模转换器和第一余量采集电容作为采样电容对输入电压采样,采样时,φs1为高电平,开关S6导通,第二余量采集电容与积分电容相连构成无源积分器,对第二余量采集电容上存储的上一个周期的余量电压Vres(n-1)进行积分产生输出电压,其中,φs为高电平,开关S7导通,积分后的输出电压通过电压缓冲器与电容型数模转换器下极板相连,等到φs、φs1为低时,开关S1、S7、S6、S8断开,电容型数模转换器上存储的电压为输入电压和电压缓冲器的输出电压之和。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,φr为高,电容型数模转换器的下极板切到共模电压,开关S2导通,电容型数模转换器的上极板的电压信号通过积分电容输入比较器,比较器输入端的电压为输入电压和2倍的无源环路滤波器的输出电压之和,比较器开始比较并输出数字码,当所有数字码完成输出后,电容型数模转换器和第一余量采集电容的上极板剩余电压即为本周期的电压余量。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,进入第n+1个周期,φ2为高,第一余量采集电容和第二余量采集电容交换,再次进行上述操作。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,电容型数模转换器包括电容阵列和采样开关S1。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器中,在逐次逼近模数转换器完成当前量化周期的最后一位量化后,产生的数字码通过SAR逻辑控制电路来控制电容型数模转换器额外进行一次开关切换,在电容型数模转换器上极板上得到本周期的余量电压,通过无源积分器对余量电压进行一阶积分且将积分后的电压分别通过电压缓冲器和比较器反馈。
本发明另一方面,一种双反馈回路噪声整形过采样逐次逼近模数转换器的控制方法包括以下步骤,
电容型数模转换器进行开关切换,在其上极板产生余量电压,
无源环路滤波器对所述余量电压噪声整形产生输出电压,其中,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,第一余量采集电容和第二余量采集电容与积分电容相连形成无源积分器输出无源环路滤波器的输出电压,
比较器将输入电压信号与余量反馈信号的加和信号量化成数字码,
SAR逻辑数字电路基于所述数字码控制电容型数模转换器的切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束。
与现有技术相比,本发明的有益效果是:
本发明利用电容型数模转换器和第一余量采集电容和第二余量采集电容直接相连的方式获取本周期余量电压Vres,不需要额外的开关周期来采集余量电压。同时,使用两个余量采集电容进行乒乓操作,可以在下一次采样周期内完成无源积分器的积分过程,从而相较于现有的SAR ADC不增加噪声整形所需的额外周期。
本发明未使用多输入端的比较器,从而减小了比较器输入管的尺寸以及多输入端额外带来的噪声,进一步优化了噪声整形效果。
本发明利用多回路反馈的方式,实现了更优化的NTF,提升了一阶噪声整形的效果,有效抑制了信号带内的量化噪声和比较器的噪声,明显提高了SAR ADC的信噪比。
上述说明仅是本发明技术方案的概述,为了能够使得本发明的技术手段更加清楚明白,达到本领域技术人员可依照说明书的内容予以实施的程度,并且为了能够让本发明的上述和其它目的、特征和优点能够更明显易懂,下面以本发明的具体实施方式进行举例说明。
附图说明
通过阅读下文优选的具体实施方式中的详细描述,本发明各种其他的优点和益处对于本领域普通技术人员将变得清楚明了。说明书附图仅用于示出优选实施方式的目的,而并不认为是对本发明的限制。显而易见地,下面描述的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。而且在整个附图中,用相同的附图标记表示相同的部件。
在附图中:
图1为本发明的噪声整形SAR ADC结构示意图;
图2为本发明的噪声整形SAR ADC中采用的电压缓冲器的结构图;
图3为本发明的噪声整形SAR ADC的工作时序图;
图4为本发明的噪声整形SAR ADC的信号流图;
图5为本发明的噪声整形SAR ADC噪声传递函数幅频特性曲线;
图6为本发明的噪声整形SAR ADC无噪声整形时输出的FFT结果;
图7为本发明的噪声整形SAR ADC有噪声整形时输出的FFT结果。
以下结合附图和实施例对本发明作进一步的解释。
具体实施方式
下面将参照附图1至图7更详细地描述本发明的具体实施例。虽然附图中显示了本发明的具体实施例,然而应当理解,可以以各种形式实现本发明而不应被这里阐述的实施例所限制。相反,提供这些实施例是为了能够更透彻地理解本发明,并且能够将本发明的范围完整的传达给本领域的技术人员。
需要说明的是,在说明书及权利要求当中使用了某些词汇来指称特定组件。本领域技术人员应可以理解,技术人员可能会用不同名词来称呼同一个组件。本说明书及权利要求并不以名词的差异来作为区分组件的方式,而是以组件在功能上的差异来作为区分的准则。如在通篇说明书及权利要求当中所提及的“包含”或“包括”为一开放式用语,故应解释成“包含但不限定于”。说明书后续描述为实施本发明的较佳实施方式,然所述描述乃以说明书的一般原则为目的,并非用以限定本发明的范围。本发明的保护范围当视所附权利要求所界定者为准。
为便于对本发明实施例的理解,下面将结合附图以具体实施例为例做进一步的解释说明,且各个附图并不构成对本发明实施例的限定。
为了更好地理解,如图1至图7所示,一种双反馈回路噪声整形过采样逐次逼近模数转换器包括,
电容型数模转换器,其经由切换在其上极板产生余量电压,
无源环路滤波器,其配置成对所述余量电压噪声整形,其中,其包括存储余量电压的第一余量采集电容和第二余量采集电容以及用于实现无源增益的积分电容,其中,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连所述电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,第一余量采集电容和第二余量采集电容与积分电容相连形成无源积分器输出无源环路滤波器的输出电压,
电压缓冲器,其分别连接所述无源环路滤波器和电容型数模转换器以将所述输出电压连接到电容型数模转换器的下极板,
比较器,比较器的输入端经由所述积分电容与电容型数模转换器的上极板相连,其中,无源环路滤波器经由电压缓冲器连接电容型数模转换器的下极板,电容型数模转换器的上极板通过积分电容连接比较器形成双回路反馈结构,比较器将输入电压的信号与来自无源环路滤波器输出电压信号的加和信号量化成数字码,
SAR逻辑数字电路,其输入端连接所述比较器的输出端,基于所述数字码控制电容型数模转换器切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,第一余量采集电容和第二余量采集电容进行乒乓操作,以在下一次采样周期内完成无源积分器积分。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,电压缓冲器包括全差分电压缓冲器或电压源随器。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,电压缓冲器包括由晶体管M0、M1、M2、M3构成一个二极管作负载的五管单元、M4、M5、M6、M7作为运放的第二级放大器和用于确定第二级放大器的输出共模电压的电阻R0,其中M4、M5和前级M2、M3构成比例为1:M的电流镜。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,逐次逼近模数转换器的每个周期分为采样阶段φs和转换阶段φr,第一余量采集电容和第二余量采集电容响应于φ1和φ2交替轮转,第n个转换周期,当φs、φ1为高时,开关S1导通,电容型数模转换器和第一余量采集电容作为采样电容对输入电压采样,采样时,φs1为高电平,开关S6导通,第二余量采集电容与积分电容相连构成无源积分器,对第二余量采集电容上存储的上一个周期的余量电压Vres(n-1)进行积分产生输出电压,其中,φs为高电平,开关S7导通,积分后的输出电压通过电压缓冲器与电容型数模转换器下极板相连,等到φs、φs1为低时,开关S1、S7、S6、S8断开,电容型数模转换器上存储的电压为输入电压和电压缓冲器输出电压之和。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,φr为高,电容型数模转换器的下极板切到共模电压,开关S2导通,电容型数模转换器的上极板的电压信号通过积分电容输入比较器,比较器输入端的电压为输入电压和2倍的无源环路滤波器输出电压之和,比较器开始比较并输出数字码,当所有数字码完成输出后,电容型数模转换器和第一余量采集电容的上极板剩余电压即为本周期的电压余量。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,进入第n+1个周期,φ2为高,第一余量采集电容和第二余量采集电容交换,再次进行上述操作。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,电容型数模转换器包括电容阵列和采样开关S1。
所述的双反馈回路噪声整形过采样逐次逼近模数转换器的优选实施例中,在逐次逼近模数转换器完成当前量化周期的最后一位量化后,产生的数字码通过SAR逻辑控制电路来控制电容型数模转换器额外进行一次开关切换,在电容型数模转换器上极板上得到本周期的余量电压,通过无源积分器对余量电压进行一阶积分且将积分后的电压分别通过电压缓冲器和比较器反馈。
为了进一步理解本发明,在一个实施例,所述的双反馈回路噪声整形过采样逐次逼近模数转换器SAR ADC包括电容型CDAC、无源环路滤波器、低回踢噪声比较器、电压缓冲器和SAR逻辑数字电路。其中无源环路滤波器包括了两个用于存储上个周期余量电压的余量采集电容Cresl和Cres2以及一个用于实现无源增益方案的积分电容Cint。
在一个实施例中,在SAR ADC完成当前量化周期的最后一位量化后,用产生的数字码通过SAR逻辑控制电路来控制CDAC额外进行一次开关切换,在CDAC上极板上得到本周期的余量电压Vres,之后通过无源积分器对该电压进行一阶积分,同时将积分后的电压分别通过电压缓冲器和比较器反馈回环路,从而实现对带内噪声的整形。其中无源采样方案通过交替将余量采集电容Cresl、Cres2和CDAC的上极板连接在一起,当CDAC完成最后一个周期的转换,Cresl和Cres2电容分奇偶周期交替与CDAC电容的上极板相连,存储由CDAC产生的当前本周期的余量电压Vres。然后,余量采集电容与积分电容Cint相连形成无源积分器作为无源环路滤波器,无源环路滤波器的输出电压通过电压缓冲器连接到CDAC的下极板,之后,在下个周期,CDAC上极板通过积分电容Cint与比较器的输入端相连,形成双回路反馈结构。利用比较器将输入电压信号与余量反馈信号的加和信号量化成数字码,SAR逻辑控制电路根据该数字码来控制CDAC进行切换,不断产生下一位数字码,直到整个量化结束,输出的所有数字码即为SAR ADC的当前采样的量化结果。
在一个实施例中,如图1所示,本发明提供的新型无源噪声整形SAR ADC,包括电容型CDAC、无源环路滤波器、低回踢噪声比较器、电压缓冲器和SAR逻辑数字电路。其中无源环路滤波器包括了两个用于存储上个周期余量电压的余量采集电容Cres1和Cres2以及一个用于实现无源增益方案的积分电容Cint。
在一个实施例中,图2即给出了电压缓冲器的一种实现方式,提出了一种全差分电压缓冲器。
在一个实施例中,由晶体管M0、M1、M2、M3构成一个二极管作负载的五管单元,M4、M5、M6、M7作为运放的第二级放大器,其中M4、M5和前级M2、M3构成比例为1∶M的电流镜,对电流进行放大以增强第二级的驱动能力。电阻R0用于确定第二级的输出共模电压。实际上本发明中的电压缓冲器并不局限于这一种实现方式,还可以采用电压源随器,以及基于各种运放的电压缓冲器等多种方式来实现,各种结构的速度、功耗开销、输出共模电压不相同,具体实现时,需要根据需求具体选择。
在一个实施例中,本发明的无源噪声整形SAR ADC的工作时序图如图3所示。每个周期分为采样阶段φs和转换阶段φr,除此之外φ1和φ2控制Cres1和Cres2交替轮转。
在一个实施例中,考虑ADC工作在第n个转换周期,当φs、φ1为高时,开关S1导通,CDAC和Cres1作为采样电容对输入电压Vin进行采样。采样时,φs1为高电平,开关S6导通,Cres2与Cint相连构成无源积分器,对Cres2上存储的上一个周期的余量电压Vres(n-1)进行积分产生Vint(n),因为φs为高电平,开关S7导通,因此积分后的电压Vint(n)通过电压缓冲器与CDAC下极板相连,等到φs、φs1为低时,开关S1、S7、S6、S8断开,此时CDAC电容上存储的电压为Vin(n)+Vint(n),之后φr为高,CDAC下极板切到共模电压VCM,开关S2导通,CDAC上极板的电压信号通过积分电容Cint后输入比较器,因为Cint两端电压为Vint(n),因此可以得到比较器输入端的电压为Vin(n)+2Vint(n)。比较器开始比较并输出数字码,控制CDAC进行逐位切换。当所有数字码完成输出后,CDAC和Cres1上极板剩余电压即为本周期的电压余量Vres(n)。之后进入第n+1个周期,此时φ2为高,将Cres1和Cres2交换,再次进行上述操作。
在一个实施例中,如图4所示本文实现的噪声整形SAR ADC信号流图,假设电容Cint/(Cint+Cres1,2)=b。根据信号流图,可得
其中Vin为输入信号,Vres为余量电压,Q为比较器噪声和量化噪声的集合,Dout为SARADC的输出数字码,进一步推导可得输入信号的信号传递函数(STF)和噪声传递函数(NTF)分别为:
由此可见本结构对输入信号没有衰减作用,对带内噪声可以进行高通整形。其中NTF中有一个与b值无关的零点,且b的取值只影响极点的位置,考虑到结构的稳定性,极点位置应该在单位圆内,b取值应小于1/2。通过控制Cint、Cres1,2的电容比例,可以保证b的取值不超过1/2,在本结构中为1/8。这种结构避免了使用有源积分器所带来的额外功耗,积分增益由电容的比例决定,受工艺、电源和温度(PVT)变化的影响很小。相较于无源噪声整形结构,NTF函数的系数得到优化,整形能力大大提高。
图5是本发明的噪声整形SAR ADC噪声传递函数NTF的幅频特性曲线(b=1/8),从图中可以看出当z=1时,NTF有近乎无穷大的衰减,这说明该结构有较强的噪声整形效果。
在不打开噪声整形功能时(CDAC设计为10位),对本发明的噪声整形SAR ADC输出进行快速傅里叶变换(FFT)得到功率谱密度图如图6所示。可以看出,整个噪底在带内非常平坦。且此时ADC的有效位数(ENOB)为9.88bit,SNDR为61.24dB。
本发明的噪声整形SAR ADC在过采样率OSR=16时(CDAC设计为10位),对系统输出进行FFT,得到功率谱密度图如图7所示,可以看出,噪声底在低频处被抑制,整个频谱被高通整形,同时噪声功率谱在较高频处以20dB/DEC的增速在增加,一阶噪声整形效果明显。ADC的有效位数ENOB为14.91bit,SNDR为91.50dB,对比未打开噪声整形时,SNDR提高了30.26dB。
综上,本发明提出的具有双反馈回路的噪声整形过采样SARADC能够有效抑制带内的量化噪声和比较器噪声,并且在相较于传统SAR ADC不增加额外时钟周期的基础上,有效提升SAR ADC的信噪比。
一种双反馈回路噪声整形过采样逐次逼近模数转换器的控制方法包括以下步骤,
电容型数模转换器进行开关切换,在其上极板产生余量电压,
无源环路滤波器对所述余量电压噪声整形产生输出电压,其中,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,第一余量采集电容和第二余量采集电容与积分电容相连形成无源积分器输出无源环路滤波器的输出电压,
比较器将输入电压的信号与来自电压缓冲器余量反馈的信号的加和信号量化成数字码,
SAR逻辑数字电路基于所述数字码控制电容型数模转换器的切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束。
工业实用性
本发明所述的双反馈回路噪声整形过采样逐次逼近模数转换器及控制方法可以在集成电路领域制造并使用。
以上结合具体实施例描述了本申请的基本原理,但是,需要指出的是,在本申请中提及的优点、优势、效果等仅是示例而非限制,不能认为这些优点、优势、效果等是本申请的各个实施例必须具备的。另外,上述公开的具体细节仅是为了示例的作用和便于理解的作用,而非限制,上述细节并不限制本申请为必须采用上述具体的细节来实现。
为了例示和描述的目的已经给出了以上描述。此外,此描述不意图将本申请的实施例限制到在此公开的形式。尽管以上已经讨论了多个示例方面和实施例,但是本领域技术人员将认识到其某些变型、修改、改变、添加和子组合。
Claims (7)
1.一种双反馈回路的噪声整形过采样逐次逼近模数转换器,其包括,
电容型数模转换器,其经由切换在其上极板产生余量电压,
无源环路滤波器,其配置成对所述余量电压噪声整形,其中,其包括存储余量电压的第一余量采集电容和第二余量采集电容以及用于实现无源增益的积分电容,其中,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连所述电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,第一余量采集电容和第二余量采集电容与积分电容相连形成无源积分器输出无源环路滤波器的输出电压,
电压缓冲器,其分别连接所述无源环路滤波器和电容型数模转换器以将所述输出电压连接到电容型数模转换器的下极板,
比较器,比较器的输入端经由所述积分电容与电容型数模转换器的上极板相连,其中,无源环路滤波器经由电压缓冲器连接电容型数模转换器的下极板,电容型数模转换器的上极板通过积分电容连接比较器形成双回路反馈结构,比较器将输入电压的信号与无源环路滤波器的输出电压信号的加和信号量化成数字码,
SAR逻辑数字电路,其输入端连接所述比较器的输出端,基于所述数字码控制电容型数模转换器切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束, 其中:
逐次逼近模数转换器的每个周期分为采样阶段φ s和转换阶段φ r,第一余量采集电容和第二余量采集电容响应于φ 1和φ 2交替轮转,第n个转换周期,当φ s、φ 1为高时,开关S1导通,电容型数模转换器和第一余量采集电容作为采样电容对输入电压采样,采样时,φ s1为高电平,开关S6导通,第二余量采集电容与积分电容相连构成无源积分器,对第二余量采集电容上存储的上一个周期的余量电压V res(n-1)进行积分产生输出电压,其中,φ s为高电平,开关S7导通,积分后的输出电压通过电压缓冲器与电容型数模转换器下极板相连,等到φ s、φ s1为低时,开关S1、S7、S6、S8断开,电容型数模转换器上存储的电压为输入电压和电压缓冲器输出电压之和;
φ r为高,电容型数模转换器的下极板切到共模电压,开关S2导通,电容型数模转换器的上极板的电压信号通过积分电容输入比较器,比较器输入端的电压为输入电压和2倍的无源环路滤波器输出电压之和,比较器开始比较并输出数字码,当所有数字码完成输出后,电容型数模转换器和第一余量采集电容的上极板剩余电压即为本周期的电压余量;
进入第n+1个周期,φ 2为高,第一余量采集电容和第二余量采集电容交换,再次进行上述操作。
2.如权利要求1所述的双反馈回路噪声整形过采样逐次逼近模数转换器,其中,第一余量采集电容和第二余量采集电容进行乒乓操作,以在下一次采样周期内完成无源积分器积分。
3.如权利要求1所述的双反馈回路噪声整形过采样逐次逼近模数转换器,其中,电压缓冲器包括全差分电压缓冲器或电压源跟随器。
4.如权利要求1所述的双反馈回路噪声整形过采样逐次逼近模数转换器,其中,电压缓冲器包括由晶体管M 0、M 1、M 2、M 3构成一个二极管作负载的五管单元、M 4、M 5、M 6、M 7作为运放的第二级放大器和用于确定第二级放大器的输出共模电压的电阻R 0,其中M 4、M 5和前级M 2、M 3构成比例为1:M的电流镜。
5.如权利要求1所述的双反馈回路噪声整形过采样逐次逼近模数转换器,其中,电容型数模转换器包括电容阵列。
6.如权利要求1所述的双反馈回路噪声整形过采样逐次逼近模数转换器,其中,在逐次逼近模数转换器完成当前量化周期的最后一位量化后,产生的数字码通过SAR逻辑数字电路来控制电容型数模转换器额外进行一次开关切换,在电容型数模转换器上极板上得到本周期的余量电压,通过无源积分器对余量电压进行一阶积分且将积分后的电压分别通过电压缓冲器和比较器反馈。
7.一种如权利要求1-6中任一项所述的双反馈回路噪声整形过采样逐次逼近模数转换器的控制方法,其包括以下步骤,
电容型数模转换器进行开关切换,在其上极板产生余量电压,
无源环路滤波器对所述余量电压噪声整形产生输出电压,其中,第一余量采集电容和第二余量采集电容分别奇偶周期交替相连电容型数模转换器的上极板以存储由电容型数模转换器产生的当前本周期的余量电压,第一余量采集电容、第二余量采集电容与积分电容相连形成无源积分器以输出无源环路滤波器的输出电压,
比较器将输入电压的信号与来自无源环路滤波器的输出电压信号的加和信号量化成数字码,
SAR逻辑数字电路基于所述数字码控制电容型数模转换器的切换,以逐次逼近方式从高到低不断产生逐次逼近模数转换器的每一位输出,直到整个量化结束。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN202010098117.3A CN111211783B (zh) | 2020-02-17 | 2020-02-17 | 双反馈回路噪声整形过采样逐次逼近模数转换器及方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN202010098117.3A CN111211783B (zh) | 2020-02-17 | 2020-02-17 | 双反馈回路噪声整形过采样逐次逼近模数转换器及方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN111211783A CN111211783A (zh) | 2020-05-29 |
CN111211783B true CN111211783B (zh) | 2021-10-01 |
Family
ID=70787867
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN202010098117.3A Active CN111211783B (zh) | 2020-02-17 | 2020-02-17 | 双反馈回路噪声整形过采样逐次逼近模数转换器及方法 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN111211783B (zh) |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN113098516B (zh) * | 2021-03-04 | 2022-11-15 | 深圳市纽瑞芯科技有限公司 | 一种交错的adc的乒乓预采样保持缓冲器 |
CN113271104B (zh) * | 2021-04-30 | 2024-05-07 | 澳门大学 | 流水线模数转换电路 |
CN113315518B (zh) * | 2021-05-06 | 2023-07-07 | 西安交通大学 | 一种基于噪声整形的逐次逼近型模数转换器 |
CN113676181B (zh) * | 2021-08-25 | 2022-11-11 | 东南大学 | 一种基于双输入比较器的二阶全无源噪声整形sar adc |
CN114124089B (zh) * | 2021-11-22 | 2024-04-26 | 西安交通大学 | 一种四阶噪声整形流水线逐次逼近模数转换器 |
CN114285414B (zh) * | 2021-12-27 | 2024-04-26 | 北京大学深圳研究生院 | 缩放式增量型模数转换方法及转换器 |
CN116366067B (zh) * | 2021-12-27 | 2024-06-28 | 圣邦微电子(北京)股份有限公司 | 一种模数转换器及其操作方法 |
CN115021751B (zh) * | 2022-06-24 | 2024-07-05 | 福州大学 | 无余量电压采集的无源噪声整形逐次逼近模数转换器 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2014060798A1 (en) * | 2012-10-16 | 2014-04-24 | Department of Electronics and Information Technology | AN ENERGY-EFFICIENT FLIPDAC SWITCHING TECHNIQUE FOR CAPACITIVE DAC IN SAR ADCs |
CN105720985A (zh) * | 2016-01-18 | 2016-06-29 | 清华大学 | 一种用于压缩采样模数转换器的可变压缩比采样电路 |
-
2020
- 2020-02-17 CN CN202010098117.3A patent/CN111211783B/zh active Active
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2014060798A1 (en) * | 2012-10-16 | 2014-04-24 | Department of Electronics and Information Technology | AN ENERGY-EFFICIENT FLIPDAC SWITCHING TECHNIQUE FOR CAPACITIVE DAC IN SAR ADCs |
CN105720985A (zh) * | 2016-01-18 | 2016-06-29 | 清华大学 | 一种用于压缩采样模数转换器的可变压缩比采样电路 |
Non-Patent Citations (2)
Title |
---|
20.2 A 40MHz-BW 320MS/s Passive Noise-Shaping SAR ADC With Passive Signal-Residue Summation in 14nm FinFET;Ying-Zu Lin 等;《2019 IEEE International Solid- State Circuits Conference - (ISSCC)》;20190307;330-332 * |
A noise-shaping SAR ADC with dual error-feedback paths and alternate DACs;Jiaqi Yang 等;《2017 IEEE 12th International Conference on ASIC (ASICON)》;20180111;291-294 * |
Also Published As
Publication number | Publication date |
---|---|
CN111211783A (zh) | 2020-05-29 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
CN111211783B (zh) | 双反馈回路噪声整形过采样逐次逼近模数转换器及方法 | |
CN111327323B (zh) | 无源噪声整形过采样逐次逼近模数转换器及控制方法 | |
CN110492885B (zh) | 一种无源噪声整形逐次逼近sar模数转换器 | |
Dyer et al. | An analog background calibration technique for time-interleaved analog-to-digital converters | |
US7446686B2 (en) | Incremental delta-sigma data converters with improved stability over wide input voltage ranges | |
CN109787633B (zh) | 带斩波稳定的适用于混合型adc结构的σδadc | |
US20050052300A1 (en) | Single loop feed-forward modulator with summing flash quantizer and multi-bit feedback | |
US9900023B1 (en) | Multi-stage delta-sigma pipelined successive approximation register analog-to-digital converter | |
Bashir et al. | Analog-to-digital converters: A comparative study and performance analysis | |
CN115473533B (zh) | Flash-sar adc转换方法及电路 | |
CN110190849A (zh) | 一种逐次逼近型模数转换器 | |
CN117559999B (zh) | 一种逐次逼近型模数转换器及模数转换处理方法 | |
CN113315522B (zh) | 一种24位低失真Sigma-Delta模数转换器 | |
Chen et al. | Analysis and design of sigma-delta ADCs for automotive control systems | |
CN114285414B (zh) | 缩放式增量型模数转换方法及转换器 | |
CN116405032A (zh) | 一种噪声整形逐次逼近型模数转换器及控制方法 | |
CN107294536B (zh) | 3bit流水线式ADC的时序控制方法 | |
CN113676181B (zh) | 一种基于双输入比较器的二阶全无源噪声整形sar adc | |
CN112202449B (zh) | 一种基于模拟-数字转换器的电容测量电路及测量方法 | |
Xia et al. | A Passive Noise-Shaping SAR ADC with Energy-Efficient Switching Method | |
CN207504850U (zh) | 一种过采样式Pipeline SAR-ADC装置 | |
WO2021137686A1 (en) | Interfacing circuit and analog to digital converter for battery monitoring applications and a method thereof | |
CN211860072U (zh) | 一种新型高速高精度模数转换器 | |
CN117938156B (zh) | 一种应用于ns sar adc的二阶噪声整形电路 | |
Hsieh et al. | A sar-assisted continuous-time incremental σδ adc with first-order noise coupling |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
PB01 | Publication | ||
SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |