CN110428778A - 像素电路及其驱动方法以及显示面板 - Google Patents

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Abstract

本公开提供了一种像素电路及其驱动方法以及显示面板。像素电路包括驱动子电路、发光控制子电路、第一发光元件、第二发光元件和第三发光元件。驱动子电路用于在第一节点的电压的控制下将来自第一电源信号端的第一电源电压传递到第二节点。发光控制子电路用于在来自第一、第二和第三发光控制端的第一、第二和第三发光控制信号的控制下，使第二节点的电压和来自第二电源信号端的第二电源电压在第一时段分别传递到第一发光元件的第一极和第二极，在第二时段分别传递到第二发光元件的第一极和第二极，在第三时段分别传递到第三发光元件的第一极和第二极。

Description

像素电路及其驱动方法以及显示面板
技术领域
本公开涉及显示技术领域，具体地涉及一种像素电路及其驱动方法以及显示面板。
背景技术
常规的有机发光二极管(OLED)显示器中，每个像素单元中不同颜色的子像素在面板上横向排列，占用面板空间较大，不利于高PPI的实现。
发明内容
根据本公开的第一方面，提出了一种像素电路。所述像素电路包括驱动子电路、发光控制子电路、第一发光元件、第二发光元件和第三发光元件。所述驱动子电路与第一节点、第一电源信号端和第二节点电连接，用于在第一节点的电压的控制下将来自第一电源信号端的第一电源电压传递到第二节点。所述发光控制子电路与第二节点、第二电源信号端、第一发光控制端、第二发光控制端、第三发光控制端、第一发光元件的第一极和第二极、第二发光元件的第一极和第二极以及第三发光元件的第一极和第二极电连接，所述发光控制子电路用于在来自第一发光控制端、第二发光控制端和第三发光控制端的第一发光控制信号、第二发光控制信号和第三发光控制信号的控制下，使第二节点的电压和来自第二电源信号端的第二电源电压在第一时段分别传递到第一发光元件的第一极和第二极，在第二时段分别传递到第二发光元件的第一极和第二极，在第三时段分别传递到第三发光元件的第一极和第二极。
在一些实施例中，所述发光控制子电路包括第一晶体管、第二晶体管、第三晶体管、第四晶体管和第五晶体管。第一晶体管的控制极与第二发光控制端电连接，第一晶体管的第一极与第二节点电连接，第一晶体管的第二极与第四节点电连接。第二晶体管的控制极与第一发光控制端电连接，第二晶体管的第一极与第二节点电连接，第二晶体管的第二极与第一发光元件的第一极电连接。第三晶体管的控制极与第三发光控制端电连接，第三晶体管的第一极与第二节点电连接，第三晶体管的第二极与第五节点电连接。第四晶体管的控制极与第一发光控制端电连接，第四晶体管的第一极与第四节点电连接，第四晶体管的第二极与第二电源信号端电连接。第五晶体管的控制极与第二发光控制端电连接，第五晶体管的第一极与第五节点电连接，第五晶体管的第二极与第二电源信号端电连接。第一发光元件的第二极与第二发光元件的第一极电连接于第四节点，第二发光元件的第二极与第三发光元件的第一极电连接于第五节点，第三发光元件的第二极与第二电源信号端电连接。
在一些实施例中，所述发光控制子电路包括第一晶体管、第二晶体管、第三晶体管、第四晶体管和第五晶体管。第一晶体管的控制极与第二发光控制端电连接，第一晶体管的第一极与第二节点电连接，第一晶体管的第二极与第四节点电连接。第二晶体管的控制极与第三发光控制端电连接，第二晶体管的第一极与第三发光元件的第二极电连接，第二晶体管的第二极与第二电源信号端电连接。第三晶体管的控制极与第三发光控制端电连接，第三晶体管的第一极与第二节点电连接，第三晶体管的第二极与第五节点电连接。第四晶体管的控制极与第一发光控制端电连接，第四晶体管的第一极与第四节点电连接，第四晶体管的第二极与第二电源信号端电连接。第五晶体管的控制极与第二发光控制端电连接，第五晶体管的第一极与第五节点电连接，第五晶体管的第二极与第二电源信号端电连接。第一发光元件的第一极与第二节点电连接，第一发光元件的第二极与第二发光元件的第一极电连接于第四节点，第二发光元件的第二极与第三发光元件的第一极电连接于第五节点。
在一些实施例中，所述驱动子电路包括第六晶体管。第六晶体管的控制极与第一节点电连接，第六晶体管的第一极与第一电源信号端电连接，第六晶体管的第二极与第二节点电连接。
在一些实施例中，所述像素电路还包括：存储子电路，电连接在第一节点与第三节点之间；充电控制子电路，与扫描信号端、数据信号端、第一节点、第二节点、第三节点电连接，用于在来自扫描信号端的第一扫描电压的控制下，使所述第一节点和所述第三节点之间产生电压差；复位子电路，与第一复位控制端、第二复位控制端、第三节点和复位电压信号端电连接，用于在来自第一复位控制端的第一复位控制信号或来自第二复位控制端的第二复位控制信号的控制下，使用来自所述复位电压信号端的复位电压信号对第三节点进行复位。
在一些实施例中，所述存储子电路包括第一电容。第一电容的第一端与第三节点电连接，第一电容的第二端与第一节点电连接。
在一些实施例中，所述充电控制子电路包括第七晶体管和第八晶体管。第七晶体管的控制极与扫描信号端电连接，第七晶体管的第一极与数据信号端电连接，第七晶体管的第二极与第三节点电连接。第八晶体管的控制极与扫描信号端电连接，第八晶体管的第一极与第一节点电连接，第八晶体管的第二极与第二节点电连接。
在一些实施例中，所述复位子电路包括第九晶体管和第十晶体管。第九晶体管的控制极与第一复位控制端电连接，第九晶体管的第一极与复位电压信号端电连接，第九晶体管的第二极与第三节点电连接。第十晶体管的控制极与第二复位控制端电连接，第十晶体管的第一极与复位电压信号端电连接，第十晶体管的第二极与第三节点电连接。
在一些实施例中，扫描信号端被配置为接收针对本行像素的扫描信号，第一复位控制端被配置为接收针对上一行像素的扫描信号，第二复位控制端被配置为接收针对下一行像素的扫描信号。
根据本公开的第二方面，提出了一种显示面板。所述显示面板包括多个像素单元。所述多个像素单元中的至少一个像素单元包括根据第一方面所述的像素电路。
在一些实施例中，所述至少一个像素单元中的每一个包括：基板；控制电路层，包括所述驱动子电路和所述发光控制子电路；中间层，覆盖所述控制电路层；在所述中间层上在发光区顺序地堆叠的第一电极层、第一发光层、第二电极层、第二发光层、第三电极层、第三发光层和第四电极层，其中，第一发光层、第二发光层和第三发光层分别用作第一发光元件、第二发光元件和第三发光元件。
在一些实施例中，所述第一电极层、第二电极层和第三电极层分别通过贯穿所述中间层的通孔与控制电路层电连接。
在一些实施例中，所述第一电极层包括不透明材料，所述第二电极层、所述第三电极层和所述第四电极层包括透明材料。
根据本公开的第三方面，提出了一种对根据本公开第一方面所述的像素电路进行驱动的方法。第一时段、第二时段和第三时段中的每一个都包括初始化阶段、充电阶段和发光阶段。所述方法包括：在第一时段的发光阶段，提供具有有效电平的第一发光控制信号，提供具有无效电平的第二发光控制信号和第三发光控制信号，在第二时段的发光阶段，提供具有有效电平的第二发光控制信号，提供具有无效电平的第一发光控制信号和第三发光控制信号，在第三时段的发光阶段，提供具有有效电平的第三发光控制信号，提供具有无效电平的第一发光控制信号和第二发光控制信号，在各时段的初始化阶段和充电阶段，提供具有无效电平的第一发光控制信号、第二发光控制信号和第三发光控制信号。
根据本公开的第四方面，提出了一种显示面板。所述显示面板包括多个像素单元。每个像素单元包括：基板；控制电路层，布置在所述基板的一个表面上；中间层，布置在所述控制电路层的背对所述基板的表面上；在所述中间层上在发光区顺序地堆叠的第一电极层、第一发光层、第二电极层、第二发光层、第三电极层、第三发光层和第四电极层，其中，第一发光层、第二发光层和第三发光层分别用作第一发光元件、第二发光元件和第三发光元件。
在一些实施例中，所述第一电极层、第二电极层和第三电极层分别通过贯穿所述中间层的通孔与控制电路层电连接。
在一些实施例中，所述第一电极层包括不透明材料，所述第二电极层、所述第三电极层和所述第四电极层包括透明材料。
附图说明
为了更清楚地说明本公开实施例或现有技术中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍。显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图，图中：
图1示出了根据相关技术的显示面板的像素单元的示意截面图。
图2示出了根据本公开实施例的显示面板的像素单元的示意截面图。
图3示出了根据本公开实施例的像素单元的更为详细的层结构图。
图4示出了根据本公开实施例的像素单元中的像素电路的电路结构图。
图5示出了图4中的像素电路的进一步的电路结构图。
图6示出了图5所示的像素电路的详细电路图。
图7A示出了图6的像素电路的信号时序图。
图7B-图7F示出了图6的像素电路的各阶段原理示意图。
图8示出了图5所示的像素电路的另一详细电路图。
图9示出了根据本公开实施例的显示面板的示意方框图。
图10示出了根据本公开实施例的像素电路的驱动方法的流程图。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例中的附图，对本公开实施例中的技术方案进行清楚、完整的描述。显然，所描述的实施例是本公开的一部分实施例，而不是全部。基于所描述的本公开实施例，本领域普通技术人员在无需创造性劳动的前提下获得的所有其他实施例都属于本公开保护的范围。应注意，贯穿附图，相同的元素由相同或相近的附图标记来表示。在以下描述中，一些具体实施例仅用于描述目的，而不应该理解为对本公开有任何限制，而只是本公开实施例的示例。在可能导致对本公开的理解造成混淆时，将省略常规结构或构造。应注意，图中各部件的形状和尺寸不反映真实大小和比例，而仅示意本公开实施例的内容。
除非另外定义，本公开实施例使用的技术术语或科学术语应当是本领域技术人员所理解的通常意义。本公开实施例中使用的“第一”、“第二”以及类似词语并不表示任何顺序、数量或重要性，而只是用于区分不同的组成部分。
此外，在本公开实施例的描述中，术语“电连接”可以是指两个组件直接电连接，也可以是指两个组件之间经由一个或多个其他组件电连接。此外，这两个组件可以通过有线或无线方式电连接或耦接。
在以下实施例中，并没有对显示器的具体类型进行限定，但本领域技术人员应该理解的是，任何通过设置发光层并在发光层两端施加电压的方式发光的显示器(例如，OLED显示器、量子点发光二极管(QLED)显示器)都被本公开涵盖在内。
本公开实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件。根据在电路中的作用，本公开实施例使用的晶体管主要为开关晶体管。由于这里采用的薄膜晶体管的源极、漏极是对称的，所以其源极、漏极可以互换。在本公开实施例中，将源极和漏极中的一个称为第一极，将源极和漏极中的另一个称为第二极。在以下示例中以驱动晶体管为P型薄膜晶体管的情况进行描述，其他晶体管根据电路设计与驱动晶体管具有相同或不同的类型。类似地，在其他实施例中，驱动晶体管也可以被示为N型薄膜晶体管。本领域技术人员能够理解的是，通过将其他晶体管的类型相应地改变并将各驱动信号和电平信号进行反相(和/或进行其他附加的适应性修改)，同样能够实现本公开的技术方案。
此外，在本公开实施例的描述中，术语“第一电平”和“第二电平”仅用于区别两个电平的幅度不同。在一些实施例中，“第一电平”可以是使相关晶体管截止的无效电平，“第二电平”可以是使相关晶体管导通的有效电平。下文中，由于驱动晶体管被示例为P型薄膜晶体管，因此“第一电平”被示例为高电平，“第二电平”被示例为低电平。
以下参考附图对本公开进行具体描述。
图1示出了根据相关技术的显示面板的像素单元100的示意截面图。
显示面板包括多个像素单元100。如图1所示，像素单元100包括基板110、控制电路层120、第一电极层130、发光层140和第二电极层150。
基板110可以是例如玻璃基板。
控制电路层120中形成像素电路。具体地，控制电路层120中可以包括分别用于控制不同子像素的多个像素电路。
第一电极层130设置在控制电路层120上。第一电极层130中可以包括多个驱动电极，分别连接到控制电路层120中的不同像素电路，以从相应像素电路接收用于驱动发光层140中的不同子像素的驱动电压。第一电极层130设置在像素单元100中的发光区，其中的电极可以包括不透明电极(例如，由Al和Ag形成)。
在一些实施例中，还可设置有一个或多个中间层，所述中间层位于控制电路层120和第一电极层130之间或在发光区之外包围第一电极层130。第一电极层130通过贯穿所述一个或多个中间层的通孔与控制电路层120中的像素电路电连接。所述中间层可以包括层间介质层(ILD)和各种平坦层、绝缘层或有机层(例如，PLN层或PDL层)。
发光层140包括并排布置的三个部分，分别对应于像素单元100中的R、G、B三个子像素，以发射红、绿和蓝三种颜色的光。如上文所述，每个子像素对应于控制电路层120中的一个像素电路和第一电极层130中的一个电极，以通过所对应的电极从所对应的像素电路接收驱动电压。发光层140充当像素电路中的发光单元。
第二电极层150可以包括公共电极，面板上各像素单元的各子像素可以共用同一电极，所述公共电极可以是透明电极(例如氧化铟锡(ITO))。
在图1的像素结构中，不同颜色的子像素在面板上横向排列，占用面板空间较大，不利于高PPI的实现。
图2示出了根据本公开实施例的显示面板的像素单元200的示意截面图。
如图2所示，像素单元200包括基板210、控制电路层220、第一电极层230、第一发光层240、第二电极层250、第二发光层260、第三电极层270、第三发光层280和第四电极层290。
基板210可以是例如玻璃基板。
控制电路层220中形成像素电路。具体地，控制电路层220中可以形成单个像素电路，该像素电路用于在不同的时段分别控制像素单元200中的各个子像素发光。
第一电极层230设置在控制电路层220上。第一电极层230中可以包括单个驱动电极，其与控制电路层220中的像素电路电连接，以在一帧中的第一时段从像素电路接收用于驱动第一发光层240的驱动电压。第一电极层230设置在像素单元200中的发光区，其中的驱动电极可以是不透明电极(例如，由Al和Ag形成)。
在一些实施例中，还设置有一个或多个中间层，中间层可以设置在控制电路层220和第一电极层230之间或者在发光区之外包围第一电极层以及之上的层结构。第一电极层230通过贯穿中间层的通孔与控制电路层220中的像素电路电连接。所述中间层可以包括层间介质层(ILD)和各种平坦层、绝缘层或有机层(例如，PLN层或PDL层)。
第一发光层240包括单个部分，对应于像素单元200中的R子像素，用来发射红光。第一发光层240与通过所述第一电极层230中的驱动电极从所控制电路层220中的像素电路接收驱动电压。
第二电极层250设置在第一发光层240上。第二电极层250中可以包括单个电极，其与控制电路层220中的像素电路电连接，以在一帧中的第一时段接收公共电压，在一帧中的第二时段从像素电路接收用于驱动第二发光层260发光的驱动电压。第二电极层250中的驱动电极可以是透明电极。为了实现第二电极层250与控制电路层220中的像素电路的电连接，需要在中间层中设置通孔。
第二发光层260包括单个部分，对应于像素单元200中的G子像素，用来发射绿光。第二发光层260与通过所述第二电极层250中的驱动电极从所控制电路层220中的像素电路接收驱动电压。
第三电极层270设置在第二发光层260上。第三电极层270中可以包括单个电极，其与控制电路层220中的像素电路电连接，以在一帧中的第二时段接收公共电压，在一帧中的第三时段从像素电路接收用于驱动第三发光层280发光的驱动电压。第三电极层270中的驱动电极可以是透明电极。为了实现第三电极层270与控制电路层220中的像素电路的电连接，需要在中间层中设置通孔。
第三发光层280包括单个部分，对应于像素单元200中的B子像素，用来发射蓝光。第三发光层280与通过所述第二电极层270中的驱动电极从所控制电路层220中的像素电路接收驱动电压。
第四电极层290设置在第三发光层280上。第四电极层290中可以包括单个电极，其与控制电路层220中的像素电路电连接，以在一帧中的第三时段接收公共电压。第四电极层290中的驱动电极可以是透明电极。为了实现第四电极层290与控制电路层220中的像素电路的电连接，需要在中间层中设置通孔。
图3示出了根据本公开实施例的像素单元的更为详细的层结构图。
如图3所示，像素单元300的结构包括依次堆叠的基板310、缓冲层320、控制电路层330、第一中间层340、第二中间层350、第三中间层360、第一电极层370、第一发光层371、第二电极层372、第二发光层373、第三电极层374、第三发光层375和第四电极层376。其中，第一发光层371、第二发光层373和第三发光层375位于像素单元的发光区。第一电极层370、第二电极层372、第三电极层374和第四电极层376也都有一部分覆盖发光区，但其各自还包括位于TFT区的部分，以便与像素电路或公共电源线电连接。应该理解的是，在其他实施例中，可以去除图3中所示结构中的某些层(例如，缓冲层320)或增加新的层，也可以对某些层的结构进行改变，本公开对此不加以限制。
示例性地，图3中的控制电路层330示出了像素电路中的两个晶体管M1和M2。晶体管M1的源极和漏极之一通过通孔V1与第一电极层370电连接，其中，第一电极层370与通孔V1一体地形成。晶体管M2通过通孔V2与第二电极层372电连接，其中，第二电极层372与通孔V2通过不同材料形成。第三电极层374同样与像素电路中的晶体管电连接，但图3中只是截取了像素单元的特定截面图的一部分，并未示出与第三电极层374连接的晶体管。
从图2的示意图和图3的示例层结构图可见，通过在原本设置单个子像素的区域在竖直方向顺序地堆叠三个子像素，并通过原本用于对单个子像素进行驱动的像素电路对三个子像素分别进行驱动，能够节省每个像素单元所占用的面板空间，更有利于高PPI的实现。
为了实现显示面板的正常显示，需要对像素电路和信号时序进行设计，使得三个子像素在不同的时段发光，每一个子像素都不会受到其他子像素的驱动影响。在如下的各电路结构中，通过发光元件R、G和B来表示以上分层结构图中的三个子像素。
图4示出了根据本公开实施例的像素单元中的像素电路400的电路结构图。
如图4所示，像素电路400包括驱动子电路410、发光控制子电路420、第一发光元件R、第二发光元件G和第三发光元件B。
驱动子电路410与第一节点N1、第一电源信号端VDD和第二节点N2电连接。驱动子电路410用于在第一节点N1的电压的控制下将来自第一电源信号端VDD的第一电源电压传递到第二节点N2。
发光控制子电路420与第二节点N2、第二电源信号端VSS、第一发光控制端EM1、第二发光控制端EM2、第三发光控制端EM3、第一发光元件R的第一极和第二极、第二发光元件G的第一极和第二极以及第三发光元件B的第一极和第二极电连接，所述发光控制子电路420用于在来自第一发光控制端EM1、第二发光控制端EM2和第三发光控制端EM3的第一发光控制信号、第二发光控制信号和第三发光控制信号的控制下，使第二节点N2的电压和来自第二电源信号端VSS的第二电源电压在第一时段分别传递到第一发光元件R的第一极和第二极，在第二时段分别传递到第二发光元件G的第一极和第二极，在第三时段分别传递到第三发光元件B的第一极和第二极。
如此，图4中的电路结构能够实现三个不同的子像素R、G和B在一帧中的不用时段的分时驱动，使得图2-图3中的像素单元能够实现显示。
图5示出了图4中的像素电路的进一步的电路结构图。
在图4的基础上，图5中的像素电路500还包括存储子电路430、充电控制子电路440和复位子电路450。
存储子电路430电连接在第一节点N1与第三节点N3之间。
充电控制子电路440与扫描信号端Scan、数据信号端Data、第一节点N1、第二节点N2、第三节点N3电连接，用于在来自扫描信号端Scan的第一扫描电压的控制下，使第一节点N1和第三节点N3之间产生电压差。
复位子电路450与第一复位控制端Resetl、第二复位控制端Reset2、第三节点N3和复位电压信号端Vini电连接，用于在来自第一复位控制端Resetl的第一复位控制信号或来自第二复位控制端Reset2的第二复位控制信号的控制下，使用来自复位电压信号端Vini的复位电压信号对第三节点N3进行复位。
图6示出了图5所示的像素电路的详细电路图。
如图6所示，发光控制子电路420可以包括第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4和第五晶体管T5。
第一晶体管T1的控制极与第二发光控制端EM2电连接，第一晶体管T1的第一极与第二节点N2电连接，第一晶体管T1的第二极与第四节点N4电连接。
第二晶体管T2的控制极与第一发光控制端EM1电连接，第二晶体管T2的第一极与第二节点N2电连接，第二晶体管T2的第二极与第一发光元件R的第一极电连接。
第三晶体管T3的控制极与第三发光控制端EM3电连接，第三晶体管T3的第一极与第二节点N2电连接，第三晶体管T3的第二极与第五节点N5电连接。
第四晶体管T4的控制极与第一发光控制端EM1电连接，第四晶体管T4的第一极与第四节点N4电连接，第四晶体管T4的第二极与第二电源信号端VSS电连接。
第五晶体管T5的控制极与第二发光控制端EM2电连接，第五晶体管T5的第一极与第五节点N5电连接，第五晶体管T5的第二极与第二电源信号端VSS电连接。
第一发光元件R的第二极与第二发光元件G的第一极电连接于第四节点N4，第二发光元件G的第二极与第三发光元件B的第一极电连接于第五节点N5，第三发光元件B的第二极与第二电源信号端VSS电连接。
驱动子电路410包括第六晶体管T6。
第六晶体管T6的控制极与第一节点N1电连接，第六晶体管T6的第一极与第一电源信号端VDD电连接，第六晶体管T6的第二极与第二节点N2电连接。
存储子电路430包括第一电容C1。
第一电容C1的第一端与第三节点N3电连接，第一电容C1的第二端与第一节点N1电连接。
充电控制子电路440包括第七晶体管T7和第八晶体管T8。
第七晶体管T7的控制极与扫描信号端Scan电连接，第七晶体管T7的第一极与数据信号端Data电连接，第七晶体管T7的第二极与第三节点N3电连接。
第八晶体管T8的控制极与扫描信号端Scan电连接，第八晶体管T8的第一极与第一节点N1电连接，第八晶体管T8的第二极与第二节点N2电连接。
复位子电路450包括第九晶体管T9和第十晶体管T10。
第九晶体管T9的控制极与第一复位控制端Reset1电连接，第九晶体管T9的第一极与复位电压信号端Vini电连接，第九晶体管T9的第二极与第三节点N3电连接。
第十晶体管T10的控制极与第二复位控制端Reset2电连接，第十晶体管T10的第一极与复位电压信号端Vini电连接，第十晶体管T10的第二极与第三节点N3电连接。
在一些实施例中，扫描信号端Scan被配置为接收针对本行像素的扫描信号，第一复位控制端Reset1被配置为接收针对上一行像素的扫描信号，第二复位控制端Reset2被配置为接收针对下一行像素的扫描信号。在以下描述中，以这一情形作为示例进行描述。
图7A示出了图6的像素电路的信号时序图。图7B-图7F示出了图6的像素电路的各阶段原理示意图。
具体地，参见图7A，每一帧中分三个时段tp1、tp2和tp3，每个时段分别用于驱动一个发光单元(即一个子像素)发光。具体地，tp1时段用于驱动第一发光单元R，tp2时段用于驱动第二发光单元G，tp3时段用于驱动第三发光单元B。每个时段又分为三个阶段，即初始化阶段、充电阶段以及发光阶段。
先描述第一时段tpl，在此阶段将驱动第一发光单元R发光。
在初始化阶段P1期间，第一发光控制端EM1、第二发光控制端EM2和第三发光控制端EM3均提供高电平信号，从而T1-T5全部截止。
第一复位控制端Reset1提供低电平信号，第二复位控制端Reset2和扫描信号端Scan提供高电平信号。从而，T7、T8和T10截止，T9导通。通过Vini将第三节点N3复位。假定Vini的电压为VGL，则此时第三节点N3被复位为VGL。并且，通过电容C1的作用，N3的电压将浮置的第一节点N1的电压变为VGL，使得T6导通，将第一电源端VDD的电压Vdd传送到第二节点N2。
在P1阶段，像素电路的原理示意图如图7B所示，应该指出的是，图7B中将本阶段截止的晶体管通过斜十字“×”标记。
在充电阶段P2期间，第一发光控制端EM1、第二发光控制端EM2和第三发光控制端EM3保持提供高电平信号，从而T1-T5保持截止。
扫描信号端Scan提供提供低电平信号，第一复位控制端Reset1与第二复位控制端Reset2提供高电平信号。从而，T7、T8导通，T9和T10截止。此时，高电平数据电压Vdata通过数据信号端Data输入到第三节点N3，将第一电容C1的第一端的电平变为Vdata。另一方面，第一节点N1和第二节点N2电连接，第一电源信号端VDD开始对第一节点充电，直到N1点的电平变为Vdd+Vth时达到平衡，其中Vth是第六晶体管T6的阈值电压。
在这一阶段，通过数据电压端Data和第一电源端VDD的充电，在第一电容C1的两端施加了不同的电压，产生了电压差Vdd+Vth-Vdata。
在P2阶段，像素电路的原理示意图如图7C所示，应该指出的是，图7C中将本阶段截止的晶体管通过斜十字“×”标记。
在发光阶段P3期间，第二发光控制端EM2和第三发光控制端EM3保持提供高电平信号，第一发光控制端EM1提供低电平信号，从而T1、T3和T5保持截止，T2和T4导通，使得第一发光元件R的两端分别与第二节点N2和第二电源端VSS接通。
扫描信号端Scan和第一复位控制端Reset1提供高电平信号，第二复位控制端Reset2提供低电平信号。从而，T10导通，T7至T9截止。此时，复位信号端Vini将第三节点N3的电压变为VGL。由于第一节点N1再次变为浮置，第一电容C1保持此前产生的压差。从而，第一节点N1的电压变为Vdd+Vth-Vdata+VGL。此时，第六晶体管T6处于饱和状态。对于P型晶体管T6来讲，其源栅电压Vsg为：
Vsg＝Vdd-(Vdd+Vth-Vdata+VGL)＝Vdata-VGL-Vth。
从而，驱动电流Id的表达式为：
Id＝K·(Vgs-Vth)2
＝K·(-Vdata+VGL+Vth-Vth)2
＝K·(Vdata-VGL)2
其中，K为关联于第六晶体管T6的电流常数，与第六晶体管T6的工艺参数和几何尺寸有关。由以上公式可知，用于驱动第一发光元件R进行发光的驱动电流Id与第六晶体管T6的阈值电压Vth无关，从而可以消除由于第六晶体管T6的阈值电压Vth存在差异而导致的发光元件亮度不均的现象。
在P3阶段，像素电路的原理示意图如图7D所示，应该指出的是，图7D中将本阶段截止的晶体管通过斜十字“×”标记。
接下来描述第二时段tp2，在此阶段将驱动第二发光单元G发光。
从时序图图7A可以看出，第二时段tp2的初始化阶段P4和充电阶段P5与第一时段tpl的初始化阶段P1和充电阶段P2的操作完全相同，在此不再进行赘述。
第二时段tp2与第一时段tp1的区别在于发光阶段，在发光阶段P6期间，第一发光控制端EM1和第三发光控制端EM3保持提供高电平信号，第二发光控制端EM2提供低电平信号，从而T2、T3和T4截止，T1和T5导通，使得第二发光元件G的两端分别与第二节点N2和第二电源端VSS接通。
扫描信号端Scan和第一复位控制端Resetl提供高电平信号，第二复位控制端Reset2提供低电平信号。从而，T10导通，T7至T9截止。此时，复位信号端Vini将第三节点N3的电压变为VGL。由于第一节点N1再次变为浮置，第一电容C1保持此前产生的压差。从而，第一节点N1的电压变为Vdd+Vth-Vdata+VGL。此时，第六晶体管T6处于饱和状态。对于P型晶体管T6来讲，其源栅电压Vsg为：
Vsg＝Vdd-(Vdd+Vth-Vdata+VGL)＝Vdata-VGL-Vth。
从而，驱动电流Id的表达式为：
Id＝K·(Vgs-Vth)2
＝K·(-Vdata+VGL+Vth-Vth)2
＝K·(Vdata-VGL)2
其中，K为关联于第六晶体管T6的电流常数，与第六晶体管T6的工艺参数和几何尺寸有关。由以上公式可知，用于驱动第二发光元件G进行发光的驱动电流Id与第六晶体管T6的阈值电压Vth无关，从而可以消除由于第六晶体管T6的阈值电压Vth存在差异而导致的发光元件亮度不均的现象。
在P6阶段，像素电路的原理示意图如图7E所示，应该指出的是，图7E中将本阶段截止的晶体管通过斜十字“×”标记。
最后，描述第三时段tp3，在此阶段将驱动第三发光单元B发光。
从时序图图7A可以看出，第三时段tp3的初始化阶段P7和充电阶段P8与第一时段tp1的初始化阶段P1和充电阶段P2的操作完全相同，在此不再进行赘述。
第三时段tp3与第一时段tp1的区别在于发光阶段，在发光阶段P9期间，第一发光控制端EM1和第二发光控制端EM2保持提供高电平信号，第三发光控制端EM3提供低电平信号，从而T1、T2、T4和T5截止，T3导通，使得第三发光元件B的两端分别与第二节点N2和第二电源端VSS接通。
扫描信号端Scan和第一复位控制端Reset1提供高电平信号，第二复位控制端Reset2提供低电平信号。从而，T10导通，T7至T9截止。此时，复位信号端Vini将第三节点N3的电压变为VGL。由于第一节点N1再次变为浮置，第一电容C1保持此前产生的压差。从而，第一节点N1的电压变为Vdd+Vth-Vdata+VGL。此时，第六晶体管T6处于饱和状态。对于P型晶体管T6来讲，其源栅电压Vsg为：
Vsg＝Vdd-(Vdd+Vth-Vdata+VGL)＝Vdata-VGL-Vth。
从而，驱动电流Id的表达式为：
Id＝K·(Vgs-Vth)2
＝K·(-Vdata+VGL+Vth-Vth)2
＝K·(Vdata-VGL)2
其中，K为关联于第六晶体管T6的电流常数，与第六晶体管T6的工艺参数和几何尺寸有关。由以上公式可知，用于驱动第三发光元件B进行发光的驱动电流Id与第六晶体管T6的阈值电压Vth无关，从而可以消除由于第六晶体管T6的阈值电压Vth存在差异而导致的发光元件亮度不均的现象。
在P9阶段，像素电路的原理示意图如图7F所示，应该指出的是，图7F中将本阶段截止的晶体管通过斜十字“×”标记。
图8示出了图5所示的像素电路的另一详细电路图。图8中的像素电路800与图6中的像素电路600的区别在于发光控制子电路420的电路结构不同。在此，对其他子电路的电路结构不再赘述。
如图8所示，发光控制子电路420可以包括第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4和第五晶体管T5。
第一晶体管T1的控制极与第二发光控制端EM2电连接，第一晶体管T1的第一极与第二节点N2电连接，第一晶体管T1的第二极与第四节点N4电连接。
第二晶体管T2的控制极与第三发光控制端EM3电连接，第二晶体管T2的第一极与第三发光元件B的第二极电连接，第二晶体管T2的第二极与第二电源信号端VSS电连接。
第三晶体管T3的控制极与第三发光控制端EM3电连接，第三晶体管T3的第一极与第二节点N2电连接，第三晶体管T3的第二极与第五节点N5电连接。
第四晶体管T4的控制极与第一发光控制端EM1电连接，第四晶体管T4的第一极与第四节点N4电连接，第四晶体管T4的第二极与第二电源信号端VSS电连接。
第五晶体管T5的控制极与第二发光控制端EM2电连接，第五晶体管T5的第一极与第五节点N5电连接，第五晶体管T5的第二极与第二电源信号端VSS电连接。
第一发光元件R的第一极与第二节点N2电连接，第一发光元件R的第二极与第二发光元件G的第一极电连接于第四节点N4，第二发光元件G的第二极与第三发光元件B的第一极电连接于第五节点N5。
图9示出了根据本公开实施例的显示面板900的示意方框图。
如图9所示，显示面板900可以包括多条扫描线SL；多条数据线DL，与所述多条扫描信号线SL纵横交叉设置；以及多个像素单元910，以矩阵的形式设置在每个扫描信号线和每个数据信号线的交叉处，并且与对应的数据线DL和扫描线SL电连接。所述多个像素单元910中的每一个中设置有根据本公开实施例的像素电路，例如根据图2、图3、图4、图5、图6或图8所示的像素电路。
当通过图4、图5、图6或图8中的像素电路来实现图9的显示面板900时，像素电路中的数据信号端Scan从对应数据线DL接收数据信号，像素电路中的扫描信号端Scan从对应扫描线SL接收扫描信号。
显示面板900可以是电子纸、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
图10示出了根据本公开实施例的像素电路的驱动方法1000的流程图。如上文所述，对像素电路的驱动分第一时段、第二时段和第三时段进行，每一个时段都包括初始化阶段、充电阶段和发光阶段。
所述方法1000包括步骤S1010-步骤S1030，
步骤S1010，在第一时段的发光阶段，提供具有有效电平的第一发光控制信号，提供具有无效电平的第二发光控制信号和第三发光控制信号。
此外，在第一时段的初始化阶段和充电阶段，提供具有无效电平的第一发光控制信号、第二发光控制信号和第三发光控制信号。
在如图6或图8所述的实施例中，晶体管是P型晶体管，有效电平为低电平，无效电平为高电平。
步骤S1020，在第二时段的发光阶段，提供具有有效电平的第二发光控制信号，提供具有无效电平的第一发光控制信号和第三发光控制信号。
此外，在第二时段的初始化阶段和充电阶段，提供具有无效电平的第一发光控制信号、第二发光控制信号和第三发光控制信号。
步骤S1030，在第三时段的发光阶段，提供具有有效电平的第三发光控制信号，提供具有无效电平的第一发光控制信号和第二发光控制信号。
此外，在第三时段的初始化阶段和充电阶段，提供具有无效电平的第一发光控制信号、第二发光控制信号和第三发光控制信号。
以上的详细描述通过使用示意图、流程图和/或示例，已经阐述了众多实施例。在这种示意图、流程图和/或示例包含一个或多个功能和/或操作的情况下，本领域技术人员应理解，这种示意图、流程图或示例中的每一功能和/或操作可以通过各种结构、硬件、软件、固件或实质上它们的任意组合来单独和/或共同实现。
虽然已参照几个典型实施例描述了本公开，但应当理解，所用的术语是说明和示例性、而非限制性的术语。由于本公开能够以多种形式具体实施而不脱离公开的精神或实质，所以应当理解，上述实施例不限于任何前述的细节，而应在随附权利要求所限定的精神和范围内广泛地解释，因此落入权利要求或其等效范围内的全部变化和改型都应为随附权利要求所涵盖。

Claims (17)

1.一种像素电路，包括驱动子电路、发光控制子电路、第一发光元件、第二发光元件和第三发光元件，其中，
所述驱动子电路与第一节点、第一电源信号端和第二节点电连接，用于在第一节点的电压的控制下将来自第一电源信号端的第一电源电压传递到第二节点，
所述发光控制子电路与第二节点、第二电源信号端、第一发光控制端、第二发光控制端、第三发光控制端、第一发光元件的第一极和第二极、第二发光元件的第一极和第二极以及第三发光元件的第一极和第二极电连接，所述发光控制子电路用于在来自第一发光控制端、第二发光控制端和第三发光控制端的第一发光控制信号、第二发光控制信号和第三发光控制信号的控制下，使第二节点的电压和来自第二电源信号端的第二电源电压在第一时段分别传递到第一发光元件的第一极和第二极，在第二时段分别传递到第二发光元件的第一极和第二极，在第三时段分别传递到第三发光元件的第一极和第二极。
2.根据权利要求1所述的像素电路，其中，所述发光控制子电路包括第一晶体管、第二晶体管、第三晶体管、第四晶体管和第五晶体管，其中，
第一晶体管的控制极与第二发光控制端电连接，第一晶体管的第一极与第二节点电连接，第一晶体管的第二极与第四节点电连接，
第二晶体管的控制极与第一发光控制端电连接，第二晶体管的第一极与第二节点电连接，第二晶体管的第二极与第一发光元件的第一极电连接，
第三晶体管的控制极与第三发光控制端电连接，第三晶体管的第一极与第二节点电连接，第三晶体管的第二极与第五节点电连接，
第四晶体管的控制极与第一发光控制端电连接，第四晶体管的第一极与第四节点电连接，第四晶体管的第二极与第二电源信号端电连接，
第五晶体管的控制极与第二发光控制端电连接，第五晶体管的第一极与第五节点电连接，第五晶体管的第二极与第二电源信号端电连接，
第一发光元件的第二极与第二发光元件的第一极电连接于第四节点，第二发光元件的第二极与第三发光元件的第一极电连接于第五节点，第三发光元件的第二极与第二电源信号端电连接。
3.根据权利要求1所述的像素电路，其中，所述发光控制子电路包括第一晶体管、第二晶体管、第三晶体管、第四晶体管和第五晶体管，其中，
第一晶体管的控制极与第二发光控制端电连接，第一晶体管的第一极与第二节点电连接，第一晶体管的第二极与第四节点电连接，
第二晶体管的控制极与第三发光控制端电连接，第二晶体管的第一极与第三发光元件的第二极电连接，第二晶体管的第二极与第二电源信号端电连接，
第三晶体管的控制极与第三发光控制端电连接，第三晶体管的第一极与第二节点电连接，第三晶体管的第二极与第五节点电连接，
第四晶体管的控制极与第一发光控制端电连接，第四晶体管的第一极与第四节点电连接，第四晶体管的第二极与第二电源信号端电连接，
第五晶体管的控制极与第二发光控制端电连接，第五晶体管的第一极与第五节点电连接，第五晶体管的第二极与第二电源信号端电连接，
第一发光元件的第一极与第二节点电连接，第一发光元件的第二极与第二发光元件的第一极电连接于第四节点，第二发光元件的第二极与第三发光元件的第一极电连接于第五节点。
4.根据权利要求1所述的像素电路，其中，所述驱动子电路包括第六晶体管，其中，
第六晶体管的控制极与第一节点电连接，第六晶体管的第一极与第一电源信号端电连接，第六晶体管的第二极与第二节点电连接。
5.根据权利要求1-4中的任一项所述的像素电路，还包括：
存储子电路，电连接在第一节点与第三节点之间，
充电控制子电路，与扫描信号端、数据信号端、第一节点、第二节点、第三节点电连接，用于在来自扫描信号端的第一扫描电压的控制下，使所述第一节点和所述第三节点之间产生电压差，
复位子电路，与第一复位控制端、第二复位控制端、第三节点和复位电压信号端电连接，用于在来自第一复位控制端的第一复位控制信号或来自第二复位控制端的第二复位控制信号的控制下，使用来自所述复位电压信号端的复位电压信号对第三节点进行复位。
6.根据权利要求5所述的像素电路，其中，所述存储子电路包括第一电容，
第一电容的第一端与第三节点电连接，第一电容的第二端与第一节点电连接。
7.根据权利要求5所述的像素电路，其中，所述充电控制子电路包括第七晶体管和第八晶体管，其中
第七晶体管的控制极与扫描信号端电连接，第七晶体管的第一极与数据信号端电连接，第七晶体管的第二极与第三节点电连接，
第八晶体管的控制极与扫描信号端电连接，第八晶体管的第一极与第一节点电连接，第八晶体管的第二极与第二节点电连接。
8.根据权利要求5所述的像素电路，其中，所述复位子电路包括第九晶体管和第十晶体管，其中
第九晶体管的控制极与第一复位控制端电连接，第九晶体管的第一极与复位电压信号端电连接，第九晶体管的第二极与第三节点电连接，
第十晶体管的控制极与第二复位控制端电连接，第十晶体管的第一极与复位电压信号端电连接，第十晶体管的第二极与第三节点电连接。
9.根据权利要求5所述的像素电路，其中，扫描信号端被配置为接收针对本行像素的扫描信号，第一复位控制端被配置为接收针对上一行像素的扫描信号，第二复位控制端被配置为接收针对下一行像素的扫描信号。
10.一种显示面板，包括多个像素单元，所述多个像素单元中的至少一个像素单元包括根据权利要求1-9中的任一项所述的像素电路。
11.根据权利要求10所述的显示面板，其中，所述至少一个像素单元中的每一个包括：
基板；
控制电路层，包括所述驱动子电路和所述发光控制子电路；
中间层，覆盖所述控制电路层；
在所述中间层上在发光区顺序地堆叠的第一电极层、第一发光层、第二电极层、第二发光层、第三电极层、第三发光层和第四电极层，其中，第一发光层、第二发光层和第三发光层分别用作第一发光元件、第二发光元件和第三发光元件。
12.根据权利要求11所述的显示面板，其中，所述第一电极层、第二电极层和第三电极层分别通过贯穿所述中间层的通孔与发光控制子电路电连接。
13.根据权利要求11所述的显示面板，其中，所述第一电极层包括不透明材料，所述第二电极层、所述第三电极层和所述第四电极层包括透明材料。
14.一种对根据权利要求1-9所述的像素电路进行驱动的方法，其中，第一时段、第二时段和第三时段中的每一个都包括初始化阶段、充电阶段和发光阶段，所述方法包括：
在第一时段的发光阶段，提供具有有效电平的第一发光控制信号，提供具有无效电平的第二发光控制信号和第三发光控制信号，
在第二时段的发光阶段，提供具有有效电平的第二发光控制信号，提供具有无效电平的第一发光控制信号和第三发光控制信号，
在第三时段的发光阶段，提供具有有效电平的第三发光控制信号，提供具有无效电平的第一发光控制信号和第二发光控制信号，
在各时段的初始化阶段和充电阶段，提供具有无效电平的第一发光控制信号、第二发光控制信号和第三发光控制信号。
15.一种显示面板，包括多个像素单元，每个像素单元包括：
基板；
控制电路层，布置在所述基板的一个表面上；
中间层，布置在所述控制电路层的背对所述基板的表面上；
在所述中间层上在发光区顺序地堆叠的第一电极层、第一发光层、第二电极层、第二发光层、第三电极层、第三发光层和第四电极层，其中，第一发光层、第二发光层和第三发光层分别用作第一发光元件、第二发光元件和第三发光元件。
16.根据权利要求15所述的显示面板，其中，所述第一电极层、第二电极层和第三电极层分别通过贯穿所述中间层的通孔与控制电路层电连接。
17.根据权利要求15所述的显示面板，其中，所述第一电极层包括不透明材料，所述第二电极层、所述第三电极层和所述第四电极层包括透明材料。
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