CN110349972A - 一种薄膜晶体管基板及其制备方法 - Google Patents

一种薄膜晶体管基板及其制备方法 Download PDF

Info

Publication number
CN110349972A
CN110349972A CN201910537634.3A CN201910537634A CN110349972A CN 110349972 A CN110349972 A CN 110349972A CN 201910537634 A CN201910537634 A CN 201910537634A CN 110349972 A CN110349972 A CN 110349972A
Authority
CN
China
Prior art keywords
layer
film transistor
drain electrode
base plate
thin film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN201910537634.3A
Other languages
English (en)
Inventor
赵文群
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
TCL China Star Optoelectronics Technology Co Ltd
Original Assignee
Shenzhen China Star Optoelectronics Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shenzhen China Star Optoelectronics Technology Co Ltd filed Critical Shenzhen China Star Optoelectronics Technology Co Ltd
Priority to CN201910537634.3A priority Critical patent/CN110349972A/zh
Priority to PCT/CN2019/100865 priority patent/WO2020252876A1/zh
Publication of CN110349972A publication Critical patent/CN110349972A/zh
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1222Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition, shape or crystalline structure of the active layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1259Multistep manufacturing methods
    • H01L27/127Multistep manufacturing methods with a particular formation, treatment or patterning of the active layer specially adapted to the circuit arrangement

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing & Machinery (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Thin Film Transistor (AREA)

Abstract

本发明提供一种薄膜晶体管基板及其制备方法,薄膜晶体管基板包括依次设置的基板、有源层、栅极绝缘层、栅极层、层间介质层、源漏极层、有机层和像素电极层;其中所述有源层的材料采用碘化亚铜。过惰性气体退火处理、水蒸汽退火处理或利用紫外光近室温光分解碘化亚铜薄膜中碘离子的技术,获得稳定性好,质量高的碘化亚铜薄膜,制备得到的碘化亚铜薄膜晶体管结构具有低的操作电压,优异的电学性能,为低功耗、高性能CMOS器件的发展奠定良好的科学基础。

Description

一种薄膜晶体管基板及其制备方法
技术领域
本发明涉及显示面板技术领域,特别涉及一种薄膜晶体管基板及其制备方法。
背景技术
薄膜晶体管(Thin Film Transistor,TFT)在有源矩阵驱动液晶显示器件中发挥了重要的作用,是平板显示的核心部件,每台显示器都集成了数百万甚至上亿个TFT器件。非晶硅薄膜晶体管制程简单成本低,但是其迁移率比较低;低温多晶硅薄膜晶体管虽然迁移率高,但是成本高,而且制程复杂。
目前研究与应用最多的半导体材料为无机金属氧化物,如ZnO、SnO2、In2O3,或其多元的混合物(IGZO)。这些无机金属氧化物均展现n型半导体特征,这极大的限制了CMOS器件与数字集成电路的发展。
然而基于p型半导体器件应用比较少,主要是由于电化学性能适宜于p型半导体材料的相对较少和环境稳定性差等缺点。碘化亚铜CuI是一种绿色环保材料,其中铜和碘元素管饭存在于自然界中;CuI是一种宽禁带的本征P型半导体,带隙3.1ev,在可见光下透明;CuI具有生长温度低,迁移率高(本征载流子迁移率44cm2/Vs),价格低廉等优点。相比其他P型半导体,用CuI制备高性能器件具有更大的潜能。
我们知道在电场下,CuI具有极高载流子浓度且很难控制,导致CuI器件的稳定性很差。
因此,确有必要来开发一种新型的薄膜晶体管基板,以克服现有技术的缺陷。
发明内容
本发明的一个目的是提供一种薄膜晶体管基板,其能够解决现有技术中碘化亚铜薄膜晶体管结构稳定性很差的问题。
为实现上述目的,本发明提供一种薄膜晶体管基板,包括依次设置的基板、有源层、栅极绝缘层、栅极层、层间介质层、源漏极层、有机层和像素电极层;其中所述有源层采用的材料为碘化亚铜。
进一步的,在其他实施方式中,其中所述有源层定义有沟道区、非沟道区和源漏极掺杂区,所述源漏极掺杂区内的有源层掺杂有碘离子。
进一步的,在其他实施方式中,其中所述有源层定义有沟道区、非沟道区和源漏极掺杂区,所述源漏极掺杂区内的有源层掺杂有锌离子。
本发明还提供一种制备本发明涉及的所述薄膜晶体管基板的方法,包括以下步骤:
步骤S1:提供一基板,在所述基板上沉积碘化亚铜薄膜层,形成有源层;
步骤S2:沉积栅极绝缘层和栅极层,对所述有源层进行导体化;
步骤S3:沉积层间介质层,在所述层间介质层上设置第一过孔;沉积源漏极层,刻蚀后形成所述源漏极层图案;沉积有机层,在所述有机层上设置第二过孔;沉积像素电极层,通过刻蚀形成像素电极。
进一步的,在其他实施方式中,其中在所述步骤S1中,沉积所述碘化亚铜薄膜层的方法包括雾化喷雾法、水热法、化学沉积法、脉冲激光沉积和反应磁控溅射中的一种。
进一步的,在其他实施方式中,其中在所述步骤S1中,还包括分解所述碘化亚铜薄膜层中的碘离子,分解所述碘化亚铜薄膜层中的碘离子的方法包括惰性气体退火处理方法、水蒸气退化处理方法和利用紫外光近室温光分解方法中的一种。
进一步的,在其他实施方式中,其中在步骤S2中,对所述有源层进行导体化包括以下步骤:
步骤S21:涂布第一光阻层,对所述第一光阻层进行光阻灰化,灰化形成的区域定义出源漏极掺杂区域;
步骤S22:对所述源漏极掺杂区域和非沟道区域内的所述有源层注入离子进行掺杂。
进一步的,在其他实施方式中,其中在步骤S22中,所述源漏极掺杂区域内的所述栅极绝缘层的厚度大于非沟道区域内的所述栅极绝缘层的厚度。
进一步的,在其他实施方式中,其中所述离子为碘离子。
进一步的,在其他实施方式中,其中所述离子为锌离子。
进一步的,在其他实施方式中,其中所述栅极绝缘层采用的材料包括氧化硅或氮化硅。
进一步的,在其他实施方式中,其中所述栅极层采用的材料包括铝金属或铜金属或钼金属。
相对于现有技术,本发明的有益效果在于:本发明提供一种薄膜晶体管基板及其制备方法,通过惰性气体退火处理、水蒸汽退火处理或利用紫外光近室温光分解碘化亚铜薄膜中碘离子的技术,获得稳定性好,质量高的碘化亚铜薄膜,制备得到的碘化亚铜薄膜晶体管结构具有低的操作电压,优异的电学性能,为低功耗、高性能CMOS器件的发展奠定良好的科学基础。此外,在制备薄膜晶体管基板的过程中,透过不同厚度的栅极绝缘层对有源层注入离子进行掺杂,直接形成掺杂浓度差,减少了制程,节约了成本。
附图说明
为了更清楚地说明本发明实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本发明实施例1提供的薄膜晶体管基板的结构示意图;
图2为本发明实施例1提供的薄膜晶体管基板的制备方法的流程图;
图3为本发明实施例1提供的制备方法中步骤S1时薄膜晶体管基板的结构示意图;
图4为本发明实施例1提供的制备方法中步骤S2时薄膜晶体管基板的结构示意图;
图5为本发明实施例1提供的制备方法中步骤S3时薄膜晶体管基板的结构示意图;
图6为本发明实施例1提供的制备方法中步骤S4时薄膜晶体管基板的结构示意图;
图7为本发明实施例1提供的制备方法中步骤S5时薄膜晶体管基板的结构示意图;
图8为本发明实施例1提供的制备方法中步骤S6时薄膜晶体管基板的结构示意图;
图9为本发明实施例1提供的制备方法中步骤S7时薄膜晶体管基板的结构示意图;
图10为本发明实施例1提供的制备方法中步骤S8时薄膜晶体管基板的结构示意图;
图11为本发明实施例1提供的制备方法中步骤S9时薄膜晶体管基板的结构示意图;
图12为本发明实施例1提供的制备方法中步骤S10时薄膜晶体管基板的结构示意图;
图13为本发明实施例1提供的制备方法中步骤S11时薄膜晶体管基板的结构示意图;
图14为本发明实施例1提供的制备方法中步骤S12时薄膜晶体管基板的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
这里所公开的具体结构和功能细节仅仅是代表性的,并且是用于描述本发明的示例性实施例的目的。但是本发明可以通过许多替换形式来具体实现,并且不应当被解释成仅仅受限于这里所阐述的实施例。
实施例1
本实施例提供一种薄膜晶体管基板,包括依次设置的基板10、第一有源层21和第二有源层22、栅极绝缘层30、第一栅极层41和第二栅极层42、层间介质层50、源漏极层60、有机层70和像素电极层80。
其中第一有源层21和第二有源层22采用的材料为碘化亚铜,碘化亚铜薄膜晶体管结构具有低的操作电压,优异的电学性能。
其中,第一有源层21定义有沟道区25、非沟道区24和源漏极掺杂区23,源漏极掺杂区23内的第一有源层21掺杂有碘离子,此时为P型掺杂。在其他实施方式中,源漏极掺杂区23内的第一有源层21掺杂的离子也可以为锌离子,此时为N型掺杂。
实施例2
本实施例提供一种实施例1涉及的所述薄膜晶体管基板的制备方法,请参阅图2,图1所示为本实施例提供的薄膜晶体管基板的制备方法的流程图,包括以下步骤:
步骤S1:提供一基板10,在基板10上沉积碘化亚铜薄膜层20;
请参阅图3,图3所示为本实施例提供的制备方法中步骤S1时薄膜晶体管基板的结构示意图。
沉积所述碘化亚铜薄膜层的方法包括雾化喷雾法、水热法、化学沉积法、脉冲激光沉积和反应磁控溅射中的一种,可随需要而定,在此不做限定。
步骤S1还包括分解碘化亚铜薄膜层20中的碘离子,获得稳定性好、高质量的碘化亚铜薄膜。
分解碘化亚铜薄膜层20中的碘离子的方法包括惰性气体退火处理方法、水蒸气退化处理方法和利用紫外光近室温光分解方法中的一种。
步骤S2:对碘化亚铜薄膜层进行光阻涂布、曝光显影及刻蚀,形成第一有源层21和第二有源层22;
请参阅图4,图4所示为本实施例提供的制备方法中步骤S2时薄膜晶体管基板的结构示意图。
步骤S3:在第一有源层21和第二有源层22上依次沉积栅极绝缘层30和栅极层40,涂布第一光阻层11和第二光阻层12,定义栅极层图案;
请参阅图5,图5所示为本实施例提供的制备方法中步骤S3时薄膜晶体管基板的结构示意图。
在本实施例中,栅极绝缘层30采用的材料可以是氧化硅或氮化硅,在此不做限定。
在本实施例中,栅极层40采用的材料可以为铝金属或铜金属或钼金属,在此不做限定。
步骤S4:对栅极层刻蚀后形成第一栅极层41和第二栅极层42,在第二光阻层上12涂布第三光阻层13形成保护层,接着对栅极绝缘层30进行刻蚀形成栅极绝缘层图案;
请参阅图6,图6所示为本实施例提供的制备方法中步骤S4时薄膜晶体管基板的结构示意图。
步骤S5:对第一光阻层11进行光阻灰化,灰化形成的区域定义出源漏极掺杂区域23;
请参阅图7,图7所示为本实施例提供的制备方法中步骤S5时薄膜晶体管基板的结构示意图。
步骤S6:刻蚀源漏极掺杂区域23下的第一栅极层41;
请参阅图8,图8所示为本实施例提供的制备方法中步骤S6时薄膜晶体管基板的结构示意图。
步骤S7:对源漏极掺杂区域23和非沟道区域24内的第一有源层21注入第一离子进行掺杂;
请参阅图9,图9所示为本实施例提供的制备方法中步骤S7时薄膜晶体管基板的结构示意图。
其中源漏极掺杂区域23内的栅极绝缘层30的厚度大于非沟道区域14内的栅极绝缘层的厚度,源漏极掺杂区域23内的第一有源层21形成离子掺杂浓度比非沟道区域24内的第一有源层21形成离子掺杂浓度高。利用源漏极掺杂区域23和非沟道区域24内的栅极绝缘层30的厚度不同,源漏极掺杂区域23和非沟道区域24内的第一有源层21形成离子掺杂浓度差,减少了制程,节约了成本。
在本实施例中,第一离子为碘离子或锌离子。第一离子采用锌离子,会形成N型掺杂。
步骤S8:剥离第一光阻层11、第二光阻层12和第三光阻层13;
请参阅图10,图10所示为本实施例提供的制备方法中步骤S8时薄膜晶体管基板的结构示意图。
步骤S9:对栅极绝缘层30进行刻蚀;
请参阅图11,图11所示为本实施例提供的制备方法中步骤S9时薄膜晶体管基板的结构示意图。
步骤S10:在第一栅极层41上沉积第四光阻层14,对第二有源层22注入第二离子进行掺杂;
请参阅图12,图12所示为本实施例提供的制备方法中步骤S10时薄膜晶体管基板的结构示意图。
其中第二离子与第一离子为不同种类的离子;在本实施例中,第二离子为碘离子或锌离子。
步骤S11:剥离第四光阻层14;
请参阅图13,图13所示为本实施例提供的制备方法中步骤S11时薄膜晶体管基板的结构示意图。
步骤S12:沉积层间介质层50,在层间介质层50和栅极绝缘层30上设置第一过孔;沉积源漏极层60,刻蚀后形成源漏极层图案;沉积有机层70,在有机层上设置第二过孔;沉积像素电极层80,通过刻蚀形成像素电极;
请参阅图14,图14所示为本实施例提供的制备方法中步骤S112时薄膜晶体管基板的结构示意图。
本发明的有益效果在于:本发明提供一种薄膜晶体管基板及其制备方法,通过惰性气体退火处理、水蒸汽退火处理或利用紫外光近室温光分解碘化亚铜薄膜中碘离子的技术,获得稳定性好,质量高的碘化亚铜薄膜,制备得到的碘化亚铜薄膜晶体管结构具有低的操作电压,优异的电学性能,为低功耗、高性能CMOS器件的发展奠定良好的科学基础。此外,在制备薄膜晶体管基板的过程中,透过不同厚度的栅极绝缘层对有源层注入离子进行掺杂,直接形成掺杂浓度差,减少了制程,节约了成本。
以上所述仅是本发明的优选实施方式,应当指出,对于本技术领域的普通技术人员,在不脱离本发明原理的前提下,还可以做出若干改进和润饰,这些改进和润饰也应视为本发明的保护范围。

Claims (10)

1.一种薄膜晶体管基板,包括依次设置的基板、有源层、栅极绝缘层、栅极层、层间介质层、源漏极层、有机层和像素电极层;其特征在于,其中所述有源层采用的材料为碘化亚铜。
2.根据权利要求1所述的薄膜晶体管基板,其特征在于,所述有源层定义有沟道区、非沟道区和源漏极掺杂区,所述源漏极掺杂区内的有源层掺杂有碘离子。
3.根据权利要求1所述的薄膜晶体管基板,其特征在于,所述有源层定义有沟道区、非沟道区和源漏极掺杂区,所述源漏极掺杂区内的有源层掺杂有锌离子。
4.一种制备权利要求1所述薄膜晶体管基板的方法,包括以下步骤:
步骤S1:提供一基板,在所述基板上沉积碘化亚铜薄膜层,形成有源层;
步骤S2:沉积栅极绝缘层和栅极层,对所述有源层进行导体化;
步骤S3:沉积层间介质层,在所述层间介质层上设置第一过孔;沉积源漏极层,刻蚀后形成所述源漏极层图案;沉积有机层,在所述有机层上设置第二过孔;沉积像素电极层,通过刻蚀形成像素电极。
5.根据权利要求4所述的制备方法,其特征在于,在所述步骤S1中,沉积所述碘化亚铜薄膜层的方法包括雾化喷雾法、水热法、化学沉积法、脉冲激光沉积和反应磁控溅射中的一种。
6.根据权利要求4所述的制备方法,其特征在于,在所述步骤S1中,还包括分解所述碘化亚铜薄膜层中的碘离子,分解所述碘化亚铜薄膜层中的碘离子的方法包括惰性气体退火处理方法、水蒸气退化处理方法和利用紫外光近室温光分解方法中的一种。
7.根据权利要求4所述的制备方法,其特征在于,在步骤S2中,对所述有源层进行导体化包括以下步骤:
步骤S21:涂布第一光阻层,对所述第一光阻层进行光阻灰化,灰化形成的区域定义出源漏极掺杂区域;
步骤S22:对所述源漏极掺杂区域和非沟道区域内的所述有源层注入离子进行掺杂。
8.根据权利要求7所述的制备方法,其特征在于,在步骤S22中,所述源漏极掺杂区域内的所述栅极绝缘层的厚度大于非沟道区域内的所述栅极绝缘层的厚度。
9.根据权利要求7所述的制备方法,其特征在于,所述离子为碘离子。
10.根据权利要求7所述的制备方法,其特征在于,所述离子为锌离子。
CN201910537634.3A 2019-06-20 2019-06-20 一种薄膜晶体管基板及其制备方法 Pending CN110349972A (zh)

Priority Applications (2)

Application Number Priority Date Filing Date Title
CN201910537634.3A CN110349972A (zh) 2019-06-20 2019-06-20 一种薄膜晶体管基板及其制备方法
PCT/CN2019/100865 WO2020252876A1 (zh) 2019-06-20 2019-08-15 一种薄膜晶体管基板及其制备方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201910537634.3A CN110349972A (zh) 2019-06-20 2019-06-20 一种薄膜晶体管基板及其制备方法

Publications (1)

Publication Number Publication Date
CN110349972A true CN110349972A (zh) 2019-10-18

Family

ID=68182543

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201910537634.3A Pending CN110349972A (zh) 2019-06-20 2019-06-20 一种薄膜晶体管基板及其制备方法

Country Status (2)

Country Link
CN (1) CN110349972A (zh)
WO (1) WO2020252876A1 (zh)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113257877A (zh) * 2021-05-12 2021-08-13 厦门天马微电子有限公司 显示面板及显示装置

Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1763975A (zh) * 2004-10-18 2006-04-26 中华映管股份有限公司 薄膜晶体管及其制造方法
US20060199337A1 (en) * 2005-02-01 2006-09-07 Hsi-Ming Chang Thin film transistor
CN101840865A (zh) * 2010-05-12 2010-09-22 深圳丹邦投资集团有限公司 一种薄膜晶体管的制造方法及用该方法制造的晶体管
CN104752231A (zh) * 2015-03-27 2015-07-01 京东方科技集团股份有限公司 薄膜晶体管及制备方法、阵列基板及制备方法、显示装置
CN105810573A (zh) * 2016-03-15 2016-07-27 深圳市华星光电技术有限公司 薄膜晶体管的制作方法
CN108376712A (zh) * 2018-02-05 2018-08-07 浙江大学 一种基于碘化亚铜的透明薄膜晶体管及制备方法
CN108447822A (zh) * 2018-05-18 2018-08-24 武汉华星光电技术有限公司 Ltps tft基板的制作方法
CN108493098A (zh) * 2018-04-17 2018-09-04 南京邮电大学 基于低温溶液法p型金属碘化物薄膜晶体管的制备方法

Patent Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1763975A (zh) * 2004-10-18 2006-04-26 中华映管股份有限公司 薄膜晶体管及其制造方法
US20060199337A1 (en) * 2005-02-01 2006-09-07 Hsi-Ming Chang Thin film transistor
CN101840865A (zh) * 2010-05-12 2010-09-22 深圳丹邦投资集团有限公司 一种薄膜晶体管的制造方法及用该方法制造的晶体管
CN104752231A (zh) * 2015-03-27 2015-07-01 京东方科技集团股份有限公司 薄膜晶体管及制备方法、阵列基板及制备方法、显示装置
CN105810573A (zh) * 2016-03-15 2016-07-27 深圳市华星光电技术有限公司 薄膜晶体管的制作方法
CN108376712A (zh) * 2018-02-05 2018-08-07 浙江大学 一种基于碘化亚铜的透明薄膜晶体管及制备方法
CN108493098A (zh) * 2018-04-17 2018-09-04 南京邮电大学 基于低温溶液法p型金属碘化物薄膜晶体管的制备方法
CN108447822A (zh) * 2018-05-18 2018-08-24 武汉华星光电技术有限公司 Ltps tft基板的制作方法

Non-Patent Citations (3)

* Cited by examiner, † Cited by third party
Title
CHANG-HO CHOI,JENNA Y.GOARCKI,ZHEN FANG,MARSHALL ALEN,SHUJIE LI: "Low-temperature,Inkjet Printed p-type Copper(I) Iodide Thin Film Transistors", 《JOURNAL OF MATERIALS CHEMISTRY C》 *
M.N.AMALINA,Y.AZILAWATI,N.A.RASHEID,M.RUSOP: "The properties of copper (I) iodide (CuI) thin films prepared by mister atomizer at different doping concentration", 《PROCEDIA ENGINEERING》 *
SEBASTIAN C.DIXON,DAVID O.SCANLON,CLAIRE J.CARMALT,IVAN P.PARKIN: "n-Type doped transparent conducting binary oxides:an overview", 《JOURNAL OF MATERIALS CHEMISTRY C》 *

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113257877A (zh) * 2021-05-12 2021-08-13 厦门天马微电子有限公司 显示面板及显示装置

Also Published As

Publication number Publication date
WO2020252876A1 (zh) 2020-12-24

Similar Documents

Publication Publication Date Title
CN107507841B (zh) 阵列基板及其制作方法、显示装置
US8101949B2 (en) Treatment of gate dielectric for making high performance metal oxide and metal oxynitride thin film transistors
Oh et al. Improving the gate stability of ZnO thin-film transistors with aluminum oxide dielectric layers
CN105702623B (zh) Tft阵列基板的制作方法
CN103779209A (zh) 一种多晶硅薄膜晶体管的制备方法
US20100059745A1 (en) Thin-film transistor display panel and method of fabricating the same
KR20130018300A (ko) 박막 트랜지스터의 반도체층용 산화물 및 스퍼터링 타깃, 및 박막 트랜지스터
CN106128944A (zh) 金属氧化物薄膜晶体管阵列基板的制作方法
CN110867458A (zh) 金属氧化物半导体薄膜晶体管阵列基板及制作方法
CN102683422A (zh) 氧化物薄膜晶体管及制作方法、阵列基板、显示装置
CN102270570A (zh) 使硅层结晶的方法及使用该方法形成薄膜晶体管的方法
CN105304500A (zh) N型tft的制作方法
US8067768B2 (en) Thin-film transistor display panel including an oxide active layer and a nitrogen oxide passivation layer, and method of fabricating the same
CN108550625A (zh) 一种薄膜晶体管及其制作方法
CN110233156A (zh) 薄膜晶体管基板的制作方法及薄膜晶体管基板
CN106356306A (zh) 顶栅型薄膜晶体管的制作方法及顶栅型薄膜晶体管
CN110190066A (zh) 阵列基板和阵列基板的制备方法
CN106328592A (zh) 薄膜晶体管及其制作方法、阵列基板和显示装置
Kim et al. Electrothermal annealing (ETA) method to enhance the electrical performance of amorphous-oxide-semiconductor (AOS) thin-film transistors (TFTs)
CN102651399B (zh) 微晶非晶硅复合型薄膜晶体管及其制造方法
Kim et al. Optimization of dual-fuel combustion synthesis for rapid formation of solution-processed metal-oxide thin-film transistors
CN106972063B (zh) 金属氧化物薄膜晶体管的制作方法
CN110349972A (zh) 一种薄膜晶体管基板及其制备方法
CN107833893A (zh) 阵列基板及其制作方法、显示面板
CN102437195B (zh) 薄膜晶体管及其制造方法

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
CB02 Change of applicant information

Address after: 9-2 Tangming Avenue, Guangming New District, Shenzhen City, Guangdong Province

Applicant after: TCL China Star Optoelectronics Technology Co.,Ltd.

Address before: 9-2 Tangming Avenue, Guangming New District, Shenzhen City, Guangdong Province

Applicant before: Shenzhen China Star Optoelectronics Technology Co.,Ltd.

CB02 Change of applicant information
RJ01 Rejection of invention patent application after publication

Application publication date: 20191018

RJ01 Rejection of invention patent application after publication