CN110136625A - 显示面板和显示装置 - Google Patents

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CN110136625A CN201910412211.9A CN201910412211A CN110136625A CN 110136625 A CN110136625 A CN 110136625A CN 201910412211 A CN201910412211 A CN 201910412211A CN 110136625 A CN110136625 A CN 110136625A
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Abstract

公开了一种显示面板，包括多条数据线、多组栅线和多个像素单元。每组栅线包括至少三条栅线。所述多个像素单元呈阵列排布，每个像素单元包括多个亚像素，并且每个亚像素包括至少两个子亚像素。每行亚像素配置成由相应的一组栅线控制，并且每列亚像素配置成使得所述至少两个子亚像素在各组栅线的控制下从相应的一条数据线接收数据信号。还公开了包括该显示面板的显示装置。

Description

显示面板和显示装置
技术领域
本发明涉及显示领域，具体涉及一种显示面板和包括该显示面板的显示装置。
背景技术
诸如智能手表的可穿戴设备正逐步被消费者所青睐。通过使用半透半反技术，智能可穿戴设备可以实现在强光下反射、暗光下透射的功能。这降低了设备的功耗，并且提高续航时间。在强光下反射的工作模式提高了可穿戴设备在强光下的可适度，提高了消费者的体验性。
发明内容
在一方面，本公开实施例提供了一种显示面板，包括：多条数据线；多组栅线，其中每组栅线包括至少三条栅线；以及多个像素单元，其中所述多个像素单元呈阵列排布，每个像素单元包括多个亚像素，并且每个亚像素包括至少两个子亚像素，其中每行亚像素配置成由相应的一组栅线控制，并且每列亚像素配置成使得所述至少两个子亚像素在各组栅线的控制下从相应的一条数据线接收数据信号。
在一个或多个实施例中，与相邻两行亚像素对应的两组栅线共用一条栅线。
在一个或多个实施例中，所述多组栅线包括与奇数行像素单元对应的奇数组栅线以及与偶数行像素单元对应的偶数组栅线，以及其中相邻两个奇数组栅线共用一条栅线，并且相邻两个偶数组栅线共用一条栅线。
在一个或多个实施例中，对于每个亚像素，所述显示面板还包括多个开关元件，所述多个开关元件中的每个开关元件由相应的一条栅线控制通断。
在一个或多个实施例中，每个亚像素中的每个子亚像素通过所述多个开关元件中的两个开关连接到相应的一条数据线。
在一个或多个实施例中，每个亚像素包括第一子亚像素、第二子亚像素，每组栅线包括第一栅线、第二栅线和第三栅线，并且所述多个开关元件包括第一开关元件、第二开关元件、第三开关元件。
在一个或多个实施例中，所述第一栅线控制所述第一开关的通断，所述第二栅线控制所述第二开关的通断，所述第三栅线控制所述第三开关的通断。
在一个或多个实施例中，对于每个亚像素，第一子亚像素通过第一开关元件和第二开关元件连接到第一数据线，第二子亚像素通过第三开关元件和第二开关元件连接到第一数据线。
在一个或多个实施例中，每个亚像素包括第一子亚像素、第二子亚像素和第三子亚像素，每组栅线包括第一栅线、第二栅线和第三栅线，并且所述多个开关元件包括第一开关元件、第二开关元件、第三开关元件、第四开关元件和第五开关元件。
在一个或多个实施例中，所述第一栅线控制所述第一开关和所述第四开关的通断，所述第二栅线控制所述第二开关的通断，所述第三栅线控制所述第三开关和所述第五开关的通断。
在一个或多个实施例中，对于每个亚像素，第一子亚像素通过第一开关元件和第二开关元件连接到第一数据线，第二子亚像素通过第五开关元件和第四开关元件连接到第一数据线，并且第三子亚像素通过第三开关元件和第二开关元件连接到第一数据线。
在一个或多个实施例中，第一子亚像素、第二子亚像素和第三子亚像素的面积比例为4:2:1。
在一个或多个实施例中，每个亚像素的第一子亚像素、第二子亚像素和第三子亚像素具有相同的基色。
在一个或多个实施例中，每个亚像素的第三子亚像素为白色子亚像素。
在一个或多个实施例中，所述白色子亚像素为全反射子亚像素。
在一个或多个实施例中，所述开关元件为薄膜晶体管。
在另一方面，本公开实施例还提供了一种显示装置，包括如上所述的显示面板。
本公开提供了一种显示面板以及包括该显示面板的显示装置。每个像素单元包括多个亚像素，每个亚像素包括至少两个子亚像素，每行亚像素配置成由相应的一组栅线控制，并且每列亚像素配置成使得所述至少两个子亚像素在各组栅线的控制下从相应的一条数据线接收数据信号。藉此，在与常规设计相比栅线数目更少的情况下增加了显示面板的显示的灰阶和颜色数量。此外，通过全反射子亚像素的设计，在低刷新率显示模式下提高了屏幕的显示亮度，从而提高了用户的体验。
附图说明
为了更清楚地说明本公开实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本公开的一些实施例。
图1是一种显示面板的像素单元的示意图；
图2是用于图1所示像素单元的布线示意图；
图3是用于驱动图2所示像素单元的信号的时序图；
图4是根据本公开实施例的显示面板的像素单元的示意图；
图5是用于图4所示像素单元的布线示意图；以及
图6是用于驱动图4所示像素单元的信号的时序图。
附图仅是示意性的，且不一定按照比例绘制。贯穿所有附图，相同的附图标记指示相同或相似的部分。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚，下面将结合附图对本公开实施例的技术方案作进一步地详细描述。
受限于尺寸和功耗，可穿戴设备的驱动器集成电路(Driver IC)通常只能选用串行外设接口(Serial Peripheral Interface, SPI)信号来进行传输。这种信号为高或低，即0或1，因此无法通过直接控制数据线中控制信号的高低的方式来实现不同显示灰阶。
作为一种解决方案，像素单元中的亚像素被分割为两子亚像素，并且子亚像素被接通或切断以实现不同显示灰阶。图1示意性示出一种显示面板的像素单元的布局。该显示面板包括多个像素单元100(图1中仅其中一个)。每个像素单元100包括三个亚像素，例如第一亚像素110、第二亚像素120和第三亚像素130。以RBG三基色显示系统为例，第一亚像素110为红色亚像素，第二亚像素120为绿色亚像素，并且第三亚像素130为蓝色亚像素。在图1的布局中，每个亚像素分割为两个子亚像素。例如，第一亚像素110包括第一子亚像素110a和第二子亚像素110b，第二亚像素120包括第一子亚像素120a和第二子亚像素120b，并且第三亚像素130包括第一子亚像素130a和第二子亚像素130b。每个亚像素的两个子亚像素按照预设面积比例分割。通常第一子亚像素和第二子亚像素的面积比例为2:1。以第一亚像素110为例，第一子亚像素110a与第二子亚像素110b的面积比例为2:1。
图2示意性示出用于图1所示像素单元的布线图。多个像素单元100呈阵列排布。该显示面板还包括交错布置的多条数据线和多条栅线。图2仅仅示出奇数行的像素单元，z条数据线S1、S2、S3…Sz，以及奇数条栅线G1-0、G1-1、G1-2、G3-0、G3-1、G3-2…Gn-m。此处，n为大于1的正奇数，m为0-2之间的整数。
如图2所示，每行亚像素对应一组栅线，每组栅线包括三条栅线。第一奇数行的像素单元100对应第一组栅线。该第一组栅线包括第一栅线G1-0、第二栅线G1-1和第三栅线G1-2。第二奇数行的像素单元100对应第三组栅线。该第三组栅线包括第三栅线G3-0、第四栅线G3-1和第五栅线G3-2。此处未示出偶数行的像素单元及其对应的各组栅线，例如，第一偶数行的像素单元及其对应的第二组栅线，以及第二偶数行的像素单元及其对应的第四组栅线。相邻两个奇数组栅线可以共用一条栅线，并且相邻两个偶数组栅线可以共用一条栅线，例如，G1-2和G3-0可以为同一栅线。
三个子亚像素中的每个子亚像素分别接通或切断以提供不同显示灰阶。在第一亚像素110中，第一子亚像素110a通过第一开关元件21和第二开关元件22连接到数据线S1，其中第一栅线G1-0控制第一开关元件21的通断，第二栅线G1-1控制第二开关元件22的通断。第二子像素110b通过第三开关元件23和第二开关元件22连接到数据线S1，其中第三栅线G1-2控制第三开关元件23的通断，第二栅线G1-1控制第二开关元件22的通断。两个开关元件共同控制一个子亚像素。第一子亚像素110a由第一开关元件21和第二开关元件22组合控制，并且第二子亚像素110b由第二开关元件22和第三开关元件23组合控制。数据线S1-Sz用于提供驱动子亚像素发光的电信号，例如电压信号。栅线G1-0至Gn-m用于按照一定时序控制每一行亚像素的子亚像素，例如接通或切断相应的子亚像素。例如，栅线G1-0和G1-1同时为高电平(即均为“1”)，第一数据线S1与第一子亚像素110a之间导通，使得第一子亚像素110a接通。栅线G1-1和G1-2同时为高电平时，第一数据线S1与第二子亚像素110b之间导通，使得第二子亚像素110b接通。将相邻三条栅线分为一组，逐组进行扫描，来实现整个显示面板的显示。例如，栅线G1-0、G1-1和G1-2为第一组栅线，栅线G3-0（G1-2）、G3-1和G3-2为第二组栅线，并且其余栅线分组以此类推。在显示时，首先扫描第一组栅线G1-0、G1-1和G1-2，进行第一行像素单元的显示。即，按照时序信号分别控制第一行像素单元中的亚像素110、120、130的子亚像素110a-110b、120a-120b、130a-130b。接着，扫描第二组栅线G2-0、G2-1和G2-2，进行第二行像素单元的显示。接着，扫描第三组栅线G3-0（G1-2）、G3-1和G3-2，进行第三行像素单元的显示。再接着，扫描第四组栅线G4-0（G2-2）、G4-1和G4-2，进行第四行像素单元的显示。如此逐组进行扫描直至最后一组栅线，从而完成显示面板的所有行的显示，即一帧画面的显示。
应当理解，也可能的是，将相邻两条栅线分为一组，逐组进行扫描，来实现整个显示面板的显示，其中两条栅线中的第二条重复扫描一次。例如，栅线G1-0和G1-1为第一组扫描，栅线G1-1和G1-2为第二组扫描，栅线G1-2（G3-0）和G3-1为第三组扫描，并且其余栅线扫描以此类推。在这种情况下，在显示时，首先扫描第一组栅线G1-0、G1-1，显示子亚像素110a、120a、130a。接着，扫描第二组栅线G1-1、G1-2，显示子亚像素110b、120b、130b。接着，扫描第三组栅线G1-2（G3-0）、G3-1，进行第三行子亚像素的显示。再接着，扫描第四组栅线G3-1、G3-2，进行第四行子亚像素的显示。如此逐组进行扫描直至最后一组栅线，从而完成显示面板的所有行的显示，即一帧画面的显示。
对于第一亚像素110而言，共有下列4种不同的显示模式。第一子亚像素110a和第二子亚像素110b均未接通，此时第一亚像素110显示的灰阶用R21表示。第一子亚像素110a未接通并且第二子亚像素110b接通，此时第一亚像素110显示的灰阶用R22表示。第一子亚像素110a接通并且第二子亚像素110b未接通，此时第一亚像素110显示的灰阶用R23表示。第一子亚像素110a和第二子亚像素110b均接通，此时第一亚像素110显示的灰阶用R24表示。由此在每个亚像素中实现了4种不同的显示灰阶R21-R24。例如，在RGB显示系统中，每个像素单元100包括R、G、B三个不同的亚像素110、120、130。通过采用上述像素布局，每个像素单元提供4×4×4=64种颜色的显示。
图3示意性地示出用于驱动图2所示像素单元的时序信号。在图3所示的时序图中，在T1、T2阶段，完成对第一奇数行(第一行)的像素单元的驱动；在T3、T4阶段，完成对第一偶数行(第二行)的像素单元的驱动；在T5、T6阶段，完成对第二奇数行(第三行)亚像素的驱动；并且在T7、T8阶段，完成对第二偶数行(第四行)亚像素的驱动。在后续时间段，依次完成对所有行的亚像素的驱动。
结合图3，描述第一行的像素单元的驱动方式。在T1阶段，第一栅线G1-0和第二G1-1同时为高电平(即均为“1”)并且第三栅线G1-2为低电平(即为“1”)，第一数据线S1与第一子亚像素110a之间导通。在T2阶段，第二栅线G1-1和第三栅线G1-2同时为高电平并且第一栅线G1-0为低电平，第一数据线S1与第二子亚像素110b之间导通。通过设置在T1、T2阶段施加到第一栅线G1-0和第二栅线G1-1上的驱动信号(即高电平或低电平)，在每个亚像素中实现了4种不同的显示灰阶，如上文所述。
图4示意性示出根据本公开实施例的显示面板的像素单元的布局。显示面板包括多个像素单元400(图4中仅出其中一个)。每个像素单元400包括三个亚像素，即第一亚像素410、第二亚像素420和第三亚像素430。以RBG三基色显示系统为例，第一亚像素410为红色亚像素，第二亚像素420为绿色亚像素，并且第三亚像素430为蓝色亚像素。
在图4的实施例中，每个亚像素分割为三个子亚像素。例如，第一亚像素410包括第一子亚像素410a、第二子亚像素410b和第三子亚像素410c，亚像素420包括第一子亚像素420a、第二子亚像素420b和第三子亚像素420c，并且亚像素430包括第一子亚像素430a、第二子亚像素430b和第三子亚像素430c。
每个亚像素的三个子亚像素按照预设面积比例分割。在本公开实施例中，每个亚像素的第一子亚像素、第二子亚像素和第三子亚像素的面积比例为4:2:1。例如，以图4所示像素单元的第一亚像素410为例，第一子亚像素410a、第二子亚像素410b和第三子亚像素410c的面积比例为4:2:1。
图5示意性示出用于图4所示显示面板的像素单元的布线图。与图2所示电路示意图相似，多个像素单元400呈阵列排布，并且数据线S1-Sz与栅线G1-0至Gn-m交错布置。显示面板包括多条数据线和多组栅线，每组栅线包括至少三条栅线。显示面板还包括呈阵列排布的多个像素单元，每个像素单元包括多个亚像素，并且每个亚像素包括至少三个子亚像素。以图4所示显示面板的像素单元为例，每个亚像素包括三个子亚像素。每行像素单元(或亚像素)配置成由相应的一组栅线控制，每列亚像素配置成连接到相应的一条数据线并且配置成使得各子亚像素在各组栅线的控制下从该数据线接收数据信号。图5仅仅示出z条数据线S1、S2、S3…Sz，奇数行的像素单元，以及与奇数行像素单元对应的奇数组栅线所包含的栅线G1-0、G1-1、G1-2、G3-0、G3-1、G3-2…Gn-m。此处，n为大于1的正奇数，m为0-2之间的的整数。
每一行的像素单元对应一组栅线，并且每组栅线包括至少三条栅线。例如，第一奇数行的像素单元400(或者该亚像素单元包括的亚像素)对应第一组栅线。该第一组栅线包括三条栅线，例如第一栅线G1-0、第二栅线G1-1和第三栅线G1-2。第二奇数行的像素单元400对应第三组栅线。该第三组栅线包括三条栅线，例如第三栅线G3-0、第四栅线G3-1和第五栅线G3-2。类似地，每一偶数行的像素单元对应包括至少三条栅线的一组栅线。此处未示出偶数行的像素单元及其对应的各组栅线，例如，第一偶数行(第二行)的像素单元及其对应的第二组栅线，以及第二偶数行(第四行)的像素单元及其对应的第四组栅线。
两个开关元件共同控制一个子亚像素。每个开关元件由对应的一条栅线控制通断。例如，第一子亚像素410a由第一开关元件51和第二开关元件52组合控制，第二子亚像素410b由第四开关元件54和第五开关元件55组合控制，并且第三子亚像素410c由第二开关元件52和第三开关元件53组合控制。
每列亚像素连接到相应一条数据线，并且从相应数据线接收数据信号。在本公开实施例中，每条数据线通过相应的开关元件连接到每个亚像素的各个子亚像素。以图5所示的第一行像素单元的第一亚像素410为例。第一亚像素410包括第一子亚像素410a、第二子亚像素410b和第三子亚像素410c。第一子亚像素410a通过第一开关元件51和第二开关元件52连接到第一数据线S1。第二子亚像素410b通过第五开关元件55和第四开关元件54连接到第一数据线S1。第三子亚像素410c通过第三开关元件53和第二开关元件52连接到第一数据线S1。在本公开实施例中，每个像素单元包括三个亚像素，因此每列像素单元对应三条数据线，这三条数据线中的每一条分别连接到该列像素单元中的三列亚像素。
在一些实施例中，开关元件(例如图2中的开关元件21-23以及图5中的开关元件51-55)可以为薄膜晶体管，或任何其他合适的开关元件。
具体地，例如，开关元件51-55可以为薄膜晶体管。第一开关元件51可以为薄膜晶体管TFT1。第一子亚像素410a连接到薄膜晶体管TFT1的源极和漏极中的一个，薄膜晶体管TFT1的栅极连接到第一栅线G1-0。并且第二开关元件52可以为薄膜晶体管TFT2，薄膜晶体管TFT1的源极和漏极中的另一个连接到薄膜晶体管TFT2的源极和漏极中的一个，薄膜晶体管TFT2的栅极连接到第二栅线G1-1，薄膜晶体管TFT2的源极和漏极中的另一个连接到数据线S1。第三开关元件53可以为薄膜晶体管TFT3，所述薄膜晶体管TFT2的源极和漏极中的一个还连接到薄膜晶体管TFT3的源极和漏极中的一个，薄膜晶体管TFT3的栅极连接到第三栅线G1-1，并且薄膜晶体管TFT3的源极和漏极中的另一个连接到第三像素410c。第四开关元件54可以为薄膜晶体管TFT4，第五开关元件54可以为薄膜晶体管TFT5。第二子亚像素410b连接到薄膜晶体管TFT5的源极和漏极中的一个，薄膜晶体管TFT5的栅极连接到第三栅线G1-2，薄膜晶体管TFT5的源极和漏极中的另一个连接到薄膜晶体管TFT4的源极和漏极中的一个，薄膜晶体管TFT4的栅极连接到第一栅线G1-0，薄膜晶体管TFT4的源极和漏极中的另一个连接到数据线S1。
根据本公开实施例，相邻两个奇数行的像素单元(或者亚像素)对应的两组栅线共用一条栅线，并且相邻两个偶数行的像素单元(或者亚像素)对应的两组栅线共用一条栅线。以图5所示情形为例，多个像素单元呈阵列排布，并且划分为奇数行像素单元(或者亚像素)和偶数行像素单元(或者亚像素)。奇数行像素单元对应于奇数组栅线，并且偶数行像素单元对应于偶数组栅线。因此，相邻两个奇数组栅线共用一条栅线，并且相邻两个偶数组栅线共用一条栅线。例如，第一奇数行(第一行)的像素单元400对应的第一组栅线和第二奇数行(第三行)的像素单元对应的第三组栅线共用一条栅线，即，第三栅线G1-2（G3-0）。类似地，第一偶数行(第二行)的像素单元对应的第二组栅线和第二偶数行(第四行)的像素单元对应的第四组栅线共用一条栅线。
接着描述图5的显示面板的显示过程。在显示时，首先扫描第一组栅线G1-0、G1-1和G1-2，进行第一行的子亚像素的显示。即，按照时序分别控制亚像素410、420、430的子亚像素410a-410c、420a-420c、430a-430c。接着，扫描第二组栅线G2-0、G2-1和G2-2，进行第二行像素单元的显示。接着，扫描第三组栅线G3-0（G1-2）、G3-1和G3-2，进行第三行亚像素的显示。再接着，扫描第四组栅线G4-0（G2-2）、G4-1和G4-2，进行第四行像素单元的显示。如此逐组进行扫描直至最后一组栅线，从而完成显示面板的所有行的显示，即一帧画面的显示。
在上述实施例中，每行像素单元(或亚像素)连接到一组栅线，并且每组栅线包括三条栅线。每个亚像素中的子亚像素分别接通或切断以提供不同显示灰阶。与图2所示情况相比，图5的实施例在不增加数据线和栅线情况下控制三种不同子亚像素的接通和切断。通过这种设计，在不增加数据线和栅线情况下增加了可以控制的子亚像素的数量。并且，与常规的每条栅线分别对应控制每个子亚像素的设计相比减少了栅线的数目。
对于第一亚像素410而言，共有下列8种不同的显示模式。第一子亚像素410a、第二子亚像素410b和第三子亚像素410c均未接通，此时第一亚像素410显示的灰阶用R41表示。第一子亚像素410a和第二子亚像素410b未接通，第三子亚像素410c接通，此时第一亚像素410显示的灰阶用R42表示。第一子亚像素410a和第三子亚像素410c未接通，第二子亚像素410b接通，此时第一亚像素410显示的灰阶用R43表示。由于亚像素显示的亮暗(即灰阶)与亚像素中接通的子亚像素的面积有关，可以得到以下另外5种的显示灰阶。第一子亚像素410a未接通，第二子亚像素410b和第三子亚像素410c接通，此时第一亚像素410显示的灰阶用R44表示。第一子亚像素410a接通，第二子亚像素410b和第三子亚像素410c未接通，此时第一亚像素410显示的灰阶用R45表示。第一子亚像素410a和第三子亚像素410c接通，第二子亚像素410b未接通，此时第一亚像素410显示的灰阶用R46表示。第一子亚像素410a和第二子亚像素410b接通，第三子亚像素410c未接通，此时第一亚像素410显示的灰阶用R47表示。第一子亚像素410a、第二子亚像素410b和第三子亚像素410c均接通，此时第一亚像素410显示的灰阶用R48表示。由此在每个亚像素中实现了8种不同的显示灰阶R41-R48。
对于诸如RGB三基色的显示系统，每个像素单元400的第一亚像素410、第二亚像素420和第三亚像素430分别为红色、绿色、蓝色亚像素。这种情况下，可以提供8×8×8=512种颜色的显示。这提高了所显示的灰阶数量和颜色数量。藉此，显示面板的显示颜色更加丰富，进一步提高用户的体验效果。
图6示意性地示出用于驱动图5所示像素单元的信号的时序图。在图6所示的时序图中，在T1、T2、T3阶段，完成对第一行亚像素的驱动；在T4、T5、T6阶段，完成对第二行亚像素的驱动；在T7、T8、T9阶段，完成对第三行亚像素的驱动；并且在T10、T11、T12阶段，完成对第四行亚像素的驱动。以此类推，通过对相应栅线施加驱动信号，完成对所有行的亚像素的驱动。
结合图6，描述第一行亚像素的驱动方式。在T1阶段，第一栅线G1-0和第二栅线G1-1同时为高电平并且第三栅线G1-2为低电平，第一数据线S1与第一子亚像素410a之间导通。在T2阶段，第二栅线G1-1和第三栅线G1-2同时为高电平并且第一栅线G1-0为低电平，第一数据线S1与第三子亚像素410c之间导通。在T3阶段，第一栅线G1-0和第三栅线G1-2同时为高电平并且第二栅线G1-1为低电平，第一数据线S1与第二子亚像素410b之间导通。通过设置在T1、T2、T3阶段施加到栅线G1-0、G1-1和G1-2上的驱动信号(即高电平或低电平)，在每个亚像素中实现了8种不同的显示灰阶，如上文所述。
应当理解，隔行扫描等扫描模式也是可能的，即，对奇数行的像素单元(或亚像素)与偶数行的像素单元(或亚像素)的扫描可以分开进行。
应当理解，在一些实施例中，在采用不同的扫描模式的情况下，每行像素单元(或亚像素)所连接的栅线的分组的模式可能是不同的。例如，第一行的像素单元400(或者该亚像素单元包括的亚像素)对应第一组栅线。该第一组栅线包括三条栅线，例如第一栅线G1-0、第二栅线G1-1和第三栅线G1-2。第二行的像素单元400(或者该亚像素单元包括的亚像素)对应第二组栅线。该第二组栅线包括三条栅线，例如第三栅线G2-0、第四栅线G2-1和第五栅线G2-2。其他行的像素单元400(或者该亚像素单元包括的亚像素)对应的栅线以此类推。各个亚像素（子亚像素）与栅线以及数据线连接的方式与前述类似，在此不再赘述。在这种情况下，相邻的两组栅线共用一条栅线，即与相邻两行亚像素对应的两组栅线共用一条栅线，例如，第一组栅线与第二组栅线共用一条栅线，即，第三栅线G1-2（G2-0）。相应地，在显示时，可以按照扫描时序分别扫描第一组、第二组……直至最后一组栅线，从而完成第一行、第二行……直至最后一行像素单元的显示。
在上述实施例中，以RGB三基色显示系统为例进行描述。然而应指出，根据本公开的实施例的显示面板可以用于诸如CMYK的更多基色的显示系统。
注意，三种子亚像素与栅线的电路连接关系，并不限于图中所示的关系。例如，三种子亚像素的位置可以互换。
在一些实施例中，每个亚像素中的三个子亚像素具有相同的基色。例如，以图5所示像素单元为例，第一亚像素410为R亚像素，第二亚像素420为G亚像素，并且第三亚像素430为B亚像素。这种情况下，第一亚像素410的第一子亚像素410a、第二子亚像素410b和第三子亚像素410c均为R子亚像素，第二亚像素420的第一子亚像素420a、第二子亚像素420b和第三子亚像素420c均为G子亚像素，并且第三亚像素430的第一子亚像素430a、第二子亚像素430b和第三子亚像素430c均为B子亚像素。
在一些实施例中，三个子亚像素中的一个子亚像素为白色子亚像素。在一些实施例中，三个子亚像素中面积最小的子亚像素为白色子亚像素。例如，在图5所示实施例中，第一亚像素410的第三子亚像素410c，第二亚像素420的第三子亚像素420c，以及第三亚像素430的第三子亚像素430c为白色子亚像素。
在一些实施例中，在每个亚像素中，上述白色子亚像素为全反射子亚像素，并且其它子亚像素为透射子亚像素。当显示面板在例如1HZ的低刷新率下操作时，后置的背光被切断，显示面板的透射部分(即每个亚像素中除白色子亚像素之外的其它子亚像素)无显示。此时，由于存在外部环境光，显示面板的反射部分(即全反射子亚像素)可以通过反射环境光的反射进行显示。藉此，当显示面板在低刷新率工作时，反射率提高，进而使得显示面板子低刷新率时的显示亮度提高。
本公开的实施例中描述的显示面板还可以适用于每行亚像素分别对应多于三条栅线的情形。在这种情况下，可以单独控制的子亚像素的数量将多于三个。
在本文所描述的实施例中，术语“接通”不限于对自发光的像素单元进行充电或通电，任何能够使像素单元发光的手段，例如通过调整液晶的方向使像素单元发光，都应该包括在术语“接通”的范围内。相应地，“切断”则表示与“接通”相反的含义，即使像素单元的子亚像素由发光的状态转变为不发光的状态。
基于同一发明构思，本公开实施例还提供了一种显示装置，包括本公开实施例提供的上述显示面板，该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。该显示装置的实施可以参见上述显示面板的实施例，重复之处不再赘述。
除了在上述各实施例中描述的显示面板之外，该显示装置还可以包括源极驱动器、栅极驱动器和时序控制器。该源极驱动器的输出端连接到显示面板的数据线，并且配置成提供数据信号到数据线。该数据信号被输入到与数据线连接的亚像素或者子亚像素。该栅极驱动器连接到显示面板的栅线，并且配置成提供扫描信号到栅线。当栅线接收到扫描信号后，与栅线连接的某一行亚像素的开关元件接通，从而可以接收数据信号。该时序控制器连接到该源极驱动器和该栅极驱动器。该时序控制器生成栅极控制信号和源极控制信号。该源极控制信号输出到该源极驱动器，并且该栅极控制信号输出到该栅极驱动器，由此控制该源极驱动器和该栅极驱动器的工作。
本公开提供了一种显示面板以及包括该显示面板的显示装置。每个像素单元包括多个亚像素，每个亚像素包括至少两个子亚像素，每行亚像素配置成由相应的一组栅线控制，每列亚像素配置成在各组栅线的控制下从数据线接收数据信号。藉此，在与每条栅线分别对应控制每个子亚像素的常规设计相比减少了栅线的数目的情况下增加了显示面板的显示的灰阶和颜色数量。此外，通过全反射子亚像素的设计，在低刷新率显示模式下提高了屏幕的显示亮度，从而提高了用户的体验。
显然，本领域的技术人员可以对本公开进行各种改动和变型而不脱离本公开的精神和范围。这样，倘若本公开的这些修改和变型属于本公开权利要求及其等同技术的范围之内，则本公开也意图包含这些改动和变型在内。

Claims (17)

1.一种显示面板，包括：
多条数据线；
多组栅线，其中每组栅线包括至少三条栅线；以及
多个像素单元，其中所述多个像素单元呈阵列排布，每个像素单元包括多个亚像素，并且每个亚像素包括至少两个子亚像素，
其中每行亚像素配置成由相应的一组栅线控制，并且每列亚像素配置成使得所述至少两个子亚像素在各组栅线的控制下从相应的一条数据线接收数据信号。
2.根据权利要求1所述的显示面板，其中，与相邻两行亚像素对应的两组栅线共用一条栅线。
3.根据权利要求1所述的显示面板，其中所述多组栅线包括与奇数行像素单元对应的奇数组栅线以及与偶数行像素单元对应的偶数组栅线，以及
其中相邻两个奇数组栅线共用一条栅线，并且相邻两个偶数组栅线共用一条栅线。
4.根据前述权利要求中的任一项所述的显示面板，其中，对于每个亚像素，所述显示面板还包括多个开关元件，所述多个开关元件中的每个开关元件由相应的一条栅线控制通断。
5.根据权利要求4所述的显示面板，其中，每个亚像素中的每个子亚像素通过所述多个开关元件中的两个开关连接到相应的一条数据线。
6.根据权利要求5所述的显示面板，其中每个亚像素包括第一子亚像素、第二子亚像素，每组栅线包括第一栅线、第二栅线和第三栅线，并且所述多个开关元件包括第一开关元件、第二开关元件、第三开关元件。
7.根据权利要求6所述的显示面板，其中，所述第一栅线控制所述第一开关的通断，所述第二栅线控制所述第二开关的通断，所述第三栅线控制所述第三开关的通断。
8.根据权利要求6所述的显示面板，其中，对于每个亚像素，第一子亚像素通过第一开关元件和第二开关元件连接到第一数据线，第二子亚像素通过第三开关元件和第二开关元件连接到第一数据线。
9.根据权利要求5所述的显示面板，其中每个亚像素包括第一子亚像素、第二子亚像素和第三子亚像素，每组栅线包括第一栅线、第二栅线和第三栅线，并且所述多个开关元件包括第一开关元件、第二开关元件、第三开关元件、第四开关元件和第五开关元件。
10.根据权利要求9所述的显示面板，其中，所述第一栅线控制所述第一开关和所述第四开关的通断，所述第二栅线控制所述第二开关的通断，所述第三栅线控制所述第三开关和所述第五开关的通断。
11.根据权利要求9所述的显示面板，其中，对于每个亚像素，第一子亚像素通过第一开关元件和第二开关元件连接到第一数据线，第二子亚像素通过第五开关元件和第四开关元件连接到第一数据线，并且第三子亚像素通过第三开关元件和第二开关元件连接到第一数据线。
12.根据前述权利要求9所述的显示面板，其中第一子亚像素、第二子亚像素和第三子亚像素的面积比例为4:2:1。
13.根据权利要求9-12中任意一项所述的显示面板，其中每个亚像素的第一子亚像素、第二子亚像素和第三子亚像素具有相同的基色。
14.根据权利要求9-12中任意一项所述的显示面板，其中每个亚像素的第三子亚像素为白色子亚像素。
15.根据权利要求14所述的显示面板，其中所述白色子亚像素为全反射子亚像素。
16.根据权利要求4所述的显示面板，其中所述开关元件为薄膜晶体管。
17.一种显示装置，包括根据权利要求1-16中任意一项所述的显示面板。
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