CN110045911B - 模数转换控制电路及单片机模数转换电路 - Google Patents
模数转换控制电路及单片机模数转换电路 Download PDFInfo
- Publication number
- CN110045911B CN110045911B CN201910134314.3A CN201910134314A CN110045911B CN 110045911 B CN110045911 B CN 110045911B CN 201910134314 A CN201910134314 A CN 201910134314A CN 110045911 B CN110045911 B CN 110045911B
- Authority
- CN
- China
- Prior art keywords
- register
- analog
- signal
- bit
- signal bit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/05—Digital input using the sampling of an analogue quantity at regular intervals of time, input from a/d converter or output to d/a converter
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/1205—Multiplexed conversion systems
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
本发明提供一种模数转换控制电路。该模数转换控制电路分别与单片机和多个模数转换器连接,包括:现场可编程门阵列,通过APB总线与单片机连接,并与多个模数转换器连接,用于存储每个模数转换器进行模数转换的相关信号,并通过APB总线自单片机接收相应的控制指令,根据控制指令,获取相应的模数转换器进行模数转换的相关信号,以根据相关信号控制模数转换器执行相关操作或获取模数转换器进行模数转换的相关信息。本发明还提供单片机模数转换电路。本发明的模数转换控制电路可实现对A/D转换器数量的动态管理,增强单片机对A/D转换器数量的扩展性,同时不会增加用户设计的复杂度。
Description
技术领域
本发明的所公开实施例涉及电路技术领域,且更具体而言,涉及一种模数转换控制电路及单片机模数转换电路。
背景技术
模数转换器即A/D转换器,通常是指一个将模拟信号转变为数字信号的电子元件。通常的模数转换器是将一个输入电压信号转换为输出的数字信号。单片机又称微型计算机,其将微控制单元和外设接口整合在单一芯片上,形成芯片级的计算机。
目前单片机获取A/D转换信号主要有两种方案:第一种方案中,单片机厂商内部集成A/D转换器外设,将A/D转换器和转换控制器以硬件方式固化在单片机内部,具有用户使用方便快捷的特点,但单片机厂商集成的A/D转换外设数量有限,不具有扩展性;第二种方案中,单片机通过外接A/D转换器,虽然具有很好的扩展性,但其A/D转换器的控制器部分需要用户软件实现,同时还需要考虑单片机与A/D转换器之间的通信协议,增加了用户设计的复杂度。
发明内容
根据本发明的实施例,本发明提出一种模数转换控制电路及单片机模数转换电路,以解决上述问题。
根据本发明的第一方面,公开一种实例性的一种模数转换控制电路。该模数转换控制电路分别与单片机和多个模数转换器连接,包括:现场可编程门阵列,通过APB总线与所述单片机连接,并与所述多个模数转换器连接,用于存储每个所述模数转换器进行模数转换的相关信号,并通过所述APB总线自所述单片机接收相应的控制指令,根据所述控制指令,获取相应的所述模数转换器进行模数转换的相关信号,以根据所述相关信号控制所述模数转换器执行相关操作或获取所述模数转换器进行模数转换的相关信息。
其中,所述现场可编程门阵列包括多个寄存器组,每个所述寄存器组均与所述APB总线和一个所述模数转换器连接,其中每个所述寄存器组包括:控制寄存器,用于存储模数转换的控制信号;状态寄存器,用于存储模数转换的状态信号;以及数据寄存器,用于存储模数转换后的数字信号;其中,每个所述寄存器组中的所述控制寄存器、所述状态寄存器以及所述数据寄存器分配有不同的APB总线地址。
其中,所述控制指令包括:寄存器地址,用于表示所述模数转换器所连接的寄存器组中任一寄存器;以及总线信号,用于表示对所述寄存器地址所表示的寄存器执行读操作或写操作。
其中,所述总线信号包括第一信号位、第二信号位和第三信号位,其中根据所述总线信号确定对所述寄存器地址所表示的寄存器执行读操作或写操作包括:在所述第一信号位等于1时,判断所述第二信号位是否等于0;若所述第二信号位等于0,则确定对所述寄存器地址所表示的寄存器执行读操作;若所述第二信号位不等于0,则判断所述第三信号位是否等于0;若所述第三信号位等于0,则确定对所述寄存器地址所表示的寄存器执行写操作。
其中,所述总线信号还包括第四信号位,其中当所述第一信号位等于1且所述第二信号位等于0时,所述第四信号位等于第一预设值表示对所述数据寄存器执行读操作,所述第四信号位等于第二预设值表示对所述控制寄存器执行读操作,所述第四信号位等于第三预设值表示对所述状态寄存器执行读操作;当所述第一信号位等于1、所述第二信号位不等于0且所述第三信号位等于0时,所述第四信号位等于所述第二预设值表示对所述控制寄存器执行写操作,所述第四信号位等于所述第三预设值表示对所述状态寄存器执行写操作。
其中,所述第一信号位为所述APB总线的PSEL信号,第二信号位为所述APB总线的PWRITE信号,第三信号位为所述APB总线的PENABLE信号。
其中,所述控制寄存器为6位寄存器,所述状态寄存器为1位寄存器,所述数据寄存器为12位寄存器。
其中,所述控制寄存器包括Channel_sel[2:0]位、Adon位、Soc位以及Eocie位,其中Channel_sel[2:0]位用于控制转换模拟通道的选择,Adon位用于控制转换使能,Soc位用于控制转换开始,Eocie位用于控制中断使能;所述状态寄存器包括Eoc位,其中Eoc位用于表示转换状态标志位;所述数据寄存器包括Data[11:0]位,其中Data[11:0]位用于表示数字信号输出位。
其中,所述Eoc位、Eocie位、Adon位、Soc位、Channel_sel[2:0]位和Data[11:0]位分别与所述模数转换器的EOC引脚、PD引脚、SOC引脚、SEL引脚和ADOUT引脚连接;所述Eoc位和所述Eocie位还经过逻辑与运算连接于所述单片机的中断向量表。
根据本发明的第二方面,公开一种实例性的一种单片机模数转换电路。该单片机模数转换电路包括:单片机,用于发送控制指令;现场可编程门阵列,通过APB总线与所述单片机连接,用于存储每个所述模数转换器进行模数转换的相关信号,并通过所述APB总线自所述单片机接收控制指令,根据所述控制指令,获取所述模数转换器进行模数转换的相关信号;以及多个模数转换器,分别与所述现场可编程门阵列连接,用于根据所述相关信号,执行相关操作。
本发明的有益效果有:通过FPGA经过APB总线与单片机连接,实现模数转换控制电路,进而实现对A/D转换器数量的动态管理,增强单片机对A/D转换器数量的扩展性,同时不会增加用户设计的复杂度。
附图说明
图1是本发明第一实施例的模数转换控制电路的结构示意图。
图2是本发明第二实施例的模数转换控制电路的结构示意图。
图3是本发明实施例的根据总线信号确定对寄存器执行读操作或写操作的流程图。
图4是本发明第三实施例的模数转换控制电路的部分结构示意图。
图5是本发明实施例的单片机模数转换电路的结构示意图。
具体实施方式
本说明书及权利要求书通篇中所用的某些用语指代特定部件。如所属领域的技术人员可以理解的是,电子设备制造商可利用不同名称来指代同一个部件。本文并非以名称来区分部件,而是以功能来区分部件。在以下说明书及权利要求书中,用语“包括”是开放式的限定词语,因此其应被解释为意指“包括但不限于…”。另外,用语“耦合”旨在意指间接电连接或直接电连接。因此,当一个装置耦合到另一装置时,则这种连接可以是直接电连接或通过其他装置及连接部而实现的间接电连接。
如图1所示,为本发明第一实施例的模数转换控制电路200的结构示意图。该模数转换控制电路200分别与单片机100和多个模数转换器1-n连接。具体地,该模数转换控制电路200包括现场可编程门阵列(Field Programmable Gate Array,FPGA)220,其中FPGA 220通过APB总线210与单片机100连接,并与多个模数转换器1-n连接。FPGA 220用于存储每个模数转换器进行模数转换的相关信号,并通过APB总线210自单片机100接收相应的控制指令,根据控制指令,获取相应的模数转换器进行模数转换的相关信号,以根据相关信号控制模数转换器执行相关操作或获取模数转换器进行模数转换的相关信息。
在图1的示例中,多个模数转换器1-n以n个模数转换器为例进行说明,其中n为正整数。例如,FPGA 220存储有模数转换器2进行模数转换的控制信号,FPGA 220自单片机100接收与模数转换器2对应的控制指令,根据该控制指令,获取所存储的模数转换器2进行模数转换的控制信号,进而,根据该控制信号,模数转换器2被控制执行相关操作。在一示例中,该控制信号表示转换使能,模数转换器2被控制执行开启或关闭操作,即模数转换器2被开启或关闭。又例如,FPGA 220存储有模数转换器3进行模数转换的状态信号,FPGA220自单片机100接收与模数转换器3对应的控制指令,根据该控制指令,获取所存储的模数转换器3进行模数转换的状态信号,进而根据该控制信号,获取模数转换器3进行模数转换的状态信息。在一示例中,该状态信号表示转换状态,当该状态信号为高电平时,表示模数转换结束。又例如,FPGA 220存储有模数转换器1进行模数转换后的数字信号,FPGA 220自单片机100接收与模数转换器1对应的控制指令,进而根据该控制指令,获取模数转换器1进行模数转换后的数字信号。
在本实施例中,通过FPGA经过APB总线与单片机连接,实现模数转换控制电路,进而实现对A/D转换器数量的动态管理,增强单片机对A/D转换器数量的扩展性,同时不会增加用户设计的复杂度。
如图2所示,为本发明第二实施例的模数转换控制电路200的结构示意图,在上述实施例的基础上,现场可编程门阵列220包括多个寄存器组221,每个寄存器组221均与APB总线210和一个模数转换器连接,其中每个寄存器组221包括控制寄存器a、状态寄存器b和数据寄存器c。控制寄存器a用于存储模数转换的控制信号,状态寄存器b用于存储表示转换状态的状态信号,数据寄存器c用于存储模数转换后的数字信号。
其中,每个寄存器组221中的控制寄存器a、状态寄存器b以及数据寄存器c分配有不同的APB总线地址。若要对寄存器组221中的某个寄存器进行例如读操作或写操作等操作时,可以根据寄存器中的每个寄存器的APB总线地址来选中该寄存器,接着确定对该寄存器是进行读操作还是写操作,进而对该寄存器进行读操作或写操作,以获取该寄存器中的相关信号或向该寄存器中存储相关信号。
在本实施例中,通过每个寄存器组均与APB总线和一个模数转换器连接,可以实现根据需求在APB总线上挂载不同数量的A/D转换器,并且每个模数转换器均与相同的寄存器组连接,相同的寄存器组的操作方法一致,提供良好的用户软件层面的可移植性和扩展性。
如上所述,FPGA 220通过APB总线210自单片机100接收相应的控制指令,根据控制指令,获取相应的模数转换器进行模数转换的相关信号,以根据相关信号控制模数转换器执行相关操作或获取模数转换器进行模数转换的相关信息。
在一示例中,控制指令包括寄存器地址和总线信号。其中寄存器地址用于表示模数转换器所连接的寄存器组221中任一寄存器,也就是说,寄存器组221中的每个寄存器分配有不同的寄存器地址。总线信号用于表示对寄存器地址所表示的寄存器执行读操作或写操作,也就是说,根据总线信号可以确定对寄存器地址所表示的寄存器执行读操作还是写操作。
进一步地,寄存器地址可以为APB总线地址,例如,控制寄存器a的APB总线地址表示该控制寄存器a。若单片机100需要控制A/D转换器2执行相关操作,则相应的控制指令包括与A/D转换器2连接的寄存器组221中的控制寄存器a的APB总线地址,此时,表示需要对该APB总线地址所表示的控制寄存器a进行相关操作,以获取该APB总线地址所表示的控制寄存器a内的控制信号,进而根据该控制信号,控制A/D转换器2执行相关操作。
总线信号可以由解析APB总线210得到。在一实施例中,总线信号包括第一信号位、第二信号位和第三信号位。如上所述,总线信号用于对寄存器地址所表示的寄存器执行读操作或写操作,也就是说,根据总线信号可以确定对寄存器地址所表示的寄存器执行读操作还是写操作。具体地,在一示例中,如图3所示,根据总线信号确定对寄存器地址所表示的寄存器执行读操作或写操作包括:
步骤310:判断第一信号位是否等于1。若是,则执行步骤320。
步骤320:判断第二信号位是否等于0。若是,则执行步骤330,若否,则执行步骤340。
步骤330:确定对寄存器地址所表示的寄存器执行读操作;
步骤340:判断第三信号位是否等于0。若是,则执行步骤350。
步骤350:确定对寄存器地址所表示的寄存器执行写操作。
在一示例中,总线信号还包括第四信号位,其中当第一信号位等于1且第二信号位等于0时,第四信号位等于第一预设值表示对数据寄存器c执行读操作,第四信号位等于第二预设值表示对控制寄存器a执行读操作,第四信号位等于第三预设值表示对状态寄存器b执行读操作;当第一信号位等于1、第二信号位不等于0且第三信号位等于0时,第四信号位等于第二预设值表示对控制寄存器a执行写操作,第四信号位等于第三预设值表示对状态寄存器b执行写操作。在确定执行读操作时,可以依次判断第四信号位是否等于第一预设值、第二预设值和第三预设值,进而确定对哪个寄存器执行读操作,同样地,在确定执行写操作时,可以依次判断第四信号位是否等于第二预设值和第三预设值,进而确定对控制寄存器a还是状态寄存器b执行写操作。
在一示例中,第一信号位为APB总线210的PSEL信号,第二信号位为APB总线210的PWRITE信号,第三信号位为APB总线210的PENABLE信号。进一步地,第四信号位为APB总线210的PADDR信号。在第四信号位为APB总线210的PADDR信号的示例中,第一预设值为0,第二预设值为0X4,第三预设值为0X8。
在一实施例中,控制寄存器a为6位寄存器,状态寄存器b为1位寄存器,数据寄存器c为12位寄存器。下面结合图4,其为本发明第三实施例的模数转换控制电路的部分结构示意图,对一个寄存器组221进行详细说明。
如上所述,每个寄存器组221包括控制寄存器a、状态寄存器b和状态寄存器c。如图4所示,控制寄存器a包括Channel_sel[2:0]位、Adon位、Soc位以及Eocie位,其中Channel_sel[2:0]位用于控制转换模拟通道的选择,Adon位用于控制转换使能,Soc位用于控制转换开始,Eocie位用于控制中断使能。状态寄存器b包括Eoc位,其中Eoc位用于表示转换状态标志位。数据寄存器c包括Data[11:0]位,其中Data[11:0]位用于表示数字信号输出位。
Eoc位、Eocie位、Adon位、Soc位、Channel_sel[2:0]位和Data[11:0]位分别与模数转换器的EOC引脚、PD引脚、SOC引脚、SEL引脚和ADOUT引脚连接。Eoc位和Eocie位还经过逻辑与运算222连接于单片机100的中断向量表,也就是说,Eoc位和Eocie位进行逻辑与运算输出到单片机100的中断向量表。
模数转换器的CLK引脚输入外部的A/D转换时钟信号,模数转换器的CH[7:0]引脚输入模拟信号,模数转换器的VREF引脚输入转换参考电压。
如图5所示,为本发明实施例的单片机模数转换电路的结构示意图。该单片机模数转换电路500包括单片机510、现场可编程门阵列520和多个模数转换器1-n。其中现场可编程门阵列520通过APB总线530与单片机510连接,多个模数转换器1-n分别与现场可编程门阵列520连接。单片机510用于发送控制指令,FPGA 520用于存储每个模数转换器进行模数转换的相关信号,并通过APB总线530接收单片机510的控制指令,根据单片机510的控制指令,获取模数转换器进行模数转换的相关信号。多个模数转换器1-n用于根据相关信号,执行相关操作。
单片机510、现场可编程门阵列520和多个模数转换器1-n与上述实施例的单片机100、现场可编程门阵列220和多个模数转换器1-n相同,在此不再进行说明,相关说明详见上述实施例。
在本实施例中,通过FPGA经过APB总线与单片机连接,实现对A/D转换器数量的动态管理,增强单片机对A/D转换器数量的扩展性,同时不会增加用户设计的复杂度。
所属领域的技术人员易知,可在保持本发明的教示内容的同时对装置及方法作出诸多修改及变动。因此,以上公开内容应被视为仅受随附权利要求书的范围的限制。
Claims (6)
1.一种模数转换控制电路,其特征在于,分别与单片机和多个模数转换器连接,包括:
现场可编程门阵列,通过APB总线与所述单片机连接,并与所述多个模数转换器连接,用于存储每个所述模数转换器进行模数转换的相关信号,并通过所述APB总线自所述单片机接收相应的控制指令,根据所述控制指令,获取相应的所述模数转换器进行模数转换的相关信号,以根据所述相关信号控制所述模数转换器执行相关操作或获取所述模数转换器进行模数转换的相关信息;
其中,所述现场可编程门阵列包括多个寄存器组,每个所述寄存器组均与所述APB总线和一个所述模数转换器连接,其中每个所述寄存器组包括:
控制寄存器,用于存储模数转换的控制信号,其中所述控制信号表示相应的所述模数转换器的转换使能;
状态寄存器,用于存储模数转换的状态信号;以及
数据寄存器,用于存储模数转换后的数字信号;
其中,每个所述寄存器组中的所述控制寄存器、所述状态寄存器以及所述数据寄存器分配有不同的APB总线地址;
其中,所述控制指令包括:
寄存器地址,用于表示所述模数转换器所连接的寄存器组中任一寄存器;以及
总线信号,用于表示对所述寄存器地址所表示的寄存器执行读操作或写操作;
其中,所述总线信号包括第一信号位、第二信号位和第三信号位,其中根据所述总线信号确定对所述寄存器地址所表示的寄存器执行读操作或写操作包括:
在所述第一信号位等于1时,判断所述第二信号位是否等于0;
若所述第二信号位等于0,则确定对所述寄存器地址所表示的寄存器执行读操作;
若所述第二信号位不等于0,则判断所述第三信号位是否等于0;
若所述第三信号位等于0,则确定对所述寄存器地址所表示的寄存器执行写操作;
其中,所述总线信号还包括第四信号位,其中当所述第一信号位等于1且所述第二信号位等于0时,所述第四信号位等于第一预设值表示对所述数据寄存器执行读操作,所述第四信号位等于第二预设值表示对所述控制寄存器执行读操作,所述第四信号位等于第三预设值表示对所述状态寄存器执行读操作;当所述第一信号位等于1、所述第二信号位不等于0且所述第三信号位等于0时,所述第四信号位等于所述第二预设值表示对所述控制寄存器执行写操作,所述第四信号位等于所述第三预设值表示对所述状态寄存器执行写操作。
2.如权利要求1中所述的模数转换控制电路,其特征在于,所述第一信号位为所述APB总线的PSEL信号,第二信号位为所述APB总线的PWRITE信号,第三信号位为所述APB总线的PENABLE信号。
3.如权利要求1中所述的模数转换控制电路,其特征在于,所述控制寄存器为6位寄存器,所述状态寄存器为1位寄存器,所述数据寄存器为12位寄存器。
4.如权利要求3中所述的模数转换控制电路,其特征在于,所述控制寄存器包括Channel_sel[2:0]位、Adon位、Soc位以及Eocie位,其中Channel_sel[2:0]位用于控制转换模拟通道的选择,Adon位用于控制转换使能,Soc位用于控制转换开始,Eocie位用于控制中断使能;
所述状态寄存器包括Eoc位,其中Eoc位用于表示转换状态标志位;
所述数据寄存器包括Data[11:0]位,其中Data[11:0]位用于表示数字信号输出位。
5.如权利要求4中所述的模数转换控制电路,其特征在于,所述Eoc位、Eocie位、Adon位、Soc位、Channel_sel[2:0]位和Data[11:0]位分别与所述模数转换器的EOC引脚、PD引脚、SOC引脚、SEL引脚和ADOUT引脚连接;
所述Eoc位和所述Eocie位还经过逻辑与运算连接于所述单片机的中断向量表。
6.一种单片机模数转换电路,其特征在于,包括:
单片机,用于发送控制指令;
现场可编程门阵列,通过APB总线与所述单片机连接,用于存储每个所述模数转换器进行模数转换的相关信号,并通过所述APB总线自所述单片机接收控制指令,根据所述控制指令,获取所述模数转换器进行模数转换的相关信号;以及
多个模数转换器,分别与所述现场可编程门阵列连接,用于根据所述相关信号,执行相关操作;
其中,所述现场可编程门阵列包括多个寄存器组,每个所述寄存器组均与所述APB总线和一个所述模数转换器连接,其中每个所述寄存器组包括:
控制寄存器,用于存储模数转换的控制信号,其中所述控制信号表示相应的所述模数转换器的转换使能;
状态寄存器,用于存储模数转换的状态信号;以及
数据寄存器,用于存储模数转换后的数字信号;
其中,每个所述寄存器组中的所述控制寄存器、所述状态寄存器以及所述数据寄存器分配有不同的APB总线地址;
其中,所述控制指令包括:
寄存器地址,用于表示所述模数转换器所连接的寄存器组中任一寄存器;以及
总线信号,用于表示对所述寄存器地址所表示的寄存器执行读操作或写操作;
其中,所述总线信号包括第一信号位、第二信号位和第三信号位,其中根据所述总线信号确定对所述寄存器地址所表示的寄存器执行读操作或写操作包括:
在所述第一信号位等于1时,判断所述第二信号位是否等于0;
若所述第二信号位等于0,则确定对所述寄存器地址所表示的寄存器执行读操作;
若所述第二信号位不等于0,则判断所述第三信号位是否等于0;
若所述第三信号位等于0,则确定对所述寄存器地址所表示的寄存器执行写操作;
其中,所述总线信号还包括第四信号位,其中当所述第一信号位等于1且所述第二信号位等于0时,所述第四信号位等于第一预设值表示对所述数据寄存器执行读操作,所述第四信号位等于第二预设值表示对所述控制寄存器执行读操作,所述第四信号位等于第三预设值表示对所述状态寄存器执行读操作;当所述第一信号位等于1、所述第二信号位不等于0且所述第三信号位等于0时,所述第四信号位等于所述第二预设值表示对所述控制寄存器执行写操作,所述第四信号位等于所述第三预设值表示对所述状态寄存器执行写操作。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201910134314.3A CN110045911B (zh) | 2019-02-22 | 2019-02-22 | 模数转换控制电路及单片机模数转换电路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201910134314.3A CN110045911B (zh) | 2019-02-22 | 2019-02-22 | 模数转换控制电路及单片机模数转换电路 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN110045911A CN110045911A (zh) | 2019-07-23 |
CN110045911B true CN110045911B (zh) | 2020-09-25 |
Family
ID=67274316
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201910134314.3A Active CN110045911B (zh) | 2019-02-22 | 2019-02-22 | 模数转换控制电路及单片机模数转换电路 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN110045911B (zh) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN110765065A (zh) * | 2019-09-09 | 2020-02-07 | 广东高云半导体科技股份有限公司 | 片上系统 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN201904776U (zh) * | 2010-12-16 | 2011-07-20 | 国网电力科学研究院 | 多通道adc同步采样处理电路 |
CN104516990A (zh) * | 2014-12-17 | 2015-04-15 | 中国科学院长春光学精密机械与物理研究所 | 在线式高速多通道光谱数据采集系统 |
CN107255961A (zh) * | 2017-06-14 | 2017-10-17 | 电子科技大学 | 一种高效数据交互的无线智能示波器 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN101592706B (zh) * | 2009-07-08 | 2011-05-18 | 天津渤海易安泰电子半导体测试有限公司 | 数字模拟混合信号芯片测试卡 |
CN101820564A (zh) * | 2010-03-16 | 2010-09-01 | 电子科技大学 | 微型多声道声频定向扬声器 |
KR20130116672A (ko) * | 2012-04-16 | 2013-10-24 | 한국전자통신연구원 | 다지점 데이터 수집 장치 및 방법 |
CN203233375U (zh) * | 2013-04-17 | 2013-10-09 | 中国科学院等离子体物理研究所 | 基于fpga的多通道高精度脉冲控制器 |
CN106374927A (zh) * | 2016-08-30 | 2017-02-01 | 成都金本华电子有限公司 | 一种基于FPGA和PowerPC的多通道高速AD系统 |
CN207440565U (zh) * | 2017-10-30 | 2018-06-01 | 湖南跨线桥航天科技有限公司 | 基于射频adc的多通道导航阵列信号采集处理主板 |
CN107994903B (zh) * | 2017-12-15 | 2021-07-16 | 北京特邦微电子科技有限公司 | 模数转换电路及流水线模数转换器 |
-
2019
- 2019-02-22 CN CN201910134314.3A patent/CN110045911B/zh active Active
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN201904776U (zh) * | 2010-12-16 | 2011-07-20 | 国网电力科学研究院 | 多通道adc同步采样处理电路 |
CN104516990A (zh) * | 2014-12-17 | 2015-04-15 | 中国科学院长春光学精密机械与物理研究所 | 在线式高速多通道光谱数据采集系统 |
CN107255961A (zh) * | 2017-06-14 | 2017-10-17 | 电子科技大学 | 一种高效数据交互的无线智能示波器 |
Also Published As
Publication number | Publication date |
---|---|
CN110045911A (zh) | 2019-07-23 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
TW498164B (en) | Integrated circuit testing device with dual purpose analog and digital channels | |
JPH08265155A (ja) | 半導体集積回路装置と制御システム | |
US8416113B1 (en) | Integrated circuit device with programmable blocks and analog circuit control | |
US20210303503A1 (en) | Method and system for enhanced spi communication | |
US20090289822A1 (en) | Ad converter and data processing unit | |
JP2003218687A5 (zh) | ||
US11630796B2 (en) | Serial peripheral interface (SPI) automatic register address incrementation across data frames | |
US7836240B2 (en) | Interface arrangement for a system on a chip suitable for outputting higher-frequency signals for operating peripheral devices, and use thereof | |
CN110045911B (zh) | 模数转换控制电路及单片机模数转换电路 | |
US20100318691A1 (en) | Memory control device, data processor, and data read method | |
US7558285B2 (en) | Data processing system and data interfacing method thereof | |
US7418528B2 (en) | Multimode, multiline data transfer system and method of operating the same | |
JP4855864B2 (ja) | ダイレクトメモリアクセスコントローラ | |
US7245248B2 (en) | A/D converter and a microcontroller including the same | |
CN115328845B (zh) | 一种四线串行外设接口通信协议设计的方法 | |
TW201720091A (zh) | 積體電路以及其串化器/解串化器實體層電路的操作方法 | |
US6831583B1 (en) | Integrated circuit comprising a microprocessor and an analogue to digital converter which is selectively operable under the control of the microprocessor and independently of the microprocessor, and a method for operating the integrated circuit | |
US20180183412A1 (en) | Realtime streaming control of an arbitrary waveform generator | |
CN221010098U (zh) | Adc通道防串通切换控制电路 | |
CN117725003B (zh) | 适用于高速adc通信的定制spi接口和数据读写方法 | |
JPH08272765A (ja) | 半導体集積回路及びモータ駆動制御回路 | |
JPH08265156A (ja) | 半導体集積回路装置と制御システム | |
CN115103032B (zh) | 通信协议控制电路和芯片 | |
JP2005303575A (ja) | Ad変換装置とad変換方法 | |
CN113485768B (zh) | 一种phy参数配置装置及ssd |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
PB01 | Publication | ||
SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |