CN1099064C - 在一双壳壳体中键盘－触摸垫的组合 - Google Patents

在一双壳壳体中键盘－触摸垫的组合 Download PDF

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Abstract

一种用于被安置在一主壳体内具有一中央处理单元的计算机系统的输入装置包括有被安装在一铰链双壳壳体内的一键盘和触摸垫。该输入装置由一导电系链被限制到该主壳体。

Description

在一双壳壳体中键盘一触摸垫的组合
本发明一般涉及数字计算机系统，更详细地说，是涉及具有一包括被安置在铰接双壳或“蛤壳”机壳内的一键盘和触摸垫的输入装置的计算机系统。
视频图示计算机系统是公知的、流行的消费产品。一典型的系统包括有一连接到用来显示游戏或其它应用图象的普通电视机的数据处理单元。该数据处理单元接收来自一只读存储器(ROM)的控制软件，该ROM通常以盒式存储器的形式被封装。该盒式存储器可拆卸地插入该数据处理单元。至少一个诸如键盘、触摸垫、鼠标器、操纵杆、触摸屏、开关垫、或光枪之类的输入装置被连接到该数据处理单元，以容许用户输入诸如位置信息或信息文本之类的信息，这些被使用的信息通过控制软件去执行该应用程序。
数据处理单元典型地具有一中央处理单元(CPU)和有关的易失和非易失存储器(包括所有随机存取存储器(RAM)和引导只读存储器(引导ROM))、一电视(RF视频)信号发生器和接合到各种指示装置的一输入/输出(I/O)处理器。这些装置在电路中进行通信。这些系统的一个区别特征是使用一母板或系统平面将这些部件电连接在一起。
键盘是公知的输入装置，用来将信息的离散位传送到数字系统。普通的键盘的例子包括有用来向数字计算机系统输入原文本和指令数据的公知的“QWERTY”打字机键盘和用来向诸如钢琴、风琴、拨弦古钢琴等之类的机械和电子音乐仪器输入音乐音符的公知的音乐键盘。典型的每个键与一个或多个固定输入端相关，这些输入端是由按压该键来触发的。
触摸垫是用来向计算机系统输入坐标类型数据的坐标类型指示装置。该触摸垫是典型的一种能够检测在它们表面上的压力位置的压力敏感有界平面。当一用户用手指、记录针或其它类似物品触摸该表面时，该触摸垫向被连接的计算机系统报告被触摸位置的坐标。如果有的话，根据响应，该计算机执行与该被按压位置有关的功能。
该触摸垫的典型的一个或多个区域被赋予在该系统或在应用程序内的某些功能。用户知道什么功能是与标准框的每个区域相关的。一标准框是带有图示设计的薄层，它被安置在其上并且接触该触摸垫表面。该图示设计典型地安排该触摸表面的区域并且该区域被典型地标记以向用户提供一提示以便用户了解与各个被绘制区域相关的功能。
在数字计算机系统中一个相对的最新的趋势是提供一诸如触摸垫、鼠标器或触摸屏之类的QWERTY键盘和指示装置。
键盘/触摸垫的组合在本技术领域中并不是未公知的。例如美国专利5231380(Logan)披露了一种用来控制显示器上指针的小触摸垫，其下面与个人计算机系统键盘的间隔棒相连接。美国专利5008854披露了一种在个人计算机系统中与键盘分离使用的大触摸垫。
但是，还没有一种具有实用、便携的触摸垫-键盘的组合的输入装置作为计算机系统的远程输入装置。
根据本发明，在一铰接双壳或“蛤壳”式的机壳里提供了一包括键盘和触摸垫相结合的输入装置。该输入装置通过一有线或无线通信链路在电路中与数据处理单元进行通信。
因而，本发明的一个优点是提供了一种可方便地闭合的与一全尺寸触摸垫相结合的键盘，从而减小了整个壳体的尺寸，因此适于携带和贮存。
本发明的另一个优点是提供了一种适用于与一计算机系统相结合的便携式触摸垫-键盘。
本发明的这些以及另外的优点通过对本发明的详细描述将会变得更加明显。
在被插入说明书并构成说明书的一部分的附图中，图示说明了本发明的实施例，这些实施例与上面所述的本发明的一般说明一起，在下面将作为例子详细说明本发明的原理。
图1A和1B是表示本发明的系统的一般性构成的方框图；
图1G是表示在本发明的系统中所使用的视频数字/模拟转换器的细节部分的原理图；
图2A是本发明输入装置的一实施例的透视图；
图2B是图2A中所示的本发明输入装置实施例的一侧面的正视图；
图3A是本发明输入装置的另一实施例的透视图；
图3B是图3A中所示的本发明输入装置实施例的一侧面的正视图；和
图4是表示本发明输入装置的电路原理的方框图。
参见图1A和1B，图中示出了本发明的一计算机系统10。如图1A所示，该系统10包括一带有一可拆卸地与其相连接的程序盒式存储器14的数据处理单元12。与该数据处理单元12相连接的还有一标准电视机(TV)16以及具有一触摸垫19和一键盘20的输入装置18。该输入装置18向数据处理单元12发送在该触摸垫19上对应于手指、记录笔21等的触摸位置的座标类型数据。另外，该输入装置还向数据处理单元12发送对应于键盘20的键位被敲击的数据。虽然在图1A中并未示出，但该标准电视16也可以由接收合成的视频信号的一对扬声器和一显示器来替代。该输入装置18通过一串行数据链路22连接到该数据处理单元12。该TV16通过一RF视频线24连接到该数据处理单元12。
盒式存储器14具有一在26处所示出的卡边缘连接器，它可与一盒式存储器连接器28相连接，因此该盒式存储器14中的部件可与数据处理单元12中的部件进行电连接。
处理单元12包括由系统总线31与其相联系的一中央处理单元(CPU)30和一音频/视频(A/V)控制器/协处理器32、与由来自系统总线31的A/V控制器/协处理器32所引出的系统总线34相连的一系统存储器33、第一和第二译码器芯片(未示出)、一I/O协处理器36、二个盒式存储器连接器(一个在28处示出，另一个未示出)、所需要的用于产生音频和视频信号的附加电路系统38、以及一扩展连接器39。如在该图中所示的那样，这些装置在电路中被连接以便进行通信。附加电路系统38示于图1B中，并在说明书中将对图1B进行更详细的讨论。
CPU30产生多条在本技术领域中所公知的总线：一条数据总线、一条地址总线和一条控制总线。这三条总线通称之为系统总线31。在本实施例中，CPU30是一由Intel公司(3065 Bowers Ave.，Santa Clara，California，95051)制造的80376。该80376是已知的80386SX的变型，在本技术领域中它是公知的并可从Intel公司购买到。该80376与80386SX不同之处是80376工作在32位模式而不是16位模式。具体地说，在比特0被强制为逻辑1而迫使该CRO寄存器为0011H(在16进制表示法中为0011)，有效地使该376工作在32位存储模式。被使能的页面调换则允许虚拟386工作。
A/V控制器/协处理器32产生三条来自系统总线31的备用的通用I/O译码器线(GPIO1、GPIO2和GPIO3)，每一条均提供32位I/O地址区域。通用译码器可用来提供三个有源低压芯片，以使这些装置能外接到A/V控制器/协处理器32。在数据处理单元12中，该通用译码器被用来对该I/O协处理器36(GPIO1)和二个盒式存储器连接器(GPIO2和GPIO3)的地址区域进行译码。该A/V控制器/协处理器32的其余电路系统将在下面进行讨论。
该系统存储器32包括屏面RAM、系统RAM和引导ROM(均未示出)。在该屏面RAM和系统RAM上是32位DRAM的1兆字节。适合的DRAM是由一对Toshiba所制造的256K字节的16位存储器芯片Tcs14170BJ所构成，以提供一32位存储器。CPU30的地址空间的一部分位置对在该A/V控制器/协处理器32中的若干8位寄存器译码。所有内部位置是在偶数地址边界中，在那里可适当地执行字-宽I/O的读和写。在这个特定的实施例中，在字-宽寄存器中不能执行字节-宽的写入并且I/O周期不能用来访问奇数的地址。
引导ROM总是16位宽。该引导ROM包括二个由许多制造商所制造的27C512可擦除可编程只读存储器，因而给出128K引导ROM。随着一复位指令，从F20000H至FFFFFFH包括ROM和内部存储器的1兆字节窗口在整个16兆字节地址区域内被重复。
该系统存储器33在若干装置之间被共享。该A/V控制器/协处理器32是用于系统存储器32的仲裁，因而该系统总线31由A/V控制器/协处理器32改变到系统总线34(包括一数据总线、一地址总线和一控制总线，图中均未示出)。因此，该系统存储器33通过系统总线34而被访问。
I/O协处理器36将CPU30接口到诸如输入装置18以及例如是一对控制杆(未示出)、控制器(未示出)、一鼠标器(未示出)和一打印机(未示出)中任意的装置上。在本实施例中，该I/O协处理器36是一由Motorola公司制造的工作在2MHZ的被预编程的MC68HC705C8(后面称之为68HC705)。该68HC705I/O协处理器36通过作为一外围装置构成的68HC705而被接口到CPU30：(1)PA0-PA7被连接到数据总线的D0-D7；(2)PB7、PB1和PB2被分别连接到控制总线和地址总线的GPIO1(由A/V控制器/协处理器32译码的一32字节地址区域，如下面所描述的那样)、A1和A2；(3)PB3、PB4和PB5被分别连接到控制总线的ADS、READY和W/R。该I/O协处理器36通过A/V控制器/协处理器对在I/O空间具有的四个16位地址(这里称之为AS0、AS2、AS4和AS6)译码。
在68HC705里面的程序按如下所述接口到CPU30。该68HC705被设计成直接连接到该处理器总线，并实际上作为到CPU30的一I/O端口。一对内部锁存器保存在每个处理器之间所通过的数据，直到其它的装置准备接收这些数据为止。状态位表明了每个处理器的数据锁存器的情况。通过对该状态位的检测可告知以前的数据是否已被读出和是否有新数据等待读出。
除此之外，该I/O协处理器36实施如下的功能：(1)一50ms定时器，(2)用来从该输入装置接收通信信息分组的一串行控制器链路，(3)一盒式存储器/扩展检测，用来判定在每个盒式存储器连接器中一盒式存储器14的存在或不存在以及判定在扩展连接器中一扩展装置或CD驱动装置的存在或不存在，(4)系统复位，和(5)一I2C非易失RAM(NVRAM)接口。该I/O协处理器36还配备一任选的DSA小型盘控制串行线，以允许同一任选的CD装置通信。
50ms定时器是由构成68HC705I/O协处理器36的监视器定时器来实现的，以便在规定的50毫秒间隔处终止。在每个监视器定时器终止的时间，I/O协处理器36利用A/V控制器/协处理器32的模拟中断0(AIO)而中断CPU30(该A/V控制器/协处理器响应于该I/O协处理器将AIO拉向低电平通过IRQ线而中断该CPU)。通过分别向I/O端口ASO写入字节0F0H或字节00H而使该CPU启动并中止该50ms定时器。
在该CPU的中断应答周期内，A/V控制器/协处理器维持该中断处理程序的地址。该中断处理程序使得CPU30自对应于I/O协处理器的16位I/O端口ASO读取一个或多个字节。在每个I/O端口ASO读取期间，A/V控制器/协处理器32选择I/O协处理器35，因而允许在CPU30和I/O协处理器36之间的数据传送。
响应于50ms中断，I/O协处理器36将总是有一字节被传送到该CPU。因为最后的中断应答周期和这个字节的上半字节包含有被传送到该CPU的I/O装置信息的数目，所以这个字节的下半字节包含有该50ms定时器的中断数目。如果该50ms定时器被中止，则这个字节的下半字节将为零。如果所接收的信息多于15个，则在该上半字节中只传送15个信息，而余下的信息是在下一传送期间被传送。根据这个第一字节的内容，该CPU可自I/O协处理器36读取通常来自输入装置的数据信息分组的后面接着的字节。典型地是，仅当它们各自的状态变化时，该输入装置将发送信息，因而信息传送频率很低。
输入装置18以及所有的其它输入装置都通过串行数据链路22连接到I/O协处理器36。为了沿该串行链路22传送，个别输入装置(即输入装置18)将该控制装置的移动变换为一适合的格式。该输入装置18通过该串行数据链路22将数据信息分组传送到系统单元12。如像下面将要说明的那样，该数据信息分组的结构是根据输入装置的类型不同而有所差异。座标型装置(鼠标器、模拟控制杆、触摸垫等)的数据信息分组结构和开关闭合型(键盘、数字控制杆、开关垫等)的数据信息分组结果是不同的。
串行控制器链路22包括三条线：一条数据接收线、一条VCC(+5VDC)线和一条地线。使用该68HC705的PDO/RDI管脚，该68HC705配有该控制器串行链路的数据接收线。这个管脚被设计成作为到利用公知异步格式的串行装置的一个接口。串行传输具有以下的格式：每秒4800位，无奇偶性，8数据位和一停止位。在另一方案中可使用一计时异步格式。使用公知的六线小型插塞式连接器(未示出)而将该串行控制器链路22与外部装置相连接。输入装置是菊花链类型装置，因此一单一装置实际上与数据处理单元12相连。例如，如果一所谓的鼠标指示器件被加到该系统10，那么该鼠标器与输入器件18相连，也与处理单元12相连接。
盒式存储器检测和扩展检测是用来确定在每个盒式存储器连接器或扩展连接器中盒式存储器14的存在或不存在，并由I/O协处理器36查询盒式存储器连接器28的一管脚而被实施。该管脚由在该系统平面内的一适合的上拉电阻(未示出)被拉到逻辑1，并且一适当地被连接的盒式存储器14将该管脚拉到逻辑0。因而，在每个盒式存储器检测中1表明盒式存储器14不存在而0表明存在盒式存储器14。同样，在扩展检测中1表明不存在诸如可选择的CD驱动装置之类的扩展装置，而0表明存在一扩展装置。
通过I/O协处理器36控制A/V控制器/协处理器32所通过的复位信号，同样也控制CPU30的复位信号来实施复位。鉴于I/O协处理器36复位A/V控制器/协处理器，同样也复位CPU30，所以该CPU30可命令该I/O协处理器36复位系统10。通过将字节OFFH写入I/O端口ASO，该CPU使得该I/O控制器产生一系统复位。另外，该I/O协处理器36监视用于该系统的任选的复位开关(未示出)并当它检测到一开并闭合时则复位该系统。
最后，I/O协处理器执行一I2C非易失性RAM(NVRAM)接口去读、写，并且检测非易失系统RAM的512个字节的内容。该NVRAM(未示出)包括一由philips Semiconductor制造的PCF8594并在电路中通过该I2C接口与I/O协处理器通信。多个PCF8594可进行级联以便提供更多的NVRAM性能。为了访问NVRAM，使用了一个三字节顺序。所有三个字节通过I/O端口ASO被存取。第一字节由CPU写到I/O协处理器表明该传送是读还是写并给I/O协处理器一个段地址。这个字节的下半字节表明传送的类型：01H表明是一个来自NVRAM的写入而02H表明是一个来自NVRAM的读出。这个字节的上半字节是一相应于NVRAM的256字节段的4位段数。虽然NVRAM有512字节，仅使用了其底部二段(0和1)。为了读出和写入，下一字节是相同的——下一字节由CPU写入并且是在该段内被存取的该字节的地址。最后一个字节不是由CPU向I/O协处理器写入就是自I/O协处理器读出，并且是自NVRAM读出或向NVRAM写入的数据字节。
另外，I/O协处理器可用另外的方式来执行。例如，三态可读移位寄存器可适合地接收来自串行数据链路22的信息。在这种情况下，该CPU30周期地读取该移位寄存器，以便从输入装置存取该数据信息分组。
第一译码芯片(未示出)在电路中与CPU30、A/V控制器/协处理器32和二个盒式存储器连接器28(另一个未示出)进行通信。该第一译码芯片接受系统总线31的上面二条地址线作为输入，对变为四个4兆字节区域的80376 CPU30的16兆字节地址空间译码，由三条芯片选择线来表示：二条用于盒式存储器连接器28(另一个未示出)而一条用于A/V控制器/协处理器32。上部4兆字节和下部4兆字节对A/V控制器/协处理器芯片选择译码，剩余的两个4兆字节区域对两个盒式存储器连接器芯片选择译码。
第二译码器芯片(未示出)用来对扩展连接器39实施芯片选择。该第二译码芯片在电路中沿系统总线34与A/V控制器/协处理器32和扩展连接器39进行通信。该第二译码芯片容许A/V控制器/协处理器32对在F20000H处开始的系统ROM的128K字组译码。自F40000H到FFFFFFH区域是由该扩展连接器39使用的第二译码芯片译码。这个由第二译码芯片译码的ROM的字组被用来通过该扩展连接器39将ROM加到系统10。
为了所安置的盒式存储器14在电路中与CPU30和其它系统部分进行通信，该数据处理单元12还有一对盒式存储器连接器(一个在28处示出，另一个未示出)。该盒式存储器14通过一镀金62脚(二排31脚导电带)卡边缘插头26而被连接到该数据处理单元12。为了接受该卡边缘插头26的卡边缘连接，该处理单元12具有二个盒式存储器连接器28。该盒式存储器14所具有的镀金板的印刷线应与该连接器28的导体相匹配，以便容许该盒式存储器14可插地被连接到处理单元12 。通过该盒式存储器连接器28(另一个未示出)，以下的信号被传送到外部装置：系统总线31信号、盒式存储器检测线、电源、地、模拟中断1或2(每个盒式存储器具有一唯一的中断)、GPIO2或3(每个盒式存储器具有一唯一的芯片选择)、锁定线(它是80376和80386SX系统总线31的一典型信号)以及盒式存储器选择，这些信号是由第一译码芯片产生的。另一方面，通过该盒式存储器连接器28，这些需被连接到一任选的CD驱动器的信号也可被连接到外部装置。
另外，该处理器12具有一有112脚(二行，每行56个脚)的卡边缘扩展插座39。该扩展插座39容许这些装置向系统存储器33附加更多的存储器并附加各种其它的特征。被连接到该扩展插座39的装置应具有与该扩展插座相匹配的镀金卡边缘，以容许该装置能可插地连接到该处理器单元12。通过该扩展插座39以下的信号被传送到外部装置：系统总线信号、扩展插座检测线、电源、地、CAS和RAS线和扩展插座39选择，这些信号是由第二译码芯片产生的。另一方面，通过该扩展插座39这些需被连接到一任选的CD驱动器的信号也可被连接到外部装置。
程序盒式存储器14包括有一程序ROM40和一译码器42。另一方面，译码器42还可被设计安置在处理单元12之中。程序ROM40包括用来以只读存储的格式在CPU30中执行的合适的代码。另一方面，诸如电池支持的(battery-backed)RAM之类的其它的存储器类型在该盒式存储器14中可作为存贮装置。如在图1A中所示，该程序ROM40在电路中与CPU30进行通信。
如像在本技术领域中公知的那样，在盒式存储器14中地址译码器42对针对程序ROM40的适当存储区域的地址总线的全部宽度进行译码，并产生一芯片选择信号44。该地址译码器42在一本技术领域中公知的16V8可编程序阵列逻辑(PAL)中被执行，该芯片是由许多制造商例如AMD公司制造的。如果该译码器被设计安置在处理单元12中，则选择信号44通过连接器26被电连通到ROM40。
现在参见图1B，图1A所示的附加的电路系统38被连接到A/V控制器/协处理器32。该附加的电路系统38包括有4个装置：一视频数字-模拟变换器(视频DAC)50、一NTSC/PAL(“PAL”涉及公知的欧洲电视信号标准)编码器52、一音频数字-模拟变换器/模拟-数字变换器/压缩器/去压缩器(ADC/DAC/CODEC)54和一RF调制器56。每一部件的连接如图所示。
音频/视频控制器/协处理器(A/V控制器/协处理器)32的电子线路基本上被包括在一种整块的传统逻辑芯片内，如像已知的一ASIC(特殊应用集成电路)。一种满足这里所描述的A/V控制器/协处理器32可从MSU Ltd.(270 Upper 4th street，Witan GateWest，Centval Milton Keynes，MK9 1DP England)购买。该A/V控制器/协处理器32包括一处理器接口60、一处理器高速缓冲存储器62、一存储器接口/更新64、一视频控制器66、一中断控制器68、一视频位块移动器(blitter)70、一任选CD部件译码器、一数字信号处理器(DSP)74和一DSP存储器76。该处理器接口60、存储器接口/更新64和视频控制器66被汇集在一起称之为视频/存储器控制器67。系统存储器33、中央处理单元30和其它装置被置于该A/V控制器/协处理器之外。
A/V控制器/处理器32自系统总线31产生系统总线34，从而使系统存储器33与CPU30隔离。因此，系统总线34对到该系统存储器33的各种装置进行电连接。共享该总线34的是六个可能的总线主控器(分别按从最高优先级到最低优先级的顺序)：存储器更新64、视频控制器66、一可选CD部件译码器(未示出)、DSP74、位块移动器70和CPU30(通过处理器接口60)。在任何时间都只有一个总线主控器可以控制该系统总线34。在该视频/存储器控制器67中仲裁器控制这些装置的优先级的变化，如像这里所述那样，并且在电路中与该A/V控制器/协处理器32中的所有装置进行通信。例如，该CPU具有所有总线主控器的最低优先级，直至出现一中断为止。因此，在该电路中，该仲裁器与CPU接口60和中断控制器68进行通信。
在检测用于CPU30的预取指令中，该高速缓冲存储器62不是一高速缓冲存储器。更确切地说，该高速缓冲存储器62是一位于F14000H至F143FFH的512×16位静态RAM，它可通过CPU30用于变量、堆栈或程序编码以便加速程序的执行。
如像在本技术领域中已公知的，该视频/存储器控制器67(处理器接口60、存储器接口/更新64和视频控制器66)控制该系统总线34，并且为了使存储器装置连接到该系统总线34而提供存储器定时信号(即，CAS、RAS、写使能等)。对于取出任何视频显示数据以及更新动态RAM(DRAM)的短暂周期的视频线期间，它中止总线主控器的工作。它还控制与CPU30的接口。
视频控制器66具有一弹性视频定时发生器，它可对适合的不同TV标准编程并将监视器提高到480VGA标准的640线。由在A/V控制器/协处理器中所设置的各种寄存器控制该精确的视频格式：水平周期、水平同步、水平消隐结束、水平消隐开始、水平显示开始、水平显示结束、水平取数开始、水平取数结束、水平垂直同步、垂直周期、垂直同步、垂直消隐结束、垂直消隐开始、垂直显示开始、垂直显示结束、视频中断和光笔寄存。该视频控制器66具有三种可用的色彩清晰度：每像素4位、每像素8位和每像素16位。该屏面的存储器映射不依赖于该视频显示器宽度，而是独立地被规定。
视频/存储器控制器67对在如下存储映射中的80376 CPU30的16兆字节进行译码：系统ROM的1MB(000000H-0FFFFFH)、第一盒式存储器ROM的4MB(400000H-7FFFFFH)、第二盒式存储器ROM的4MB(800000H-BFFFFFH)、用于音频/视频控制器/协处理器的内部存储器的64KB(F10000H-F1FFFFH)和系统ROM的128KB单元(FE0000H-FFFFFFH)。该内部存储器的64K字节包括调色板RAM、位块移动器寄存器以及DSP寄存器的存储器，调色板地址区域如上所述。位块移动器寄存器地址从区域F10400H延伸到F107FFH。DSP存储器地址从F10800H扩展到F18000H。
如果任选的CD驱动器被附加到该系统，那么如下的区域被附加到存储映射：系统RAM的另外1MB(100000H-1FFFFFH)和用于CD驱动的128KB(FC0000H-FDFFFFH)。
中断控制器68将六个内部中断接口到该CPU30：视频中断(最高优先级)、模拟中断0(AI0)、模拟中断1(AI1)、模拟中断2(AI2)、CD单元译码器中断和DSP中断(最低优先级)。当CPU30执行该中断应答周期时，中断控制器自动地清除一中断。对于每个中断可利用一屏蔽位。
位块移动器70是一用来快速屏面更新和动画片制作的图形处理器，是作为用于CPU30或DSP74的一硬件图形子例程。它执行由CPU30和DSP74写入存储器中的指令。它通过由系统存储器33读出所设置的新指令执行图形操作的任意逻辑序列。通过位块移动器程序操作它成为总线主控器，并且因此对于可考虑的周期来说具有不兼容的系统总线34控制。但是，它的超过CPU30的优先级是有条件的；当一中断出现时，它可请求停止系统总线到CPU30。该CPU30在该系统等级中是最低优先级总线主控器；但是，它能完成其它硬件的控制，因此，该系统总线34的使用完全在CPU30程序控制之下。
位块移动器70具有一多用途比较器，以容许智能位块移动操作，并使一逻辑功能单元(LFU)产生输出数据。该逻辑功能单元可用若干种方式组合该数据寄存器的内容来产生输出数据，并且该比较器可对该数据执行某种比较以禁止写操作，并有选择地停止块移动器操作。
逻辑功能单元产生输出数据，该输出数据被写入系统存储器33中的目的地。它可执行源和目的寄存器像素的任何逻辑结合。“源数据像素”可由源数据寄存器或数据图形数据寄存器中选择。LFU选择来自数据寄存器的输入数据两个置位的四个布尔(Boolean)小项A&B、A&B、A&B和A&B)，并产生该两个被选择小项的逻辑“或”。这就容许输入数据的任何逻辑组合；因此存在16种功能的可能性。
比较器可执行对在源、目的和图形数据寄存器中的数据的各种比较。如果满足它的比较条件，则它产生一中止信号。该中止信号用来中止一写操作，并可选择地去停止位块移动器操作。为了故障检测和系统存储器33查找操作，以及作为字符着色的一种辅助，该比较器还可用来提供一像素平面效果，以给出清楚的色彩。
DSP74是用于声音合成的一种简单的、极高速的处理器，其工作在高达每秒33×106指令(MIPS)的状态。它通过一DSP DMA控制器(未示出)对系统总线34进行访问，该DSP DMA控制器容许向系统存储器33中读和写字节或字。这些传送出现在短字符组中，并且是在DSP程序控制之下。该DSP74实际上执行程序并在它自己的专用高速存储器76中存贮数据。
DSP74音频协处理器是一具有足够能力去实施一高性能音乐合成的通用算术协处理器。同步串行输出端提供一所产生的具有16位精度的立体声音频信号，给出一与小型盘技术有关的正常的音质。该DSP74是来自主机CPU30的微可编程的，并且该指令的设置充分地灵活，使得用户可进行编程，使该装置能实现许多不同功能，这些功能几乎完全不同于“音乐合成器”的功能。这种应用可包括算法语言产生、利用快速富里叶变换技术的音频分析和三维图形旋转。对于最大数据吞吐量，该DSP74使用了哈佛大学的体系结构(分离程序和数据总线)。该DSP74具有一算术逻辑单元(ALU)，该ALU的特征是一16位的硬件，执行16位硬件乘/累加以及加法、减法和逻辑功能。还有一分离串行除法单元，用以每信号产生一商数位。
在DSP74中的ALU是一16位算术逻辑单元，它具有与在本技术领域中公知的Texas Instruments 74181相同的功能。通常的算术操作是按照指令编码；不寻常的指令用通用算术指令(GAI)直接置定ALU模式位而被执行的。
DSP74具有一与其相关的DSP存储器76。该DSP存储器76包括程序RAM、数据RAM、一寄存器/常量表和一正弦ROM(均未示出)。DSP存储器76通常在DSP的内部地址空间以及系统存储器33的地址空间是易于使用的。该DSP程序RAM是512个18位字。就该DSP74而论，这些位置仅可由CPU30写入，并且是只读程序。程序RAM不呈现在该DSP内部地址空间。当DSP74运行时该程序RAM不易于访问主机，而当DSP空闲时则可访问主机。
DSP74还具有一串行音频数字-模拟转换器(DAC)接口。该串行DAC接口容许DSP74不但驱动一同步串行(I2S或类似的)DAC，而且还从诸如一CD驱动装置之类的同步串行数据源输入数据。
A/V控制器/协处理器32连接到一外部视频DAC50，以将来自视频控制器66的18位像素信息78(红、绿、蓝各为6位)转换为在本技术领域中公知的RGB信号。如图1C所示，该视频DAC50的每一色彩通道(R80a、G80b和B80c)用一R2R电阻树和一2N2222晶体管所实现。在图1C中的这些器件在电路中的通信如像所示的那样。在图1C中的电阻86a-86j均为0.25瓦，其阻值如图中所示，其公差在5％之内。晶体管88是一2N2222。
再次参见图1B，RGB信号80通过NTSC/PAL编码器52被转换成一NTSC合成视频信号90 。该NTSC/PAL编码器52接受由A/V控制器/协处理器32的视频控制器66所产生的色度时钟92、HSYNC和VSYNC信号94，以及由视频DAC50产生的红80a、绿80b、蓝80c视频输出，并产生一公知的NTSC或基带视频格式的合成视频信号90。另一方面，也可产生公知的PAL(欧洲电视信号标准)格式。该合成视频信号90由一本技术领域公知的凹形RCA类型声音插孔(未示出)与外部装置相连接。在本实施例中，该NTSC/PAL编码器52是一由Sony公司制造的CXA1145。另外，也可使用由Motorola公司制造的MC1377。
音频ADC/DAC/CODEC54用一遵循已知的Philips I2C协议的串行链路96连接到DSP74。该ADC/DAC/CODEC54将模拟数据转换为数字数据，反之亦然，转换为压缩和去压缩数字数据。该ADC/DAC/CODEC54接口自任选的话筒到A/V控制器/协处理器32的主体声模拟数据97a-97b。该音频输入97a-97b由一标准立体声1/4″连接器连接到外部装置。该音频ADC/DAC/CODEC54还由所产生的左和右音频线输出信号98a-98b将来自A/V控制器/协处理器的数字信号接口到外部装置。这些信号98a-98b用二个在本技术领域中公知的凹形RCA声音插孔而连接到诸如任选的扬声器(未示出)之类的外部装置上。如下面所述，该音频线信号98a-98b还被附加到该RF视频信号22上。
在该最佳实施例中，ADC/DAC/CODEC54是一由CrystalSemiconductor所制造的CS4216。该元件包括具有可编程放大的麦克风输入端，以及具有可编程衰减器的输出端。放大和衰减都是由DSP74可编程地控制的。
另一方面，该ADC/DAC/CODEC54可用由Philips所制造的TDA1311所替代。如果使用这种芯片，则不会得到ADC和CODEC功能。
RF调制器56将来自NTSC/PAL编码器52的合成视频信号90与来自音频ADC/DAC/CODEC54的左和右音频线输出信号98a和98b相合并成一载波频率以产生一适于直接输入到TV16中的RF视频信号22。为了产生不同的PAL(欧洲电视信号标准)和NTSC格式，必须使用一不同的RF调制器和晶体检波器。RF视频信号22使用一本技术领域中所公知的单一的凹形F同轴连接器与外部装置相连。
现在参见图2A、2B，该图示出了本发明的输入装置18的一个实施例。如图所示，该输入装置18包括有被安置在一单独的机壳100内的一触摸垫19和一键盘20。
机壳100是一具有二个相等的半壳体100a和100b的双壳或“蛤壳”机壳，该机壳是由ABS-T(丙烯腈丁二烯乙烯共聚物，材料为ABS，等级为T；它可由Wong’s电子公司购得，该公司地址为Wongs Industrial cenfre，180 Wai Yip Street，Kwun Tong，Kowloon，Hong Kong)或任何其它刚度适合的可成型性材料所制成。这两个半壳体通过一铰链102被相互连接，该铰链的构成可允许半壳体100a相对于另一半壳体100b沿着平行于铰链102的轴而运动(如在104处所指明的)。该铰链102容许两个半壳体100a和100b运动到如图2B中所示的使两个壳体可呈闭合状态的程度。该铰链102可像在本技术领域中公知的“笔记本型”计算机设计那样被压制到该机壳的半壳体100a和100b之中，也可用标准的方法将任何其它合适的铰链，例如“钢琴”铰链，加接到两个半壳体100a和100b。在本实施例中，铰链102的构型必须允许使得在一半壳100a中的电路系统能与另一半壳100b进行电路通信，这样就可使来自一半壳100a中电路系统的信号通过被连接到另一半壳100b的公共链路22而被传送到处理单元12。
这两个半壳100a和100b使用在笔记本计算机设计技术领域中公知的标准闩锁装置而保证处于图2B中的闭合位置。在一实施中，闩锁110a和110b被附置在一半壳体100a上。该闩锁110a和110b嵌入槽112a和112b中并与制动装置(未示出)啮合，并且制动装置由一对滑块114a和114b控制。该滑块114在槽(未示出)中滑动并将该制动装置移动到二个位置：一个位置是使每个制动装置保证它的各自的闩锁而另一位置是使该闩锁自由的退出它的各自的槽。
图3A和3B示出了本发明的输入装置18的另外的实施例。如图3A所示，在这个实施例中触摸垫19和键盘20由一个在它们侧边上的铰链而被铰接，这样在正常情况下当键盘20面对用户时它们被置于并排的位置上。这个实施例与图2A和2B所示的实施例的不同之处在于图3A的键盘20实际是一带有QWERTY的图示图像的第二触摸垫或写在第二触摸垫之中或之上的其它的键盘。另一方面，一具有单独的、可动键位的键盘可使用在这个具有触摸垫19的并排安置的实施例中。该输入装置18的这个实施例折迭成为如图3B所示的闭合形态。
象所用的另外实施例一样，这两个半壳100a和100b利用在笔记本计算机设计技术中所公知的标准闩锁装置被保证在图3B所示的闭合位置。在一实施例中，闩锁110a和110b被附加在一半壳100a上。该闩锁110a和110b嵌入槽112a和112b中并与制动装置(未示出)啮合，该制动装置由一对滑块114a和114b来控制。该滑块114在槽(未示出)中滑动并将该制动装置移动到两个位置：在其中的一个位置中每个制动装置相连接地啮合因而保证它的各自的闩锁；而在另一个位置中该闩锁自由地退出它的各自的槽。
现在参见图4，该图示出了在该输入装置18中的电路系统的方框图。输入装置18包括坐标型传感器122、键盘传感器124、坐标确定电路系统126、键盘电路系统128、100毫秒定时器130和接口电路系统132，在电路中进行通信的所有连接如图4所示。
触摸垫传感器122以这样一种方式构成，即用手指、记录针21或类似物品按压或接近该传感器表面，则容许该传感器检测该触摸的位置。触摸垫传感器122可以是诸如电阻基面传感器、声学传感器和开关闭合型传感器等许多类型中的一种。例如包括膜片开关矩阵即在美国专利4736190中(Florella)所披露的装置和较细分辨力开关闭合型传感器即在美国专利4529959中(Ito等)披露的装置。一种适合的传感器102可从Wong’s电子公司(Wongs Industrialcenfre，180 Wai Yip Street，Kwun Tong，Kowloon，Hong Kong，部件编号PR39983)购买到。
传感器122响应于记录针21、手指或类似物品触摸该传感器表面或触摸一贴近于该传感器表面模板覆盖层而产生至少一个电信号123。例如，开关闭合型传感器典型地需要若干个驱动器去顺序地驱动在一轴上的许多线和若干接收器去检测在另外轴上的哪些线正在传导由这些驱动器驱动的信号。知道哪个驱动器产生由那些接收器所检测的信号，就可以确定引起开关闭合的触摸的位置。
键盘传感器124可以是许多适合的传感器中的任一个，这些传感器是键盘设计和笔记本型计算机设计技术中公知的。另外，该键盘传感器可以是具有一QWERTY的样板图示设计的第二坐标型传感器或被刻在该表面之中或之上的其它键盘。该键盘传感器124响应于该传感器124的键位闭合事件而产生一电信号125。
坐标确定电路系统126在电路中与坐标传感器122、接口电路系统132以及100毫秒定时器130进行通信。该坐标确定电路系统126是构成能接受来自坐标传感器122的电信号123并确定对应于由手指、记录针21或类似物品所触摸的位置的X轴和Y轴值。例如，如象在本技术领域中公知的，如果该坐标传感器122是一开关型传感器，那么该坐标确定电路系统126将包括驱动器和接收器去确定哪个开关被闭合，并逻辑传送这个开关的位置到与该传感器表面有关的一个有益的值。
键盘电路系统128在电路中与键盘传感器124和接口电路系统128相通信。该键盘电路系统128接受来自键盘传感器124的电信号125，确定哪一个键位被触摸，并产生相应于击键的信息。
100毫秒定时器130在电路中与坐标确定电路系统126通信。该定时器130反复地测定100毫秒时间间隔的终止并产生一表明该间隔终止的信号131。在由定时器130所检测的100毫秒间隔终止之间，坐标确定电路系统126利用信号131去检测手指、记录针21或类似物品的触摸位置的变化。
接口电路系统132在电路中与坐标确定电路系统126、键盘电路系统128、数据处理单元12(通过串行数据线22)以及如果有的话则通过串行数据线延长部分23与其它输入装置进行通信。接口电路系统132接受由坐标确定电路系统126所确定的坐标值、
由键盘电路系统128所产生的键位按压信息和由方向确定电路系统206所产生的信息，并且通过该串行数据链路22向数据处理单元12传送任意这样的信息。
所有输入装置是被连接到该处理单元12的数据收集和整理系统。因此，接口电路系统必须通过来自其它输入装置到CPU30去的任何信息分组。如象在下面所述的更完全的说明，每个被连接到处理单元12的输入装置具有唯一的装置编号。最靠近处理单元12的装置具有的装置编号为0，并且较远离处理单元12的装置具有较高的装置编号。但是，这些输入装置并不知道它们自己或其它装置的装置编号。因此，每个装置必须向来自相同类型的其它输入装置的任何所通过的数据信息分组的装置编号加1。在链路中任何具有大于15的装置编号的输入装置则被忽略。
例如，假设三个连接到处理单元12的相同类型的输入装置α、β和γ按如下连接：α被连接到处理单元12，β被连接到α且γ被连接到β。因此，α具有一装置编号0，β具有一装置编号1且γ具有一装置编号2。其它的装置不知道它们自己或其它装置编号。每个装置发送它自己的带有一装置编号0的数据信息分组。
当α通过一数据信息分组到处理单元12时，由于α最靠近该处理单元12，所以不履行装置编号0是正确的。但是，β和γ还发送具有一装置编号0的数据信息分组。为了对这种情况进行补救，每个装置对通过信息分组的装置编号加1。因此，当β从γ到α通过一数据信息分组时，β向该装置编号加1，从而给出来自γ装置编号1的信息分组。同样，当α通过γ数据信息分组到处理单元12时，α向该装置编号加1，从而给出来自γ一正确的装置编号2的信息分组。因此，在该链路中的每个装置向每个来自通向下一装置的相同类型装置的数据信息分组的装置编号加1。
因此，除了通过自其它输入装置(如果有的话)所接收的数据信息分组之外，接口电路系统132在来自通过串行数据线延伸部分23接收的相同类型装置的任何数据信息分组中对该装置编号加1。该接口电路系统132通过具有被改变和未被改变的装置编号的数据信息分组到处理单元12。
采用具有本发明的输入装置18和系统10是非常简单的。该输入装置通过串行链路22向数据处理单元12发送数据信息分组。如上所述，该输入装置通过I/O协处理器36接口到CPU30。每个输入装置以菊花链形式连接到下一输入装置。该I/O协处理器36以先入先出(FIFO)方式接收并存贮该数据信息分组。
每个50毫秒的“一刹那”，I/O协处理器36中断CPU30。作为应答，该CPU存取在协处理器36的I/O端口ASO处的单一字节，以确定如上所述的自该CPU最后存取以来50毫秒刹那的数以及所传送的装置信息数。该装置信息的十种类型如下表所示。
装置类型 字节0(计数) 字节1(装置1D) 字节2 字节3 字节4
(4-7位) (0-3位)
键盘(PS/2)   2 0     0 扫描码 N/A N/A
鼠标(PS/2)   4 1     0 鼠标字节1(按钮) 鼠标字节2(X数据) 鼠标字节3(Y数据)
开关闭合   可变1-255 在链路中的装置编号     1 按扭状态0：开1：闭 按钮状态(任意选择) 按钮状态(任意选择)
操纵杆(数字)   2 在链路中的装置编号     2 开关闭/开码 N/A N/A
坐标(相对的)   4 在链路中的装置编号     3 按钮状态 Δ.X Δ.Y
坐标(绝对的)   4 在链路中的装置编号     4 按钮状态 X坐标 Y坐标
触摸垫覆盖层信息   2 在链路中的装置编号     5 覆盖层码(0-63) N/A N/A
作用信息   可变1-255 在链路中的装置编码     6 作用铵钮数据 (任选) (任选)
系统通路通过   可变1-255 在链路中的装置编码     14 字节0 字节1(任选) 字节2(任选)
预置信息   可变1-255 在链路中的装置编码     15 装置类型(ID) Mfg码字节0 Mfg码字节1(任选)
表：输入装置信息结构
从该表可看出，这些信息结构的长度不同并且具有与它们对应的输入装置密切相关的结构。对于如象I/O协处理器将数据传送到CPU而从各自的I/O装置传送到I/O协处理器的数据，在该表中该装置信息是相同的。除了上述结构之外，每个从I/O装置传送到I/O协处理器的信息具有一校验和，以确保从输入装置18传送到处理单元12的数据的正确。该校验和是一标准模数256的校验和，其中该校验和值是需要构成所有字节0的和的值(在求和期间忽略任何进位)。在将该数据传送到CPU之前，该I/O协处理器除掉该校验和。因此，由CPU读出的字节流实际上和由I/O协处理器所接收的字节流是相同的，除下述情况之外：(1)由该CPU读出的第一字节是包括50毫秒的数和I/O装置信息数的特殊字节及(2)该校验和被遗漏。
PS/2鼠标器和键盘装置作为装置类型0而被支持。该键盘具有一为0的链路编号而鼠标器具有一为1的链路编号。这些装置由通过串行数据链路22使用存在的PS/2协议的I/O协处理器而被支持。
装置类型1准备用作具有多个按钮的装置。多达255字节(每字节8个按钮)或2040个按钮可利用这种信息类型输入到该系统。打开按钮作为逻辑0传送而闭合按钮作为逻辑1传送。这是一可变长信息。
诸如操纵杆20a、20b之类的数字操纵杆是作为装置类型2被支持的。有两个与每个触摸垫19相关的操纵杆。每个操纵杆具有一唯一的链路编号。每个左边的操纵杆是奇数(1、3、5、7、9等)而每个右边的操纵杆是偶数(0、2、4、6等)。每个操纵杆被独立地报告。该信息是一固定长度信息。重复呼叫数字操纵杆传感器包括若干开关150a-150b。该信息是一表示高达8个开关的字节，它包括有运动传感器开关150a-150b和数据输入开关，诸如开关130a。对于这种类型来说该信息字节的个别比特表示为：高开关(MSB)、低开关、左开关、右开关、开关#1、开关#2、开关#3和开关#4(LSB)。包括有触摸垫19的操纵杆20a、20b仅具有一个对应于上述开关#1的按钮130。其余三个按钮总是作为0被报告。
诸如鼠标器和跟踪球之类的坐标装置是作为装置类型3而被报告的。接着ID的第一字节是报告对于该装置的任何按钮信息。可以报告多达8个按钮。下一字节是ΔX值，再接着是ΔY值。ΔX和ΔY值是基于该装置的最后所报告的位置。如果必须的话，该应用程序必须将这些值转换为绝对坐标。最大移动为255。如果实际的移动超过255，那么两个或多个信息将被传送。这是一个固定长度信息。
触摸垫19作为装置类型4而被支持。这种装置类型的其它装置包括模拟操纵杆。接着ID的第一个字节是用来报告按钮信息的。下一个字节是用来报告绝对X位置的。按顺序下一个是绝对Y位置。该绝对X和Y值每一个为一个字节并且被限制在0-255的范围。这是一固定长度的信息。
触摸垫覆盖层102作为装置类型5而被报告。触摸垫覆盖层使用在该触摸垫中的6位传感器而被检测。当该触摸层检测到一覆盖层的变化时，产生一信息。所有的覆盖层代码是依赖于应用的，并且该应用程序必须识别每个覆盖层代码。这个信息是固定长度信息。
该动作信息被用来规定一个依赖于预规定装置功能的公共置位，它可以以不同方式由多个装置类型所产生但以相同的方式由该系统和应用程序使用和解释。动作信息是作为利用一可变长度信息的装置类型6而被报告的。在这个特定的实施例中，规定了三个依赖于装置的功能并分别与这个字节的较低的三位有关：START(开始活动或处理)、PAUSE(暂停活动或处理)和SELECT(选择多个事件或动作中的一个)。这些位被置位以报告这些功能。所有其它位被保留以便进一步使用并且作为0被报告给CPU。
该系统通过信息类型被用来处理对上述所规定的装置类型不适用的任何装置类型。利用了信息类型14。这是一可变长度信息。该数据的定义依赖于装置并且还必须是特殊的应用。
来自每个装置的第一个信息是装置类型15。这是用来告诉该系统一装置将发送输入信息。这个信息还规定该未来的装置将被用来报告输入。这是一个可变长度信息。
在加上系统电源和50毫秒间隔时，I/O协处理器扫描该盒式存储器和扩展检测线以确定其配置和向该系统发生警报并向CPU发出一配置字节。这是当加上电源时该CPU从I/O协处理器接收的第一个字节。当检测到一个变化时，该I/O协处理器将仅产生一个模块配置中断；一个盒式存储器状态的变化会导致一系统复位，从而导致该I/O协处理器向该CPU发送另一个配置字节。在该发送字节中所置的适当的位表明了相关项目的存在：0位相应于盒式存储器1、1位相应于盒式存储器2和2位相应于任选CD驱动器。其余位置0。
另外，由于向I/O协处理器36写入信息，通过串行链路22该CPU向I/O装置传送数据。随着由字节03H作为开端的每个字节，数据字节被写到I/O端口ASO。该I/O协处理器将这些字节写到I/O装置。这个能力被用来将数据传送到例如一打印机(未示出)。
接口到具有本发明的触摸垫和键盘的输入装置也是简单的。在CPU30中一中断处理器通过I/O协处理器36执行从该系统BIOS接收来自输入装置的数据。该中断处理器只不过安置从I/O协处理器36进入存储器33的传送。在CPU30中的应用程序通过一软件中断周期地执行对操作系统BIOS的查询，以确定是否接收了任何输入。如果是，则响应于该软件中断，通过操作系统它们被传送到该应用程序。
虽然通过本发明的实施例的描述对本发明作了具体说明，尽管对实施例作了相当详细的介绍，但申请人的意图并不是要将所附的权利要求范围限制或以任何方式限定到如此详细的地步。对本技术领域的普通技术人员来说，另外的优点和改进是很容易的。例如，该坐标确定电路系统126、键盘电路系统128、100毫秒定时器130和接口电路系统132均可在一单个微控制器中付诸实现。因此，从更广泛的角度来说，本发明并不局限于特殊的细节部分、典型的装置和方法以及例证性的例子的图示和描述。因此，在不违背申请人总的发明构思的精神和范围的前提下，对这样的细节部分可进行改动。

Claims (14)

1.一种同具有被安装在一主机壳中的中央处理单元(CPU)的计算机系统一起使用的输入装置，包括有：
(a)一包括有多个键位盘，每个键位被构成为相应于所述键位被敲击而产生击键信号；
(b)一具有垫表面的触摸垫，该触摸垫被构成为相应于所述垫表面被触摸而产生触摸位置信号；
(c)一具有第一和第二半壳的铰链双壳壳体，其中所述键盘被安置在铰链双壳壳体的第一半壳之内而所述触摸垫被安置在铰链双壳壳体的第二半壳之内，并且其中所述铰链连接第一半壳和第二半壳所述键盘和触摸垫并构成为在至少一个打开位置和一个闭合位置之间允许所述键盘相对于所述触摸垫枢轴移动；和
(d)在电路中与所述键盘和触摸垫通信的接口电路系统并且构成为相应于所述键盘的键位的敲击而传送到CPU数据信息分组并进一步构成为相应于用手指、记录针或其它物品触摸所述垫表面的触摸位置而传送到CPU数据信息分组。
2.如权利要求1所述的输入装置，其特征在于进一步包括有一用来安置所述接口电路系统在电路中与CPU通信和用来将所述主壳体与所述双壳壳体相连接的预置长度的信号导体。
3.如权利要求1-2之一所述的输入装置，其特征在于所述键盘包括具有一与其相关的一键盘标准框的第二触摸垫。
4.如权利要求1-2之一所述的输入装置，其特征在于所述触摸垫的垫表面实质上与所述键盘的尺寸相同。
5.一种同具有一中央处理单元(CPU)的计算机系统一起使用并安置在一主壳体中的输入装置，包括有：
(a)-第一箱体；
(b)-第二箱体；
(c)为了在至少一个打开位置和一个闭合位置之间使所述一个箱体相对于另一个箱体作枢轴移动而连接所述第一和第二箱体的一个铰链；
(d)-具有一垫表面的触摸垫，被安置在所述第一箱体内，并且构成为响应于所述垫表面的触摸而产生触摸位置信号；
(e)-被安置在所述第二箱体内并具有若干键位的键盘，其中的每个键位被构成为响应于所述键位敲击而产生键位敲击信号；和
(f)在电路中与所述键盘和触摸垫通信的接口电路系统，其构成为相应于所述键盘的所述键位的敲击而传送到CPU数据信息分组，并进一步构成为相应于用手指、记录针或类似物品触摸所述垫表面的触摸位置而传送到CPU数据信息分组。
6.如权利要求5所述的输入装置，其特征在于：
(a)所述第一箱体具有一般的矩形平行六面体的构形；
(b)所述第二箱体具有一般的矩形平行六面体构形；和
(c)所述铰链连接所述第一和第二箱体以容许一个箱体相对于另一个箱体按沿平行于第一和第二箱体的长度方向相对一轴作枢轴移动。
7.如权利要求5所述的输入装置，其特征在于进一步包括一用来安置所述接口电路系统在电路中与CPU通信并用来将所述主壳体连接到所述双壳壳体的预置长度信号导体。
8.如权利要求5-7之一所述的输入装置，其特征在于所述键盘包括具有一与其相关的一键盘标准框的第二触摸垫。
9.如权利要求5-7之一所述的输入装置，其特征在于所述触摸垫的垫表面实质上与所述键盘的尺寸相同。
10.一计算机处理系统，包括：
(a)一主壳体；
(b)安装在所述主壳体内的一中央处理单元(CPU)；
(c)在电路中与CPU通信并安装在所述主壳体内的一存储器电路；
(d)在电路中与CPU通信的一图形控制器，其构成为相应于一光学图像而产生至少一个电信号，并且该图形控制器被安装在所述主壳体内；
(e)被安装在所述主壳体内在电路中与所述图形控制器通信的一无线电频率调制器，并构成为相应于在无线电频率载波中适于在一电视机中接受并显示的一光学图像而调制至少一个电信号；和
(f)一包括有若干键位的键盘，每一个健位的构成为响应于所述键位的敲击而产生键位敲击信号；
(g)一实质上与所述键盘具有相同尺寸其操作与所述键盘相关的并具有一垫表面的触摸垫，并且其构成为响应于所述垫表面的触摸而产生触摸位置信号；
(h)一具有第一和第二壳体的铰链双壳壳体，在其中所述键盘被安置在所述铰链双壳壳体的第一半壳体之内而所述触摸垫被安置在所述铰链双壳壳体的第二半壳体之内，并且其中所述铰链连接所述第一半壳和第二半壳，并构成为在至少一个打开位置和一个闭合位置之间允许所述键盘相对于所述触摸垫枢轴移动；
(i)在电路中与所述键盘和触摸垫相通信的接口电路系统，其构成为相应于所述键盘的键位的敲击而传送到在主壳体内的CPU数据信息分组，并进一步构成为相应于用手指、记录针或其它类似物品触摸所述垫表面的触摸位置而传送到在主壳内的CPU数据信息分组；和
(j)用来安置所述接口电路系统在电路中与CPU通信并用来将所述主壳体与双壳壳体相连接的一预置长度的信号导体。
11.如权利要求10所述的系统，其特征在于进一步包括有用来安置所述无线电频率调制器在电路中与该标准电视机通信和用来将所述主壳体与该标准电视机相连接的一第二预置长度的第二信号导体。
12.如权利要求10所述的系统，其特征在于：
(a)所述铰链双壳壳体的第一半壳体具有一般的矩形平行六面体的构形；
(b)所述铰链双壳壳体的第二半壳体具有一般的矩形平行六面体的构形；和
(c)所述连接第一和第二壳体的铰链被构成为容许一半壳体相对于另一半壳体按沿平行于所述第一和第二壳体的长度方向相对于一轴作枢轴移动。
13.如权利要求10-12之一所述的系统，其特征在于所述键盘包括具有一与其相关的一键盘标准框的第二触摸垫。
14.如权利要求10-12之一所述的系统，其特征在于所述触摸垫的垫表面实质上与所述键盘的尺寸相同。
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