CN109148548B - 阵列基板及显示面板 - Google Patents

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Abstract

本发明涉及一种阵列基板，包括显示区和围绕显示区设置的非显示区；显示区包括阵列排布的像素电路和连接每列像素电路的第一信号线；非显示区包括共用模块，每个共用模块分别通过第一信号线连接每列像素电路，用于为像素电路提供初始化信号和数据信号；非显示区还包括数据驱动模块，数据驱动模块通过第二信号线和第三信号线连接共用模块；数据驱动模块通过第二信号线提供初始化信号至共用模块，共用模块接收初始化信号并通过第一信号线对像素电路进行初始化；数据驱动模块通过第三信号线提供数据信号至共用模块，共用模块接收数据信号并通过第一信号线对像素电路进行数据写入，解决了采用同一走线输出不同信号可能导致的显示失效的问题。

Description

阵列基板及显示面板
技术领域
本发明涉及显示领域，特别是涉及阵列基板及显示面板。
背景技术
有机发光显示面板因其具有对比度高、低功耗、视角光、反应速度快等优点，被越来越多地应用到显示领域。有机发光显示面板中包含阵列排布像素电路。通常，为了实现高分辨率，会降低像素电路的尺寸且合并将数据信号线和初始化信号线合并，即数据信号和初始化信号通过同一信号线输入至像素电路中。发明人在实现传统技术时发现，由于驱动芯片通过同一条信号线输出不同信号控制像素电路工作，容易产生控制失效的问题，进而导致显示面板显示失效。
发明内容
基于此，有必要针对驱动芯片通过同一条信号线输出不同信号控制像素电路工作，容易产生控制失效的问题，提供一种阵列基板及显示面板。
一种阵列基板，包括显示区和围绕所述显示区设置的非显示区；
所述显示区包括阵列排布的像素电路和连接每列所述像素电路的第一信号线；
所述非显示区包括共用模块，每个所述共用模块分别通过所述第一信号线连接每列所述像素电路，用于为所述像素电路提供初始化信号和数据信号；
所述非显示区还包括数据驱动模块，所述数据驱动模块通过第二信号线和第三信号线连接所述共用模块；
所述数据驱动模块通过所述第二信号线提供所述初始化信号至所述共用模块，所述共用模块接收所述初始化信号并通过所述第一信号线对所述像素电路进行初始化；
所述数据驱动模块通过所述第三信号线提供所述数据信号至所述共用模块，所述共用模块接收所述数据信号并通过所述第一信号线对所述像素电路进行数据写入。
在其中一个实施例中，所述共用模块包括初始化单元和数据写入单元；
所述初始化单元通过所述第二信号线连接所述数据驱动单元，用于接收所述数据驱动单元输出的初始化信号并通过所述第一信号线将所述初始化信号传输至所述像素电路；
所述数据写入单元通过所述第三信号线连接所述数据驱动单元，用于接收所述数据驱动单元输出的数据信号并通过所述第一信号线将所述数据信号传输至所述像素电路。
在其中一个实施例中，所述非显示区还包括扫描驱动模块和连接所述扫描驱动模块的第一控制信号线和第二控制信号线；
所述扫描驱动模块通过所述第一控制信号线提供第一控制信号至所述初始化单元，以使所述初始化单元在所述第一控制信号有效时将所述初始化信号提供至每列所述像素电路；
所述扫描驱动模块通过所述第二控制信号线提供第二控制信号至所述数据写入单元，以使所述数据写入单元在所述第二控制信号有效时将所述数据信号提供至每列所述像素电路。
在其中一个实施例中，所述初始化单元包括初始化晶体管，所述数据写入单元包括数据写入晶体管；
所述初始化晶体管的控制端通过所述第一控制信号线连接所述扫描驱动模块，所述初始化晶体管的第一极通过所述第一信号线连接所述像素电路，所述初始化晶体管的第二极通过所述第二信号线连接所述数据驱动模块；
所述数据写入晶体管的控制端通过所述第二控制信号线连接所述扫描驱动模块，所述数据写入晶体管的第一极通过所述第一信号线连接所述像素电路，所述数据写入晶体管的第二极通过所述第二信号线连接所述数据驱动模块。
在其中一个实施例中，所述像素电路包括晶体管T1、晶体管T2、晶体管T3、晶体管T4、晶体管T5、晶体管T6、电容C1和发光二极管D1；
所述晶体管T1的控制端连接所述电容C1的第一极板、所述晶体管T2的第二极和所述晶体管T6的第一极，所述晶体管T1的第一极连接所述第一电源VDD，所述晶体管T1的第二极连接所述晶体管T2的第一极和所述晶体管T3的第一极；
所述晶体管T2的控制端连接第二扫描信号线；
所述晶体管T3的控制端连接发光控制信号线，所述晶体管T3的第二极连接所述晶体管T5的第一极和所述发光二极管的D1阳极，所述发光二极管D1的阴极连接第二电源VSS；
所述晶体管T5的控制端分别连接所述晶体管T6的控制端和第一扫描信号线，所述晶体管T5的第二极连接所述晶体管T6的第二极、所述晶体管T4的第二极、所述初始化晶体管的第一极和所述数据写入晶体管的第一极；
所述晶体管T4的控制端连接第三扫描信号线，所述晶体管T4的第一极连接电容C1的第二极板。
在其中一个实施例中，所述第一控制信号和所述第一扫描信号同时有效时，所述第一控制信号控制所述初始化晶体管导通，所述第一扫描信号控制所述晶体管T5和所述晶体管T6导通，所述初始化信号对所述电容C1的第一极板、所述晶体管T1的控制端和所述发光二极管D1的阳极进行初始化。
在其中一个实施例中，所述第三扫描信号和所述第二控制信号同时有效时，所述第三扫描信号控制所述晶体管T4导通，所述第二控制信号控制所述数据写入晶体管导通，所述数据信号通过所述数据写入晶体管和所述晶体管T4写入所述电容C1的第二极板。
在其中一个实施例中，所述第三扫描信号和所述第一控制信号同时有效时，所述第三扫描信号控制所述晶体管T4导通，所述第一控制信号控制所述初始化晶体管导通，所述初始化信号通过所述电容C1施加至所述晶体管T1的控制端，并对第一电源VDD提供的电源电压进行补偿，以使流过所述晶体管T1的电流与所述第一电源VDD的电源电压无关。
在其中一个实施例中，在所述发光控制信号有效时，所述发光控制信号控制所述晶体管T3导通，电流流经所述发光二极管D1以使所述发光二极管D1发光。
一种显示面板，包括前述阵列基板。
上述阵列基板及显示面板在非显示区设置有共用模块，数据驱动模块通过第二信号线和第三信号线连接共用模块，且数据驱动模块在不同的时段输出不同的信号，可通过第二信号线提供初始化信号至共用模块，通过第三信号线提供数据信号至共用模块。共用模块将接收到的信号通过第一信号线输出至像素电路。本申请通过采用不同走线输出不同信号，可便于数据驱动模块控制，解决了采用同一走线输出不同信号可能导致的显示失效的问题。同时，在显示区内，共用模块通过第一信号线在不同时段分别传输数据信号和初始化信号至像素电路，即在显示区内数据信号和初始化信号共用一条信号线，降低了屏体走线的密度，从而可以增大开口率，实现高分辨率显示。
附图说明
图1为本申请的一个实施例提供的阵列基板模块示意图；
图2为申请的一个实施例提供的像素电路示意图；
图3为申请的一个实施例提供的像素电路的时序信号图。
具体实施方式
为使本发明的上述目的、特征和优点能够更加明显易懂，下面结合附图对本发明的具体实施方式做详细的说明。在下面的描述中阐述了很多具体细节以便于充分理解本发明。但是本发明能够以很多不同于在此描述的其它方式来实施，本领域技术人员可以在不违背本发明内涵的情况下做类似改进，因此本发明不受下面公开的具体实施例的限制。
需要说明的是，当元件被称为“设置于”另一个元件，它可以直接在另一个元件上或者也可以存在居中的元件。当一个元件被认为是“连接”另一个元件，它可以是直接连接到另一个元件或者可能同时存在居中元件。本文所使用的术语“垂直的”、“水平的”、“左”、“右”以及类似的表述只是为了说明的目的，并不表示是唯一的实施方式。
除非另有定义，本文所使用的所有的技术和科学术语与属于本发明的技术领域的技术人员通常理解的含义相同。本文中在本发明的说明书中所使用的术语只是为了描述具体的实施例的目的，不是在于限制本发明。
本申请的一个实施例提供一种阵列基板，包括显示区100和围绕显示区100设置的非显示区200。显示区100包括阵列排布的像素电路110和连接每列像素电路110的第一信号线120。非显示区200包括共用模块210，每个共用模块210分别通过第一信号线120连接每列像素电路110，用于为每列像素电路110提供初始化信号和数据信号。非显示区200还包括数据驱动模块220，数据驱动模块220通过第二信号线221和第三信号线222连接共用模块210。进一步的，数据驱动模块220通过第二信号线221提供初始化信号至共用模块210。共用模块210接收到初始化信号后通过第一信号线120对像素电路110进行初始化。数据驱动模块220通过第三信号线222提供数据信号至共用模块210。共用模块210接收到数据信号后通过第一信号线120对像素电路110进行数据写入。
本实施例中，数据驱动模块220可在不同时段输出不同的信号，并分别通过第二信号线或第三信号线传输至共用模块。需要说明的是，第一信号线120位于显示区100内，第二信号线221和第三信号线222位于非显示区内。
上述实施例提供的阵列基板在非显示区200设置有共用模块210，数据驱动模块220通过第二信号线221和第三信号线222连接共用模块210，且数据驱动模块220在不同的时段输出不同的信号，可通过第二信号线221提供初始化信号至共用模块210，通过第三信号线222提供数据信号至共用模块210。共用模块210将接收到的信号通过第一信号线120输出至像素电路110。本实施例通过采用不同走线输出不同信号，可便于数据驱动模块220控制，解决了采用同一走线输出不同信号可能导致的显示失效的问题。同时，在显示区100内，共用模块210通过第一信号线120在不同时段分别传输数据信号和初始化信号至像素电路110，即在显示区100内数据信号和初始化信号共用一条信号线，降低了屏体走线的密度，从而可以增大开口率，实现高分辨率显示。
在其中一个实施例中，请继续参见图1，共用模块210包括初始化单元211和数据写入单元212。初始化单元211通过第二信号线221连接数据驱动模块220，用于接收数据驱动模块220输出的初始化信号，并通过第一信号线120将初始化信号传输至像素电路110。数据写入单元212通过第三信号线222连接数据驱动模块，用于接收数据驱动模,220输出的数据信号并通过第一信号线120将数据信号传输至像素电路110。
本实施例中，每组初始化单元211和数据写入单元212的输出端共同连接同一条第一信号线120，并通过该第一信号线120对应连接一列像素单元。可以理解的是，初始化单元211和数据写入单元212分别在不同时段工作，当初始化单元211工作时，数据写入单元212不工作，初始化单元211接收初始化信号并通过第一信号线120传输至像素电路110。数据写入单元212工作时初始化单元211不工作，数据写入单元212接收数据信号并通过第一信号线120传输至像素电路110。因此，本实施例中数据驱动模块220分别通过不同的信号线传输两种信号，便于控制，且降低了采用同一走线输出不同信号可能导致的显示失效的风险。
在其中一个实施例中，阵列基板的非显示区200还包括扫描驱动模块230和连接所述扫描驱动模块230的第一控制信号线231和第二控制信号线232。扫描驱动模块230通过第一控制信号线231提供第一控制信号至初始化单元211，以使初始化单元211在第一控制信号有效时将初始化信号提供至每列像素电路110。扫描驱动模块230通过第二控制信号线232提供第二控制信号至数据写入单元212，以使数据写入单元212在第二控制信号有效时将所述数据信号提供至每列像素电路110。
具体的，扫描驱动模块230通过第一控制信号线231连初始化单元211的控制端，通过第二控制信号线232连接数据写入单元212的控制端。扫描驱动模块230输出第一控制信号并通过第一控制信号线231传输至初始化单元211的控制端，以使初始化单元211打开，进而初始化信号可通过初始化单元211传输至像素电路110。扫描驱动模块230输出第二控制信号并通过第二控制信号线232传输至数据写入单元212的控制端，以使数据写入单元212打开，进而数据信号可通过数据写入单元212传输至像素电路110以将数据信号写入像素电路110。
进一步的，扫描驱动模块230还通过扫描信号线连接每行像素电路110，用于为每行的像素电路110提供扫描信号。阵列基板还包括发光控制模块240，通过发光控制信号线连接每行像素电路110，用于为每行像素电路110提供发光控制信号。
可以理解的是，数据驱动模块220、扫描驱动模块230和发光控制模块240可以是各自相互独立的控制芯片，也可以集成于同一控制芯片上。
请参见图2，在其中一个实施例中，初始化单元包括初始化晶体管T7，数据写入单元包括数据写入晶体管T8。初始化晶体管T7的控制端通过第一控制信号线连接扫描驱动模块，初始化晶体管T7的第一极通过第一信号线连接像素电路，初始化晶体管T7的第二极通过第二信号线连接数据驱动模块。数据写入晶体管T8的控制端通过第二控制信号线232连接扫描驱动模块，数据写入晶体管T8的第一极通过第一信号线连接像素电路，数据写入晶体管T8的第二极通过第二信号线连接数据驱动模块。
本实施例中，初始化晶体管T7和数据写入晶体管T8可以均为P型晶体管。扫描驱动模块输出的第一控制信号和第二控制信号可以是低电平信号，进而第一控制信号和第二控制信号可以分别控制初始化晶体管T7和数据写入晶体管T8导通，以使初始化信号或数据信号可通过初始化晶体管T7或数据写入晶体管T8写入像素电路110中。
请继续参见图2，在其中一个实施例中，像素电路110包括晶体管T1、晶体管T2、晶体管T3、晶体管T4、晶体管T5、晶体管T6、电容C1和发光二极管D1。
其中，晶体管T1的控制端连接电容C1的第一极板、晶体管T2的第二极和晶体管T6的第一极，晶体管T1的第一极连接第一电源VDD，晶体管T1的第二极连接晶体管T2的第一极和晶体管T3的第一极。晶体管T2的控制端连接第二扫描信号线。晶体管T3的控制端连接发光控制信号线，晶体管T3的第二极连接晶体管T5的第一极和发光二极管的D1阳极。发光二极管D1的阴极连接第二电源VSS。晶体管T5的控制端分别连接晶体管T6的控制端和第一扫描信号线，晶体管T5的第二极连接晶体管T6的第二极、晶体管T4的第二极、初始化晶体管T7的第一极和数据写入晶体管T8的第一极。晶体管T4的控制端连接第三扫描信号线，晶体管T4的第一极连接电容C1的第二极板。
本实施例中，像素电路110的晶体管T2、晶体管T3、晶体管T4、晶体管T5、晶体管T6均为开关晶体管，晶体管T1为驱动晶体管。电容C1为储能电容，发光二极管D1为OLED(Organic Light-Emitting Diode,有机发光二极管)。本实施例中的晶体管均采用P型晶体管，可以理解的是，控制端为晶体管的栅极，第一极为晶体管的源极，第二极为晶体管的漏极，对晶体管的控制端施加低电平以使晶体管导通。由于该薄膜晶体管为对称器件，故第一极和第二极可以互换。当然，在其他实施例中，晶体管也可以是N型晶体管，在采用N型晶体管作为像素电路中的晶体管时，对晶体管的控制端输入高电平信号以使其导通。
第一电源VDD可以是正电压，并用于为晶体管T1提供电源电压，晶体管T1在第一电源VDD的作用下，可以输出电流，该电流流入发光二极管D1，使得发光二极管D1发光，在发光二极管D1发光时，该电流流入第二电源VSS，第二电源VSS可以是负电压。
图2所示电路中，S1为第一扫描信号线传输的第一扫描信号，S2为第二扫描信号线传输的第二扫描信号，S3为第三扫描信号线传输的第三扫描信号，EM为发光控制信号线传输的发光控制信号，X1为第二信号线传输的第二控制信号，X2为第三信号线传输的第三信号。
第一扫描信号线连接晶体管T5和晶体管T6的控制端，用于向晶体管T5和晶体管T6的控制端输入第一扫描信号。第二扫描信号线连接晶体管T2的控制端，用于向晶体管T2的控制端输入第二扫描信号，以控制晶体管T2的导通与断开。第三扫描信号线连接晶体管T4的控制端，用于向晶体管T4的控制端输入第三扫描信号，以控制晶体管T4的导通与断开。第一控制信号线231连接初始化晶体管T7的控制端，用于向初始化晶体管T7的控制端输入第一控制信号，以控制初始化晶体管T7的导通与断开。第二控制信号线232连接数据写入晶体管T8的控制端，用于向数据写入晶体管T8的控制端输入第二控制信号，以控制数据写入晶体管T8的导通与断开。
当第一控制信号和第一扫描信号同时有效时，第一扫描信号控制晶体管T5和晶体管T6处于导通状态，且第一控制信号控制初始化晶体管T7处于导通状态，初始化信号通过初始化晶体管T7传输至像素电路110中，并通过晶体管T6对电容C1的第一极板和晶体管T1的控制端进行初始化，以使数据能够写入电容C1。同时，初始化信号通过晶体管T5对发光二极管D1的阳极进行初始化。需要说明的是，初始化信号的电压小于第二电源VSS的电源电压，以防止在初始化阶段发光二极管D1发光。
当第二扫描信号、第三扫描信号和第二控制信号同时有效时，第二扫描信号控制晶体管T2处于导通状态，第三扫描信号控制晶体管T4处于导通状态，第二控制信号控制数据写入晶体管T8处于导通状态，数据信号通过数据写入晶体管T8和晶体管T4写入电容C1的第二极板。
当第三扫描信号和第一控制信号同时有效时，第三扫描信号控制晶体管T4处于导通状态，第一控制信号控制初始化晶体管T7处于导通状态，初始化信号通过电容C1施加至晶体管T1的控制端，并对第一电源VDD提供的电源电压进行补偿，以使流过所述晶体管T1的电流与所述第一电源VDD的电源电压无关。
当发光控制信号有效时，发光控制信号控制晶体管T3处于导通状态，电流流经所述发光二极管D1以使所述发光二极管D1发光。
图3为本申请的一个实施例提供的所述像素电路的工作时序图，基于图2与图3，所述像素电路的工作原理为：
在初始化阶段t1，第一扫描信号和第一控制信号为低电平信号，第二扫描信号、第三扫描信号、发光控制信号和第二控制信号为高电平信号。初始化晶体管T7、晶体管T5、晶体管T6导通，数据写入晶体管T8、晶体管T2、晶体管T3、晶体管T4截止。
由于初始化晶体管T7导通，初始化信号通过晶体管T7和连接晶体管T7的第一信号线进入像素电路。初始化信号通过晶体管T6对晶体管T1的控制端和电容C1的第一极板进行初始化。其中，第一参考电压Vref1可以是负电压，第一参考电压Vref1作用于晶体管T1的控制端可以使晶体管T1导通。由于晶体管T5导通，初始化信号可以对发光二极管D1的阳极进行初始化。
在数据写入阶段t2，第二扫描信号第三扫描信号和第二控制信号为低电平信号，第一扫描信号、第一控制信号和发光控制信号为高电平信号。数据写入晶体管T8、晶体管T2和晶体管T4导通，在初始化阶段，晶体管T1已导通。晶体管T3、晶体管T5、晶体管T6、初始化晶体管T7截止。
由于晶体管T1导通，第一电源VDD的电源电压写入晶体管T1的第一极，由于晶体管T1的第一极电压不断升高，直至晶体管T1处于截止与导通的临界状态，此时，晶体管T1的第一极的点位为VDD，控制端点位为VDD-|Vth|,因此实现了对晶体管T1的阈值电压的补偿。由于数据写入晶体管T8导通，数据信号经过数据写入晶体管T8进入像素电路内。由于晶体管T4导通，数据信号通过晶体管T4写入电容C1的第二极板，以使电容C1的第二极板的电位为Vdata。
在补偿阶段t3，第三扫描信号和第一控制信号为低电平信号，第一扫描信号、第二扫描信号、发光控制信号和第二控制信号为高电平信号，晶体管T4、初始化晶体管T7导通，晶体管T2、晶体管T3、晶体管T6、晶体管T5、数据写入晶体管T8截止。
由于初始化晶体管T7导通，初始化电压通过初始化晶体管T7和晶体管T4写入电容C1的第二极板，因此，电容C1的第二极板的电位由Vdata变为Vref。由于晶体管T2和晶体管T6截止，电容C1两端的电压差不变，根据电容耦合原理，在电容C1的电压差保持不变的情况下，电容C1的第一极板的电位也会随第二极板的变化而变化，故电容C1的第一极板的电位变化量为Vref-Vdata。由于晶体管T1的控制端连接电容C1的第一极板，进而，晶体管T1的控制端电位变化量为Vref-Vdata。因此，晶体管T1的控制端的电位为VDD-|Vth|+Vref-Vdata。
在发光阶段t4，发光控制信号为低电平信号，第一扫描信号、第二扫描信号、第三扫描信号、第一控制信号和第二控制信号均为高电平信号。晶体管T3导通，晶体管T2、晶体管T4、晶体管T6、晶体管T5、初始化晶体管T7、数据写入晶体管T8截止。由于晶体管T3导通，则从第一电源VDD、晶体管T1、晶体管T3、发光二极管D1至第二电源VSS的回路导通。流过晶体管T1的电流为：
I＝K*(Vgs-Vth)2＝K*(VDD-|Vth|+Vref-Vdata-VDD+|Vth|)2＝K*(Vref-Vdata)2
其中，K＝1/2*μ*Cox*W/L。μ是晶体管T1的电子迁移率，Cox是晶体管T1单位面积的栅氧化层电容，W是晶体管T1的沟道宽度，L是晶体管T1的沟道长度。流过晶体管T1的驱动电流即为流过发光二极管D1的发光电流。由上述公式可以看出，流过发光二极管D1的发光电流与第一电源VDD的电压无关，与晶体管的阈值电压也无关，而与初始化信号的电压值有关。因此本申请的实施例提供的阵列基板，其上的电路结构可利用初始化信号补偿第一电源线上的电流-电阻压降，同时，上述电路结构及其控制方法也补偿了阈值电压对发光电流的影响，因此可以提高屏体发光的均一性。且阵列基板的数据驱动模块分别通过第二信号线和第三信号线连接初始化晶体管T7和数据写入晶体管T8，通过不同的信号线传输不同的信号，便于控制，防止产生显示失效的问题。在显示区内，初始化晶体管T7和数据写入晶体管T8均通过第一信号线向像素电路输入信号，因此降低了屏体的走线密度，进一步提高屏体的分辨率。
以上所述实施例的各技术特征可以进行任意的组合，为使描述简洁，未对上述实施例中的各个技术特征所有可能的组合都进行描述，然而，只要这些技术特征的组合不存在矛盾，都应当认为是本说明书记载的范围。
以上所述实施例仅表达了本发明的几种实施方式，其描述较为具体和详细，但并不能因此而理解为对发明专利范围的限制。应当指出的是，对于本领域的普通技术人员来说，在不脱离本发明构思的前提下，还可以做出若干变形和改进，这些都属于本发明的保护范围。因此，本发明专利的保护范围应以所附权利要求为准。

Claims (10)

1.一种阵列基板，其特征在于，包括显示区和围绕所述显示区设置的非显示区；
所述显示区包括阵列排布的像素电路和连接每列所述像素电路的第一信号线；
所述非显示区包括共用模块，每个所述共用模块分别通过所述第一信号线连接每列所述像素电路，用于为所述像素电路提供初始化信号和数据信号；
所述非显示区还包括数据驱动模块和扫描驱动模块，所述数据驱动模块通过第二信号线和第三信号线连接所述共用模块，所述扫描驱动模块通过第一控制信号线和第二控制信号线连接所述共用模块；
所述扫描驱动模块通过所述第一控制信号线提供第一控制信号至所述共用模块，当所述第一控制信号有效时，所述数据驱动模块通过所述第二信号线提供所述初始化信号至所述共用模块，所述共用模块接收所述初始化信号并通过所述第一信号线对所述像素电路进行初始化；
所述扫描驱动模块通过所述第二控制信号线提供第二控制信号至所述共用模块，当所述第二控制信号有效时，所述数据驱动模块通过所述第三信号线提供所述数据信号至所述共用模块，所述共用模块接收所述数据信号并通过所述第一信号线对所述像素电路进行数据写入。
2.根据权利要求1所述的阵列基板，其特征在于，所述共用模块包括初始化单元和数据写入单元；
所述初始化单元通过所述第二信号线连接所述数据驱动模块，用于接收所述数据驱动模块输出的初始化信号并通过所述第一信号线将所述初始化信号传输至所述像素电路；
所述数据写入单元通过所述第三信号线连接所述数据驱动模块，用于接收所述数据驱动模块输出的数据信号并通过所述第一信号线将所述数据信号传输至所述像素电路。
3.根据权利要求2所述的阵列基板，其特征在于，所述非显示区还包括扫描驱动模块和连接所述扫描驱动模块的第一控制信号线和第二控制信号线；
所述扫描驱动模块通过所述第一控制信号线提供第一控制信号至所述初始化单元，以使所述初始化单元在所述第一控制信号有效时将所述初始化信号提供至每列所述像素电路；
所述扫描驱动模块通过所述第二控制信号线提供第二控制信号至所述数据写入单元，以使所述数据写入单元在所述第二控制信号有效时将所述数据信号提供至每列所述像素电路。
4.根据权利要求3所述的阵列基板，其特征在于，所述初始化单元包括初始化晶体管，所述数据写入单元包括数据写入晶体管；
所述初始化晶体管的控制端通过所述第一控制信号线连接所述扫描驱动模块，所述初始化晶体管的第一极通过所述第一信号线连接所述像素电路，所述初始化晶体管的第二极通过所述第二信号线连接所述数据驱动模块；
所述数据写入晶体管的控制端通过所述第二控制信号线连接所述扫描驱动模块，所述数据写入晶体管的第一极通过所述第一信号线连接所述像素电路，所述数据写入晶体管的第二极通过所述第二信号线连接所述数据驱动模块。
5.根据权利要求4所述的阵列基板，其特征在于，所述像素电路包括晶体管T1、晶体管T2、晶体管T3、晶体管T4、晶体管T5、晶体管T6、电容C1和发光二极管D1；
所述晶体管T1的控制端连接所述电容C1的第一极板、所述晶体管T2的第二极和所述晶体管T6的第一极，所述晶体管T1的第一极连接第一电源VDD，所述晶体管T1的第二极连接所述晶体管T2的第一极和所述晶体管T3的第一极；
所述晶体管T2的控制端连接第二扫描信号线；
所述晶体管T3的控制端连接发光控制信号线，所述晶体管T3的第二极连接所述晶体管T5的第一极和所述发光二极管的D1阳极，所述发光二极管D1的阴极连接第二电源VSS；
所述晶体管T5的控制端分别连接所述晶体管T6的控制端和第一扫描信号线，所述晶体管T5的第二极连接所述晶体管T6的第二极、所述晶体管T4的第二极、所述初始化晶体管的第一极和所述数据写入晶体管的第一极；
所述晶体管T4的控制端连接第三扫描信号线，所述晶体管T4的第一极连接电容C1的第二极板。
6.根据权利要求5所述的阵列基板，其特征在于，所述第一控制信号和所述第一扫描信号同时有效时，所述第一控制信号控制所述初始化晶体管导通，所述第一扫描信号控制所述晶体管T5和所述晶体管T6导通，所述初始化信号对所述电容C1的第一极板、所述晶体管T1的控制端和所述发光二极管D1的阳极进行初始化。
7.根据权利要求6所述的阵列基板，其特征在于，所述第三扫描信号和所述第二控制信号同时有效时，所述第三扫描信号控制所述晶体管T4导通，所述第二控制信号控制所述数据写入晶体管导通，所述数据信号通过所述数据写入晶体管和所述晶体管T4写入所述电容C1的第二极板。
8.根据权利要求7所述的阵列基板，其特征在于，所述第三扫描信号和所述第一控制信号同时有效时，所述第三扫描信号控制所述晶体管T4导通，所述第一控制信号控制所述初始化晶体管导通，所述初始化信号通过所述电容C1施加至所述晶体管T1的控制端，并对第一电源VDD提供的电源电压进行补偿，以使流过所述晶体管T1的电流与所述第一电源VDD的电源电压无关。
9.根据权利要求8所述的阵列基板，其特征在于，在所述发光控制信号有效时，所述发光控制信号控制所述晶体管T3导通，电流流经所述发光二极管D1以使所述发光二极管D1发光。
10.一种显示面板，其特征在于，包括权利要求1-9中任一项所述的阵列基板。
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