CN109037326B - 一种具有p型埋层结构的增强型hemt器件及其制备方法 - Google Patents

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Abstract

一种具有P型埋层结构的增强型HEMT器件及其制备方法,属于半导体晶体管器件制作领域。技术要点包括:在半导体衬底上依次生长缓冲层、i‑GaN漂移层、势垒层和栅极钝化层,所述i‑GaN漂移层上设置有源电极和漏电极,所述栅极钝化层上设置有栅电极,所述i‑GaN漂移层中内嵌P型埋层。该结构利用P型埋层形成PN结内建电场,从而耗尽栅极下方的二维电子气达到增强型的目的。有益效果是:本发明所述的具有P型埋层结构的增强型HEMT器件及其制备方法能够实现在二维电子气沟道导电性能不发生退化的情况下同时提高器件稳定而均匀的正向阈值电压,对该领域是个重要的技术补充。

Description

一种具有P型埋层结构的增强型HEMT器件及其制备方法
技术领域
本发明属于半导体晶体管器件制作领域,尤其涉及一种具有P型埋层结构的增强型HEMT器件及其制备方法。
背景技术
二十世纪末以来,在以Si为代表的第一代半导体和以GaAs为代表的第二代半导体之后,第三代半导体材料迅猛发展。第三代半导体材料具有优秀的物理和化学特性,近年来已被广泛地应用于无线通信、卫星、照明等领域。其中比较具有代表性的材料有GaN和SiC等。第三代半导体也称宽禁带半导体,具有较宽的禁带宽度,一般大于2eV,具有较高的击穿场强,较高的热导率和较高的电子饱和速率,因此具有更为优异的功率特性,适合应用于大功率器件中,可以实现高击穿电压和低导通电阻,因此可以工作于更高的电压、电流以及更高的温度下。特别地,由于带阶差、极化效应和表面态的作用,GaN基异质结(典型如AlGaN/GaN)的界面处可以在非故意掺杂的情况下产生高密度的二维电子气(2-DEG)(>1013cm-2),其电子迁移率可稳定达到2000cm2V-1s-1以上。以2-DEG为导电沟道的高电子迁移率晶体管(HEMT)器件在导通电阻和饱和电流上有很大优势,因此在新型功率开关器件中脱颖而出。
由于2-DEG可以在不施加偏压及故意掺杂的情况下稳定存在于AlGaN/GaN异质结界面处,目前研究者们已经可以基于AlGaN/GaN异质结制作出满足控制电路基本要求的耗尽型HEMT器件。相比于耗尽型器件,增强型功率器件的使用不仅能够简化电路,还能大幅减少电路功率损耗,然而,由于结构创新的局限和工艺复杂程度带来的新不确定因素,增强型HEMT器件的结构设计与制作工艺仍然难以达到其在控制电路中的理想要求。
目前实现增强型HEMT器件的方法都是对沟道上方的栅极势垒层进行设计调整,主要有栅极势垒层刻蚀、栅极势垒层氟离子注入和采用具有P-GaN帽层的栅电极结构三种。然而这些方法都有一些难以避免的缺陷:势垒层刻蚀带来的表面不平整会增强沟道内电子的杂质散射,从而导致沟道电子迁移率降低,引起开态电阻退化;注入势垒层的氟离子具有温度不稳定性,因此导致阈值电压随温度漂移,降低了器件的可靠性;P-GaN帽层的插入使栅极与沟道间的距离增大,削弱了器件的栅控能力,导致器件跨导的退化,从而降低了器件的开关速率。由于以上三种方法均在沟道上方的栅极势垒层进行附加工艺步骤,由此引入额外缺陷和杂质,因此二维电子气沟道导电性能发生退化,器件导通电阻增加。因此,如何在不增加器件导通电阻的前提下,提高并形成稳定而均匀的正向阈值电压,是目前需要解决的难题之一。
发明内容
为了解决上述现有技术中的问题,本发明提出一种具有P型埋层结构的增强型HEMT器件及其制备方法,该增强型HEMT器件能够实现在不向栅极上方势垒层引入新的杂质和缺陷的情况下实现稳定而均匀的正向阈值电压。
技术方案如下:
一种具有P型埋层结构的增强型HEMT器件,在半导体衬底上依次生长缓冲层、i-GaN漂移层、势垒层和栅极钝化层,所述i-GaN漂移层上设置有源电极和漏电极,所述栅极钝化层上设置有栅电极,所述i-GaN漂移层中内嵌P型埋层。
一种具有P型埋层结构的增强型HEMT器件,在半导体衬底上依次生长缓冲层、i-GaN漂移层、势垒层和栅极钝化层,所述i-GaN漂移层上设置有源电极和漏电极,所述栅极钝化层上设置有栅电极,所述i-GaN漂移层中内嵌P型埋层,所述P型埋层设置在所述栅电极下方,所述P型埋层和所述栅电极之间的i-GaN漂移层、势垒层和栅极钝化层顺势向上凸出。
进一步的,所述半导体衬底为Si、蓝宝石、SiC、GaN、金刚石、石墨烯中的任意一种。
进一步的,所述缓冲层由AlN超晶格结构或者AlGaN超晶格结构构成。
进一步的,所述i-GaN漂移层的厚度为0.5~10μm,所述势垒层是Al组分比例为0.1~0.35的AlGaN。
进一步的,所述P型埋层为P-GaN。
本发明还包括一种具有P型埋层结构的增强型HEMT器件制备方法,步骤如下:
S1、采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在衬底上依次生长AlN超晶格结构缓冲层或者AlGaN超晶格结构缓冲层、非故意掺杂的i-GaN层;
S2、采用等离子体增强化学的气相沉积法或者电子束蒸发法沉积SiO2、Si3N4或者Ni金属作为硬掩膜层,并利用半导体光刻法刻出1~3μm的掩膜开口;
S3、对P型埋层进行生长;
S4、采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在样品表面生长5~100nm的i-GaN层和10~30nm的AlGaN层,Al组分比例为0.1~0.35,形成异质结;生长10-50nm的钝化层,钝化层采用氮化硅、氧化铝、氧化镓的任意一种;
S5、采用半导体光刻方法定义出源、漏电极所需区域,通过ICP刻蚀方法,将源、漏区域表面钝化层及AlGaN层刻蚀掉,采用磁控溅射法、电子束蒸发法或者热蒸发法沉积复合金属结构,利用高温退火形成合金,制作源、漏电极欧姆接触;通过半导体光刻方法定义出栅电极区域,通过磁控溅射法、电子束蒸发法或者热蒸发法沉积栅电极金属,形成栅区金属-绝缘层-半导体结构。
进一步的,步骤S3中对P型埋层进行生长方法步骤如下:
S3.1、利用半导体刻蚀方法制作出生长埋层所需的凹槽,通过基于Cl基气体的反应耦合等离子体半导体刻蚀法,刻蚀100~500nm深度凹槽;
S3.2、采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在样品表面生长100~500nm的P型埋层,然后采用缓冲氢氟酸BOE溶液腐蚀除去硬掩膜,获得平整的GaN表面。
进一步的,步骤S3中对P型埋层进行生长方法步骤如下:采用离子注入法在样品表面注入Mg或Fe或Mg/Al复合杂质,然后用缓冲氢氟酸BOE溶液去除硬掩膜,获得平整的GaN表面,并采用热退火法进行杂质激活,完成P-GaN埋层制作。
进一步的,采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在样品表面生长100~500nm的P-GaN层,并用缓冲氢氟酸BOE溶液去除硬掩膜。
本发明的有益效果是:
本发明所述的具有P型埋层结构的增强型HEMT器件及其制备方法能够实现在不向栅极上方势垒层引入新的杂质和缺陷的情况下实现稳定而均匀的正向阈值电压。
附图说明
图1是本发明提出的具有P型埋层的增强型HEMT器件结构示意图①;
图2是本发明提出的具有P型埋层的增强型HEMT器件结构示意图②;
图3是本发明实施例2步骤①所述的晶圆生长后的结构示意图;
图4是本发明实施例2步骤②所述的硬掩膜生长后的结构示意图;
图5是本发明实施例2步骤③所述的埋层凹槽刻蚀后的结构示意图;
图6是本发明实施例2步骤④所述的P-GaN埋层生长后的结构示意图;
图7是本发明实施例2步骤⑤所述的极化结和钝化层生长后的结构示意图;
图8是本发明实施例2步骤⑥所述的源、漏、栅电极制作后的结构示意图;
图9是本发明实施例3步骤③所述的离子注入后的结构示意图;
图10是本发明实施例4步骤③所述的P-GaN埋层生长后的结构示意图;
图11是本发明实施例4步骤④所述的异质结和钝化层生长后的结构示意图;
图12是本发明实施例4步骤⑤所述的源、漏、栅电极制作后的结构示意图;
图13是基于实施例5参数获得的器件性能结果(ID-VG曲线)示意图;
图14是基于实施例5参数获得的器件性能结果(ID-VD曲线)示意图。
具体实施方式
下面结合附图1-14对具有P型埋层结构的增强型HEMT器件及其制备方法做进一步说明。
实施例1
一种具有P型埋层结构的增强型HEMT器件,器件结构基本组成由下至上分别为:
(1)Si、蓝宝石、SiC、GaN、金刚石或石墨烯等材料衬底,由于不同材料的晶格常数、热膨胀系数和热导率不同,可根据成本以及对外延片的质量要求进行选择;
(2)由AlN或者AlGaN超晶格结构构成的缓冲层;
(3)0.5~10μm的非故意掺杂的i-GaN漂移层;
(4)位于i-GaN漂移层内的P-GaN埋层,用以在零偏栅压下耗尽栅极下方2-DEG沟道中的电子实现增强型操作;
(5)i-GaN沟道层上方Al组分为0.1~0.35的AlGaN势垒层,使其在i-GaN沟道层内形成导电2-DEG;
(6)栅极钝化层用以防止栅极漏电并调制阈值电压;
(7)源(source)、栅(gate)、漏(drain)金属电极。
其基本工作原理是:由于大的带阶差和极化效应,AlGaN/i-GaN异质结界面下方的沟道层内产生高密度的导电2-DEG,由于P型埋层的插入,在零偏栅压下,栅极下方沟道内的2-DEG被耗尽,器件导电沟道夹断,器件因此处于关断状态;当在栅极施加大于器件阈值电压的栅极电压后,栅极下方沟道内电子积累,源漏之间形成连续的导电沟道,器件处于开启状态。
实施例2
步骤①:晶圆生长。采用如金属有机物化学气相沉积(MOCVD)、分子束外延(MBE)等半导体材料生长技术依次在Si、蓝宝石或者GaN衬底上依次生长AlN或者AlGaN超晶格结构缓冲层、0.5~10μm的非故意掺杂的i-GaN层,如图3所示;
步骤②:硬掩膜生长。采用等离子体增强化学的气相沉积法(PECVD)或者电子束蒸发法沉积SiO2、Si3N4或者Ni金属作为硬掩膜层,并利用半导体光刻技术实现1~3μm的掩膜开口,如图4所示。其中半导体光刻技术包含一整套的匀胶、软烘、曝光、显影、坚膜等步骤;
步骤③:埋层凹槽刻蚀。利用半导体刻蚀技术制作出生长埋层所需的凹槽,通过如基于Cl基气体的反应耦合等离子体(ICP)等半导体刻蚀技术,刻蚀100~500nm深度凹槽,如图5所示;
步骤④:P型埋层生长。采用如金属有机物化学气相沉积(MOCVD)、分子束外延(MBE)等半导体材料生长技术在样品表面生长100~500nm的P型埋层(典型的P型埋层为P-GaN),然后采用缓冲氢氟酸BOE溶液腐蚀除去硬掩膜,获得平整的GaN表面,如图6所示;
步骤⑤:异质结和钝化层生长。采用如金属有机物化学气相沉积(MOCVD)、分子束外延(MBE)等半导体材料生长技术在样品表面生长5~100nm的i-GaN层和10~30nm的AlGaN层,Al组分为0.1~0.35,形成异质结;生长10-50nm的钝化层,钝化层可为氮化硅、氧化铝或者氧化镓等,如图7所示;
步骤⑥:源、漏、栅电极制作。采用半导体光刻技术定义出源、漏电极所需区域,通过如基于Cl基气体的ICP刻蚀技术,将源、漏区域表面钝化层及AlGaN层刻蚀掉,采用磁控溅射、电子束蒸发或者热蒸发等金属沉积技术沉积复合金属结构,利用高温退火形成合金,制作良好的源、漏电极欧姆接触;通过半导体光刻技术定义出栅电极区域,通过如磁控溅射、电子束蒸发或者热蒸发等金属沉积技术沉积栅电极金属,形成栅区金属-绝缘层-半导体(MIS)结构,器件制作完成,如图8所示。
实施例3
步骤①:晶圆生长。与实施例2步骤①相似;
步骤②:硬掩膜生长。与实施例2步骤②相似;
步骤③:离子注入。采用离子注入技术在样品表面注入Mg或Fe或Mg/Al复合杂质,然后用缓冲氢氟酸BOE溶液去除硬掩膜,获得平整的GaN表面,并采用热退火技术进行杂质激活,完成P-GaN埋层制作,如图9所示;
步骤④:异质结和钝化层生长。与实施例2步骤⑤相似;
步骤⑤:源、漏、栅电极制作。与实施例2步骤⑥相似。
实施例4
步骤①:晶圆生长。与实施例2步骤①相似;
步骤②:硬掩膜生长。与实施例2步骤②相似;
步骤③:P-GaN埋层生长。采用如金属有机物化学气相沉积(MOCVD)、分子束外延(MBE)等半导体材料生长技术在样品表面生长100~500nm的P-GaN层,并用缓冲氢氟酸BOE溶液去除硬掩膜,如图10所示;
步骤④:异质结和钝化层生长。与实施例2步骤⑤相似,如图11所示;
步骤⑤:源、漏、栅电极制作。与实施例2步骤⑥相似,如图12所示。
实施例5
步骤①:晶圆生长。采用MOCVD技术依次在p型Si衬底上依次生长200nmAlGaN超晶格缓冲层、3μm的本征i-GaN层;
步骤②:硬掩膜生长。采用PECVD技术沉积350nm的SiO2层,利用光刻技术定义2μm的掩膜开口区域,过程为:
(1)将样品以4000r/min的速率持续30s均匀旋涂AZ5214光刻胶;
(2)将样品放置在100℃的热板上加热软烘90s;
(3)把样品放置在光强为7mW/cm2的左右曝光机中持续曝光20s;
(4)在显影液中显影45s;
(5)在100℃的热板上加热坚膜60s。然后用缓冲氢氟酸BOE去除开口处掩膜;
步骤③:埋层凹槽刻蚀。利用ICP刻蚀技术,采用BCl3反应气体,在200W功率下刻蚀埋层凹槽,刻蚀深度为170nm,后通过丙酮溶液清洗去胶;
步骤④:P型埋层生长。采用MOCVD技术在样品表面生长170nm的P-GaN层,并用BOE溶液去除硬掩膜,获得平整干净的GaN表面;
步骤⑤:异质结和钝化层生长。采用MOCVD技术在样品表面生长5nm的i-GaN层,20nm的Al0.25Ga0.75N层以及50nm的氮化硅层;
步骤⑥:源、漏电极制作。通过步骤②所述的半导体光刻技术定义出源、漏电极所需区域,利用ICP刻蚀技术,采用BCl3反应气体和50W功率的低损伤刻蚀工艺,实现源、漏电极区域AlGaN势垒层刻蚀;通过电子束蒸发技术沉积Ti/Al/Ni/Au(20/100/45/55nm)复合金属结构,然后金属剥离、清洗去胶;在875℃高温和氮气环境中退火30s,使复合金属结构变为合金,形成良好的欧姆接触;
步骤⑦:栅电极制作。通过步骤②所述的半导体光刻技术定义出栅电极所需区域,栅长为1μm,栅宽为300μm,通过电子束蒸发技术沉积Ni/Au(100/50nm)复合金属结构,后金属剥离、清洗去胶,完成栅电极制作。
图13和图14为基于本实施例结构和工艺参数获得的器件性能结构,其中图13器件开关转移特性曲线,图14输出特性曲线。由图中可以看出,基于本专利申请方案的HEMT器件阈值电压约为3V,为典型的增强型HEMT器件类型,在器件结构参数和工艺条件进一步优化后,将获得更优的器件整体性能。
本发明技术方案对现有的异质结HEMT器件制作是个重要的技术补充,本发明方案可用于微波射频器件,也可用于功率开关器件制作过程。本发明所述的实施例,并非对本发明内容进行限定,其他具有2-DEG的异质结HEMT器件都适用于本发明提案涉及范围。任何其他钝化层生长(包括不同的生长技术、不同的钝化层组合或者也可直接省略钝化工艺步骤)、欧姆接触电极制作工艺(包括不同的金属选择、沉积方法、退火条件)或者台面刻蚀工艺,在基于实现本发明所述增强型器件基本功能目的下,都适用于本发明提案涉及范围。P型埋层为P-GaN,也可采用其他P型材料,或者采用氟离子、氧离子等其他类型离子注入技术形成区域埋层,任何修饰和改动,在基于实现器件栅区下方沟道载流子耗尽从而使器件达到增强型类型特点的目的下,都应涵盖在本发明的保护范围之内。同样地,材料结构参数、电极的尺寸和P型埋层形状的改变,或等同替换等,都应涵盖在本发明的保护范围之内。

Claims (8)

1.一种具有P型埋层结构的增强型HEMT器件,其特征在于,在半导体衬底上依次生长缓冲层、i-GaN漂移层、势垒层和栅极钝化层,所述i-GaN漂移层上设置有源电极和漏电极,所述栅极钝化层上设置有栅电极,所述i-GaN漂移层中内嵌P型埋层;制备步骤如下:
S1、采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在衬底上依次生长AlN超晶格结构缓冲层或者AlGaN超晶格结构缓冲层、非故意掺杂的i-GaN层;
S2、采用等离子体增强化学的气相沉积法或者电子束蒸发法沉积SiO2、Si3N4或者Ni金属作为硬掩膜层,并利用半导体光刻法刻出1~3μm的掩膜开口;
S3、对P型埋层进行生长:采用离子注入法在样品表面注入Mg或Fe或Mg/Al复合杂质,然后用缓冲氢氟酸BOE溶液去除硬掩膜,获得平整的GaN表面,并采用热退火法进行杂质激活,完成P-GaN埋层制作;
S4、采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在样品表面生长5~100nm的i-GaN层和10~30nm的AlGaN层,Al组分比例为0.1~0.35,形成异质结;生长10-50nm的钝化层,钝化层采用氮化硅、氧化铝、氧化镓的任意一种;
S5、采用半导体光刻方法定义出源、漏电极所需区域,通过ICP刻蚀方法,将源、漏区域表面钝化层及AlGaN层刻蚀掉,采用磁控溅射法、电子束蒸发法或者热蒸发法沉积复合金属结构,利用高温退火形成合金,制作源、漏电极欧姆接触;通过半导体光刻方法定义出栅电极区域,通过磁控溅射法、电子束蒸发法或者热蒸发法沉积栅电极金属,形成栅区金属-绝缘层-半导体结构。
2.如权利要求1所述的具有P型埋层结构的增强型HEMT器件,其特征在于,所述P型埋层设置在所述栅电极下方,所述P型埋层和所述栅电极之间的i-GaN漂移层、势垒层和栅极钝化层顺势向上凸出。
3.如权利要求1或2所述的具有P型埋层结构的增强型HEMT器件,其特征在于,所述半导体衬底为Si、蓝宝石、SiC、GaN、金刚石的任意一种。
4.如权利要求1或2所述的具有P型埋层结构的增强型HEMT器件,其特征在于,所述缓冲层由AlN超晶格结构或者AlGaN超晶格结构构成。
5.如权利要求1或2所述的具有P型埋层结构的增强型HEMT器件,其特征在于,所述i-GaN漂移层的厚度为0.5~10μm,所述势垒层是Al组分比例为0.1~0.35的AlGaN。
6.如权利要求1或2所述的具有P型埋层结构的增强型HEMT器件,其特征在于,所述P型埋层为P-GaN。
7.如权利要求1所述的具有P型埋层结构的增强型HEMT器件,其特征在于,步骤S3中对P型埋层进行生长方法步骤如下:
S3.1、利用半导体刻蚀方法制作出生长埋层所需的凹槽,通过基于Cl基气体的反应耦合等离子体半导体刻蚀法,刻蚀100~500nm深度凹槽;
S3.2、采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在样品表面生长100~500nm的P型埋层,然后采用缓冲氢氟酸BOE溶液腐蚀除去硬掩膜,获得平整的GaN表面。
8.如权利要求1所述的具有P型埋层结构的增强型HEMT器件,其特征在于,采用金属有机物化学气相沉积、分子束外延半导体材料生长方法在样品表面生长100~500nm的P-GaN层,并用缓冲氢氟酸BOE溶液去除硬掩膜。
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