CN109003906A - 一种基板双面塑封制程方法 - Google Patents

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Abstract

本发明涉及一种基板双面塑封制程方法,它包括以下步骤:步骤一、在基板背面植球;步骤二、在基板背面进行芯片装片、打线;步骤三、在基板正面进行芯片装片、打线;步骤四、上模组上设置有多个上模组伸缩凸块,下模组上设置有多个下模组伸缩凸块,将完成步骤三的基板放置在下模组上,上模组和下模组合模,基板位于上模组伸缩凸块和下模组伸缩凸块之间;步骤五、完成注塑后,上模组伸缩凸块和下模组伸缩凸块收缩,打开上模组,取出包封产品;步骤六、将包封产品周围残留的塑封胶去除,完成基板双面包封制程。本发明一种基板双面塑封制程方法,它能够通过控制伸缩凸块的长度实现基板的双面一次完成塑封,且可以保证基板正面与背面的塑封体的厚度不同,可以提高塑封效率,减少基板翘曲。

Description

一种基板双面塑封制程方法
技术领域
本发明涉及一种基板双面塑封制程方法,属于半导体封装技术领域。
背景技术
传统双面包封工艺基本制作方法如下(如图1所示):
先进行基板正面芯片装片、打线后,再根据基板正面塑封体2的厚度选择对应的模腔进行塑封,完成基板正面塑封,再进行基板背面植球工艺,通过回流固化锡球3后,此时进行基板背面芯片装片、打线后,再次根据背面塑封体1的厚度选择对应模腔进行背面塑封,完成基板双面包封工艺。
上述传统工艺方法的缺点:传统双面包封工艺由于基板正面塑封体与背面塑封体存在模腔的厚度不同,需要进行单独包封,影响基板包封效率。
发明内容
本发明所要解决的技术问题是针对上述现有技术提供一种基板双面塑封制程方法,它能够通过控制伸缩凸块的长度实现基板的双面一次完成塑封,且可以保证基板正面与背面的塑封体的厚度不同,可以提高塑封效率,减少基板翘曲。
本发明解决上述问题所采用的技术方案为:一种基板双面塑封制程方法,其特征在于所述方法包括以下步骤:
步骤一、在基板背面植球;
步骤二、在基板背面进行芯片装片、打线;
步骤三、在基板正面进行芯片装片、打线;
步骤四、上模组上设置有多个上模组伸缩凸块,下模组上设置有多个下模组伸缩凸块,将完成步骤三的基板放置在下模组上,上模组和下模组合模,基板位于上模组伸缩凸块和下模组伸缩凸块之间,通过气压调节上模组伸缩凸块和下模组伸缩凸块高度,然后进行注塑包封;
步骤五、完成注塑后,上模组伸缩凸块和下模组伸缩凸块收缩,打开上模组,取出产品;
步骤六、将包封产品周围残留的塑封胶去除,完成基板双面包封制程。
优选的,上模组和下模组上均设置有横向活动轨道和纵向活动轨道,上模组伸缩凸块和下模组伸缩凸块分别位于上模组和下模组上横向活动轨道和纵向活动轨道内。
优选的,上模组伸缩凸块和下模组伸缩凸块的位置对应于基板的切割道。
优选的,上模组伸缩凸块的高度和下模组伸缩凸块的高度可以自由调节。
优选的,上模组伸缩凸块和下模组伸缩凸块连接空气压缩装置,通过气压控制伸长和缩短。
优选的,下模组上设置有下模组挖槽。
与现有技术相比,本发明的优点在于:
本发明一种基板双面塑封制程方法,其上下模组都设有伸缩凸块,通过控制伸缩凸块高度,可以调节基板正面和背面的塑封体的高度,基板双面一次包封完成,另外由于每个基板的单颗产品的切割道上都分布伸缩凸块,可以减少塑封料的收缩率,减少基板包封中产生的翘曲问题。
附图说明
图1为传统双面包封工艺方法的示意图。
图2为本发明一种基板双面塑封制程方法的示意图。
图3为图2中下模组的剖视图。
图4为图2中上模组的剖视图。
其中:
背面塑封体1
正面塑封体2
锡球3
下模组伸缩凸块4
下模组塑封体5
上模组伸缩凸块6
上模组塑封体7
基板8
活塞9
下模组挖槽10
横向活动轨道11
纵向活动轨道12
单个产品13
活塞口14
流道口15。
具体实施方式
以下结合附图实施例对本发明作进一步详细描述。
本实施例中的一种基板双面塑封制程方法,它包括以下步骤:
步骤一、在基板8背面植球;
步骤二、在基板8背面进行芯片装片、打线;
步骤三、将完成步骤二的产品朝下放置在载具上,在基板8正面进行芯片装片、打线;
步骤四、参见图2~图4,上模组上设置有多个上模组伸缩凸块6,下模组上设置有多个下模组伸缩凸块4,将完成步骤三的基板8放置在下模组上,上模组和下模组合模,基板位于上模组伸缩凸块6和下模组伸缩凸块4之间,通过气压调节上模组伸缩凸块6 和下模组伸缩凸块4高度,从而调节基板8上下位置,控制产品的上模组塑封体7和下模组塑封体5的厚度,包封时向上挤压下模组上的活塞9至上模组的活塞口14,使塑封胶料从活塞9通过流道口15而进入上下模组内,待模流速度稳定后继续填充,当塑封胶填充模组后,活塞保持静止并持续一段时间直到塑封胶硬化;
上模组和下模组上均设置有横向活动轨道11和纵向活动轨道12,上模组伸缩凸块6和下模组伸缩凸块4分别位于上模组和下模组上横向活动轨道11和纵向活动轨道12 内,可以根据单颗产品13尺寸大小移动;
优选的,上模组伸缩凸块6和下模组伸缩凸块4的位置对应于基板的切割道。
优选的,上模组伸缩凸块6的高度和下模组伸缩凸块4的高度可以自由调节。
上模组伸缩凸块6和下模组伸缩凸块4连接空气压缩装置,通过气压控制伸长和缩短;
下模组上设置有下模组挖槽10,能够保护基板背面的芯片和焊线;
步骤五、完成注塑后,上模组伸缩凸块6和下模组伸缩凸块4收缩,拉动活塞9,打开上模组,取出包封产品;
步骤六、将包封产品周围残留的塑封胶去除,完成基板双面包封制程。
除上述实施例外,本发明还包括有其他实施方式,凡采用等同变换或者等效替换方式形成的技术方案,均应落入本发明权利要求的保护范围之内。

Claims (6)

1.一种基板双面塑封制程方法,其特征在于所述方法包括以下步骤:
步骤一、在基板背面植球;
步骤二、在基板背面进行芯片装片、打线;
步骤三、在基板正面进行芯片装片、打线;
步骤四、上模组上设置有多个上模组伸缩凸块,下模组上设置有多个下模组伸缩凸块,将完成步骤三的基板放置在下模组上,上模组和下模组合模,基板位于上模组伸缩凸块和下模组伸缩凸块之间,通过气压调节上模组伸缩凸块和下模组伸缩凸块高度,然后进行注塑包封;
步骤五、完成注塑后,上模组伸缩凸块和下模组伸缩凸块收缩,打开上模组,取出包封产品;
步骤六、将包封产品周围残留的塑封胶去除,完成基板双面包封制程。
2.根据权利要求1所述的一种基板双面塑封制程方法,其特征在于:上模组和下模组上均设置有横向活动轨道和纵向活动轨道,上模组伸缩凸块和下模组伸缩凸块分别位于上模组和下模组上横向活动轨道和纵向活动轨道内。
3.根据权利要求2所述的一种基板双面塑封制程方法,其特征在于:上模组伸缩凸块和下模组伸缩凸块的位置对应于基板的切割道。
4.根据权利要求1所述的一种基板双面塑封制程方法,其特征在于:上模组伸缩凸块的高度和下模组伸缩凸块的高度可以自由调节。
5.根据权利要求1所述的一种基板双面塑封制程方法,其特征在于:上模组伸缩凸块和下模组伸缩凸块连接空气压缩装置,通过气压控制伸长和缩短。
6.根据权利要求1所述的一种基板双面塑封制程方法,其特征在于:下模组上设置有下模组挖槽。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2023078213A1 (zh) * 2021-11-03 2023-05-11 青岛歌尔微电子研究院有限公司 电路板的双面塑封方法和双面塑封的电路板

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11111746A (ja) * 1997-10-07 1999-04-23 Miyazaki Oki Electric Co Ltd 半導体装置の製造方法及びその製造装置
CN104599982A (zh) * 2014-12-11 2015-05-06 南通富士通微电子股份有限公司 全包封半导体晶圆级封装模具

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11111746A (ja) * 1997-10-07 1999-04-23 Miyazaki Oki Electric Co Ltd 半導体装置の製造方法及びその製造装置
CN104599982A (zh) * 2014-12-11 2015-05-06 南通富士通微电子股份有限公司 全包封半导体晶圆级封装模具

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2023078213A1 (zh) * 2021-11-03 2023-05-11 青岛歌尔微电子研究院有限公司 电路板的双面塑封方法和双面塑封的电路板

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