CN107799062A - 一种像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明的实施例提供一种像素电路及其驱动方法、显示装置，涉及显示技术领域，可避免发光阶段漏电，以使显示装置正常显示。像素电路中驱动模块包括驱动晶体管和第一存储电容；第一存储电容的一端与驱动晶体管的栅极电连接，另一端与驱动晶体管的第二极电连接；写入模块连接第一扫描信号线、数据线和驱动晶体管的栅极，用于在第一扫描信号线的控制下，在写入阶段将数据电压写入至驱动晶体管，在发光阶段保持所述驱动晶体管的开启；重置模块连接第二扫描信号线和发光模块，用于在第二扫描信号线的控制下，将输入至重置模块的初始电压提供至发光模块，对发光模块进行重置；驱动晶体管还连接发光模块，用于驱动发光模块发光。

Description

一种像素电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素电路及其驱动方法、显示装置。
背景技术
有机电致发光二极管(Organic Light Emitting Diode，OLED)显示是目前研究领域的热点之一，与液晶显示器(Liquid Crystal Display，LCD)相比，OLED显示装置具有低能耗、生产成本低、自发光、宽视角及相应速度快等优点。
由于氧化物薄膜晶体管(Thin Film Transistor，TFT)具有更高的迁移率、更稳定的特性以及较好的工艺均匀性，因此，被应用于OLED显示装置中构建像素单元电路。
但是，由于氧化物TFT在负偏压下，栅源电压(Vgs)的负向偏置电压越大，阈值电压(Vth)负向偏移越多，导致在发光阶段，用作开关的氧化物TFT漏电，从而导致显示面板无法正常显示。
发明内容
本发明的实施例提供一种像素电路及其驱动方法、显示装置，可避免发光阶段漏电，以使显示装置正常显示。
为达到上述目的，本发明的实施例采用如下技术方案：
第一方面，提供一种像素电路，包括：写入模块、重置模块、驱动模块和发光模块；所述驱动模块包括驱动晶体管和第一存储电容；所述第一存储电容的一端与所述驱动晶体管的栅极电连接，另一端与所述驱动晶体管的第二极电连接；所述写入模块，分别连接第一扫描信号线、数据线和所述驱动晶体管的栅极，用于在所述第一扫描信号线的控制下，在写入阶段将所述数据线输出的数据电压写入至所述驱动晶体管，在发光阶段保持所述驱动晶体管的开启；所述重置模块，分别连接第二扫描信号线和所述发光模块，用于在第二扫描信号线的控制下，将输入至所述重置模块的初始电压提供至所述发光模块，对所述发光模块进行重置；所述驱动晶体管，还连接所述发光模块，用于驱动所述发光模块发光。
可选的，所述驱动晶体管的第一极连接第一电源电压端。
可选的，所述写入模块包括：第一晶体管和第二晶体管；所述第一晶体管的栅极与所述第一扫描信号线电连接，第一极与所述数据线电连接，第二极与所述第二晶体管的第一极电连接；所述第二晶体管的栅极与所述第一扫描信号线电连接，第二极与所述驱动晶体管的栅极电连接；其中，所述第一晶体管和所述第二晶体管均为N型刻蚀阻挡型氧化物TFT。
可选的，所述写入模块还连接第三扫描信号线和所述驱动晶体管的第二极；基于此，所述写入模块用于在所述第一扫描信号线的控制下，在写入阶段将所述数据线输出的数据电压写入至所述驱动晶体管，在发光阶段保持所述驱动晶体管的开启，包括：所述写入模块用于在所述第一扫描信号线和所述第三扫描信号线的控制下，在写入阶段将所述数据线输出的数据电压写入至所述驱动晶体管，在发光阶段保持所述驱动晶体管的开启。
进一步选的，所述写入模块包括：第一晶体管、第二晶体管、第三晶体管和第二存储电容；所述第一晶体管的栅极与所述第一扫描信号线电连接，第一极与所述数据线电连接，第二极与所述第二晶体管的第一极电连接；所述第二晶体管的栅极与所述第一扫描信号线电连接，第二极与所述驱动晶体管的栅极电连接；所述第三晶体管的栅极与所述第三扫描信号线电连接，第一极与所述第二存储电容的一端电连接，第二极与所述第一晶体管的第二极电连接；所述第二存储电容的另一端与所述驱动晶体管的第二极电连接；其中，所述第一晶体管和所述第二晶体管均为N型顶栅型氧化物TFT。
可选的，所述重置模块包括第四晶体管；所述第四晶体管的栅极与所述第二扫描信号线电连接，第一极用于接收所述初始电压，第二极与所述发光模块电连接。
进一步可选的，所述第四晶体管的第一极与所述初始电压端电连接；或者，所述第四晶体管的第一极与感测信号线电连接，所述初始电压由所述感测信号线提供。
可选的，所述发光模块包括发光器件；所述发光器件的阳极与所述驱动晶体管的第二极电连接，阴极与第二电源电压端电连接。
第二方面，提供一种显示装置，包括若干像素，每个像素包括至少三个子像素，所述子像素包括第一方面所述的像素电路。
第三方面，提供一种如第一方面任一项所述像素电路的驱动方法，包括：一图像帧的写入阶段，写入模块将数据线输出的数据电压写入至驱动晶体管；重置模块对所述发光模块进行重置；一图像帧的发光阶段，所述驱动晶体管驱动所述发光模块发光，且所述写入模块使所述驱动晶体管保持开启。
本发明的实施例提供一种像素电路及其驱动方法、显示装置，通过在写入阶段由写入模块将数据电压写入至驱动晶体管，由重置模块对发光模块进行重置，可在发光阶段使驱动晶体管驱动发光模块发光。其中，由于在发光阶段写入模块可使驱动晶体管保持开启，即驱动晶体管的栅极电压不会从写入模块漏电，因而，在发光阶段发光模块可持续正常发光，从而当像素电路应用于显示装置时，可使显示装置正常显示。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1(a)为本发明提供的一种像素电路的结构示意图一；
图1(b)为本发明提供的一种像素电路的结构示意图二；
图2为本发明提供的一种驱动晶体管的栅极出现漏电的像素电路的示意图；
图3为图1(a)所示像素电路的各个模块的一种具体结构示意图一；
图4为图1(a)所示像素电路的各个模块的一种具体结构示意图二；
图5为本发明提供的一种刻蚀阻挡型氧化物TFT的结构示意图；
图6为本发明提供的一种驱动像素电路时采用的各个信号的时序图一；
图7为图1(b)所示像素电路的各个模块的一种具体结构示意图一；
图8为图1(b)所示像素电路的各个模块的一种具体结构示意图二；
图9为本发明提供的一种顶栅型氧化物TFT的结构示意图；
图10为本发明提供的一种驱动像素电路时采用的各个信号的时序图二；
图11为本发明提供的一种驱动像素电路的驱动方法流程示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例提供一种像素电路，如图1(a)所示，包括：写入模块10、重置模块20、驱动模块30和发光模块40；驱动模块30包括驱动晶体管Td和第一存储电容Cst1；第一存储电容Cst1的一端与驱动晶体管Td的栅极电连接，另一端与驱动晶体管Td的第二极电连接。
具体的，写入模块10，分别连接第一扫描信号线G1、数据线DL和驱动晶体管Td的栅极，用于在第一扫描信号线G1的控制下，在写入阶段将数据线DL输出的数据电压写入至驱动晶体管Td，在发光阶段保持驱动晶体管Td的开启。
重置模块20，分别连接第二扫描信号线G2和发光模块40，用于在第二扫描信号线G2的控制下，将输入至重置模块20的初始电压提供至发光模块40，对发光模块40进行重置。
驱动晶体管Td，还连接发光模块40，用于驱动发光模块40发光。
需要说明的是，第一，本领域技术人员知道，驱动晶体管Td的栅源电压(Vgs)对驱动晶体管Td的开启与否起决定性作用，如果驱动晶体管Td的栅极电压漏电，则驱动晶体管Td的Vgs会降低，降低到一定值时，驱动晶体管Td关闭。
基于此，需保证驱动晶体管Td的栅极与数据线DL的导通通道完全关闭，因此，这就需要对写入模块10的电路结构进行设计。
其中，当氧化物TFT用于构建写入模块10的电路结构时，由于其在较大负偏压下，Vth负飘的影响，会导致关闭不完全的问题，因此，基于氧化物TFT所具有的该问题，本发明的目的是设计相关电路，以保证写入模块10在发光阶段不会导致驱动晶体管Td的栅极电压漏电。
第二，图1(a)中并未示意出驱动晶体管Td的第一极如何连接，具体可根据实际情况进行连接，在此不做限定，只要能使驱动晶体管Td驱动发光模块40发光即可。
本发明实施例提供一种像素电路，通过在写入阶段由写入模块10将数据电压写入至驱动晶体管Td，由重置模块20对发光模块40进行重置，可在发光阶段使驱动晶体管Td驱动发光模块40发光。其中，由于在发光阶段写入模块10可使驱动晶体管Td保持开启，即驱动晶体管Td的栅极电压不会从写入模块10漏电，因而，在发光阶段发光模块40可持续正常发光，从而当像素电路应用于显示装置时，可使显示装置正常显示。
优选的，如图1(b)所示，写入模块10还连接第三扫描信号线G3和驱动晶体管Td的第二极。
在此情况下，写入模块10用于在第一扫描信号线G1的控制下，在写入阶段将数据线DL输出的数据电压写入至驱动晶体管Td，在发光阶段保持驱动晶体管Td的开启，包括：写入模块10用于在第一扫描信号线G1和第三扫描信号线G3的控制下，在写入阶段将数据线DL输出的数据电压写入至驱动晶体管Td，在发光阶段保持驱动晶体管Td的开启。
需要说明的是，图1(b)中并未示意出驱动晶体管Td的第一极如何连接，具体可根据实际情况进行连接，在此不做限定，只要能使驱动晶体管Td驱动发光模块40发光即可。
下面以一种具体的像素电路来说明驱动晶体管Td的栅极的漏电问题。
如图2所示，第一晶体管T1的栅极与第一扫描信号线G1电连接，第一极与数据线DL电连接，第二极与驱动晶体管Td的栅极电连接。其中，第一晶体管T1和驱动晶体管Td均为N型晶体管，且第一晶体管T1为氧化物TFT。
第四晶体管T4的栅极与第二扫描信号线G2电连接，第一极与初始电压端Vint电连接，第二极与驱动晶体管Td的第二极电连接。
基于该像素电路，在写入阶段，第一扫描信号线G1输入扫描信号，第一晶体管T1开启，将数据线DL输出的数据电压写入至驱动晶体管Td，即A点写入数据电压，记为Vdata；与此同时，第二扫描信号线G2输入扫描信号，初始电压端Vint将初始电压提供至发光模块40，即B点写入初始电压，记为V0。
在发光阶段，第一扫描信号线G1和第二扫描信号线G2输入截止信号；驱动晶体管Td开启，B点开始充电，由于电容自举的作用，A点随B点的抬升而抬升，最后A点的电压为Vdata+△V，B点的电压为V0+△V，△V为发光模块40中发光器件的跨压。
在发光阶段，第一晶体管T1的栅极电压记为Vg1，在A点电压为Vdata+ΔV的情况下，第一晶体管T1的Vgs＝Vg1-(Vdata+ΔV)，Vg1为一般-5V，目前OLED的ΔV约为8V，此时Vgs较大(若Vdata为8V，则理论上Vgs为-21V，但考虑OLED老化、灰阶损失等，Vgs约为-24V)，使得第一晶体管T1所受偏压非常大且持续时间长，这样会导致第一晶体管T1的Vth发生负向漂移，从而导致第一晶体管T1在Vg1电压下关闭不完全，使A点从第一晶体管T1漏电，进而降低了驱动晶体管Td的Vgs，直到Vgs降低到一定值时，驱动晶体管Td关闭。其中，当Vth<Vg1-Vdata时，即Vth负飘至-5V以下时，第一晶体管T1就会产生漏电。
基于此，本发明提供如下两个实施例来具体说明如何通过设计写入模块10的电路结构来改善驱动晶体管Td的栅极的漏电问题。
实施例一
如图3和图4所示，驱动晶体管Td的第一极连接第一电源电压端VDD。
写入模块10包括：第一晶体管T1和第二晶体管T2；第一晶体管T1的栅极与第一扫描信号线G1电连接，第一极与数据线DL电连接，第二极与第二晶体管T2的第一极电连接；第二晶体管T2的栅极与第一扫描信号线G1电连接，第二极与驱动晶体管Td的栅极电连接；其中，第一晶体管T1和第二晶体管T2均为N型刻蚀阻挡型氧化物TFT，驱动晶体管Td也为N型TFT。
可以理解的是，如图5所示，刻蚀阻挡型氧化物TFT包括依次设置的栅极51、栅绝缘层52、氧化物有源层53、刻蚀阻挡层54、以及设置于刻蚀阻挡层54上方的源极55和漏极56，源极55和漏极56通过刻蚀阻挡层54上的过孔与氧化物有源层53接触。
重置模块20包括第四晶体管T4；第四晶体管T4的栅极与第二扫描信号线G2电连接，第一极用于接收初始电压，第二极与发光模块40电连接。第四晶体管T4可以为N型或P型TFT，本发明实施例以第四晶体管T4为N型示意。
需要说明的是，第四晶体管T4的第一极可与初始电压端Vint电连接(如图4所示)。在此情况下，第一扫描信号线G1和第二扫描信号线G2可以为同一根信号线，可以理解的是，此时第四晶体管T4也为N型。
或者，第四晶体管T4的第一极也可以与感测信号线Sense电连接，初始电压由感测信号线Sense提供(如图3所示)。在此情况下，第一扫描信号线G1和第二扫描信号线G2可以为不同的信号线。
其中，当第四晶体管T4的第一极与感测信号线Sense电连接时，感测信号线Sense可通过开关分别与数模转换器DAC和模数转换器ADC连接。在写入阶段，使数模转换器DAC与感测信号线Sense接通，由数模转换器DAC提供初始电压至感测信号线Sense，从而输入至第四晶体管T4的第一极，对发光模块40进行重置，保证发光模块40不被点亮。此外，还可使模数转换器ADC与感测信号线Sense接通，模数转换器ADC可通过感测信号线Sense、导通的第四晶体管T4感测驱动晶体管Td的参数，以通过外部方式对驱动晶体管Td进行补偿。
需要说明的是，与感测信号线Sense连接的开关以及通过开关连接的数模转换器DAC和模数转换器ADC不属于像素电路，这些部件例如可设置于显示装置的电路板或集成于IC中。
发光模块40包括发光器件L；发光器件L的阳极与驱动晶体管Td的第二极电连接，阴极与第二电源电压端VSS电连接。
其中，发光器件L优选为OLED。
基于该像素电路，如图6所示，在写入阶段T1，第一扫描信号线G1和第二扫描信号线G2同时输入扫描信号，第一晶体管T1和第二晶体管T2开启，将数据线DL输出的数据电压写入至驱动晶体管Td，即A点写入数据电压，记为Vdata，相应的D点电位也为Vdata；与此同时，初始电压，记为V0，提供至发光器件L，即B点写入V0。
在自举阶段T2，第一扫描信号线G1和第二扫描信号线G2输入截止信号；D点由于第一晶体管T1和第二晶体管T2均为刻蚀阻挡型氧化物TFT，因此存在Cgs(栅源寄生电容)、Cgd(栅漏寄生电容)，其电压继续保持在Vdata；B点由于驱动晶体管Td打开，第一电源电压端VDD开始对其充电，而由于电容的自举作用A点的电位也随之抬升。
在发光阶段T3，A点电压为Vdata+△V，B点电压为V0+△V。对第一晶体管T1分析，其Vgs＝Vg1-Vdata<Vg1-(Vdata+ΔV)，其受到的负向偏压较图2所示的像素电路中第一晶体管T1的小，因而，本发明实施例中减小了第一晶体管T1所受偏压的影响，第一晶体管T1的Vth负向漂移的幅度也随之减小。对第二晶体管T2分析，其Vgs＝Vg1-(Vdata+ΔV)，但其Vds＝Vdata+ΔV-Vdata＝ΔV，虽然第二晶体管T2的Vgs较大，但其Vds较小，也缓解了第二晶体管T2所受偏压下对Vth的影响。基于此，由于第一晶体管T1和第二晶体管T2均减小了对Vth的影响，因而，可有效改善驱动晶体管Td的栅极漏电的问题，从而可改善显示亮度降低造成画面紊乱的情况。
需要说明的是，自举阶段T2非常短，可看作发光阶段T3的前期阶段。
实施例二
如图7和图8所示，驱动晶体管Td的第一极连接第一电源电压端VDD。
写入模块10包括：第一晶体管T1、第二晶体管T2、第三晶体管T3和第二存储电容Cst2；第一晶体管T1的栅极与第一扫描信号线G1电连接，第一极与数据线DL电连接，第二极与第二晶体管T2的第一极电连接；第二晶体管T2的栅极与第一扫描信号线G1电连接，第二极与驱动晶体管Td的栅极电连接；第三晶体管T3的栅极与第三扫描信号线G3电连接，第一极与第二存储电容Cst2的一端电连接，第二极与第一晶体管T1的第二极电连接；第二存储电容Cst2的另一端与驱动晶体管Td的第二极电连接。其中，第一晶体管T1和第二晶体管T2均为N型顶栅型氧化物TFT，驱动晶体管Td也为N型TFT。第三晶体管T3可以为N型或P型TFT，本发明实施例以第三晶体管T3为N型示意。
可以理解的是，如图9所示，顶栅型氧化物TFT包括依次设置的氧化物有源层53、栅绝缘层52、栅极51、层间绝缘层57、以及设置于层间绝缘层57上方的源极55和漏极56，源极55和漏极56通过层间绝缘层57和栅绝缘层52上的过孔与氧化物有源层53接触。
由于源极55和漏极56与氧化物有源层53的交叠面积都非常小，因此，顶栅型氧化物TFT的寄生电容可忽略。
重置模块20包括第四晶体管T4；第四晶体管T4的栅极与第二扫描信号线G2电连接，第一极用于接收初始电压，第二极与发光模块40电连接。第四晶体管T4可以为N型或P型TFT，本发明实施例以第四晶体管T4为N型示意。
需要说明的是，第四晶体管T4的第一极可与初始电压端Vint电连接(如图8所示)，在此情况下，第一扫描信号线G1和第二扫描信号线G2可以为同一根信号线，可以理解的是，此时第四晶体管T4也为N型。
或者，第四晶体管T4的第一极也可以与感测信号线Sense电连接，初始电压由感测信号线Sense提供(如图7所示)。在此情况下，第一扫描信号线G1和第二扫描信号线G2可以为不同的信号线。
其中，当第四晶体管T4的第一极与感测信号线Sense电连接时，感测信号线Sense可通过开关分别与数模转换器DAC和模数转换器ADC连接。在写入阶段，首先使数模转换器DAC与感测信号线Sense接通，由数模转换器DAC提供初始电压至感测信号线Sense，从而输入至第四晶体管T4的第一极，对发光模块40进行重置，保证发光模块40不被点亮。此外，还可使模数转换器ADC与感测信号线Sense接通，模数转换器ADC可通过感测信号线Sense、导通的第四晶体管T4感测驱动晶体管Td的参数，以通过外部方式对驱动晶体管Td进行补偿。
发光模块40包括发光器件L；发光器件L的阳极与驱动晶体管Td的第二极电连接，阴极与第二电源电压端VSS电连接。
基于该像素电路，如图10所示，在写入阶段T1，第一扫描信号线G1和第二扫描信号线G2同时输入扫描信号，第三扫描信号线G3输入截止信号，第一晶体管T1和第二晶体管T2开启，将数据线DL输出的数据电压写入至驱动晶体管Td，即A点写入数据电压，记为Vdata，相应的D点电位也为Vdata；与此同时，初始电压，记为V0，提供至发光器件L，即B点写入V0。
在自举阶段T2的第一阶段，第一扫描信号线G1和第二扫描信号线G2输入截止信号；D点由于第一晶体管T1和第二晶体管T2均为顶栅型氧化物TFT，因此Cgs、Cgd非常小，导致D点电压无法保持，D点电压非常小，记为Vc；B点由于驱动晶体管Td打开，第一电源电压端VDD开始对其充电，而由于电容的自举作用A点的电位也随之抬升。
在自举阶段T2的第二阶段，第三扫描信号线G3输入扫描信号，第三晶体管T3开启，B点继续自举，通过第二存储电容Cst2将D点电压抬升至Vc+△V1。
在发光阶段，A点电压为Vdata+ΔV，B点电压为V0+ΔV，D点电压为Vc+ΔV1。对第一晶体管T1分析，其Vgs＝Vg1-(Vc+ΔV1)<Vg1-(Vdata+ΔV)，其受到的负向偏压较图2所示的像素电路中第一晶体管T1的小，因而，本发明实施例中减小了第一晶体管T1所受偏压的影响，第一晶体管T1的Vth负向漂移的幅度也随之减小。对第二晶体管T2分析，其Vgs＝Vg1-(Vdata+ΔV)，但其Vds＝Vdata+ΔV-(Vc+ΔV1)＝ΔV，虽然第二晶体管T2的Vgs较大，但其Vds较小，也缓解了第二晶体管T2所受偏压下对Vth的影响。基于此，由于第一晶体管T1和第二晶体管T2均减小了对Vth的影响，因而，可有效改善驱动晶体管Td的栅极漏电的问题，从而可改善显示亮度降低造成画面紊乱的情况。
本发明实施例还提供一种显示装置，包括若干像素，每个像素包括至少三个子像素，所述子像素包括上述的像素电路。
其中，每个像素可包括三个子像素，也可在该三个子像素的基础上增加白色子像素，即每个像素包括四个子像素。
可以理解的是，一行像素中，所有写入模块10可连接一根第一扫描信号线，当包括第三扫描信号线时，连接一根第三扫描信号线；一行像素中，所有重置模块20可连接一根第二扫描信号线。一列像素中，所有写入模块10连接一根数据线DL。
本发明实施例还提供一种上述像素电路的驱动方法，如图11所示，该驱动方法包括：
S10、一图像帧的写入阶段，写入模块10将数据线DL输出的数据电压写入至驱动晶体管Td；重置模块20对发光模块40进行重置。
S11、一图像帧的发光阶段，驱动晶体管Td驱动发光模块40发光，且写入模块10使驱动晶体管Td保持开启。
具体可参考上述实施例一和实施例二的说明，在此不再赘述。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种像素电路，其特征在于，包括：写入模块、重置模块、驱动模块和发光模块；所述驱动模块包括驱动晶体管和第一存储电容；所述第一存储电容的一端与所述驱动晶体管的栅极电连接，另一端与所述驱动晶体管的第二极电连接；
所述写入模块，分别连接第一扫描信号线、数据线和所述驱动晶体管的栅极，用于在所述第一扫描信号线的控制下，在写入阶段将所述数据线输出的数据电压写入至所述驱动晶体管，在发光阶段保持所述驱动晶体管的开启；
所述重置模块，分别连接第二扫描信号线和所述发光模块，用于在第二扫描信号线的控制下，将输入至所述重置模块的初始电压提供至所述发光模块，对所述发光模块进行重置；
所述驱动晶体管，还连接所述发光模块，用于驱动所述发光模块发光。
2.根据权利要求1所述的像素电路，其特征在于，所述驱动晶体管的第一极连接第一电源电压端。
3.根据权利要求1所述的像素电路，其特征在于，所述写入模块包括：第一晶体管和第二晶体管；
所述第一晶体管的栅极与所述第一扫描信号线电连接，第一极与所述数据线电连接，第二极与所述第二晶体管的第一极电连接；
所述第二晶体管的栅极与所述第一扫描信号线电连接，第二极与所述驱动晶体管的栅极电连接；
其中，所述第一晶体管和所述第二晶体管均为N型刻蚀阻挡型氧化物TFT。
4.根据权利要求1所述的像素电路，其特征在于，所述写入模块还连接第三扫描信号线和所述驱动晶体管的第二极；
所述写入模块用于在所述第一扫描信号线的控制下，在写入阶段将所述数据线输出的数据电压写入至所述驱动晶体管，在发光阶段保持所述驱动晶体管的开启，包括：
所述写入模块用于在所述第一扫描信号线和所述第三扫描信号线的控制下，在写入阶段将所述数据线输出的数据电压写入至所述驱动晶体管，在发光阶段保持所述驱动晶体管的开启。
5.根据权利要求4所述的像素电路，其特征在于，所述写入模块包括：第一晶体管、第二晶体管、第三晶体管和第二存储电容；
所述第一晶体管的栅极与所述第一扫描信号线电连接，第一极与所述数据线电连接，第二极与所述第二晶体管的第一极电连接；
所述第二晶体管的栅极与所述第一扫描信号线电连接，第二极与所述驱动晶体管的栅极电连接；
所述第三晶体管的栅极与所述第三扫描信号线电连接，第一极与所述第二存储电容的一端电连接，第二极与所述第一晶体管的第二极电连接；
所述第二存储电容的另一端与所述驱动晶体管的第二极电连接；
其中，所述第一晶体管和所述第二晶体管均为N型顶栅型氧化物TFT。
6.根据权利要求1所述的像素电路，其特征在于，所述重置模块包括第四晶体管；
所述第四晶体管的栅极与所述第二扫描信号线电连接，第一极用于接收所述初始电压，第二极与所述发光模块电连接。
7.根据权利要求6所述的像素电路，其特征在于，所述第四晶体管的第一极与所述初始电压端电连接；或者，
所述第四晶体管的第一极与感测信号线电连接，所述初始电压由所述感测信号线提供。
8.根据权利要求1所述的像素电路，其特征在于，所述发光模块包括发光器件；
所述发光器件的阳极与所述驱动晶体管的第二极电连接，阴极与第二电源电压端电连接。
9.一种显示装置，其特征在于，包括若干像素，每个像素包括至少三个子像素，所述子像素包括权利要求1-8任一项所述的像素电路。
10.一种如权利要求1-8任一项所述像素电路的驱动方法，其特征在于，包括：
一图像帧的写入阶段，写入模块将数据线输出的数据电压写入至驱动晶体管；重置模块对所述发光模块进行重置；
一图像帧的发光阶段，所述驱动晶体管驱动所述发光模块发光，且所述写入模块使所述驱动晶体管保持开启。
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