CN107591145B - 一种异形显示面板及其驱动方法、显示装置 - Google Patents

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Abstract

本发明实施例提供了一种异形显示面板及其驱动方法、显示装置，涉及显示技术领域，采用一个主驱动芯片，解决现有异形显示面板的边界可见问题。显示区包括主显示区和辅显示区，异形显示面板包括辅显示区内的第一数据线和第一栅线；与主驱动芯片、多条第一栅线相连的第一扫描单元；M个第二扫描单元，各第二扫描单元的控制端与主驱动芯片相连；M个开关单元组，各开关单元组包括多个开关单元，各开关单元组的开关单元的控制端与对应的第二扫描单元的多个输出端相连，各开关单元组的开关单元的第一端与第一数据线相连；M条第二数据线，各第二数据线与主驱动芯片、对应的开关单元组中的开关单元的第二端相连。上述异形显示面板用于实现画面显示。

Description

一种异形显示面板及其驱动方法、显示装置
【技术领域】
本发明涉及显示技术领域，尤其涉及一种异形显示面板及其驱动方法、显示装置。
【背景技术】
随着显示技术的飞速发展，异形显示面板得到了越来越广泛的应用。相较于传统的显示面板来说，异形显示面板的显示区包括主显示区和辅显示区。如图1所示，以栅线Gate沿行方向延伸、数据线Data沿列方向延伸为例，由于异形显示面板的显示区的形状不规则，这就使得异形显示面板内存在L1和L2两种长度的数据线Data，进而导致长度为L1的数据线所在区域和长度为L2的数据线所在区域之间出现边界可见的问题。
为克服上述问题，现有技术中通常在主显示区和辅显示区内单独设置数据线，但是，当采用该种设置方式时，还需要额外设置一个用来驱动辅显示区内数据线的子驱动芯片，这样就会增加结构的复杂度，从而导致制作成本的增加。
【发明内容】
有鉴于此，本发明实施例提供了一种异形显示面板及其驱动方法、显示装置，在仅采用一个主驱动芯片的前提下，能够解决现有的异形显示面板中的边界可见的问题。
本发明的第一方面提供了一种异形显示面板，所述异形显示面板的显示区包括主显示区和凸起于所述主显示区的辅显示区，所述异形显示面板包括：
在所述辅显示区内交叉绝缘设置的多条第一数据线和多条第一栅线；
第一扫描单元，所述第一扫描单元分别与主驱动芯片、多条所述第一栅线相连；
M个第二扫描单元，各所述第二扫描单元的控制端分别与所述主驱动芯片相连，各所述第二扫描单元包括多个输出端；其中，M为大于1的正整数；
与M个所述第二扫描单元一一对应的M个开关单元组，各所述开关单元组分别包括多个所述开关单元，各所述开关单元组中多个所述开关单元的控制端分别与对应的第二扫描单元的多个输出端一一对应相连，各所述开关单元组中多个所述开关单元的第一端分别与所述第一数据线一一对应相连；
与M个所述开关单元组一一对应的M条第二数据线，各所述第二数据线分别与所述主驱动芯片、对应的开关单元组中的多个所述开关单元的第二端相连。
本发明的第二方面提供了一种异形显示面板的驱动方法，所述异形显示面板的驱动方法应用于如本发明的第一方面所述的异形显示面板，所述异形显示面板的驱动方法包括：在主驱动芯片的控制下，第一扫描单元分时向多条第一栅线传输第一扫描信号，在每条所述第一栅线接收到所述第一扫描信号时，各第二扫描单元分时控制对应的开关单元导通，使经由第二数据线传输的第一数据信号分时传输至对应的第一数据线中。
本发明的第三方面提供了一种显示装置，所述显示装置包括如本发明的第一方面所述的异形显示面板。
上述技术方案中的一个技术方案具有如下有益效果：
一方面，通过在主显示区和辅显示区内单独设置数据线，可以保证设置在主显示区内的数据线长度均相同，从而使得主显示区内的数据线阻抗相同，避免了由数据线阻抗不同所导致的不同区域的显示亮度出现偏差，进而避免了不同区域之间出现可见边界的问题。另一方面，基于第二扫描单元、开关单元、第一数据线和第二数据线之间的相互配合，仅需与第二扫描单元的个数相等数量的第二数据线即可实现对全部的第一数据线的驱动，无需对应每条第一数据线分别设置一条第二数据线，很大程度上减少了第二数据线的数量。并且，当第二数据线的数量较少时，将第二数据线直接与主驱动芯片相连即可，无需再额外设置子驱动芯片，从而降低了结构复杂度，降低了制作成本。
【附图说明】
为了更清楚地说明本发明实施例的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图。
图1是现有技术中异形显示面板的结构示意图一；
图2是现有技术中异形显示面板的结构示意图二；
图3是本发明实施例所提供异形显示面板的结构示意图一；
图4是本发明实施例所提供异形显示面板的结构示意图二；
图5是本发明实施例所提供的P级移位寄存器分时驱动第一栅线时对应的信号时序图；
图6是本发明实施例所提供异形显示面板的辅显示区对应的N级移位寄存器和薄膜晶体管的连接关系示意图；
图7是本发明实施例所提供的单个N级移位寄存器的结构示意图；
图8是本发明实施例所提供的单个N级移位寄存器分时驱动第一数据线时对应的信号时序图；
图9是本发明实施例提供的显示装置的结构示意图。
【具体实施方式】
为了更好的理解本发明的技术方案，下面结合附图对本发明实施例进行详细描述。
应当明确，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本发明保护的范围。
在本发明实施例中使用的术语是仅仅出于描述特定实施例的目的，而非旨在限制本发明。在本发明实施例和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式，除非上下文清楚地表示其他含义。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
应当理解，尽管在本发明实施例中可能采用术语第一、第二、第三等来描述数据线、栅线，但这些数据线、栅线不应限于这些术语。这些术语仅用来将数据线彼此区分开、以及将栅线彼此区分开。例如，在不脱离本发明实施例范围的情况下，第一数据线也可以被称为第二数据线，类似地，第二数据线也可以被称为第一数据线。
请再次参见图1，传统的异形显示面板包括交叉绝缘设置的数据线Data和栅线Gate、以及用于驱动数据线Data的主驱动芯片5。对于该种异形显示面板来说，会存在两种长度的数据线Data，而不同长度的数据线所具有的数据线阻抗不同，这就导致在显示画面时，长度为L1的数据线Data所处区域和长度为L2的数据线Data所处区域所呈现的亮度有所差别，进而导致两个区域之间会出现一个较为明显的分界，也就是出现边界可见的问题。
为克服上述边界可见的问题，现有技术中通常会在主显示区和辅显示区内单独设置数据线和栅线，即对主显示区和辅显示区进行单独驱动。其中，主显示区是指显示区中用于进行传统的信息展示的区域，辅显示区是指显示区中的异形区域，通常用来显示一些通知或者快捷菜单。一般来说，辅显示区在至少一个方向上的长度小于主显示区在对应方向上的长度。
如图2所示，辅显示区包括交叉绝缘设置的第一数据线Data1和第一栅线Gate1，主显示区包括交叉绝缘设置的第三数据线Data3和第三栅线Gate3，其中，第一数据线Data1的长度均为L3，第三数据线Data3的长度均为L1。可是，采用该种设置方式，若想要实现主驱动芯片5对辅显示区内的第一数据线Data1的驱动，每条第一数据线Data1都需要通过一条用于实现信号传输的第二数据线与主驱动芯片5相连，这样，就会有大量的第二数据线Data2贯穿主显示区。为了避免这种复杂的布线分布，就需要在辅显示区旁边再设置一个子驱动芯片6，用来单独驱动辅显示区内的第一数据线Data1。但是，在异形显示面板中额外增加子驱动芯片6虽然会简化主显示区的布线分布，但会增大异形显示面板的结构复杂度，并相应的增大制作成本。
针对上述问题，本发明实施例提供了一种异形显示面板，如图3所示，该异形显示面板的显示区包括主显示区和凸起于主显示区的辅显示区。异形显示面板包括在辅显示区内交叉绝缘设置的多条第一数据线Data1和多条第一栅线Gate1、以及第一扫描单元1、M个第二扫描单元2、与M个第二扫描单元2一一对应的M个开关单元组3和与M个开关单元组3一一对应的M条第二数据线Data2，其中，各开关单元组3包括多个开关单元4。
需要说明的是，图3所示的第二扫描单元2的数量M＝2仅仅为示意说明，并不表示对第二扫描单元2的数量的具体限定，在实际应用中，M可以为大于1的正整数。
第一扫描单元1的控制端与主驱动芯片5相连，第一扫描单元1的多个输出端分别与多条第一栅线Gate1一一对应相连。
各第二扫描单元2的控制端分别与主驱动芯片5相连，各第二扫描单元2包括多个输出端。各开关单元组3中多个开关单元4的控制端分别与对应的第二扫描单元2的多个输出端一一对应相连，各开关单元组3中多个开关单元4的第一端分别与第一数据线Data1一一对应相连。各第二数据线Data2分别与主驱动芯片5、以及对应的开关单元组3中的多个开关单元4的第二端相连。
当驱动上述异形显示面板的辅显示区进行显示时，主驱动芯片5驱动第一扫描单元1工作，令第一扫描单元1顺次向第一栅线Gate1提供第一扫描信号。在每条第一栅线Gate1接收到第一扫描信号时，主驱动芯片5驱动M个第二扫描单元2同时工作，各第二扫描单元2分时控制对应的开关单元4导通，使经由第二数据线Data2传输的第一数据信号分时传输至对应的第一数据线Data1中。
可以理解的是，上述第一数据信号是指主驱动芯片5提供的用于驱动辅显示区进行画面显示的信号，根据辅显示区显示画面的实际需求，经由第二数据线Data2向不同的第一数据线Data1传输不同或相同的第一数据信号。
采用本实施例提供的异形显示面板，一方面，通过采用主显示区和辅显示区内分别单独设置数据线的方式，可以保证设置在主显示区内的数据线长度均相同，使得主显示区内各数据线对应的数据线阻抗相同，避免了由数据线阻抗不同所导致的不同区域的显示亮度出现偏差，进而避免了不同区域之间出现可见边界的问题。另一方面，相较于图2所示的异形显示面板，采用本实施例提供的异形显示面板，基于第二扫描单元2、开关单元4、第一数据线Data1和第二数据线Data2之间的相互配合，仅需与第二扫描单元2的个数相等数量的第二数据线Data2即可实现对全部的第一数据线Data1的驱动，无需对应每条第一数据线Data1分别设置一条第二数据线Data2，很大程度上减少了第二数据线Data2的数量。并且，当第二数据线Data2的数量较少时，将第二数据线Data2直接与主驱动芯片5相连即可，无需再额外设置子驱动芯片，从而降低了结构复杂度，进而降低了制作成本。
具体的，当一个第二扫描单元2包括N个输出端时，该第二扫描单元2可以驱动N条第一数据线Data1，当异形显示面板包括M个第二扫描单元2时，全部的第二扫描单元2可以驱动M*N条第一数据线Data1。也就是说，采用本实施例提供的异形显示面板，若驱动M*N条第一数据线Data1，仅需采用M个第二扫描单元2，相应设置M条第二数据线Data2，相较于现有技术中需要设置和M*N条第一数据线Data1一一对应的M*N条第二数据线Data2相比，减少了M*(N-1)条数量的第二数据线Data2，不仅很大程度的简化了布线排布，还减少了第二数据线Data2所占用的空间。
此外，请再次参见图3，异形显示面板的主显示区内交叉绝缘设置有多条第三数据线Data3和多条第三栅线Gate3，多条第三数据线Data3分别与主驱动芯片5相连。相应的，异形显示面板还包括第三扫描单元7，第三扫描单元7的控制端与主驱动芯片5相连，第三扫描单元7的多个输出端分别与多条第三栅线Gate3相连。
当驱动异形显示面板的主显示区进行显示时，主驱动芯片5驱动第三扫描单元7工作，令第三扫描单元7顺次向第三栅线Gate3提供第二扫描信号。在每条第三栅线Gate3接收到第二扫描信号时，主驱动芯片5向多条第三数据线Data3提供第二数据信号。
可以理解的是，上述第二数据信号是指主驱动芯片5提供的用于驱动主显示区进行画面显示的信号，根据主显示区显示画面的实际需求，主驱动芯片5向不同的第三数据线Data3传输相同或不同的第二数据信号。
请再次参见图3，第三扫描单元7的数量优选为两个。当第三栅线Gate3沿行方向延伸时，一个第三扫描单元7的多个输出端分别与奇数行对应的第三栅线Gate3相连，另一个第三扫描单元7的多个输出端分别与偶数行对应的第三栅线Gate3相连。当第三栅线Gate3沿列方向延伸时，一个第三扫描单元7的多个输出端分别与奇数列对应的第三栅线Gate3相连，另一个第三扫描单元7的多个输出端分别与偶数列对应的第三栅线Gate3相连。通过该种设置方式，可以缩短向全部的第三栅线Gate3输出第二扫描信号的时间，减少驱动时间，进而降低功耗。
在实际应用中，主显示区内第三数据线Data3的延伸方向和辅显示区内第一数据线Data1的延伸方向可以平行，也可以垂直。示例性的，当主显示区内的各第三数据线Data3分别沿第一方向延伸，各第三栅线Gate3分别沿第二方向延伸时，请再次参见图3，可以令辅显示区内的各第一数据线Data1分别沿第二方向延伸，各第一栅线Gate1分别沿第一方向延伸。当然，也可以如图4所示，令辅显示区内的各第一数据线Data1分别沿第一方向延伸，各第一栅线Gate1分别沿第二方向延伸。
当辅显示区沿第一方向的长度大于辅显示区沿第二方向的长度时，优选的，可令辅显示区内的各第一数据线Data1分别沿第一方向延伸，令各第一栅线Gate1分别沿第二方向延伸。当辅显示区沿第一方向的长度小于辅显示区沿第二方向的长度时，优选的，可令辅显示区内的各第一数据线Data1分别沿第二方向延伸，令各第一栅线Gate1分别沿第一方向延伸。
以第一方向为行方向，第二方向为列方向为例，当辅显示区沿列方向上的长度小于沿行方向上的长度时，相较于图4所示的将第一数据线Data1沿列方向延伸的设置方式相比，采用图3所示的将第一数据线Data1沿行方向延伸的设置方式，所需要驱动的第一数据线Data1的数量较少。在第二扫描单元2的输出端的数量一定时，采用图3所示的设置方式，需要的第二扫描单元2的数量相应较少，对应的开关单元组3的数量也就较少，因而所需的第二数据线Data2的数量也就较少，这样可进一步减少第二数据线Data2的数量，简化布线的排布，减少第二数据线Data2所占用的空间。
需要说明的是，图4所示的第二扫描单元2的数量M＝4仅仅为示意说明，并不表示对第二扫描单元2的数量的具体限定。
当辅显示区沿行方向上的长度小于沿列方向上的长度时，优选的，第一数据线Data1沿列方向延伸，第一栅线Gate1沿行方向延伸方向，排布原理与上述排布原理类似，此处不再赘述。
此外，可以令各第二扫描单元2具有相同数量的输出端，即与各第二扫描单元2相对应的第一数据线Data1的数量相同，这样，可以使得对第一数据线Data1的控制更具规律性，应用起来更易实现。
可选的，各第二扫描单元2具体可以为N级移位寄存器，与之对应的，各第二扫描单元2对应的开关单元组3包括N个开关单元4。N级移位寄存器的N个输出端分别与对应的开关单元组3中的N个开关单元4的控制端一一对应相连，其中，N为大于1的正整数。
当然，第一扫描单元1和第三扫描单元7也可以为多级移位寄存器结构。以第一扫描单元1为例，当辅显示区设置有P'条第一栅线Gate1时，第一扫描单元1为P'级移位寄存器，该P'级移位寄存器的P'个输出端与P'条第一栅线Gate1一一对应相连。
可选的，上述开关单元4具体可以为薄膜晶体管，当开关单元4为薄膜晶体管时，薄膜晶体管的栅极与对应的第二扫描单元2的输出端相连，薄膜晶体管的源极与对应的第一数据线Data1相连，薄膜晶体管的漏极与对应的第二数据线Data2相连。
当辅显示区内设置有P'条第一栅线Gate1和M*N条第一数据线Data1，且第一扫描单元1为P级移位寄存器，第二扫描单元2为N级移位寄存器，开关单元组3为薄膜晶体管组，开关单元4为薄膜晶体管时，下面结合图5～图8，对异形显示面板的辅显示区的驱动方法进行详细说明：
当对辅显示区的第一栅线Gate1和第一数据线Data1进行驱动，以使辅显示区进行画面显示时，参见图5所示的信号时序图，主驱动芯片5向P'级移位寄存器提供帧开始信号STV'，驱动P级移位寄存器工作，在主驱动芯片5提供的第一时钟信号CKV1'表示和第二时钟信号CKV2'的作用下，P'级移位寄存器分时向P'条第一栅线Gate1传输第一扫描信号Out_1'～Out_P'。
在每条第一栅线Gate1接收到相应的第一扫描信号时，主驱动芯片5还控制M个N级移位寄存器2同时工作，使每个N级移位寄存器2分时控制对应的薄膜晶体管4导通，令经由对应的第二数据线Data2传输的第一数据信号分时传输至对应的第一数据线Data1中。
在每条第一栅线Gate1接收到第一扫描信号时，主驱动芯片5控制M个N级移位寄存器2同时工作的工作原理如下所示：
如图6所示，一个N级移位寄存器2具有N个输出端，为驱动M*N条第一数据线Data1，共需M个N级移位寄存器2。
需要说明的是，由于N级移位寄存器为第二扫描单元2的一种具体表现形式，因此，为方便理解，如下所述的N级移位寄存器2等同于第二扫描单元2，并且，将第一个N级移位寄存器～第M个N级移位寄存器均采用附图标记2表示。同理，如下所述的薄膜晶体管组3等同于开关单元组3，第一个薄膜晶体管组～第M个薄膜晶体管组均采用附图标记3表示，如下所述的薄膜晶体管4等同于开关单元4。
此外，图6中所示的N级移位寄存器2的数量为M个，如下所述的第一个N级移位寄存器2对应图6中沿第三方向上所示的第一个N级移位寄存器2，如下所述的第二个N级移位寄存器2对应图6中沿第三方向上所示的第二个N级移位寄存器2，以此类推，如下所述的第M个N级移位寄存器2对应图6中沿第三方向上所示的最后一个N级移位寄存器2。第一个薄膜晶体管组3～第M个薄膜晶体管组3在图6中的对应方式与N级移位寄存器2的对应方式相同，此处不再赘述。
其中，第一个N级移位寄存器2的第一输出端Out_1～第N输出端Out_N分别与第一个薄膜晶体管组3的N个薄膜晶体管4的栅极一一对应相连，第一个薄膜晶体管组3的N个薄膜晶体管4的源极分别与第一条第一数据线Data1_1～第N条第一数据线Data1_N一一对应相连，第一个薄膜晶体管组3的N个薄膜晶体管的漏极均与第一条第二数据线Data2_1相连。
第二个N级移位寄存器2的第一输出端Out_1～第N输出端Out_N分别与第二个薄膜晶体管组3的N个薄膜晶体管4的栅极一一对应相连，第二个薄膜晶体管组3的N个薄膜晶体管4的源极分别与第N+1条第一数据线Data1_(N+1)～第2N条第一数据线Data1_2N一一对应相连，第二个薄膜晶体管组3的N个薄膜晶体管4的漏极均与第二条第二数据线Data2_2相连。
以此类推，第M个N级移位寄存器2的第一输出端Out_1～第N输出端Out_N分别与第M个薄膜晶体管组3的N个薄膜晶体管4的栅极一一对应相连，第M个薄膜晶体管组3的N个薄膜晶体管4的源极分别与第(M-1)N+1条第一数据线Data1_[(M-1)N+1]～第MN条第一数据线Data1_MN相连，第M个薄膜晶体管组3的N个薄膜晶体管的漏极均与第M条第二数据线Data2_M相连。
并且，各N级移位寄存器2的第一时钟信号端CKV1和第二时钟信号端CKV2与分别与主驱动芯片5相连，各N级移位寄存器2的初始控制端IN0分别与主驱动芯片5的帧开始信号端STV相连。
当每条第一栅线Gate1接收到第一扫描信号，需要对辅显示区的全部第一数据线Data1进行驱动时，主驱动芯片5通过帧开始信号端STV向各N级移位寄存器2的初始控制端提供帧开始信号，驱动各N级移位寄存器2同时工作。基于移位寄存器的工作原理，各N级移位寄存器2的第一输出端Out_1～第N输出端Out_N分时向对应的薄膜晶体管4的栅极提供导通信号，分时控制对应的薄膜晶体管4导通，从而令第一条第二数据线Data2_1～第M条第二数据线Data2_M传输的第一数据信号经由导通的薄膜晶体管4的漏极和源极传输至对应的第一数据线Data1中。
如图7所示，一个N级移位寄存器2具体可包括N个级联的移位寄存器8。
需要说明的是，图7中所示的移位寄存器8的数量为N个，如下所述的第一个移位寄存器8对应图7中沿第三方向上所示的第一个移位寄存器8，如下所述的第二个移位寄存器8对应图7中沿第三方向上所示的第二个移位寄存器8，以此类推，如下所述的第N个移位寄存器8对应图7中沿第三方向上所示的最后一个移位寄存器8。第一个薄膜晶体管4～第N个薄膜晶体管4与图7中移位寄存器8的对应方式相同，此处不再赘述。
此外，为方便理解，如下所述的第一个移位寄存器～第N个移位寄存器均采用附图标记8表示。
各移位寄存器8分别包括第一时钟信号端CKV1、第二时钟信号端CKV2、第一控制端IN(第一个移位寄存器8的第一控制端IN为上述N级移位寄存器2的初始控制端IN0)、第二控制端NXT和输出端OUT。
其中，各移位寄存器8的第一时钟信号端CKV1和第二时钟信号端CKV2分别与主驱动芯片5相连，第一个移位寄存器8的第一控制端IN与主驱动芯片5的帧开始信号端STV相连，在相邻的两个移位寄存器8中，前一个移位寄存器8中的第二控制端NXT与后一个移位寄存器8中的第一控制端IN相连。
第一个移位寄存器8的输出端Out_1与薄膜晶体管组3中的第一个薄膜晶体管4的栅极相连，该薄膜晶体管的源极与第iN+1条第一数据线Data_(iN+1)相连；第二个移位寄存器8的输出端Out_2与薄膜晶体管组3中的第二个薄膜晶体管4的栅极相连，该薄膜晶体管的源极与第iN+2条第一数据线Data_(iN+2)相连；以此类推，第N个移位寄存器8的输出端Out_N与薄膜晶体管组3中的第N个薄膜晶体管4的栅极相连，该薄膜晶体管的源极与第(i+1)N条第一数据线Data1_[(i+1)N]相连；并且，第一个薄膜晶体管4～第N个薄膜晶体管4的漏极均与第i+1条第二数据线Data2_(i+1)相连。其中，i＝0～M-1。
如图8所示为单个N级移位寄存器2的信号时序图，下面结合图8，对单个N级移位寄存器2的工作原理进行详细说明(为方便理解，在图8中将帧开始信号用STV表示，将第一时钟信号用CKV1表示，将第二时钟信号用CKV2表示，将第一个移位寄存器8的输出端Out_1～第N个移位寄存器8的输出端Out_N输出的导通信号分别用Out_1～Out_N表示)：
当开始驱动辅显示区进行画面显示时，主驱动芯片5通过帧开始信号端STV向第一个移位寄存器8的第一控制端IN提供帧开始信号，驱动第一个移位寄存器8工作，同时，主驱动芯片5向各移位寄存器8的第一时钟信号端CKV1提供第一时钟信号，在第一时钟信号出现初始下降沿时，主驱动芯片5向第二时钟信号端CKV2提供第二时钟信号，其中，第一时钟信号和第二时钟信号的上升沿和下降沿交替出现。
t1时段，第二时钟信号出现初始上升沿时，第一个移位寄存器8的输出端Out_1输出导通信号，控制第一个薄膜晶体管4导通，此时，经第i+1条第二数据线Data2_(i+1)传输的第一数据信号通过第一个薄膜晶体管4传输至第iN+1条第一数据线Data_(iN+1)中，同时，第一个移位寄存器8的第二控制端NXT向第二个移位寄存器8的第一控制端IN提供控制信号，控制第二个移位寄存器8工作；t2时段，当第一时钟信号出现第二个上升沿时，第二个移位寄存器8的输出端Out_2输出导通信号，控制第二个薄膜晶体管4导通，此时，经第i+1条第二数据线Data2_(i+1)传输的第一数据信号通过第二个薄膜晶体管4传输至第iN+2条第一数据线Data_(iN+2)中，同时，第二个移位寄存器8的第二控制端NXT向第三个移位寄存器8的第一控制端IN提供控制信号，控制第三个移位寄存器8工作；以此类推；直至tN时段，第N个移位寄存器8输出导通信号，控制第N个薄膜晶体管4导通，令经第i+1条第二数据线Data2_(i+1)传输的第一数据信号通过第N个薄膜晶体管4传输至对应的第(i+1)N条第一数据线Data1_[(i+1)N]中。
以下结合图3、图5和图8对辅显示区整体的工作过程进行说明，此时，图3为对应结构示意图，图5为第一扫描单元1的时序示意图，Out_1'～Out_P'的信号会传输给对应的第一栅线Gate1，图8为图5Out_1'～Out_P'中的一个为导通电平时段的一个N级移位寄存器2的详细时序示意图。例如，本实施例提供的异形显示面板为液晶显示面板，辅显示区包括M*N*P'个子像素，上述子像素沿第一方向排列为M*N行，沿第二方向排列为P'列，每行子像素对应一条第一数据线Data1，每列子像素对应一条第一栅线Gate1，每个子像素对应有开关管，该开关管的控制端与对应的第一栅线Gate1相连，该开关管的第一端与对应的第一数据线Data1相连，该开关管的第二端与对应的像素电极相连，第一扫描信号Out_1'～Out_P'用于控制相应的第一数据线Data1与哪一列子像素中的像素电极导通。当第一扫描信号Out_1'为导通电平时，P'列子像素中的第一列子像素中的像素电极与每条第一数据线Data1导通，在此期间，M个N级移位寄存器2同时工作，工作过程参见图8中的时序以及上述说明，使每条第二数据线Data2中的第一数据信号分时传输至每条第二数据线Data2对应的N条第一数据线Data1，进而分时给第一列子像素中的像素电极进行充电；当第一扫描信号Out_2'为导通电平时，P'列子像素中的第二列子像素中的像素电极与每条第一数据线Data1导通，在此期间，M个N级移位寄存器2同时工作，工作过程参见图8中的时序以及上述说明，使每条第二数据线Data2中的第一数据信号分别传输至每条第二数据线Data2对应的N条第一数据线Data1，进而分时给第二列子像素中的像素电极；以此类推，当第二数据线Data2中的信号通过第一数据线Data1传输至每个子像素的像素电极后，即完成对整个辅显示区内所有子像素的像素电极进行充电，实现了辅显示区的驱动。
需要说明的是，图8中t1～tN时间等同于图5中Out_1'～Out_P'中的一个为导通电平时段的时间；Data2中的第一数据信号在t1～tN时间内需要根据第iN+1条～第(i+1)N条第一数据线Data1对应的子像素需要的电压信号进行变化。例如，在t1时段内，第iN+1条第一数据线Data1对应的子像素需要5v的电压，则此时Data2的第一数据信号为5V；在t2时段内，第iN+2条第一数据线Data1对应的子像素需要3v的电压，则此时Data2的第一数据信号为3V。由于每一条第一数据线Data1对应的子像素需要的电压需要根据显示图像而定，因此，图8中Data2的第一数据信号只能以随机信号的方式表示。
以上仅以液晶显示面板为例进行说明，但本发明实施例对于异形显示面板的类型不作限定，例如，有机发光显示面板也可以应用本发明实施例的方案，只是不再通过第一数据线Data1传输信号至每个子像素对应的像素电极，而是通过第一数据线Data1传输信号至每个子像素对应的驱动晶体管的栅极，但是驱动的过程是相同的。
需要说明的是，在实际应用中，根据薄膜晶体管的类型，移位寄存器8向薄膜晶体管输出不同的导通信号。例如，当薄膜晶体管为PMOS时，移位寄存器8向对应的PMOS输出低电平的导通信号，当当薄膜晶体管为NMOS时，移位寄存器8向对应的NMOS输出高电平的导通信号。
可选的，各移位寄存器8可包括输入选通模块、锁存移位模块和驱动放大模块。其中，输入选通模块用于选择辅显示区的扫描方向，锁存移位模块用于输出导通信号，以及输出控制下一个移位寄存器8工作的移位信号，驱动放大模块用于将锁存移位模块输出的导通信号进行放大，向对应的薄膜晶体管输出驱动能力较强的导通信号。需要说明的是，上述输入选通模块、锁存模块和驱动放大模块的连接关系以及工作原理均为现有技术，此处不再赘述。
可以理解的是，当N级移位寄存器用于驱动呈行方向延伸的数据线或栅线时，N级移位寄存器为水平移位寄存器(Horizontal Shift Register，简称HSR)；当N级移位寄存器用于驱动呈列方向延伸的数据线或栅线时，N级移位寄存器为垂直移位寄存器(VerticalShift Register，简称VSR)。
当辅显示区为X列*Y行分辨率，且辅显示区的帧频为f时，假定所需第二数据线Data2的数量为M，即驱动辅显示区内全部的第一数据线Data1所需M个N级移位寄存器。
当第一数据线Data1沿行方向延伸时，根据单个像素充电时间t的计算公式推导得出当第一数据线Data1沿列方向延伸时，根据单个像素充电时间t的计算公式推导得出
根据可知，第二数据线Data2的数量M与单个像素充电时间t呈正比。也就是说，若想对像素充电较长时间，就需采用较多的第二数据线Data2，但是这样会增大第二数据线Data2布线的复杂度。若想采用较少数量的第二数据线Data2，则会导致对像素的充电时间很短，进而导致充电时间不足。因此，所采用的第二数据线Data2的数量M不宜过大，也不宜过小。
目前，对单个像素的充电时间优选为5μs，基于此，假定辅显示区的尺寸为160行*1040列分辨率，下面通过两个具体实施方式，对该尺寸的辅显示区所需的第二数据线Data2的数值进行推导：
具体实施方式一：
以辅显示区内包括160条沿行方向延伸的第一数据线Data1和1040条沿列方向延伸第一栅线Gate1为例，若采用8个20级移位寄存器，即对应8条第二数据线Data2。完成辅显示区一帧充电时间T1＝20*1040*5μs＝104ms，根据f＝1/T，可以计算出对应的帧频f1＝1/104ms＝10Hz。
若采用16个10级移位寄存器，即对应16条第二数据线Data2。完成辅显示区一帧充电时间T2＝10*1040*5μs＝52ms，根据f＝1/T，可以计算出对应的帧频f2＝1/52ms＝20Hz。
由于目前异形显示面板的帧频f在15Hz左右，因此，根据f1＜f＜f2可以推导出所需的第二数据线Data2的数量应该大于8小于16。例如，该种情况下第二数据线Data2的数量可以为10条，此时需采用10个16级移位寄存器。
具体实施方式二：
以辅显示区内包括1040条沿列方向延伸第一数据线Data1和160条沿行方向延伸的第一栅线Gate1为例，若采用8个130级移位寄存器，即对应8条第二数据线Data2。完成辅显示区一帧充电时间T1'＝130*160*5μs＝104ms，根据f＝1/T，可以计算出对应的帧频f1'＝1/104ms＝10Hz。
若采用16个65级移位寄存器，即对应16条第二数据线Data2。完成辅显示区一帧充电时间T2'＝65*160*5μs＝52ms，根据f＝1/T，可以计算出对应的帧频f2'＝1/52ms＝20Hz。
由于目前异形显示面板的帧频f在15Hz左右，与上述推导方式相同，根据f1'＜f＜f2'可以推算出所需的第二数据线Data2的数量应该大于8小于16。例如，第二数据线Data2的数量可以为10条或13条，当第二数据线Data2的数量为10条时，需采用10个104级移位寄存器，当第二数据线Data2的数量为13条时，需采用13个80级移位寄存器。
基于上述推导，在保证对单个像素具有足够的充电时间的前提下，能够进一步减少所采用的第二数据线Data2的数量，进而能够减少面板走线宽度的增量。示例性的，在实际工艺中，若采用10条第二数据线Data2驱动1040条第一数据线Data1，面板走线宽度的增量可减少至50μm。
此外，由于辅显示区通常用来显示一些简单的图标，不用进行传统的信息展示，因此，对辅显示区所显示的画面的质量要求可以低于主显示区，下面通过两种方式进行具体说明：
方式一
令辅显示区的解析度低于主显示区的解析度，具体的，可以令辅显示区内的单个子像素的面积大于主显示区内的单个子像素的面积，换句话说，也就是令辅显示区单位面积内的子像素的个数小于主显示区单位面积内的子像素的个数。
通过该种设置方式，在满足辅显示区正常显示画面的要求的前提下，一方面能够减少辅显示区内的第一数据线Data1的数量，相应的减少了第二数据线Data2的数量，进而简化第二扫描单元2的结构，节省布局空间。另一方面，通过减少需要驱动的辅显示区内的子像素的个数，还能够降低驱动过程中所需的功耗。
方式二
令辅显示区能够显示的颜色的总数低于主显示区能够显示的颜色的总数，也就是令辅显示区内的色彩数小于主显示区内的色彩数。
具体的，可以通过降低辅显示区的bit数的方式降低辅显示区内的色彩数。例如，若主显示区的bit数为8bit，对应256(28)个亮度层次，也就是256灰阶，可以将辅显示区的bit数降为5bit，对应32(25)个亮度层次，也就是32灰阶，通过减少辅显示区对应的亮度层次，可以实现将颜色相近的几种颜色用一种颜色表示，这样，就可以降低辅显示区需显示的颜色的总数。并且，通过降低辅显示区内需显示的颜色的总数，可以降低主驱动芯片5的运算量，进而降低功耗。
本实施例还提供了一种异形显示面板的驱动方法，该异形显示面板的驱动方法应用于如上述异形显示面板中。
上述异形显示面板的驱动方法包括：在主驱动芯片的控制下，第一扫描单元分时向多条第一栅线传输第一扫描信号，在每条第一栅线接收到第一扫描信号时，各第二扫描单元分时控制对应的开关单元导通，使经由第二数据线传输的第一数据信号分时传输至对应的第一数据线中。
可以理解的是，上述第一数据信号是指主驱动芯片提供的用于驱动辅显示区进行画面显示的信号，根据辅显示区显示画面的实际需求，经由第二数据线向不同的第一数据线传输相同或不同的第一数据信号。
采用本实施例提供的异形显示面板的驱动方法，基于异形显示面板中的第二扫描单元、开关单元、第一数据线和第二数据线之间的相互配合，主驱动芯片仅需通过与第二扫描单元的个数相等数量的第二数据线，就可将相应的第一数据信号分时传输至全部的第一数据线中，很大程度上减少了第二数据线的数量，并且无需在异形显示面板内额外设置子驱动芯片，降低了异形显示面板的制作成本。
当然，在驱动辅显示区进行画面显示的同时，本实施例提供的异形显示面板的驱动方法还包括：在主驱动芯片的控制下，第三扫描单元分时向多条第三栅线传输第二扫描信号，在每条第一栅线接收到第一扫描信号时，主驱动芯片向各第三数据线传输相应的第二数据信号。
可以理解的是，上述第二数据信号是指主驱动芯片提供的用于驱动主显示区进行画面显示的信号，根据主显示区显示画面的实际需求，主驱动芯片向不同的第三数据线传输相应的第二数据信号。
当第二扫描单元为N级移位寄存器时，对辅显示区内第一数据线的具体驱动过程已在上述实施例中进行了详细描述，此处不再重复说明。
如图9所示，本实施例还提供了一种显示装置9，该显示装置9包括上述异形显示面板。
其中，异形显示面板的具体结构和驱动原理与上述实施例相同，在此不再赘述。当然，图9所示的显示装置9仅仅为示意说明，该显示装置可以是例如手机、平板计算机、笔记本电脑、电纸书或电视机等任何具有显示功能的电子设备。
由于本实施例所提供的显示装置包括如上述实施例所述的异形显示面板，因此，采用本实施例提供的显示装置，一方面避免主显示区内出现可见边界的问题，另一方面，还能在很大程度上减少第二数据线的数量，并且无需再额外设置子驱动芯片，降低结构复杂度，进而降低制作成本。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本发明保护的范围之内。

Claims (12)

1.一种异形显示面板，其特征在于，所述异形显示面板的显示区包括主显示区和凸起于所述主显示区的辅显示区，所述异形显示面板包括：
在所述辅显示区内交叉绝缘设置的多条第一数据线和多条第一栅线；
第一扫描单元，所述第一扫描单元分别与主驱动芯片、多条所述第一栅线相连；
M个第二扫描单元，各所述第二扫描单元的控制端分别与所述主驱动芯片相连，各所述第二扫描单元包括多个输出端；其中，M为大于1的正整数；
与M个所述第二扫描单元一一对应的M个开关单元组，各所述开关单元组分别包括多个开关单元，各所述开关单元组中多个所述开关单元的控制端分别与对应的第二扫描单元的多个输出端一一对应相连，各所述开关单元组中多个所述开关单元的第一端分别与所述第一数据线一一对应相连；
与M个所述开关单元组一一对应的M条第二数据线，各所述第二数据线分别与所述主驱动芯片、对应的开关单元组中的多个所述开关单元的第二端相连。
2.根据权利要求1所述的异形显示面板，其特征在于，所述异形显示面板包括：
在所述主显示区内交叉绝缘设置的多条第三数据线和多条第三栅线，所述第三数据线分别与所述主驱动芯片相连；
第三扫描单元，所述第三扫描单元分别与所述主驱动芯片、多条所述第三栅线相连。
3.根据权利要求2所述的异形显示面板，其特征在于，所述主显示区的各所述第三数据线分别沿第一方向延伸，各所述第三栅线分别沿第二方向延伸；所述辅显示区内的各所述第一数据线分别沿所述第二方向延伸，各所述第一栅线分别沿所述第一方向延伸。
4.根据权利要求2所述的异形显示面板，其特征在于，所述主显示区内的各所述第三数据线分别沿第一方向延伸，各所述第三栅线分别沿第二方向延伸；所述辅显示区内的各所述第一数据线分别沿所述第一方向延伸，各所述第一栅线分别沿所述第二方向延伸。
5.根据权利要求1所述的异形显示面板，其特征在于，各所述第二扫描单元的输出端的数量相同。
6.根据权利要求1所述的异形显示面板，其特征在于，一所述第二扫描单元为N级移位寄存器，该所述第二扫描单元对应的所述开关单元组包括N个所述开关单元；所述N级移位寄存器的N个输出端分别与对应的开关单元组中的N个所述开关单元的控制端一一对应相连，其中，N为大于1的正整数。
7.根据权利要求1所述的异形显示面板，其特征在于，所述开关单元为薄膜晶体管，所述薄膜晶体管的栅极与对应的第二扫描单元的输出端相连，所述薄膜晶体管的源极与对应的第一数据线相连，所述薄膜晶体管的漏极与对应的第二数据线相连。
8.根据权利要求1所述的异形显示面板，其特征在于，所述辅显示区为X列*Y行的分辨率时，所述第二数据线的条数
其中，M表示所述第二数据线的条数，t表示单个像素的充电时间，f表示所述辅显示区的帧频。
9.根据权利要求1所述的异形显示面板，其特征在于，所述辅显示区内的单个子像素的面积大于所述主显示区内的单个子像素的面积。
10.根据权利要求1所述的异形显示面板，其特征在于，所述辅显示区内的色彩数小于所述主显示区内的色彩数。
11.一种异形显示面板的驱动方法，其特征在于，所述异形显示面板的驱动方法应用于如权利要求1～10任一项所述的异形显示面板，所述异形显示面板的驱动方法包括：
在主驱动芯片的控制下，第一扫描单元分时向多条第一栅线传输第一扫描信号，在每条所述第一栅线接收到所述第一扫描信号时，各第二扫描单元分时控制对应的开关单元导通，使经由第二数据线传输的第一数据信号分时传输至对应的第一数据线中。
12.一种显示装置，其特征在于，所述显示装置包括如权利要求1～10任一项所述的异形显示面板。
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