CN105976774A - 栅极驱动器、显示驱动器电路及驱动栅极线的方法 - Google Patents

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Abstract

一种栅极驱动器、显示驱动器电路及驱动栅极线的方法。所述显示驱动器电路，包括：栅极驱动器，根据驱动顺序驱动显示面板的栅极线。栅极线按照有序排列而被布置在显示面板内。源极驱动器将与所选择的栅极线相应的图像数据转换为图像信号并将图像信号输出到显示面板的源极线。时序控制器通过将与第一栅极线相应的第一图像数据和与多条栅极线中的栅极线分别相应的图像数据部分进行比较来计算比较值。时序控制器响应于所述比较值设置用于栅极线的驱动顺序。

Description

栅极驱动器、显示驱动器电路及驱动栅极线的方法
本申请要求于2015年3月13日提交的第10-2015-0035151号韩国专利申请的权益，其主题通过引用合并于此。
技术领域
本发明构思的实施例总体上涉及半导体装置，并且更具体地讲，涉及驱动显示面板的栅极驱动器。本发明构思的其它实施例涉及显示驱动器电路以及包括至少一个显示驱动器电路的显示装置。
背景技术
显示装置包括显示图像的显示面板以及驱动与显示面板相关联的一个或多个电信号的显示驱动器电路驱动。在其运行时，显示驱动器电路从主机接收图像数据，对于接收到的图像数据执行图像处理，并且通过基于图像处理后的图像数据将电压信号施加于显示面板的源极线来驱动显示面板。随着如今显示面板的尺寸和分辨率增加，正研究各种技术以减少显示驱动器电路的功耗。
发明内容
本发明构思提供一种用于减少动态电能消耗并改善散热特性的显示驱动器电路。
本发明构思提供一种用于减少动态电能消耗并改善散热特性的显示装置。
根据本发明构思的一方面，提供一种显示驱动器电路，包括：栅极驱动器，被配置为顺序地选择显示面板的栅极线；源极驱动器，被配置为将与所选择的栅极线相应的图像数据转换为图像信号并将图像信号输出到显示面板的源极线；时序控制器，被配置为通过对与第一栅极线相应的第一图像数据与在第一栅极线之后选择的N条栅极线中的每条栅极线相应的图像数据进行比较来计算N个比较值并基于所述N个比较值确定用于所述N条栅极线的驱动顺序(其中，N是等于或大于2的整数)。
时序控制器可确定选择的顺序使得当所述N个比较值的最大值小于预定阈值时根据所述N条栅极线靠近第一栅极线的顺序而顺序地选择所述N条栅极线而不管所述N个比较值如何，并且可确定选择的顺序使得当所述N个比较值的最大值等于或大于所述预定阈值时根据递增的比较值的顺序(即，从最小的比较值开始的顺序)选择所述N条栅极线。
时序控制器可产生选择控制信号并可向栅极驱动器提供选择控制信号，其中，选择控制信号指示选择的顺序并根据在显示面板上显示的图像的图案而变化。
时序控制器可包括：选择控制逻辑单元，被配置为对第一图像数据和与所述N条栅极线相应的N条图像数据进行比较并产生指示用于所述N条栅极线的驱动顺序的选择控制信号。
当从外部接收到的图像数据是运动图像时，时序控制器可阻止选择控制逻辑单元的操作并控制栅极驱动器，使得顺序地选择栅极线。
当从外部接收到的图像数据是静止图像时，选择控制逻辑单元可在显示静止图像的多个帧时间段中的第一帧时间段中执行用于图像数据的比较的计算操作，并且可在其它帧时间段中不执行所述计算操作。
当至少两个比较值具有相同值时，时序控制器可设置选择的顺序，使得与所述至少两个比较值相应的栅极线之中的在物理上邻近第一栅极线的栅极线首先被选择。
所述N条栅极线可包括第二栅极线和第三栅极线，其中，时序控制器可对第一图像数据和与第二栅极线、第三栅极线相应的第二图像数据、第三图像数据均进行比较并选择选择的顺序，使得在二栅极线和第三栅极线之中，包括针对第一图像数据具有相对小的数据差的图像数据的栅极线首先被选择。
所述N条栅极线可包括第二栅极线、第三栅极线以及第四栅极线，其中，时序控制器可对第一图像数据和与第二栅极线、第三栅极线、第四栅极线相应的第二图像数据、第三图像数据、第四图像数据均进行比较并选择选择的顺序，使得在二栅极线和第三栅极线之中，包括针对第一图像数据具有相对大的的数据差的图像数据的栅极线最后被选择。
第一栅极线可以是在所述N条栅极线之前选择的其它N条栅极线之中最后被选择的栅极线。
第一栅极线可以是被设置为在所述多条栅极线之中首先被选择的栅极线。
时序控制器可通过对与所述N条栅极线之中最后被选择的栅极线相应的图像数据和与在N条栅极线之后选择的其它N条栅极线相应的图像数据均进行比较来计算N个比较值，并且可确定选择的顺序使得根据递增的比较值的顺序(即，从最小比较值开始的顺序)选择所述其它N条栅极线。
时序控制器可顺序地向栅极驱动器提供指示用于所述N条栅极线的驱动顺序的第一选择控制信号和指示用于所述其它N条栅极线的驱动顺序的第二选择控制信号。
栅极驱动器可包括：移位寄存器，被配置为产生多个移位脉冲；电平移位器，被配置为对所述多个移位脉冲的电压电平进行移位并输出具有移位的电压电平的信号；输出缓冲器，被配置为基于从电平移位器输出的信号产生多个扫描脉冲并向所述多条栅极线提供所述多个扫描脉冲；多路转换器，被配置为从时序控制器接收指示用于所述多条栅极线的驱动顺序的选择控制信号并响应于所述选择控制信号而设置移位寄存器的多个输出和电平移位器的多个输入之间的连接关系。
选择控制信号可包括被顺序地提供给多路转换器的第一选择控制信号和第二选择控制信号，其中，多路转换器可包括：第一多路转换器，被配置为响应于第一选择控制信号而设置移位寄存器的N个输出和电平移位器的N个输入之间的连接关系；第二多路转换器，被配置为响应于第二选择控制信号而设置移位寄存器的其它N个输出和电平移位器的其它N个输入之间的连接关系。
第二选择控制信号可在第一多路转换器向电平移位器发送N个移位脉冲之后被接收。
根据本发明构思的另一方面，提供一种显示装置，包括：显示面板，包括位于按照列的方向排列的多条栅极线和按照行的方向排列的多个源极线相互交叉的区域中的多个像素；栅极驱动单元，被配置为根据驱动的顺序顺序地驱动所述多条栅极线；源极驱动器，被配置为向所述多个源极线输出与所选择的栅极线相应的图像信号；时序控制器，被配置为对与第K组的N条栅极线相应N条比较图像数据和与从第(K-1)组的栅极线中最后被选择的栅极线相应的参考图像数据均进行比较并基于比较结果设置第K组的所述N条栅极线的驱动顺序，其中，‘K’和‘N’是等于或大于2的整数。
时序控制器可向栅极驱动单元提供指示驱动的顺序的控制信号，栅极驱动单元可响应于所述控制信号而根据所述预定驱动顺序驱动第K组的所述N条栅极线。
栅极驱动单元可包括均接收所述控制信号的多个栅极驱动器，可由不同的半导体芯片实施所述多个栅极驱动器。
显示面板可包括：所述多个像素之中在同一列中排列的像素被连接到同一源极线的直线型面板；Z字型面板，其中，在所述Z字型面板中，在同一列中排列的像素之中，在奇数列中排列的像素被连接到在所述像素的两侧排列的第一源极线和第二源极线中的第一源极线，在偶数列中排列的像素被连接到第二源极线。
时序控制器可基于所述N条栅极线的驱动顺序重设输出所述N条比较图像数据的顺序。
根据本发明构思的另一方面，提供一种用于驱动显示面板的多条栅极线的栅极驱动器，其中，栅极驱动器包括：移位寄存器，被配置为产生多个移位脉冲；电平移位器，被配置为对所述多个移位脉冲的电压电平移位并输出具有移位的电压电平的信号；输出缓冲器，被配置为向所述多条栅极线提供从电平移位器输出的所述信号；多路转换器，被配置为响应于根据图像的图案而变化的选择控制信号设置移位寄存器的多个输出和电平移位器的多个输入之间的连接关系。
附图说明
在以下结合附图的详细描述中描述本发明构思的特定实施例，其中，在附图中：
图1是根据本发明构思的实施例的显示装置的框图；
图2是进一步示出图1的时序控制器的框图；
图3是示出图1的时序控制器的操作的概念图；
图4是示出在图2的时序控制器的存储器中存储的图像数据的概念图；
图5是示出根据示例性实施例的显示装置的操作方法的流程图；
图6是示出在图5的流程图中示出的比较图像数据和确定选择顺序的示例性实施例的流程图；
图7是示出在图5的流程图中示出的比较图像数据和确定选择顺序的另一示例性实施例的流程图；
图8是示出根据示例性实施例的时序控制器的操作的流程图；
图9A、图9B及图9C是示出图1的栅极驱动器的实施示例的框图；
图10示出黑白条纹图案；
图11A、图11B及图11C均示出当图1的显示装置显示图10的图像图案时信号的波形；
图12A和图12B是示出图1的显示面板的实施例的示图；
图13是示出根据示例性实施例的当显示面板是直线型面板时时序控制器的操作方法的流程图；
图14是示出根据示例性实施例的当显示面板是Z字型面板时时序控制器的操作方法的流程图；
图15是示出图1的栅极驱动器的另一实施示例的框图；
图16示出当包括图15的栅极驱动器的显示装置显示图10的图像图案时信号的波形；
图17是示出根据示例性实施例的包括图1的显示装置的显示模块的实施示例的框图；
图18是示出根据示例性实施例的包括图1的显示装置的显示模块的另一实施示例的框图；
图19是根据示例性实施例的示出触摸屏模块的框图；
图20是示出根据示例性实施例的包括图1的显示装置的电子系统的框图；
图21是根据示例性实施例的显示系统的框图。
具体实施方式
现在将参照附图在一些附加细节中描述本发明构思的实施例。提供所示出的实施例，使得本公开将是彻底和完整的并将向本领域技术人员充分地传达本发明构思的范围。因此，虽然可按照各种方式修改本发明构思并且本发明构思可采取各种可选形式，但是作为示例，在附图中示出本发明构思的特定实施例并在下文中予以详细描述。不存在将本发明构思限于所公开的特定形式的意图。相反地，应将本发明构思的范围理解为涵盖所有的修改、等同物及可选方案。贯穿说明书和附图，同样的附图标号表示同样或类似的元件、步骤特征等。
还将理解：当在此使用时，术语“包括”和/或“包含”表示存在所陈述的特征、项目、步骤、操作、元件和/或组件，但是并不排除存在或增加一个或多个其它特征、项目、步骤、操作、元件、组件和/或前述项的组合。
如在此所使用，术语“或”包括所列出的关联项目中的一个或多个的任意及全部组合。例如，表述“A或B”可包括A、B、或者A和B二者。当诸如“至少一个”的表述位于一列元素之后时，该表述修饰所列出的元素而不修饰所述列出的单个元素。
将理解：虽然术语“第一”、“第二”等可在此被用于描述各种元件、组件、区域、层和/或区段，但是这些元件、组件、区域、层和/或区段不应被这些术语所限制。因此，在不脱离本发明构思的教导的情况下，在下文中讨论的第一元件、第一组件、第一区域、第一层和/或第一区段可被称为第二元件、第二组件、第二区域、第二层和/或第二区段。
将理解：当提及将一个元件“连接到”另一元件时，所述元件可被直接连接到另一元件或者可能存在中间元件。相反地，当提及将一个元件“直接连接到”另一元件时，不存在中间元件。
在此使用的术语仅仅是为了描述特定实施例的目的，而并非意在限制示例实施例。如在此所使用，除非上下文清楚地另有指示，否则单数形式意在也包括复数形式。
除非另有限定，在此使用的所有术语(包括技术术语和科学术语)具有与本发明构思所属领域的普通技术人员通常理解的相同含义。还将理解：应将术语(诸如在通常使用的词典中限定的术语)解释为具有与在相关技术领域的语境中的含义一致的含义并且将不在理想化或过分正式的意义上被解释，除非在其中被如此明确限定。
根据本发明构思的各种实施例的显示装置可以是具有图像显示功能的电子装置。例如，所述电子装置可包括以下项中的至少一个：智能电话、平板PC、移动电话、视频电话、电子书阅读器、桌上型PC、膝上型PC、上网本计算机、个人数字助理(PDA)、便携式多媒体播放器(PMP)、MPEG-1音频层3(MP3)播放器、移动医疗装置、相机或可穿戴装置(诸如，头戴式装置(HMD)(例如电子眼镜)、电子服装、电子手链、电子项链、电子应用配件、电子纹身或智能手表)。
在特定实施例中，所述电子装置可以是具有图像显示功能的智能家用电器。例如，所述智能家用电器可包括以下项中的至少一个：TV、DVD播放器、音频播放器、冰箱、空调、真空吸尘器、烤箱、微波炉、洗衣机、空气净化器、机顶盒、TV盒子(例如，三星HomeSyncTM、苹果TVTM或谷歌TVTM)、游戏控制台、电子词典、电子钥匙、摄像机或电子相框。
在一些实施例中，所述显示装置可包括以下项中的至少一个：各种医疗装置(例如，磁共振血管造影(MRA)、磁共振成像(MRI)、计算机断层扫描(CT)、成像装置或超声装置)、导航装置、全球定位系统(GPS)接收器、事件数据记录器(EDR)、飞行数据记录器(FDR)、车载信息娱乐装置、机头单元、海上电子设备(例如，海上导航装置和陀螺罗经)、航空电子装置、安全装置、汽车机头单元、工业机器人或家用机器人、金融机构的自动柜员机(ATM)或者商店的销售点(POS)。
在一些实施例中，所述显示装置可包括以下项中的至少一个：具有图像显示功能的家具或建筑/结构的一部分、电子图板、电子签名接收装置、投影仪或各种测量装置(例如，自来水、电力、燃气及无线电波测量装置)。包括根据本发明构思的各种实施例的所述显示装置的电子装置可以是上述各种设备中的一个或上述各种设备的组合。此外，所述显示装置可以是柔性设备。将理解：根据本发明构思的各种实施例的所述显示装置不限于上述设备。
在下文中，将参照附图来描述根据本发明构思的各种实施例的显示装置。在各种实施例中，术语“用户”可指示显示装置的用户或使用显示装置的装置(例如，人工智能(AI)电子装置)。
图1是根据本发明构思的实施例的示出显示装置1000的框图。参照图1，显示装置1000一般包括显示面板10和显示驱动器电路20。
显示面板10包括以矩阵排列的多个像素并且显示面板10被配置为以帧单位显示图像。可从以下项中所选择的一个项来实施显示面板10：液晶显示器(LCD)、发光二极管(LED)显示器、有机LED(OLED)显示器、有源矩阵OLED(AMOLED)显示器、电致变色显示器(ECD)、数字镜装置(DMD)、制动镜装置(AMD)、光栅光阀(GLV)、等离子显示面板(PDP)、电致发光显示器(ELD)、真空荧光显示器(VFD)，或者可由其它种类的平面显示器(FPD)或柔性显示器中的一个实施显示面板10。图1所示出的实施例描述在显示面板是LCD面板的假设下的显示面板10。
进一步将图1中示出的显示面板10假设为包括沿行方向排列的栅极线G1至Gn，沿列方向排列的源极线S1至Sm、在栅极线G1至Gn和源极线S1至Sm之间的交叉点形成的各个像素PX。这里，每个像素PX可包括薄膜晶体管(TFT)以及连接到TFT的漏极的液晶(LC)电容器Clc和存储电容器Cst。可将共用电压Vcom施加到LC电容器Clc和存储电容器Cst的另一端子。当栅极线G1至Gn被顺序地扫描时，连接到所选择的栅极线的像素PX的TFT可被导通，并且可将与像素数据相应的灰度电压施加到各个源极线S1至Sm。灰度电压可通过相应像素PX的TFT而被施加到LC电容器Clc和存储电容器Cst，并且可驱动LC电容器Clc和存储电容器Cst以实现显示操作。
可将图1中示出的显示驱动器电路20用于基于图像数据DATA1和从外部提供的控制信号来产生驱动信号，其中，所述驱动信号用于向显示面板10显示与图像数据DATA1相应的图像。这些从外部提供的控制信号可包括(例如)水平同步信号Hsync、垂直同步信号Vsync、时钟信号DCLK、数据使能信号DE等。显示驱动器电路20包括时序控制器100、栅极驱动器20、源极驱动器300以及电压产生器400，其中，可将显示驱动器电路20实施为单个半导体芯片或多个半导体芯片。
时序控制器100可从装置(诸如主机装置(未示出))接收图像数据DATA1和从外部提供的控制信号。响应于图像数据DATA1和从外部提供的控制信号，时序控制器100产生用于控制栅极驱动器20和源极驱动器300的控制信号CONT1、CONT2及SHFL。时序控制器100还可被用于转换从外部提供的特定图像数据DATA1的格式以符合针对与源极驱动器300相关联的接口的规格。因此，可将转换后的图像数据DATA2从时序控制器100传递到源极驱动器300。可使用一个或多个限定的(例如，封包的)数据格式执行这种数据通信。
时序控制器100还可被用于设置针对栅极线G1至Gn的选择的顺序。也就是说，可针对多条栅极线G1至Gn设置具体的“驱动顺序”，其中，根据图像数据DATA1和/或根据响应于图像数据DATA1将在显示面板10上显示的图像的图案(在下文中，称为“图像数据图案”)设置所述驱动顺序。就此而言，由时序控制器100设置的具体驱动顺序可选择性地按照相对于栅极线的“有序排列”(例如，物理布局)的有序的、部分有序的或非有序的方式驱动栅极线G1至Gn。
时序控制器100还可被用于通过将图像数据的多个部分(在下文中，称为“图像数据部分”)进行比较来分析图像数据图案，其中，所述图像数据部分包括被分配到在显示面板10的有序排列的物理相邻的至少两条栅极线的图像数据部分。当通过这种图像数据部分的比较而识别的数据差异被视为相对大时，时序控制器100可按照非有序方式选择栅极线，使得连续选择具有小的数据差的栅极线。
例如，假设三条栅极线的简单有序排列包括相邻于第二栅极线G2(第二栅极线G2相邻于第三栅极线G3)的第一栅极线G1，当与第一栅极线G1相应的第一图像数据部分和与第二栅极线G2相应的第二图像数据部分之间的第一数据差相对地大于第一图像数据部分和与第三栅极线G3相应的第三图像数据部分之间的第二数据差时，时序控制器100可针对所述栅极线设置非有序驱动顺序，使得在第一栅极线G1之后驱动第三栅极线G3，而不是第二栅极线G2，并在第三栅极线G3之后驱动第二栅极线G2。换言之，时序控制器100可按照一些指定顺序(例如，从最低到最高的递增顺序)对多个数据差进行“排序”，然后使用“排序”的数据差来限定用于与各个数据差相关联的栅极线的相应驱动顺序。
在之前的描述中，术语“图像数据”和/或“图像数据部分”表示指示被施加到连接到相应栅极线的一些像素或所有像素的灰度电压的所有像素数据或一些像素数据。在一些实施例中，图像数据可以是与连接到特定栅极线的所有像素相应的像素数据。在一些实施例中，图像数据可以是在像素数据中包括的多位图像数据单元的特定高位。
在图1所示出的实施例中，时序控制器100包括选择控制逻辑单元110，该选择控制逻辑单元110可被用于根据图像数据图案设置从栅极线G1至Gn之中相应地选择栅极线的驱动顺序。选择控制逻辑单元110可被用于通过将与参考栅极线相应的图像数据和与在参考栅极线的选择之后将被选择的一个或多条栅极线相应的图像数据进行比较来计算一个或多个比较值并基于计算出的比较值设置在栅极线之中进行选择的驱动顺序。
在一些实施例中，选择控制逻辑单元110可根据比较值的递增顺序设置针对栅极线的驱动顺序(例如，针对栅极线的起始于与最小的比较值相关联的第一栅极线直到与最大的比较值相关联的最后栅极线的驱动顺序)。按照这种方式，选择控制逻辑单元110可设置针对栅极线的驱动顺序，使得在驱动顺序中，与相对于与参考栅极线相应的图像数据部分具有最小数据差的图像数据部分相应的栅极线将首先被选择。
将前述示例延伸，选择控制逻辑单元110可被用于在每次选择栅极线之后实质上将参考栅极线重设为最后选择的栅极线。因此，一旦被选择，第一栅极线可被指定为用于具有第二小的比较值的下一(第二)栅极线的选择的参考栅极线。例如，选择控制逻辑单元110可通过将与第一栅极线(现在为新的参考栅极线)相应的图像数据部分和与剩余(先前未被选择)栅极线相应的各个图像数据部分进行比较来计算下一比较值。在这些条件之下识别出最小的比较值之时，选择控制逻辑单元110可选择适当的下一(第二)栅极线。随后，在驱动顺序中的下一(第三)栅极线的选择期间，第二栅极线被指定为新的参考栅极线，以此类推直到选择控制逻辑单元110设置针对所述多条栅极线的完整驱动顺序。
在下文中，选择控制逻辑单元110基于图像数据图案的确定(例如，与静止图像相关联的第一图像数据图案，与运动图像相关联的第二图像数据图案)设置用于栅极线的非有序驱动顺序的所依据的方法，而不是设置由其有序排列指示的顺序的驱动顺序。这种非有序(而不是有序)驱动顺序的选择可被称为“栅极线选择控制操作”。另外，根据其有序排列而顺序地选择栅极线的操作模式将被称为“默认栅极线选择模式”，而可相对于其有序排列的非有序地选择栅极线的操作模式将成为“置乱(shuffle)栅极线选择模式”。
因此，在一些实施例中，选择控制逻辑单元110可将最大的比较值和预定阈值进行比较，从而确定是否执行栅极线选择控制操作。例如，当在多个比较值之中的最大比较值小于所述阈值时，选择控制逻辑单元110可确定不需要栅极线选择控制操作。随后，时序控制器100可在默认栅极线选择模式下运行并且设置用于栅极线的有序驱动顺序，而不考虑除最大比较值以外在多个比较值中的各个比较值。相反地，当在所述多个比较值之中的最大比较值大于或等于所述阈值时，选择控制逻辑单元110可确定需要栅极线选择控制操作。随后，时序控制器100可在置乱栅极线选择模式下运行并且设置针对栅极线的非有序驱动顺序。
如在图1中进一步所示，选择控制逻辑单元110可被用于设置针对栅极线G1至Gn的驱动顺序并产生指示驱动顺序的相应选择控制信号SHFL。选择控制逻辑单元110可向栅极驱动器200提供选择控制信号SHFL和一组相应控制信号。
响应于由时序控制器100提供的第一控制信号CONT1和第二控制信号CONT2以及选择控制信号SHFL，栅极驱动器200和源极驱动器300共同地驱动显示面板10的像素PX。这里，第一控制信号CONT1和第二控制信号CONT2可以是一个或多个控制信号、控制包和/或参考信号(例如，时钟信号、电压参考、参考数据)。
在图1的实施例中，栅极驱动器200接收选择控制信号SHFL和第二控制信号CONT2，其中，控制信号CONT2可包括用于指示栅极开启(gate-on)脉冲(或扫描脉冲)的输出开始的垂直开始信号STV和用于控制栅极开始脉冲的输出时间点的栅极时钟信号(CPV)。栅极开启脉冲是指示将栅极开启电压GON施加到栅极线G1至Gn的时间段的信号。响应于栅极开启脉冲，可顺序地选择显示面板10的栅极线G1至Gn。然而，栅极驱动器200可响应于选择控制信号SHFL改变将栅极开启脉冲施加到栅极线G1至Gn的顺序。栅极驱动器200可将栅极开启电压GON施加到所选择的栅极线以激活所选择的栅极线。
源极驱动器300输出针对连接到激活的栅极线的每个像素的灰度电压。因此，显示面板100可以以水平线或行的单位显示图像。
源极驱动器300响应于作为源极驱动器控制信号的第一控制信号CNT1而驱动显示面板10的源极线S1至Sm。源极驱动器300产生与图像数据DATA2相应的灰度电压并将该灰度电压输出到显示面板10的源极线S1至Sm。
电压产生器400可产生由显示驱动器电路20和/或显示面板10使用的电压。电压产生器400可产生栅极开启电压GON、栅极关闭电压GOFF、共用电压Vcom以及模拟供电电压VDDA。栅极开启电压GON和栅极关闭电压GOFF可被提供给栅极驱动器200并用于产生将被施加到栅极线G1至Gj的扫描脉冲。共用电压Vcom可共同地被提供给LC电容器Clc的一个端子和存储电容器Cst的一个端子。模拟供电电压VDDA可被提供给源极驱动器300。
虽然在图1中未示出，但是显示驱动器电路20还可包括接口。显示驱动器电路20可经由所述接口与外部装置进行通信。所述接口可包括(例如)RGB接口、CPU接口、串行接口、移动显示数字接口(MDDI)、集成电路间(I2C)接口、串行外围接口(SPI)、微控制器单元(MCU)接口、移动工业处理器接口(MIPI)、嵌入式显示端口(eDP)接口、D微小型(D-sub)、光学接口或高清多媒体接口(HDMI)。此外，所述接口可包括(例如)移动高清链路(MHL)接口、安全数字(SD)卡/多媒体卡(MMC)接口或红外数据协会(IrDA)标准接口。另外，除上述接口以外，接口可包括各种串行接口或并行接口的一个。
在图1中示出的显示装置1000中，由于时序控制器100能够根据图像数据图案控制针对栅极线G1至Gn的驱动顺序，因此可连续选择相对地接收特征在于具有相对小的差的图像数据部分的各个栅极线。因此，在所述条件下，在从源极驱动器300中以水平线为单位输出的灰度电压之间的电压差也将是小的，并且可减少在一个帧内由源极驱动器300输出的灰度电压剧烈改变的次数。也就是说，可减少针对源极驱动器300的相对大的输出转变的数量，从而降低总体电能消耗。
实际上，可由等式1表示在源极驱动器300中包括的输出缓冲器301的动态功率：
P = 1 2 · C L o a d · V S u p p l y · V S w i n g · ( α · f 1 H ) - - - ( 1 )
其中，CLoad表示负荷电容器，VSupply表示施加到输出缓冲器301的供电电压，VSwing表示输出缓冲器301的动态摆动电压(即，在输出缓冲器301的输出的最大变化)，α表示输出缓冲器301的输出将转变的转变概率，f1H表示水平线频率。
可根据显示面板10的尺寸确定负荷电容器CLoad，可根据对比率确定供电电压VSupply，可根据显示面板10的伽马特性确定动态摆动电压VSwing，可根据显示面板10的类型、帧频及分辨率确定水平线频率f1H。根据显示面板10的特性，负荷电容器CLoad、供电电压VSupply、动态摆动电压VSwing及水平线频率f1H均可具有固定值。
可根据将在显示面板10上显示的图像的图案和针对栅极线的驱动顺序确定转变概率α。因此，可根据图像数据图案而改变栅极线选择的顺序，并由此可减少输出缓冲器301的转变概率。作为结果，可减少输出缓冲器301的动态功率和源极驱动器300的动态功率。另外，由于输出缓冲器301的动态功率和源极驱动器300的动态功率能被减少，因此，可减少当显示驱动器电路20驱动显示面板10时产生的热量。
在下文中，将参照图2至图16在一些附加细节中描述根据本发明构思的实施例的显示装置1000的操作。
图2是在一个示例中进一步示出图1的时序控制器100的框图。图3是示出根据本发明构思的实施例的时序控制器100的操作的一组相关示意图，图4是示出通过图2中示出的时序控制器100的存储器120的图像数据的流的概念图。
参照图1和图2，时序控制器100可包括存储器120以及选择控制逻辑单元110。
存储器120可被用于以帧为单位或以多条线为单位临时存储外部提供的图像数据DATA1，随后向源极驱动器300传递所述外部提供的图像数据DATA1。可选地，可向源极驱动器300提供重新格式化的图像数据DATA2(例如，响应于所述外部提供的图像数据DATA1而由时序控制器100在内部产生的图像数据)。存储器120可以是被配置为以帧为单位存储显示数据的图形随机存取存储器(图形RAM)或被配置为以线为单位存储显示数据的线缓冲器。存储器120可包括易失性存储器(诸如，动态RAM(DRAM)和静态RAM(SRAM))和/或非易失性存储器(诸如闪存)。存储器120可包括DRAM、相变RAM(PRAM)、磁性RAM(MRAM)、电阻RAM(ReRAM)、铁磁RAM(FRAM)、NOR闪存、NAND闪存或融合闪存(例如，在其中将SRAM缓冲器、NAND闪存或NOR接口逻辑单元组合的存储器)。
如上所述，选择控制逻辑单元110可被用于响应于图像数据DATA1的图案确定针对显示面板10的栅极线G1至Gn的驱动顺序。在这一方面，选择控制逻辑单元110将产生指示适当的驱动顺序的选择控制信号SHFL。将参照图3在一些附加细节中描述这一操作。
参照图3，图像数据DATA1的一个帧可包括与栅极线G1至Gn相应的图像数据(即，线数据D1至Dn)。线数据D1至Dn可分别包括与源极线S1至Sm分别相应的像素数据PD11至PD1m、PD21至PD2m...以及PDn1至PDnm。可将图像数据DATA1以帧为单位或以多个帧为单位存储在存储器120中。
选择控制逻辑单元110可被用于将与栅极线分别相应的图像数据部分进行比较，以便确定针对栅极线的驱动顺序。在一些实施例中，选择控制逻辑单元110可从存储器120中读取与栅极线G1至Gn相应的图像数据(即，线数据D1至Dn)并将线数据D1至Dn之间的数据差进行比较。例如，选择控制逻辑单元110可将与第一栅极线G1相应的第一线数据D1和与第二栅极线G2、第三栅极线G3及第四栅极线G4相应的第二线数据D2、第三线数据D3及第四线数据D4进行比较，以便计算第一比较值Diff1、第二比较值Diff2及第三比较值Diff3。
选择控制逻辑单元110可基于第一比较值Diff1、第二比较值Diff2及第三比较值Diff3确定针对第二栅极线G2、第三栅极线G3及第四栅极线G4的驱动顺序。例如，选择控制逻辑单元110可根据比较值的递增顺序(即，从最小的比较值开始的顺序)确定针对第二栅极线G2、第三栅极线G3及第四栅极线G4的驱动顺序。当第二比较值Diff2最小并且第三比较值Diff3最大时，选择控制逻辑单元110可确定以下驱动顺序：在第一栅极线G1被选择之后，选择第三栅极线G3，然后选择第二栅极线G2，然后选择第四栅极线G4。
在一些实施例中，当至少两个比较值彼此相等时，选择控制逻辑单元110可确定以下驱动顺序：从与所述至少两个比较值相应的栅极线中首选选择与比较参考栅极线(例如，第一栅极线G1)物理地相邻的栅极线中的一条。
选择控制逻辑单元110可向栅极驱动器200提供指示驱动顺序的选择控制信号SHFL，使得栅极驱动器200根据所确定的驱动顺序在多条栅极线G1至Gn之中进行选择。
可以多条栅极线为单位执行驱动顺序的确定。例如，如图3所示，可针对针对第一组的栅极线G2、G3及G4的驱动顺序，然后可确定针对第二组的栅极线G5、G6及G7的驱动顺序。在确定针对第二组的栅极线G5、G6及G7的驱动顺序的情况下，选择控制逻辑单元110可将与第二组的栅极线G5、G6及G7相应的线数据D5、D6及D7和与第一组的栅极线G2、G3及G4之中最后选择的栅极线相应的线数据Dk进行比较，并基于比较值确定针对第二组的栅极线G5、G6及G7的驱动顺序。
作为另一示例，可预先确定多条参考栅极线，并且可根据与所述多条参考栅极线的数据比较而设置针对在所述多条参考栅极线之后选择的多条栅极线的驱动顺序。例如，可预先设置针对第一栅极线G1和第五栅极线G5的驱动顺序，使得首先选择第一栅极线G1、第五个选择第五栅极线G5。可通过与第一栅极线G1的数据比较设置针对第二栅极线G2、第三栅极线G3及第四栅极线G4的选择顺序，可通过与第五栅极线G5的数据比较而设置针对第六栅极线G6、第七栅极线G7及第八栅极线G8的选择顺序。
按照这种方式，可重复进行确定针对以组为单位编组的栅极线的驱动顺序的处理，因此，可确定针对所有栅极线G1至Gn的完整驱动顺序。
在图2中，虽然以三条栅极线为单位确定针对栅极线的驱动顺序，但是这仅是示例并且本发明构思不限于此。可根据合理指定的组来确定针对栅极线的任何集合的驱动顺序，其中，每个组包括至少两条栅极线。
另外，虽然将与栅极线G1至Gn相应的线数据D1至Dn相互进行比较以计算比较值，但是本发明构思不限于此。在一些其它实施例中，可仅仅将在线数据D1至Dn中包括的一些像素数据相互进行比较。例如，可将第一栅极线G1的第一像素数据PD11和第m像素数据PD1m分别与第二栅极线G2的第一像素数据PD21和第m像素数据PD2m、第三栅极线G3的第一像素数据PD31和第m像素数据PD3m及第四栅极线G4的第一像素数据PD41和第m像素数据PD4m进行比较以计算比较值Diff1、Diff2及Diff3。在一些其它实施例中，第一像素数据至第m像素数据中的每一个像素数据可包括多个位(bit)，可将栅极线的像素数据的多个位中的一些高位和另一栅极线的多个比特中的高位进行比较以计算比较值Diff1、Diff2及Diff3。在其它实施例中，可将栅极线的像素数据的多个位中的全部位与另一栅极线的多个位中的全部位进行比较以计算比较值Diff1、Diff2及Diff3。
选择控制逻辑单元110可根据比较值Diff1、Diff2及Diff3而确定用于栅极线G1至Gn的驱动顺序。如图3所示，栅极线G1至Gn可相对于其有序排列而顺序或非顺序地被选择。在默认栅极线选择模式下，栅极线G1至Gn可相对于其有序排列而被顺序地选择。然而，在置乱栅极线模式下，栅极线G1至Gn可根据比较值Diff1、Diff2及Diff3，相对于其有序排列而被非有序地被选择。
返回参照图2，选择控制逻辑单元110还可被用于将用于在存储器120中存储的线数据D1至Dn的图像数据存储顺序或者用于从存储器120输出到图1的源极驱动器的300的线数据的图像数据输出顺序改变为与针对栅极线G1至Gn的驱动顺序一致。
参照图4，外部提供的图像数据DATA1可根据数据接收顺序而以线单位被存储在存储器120中。外部提供的图像数据DATA1可根据外部提供的图像数据DATA1在存储器120中存储的顺序而以线为单位(例如，以线数据D1至Dn为单位)传递到图1的源极驱动器300。然而，如参照图3所述，当针对栅极线G1至Gn的驱动顺序改变时，针对线数据D1至Dn的图像数据输出顺序(相应地输出到源极驱动器300)也将改变。如图4所示，选择控制逻辑单元110可将针对数据D1至Dn的图像数据存储顺序改变为与针对栅极线G1至Gn的驱动顺序相应。在图像数据存储顺序改变之后，可顺序访问第一地址ADDR1至第n地址ADDRn。因此，可根据针对栅极线G1至Gn的驱动顺序将线数据D1至Dn输出到源极驱动器300。
在一些其它实施例中，选择控制逻辑单元110可根据用于栅极线G1至Gn的驱动顺序而改变用于在存储器120中存储的线数据D1至Dn的图像数据输出顺序。可在第一地址ADDR1至第n地址ADDRn中存储线数据D1至Dn(即，第一线数据D1至第n线数据Dn)，选择控制逻辑单元110可控制存储器120以基于用于栅极线G1至Gn的驱动顺序访问第一地址ADDR1至第n地址ADDRn。例如，选择控制逻辑单元110可访问第一地址ADDR1使得将第一线数据D1输出到源极驱动器300，然后可访问第三地址ADDR3使得将第三线数据D3输出到源极驱动器300。因此，线数据D1至Dn(即，第一线数据D1至第n线数据Dn)可根据用于栅极线G1至Gn的驱动顺序而被输出到源极驱动器300。
在一些实施例中，选择控制逻辑单元110可根据不同模式而选择性地操作。例如，选择控制逻辑单元110的操作状态可根据用户定义的选择而被确定。例如，用户可阻止选择控制逻辑单元110的操作，或控制选择控制逻辑单元110使得仅以有序驱动顺序(例如，栅极线选择默认模式)选择栅极线G1至Gn。
在一些其它实施例中，当外部提供的图像数据DATA1是静止图像时，选择控制逻辑单元110可操作，而当外部提供的图像数据DATA1是运动图像时，选择控制逻辑单元110不会操作。就此而言，图像模式信号IMODE可被用于指示图像数据类型或图像数据来源。在一些实施例中，图像模式信号IMODE将与从外部提供的图像数据DATA1一起从外部产生并被提供。在一些其它实施例中，时序控制器100可分析接收到的图像数据DATA1并在内部产生图像模式信号IMODE。
当外部提供的图像数据DATA1是运动图像数据时，相邻栅极线之间的数据差可小于非相邻栅极线之间的数据差。因此，当外部提供的图像数据DATA1是运动图像数据时，可阻止选择控制逻辑单元110的操作并且可根据其有序排列而有序地选择栅极线G1至Gn。相反地，当外部提供的图像数据DATA1是静止图像时，根据特定的图像数据图案，相邻栅极线之间的数据差可大于非相邻栅极线之间的数据差。例如，在图像包括水平黑白条纹图案的情况下，相邻栅极线之间的数据差可具有最大值。因此，当外部提供的图像数据DATA1是静止图像数据时，选择控制逻辑单元110可执行栅极线选择控制操作。
在一些实施例中，当在多个帧时间段期间在图1的显示面板10上显示静止图像时，选择控制逻辑单元110可在所述多个帧时间段中的第一帧时间段执行针对图像数据DATA1的比较的计算操作。可在其它帧时间段中使用在第一帧时间段中产生的选择控制信号SHFL。因此，可减少用于数据比较的选择控制逻辑单元110的计算量。
图5是示出根据本发明构思的特定实施例的显示装置1000的操作方法的流程图。
显示装置1000的操作方法是设置针对栅极线G1至Gn的驱动顺序(或选择顺序)从而根据所设置的驱动顺序驱动显示面板10的方法。这里将参照先前有关图1、图2、图3及图4描述的主题。
参照图5，显示装置1000接收图像数据(S110)。可从外部(例如，主机处理器)接收图像数据。图像数据可存储在时序控制器100中包括的存储器(例如，图2的存储器120)或独立于时序控制器100而提供的存储器中。
然后，时序控制器100将与参考栅极线相邻的多条栅极线相应的图像数据部分和与参考栅极线相关联的图像数据部分(在下文中，称为“参考图像数据部分”)进行比较(S120)。例如，参考栅极线可以是显示面板10的第一栅极线或驱动顺序的多条栅极线中的具有预先部分选择的一条栅极线。作为另一示例，如果以组为单位执行与多条栅极线相应的图像数据部分的比较，则参考栅极线可以是被设置为在特定组中最后被选择的栅极线，其中，所述特定组在将确定其驱动顺序的栅极线的当前组之前。
时序控制器100可基于各个比较值确定用于多条栅极线的驱动顺序(S130)。时序控制器100可产生指示驱动顺序的选择控制信号并将选择控制信号提供给栅极驱动器200。
栅极驱动器200可响应于由选择控制信号指示的驱动顺序从多条栅极线之中进行选择(S140)。源极驱动器300可向源极线输出与所选择的栅极线相应的图像信号(即，灰度电压)(S150)。
图6是进一步示出根据本发明构思的实施例的图5的方法中包括的比较步骤(S120)和驱动顺序确定步骤(S130)的一个示例的流程图。参照图6，时序控制器100可被用于计算在与栅极线相关联的图像数据部分和参考图像数据部分之间的各个数据差(S210)。例如，假设使用与N条栅极线分别相应的N个图像数据部分，其中，‘N’是大于1的正整数，针对参考图像数据部分分别进行N个相同的比较，以便计算N个数据差别。
接着，时序控制器100可被用于确定用于多条栅极线的驱动顺序(或栅极线选择的顺序)，其中，所述驱动顺序与数据差的递增顺序(即，从最小的数据差开始的顺序)一致(S220)。如果与至少两条栅极线相应的比较值彼此相等，则时序控制器100可控制选择的顺序，使得在所述至少两条栅极线中的与参考栅极线物理地相邻的栅极线首先被选择。
图7是进一步示出根据本发明构思的实施例的在在图5的方法中包括的比较步骤(S120)和驱动顺序确定步骤(S130)的一个示例的流程图。
参照图7，时序控制器100可被用于计算在与栅极线相关联的图像数据部分和参考图像数据部分之间的各个数据差(S310)。因此，可计算相应多个数据差别。
然后，时序控制器100可确定在所述多个数据差之中的最大数据差是否等于或大于预定阈值(S320)。如果所述最大数据差等于或大于所述预定阈值(S320＝是)，则时序控制器100将根据所述多个数据差的递增顺序设置用于多个栅极线的非有序的驱动顺序(S330)。如果所述最大数据差小于所述预定阈值(S320＝否)，则时序控制器100将设置与有序排列一致的用于多个栅极线的依次驱动顺序，而不考虑计算出的多个数据差如何(S340)。
图8是示出根据本发明构思的实施例的时序控制器100的操作的流程图。
参照图8，时序控制器100接收外部提供的图像数据(S410)。然后，时序控制器100确定所述图像数据是否是静止图像数据(S420)。例如，时序控制器100可接收指示外部提供的图像数据的类型(或来源)的信号。这种信号可从外部提供或由时序控制器100在内部产生。例如，可通过将在帧之间的图像数据进行比较，而将外部提供的图像数据确定为静止图像数据或运动图像数据。
当所述图像数据被确定为静止图像数据(S420＝是)时，时序控制器100使用选择控制逻辑单元110来进行操作(S430)，选择控制逻辑单元110可将与栅极线或栅极线组相关联的各种图像数据部分进行比较，以便设置用于栅极线的驱动顺序。然而，当外部提供的图像数据被确定为运动图像数据(S420＝否)时，时序控制器100阻止选择控制逻辑单元110的操作，并设置用于栅极线的依次驱动顺序。
图9A、图9B及图9C是不同地示出针对图1的栅极驱动器200的实施示例的框图。
参照图9A，栅极驱动器200a可包括移位寄存器210、多路转换器220a、电平移位器230及输出缓冲器240。
移位寄存器210可基于垂直开始信号STV和栅极时钟信号CPV而顺序地产生多个移位脉冲。由移位寄存器210产生的移位脉冲的数量可等于栅极线G1至Gn的数量。可从移位寄存器210的多个输出端子O1至On顺序地输出所述多个移位脉冲。
电平移位器230可对所施加的移位脉冲的电压电平进行移位。输出缓冲器240可基于从电平移位器230输出的电平移位后的移位脉冲来产生多个扫描脉冲并将多个扫描脉冲提供给栅极线G1至Gn。
多路转换器220a可响应于选择控制信号SHFL而设置在移位寄存器210的多个输出和电平移位器230的多个输入之间的连接关系。在一些实施例中，多路转换器220a可包括多个多路转换器221a至22ja。多个多路转换器221a至22ja可响应于选择控制信号SHFL而设置在移位寄存器210的N个输出和电平移位器230的N个输入之间的连接关系。
如图9A所示，多个多路转换器221a至22ja中的每个多路转换器可以是连接到移位寄存器210的两个输出和电平移位器230的两个输入的2×2多路转换器。可响应于选择控制信号SHFL改变在各个多路转换器221a至22ja的输入和各个多路转换器221a至22ja的输出之间的连接。选择控制信号SHFL可以是一位数据并具有低电平或高电平。
由于多路转换器220a包括多个多路转换器221a至22ja，因此，选择控制信号SHFL可包括与多个多路转换器221a～22ja分别相应的第一选择控制信号SHFL1至第j选择控制信号SHFLj，并且可通过时间共享方法接收第一选择控制信号SHFL1至第j选择控制信号SHFLj，然后提供给多个多路转换器221a～22ja。
按照这种方式，由于多路转换器220a响应于选择控制信号SHFL控制移位寄存器210的多个输出和电平移位器230的多个输入之间的连接关系，因此可根据所设置的顺序而选择栅极线G1至Gn。
如图9B所示，与多路转换器220a相应的多路转换器220b可包括多个3×3多路转换器221b至22ib。另外，如图9C所示，与多路转换器220a相应的多路转换器220c可包括(N×N)多路转换器。
参照图9B，多个多路转换器221b至22ib中的每个多路转换器连接到移位寄存器210的三个输出和电平移位器230的三个输入并控制移位寄存器210的三个输出和电平移位器230的三个输入之间的连接关系。在这种情况下，选择控制信号SHFL可以是包括多个位的数据，并且可根据选择控制信号SHFL的数据值而改变多路转换器221b至22ib的输入和多路转换器221b至22ib的输出之间的连接。
参照图9C，多路转换器230c可包括一个(N×N)多路转换器。在这种情况下，‘N’是大于2且小于n的整数，‘n’是栅极线G1至Gn的数量。
虽然在图9A、图9B及图9C中未示出，但是多路转换器220a、多路转换器220b及多路转换器220c中的每一个多路转换器可包括具有不同数量的输入和不同数量的输出的不同种类的多路转换器。
虽然栅极驱动器200a、200b及200c的配置和操作已参照图9A、图9B及图9C进行了上述描述，但是不限于此。可参照图9A、图9B及图9C不同地改变栅极驱动器200a、200b及200c的配置和操作。
图10、图11A、图11B及图11C是根据本发明构思的实施例的在一些附加细节中描述图1的显示装置1000的操作方法的示图。图10示出黑白条纹图案。图11A、图11B及图11C均示出当显示装置1000显示图10的图像图案(即，黑白条纹图案)时信号的波形。
为了简洁，假设显示面板10包括按照8行8列排列的像素。另外，假设显示面板10是列反转的(column-inverted)，将正信号施加到奇数源极线，将负信号施加到偶数源极线。在这种情况下，正信号表示具有比等同地施加到像素PX的共用电压Vcom的电压电平高的电压电平的灰度电压，负信号表示具有比共用电压Vcom的电压电平低的电压电平的灰度电压。
参照图10，黑色图像和白色图像以栅极线为单位交替重复。在黑色图像和白色图像交替重复的图案的情况下，源极驱动器300的输出可在最小灰度电压和最大灰度电压之间转变。换言之，源极驱动器300的输出可以以最大幅度摆动。
当根据排列的顺序而顺序地选择并驱动栅极线时，源极驱动器300的输出可转变八次。参照等式1，可由等式2表示在源极驱动器300中包括的图1的输出缓冲器301的动态功率：
P = 1 2 · C L o a d · V S u p p l y · V S w i n g · ( 1 · f 1 H ) - - - ( 2 )
由于输出缓冲器301的输出针对每条栅极线以最大幅度摆动，因此转变概率可以是1并且可使动态功率的输出最大化。
参照图11A，用于第一栅极线G1至第八栅极线G8的驱动顺序可响应于由一位构成的选择控制信号SHFL而以两条栅极线为单位改变。参照图10，奇数栅极线G1、G3、G5及G7与黑色图像相应，偶数栅极线G2、G4、G6及G8与白色图像相应。在选择第一栅极线G1之后，可首先选择在第二栅极线G2和第三栅极线G3之中具有与第一栅极线G1相同的图像数据的第三栅极线G3。在第二水平线时间段H2中，图像信号的改变不在源极线S1和S2发生。由于在第二水平线时间段H2之后选择与白色图像相应的第二栅极线G2，图像信号的改变在源极线S1和S2发生。因此，图1的源极驱动器300的输出转变。
由于以两条栅极线为单位设置针对第一栅极线G1至第八栅极线G8的驱动顺序，所以以两条水平线为单位交替显示黑色图像和白色图像，因此，源极驱动器300的输出可转变四次。因此，转变概率可以是0.5，因此，在源极驱动器300中包括的输出缓冲器301的动态功率可以是最大值的一半。
参照图11B，可响应于由多个位构成的选择控制信号SHFL而以四条栅极线为单位改变针对第一栅极线G1至第八栅极线G8的驱动顺序。在选择第一栅极线G1之后，可首先选择在第二栅极线G2至第五栅极线G5之中均具有与第一栅极线G1相同的图像数据的第三栅极线G3和第五栅极线G5。在第二水平线时间段H2和第三水平线时间段H3中，图像信号的改变不在源极线S1和S2发生。由于在第二水平线时间段H2和第三水平线时间段H3之后选择与白色图像相应的第二栅极线G2和第四栅极线G4，图像信号的改变在源极线S1和S2发生。因此，源极驱动器300的输出转变。
由于以四条栅极线为单位设置针对第一栅极线G1至第八栅极线G8的驱动顺序，所以源极驱动器300的输出可转变两次。因此，转变概率可以是0.25，因此，在源极驱动器300中包括的输出缓冲器301的动态功率可以是最大值的1/4。
参照图11C，可响应于由多个位构成的选择控制信号SHFL同时改变针对第一栅极线G1至第八栅极线G8的驱动顺序。在选择第一栅极线G1之后，可首先选择在第二栅极线G2至第八栅极线G8之中均具有与第一栅极线G1相同的图像数据的第三栅极线G3、第五栅极线G5及第七栅极线G7。在第二水平线时间段H2、第三水平线时间段H3及第四水平线时间段H4中，图像信号的改变不在源极线S1和S2发生。由于在第二水平线时间段H2、第三水平线时间段H3及第四水平线时间段H4之后选择与白色图像相应的第二栅极线G2，因此在第五水平线时间段H5中图像信号的改变在源极线S1和S2发生。因此，源极驱动器300的输出转变。
由于以八条栅极线为单位设置针对第一栅极线G1至第八栅极线G8的驱动顺序，所以源极驱动器300的输出可转变一次。因此，转变概率可以是0.125，因此，在源极驱动器300中包括的输出缓冲器301的动态功率可以是最大值的1/8。
图12A和图12B是示出图1的显示面板10的可行的实施例的示图。图12A示出直线型面板，图12B示出Z字型面板。
参照图12A，显示面板10a可以是在同一列中排列的多个像素PX连接到同一源极线的直线型面板。如果按照列反转(column inversion)方法驱动显示面板10a，则可将正信号施加到奇数源极线S1和S3并可将负信号施加到偶数源极线S2和S4。
参照图12B，显示面板10b可以是在同一列中布置的多个像素PX连接到在像素PX的两侧排列的两条源极线中的一条源极线的Z字型面板。因此，即使从图1的源极驱动器300中输出的信号的极性未被改变，可按照点反转(dot inversion)方法驱动显示面板10b。
图13是示出根据示例性实施例的当显示面板10a是直线型面板时时序控制器的操作方法的流程图。
参照图13，可以以两条栅极线为单位控制用于栅极线的驱动顺序，并且可以以像素为单位将多条数据相互进行比较。
P(m,n)是在存储器(例如，图12的存储器120)中的第n行、第m列中排列的存储器单元中存储的像素数据。最初(例如，在通过设置针对栅极线的驱动顺序而执行像素数据的重新排列之前)，P(m,n)表示指示第n条栅极线的第m个像素的像素数据。
对与相邻栅极线相关联的多个像素数据部分相互进行比较，以计算各个比较值(S510)。可将P(m,n+1)和P(m,n)之间的数据差计算为第一比较值Diff1，可将在P(m,n+2)和P(m,n)之间的数据差计算为第二比较值Diff2。
确定第一比较值Diff1是否大于第二比较值Diff2(S520)。如果确定第一比较值Diff1大于第二比较值Diff2，则可将选择控制信号SHFL(n)设置为第二逻辑电平(例如，逻辑高电平)(S530)。如果确定第一比较值Diff1不大于第二比较值Diff2，则可将选择控制信号SHFL(n)设置为第一逻辑电平(例如，逻辑低电平)(S540)。如果将选择控制信号SHFL(n)设置为第二逻辑电平，则非有序地驱动栅极线，因此，可将多条像素数据的存储顺序改变为与用于栅极线的驱动顺序相应(S550)。在一些实施例中，可将P(m,n+1)存储在虚设单元中，可将P(m,n+2)存储在与P(m,n+1)相应的存储器单元中。可将在虚设单元中存储的数据再次存储在与P(m,n+2)相应的存储器单元中，因此，可重新排列所述多条像素数据。
可通过将m与n分别与指示显示面板(例如，图1的显示面板10)的分辨率的M与N进行比较来确定是否针对所有栅极线设置了驱动顺序，其中，‘M’是显示面板的水平分辨率，‘N’是显示面板的垂直分辨率(S560)。如果m与n分别小于M与N，则确定未完成针对栅极线的选择顺序的设置，因此，将n增加2(S570)，并且针对第n+2行适当地执行操作S510至操作S550。可通过重复这类处理来设置针对所有栅极线的驱动顺序，因此可在存储器120中重新排列像素数据。
图14是示出根据本发明构思的示例性实施例的当显示面板10a是Z字型面板时时序控制器的操作方法的流程图。
参照图14，可以两条栅极线为单位控制针对栅极线的驱动顺序，并且可使用(例如)限定的像素单位将多条数据进行比较。
在Z字型面板的情况下，对像素数据进行比较的方法根据P(m,n)是奇数行的像素数据还是偶数行的像素数据而变化。因此，必须确定第n行是奇数行还是偶数行(S610)。
如果确定第n行是奇数行，则对在相邻栅极线之间的多条像素数据相互进行比较以计算比较值(S621)。具体而言，如果确定第n行是奇数行，则可将P(m+1,n+1)与P(m,n)之间的数据差计算为第一比较值Diff1，并且将P(m,n+2)与P(m,n)之间的数据差计算为第二比较值Diff2。
确定第一比较值Diff1是否大于第二比较值Diff2(S631)。如果确定第一比较值Diff1大于第二比较值Diff2，则可将选择控制信号SHFL(n)设置为第二逻辑电平(例如，逻辑高电平)(S642)。如果确定第一比较值Diff1不大于第二比较值Diff2，则可将选择控制信号SHFL(n)设置为第一逻辑电平(例如，逻辑低电平)(S641)。如果将选择控制信号SHFL(n)设置为第二逻辑电平，则非有序地驱动栅极线，因此，可将针对各条像素数据的图像数据存储顺序改变为与针对栅极线的驱动顺序相应(S651)。在一些实施例中，可将P(m+1,n+1)存储在虚设单元中，可将P(m,n+2)存储在与P(m+1,n+1)相应的存储器单元中。可将在虚设单元中存储的数据再次存储在与P(m,n+2)相应的存储器单元中，因此，可重新排列像素数据部分。
如果确定第n行是偶数行，则对在相邻栅极线之间的像素数据部分相互进行比较，以计算比较值(S622)。具体而言，如果确定第n行是偶数行，则可将P(m-1,n+1)与P(m,n)之间的数据差计算为第一比较值Diff1，并且将P(m,n+2)与P(m,n)之间的数据差计算为第二比较值Diff2。
确定第一比较值Diff1是否大于第二比较值Diff2(S632)。如果确定第一比较值Diff1大于第二比较值Diff2，则可将选择控制信号SHFL(n)设置为第二逻辑电平(例如，逻辑高电平)(S643)。如果确定第一比较值Diff1不大于第二比较值Diff2，则可将选择控制信号SHFL(n)设置为第一逻辑电平(例如，逻辑低电平)(S641)。如果将选择控制信号SHFL(n)设置为第二逻辑电平，则非有序地驱动栅极线，因此，可将像素数据存储顺序改变为与针对栅极线的驱动顺序相应(S652)。在一些实施例中，可将P(m-1,n+1)存储在虚设单元中，可将P(m,n+2)存储在与P(m+1,n+1)相应的存储器单元中。可将在虚设单元中存储的数据再次存储在与P(m,n+2)相应的存储器单元中，因此，可重新排列像素数据部分。
接下来，确定是否针对所有栅极线已经设置了驱动顺序(S661)。如果m与n分别小于M与N，则确定未完成针对栅极线的选择顺序的设置，因此，将n增加2(S671)并且针对第n+2行执行操作S610至操作S651。可通过重复这样的处理来设置针对所有栅极线的驱动顺序，因此，可在存储器120中重新排列像素数据。
图15是示出图1的栅极驱动器200的另一实施示例的框图。
参照图15，栅极驱动器200d可包括移位寄存器210、多路转换器220d、电平移位器230以及输出缓冲器240。
图15的移位寄存器210、多路转换器220d、电平移位器230及输出缓冲器240的操作类似于图9A和图9B的移位寄存器210、多路转换器220a或220c、电平移位器230及输出缓冲器240的操作。然而，在图15中，移位寄存器210的输出O1至On中的一些输出O1、O6、O11…可直接连接到电平移位器230的相应输入I1、I6、I8…，而不用经过多路转换器221d和222d。在这种情况下，图1的选择控制逻辑单元110可将第一栅极线G1和第六栅极线G6设置为参考栅极线，对与第二栅极线G2至第五栅极线G5相应的图像数据和与第一栅极线G1相应的图像数据进行比较，对与第七栅极线G7至第十栅极线G10相应的图像数据和与第六栅极线G6相应的图像数据进行比较，并基于比较结果产生选择控制信号SHFL。可顺序地执行或并行执行针对包括多个栅极线的组(例如，包括第二栅极线G2至第五栅极线G5的第一组、包括第七栅极线G7至第十栅极线G10的第二组)的选择控制操作。当并行执行选择控制操作时，可减少设置针对多条栅极线的驱动顺序所需的时间。
在图15中，虽然多路转换器221d和222d是4×4多路转换器，但是本发明构思不限于此。多路转换器221d和222d可以是N×N多路转换器，其中，‘N’是大于1且小于n/2的整数。
图16示出当包括图15的栅极驱动器200a的显示装置1000显示图10的图像图案时信号的波形。
参照图16，可响应于由多个位构成的选择控制信号SHFL，以四条栅极线为单位改变针对第一栅极线G1至第八栅极线G8的驱动顺序。可预先将第一栅极线G1和第六栅极线G6分别设置为首先被选择和第六个被选择。可基于与第一栅极线G1的图像数据比较的结果来设置针对第二栅极线G2至第五栅极线G5的驱动顺序。另外，可基于与第六栅极线G6的图像数据比较的结果设置针对第七栅极线G7至第十栅极线G10的驱动顺序。在选择第一栅极线G1之后，在第二栅极线G2至第五栅极线G5之中具有与第一栅极线相同的图像数据的第三栅极线G3和第五栅极线G5可首先被选择。在第二水平线时间段H2和第三水平线时间段H3中，图像信号的改变不在源极线S1和S2发生。由于在第三水平线时间段H3之后选择与白色图像相应的第二栅极线G2，因此在第四水平线时间段H4中，图像信号的改变在源极线S1和S2发生。因此，图1的源极驱动器300的输出转变。
在第五个选择第四栅极线G4之后，可选择第六栅极线G6。接下来，可选择具有与第六栅极线G6相同的图像数据的第八栅极线G8和第十栅极线(未示出)。然后，由于选择与黑色图像相应的第七栅极线G7，因此在第九水平线时间段H9中，图像信号的改变可在源极线S1和S2发生。
图17是示出根据示例性实施例的包括显示装置1000的显示模块的实施示例的示图。
在图17的显示模块中，可通过多个半导体芯片实施显示驱动器电路(即，图1的显示驱动器电路20)。具体而言，可通过多个源极驱动芯片310实施源极驱动器(即，图1的源极驱动器300)，可通过多个栅极驱动芯片210实施栅极驱动器(即，图1的栅极驱动器200)。可通过一个半导体芯片或多个半导体芯片实施时序控制器100(即，图1的时序控制器100)。
多个源极驱动芯片310和多个栅极驱动芯片210可安装在膜1上并且连接到显示面板10。多个源极驱动芯片310可连接到显示面板10的上部或下部。多个栅极驱动芯片210可连接到显示面板10的左部或右部。
时序控制器100可安装在印刷电路板2上并且时序控制器100通过连接器3和印刷电路板2向多个源极驱动芯片310和多个栅极驱动芯片210发送信号。时序控制器100包括选择控制逻辑110。选择控制逻辑110可通过对与栅极线单元相关联的图像数据部分进行比较来选择针对栅极线的驱动顺序并产生指示选择的顺序的选择控制信号SHFL。时序控制器100将选择控制信号SHFL提供给多个栅极驱动芯片210。
可将图17的显示模块安装在中等尺寸或大尺寸的电子装置(诸如电视机、监视器及电子公告栏)上。
图18是示出根据示例性实施例的包括显示装置1000的显示模块的另一实施示例的示图。
在图18的显示模块中，可通过单个半导体芯片IC或多个半导体芯片IC实施显示驱动器电路(即，图1显示驱动器电路20)。可按照玻璃覆晶封装(COG)形式将集成显示驱动器电路(例如，时序控制器100、栅极驱动器200及源极驱动器300)的半导体芯片IC安装在形成有显示面板10的下基板12上。可经由在下基板12上图案化的互连线向显示面板10提供从半导体芯片IC输出的信号(例如，源极线驱动信号和栅极线驱动信号)。时序控制器100可通过对与栅极线单元相关联的图像数据部分进行比较来选择针对栅极线的驱动顺序并产生指示选择顺序的选择控制信号SHFL。时序控制器100将选择控制信号SHFL提供给栅极驱动器200。
可将图18的显示模块安装在小尺寸或中等尺寸的电子装置(诸如智能电话、平板PC及智能手表)上。
图19是示出根据本发明构思的实施例的触摸屏模块2000的示图。
参照图19，触摸屏模块2000可包括显示装置1000、偏光板(polarizingplate)2010、触摸面板2030、触摸控制器2040及窗口玻璃2020。显示装置1000可包括显示面板1010、印制板1020及显示驱动器电路1030。在图19中示出的显示装置1000可以是参照图1至图16描述的根据示例性实施例的显示装置1000。
窗口玻璃2020由丙烯醛基或增强玻璃形成以保护触摸屏模块2000抵抗外部冲击或由重复触摸造成的刮擦。可提供偏振板2010以便改善显示面板1010的光学特性。可通过对在印制板1020上的透明电极进行图案化来形成显示面板1010。显示面板1010可包括用于显示帧的多个像素。在示例性实施例中，显示面板1010可以是液晶面板。然而，本发明构思不限于此。显示面板1010可包括各种显示装置。例如，显示面板1010可以是从以下项中选择的一个：有机发光二极管(OLED)、电致变色显示器(ECD)、数字镜装置(DMD)、制动镜装置(AMD)、光栅光阀(GLV)、等离子显示面板(PDP)、电致发光显示器(ELD)、发光二级管(LED)显示器以及真空荧光显示器(VFD)。
显示驱动器电路1030可包括根据上述示例性实施例的显示驱动器电路20。为了方便起见，根据当前的示例性实施例，将显示驱动器电路1030示出为一个芯片。然而，显示驱动器电路1030可由多个芯片构成。另外，可将显示驱动器电路1030安装在玻璃覆晶封装(COG)型的玻璃印制板上。然而，以上仅是示例性实施例。可将显示驱动器电路1030安装在各种类型(诸如薄膜覆晶封装(COF)及板上芯片封装(COB))的玻璃印制板上。
如上所述，触摸屏模块2000可包括触摸面板2030和触摸控制器2040。可通过对在玻璃基板或聚对苯二甲酸乙二酯(PET)膜上的透明电极(诸如氧化铟锡(ITO))进行图案化来形成触摸面板2030。在实施例中，可在显示面板1010上形成触摸面板2030。例如，可将触摸面板2030的像素与显示面板1010的像素合并。触摸控制器2040感测在触摸面板2030上的触摸的产生、计算触摸坐标并向主机(未示出)发送计算出的触摸坐标。可将触摸控制器2040与显示驱动器电路1030集成到一个半导体芯片中。
图20是根据本发明构思的实施例的包括显示装置1000的电子系统3000的框图。
参照图20，可将电子系统3000实施为可使用或支持MIPI接口的数据处理设备，例如，移动电话、PDA、PMP或智能电话。
电子系统3000包括应用处理器3110、图像传感器3140及显示装置3150。显示装置3150可以是根据上述实施例的显示装置1000。
在应用处理器3110中实施的相机串行接口(CSI)主机3112可通过CSI与图像传感器3140的CSI装置3141进行串行通信。在这种情况下，例如，可在CSI主机3112中实施光学解串器，并且在CSI装置3141中实施光学串化器。
在应用处理器3110中实施的显示串行接口DSI主机3111可通过DSI与显示器3150的DSI装置3151进行串行通信。在这种情况下，例如，可在DSI主机3111中实施光学串化器，并且在DSI装置3151中实施光学解串器。
电子系统3000可还包括可与应用处理器3110进行通信的射频(RF)芯片3160。根据MIPI DigRF接口，电子系统3000的物理层协议(PHY)3113和RF芯片3160的PHY 3160可向彼此发送数据并从彼此接收数据。
电子系统3000可还包括：全球定位系统(GPS)3120、存储器3170、麦克风3180、动态随机存取存储器(DRAM)3785以及扬声器3190并且可通过使用Wimax 3230、无线局域网(WLAN)3220及超宽带(UWB)3210进行通信。
图21是根据示例性实施例的显示系统4000的框图。
参照图21，显示系统4000可包括电连接到系统总线4010的处理器4020、显示装置4050、外围装置4030以及存储器4040。
处理器4020控制外围装置4030、存储器4040及显示装置4050的数据的输入和输出并且可处理在所述装置之间发送的数据。显示装置4050包括显示面板DP和显示驱动器电路DRVC，并将通过系统总线4010施加的图像数据存储在显示驱动器电路DRVC中包括的帧存储器或线存储器(line memory)中，并且在显示面板DP上显示存储的图像数据。显示装置4050可以是图1的显示装置1000。显示驱动器电路DRVC可包括图1的显示驱动器电路20。
外围装置4030可以是用于将相机、扫描仪及web相机的运动图像或静止图像转换为电信号的装置。通过外围装置4030获得的图像数据可存储在存储器4040中或可实时显示在显示装置4050的面板上。存储器4040可包括易失性存储器(诸如动态随机存取存储器(DRAM))和/或非易失性存储器(诸如闪存)。存储器4040可以是DRAM、参数RAM(PRAM)、磁阻RAM(MRAM)、电阻RAM(ReRAM)、铁电RAM(FRAM)、NOR闪存、NAND闪存或融合闪存(例如，通过将静态RAM(SRAM)缓冲器、NAND闪存或NOR接口逻辑单元组合获得的存储器)。存储器4040存储由外围装置4030获得的图像数据或可存储由处理器4020处理的图像信号。
可在电子产品(诸如平板PC或TV)中提供根据当前示例性实施例的显示系统4000。然而，本发明构思不限于此。可在显示图像的各种电子产品中提供显示系统4000。
虽然已经参照本发明构思的实施例具体示出并描述本发明构思，但是将理解：在不脱离权利要求的范围的情况下，可在其中做出形式和细节方面的各种改变。

Claims (23)

1.一种显示驱动器电路，包括：
栅极驱动器，被配置为根据驱动顺序选择并驱动显示面板的多条栅极线，其中，所述多条栅极线按照特定顺序排列在显示面板内；
源极驱动器，被配置为将与所选择的栅极线相应的图像数据转换为图像信号并将图像信号输出到显示面板的源极线；以及
时序控制器，被配置为通过对与所述多条栅极线中的第一栅极线相应的第一图像数据部分与所述多条栅极线中的N条栅极线分别相应的N个图像数据部分分别进行比较来计算N个比较值，并且还被配置为根据所述N个比较值而设置用于所述N条栅极线的驱动顺序，其中，N是等于或大于2的整数。
2.如权利要求1所述的显示驱动器电路，其中，时序控制器还被配置为从所述N个比较值中选择最大比较值，
将最大比较值与阈值进行比较，以及
在确定最大比较值不大于所述阈值时，将用于所述N条栅极线的驱动顺序设置为与所述N条栅极线的排列顺序一致的有序驱动顺序，而不管所述N个比较值中的各个值如何。
3.如权利要求1所述的显示驱动器电路，其中，时序控制器还被配置为从所述N个比较值中选择最大比较值，
将最大比较值与阈值进行比较，以及
在确定最大比较值大于所述阈值时，根据所述N个比较值中的各个值，将用于所述N条栅极线的驱动顺序设置为与所述N条栅极线的排列顺序不一致的非有序驱动顺序。
4.如权利要求3所述的显示驱动器电路，其中，时序控制器还被配置为按照从最小比较值开始并延伸到最大比较值的递增顺序排列所述N个比较值的各个值，以及
根据N个比较值的递增顺序设置非有序的驱动顺序。
5.如权利要求1所述的显示驱动器电路，其中，时序控制器还被配置为产生指示针对所述多条栅极线的驱动顺序的选择控制信号并将选择控制信号提供给栅极驱动器。
6.如权利要求1所述的显示驱动器电路，其中，时序控制器包括：选择控制逻辑单元，被配置为对第一图像数据部分和所述N个图像数据部分中的每一个图像数据部分分别进行比较并产生指示用于所述N条栅极线的驱动顺序的选择控制信号。
7.如权利要求6所述的显示驱动器电路，其中，时序控制器还被配置为接收外部提供的图像数据，确定外部提供的图像数据是否是静止图像数据，并且在确定外部提供的数据不是静止图像数据时，阻止选择控制逻辑单元的操作并将用于所述N条栅极线的驱动顺序设置为与所述N条栅极线的排列顺序一致的有序驱动顺序，而不管所述N个比较值的各个值如何。
8.如权利要求6所述的显示驱动器电路，其中，时序控制器还被配置为接收外部提供的图像数据，确定外部提供的图像数据是否是静止图像数据，并且在确定外部提供的数据是静止图像数据时，使用选择控制逻辑单元以根据所述N个比较值的各个值将用于所述N条栅极线的驱动顺序设置为与所述N条栅极线的排列顺序不一致的非有序的驱动顺序。
9.如权利要求8所述的显示驱动器电路，其中，时序控制器还被配置为按照从最小比较值开始并延伸到最大比较值的递增顺序排列所述N个比较值的各个值，以及
根据所述N个比较值的递增顺序设置所述非有序驱动顺序。
10.如权利要求3所述的显示驱动器电路，其中，时序控制器还被配置为按照从最小比较值到最大比较值的递增顺序排列所述N个比较值的各个值，并且根据所述递增顺序设置所述非有序驱动顺序。
11.如权利要求10所述的显示驱动器电路，其中，时序控制器向栅极驱动器顺序地提供指示所述N条栅极线的选择顺序的第一选择控制信号和指示其它N条栅极线的选择顺序的第二选择控制信号。
12.如权利要求10所述的显示驱动器电路，其中，在确定所述N个比较值中的与所述N条栅极线之中的第二栅极线和第三栅极线分别相应的两个比较值相等时，时序控制器还被配置为在非有序驱动顺序中将第二栅极线和第三栅极线中的一个栅极线分配在比第二栅极线和第三栅极线中的另一栅极线更靠前的位置，其中，在有序排列中，第二栅极线和第三栅极线中的所述一条栅极线比第二栅极线和第三栅极线中的所述另一栅极线更靠近第一栅极线。
13.如权利要求1所述的显示驱动器电路，其中，栅极驱动器包括：
移位寄存器，被配置为产生多个移位脉冲；
电平移位器，被配置为对所述多个移位脉冲的电压电平进行移位并输出具有移位的电压电平的信号；
输出缓冲器，被配置为基于从电平移位器输出的信号产生多个扫描脉冲并向所述多条栅极线提供多个扫描脉冲；以及
多路转换器，被配置为从时序控制器接收指示用于所述多条栅极线的驱动顺序的选择控制信号并响应于所述选择控制信号设置移位寄存器的多个输出与电平移位器的多个输入之间的连接关系。
14.如权利要求13所述的显示驱动器电路，其中，所述选择控制信号包括被顺序地提供给多路转换器的第一选择控制信号和第二选择控制信号，
多路转换器包括：
第一多路转换器，被配置为响应于第一选择控制信号而设置移位寄存器的N个输出和电平移位器的N个输入之间的连接关系；以及
第二多路转换器，被配置为响应于第二选择控制信号而设置移位寄存器的其它N个输出和电平移位器的其它N个输入之间的连接关系。
15.一种用于响应于图像数据而驱动显示面板的多条栅极线以在显示面板上显示图像的栅极驱动器，所述栅极驱动器包括：
移位寄存器，产生多个移位脉冲；
电平移位器，对所述多个移位脉冲的电压电平进行移位并输出具有被移位的电压电平的信号；
输出缓冲器，向所述多条栅极线提供从电平移位器中输出的信号；以及
多路转换器，响应于根据针对图像数据确定的图像数据图案而变化的选择控制信号，而设置移位寄存器的多个输出与电平移位器的多个输入之间的连接关系。
16.如权利要求15所述的栅极驱动器，其中，多路转换器包括连接到移位寄存器的N个输出和电平移位器的N个输入的N×N多路转换器，其中，N是大于或等于2的整数。
17.如权利要求15所述的栅极驱动器，其中，所述选择控制信号包括被顺序地提供给多路转换器的第一选择控制信号和第二选择控制信号，
多路转换器包括：响应于第一选择控制信号而操作的第一多路转换器和响应于第二选择控制信号而操作的第二多路转换器。
18.如权利要求17所述的栅极驱动器，其中，第二选择控制信号在第一多路转换器向电平移位器发送N个移位脉冲之后被接收。
19.如权利要求15所述的栅极驱动器，其中，所述选择控制信号是包括多个位的数字信号。
20.一种驱动在显示装置中的多条栅极线的方法，其中，所述多条栅极线按照特定顺序排列，所述方法包括：
接收图像数据；
确定所述图像数据是否包括第一图像图案；
在确定所述图像数据包括第一图像图案时，响应于第一图像图案，按照与排列顺序不一致的非有序驱动顺序来驱动所述多条栅极线，否则，按照与排列顺序一致的有序驱动顺序驱动所述多条栅极线。
21.如权利要求20所述的方法，其中，在图像数据中的第一图像图案的所述确定指示所述图像数据是静止图像数据。
22.如权利要求21所述的方法，其中，所述显示装置包括：包含时序控制器和栅极驱动器的显示驱动器电路，并且所述方法还包括：
在时序控制器中接收图像数据；
在时序控制器中确定所述图像数据是否包括第一图像图案；
响应于所述图像数据是否包括第一图像图案的确定，在时序控制器中产生选择控制信号；以及
向栅极驱动器提供所述选择控制信号。
23.如权利要求22所述的方法，其中，所述接收到的图像数据具有第一格式，显示驱动器电路还包括源极驱动器，并且所述方法还包括：
在时序控制器中将所述接收到的图像数据转换为具有不同于第一格式的第二格式的图像数据；以及
向源极驱动器提供所述转换后的图像数据。
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