CN105869593B - 一种显示面板及其栅极驱动电路 - Google Patents

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Abstract

本发明公开了一种显示面板及其栅极驱动电路。该栅极驱动电路包括多级栅极驱动单元，每级栅极驱动单元包括：第二拉动控制信号的频率小于第一时钟信号的频率，并且大于显示面板的刷新频率。通过以上方式，本发明能够有效防止栅极驱动单元的薄膜晶体管特性的漂移，提高栅极驱动单元的信赖性。

Description

一种显示面板及其栅极驱动电路
技术领域
本发明涉及液晶显示技术领域，特别是涉及一种显示面板及其栅极驱动电路。
背景技术
阵列基板行驱动(GOA，Gate Driver On Array或Gate On Array)电路，是利用现有薄膜晶体管显示装置(TFT-LCD)阵列(Array)制程将栅线(Gate)行扫描驱动信号电路制作在阵列基板上，以实现对栅线逐行扫描的驱动方式的一项技术。其与传统的柔性电路板(COF)和玻璃电路板(COG)工艺相比，不仅节省了制作成本，而且还可以省去栅极方向邦定(Bonding)的工艺，对提升产能极为有利，并提高了显示装置的集成度。
在实际使用时，每级GOA电路均设计相应的辅助下拉电路，通常为两组辅助下拉电路，两组辅助下拉电路在不同的时间段内交替工作，以对GOA电路中的Q点和栅极驱动信号进行下拉。目前辅助下拉电路包括两种切换频率，一种切换频率与时钟信号的频率相同，另一种切换频率为每隔若干帧的时间切换一次。若切换频率与时钟信号的频率相同，则GOA电路的薄膜晶体管收到高频的压力；若切换频率为每隔若干帧的时间切换一次，则GOA电路的薄膜晶体管收到低频的压力，造成GOA电路工作异常。
发明内容
本发明主要解决的技术问题是提供一种显示面板及其栅极驱动电路，以解决上述问题。
本发明提供一种栅极驱动电路，其包括多级栅极驱动单元，每级栅极驱动单元包括：
第一拉动控制单元，用于在第一节点输出第一拉动控制信号；
第一拉动单元，其耦接第一节点，接收第一时钟信号，根据第一拉动控制信号和第一时钟信号生成栅极驱动信号，栅极驱动信号输出端输出栅极驱动信号；
第二拉动控制单元，用于接收第一信号、第二信号、第三信号和第四信号，根据第一信号、第二信号、第三信号和第四信号输出第二拉动控制信号；
第二拉动单元，其耦接第一节点和栅极驱动信号输出端，接收第二拉动控制信号，根据第二拉动控制信号拉动第一节点的电平和栅极驱动信号输出端的电平；
其中，第二拉动控制信号的频率小于第一时钟信号的频率，并且大于显示面板的刷新频率。
其中，第二拉动控制信号为方波脉冲控制信号。
其中，第一信号为第二时钟信号，第二时钟信号的频率与第一时钟信号的频率的比例范围为2-50。
其中，第二时钟信号的频率为第一时钟信号的频率的4倍，第三信号为前两级的栅极驱动单元的第二信号，第四信号为后两级的栅极驱动单元的第二信号。
其中，第二时钟信号的频率为第一时钟信号的频率的2倍，第三信号为前四级的栅极驱动单元的第二信号，第四信号为后四级的栅极驱动单元的第二信号。
其中，第一拉动控制单元包括第一薄膜晶体管，第一薄膜晶体管的第一端接收第一参考电压，第一薄膜晶体管的第二端接收前两级的栅极驱动单元的栅极驱动信号，第一薄膜晶体管的第三端连接第一节点。
其中，第一拉动单元包括第二薄膜晶体管和电容，第二薄膜晶体管的第一端接收第一时钟信号，第二薄膜晶体管的第二端连接第一节点，第二薄膜晶体管的第三端为栅极驱动信号输出端，电容的一端连接第一节点，电容的另一端连接第二薄膜晶体管的第三端。
其中，第二拉动控制单元包括第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管、第七薄膜晶体管、第八薄膜晶体管、第九薄膜晶体管、第十薄膜晶体管、第十一薄膜晶体管、第十二薄膜晶体管以及第十三薄膜晶体管，第三薄膜晶体管的第一端和第四薄膜晶体管的第一端接收第一参考电压，第三薄膜晶体管的第二端接收第三信号，第四薄膜晶体管的第二端接收第二信号，第三薄膜晶体管的第三端和第四薄膜晶体管的第三端与第五薄膜晶体管的第一端、第七薄膜晶体管的第二端和第八薄膜晶体管的第二端连接，第五薄膜晶体管的第二端和第十二薄膜晶体管的第二端接收第四信号，第十三薄膜晶体管的第二端连接栅极驱动信号输出端，第五薄膜晶体管的第三端、第七薄膜晶体管的第三端、第九薄膜晶体管的第三端、第十二薄膜晶体管的第三端和第十三薄膜晶体管的第三端接收第二参考电压，第六薄膜晶体管的第一端和第二端接收第一参考电压，第六薄膜晶体管的第三端与第七薄膜晶体管的第一端和第九薄膜晶体管的第二端连接，第八薄膜晶体管的第一端接收第一参考电压，第八薄膜晶体管的第三端与第九薄膜晶体管的第一端、第十薄膜晶体管的第二端和第十一薄膜晶体管的第二端连接，第十薄膜晶体管的第一端接收第一信号，第十薄膜晶体管的第三端输出第二信号，第十一薄膜晶体管的第一端接收第一信号，第十一薄膜晶体管的第三端连接第十二薄膜晶体管的第一端和第十三薄膜晶体管的第一端，第十一薄膜晶体管的第三端输出第二拉动控制信号。
其中，第二拉动单元包括第十四薄膜晶体管、第十五薄膜晶体管、第十六薄膜晶体管以及第十七薄膜晶体管，第十四薄膜晶体管的第一端连接第一节点，第十四薄膜晶体管的第二端和第十五薄膜晶体管的第二端连接第十一薄膜晶体管的第三端，第十四薄膜晶体管的第三端、第十五薄膜晶体管的第三端、第十六薄膜晶体管的第三端以及第十七薄膜晶体管的第三端接收第二参考电压，第十五薄膜晶体管的第一端连接栅极驱动信号输出端，第十六薄膜晶体管的第一端连接第一节点，第十六薄膜晶体管的第二端和第十七薄膜晶体管的第二端接收后两级的栅极驱动单元的栅极驱动信号，第十七薄膜晶体管的第一端连接栅极驱动信号输出端。
本发明还提供一种显示面板，其包括上述的栅极驱动电路。
通过上述方案，本发明的有益效果是：本发明的每级栅极驱动单元包括第一拉动控制单元，用于在第一节点输出第一拉动控制信号；第一拉动单元，其耦接第一节点，接收第一时钟信号，根据第一拉动控制信号和第一时钟信号生成栅极驱动信号，栅极驱动信号输出端输出栅极驱动信号；第二拉动控制单元，用于接收第一信号、第二信号、第三信号和第四信号，根据第一信号、第二信号、第三信号和第四信号输出第二拉动控制信号；第二拉动单元，其耦接第一节点和栅极驱动信号输出端，接收第二拉动控制信号，根据第二拉动控制信号拉动第一节点的电平和栅极驱动信号输出端的电平；其中，第二拉动控制信号的频率小于第一时钟信号的频率，并且大于显示面板的刷新频率；能够有效防止栅极驱动单元的薄膜晶体管特性的漂移，提高栅极驱动单元的信赖性。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。其中：
图1是本发明第一实施例的栅极驱动电路的结构示意图；
图2是图1中栅极驱动单元的结构示意图；
图3是本发明第二实施例的栅极驱动单元的电路图；
图4是图3中第一时钟信号和栅极驱动信号的时序图；
图5是图3中第二时钟信号和第二信号的时序图；
图6是本发明第三实施例的栅极驱动单元的电路图；
图7是图6中第二时钟信号和第二信号的时序图；
图8是本发明第一实施例的显示面板的结构示意图；
图9是本发明第一实施例的液晶显示装置的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性的劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
请参见图1所示，图1是本发明第一实施例的栅极驱动电路的结构示意图。本实施例所揭示的栅极驱动电路应用于显示面板，用于驱动液显示面板的多条扫描线，以使多条扫描线打开。
如图1所示，栅极驱动电路10与多条扫描线20连接，栅极驱动电路10用于产生栅极驱动信号，用于驱动多条扫描线20。该栅极驱动驱动电路10包括多级栅极驱动单元11，一级栅极驱动单元11对应一条扫描线20，每级栅极驱动单元11的输出端均与一条扫描线20连接。
以下以第n级栅极驱动单元11进行详细说明，其中n为大于或等于1的整数。
如图2所示，第n级栅极驱动单元11包括第一拉动控制单元111、第一拉动单元112、第二拉动控制单元113以及第二拉动单元114。其中，第一拉动控制单元111用于在第一节点Qn输出第一拉动控制信号。第一拉动单元112耦接第一节点Qn，第一拉动单元112接收第一时钟信号CK，并根据第一拉动控制信号和第一时钟信号CK生成栅极驱动信号Gn，栅极驱动信号输出端输出栅极驱动信号Gn，即第一拉动单元112的栅极驱动信号输出端输出栅极驱动信号Gn，栅极驱动信号Gn用于驱动扫描线20。
在第一拉动控制信号和第一时钟信号CK均为高电平时，第一拉动单元112根据第一拉动控制信号和第一时钟信号CK生成栅极驱动信号Gn为高电平，此时与第n级栅极驱动单元11对应的扫描线20打开。
第二拉动控制单元113用于接收第一信号、第二信号、第三信号和第四信号，并根据第一信号、第二信号、第三信号和第四信号输出第二拉动控制信号。第二拉动单元114耦接第一节点Qn和栅极驱动信号输出端，接收第二拉动控制信号，并根据第二拉动控制信号拉动第一节点Qn的电平和栅极驱动信号输出端的电平。
在第二拉动控制信号为高电平时，第二拉动单元114根据第二拉动控制信号拉动第一节点Qn的电平和栅极驱动信号输出端的电平至低电平，此时与第n级栅极驱动单元11对应的扫描线20打开关闭。
在本实施例中，第二拉动控制信号的频率小于第一时钟信号CK的频率，并且大于显示面板的刷新频率；显示面板的刷新频率为显示面板每秒显示图像的次数。
其中，第二拉动控制单元113根据第一信号、第二信号和第三信号控制第二拉动控制信号的频率，以使第二拉动控制信号的频率小于第一时钟信号CK的频率，并且大于显示面板的刷新频率。
本实施例能够有效防止栅极驱动单元11的薄膜晶体管特性的漂移，提高栅极驱动单元11的信赖性。
本发明还提供第二实施例的栅极驱动单元，其在第一实施例所揭示的栅极驱动单元11的基础上进行描述。如图3所示，第一拉动控制单元111包括第一薄膜晶体管T1，第一薄膜晶体管T1的第一端接收第一参考电压VDD，第一薄膜晶体管T1的第二端接收前两级的栅极驱动单元11的栅极驱动信号Gn-2，第一薄膜晶体管T1的第三端连接第一节点Qn。
第一拉动单元112包括第二薄膜晶体管T2和电容C，第二薄膜晶体管T2的第一端接收第一时钟信号CK，第二薄膜晶体管T2的第二端连接第一节点Qn，第二薄膜晶体管T2的第三端为栅极驱动信号输出端Gn，用于输出栅极驱动信号Gn；电容C的一端连接第一节点Qn，电容C的另一端连接第二薄膜晶体管T2的第三端。
第二拉动控制单元113包括第三薄膜晶体管T3、第四薄膜晶体管T4、第五薄膜晶体管T5、第六薄膜晶体管T6、第七薄膜晶体管T7、第八薄膜晶体管T8、第九薄膜晶体管T9、第十薄膜晶体管T10、第十一薄膜晶体管T11、第十二薄膜晶体管T12以及第十三薄膜晶体管T13，第三薄膜晶体管T3的第一端和第四薄膜晶体管T4的第一端接收第一参考电压VDD，第三薄膜晶体管T3的第二端接收第三信号，第四薄膜晶体管T4的第二端接收第二信号，第三薄膜晶体管T3的第三端和第四薄膜晶体管T4的第三端与第五薄膜晶体管T5的第一端、第七薄膜晶体管T7的第二端和第八薄膜晶体管T8的第二端连接，第五薄膜晶体管T5的第二端和第十二薄膜晶体管T10的第二端接收第四信号，第十三薄膜晶体管T13的第二端连接栅极驱动信号输出端Gn，第五薄膜晶体管T5的第三端、第七薄膜晶体管T7的第三端、第九薄膜晶体管T9的第三端、第十二薄膜晶体管T12的第三端和第十三薄膜晶体管T13的第三端接收第二参考电压VSS，第六薄膜晶体管T6的第一端和第二端接收第一参考电压VDD，第六薄膜晶体管T6的第三端与第七薄膜晶体管T7的第一端和第九薄膜晶体管T9的第二端连接，第八薄膜晶体管T8的第一端接收第一参考电压VDD，第八薄膜晶体管T8的第三端与第九薄膜晶体管T9的第一端、第十薄膜晶体管T10的第二端和第十一薄膜晶体管T11的第二端连接，第十薄膜晶体管T10的第一端接收第一信号，第十薄膜晶体管T10的第三端输出第二信号，第十一薄膜晶体管T11的第一端接收第一信号，第十一薄膜晶体管T11的第三端连接第十二薄膜晶体管T12的第一端和第十三薄膜晶体管T13的第一端，第十一薄膜晶体管T11的第三端输出第二拉动控制信号。
第二拉动单元114包括第十四薄膜晶体管T14、第十五薄膜晶体管T15、第十六薄膜晶体管T16以及第十七薄膜晶体管T17，第十四薄膜晶体管T14的第一端连接第一节点，第十四薄膜晶体管T14的第二端和第十五薄膜晶体管T15的第二端连接第十一薄膜晶体管T11的第三端，第十四薄膜晶体管T14的第三端、第十五薄膜晶体管T15的第三端、第十六薄膜晶体管T16的第三端以及第十七薄膜晶体管T17的第三端接收第二参考电压VSS，第十五薄膜晶体管T15的第一端连接栅极驱动信号输出端Gn，第十六薄膜晶体管T16的第一端连接第一节点，第十六薄膜晶体管T16的第二端和第十七薄膜晶体管T17的第二端接收后两级的栅极驱动单元的栅极驱动信号Gn-2，第十七薄膜晶体管T17的第一端连接栅极驱动信号输出端Gn。其中，第二参考电压VSS为低电平。
优选地，第二拉动控制信号为方波脉冲控制信号。第一信号优选为第二时钟信号CKH，其中第二时钟信号CKH的频率与第一时钟信号CK的频率的比例范围为2-50。
优选地，第二时钟信号CKH的频率为第一时钟信号CK的频率的4倍。此时，第二信号为PDn，第三信号PDn-2为前两级的栅极驱动单元的第二信号，第四信号PDn+2为后两级的栅极驱动单元的第二信号，即第二拉动控制单元113根据第二时钟信号CKH、第二信号PDn、第三信号PDn-2和第四信号PDn+2输出第二拉动控制信号。结合图4-5所示的时序图详细描述该栅极驱动单元的工作原理。
如图4所示，在前两级的栅极驱动单元的栅极驱动信号Gn-2为高电平时，第一薄膜晶体管T1导通，第一薄膜晶体管T1的第三端在第一节点Qn输出的第一拉动控制信号为高电平；第二薄膜晶体管T2导通，栅极驱动信号Gn与第一时钟信号CK相同。
在前两级的栅极驱动单元的栅极驱动信号Gn-2为低电平时，第一薄膜晶体管T1断开，第一薄膜晶体管T1的第三端没有输出第一拉动控制信号；由于电容C充放电的作用，第一节点Qn为高电平，第二薄膜晶体管T2导通，栅极驱动信号Gn与第一时钟信号CK相同。
在后两级的栅极驱动单元的栅极驱动信号Gn+2为高电平时，第十六薄膜晶体管T16和第十七薄膜晶体管T17导通，第十六薄膜晶体管T16将第一节点Qn的电平由高电平拉到低电平，第二薄膜晶体管T2断开；第十七薄膜晶体管T17将栅极驱动信号Gn的电平由高电平拉到低电平。
如图5所示，当第三信号PDn-2为高电平、第二时钟信号CKH为低电平和第四信号PDn+2为低电平时，第三薄膜晶体管T3、第七薄膜晶体管T7、第八薄膜晶体管T8、第十薄膜晶体管T10以及第十一薄膜晶体管T11均导通，此时第二信号PDn与第二时钟信号CKH相同，即第二信号PDn为低电平；第四薄膜晶体管T4、第五薄膜晶体管T5、第九薄膜晶体管T9以及第十二薄膜晶体管T12均断开，第十一薄膜晶体管T11的第三端输出第二拉动控制信号为低电平。在栅极驱动信号Gn为低电平时，第十三薄膜晶体管T13断开，第十四薄膜晶体管T14和第十五薄膜晶体管T15均断开；在栅极驱动信号Gn为高电平时，第十三薄膜晶体管T13导通，第十四薄膜晶体管T14和第十五薄膜晶体管T15均断开。
当第三信号PDn-2为低电平、第二时钟信号CKH为高电平、第二信号PDn为高电平和第四信号PDn+2为低电平时，第三薄膜晶体管T3断开，第四薄膜晶体管T4、第七薄膜晶体管T7、第八薄膜晶体管T8、第十薄膜晶体管T10以及第十一薄膜晶体管T11均导通，此时第二信号PDn与第二时钟信号CKH相同，即第二信号PDn为高电平；第五薄膜晶体管T5、第九薄膜晶体管T9以及第十二薄膜晶体管T12均断开，第十一薄膜晶体管T11的第三端输出第二拉动控制信号为高电平。在栅极驱动信号Gn为低电平时，第十三薄膜晶体管T13断开，第十四薄膜晶体管T14和第十五薄膜晶体管T15均导通，第十四薄膜晶体管T14拉动第一节点Qn的电平到低电平，第十五薄膜晶体管T15拉动栅极驱动信号输出端Gn的电平到低电平；在栅极驱动信号Gn为高电平时，第十三薄膜晶体管T13导通，第十四薄膜晶体管T14和第十五薄膜晶体管T15均断开。
当第三信号PDn-2为低电平、第二时钟信号CKH为低电平、第二信号PDn为低电平和第四信号PDn+2为高电平时，第三薄膜晶体管T3、第四薄膜晶体管T4、第七薄膜晶体管T7、第八薄膜晶体管T8、第十薄膜晶体管T10以及第十一薄膜晶体管T11均断开，第五薄膜晶体管T5、第六薄膜晶体管T6、第九薄膜晶体管T9以及第十二薄膜晶体管T12导通，第十一薄膜晶体管T11的第三端输出第二拉动控制信号为低电平。在栅极驱动信号Gn为低电平时，第十三薄膜晶体管T13断开，第十四薄膜晶体管T14和第十五薄膜晶体管T15均断开；在栅极驱动信号Gn为高电平时，第十三薄膜晶体管T13导通，第十四薄膜晶体管T14和第十五薄膜晶体管T15均断开。
第十三薄膜晶体管T13用于保证在栅极驱动信号输出端的栅极驱动信号Gn为高电平时，将第十一薄膜晶体管T11的第三端输出第二拉动控制信号维持在低电平，第十四薄膜晶体管T14和第十五薄膜晶体管T15保持断开，以保证栅极驱动电路10的正常工作。
如图5所示，第二信号PDn每个脉冲宽度为w1。在显示面板的一帧周期内，第十四薄膜晶体管T14用于对第一节点Qn进行下拉，第十五薄膜晶体管T15用于对栅极驱动信号输出端的栅极驱动信号Gn进行下拉，第十四薄膜晶体管T14和第十五薄膜晶体管T15导通四次，即第十四薄膜晶体管T14下拉第一节点Qn四次，第十五薄膜晶体管T15下拉栅极驱动信号Gn四次，保证了栅极驱动电路10的正常工作，避免第十四薄膜晶体管T14和第十五薄膜晶体管T15受到过高频率或者过低频率的压力，能够有效防止栅极驱动单元的薄膜晶体管特性的漂移，提高栅极驱动单元11的信赖性。此外，通过对第二时钟信号CKH的频率进行调节，以获取较优的第二拉动控制信号的频率。
本发明还提供第三实施例的栅极驱动单元，其与第二实施例所揭示的栅极驱动单元不同之处在于：第二时钟信号CKH的频率为第一时钟信号的频率的2倍，例如第二时钟信号CKH采用8个时钟信号。如图6所示，第二信号为PDn，第三信号PDn-4为前四级的栅极驱动单元的第二信号，第四信号PDn+4为后四级的栅极驱动单元的第二信号。
如图7所示的时序图，与图5所示的时序图比较可知，本实施例的第二信号PDn的脉冲宽度w2为图5所示的脉冲宽度w1的两倍。
相对于第二实施例所揭示的栅极驱动单元，本实施例的栅极驱动单元的功耗降低。因此，第二时钟信号CKH包括时钟信号的数量可以根据实际情况进行设置，通常第二时钟信号CKH包括时钟信号的数量为4，6或者8个，当第二时钟信号CKH包括时钟信号的数量为h(h为偶数)时，第二拉动控制信号由第二时钟信号CKH、第三信号P(n-h/2)和第四信号P(n+h/2)控制。当第二时钟信号CKH包括时钟信号的数量越多，则第二时钟信号CKH的频率越低，相应的功耗越小，栅极驱动电路所占用的布线空间多。当第二时钟信号CKH包括时钟信号的数量越少，则第二时钟信号CKH的频率越高，相应的功耗越大，栅极驱动电路所占用的布线空间少，利于窄边框的显示面板设计。
本发明还提供一种显示面板，如图8所示，本实施例所揭示的显示面板80包括栅极驱动电路81，该栅极驱动电路81上述实施例的栅极驱动电路，栅极驱动电路81用于驱动液显示面板80的多条扫描线82，以使多条扫描线82打开，在此不再赘述。
本发明还提供一种液晶显示装置，如图9所示，本实施例所揭示的液晶显示装置包括背光模组91和显示面板92，显示面板92设置在背光模组91的出光面的上方，背光模组91用于为显示面板92提供光源，该显示面板92包括上述实施例的栅极驱动电路，栅极驱动电路用于驱动液显示面板92的多条扫描线，以使多条扫描线打开，在此不再赘述。
综上所述，本发明的每级栅极驱动单元包括第一拉动控制单元，用于在第一节点输出第一拉动控制信号；第一拉动单元，其耦接第一节点，接收第一时钟信号，根据第一拉动控制信号和第一时钟信号生成栅极驱动信号，栅极驱动信号输出端输出栅极驱动信号；第二拉动控制单元，用于接收第一信号、第二信号、第三信号和第四信号，根据第一信号、第二信号、第三信号和第四信号输出第二拉动控制信号；第二拉动单元，其耦接第一节点和栅极驱动信号输出端，接收第二拉动控制信号，根据第二拉动控制信号拉动第一节点的电平和栅极驱动信号输出端的电平；其中，第二拉动控制信号的频率小于第一时钟信号的频率，并且大于显示面板的刷新频率；能够有效防止栅极驱动单元的薄膜晶体管特性的漂移，提高栅极驱动单元的信赖性。
以上所述仅为本发明的实施例，并非因此限制本发明的专利范围，凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本发明的专利保护范围内。

Claims (10)

1.一种栅极驱动电路，其特征在于，所述栅极驱动电路包括多级栅极驱动单元，每级所述栅极驱动单元包括：
第一拉动控制单元，用于在第一节点输出第一拉动控制信号；
第一拉动单元，其耦接所述第一节点，接收第一时钟信号，根据所述第一拉动控制信号和第一时钟信号生成栅极驱动信号，栅极驱动信号输出端输出所述栅极驱动信号；
第二拉动控制单元，用于接收第一信号、第二信号、第三信号和第四信号，根据所述第一信号、第二信号、第三信号和第四信号输出第二拉动控制信号；
第二拉动单元，其耦接所述第一节点和所述栅极驱动信号输出端，接收所述第二拉动控制信号，根据所述第二拉动控制信号拉动所述第一节点的电平和所述栅极驱动信号输出端的电平；
其中，所述第二拉动控制信号的频率小于所述第一时钟信号的频率，并且大于显示面板的刷新频率。
2.根据权利要求1所述的栅极驱动电路，其特征在于，所述第二拉动控制信号为方波脉冲控制信号。
3.根据权利要求1所述的栅极驱动电路，其特征在于，所述第一信号为第二时钟信号，所述第二时钟信号的频率与所述第一时钟信号的频率的比例范围为2-50。
4.根据权利要求3所述的栅极驱动电路，其特征在于，所述第二时钟信号的频率为所述第一时钟信号的频率的4倍，所述第三信号为前两级的栅极驱动单元的第二信号，所述第四信号为后两级的栅极驱动单元的第二信号。
5.根据权利要求3所述的栅极驱动电路，其特征在于，所述第二时钟信号的频率为所述第一时钟信号的频率的2倍，所述第三信号为前四级的栅极驱动单元的第二信号，所述第四信号为后四级的栅极驱动单元的第二信号。
6.根据权利要求1所述的栅极驱动电路，其特征在于，所述第一拉动控制单元包括第一薄膜晶体管，所述第一薄膜晶体管的第一端接收第一参考电压，所述第一薄膜晶体管的第二端接收前两级的栅极驱动单元的栅极驱动信号，所述第一薄膜晶体管的第三端连接所述第一节点。
7.根据权利要求6所述的栅极驱动电路，其特征在于，所述第一拉动单元包括第二薄膜晶体管和电容，所述第二薄膜晶体管的第一端接收所述第一时钟信号，所述第二薄膜晶体管的第二端连接所述第一节点，所述第二薄膜晶体管的第三端为所述栅极驱动信号输出端，所述电容的一端连接所述第一节点，所述电容的另一端连接所述第二薄膜晶体管的第三端。
8.根据权利要求7所述的栅极驱动电路，其特征在于，所述第二拉动控制单元包括第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管、第七薄膜晶体管、第八薄膜晶体管、第九薄膜晶体管、第十薄膜晶体管、第十一薄膜晶体管、第十二薄膜晶体管以及第十三薄膜晶体管，所述第三薄膜晶体管的第一端和所述第四薄膜晶体管的第一端接收所述第一参考电压，所述第三薄膜晶体管的第二端接收所述第三信号，所述第四薄膜晶体管的第二端接收所述第二信号，所述第三薄膜晶体管的第三端和所述第四薄膜晶体管的第三端与所述第五薄膜晶体管的第一端、所述第七薄膜晶体管的第二端和所述第八薄膜晶体管的第二端连接，所述第五薄膜晶体管的第二端和所述第十二薄膜晶体管的第二端接收所述第四信号，所述第十三薄膜晶体管的第二端连接所述栅极驱动信号输出端，所述第五薄膜晶体管的第三端、所述第七薄膜晶体管的第三端、所述第九薄膜晶体管的第三端、所述第十二薄膜晶体管的第三端和所述第十三薄膜晶体管的第三端接收第二参考电压，所述第六薄膜晶体管的第一端和第二端接收所述第一参考电压，所述第六薄膜晶体管的第三端与所述第七薄膜晶体管的第一端和所述第九薄膜晶体管的第二端连接，所述第八薄膜晶体管的第一端接收所述第一参考电压，所述第八薄膜晶体管的第三端与所述第九薄膜晶体管的第一端、所述第十薄膜晶体管的第二端和所述第十一薄膜晶体管的第二端连接，所述第十薄膜晶体管的第一端接收所述第一信号，所述第十薄膜晶体管的第三端输出所述第二信号，所述第十一薄膜晶体管的第一端接收所述第一信号，所述第十一薄膜晶体管的第三端连接所述第十二薄膜晶体管的第一端和所述第十三薄膜晶体管的第一端，所述第十一薄膜晶体管的第三端输出所述第二拉动控制信号。
9.根据权利要求8所述的栅极驱动电路，其特征在于，所述第二拉动单元包括第十四薄膜晶体管、第十五薄膜晶体管、第十六薄膜晶体管以及第十七薄膜晶体管，所述第十四薄膜晶体管的第一端连接所述第一节点，所述第十四薄膜晶体管的第二端和所述第十五薄膜晶体管的第二端连接所述第十一薄膜晶体管的第三端，所述第十四薄膜晶体管的第三端、所述第十五薄膜晶体管的第三端、所述第十六薄膜晶体管的第三端以及所述第十七薄膜晶体管的第三端接收第二参考电压，所述第十五薄膜晶体管的第一端连接所述栅极驱动信号输出端，所述第十六薄膜晶体管的第一端连接所述第一节点，所述第十六薄膜晶体管的第二端和所述第十七薄膜晶体管的第二端接收后两级的栅极驱动单元的栅极驱动信号，所述第十七薄膜晶体管的第一端连接所述栅极驱动信号输出端。
10.一种显示面板，其特征在于，所述显示面板包括如权利要求1-9任意一项所述的栅极驱动电路。
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