CN105741745A - 一种移位寄存器、栅极驱动电路及显示面板 - Google Patents

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Abstract

本发明公开了一种移位寄存器、栅极驱动电路及显示面板，该移位寄存器包括：输入模块和输出模块；其中，输入模块用于在时钟信号端的控制下，将信号输入端的信号输出到控制节点；输出模块用于在控制节点的控制下，将第一参考信号端的信号或第二参考信号端的信号通过扫描信号输出端输出。本发明实施例提供的上述移位寄存器，通过输入模块和输出模块可以实现扫描信号的正常输出，同时该移位寄存器仅包括输入模块和输出模块，其结构简单功耗低，且有利于实现显示面板的窄边框设计。

Description

一种移位寄存器、栅极驱动电路及显示面板
技术领域
本发明涉及显示技术领域，尤其涉及一种移位寄存器、栅极驱动电路及显示面板。
背景技术
目前，随着显示技术的发展，显示面板业竞争越来越激烈，降低显示面板的生产成本成为面板商提高竞争力的首选方案，而为了降低显示面板的生产成本，一般地，相关技术领域的技术人员利用显示面板的边缘搭建栅极驱动电路，栅极驱动电路包括多个移位寄存器，每个移位寄存器对应一条栅线，多个移位寄存器采用级联方式设置，相邻两个移位寄存器之间有逐级传递的触发信号，每个移位寄存器接收到触发信号后，向对应栅线输出栅线扫描信号，并把触发信号输送给下一级单元电路以实现栅极驱动的功能，这样的设计可以省去在显示面板的边框区域单独设置栅极驱动芯片，降低了相关产品的生产成本，提高了显示产品的市场竞争力。
但在现有的显示领域中，移位寄存器电路结构一般设置在显示面板的周边区域，占用了较大的边框位置，不利于目前显示领域中对窄边框的需求，且移位寄存器的电路结构相对而言比较复杂，从而导致其功耗较大。
因此，如何实现显示面板的窄边框设计，且降低移位寄存器的功耗，是本领域技术人员亟待解决的技术问题。
发明内容
本发明实施例提供了一种移位寄存器、栅极驱动电路及显示面板，用以解决现有技术中存在的移位寄存器电路结构复杂，不利于显示面板的窄边框设计，且移位寄存器功耗较大的问题。
本发明实施例提供了一种移位寄存器，包括：输入模块和输出模块；其中，
所述输入模块的输入端与信号输入端相连，控制端与时钟信号端相连，输出端与控制节点相连；所述输入模块用于在所述时钟信号端的控制下，将信号输入端的信号输出到所述控制节点；
所述输出模块的控制端与所述控制节点相连，第一输入端与第一参考信号端相连，第二输入端与第二参考信号端相连，输出端与扫描信号输出端相连；所述输出模块用于在所述控制节点的控制下，将所述第一参考信号端的信号或所述第二参考信号端的信号通过所述扫描信号输出端输出。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输出模块，包括：第一输出单元和第二输出单元；其中，
所述第一输出单元的控制端与所述控制节点相连，输入端与所述第一参考信号端相连，输出端与所述扫描信号输出端相连；所述第一输出单元用于在所述控制节点的控制下，将所述第一参考信号端的信号通过所述扫描信号输出端输出；
所述第二输出单元的控制端与所述控制节点相连，输入端与所述第二参考信号端相连，输出端与所述扫描信号输出端相连；所述第二输出单元用于在所述控制节点的控制下，将所述第二参考信号端的信号通过所述扫描信号输出端输出。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一输出单元，包括：第一开关晶体管和存储电容；其中，
所述第一开关晶体管的栅极与所述控制节点相连，源极与所述第一参考信号端相连，漏极与所述扫描信号输出端相连；
所述存储电容连接于所述控制节点与所述第一开关晶体管的漏极之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一开关晶体管为P型晶体管。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二输出单元，包括：第二开关晶体管；
所述第二开关晶体管的栅极与所述控制节点相连，源极与所述第二参考信号端相连，漏极与所述扫描信号输出端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二开关晶体管为N型晶体管。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输入模块，包括：第三开关晶体管；
所述第三开关晶体管的栅极与所述时钟信号端相连，源极与所述信号输入端相连，漏极与所述控制节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第三开关晶体管为P型晶体管。
本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器；除最后一级移位寄存器外，其余每级移位寄存器的扫描信号输出端均向与其相邻的下一级移位寄存器的信号输入端输入触发信号。
本发明实施例提供了一种显示面板，包括：本发明实施例提供的上述栅极驱动电路，以及多条与各所述移位寄存器的扫描信号输出端一一对应相连的栅线。
本发明有益效果如下：
本发明实施例提供了一种移位寄存器、栅极驱动电路及显示面板，该移位寄存器包括：输入模块和输出模块；其中，输入模块的输入端与信号输入端相连，控制端与时钟信号端相连，输出端与控制节点相连；输入模块用于在时钟信号端的控制下，将信号输入端的信号输出到控制节点；输出模块的控制端与控制节点相连，第一输入端与第一参考信号端相连，第二输入端与第二参考信号端相连，输出端与扫描信号输出端相连；输出模块用于在控制节点的控制下，将第一参考信号端的信号或第二参考信号端的信号通过扫描信号输出端输出。本发明实施例提供的上述移位寄存器，通过输入模块和输出模块可以实现扫描信号的正常输出，同时该移位寄存器仅包括输入模块和输出模块，其结构简单功耗低，且有利于实现显示面板的窄边框设计。
附图说明
图1和图2分别为本发明实施例提供的移位寄存器的结构示意图；
图3为本发明实施例提供的移位寄存器的具体结构示意图；
图4为本发明实施例提供的移位寄存器的工作时序图；
图5为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器、栅极驱动电路及显示面板的具体实施方式进行详细的说明。
本发明实施例提供了一种移位寄存器，如图1所示，可以包括：输入模块01和输出模块02；其中，输入模块01的输入端与信号输入端Input相连，控制端与时钟信号端CLK相连，输出端与控制节点P相连；输入模块01用于在时钟信号端CLK的控制下，将信号输入端Input的信号输出到控制节点P；输出模块02的控制端与控制节点P相连，第一输入端与第一参考信号端Vref1相连，第二输入端与第二参考信号端Vref2相连，输出端与扫描信号输出端Out相连；输出模块02用于在控制节点P的控制下，将第一参考信号端Vref1的信号或第二参考信号端Vref2的信号通过扫描信号输出端Out输出。
本发明实施例提供的上述移位寄存器，通过输入模块和输出模块可以实现扫描信号的正常输出，同时该移位寄存器仅包括输入模块和输出模块，其结构简单功耗低，且有利于实现显示面板的窄边框设计。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图2所示，输出模块02可以包括：第一输出单元021和第二输出单元022；其中，第一输出单元021的控制端与控制节点P相连，输入端与第一参考信号端Vref1相连，输出端与扫描信号输出端Out相连；第一输出单元021用于在控制节点P的控制下，将第一参考信号端Vref1的信号通过扫描信号输出端Out输出；第二输出单元022的控制端与控制节点P相连，输入端与第二参考信号端Vref2相连，输出端与扫描信号输出端Out相连；第二输出单元022用于在控制节P的控制下，将第二参考信号端Vref2的信号通过扫描信号输出端Out输出。
具体地，本发明实施例提供的上述移位寄存器中，输出单元可以包括第一输出单元和第二输出单元，第一输出单元在控制节点的控制下，在对应阶段输出第一参考信号端的信号；第二输出单元在控制节点的控制下，在对应阶段输出第二参考信号端的信号，从而实现扫描信号的正常输出。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3所示，第一输出单元可以包括：第一开关晶体管T1和存储电容C；其中，第一开关晶体管T1的栅极与控制节点P相连，源极与第一参考信号端Vref1相连，漏极与扫描信号输出端Out相连；存储电容C连接于控制节点P与第一开关晶体管T1的漏极之间。具体地，第一开关晶体管可以在控制节点的控制下导通，导通的第一开关晶体管将第一参考信号端与扫描信号输出端导通，进而将第一参考信号端的信号通过扫描信号输出端输出。同时存储电容可通过自身的耦合作用，维持或改变控制节点的电位变化。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3所示，第一开关晶体管为P型晶体管。具体地，当控制节点的电位为低电位时，第一开关晶体管在低电位的控制下处于导通状态。此处的低电位是指能够打开P型晶体管的电位，是相对于开启N型晶体管的高电位而言。
在具体实施时，本发明实施例提供的上述移位寄存器中，第二输出单元如图3所示，可以包括：第二开关晶体管T2；第二开关晶体管T2的栅极与控制节点P相连，源极与第二参考信号端Vref2相连，漏极与扫描信号输出端Out相连。具体地，第二开关晶体管可以在控制节点的控制下导通，导通的第二开关晶体管将第二参考信号端与扫描信号输出端导通，进而将第二参考信号端的信号通过扫描信号输出端输出。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3所示，第二开关晶体管为N型晶体管。具体地，当控制节点的电位为高电位时，第而开关晶体管在高电位的控制下处于导通状态。此处的高电位是指能够打开N型晶体管的电位，是相对于开启P型晶体管的低电位而言。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3所示，输入模块01可以包括：第三开关晶体管T3；第三开关晶体管T3的栅极与时钟信号端CLK相连，源极与信号输入端Input相连，漏极与控制节点P相连。具体地，第三开关晶体管可以在时钟信号端的控制下导通，导通的第三开关晶体管将信号输入端与控制节点导通，进而将信号输入端的信号输出到控制节点。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3所示，第三开关晶体管为P型晶体管。具体地，当时钟信号端输入的信号为低电位时，第三开关晶体管在低电位的控制下处于导通状态。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，ThinFilmTransistor)，也可以是金属氧化物半导体场效应管(MOS，MetalOxideSemiconductor)，在此不做限定。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
下面结合图3所示的移位寄存器以及图4所示的图3的输入输出时序图，对本发明实施例提供的移位寄存器的工作过程作以描述。具体地，选取如图4所示的输入输出时序图中的t1～t5五个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在t1阶段，Input＝1，CLK＝0，Vref1＝0，Vref2＝1。由于CLK＝0，因此第三开关晶体管T3导通，导通的第三开关晶体管T3将信号输入端Input的信号输出到控制节点P；由于Input＝1，因此控制节点P的电位被拉高，同时对存储电容C充电，使得第二开关晶体管T2导通、第一开关晶体管T1截止，导通的第二开关晶体管T2将第二参考信号端Vref2的信号通过扫描信号输出端Out输出。
在t2阶段，Input＝0，CLK＝1，Vref1＝0，Vref2＝1。由于CLK＝1，因此第三开关晶体管T3截止。该阶段存储电容C可以保持控制节点P维持上一节点高电平，因此，第二开关晶体管T2继续导通、第一开关晶体管T1继续截止，导通的第二开关晶体管T2将第二参考信号端Vref2的信号通过扫描信号输出端Out输出。
在t3阶段，Input＝0，CLK＝0，Vref1＝0，Vref2＝1。由于CLK＝0，因此第三开关晶体管T3导通；导通的第三开关晶体管T3将信号输入端Input的信号输出到控制节点P；由于Input＝0，因此控制节点P的电位被拉低，同时对存储电容C重新充电，使得第二开关晶体管T2截止、第一开关晶体管T1导通；导通的第一开关晶体管T1将第一参考信号端Vref1的信号通过扫描信号输出端Out输出。
在t4阶段，Input＝1，CLK＝1，Vref1＝0，Vref2＝1。由于CLK＝1，因此第三开关晶体管T3截止。该阶段存储电容C可以保持控制节点P维持上一节点低电平，因此，第二开关晶体管T2继续截止、第一开关晶体管T1继续导通；导通的第一开关晶体管T1将第一参考信号端Vref1的信号通过扫描信号输出端Out输出。
在t5阶段，Input＝1，CLK＝0，Vref1＝0，Vref2＝1。由于CLK＝0，因此第三开关晶体管T3导通；导通的第三开关晶体管T3将信号输入端Input的信号输出到控制节点P；由于Input＝1，因此控制节点P的电位被拉高，同时对存储电容C重新充电，使得第二开关晶体管T2导通、第一开关晶体管T1截止；导通的第二开关晶体管T2将第二参考信号端Vref2的信号通过扫描信号输出端Out输出。
在接下来的阶段，移位寄存器始终保持输出第二参考信号端的信号，直到信号输入端下一个低电平脉冲信号到来为止。
基于同一发明构思，本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器；除最后一级移位寄存器外，其余每级移位寄存器的扫描信号输出端均向与其相邻的下一级移位寄存器的信号输入端输入触发信号。
具体地，为了方便说明，图5中仅示出了八个移位寄存器，分别为第1级移位寄存器、第2级移位寄存器、第3级移位寄存器、第4级移位寄存器、第N-3级移位寄存器、第N-2级移位寄存器、第N-1级移位寄存器、第N级移位寄存器。其中，除第N级移位寄存器外，其余每级移位寄存器的扫描信号输出端Out不仅向与其连接的栅线输出栅开启信号，还向与其相邻的下一级移位寄存器的信号输入端输入触发信号。
基于同一发明构思，本发明实施例提供了一种显示面板，包括：本发明实施例提供的上述栅极驱动电路，以及多条与各移位寄存器的扫描信号输出端一一对应相连的栅线。该显示面板可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示面板解决问题的原理与栅极驱动电路相似，因此该显示面板的实施可以参见上述栅极驱动电路的实施，重复之处不再赘述。
本发明实施例提供了一种移位寄存器、栅极驱动电路及显示面板，该移位寄存器包括：输入模块和输出模块；其中，输入模块的输入端与信号输入端相连，控制端与时钟信号端相连，输出端与控制节点相连；输入模块用于在时钟信号端的控制下，将信号输入端的信号输出到控制节点；输出模块的控制端与控制节点相连，第一输入端与第一参考信号端相连，第二输入端与第二参考信号端相连，输出端与扫描信号输出端相连；输出模块用于在控制节点的控制下，将第一参考信号端的信号或第二参考信号端的信号通过扫描信号输出端输出。本发明实施例提供的上述移位寄存器，通过输入模块和输出模块可以实现扫描信号的正常输出，同时该移位寄存器仅包括输入模块和输出模块，其结构简单功耗低，且有利于实现显示面板的窄边框设计。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (10)

1.一种移位寄存器，其特征在于，包括：输入模块和输出模块；其中，
所述输入模块的输入端与信号输入端相连，控制端与时钟信号端相连，输出端与控制节点相连；所述输入模块用于在所述时钟信号端的控制下，将信号输入端的信号输出到所述控制节点；
所述输出模块的控制端与所述控制节点相连，第一输入端与第一参考信号端相连，第二输入端与第二参考信号端相连，输出端与扫描信号输出端相连；所述输出模块用于在所述控制节点的控制下，将所述第一参考信号端的信号或所述第二参考信号端的信号通过所述扫描信号输出端输出。
2.如权利要求1所述的移位寄存器，其特征在于，所述输出模块，包括：第一输出单元和第二输出单元；其中，
所述第一输出单元的控制端与所述控制节点相连，输入端与所述第一参考信号端相连，输出端与所述扫描信号输出端相连；所述第一输出单元用于在所述控制节点的控制下，将所述第一参考信号端的信号通过所述扫描信号输出端输出；
所述第二输出单元的控制端与所述控制节点相连，输入端与所述第二参考信号端相连，输出端与所述扫描信号输出端相连；所述第二输出单元用于在所述控制节点的控制下，将所述第二参考信号端的信号通过所述扫描信号输出端输出。
3.如权利要求2所述的移位寄存器，其特征在于，所述第一输出单元，包括：第一开关晶体管和存储电容；其中，
所述第一开关晶体管的栅极与所述控制节点相连，源极与所述第一参考信号端相连，漏极与所述扫描信号输出端相连；
所述存储电容连接于所述控制节点与所述第一开关晶体管的漏极之间。
4.如权利要求3所述的移位寄存器，其特征在于，所述第一开关晶体管为P型晶体管。
5.如权利要求2所述的移位寄存器，其特征在于，所述第二输出单元，包括：第二开关晶体管；
所述第二开关晶体管的栅极与所述控制节点相连，源极与所述第二参考信号端相连，漏极与所述扫描信号输出端相连。
6.如权利要求5所述的移位寄存器，其特征在于，所述第二开关晶体管为N型晶体管。
7.如权利要求1-6任一项所述的移位寄存器，其特征在于，所述输入模块，包括：第三开关晶体管；
所述第三开关晶体管的栅极与所述时钟信号端相连，源极与所述信号输入端相连，漏极与所述控制节点相连。
8.如权利要求7所述的移位寄存器，其特征在于，所述第三开关晶体管为P型晶体管。
9.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-8任一项所述的移位寄存器；除最后一级移位寄存器外，其余每级移位寄存器的扫描信号输出端均向与其相邻的下一级移位寄存器的信号输入端输入触发信号。
10.一种显示面板，其特征在于，包括：如权利要求9所述的栅极驱动电路，以及多条与各所述移位寄存器的扫描信号输出端一一对应相连的栅线。
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