CN105118422A - 一种栅极集成驱动电路、显示面板、显示装置及驱动方法 - Google Patents
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Abstract
本发明公开了一种栅极集成驱动电路、显示面板、显示装置及驱动方法，该栅极集成驱动电路中，时钟信号线分为至少两组，一帧显示时间分为至少两个时间段，移位寄存器单元分为至少两组；在一帧的显示时间内，一组时钟信号线对应一个时间段，每组时钟信号线在对应时间段向对应的一组移位寄存器单元输入时钟信号。这样通过增加时钟信号线的数量，在一帧显示时间内，各组时钟信号线分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路整体的功耗。
Description
技术领域
本发明涉及显示技术领域，尤其涉及一种栅极集成驱动电路、显示面板、显示装置及驱动方法。
背景技术
目前，显示技术被广泛应用于电视、手机以及公共信息的显示，用于显示画面的平板显示器因其超薄节能的优点而被大力推广，而在多数的平板显示器中都需要采用栅极集成驱动电路来输出栅极扫描信号控制显示面板实现逐行扫描和逐帧刷新的功能，使得输入到显示面板的图像数据能够实时刷新，从而实现动态显示。栅极集成驱动电路包括级联的多个移位寄存器单元，且通过移位寄存器单元来实现栅极驱动的功能，既可以省去单独制作栅极驱动芯片，还可以减少一道制作工序，不但可以降低平板显示器的制作成本，还能缩短其制作周期，因此，近几年来移位寄存器技术被广泛应用于平板显示制造。
然而，采用栅极集成驱动电路的产品功耗会偏高，笔记本电脑、触控显示产品和手机等产品对显示模组自身功耗的要求较高，因此，在此类产品上栅极集成驱动电路设计的功耗需要尽可能的低。一般地，用于向栅极集成驱动电路输入时钟信号的时钟信号线，在一帧显示时间内需要向栅极驱动电路中所有的移位寄存器单元输入时钟信号，而栅极集成驱动电路的功耗绝大部分来源于时钟信号反转时，对与其连接的开关晶体管的寄生电容充电的损耗，即时钟信号线向各移位寄存器输入时钟信号时，每条时钟信号线连接的开关晶体管的数量越多、所连接的开关晶体管的尺寸越大，则栅极集成驱动电路整体的功耗也就越大。
因此，如何降低栅极集成驱动电路的功耗，以满足各显示产品的低功耗需求，是本领域技术人员亟待解决的技术问题。
发明内容
本发明实施例提供了一种栅极集成驱动电路、显示面板、显示装置及驱动方法，用以解决现有技术中存在的栅极集成驱动电路的功耗较高的问题。
本发明实施例提供了一种栅极集成驱动电路，包括：级联的多个移位寄存器单元和多条用于向所述移位寄存器单元输入时钟信号的时钟信号线；其中，
所述时钟信号线分为至少两组，对应所述时钟信号线的分组，一帧显示时间分为至少两个时间段，所述移位寄存器单元分为至少两组；
在一帧的显示时间内，一组所述时钟信号线对应一个所述时间段，每组所述时钟信号线在对应时间段向对应的一组所述移位寄存器单元输入时钟信号。
在一种可能的实施方式中，本发明实施例提供的上述栅极集成驱动电路中，所述栅极集成驱动电路包括两组时钟信号线，一帧显示时间分为两个相等的时间段，所述移位寄存器单元分为数量相等的两组；
第一组所述时钟信号线在第一时间段向对应的第一组所述移位寄存器单元输入时钟信号；
第二组所述时钟信号线在第二时间段向对应的第二组所述移位寄存器单元输入时钟信号。
在一种可能的实施方式中，本发明实施例提供的上述栅极集成驱动电路中，所述移位寄存器单元由第一级至最后一级平均分成两组，第一组所述时钟信号线对应第一组移位寄存器单元，第二组所述时钟信号线对应第二组移位寄存器单元；
所述时钟信号线与所述移位寄存器单元的排列方向平行；
第一组所述时钟信号线位于第二组所述时钟信号线与所述移位寄存器单元之间。
在一种可能的实施方式中，本发明实施例提供的上述栅极集成驱动电路中，所述栅极集成驱动电路包括两组时钟信号线，所述移位寄存器单元由第一级至最后一级平均分成四组，一帧显示时间分为四个时间段；
在第一时间段和第三时间段第一组所述时钟信号线分别向第一组所述移位寄存器单元和第三组所述移位寄存器单元输入时钟信号；
在第二时间段和第四时间段第二组所述时钟信号线分别向第二组所述移位寄存器单元和第四组所述移位寄存器单元输入时钟信号。
本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极集成驱动电路。
在一种可能的实施方式中，本发明实施例提供的上述显示面板中，所述显示面板包括两组本发明实施例提供的上述栅极集成驱动电路，两组所述栅极集成驱动电路分别位于所述显示面板相对的两侧的周边区域。
本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。
在一种可能的实施方式中，本发明实施例提供的上述显示装置中，还包括：时钟控制芯片；
所述时钟控制芯片用于在一帧显示时间内，对应每一个时间段向对应的一组时钟信号线输入时钟信号。
在一种可能的实施方式中，本发明实施例提供的上述显示装置中，所述时钟控制芯片设置于柔性电路板上。
本发明实施例提供了一种本发明实施例提供的上述显示装置的驱动方法，包括：
在一帧显示时间内，对应每一个时间段控制对应的一组时钟信号线向对应的一组所述移位寄存器单元输入时钟信号。
本发明实施例的有益效果包括：
本发明实施例提供了一种栅极集成驱动电路、显示面板、显示装置及驱动方法，该栅极集成驱动电路包括：级联的多个移位寄存器单元和多条用于向移位寄存器输入时钟信号的时钟信号线；其中，时钟信号线分为至少两组，对应时钟信号线的分组，一帧显示时间分为至少两个时间段，移位寄存器单元分为至少两组；在一帧的显示时间内，一组时钟信号线对应一个时间段，每组时钟信号线在对应时间段向对应的一组移位寄存器单元输入时钟信号。这样通过增加时钟信号线的数量，且将时钟信号线、移位寄存器单元对应分组，在一帧显示时间内，一组时钟信号线对应一个时间段，各组时钟信号线分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路整体的功耗。
附图说明
图1为本发明实施例提供的栅极集成驱动电路的结构示意图；
图2为本发明实施例提供的栅极集成驱动电路的输入输出时序图。
具体实施方式
下面结合附图，对本发明实施例提供的栅极集成驱动电路、显示面板、显示装置及驱动方法的具体实施方式进行详细地说明。
本发明实施例提供了一种栅极集成驱动电路，如图1所示，包括：级联的多个移位寄存器单元01和多条用于向移位寄存器单元输入时钟信号的时钟信号线；其中，时钟信号线分为至少两组，对应时钟信号线的分组，一帧显示时间分为至少两个时间段，移位寄存器单元01分为至少两组；在一帧的显示时间内，一组时钟信号线对应一个时间段，每组时钟信号线在对应时间段向对应的一组移位寄存器单元01输入时钟信号。
本发明实施例提供的上述栅极集成驱动电路，如图1所示，包括：级联的多个移位寄存器单元01和多条用于向移位寄存器单元01输入时钟信号的时钟信号线；其中，时钟信号线分为至少两组，对应时钟信号线的分组，一帧显示时间分为至少两个时间段，移位寄存器单元01分为至少两组；在一帧的显示时间内，一组时钟信号线对应一个时间段，每组时钟信号线在对应时间段向对应的一组移位寄存器单元01输入时钟信号。这样通过增加时钟信号线的数量，且将时钟信号线、移位寄存器单元对应分组，在一帧显示时间内，一组时钟信号线对应一个时间段，各组时钟信号线分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路整体的功耗。
在具体实施时，本发明实施例提供的上述栅极集成驱动电路中，如图1所示，栅极集成驱动电路包括两组时钟信号线，一帧显示时间分为两个相等的时间段，即前半帧时间段和后半帧时间段，移位寄存器单元01分为数量相等的两组；即第一级移位寄存器单元到第N/2级移位寄存器单元为第一组移位寄存器单元，第N/2+1级移位寄存器单元到第N级移位寄存器单元为第二组移位寄存器单元；第一组时钟信号线在第一时间段向对应的第一组移位寄存器单元输入时钟信号；第二组时钟信号线在第二时间段向对应的第二组移位寄存器单元输入时钟信号。
具体地，本发明实施例提供的上述栅极集成驱动电路中，以栅极集成驱动电路包括两个时钟信号线(CLK、CLKB)的架构为例，如图1所示，两组时钟信号线(第一组时钟信号线包括CLK11、CLK21，第二组时钟信号线包括CLK12、CLK22)对应两组移位寄存器单元，具体地，如图2所示，在前半帧第一组时钟信号线向第一组移位寄存器单元输入时钟信号，对应第一级移位寄存器单元到第N/2级移位寄存器单元的Out输出，后半帧时间段第一组时钟信号线全部输入低电平信号；而第二组时钟信号线则相反，在前半帧时间段输入低电平信号，后半帧时间段向第二组移位寄存器单元输入方波信号，对应第N/2+1级移位寄存器单元到第N级移位寄存器单元的Out输出。这样每一时间段工作的时钟信号线仅连接N/2个移位寄存器单元，时钟信号线不工作时输入低电平信号，所产生的功耗非常小，如忽略不计，则栅极集成驱动电路的整体功耗可以降低约50％。
在具体实施时，本发明实施例提供的上述栅极集成驱动电路中，如图1所示，移位寄存器单元由第一级至最后一级平均分成两组，第一组时钟信号线对应第一组移位寄存器单元，第二组时钟信号线对应第二组移位寄存器单元；时钟信号线的延伸方向与移位寄存器单元的排列方向相同；第一组时钟信号线位于第二组时钟信号线与移位寄存器单元之间。具体地，本发明实施例提供的上述栅极集成驱动电路中，可以将第一组时钟信号线设置于第二组时钟信号线与移位寄存器单元之间，这样第二组时钟信号线可以在前半帧时间段既不与移位寄存器单元相连，而且两根时钟信号线CLK12和CLK22相互之间也无交叠，因此无寄生电容产生，所以在后半帧时间段输入的时钟信号衰减很小，相对于传统方案中时钟信号线与所有移位寄存器单元相连，且在一帧显示时间内由第一级向第N级移位寄存器单元逐级输入时钟信号，本发明实施例提供的栅极集成驱动电路，由于第二组时钟信号线向第二组移位寄存器单元输入的时钟信号衰减很小，因此可以提高对第二组移位寄存器单元的驱动能力。
在具体实施时，本发明实施例提供的上述栅极集成驱动电路中，栅极集成驱动电路可以包括两组时钟信号线，将移位寄存器单元由第一级至最后一级平均分成四组，一帧显示时间分为四个时间段；在第一时间段和第三时间段第一组时钟信号线分别向第一组移位寄存器单元和第三组移位寄存器单元输入时钟信号；在第二时间段和第四时间段第二组时钟信号线分别向第二组移位寄存器单元和第四组移位寄存器单元输入时钟信号。
具体地，本发明实施例提供的上述栅极集成驱动电路中，可以将移位寄存器单元分成四组，一帧显示时间分为四个阶段，这样每一时间段工作的时钟信号线仅连接N/4个移位寄存器单元，时钟信号线不工作时输入低电平信号，所产生的功耗非常小，因此在一帧显示时间内，两组时钟信号线分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路整体的功耗。具体地，在实际应用中，可以根据具体产品的设计要求以及产品的生产技术，合理设置时钟信号线的分组数以及移位寄存器单元的分组数，在此不作限定。
基于同一发明构思，本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极集成驱动电路。由于该显示面板解决问题的原理与栅极集成驱动电路相似，因此该显示面板的实施可以参见上述栅极集成驱动电路的实施，重复之处不再赘述。
在具体实施时，本发明实施例提供的上述显示面板中，显示面板可以包括两组本发明实施例提供的上述栅极集成驱动电路，两组栅极集成驱动电路分别位于显示面板相对的两侧的周边区域。具体地，本发明实施例提供的上述显示面板中，可以采用两组栅极集成驱动电路实现双边驱动，且采用本发明实施例提供的上述栅极驱动电路，可以减少栅极集成驱动电路整体的功耗，从而减少相应产品的功耗。
基于同一发明构思，本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。该显示装置可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示装置解决问题的原理与显示面板相似，因此该显示装置的实施可以参见上述显示面板的实施，重复之处不再赘述。
在具体实施时，本发明实施例提供的上述显示装置中，还可以包括：时钟控制芯片；时钟控制芯片用于在一帧显示时间内，对应每一个时间段向对应的一组时钟信号线输入时钟信号。具体地，本发明实施例提供的上述栅极集成驱动电路中，通过时钟控制芯片产生对应的时钟信号，在一帧显示时间内，对应每一个时间段向对应的一组时钟信号线输入时钟信号，从而保证每组时钟信号线在对应时间段向对应的移位寄存器单元输入时钟信号，从而保证显示面板的正常栅驱动扫描，同时各组时钟信号线分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路整体的功耗。
在具体实施时，本发明实施例提供的上述显示装置中，时钟控制芯片设置于柔性电路板上。具体地，本发明实施例提供的上述栅极集成驱动电路中，时钟芯片可以设置于柔性电路板上，通过柔性电路板绑定于显示面板，为显示面板实现栅驱动扫描提供时钟控制信号。
基于同一发明构思，本发明实施例提供了一种本发明实施例提供的上述显示装置的驱动方法，可以包括：在一帧显示时间内，对应每一个时间段控制对应的一组时钟信号线向对应的一组移位寄存器单元输入时钟信号。这样在一帧显示时间内，时钟信号线可以分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路的功耗。
本发明实施例提供了一种栅极集成驱动电路、显示面板、显示装置及驱动方法，该栅极集成驱动电路包括：级联的多个移位寄存器单元和多条用于向移位寄存器输入时钟信号的时钟信号线；其中，时钟信号线分为至少两组，对应时钟信号线的分组，一帧显示时间分为至少两个时间段，移位寄存器单元分为至少两组；在一帧的显示时间内，一组时钟信号线对应一个时间段，每组时钟信号线在对应时间段向对应的一组移位寄存器单元输入时钟信号。这样通过增加时钟信号线的数量，且将时钟信号线、移位寄存器单元对应分组，在一帧显示时间内，一组时钟信号线对应一个时间段，各组时钟信号线分时工作，从而减少每一时刻在工作的时钟信号线所连接的移位寄存器单元的数量，即减少每一时刻在工作的时钟信号线所连接的开关晶体管的数量，这样在时钟信号反转时，可以减少对与其连接的开关晶体管寄生电容充电的损耗，从而可以降低栅极集成驱动电路整体的功耗。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。
Claims (10)
1.一种栅极集成驱动电路，其特征在于，包括：级联的多个移位寄存器单元和多条用于向所述移位寄存器单元输入时钟信号的时钟信号线；其中，
所述时钟信号线分为至少两组，对应所述时钟信号线的分组，一帧显示时间分为至少两个时间段，所述移位寄存器单元分为至少两组；
在一帧的显示时间内，一组所述时钟信号线对应一个所述时间段，每组所述时钟信号线在对应时间段向对应的一组所述移位寄存器单元输入时钟信号。
2.如权利要求1所述的栅极集成驱动电路，其特征在于，所述栅极集成驱动电路包括两组时钟信号线，一帧显示时间分为两个相等的时间段，所述移位寄存器单元分为数量相等的两组；
第一组所述时钟信号线在第一时间段向对应的第一组所述移位寄存器单元输入时钟信号；
第二组所述时钟信号线在第二时间段向对应的第二组所述移位寄存器单元输入时钟信号。
3.如权利要求2所述的栅极集成驱动电路，其特征在于，所述移位寄存器单元由第一级至最后一级平均分成两组，第一组所述时钟信号线对应第一组移位寄存器单元，第二组所述时钟信号线对应第二组移位寄存器单元；
所述时钟信号线的延伸方向与所述移位寄存器单元的排列方向相同；
第一组所述时钟信号线位于第二组所述时钟信号线与所述移位寄存器单元之间。
4.如权利要求1所述的栅极集成驱动电路，其特征在于，所述栅极集成驱动电路包括两组时钟信号线，所述移位寄存器单元由第一级至最后一级平均分成四组，一帧显示时间分为四个时间段；
在第一时间段和第三时间段第一组所述时钟信号线分别向第一组所述移位寄存器单元和第三组所述移位寄存器单元输入时钟信号；
在第二时间段和第四时间段第二组所述时钟信号线分别向第二组所述移位寄存器单元和第四组所述移位寄存器单元输入时钟信号。
5.一种显示面板，其特征在于，包括如权利要求1-4任一项所述的栅极集成驱动电路。
6.如权利要求5所述的显示面板，其特征在于，所述显示面板包括两组如权利要求1-4任一项所述的栅极集成驱动电路，两组所述栅极集成驱动电路分别位于所述显示面板相对的两侧的周边区域。
7.一种显示装置，其特征在于，包括如权利要求5或6所述的显示面板。
8.如权利要求7所述的显示装置，其特征在于，还包括：时钟控制芯片；
所述时钟控制芯片用于在一帧显示时间内，对应每一个时间段向对应的一组时钟信号线输入时钟信号。
9.如权利要求8所述的显示装置，其特征在于，所述时钟控制芯片设置于柔性电路板上。
10.一种如权利要求7-9任一项所述的显示装置的驱动方法，其特征在于，包括：
在一帧显示时间内，对应每一个时间段控制对应的一组所述时钟信号线向对应的一组所述移位寄存器单元输入时钟信号。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| RJ01 | Rejection of invention patent application after publication | ||
| RJ01 | Rejection of invention patent application after publication |
Application publication date: 20151202 |