CN103794181A - 液晶显示面板及其驱动方法 - Google Patents

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Abstract

本发明涉及一种液晶显示面板及其驱动方法，其中公开了一种通过在n个水平同步间隔期间施加选通高压来按交叠驱动模式驱动的LCD面板。此LCD面板包括：多个选通线；以及选通驱动器，该选通驱动器被配置为包括连接到所述多个选通线的多个级。该多个级被分组成多个级组，每一级组包括n个级。奇数编号的级组均允许n个级按照Z形排列，显示区位于其之间。偶数编号的级组均允许n级按照倒Z形排列，显示区位于其之间。

Description

液晶显示面板及其驱动方法
技术领域
本申请涉及一种液晶显示面板及其驱动方法。
背景技术
随着信息社会的发展，对用于显示图像的显示装置的要求以各种方式增加。因此，正在积极研究并制造与现有技术的阴极射线管（CRT）相比更薄、重量更轻的平板显示装置。平板显示装置包括液晶显示（LCD）装置、等离子体显示装置（PDP）、有机发光显示（OLED）装置等。在平板显示装置当中，LCD装置如今正由于诸如尺寸小、重量轻、纤薄和低功率驱动的特征而被广泛使用。
LCD装置响应于通过薄膜晶体管施加的数据电压而使液晶分子重新排列，并控制每一像素区的透射率，以便显示图像。多个选通线形成在设置有薄膜晶体管的LCD面板上。薄膜晶体管可通过相应选通线上的选通电压而导通/截止。
选通线从选通驱动器接收选通电压。在近来提出的GIP（gate-in-panel）型的LCD装置中，选通驱动器形成在LCD面板上以便降低制造成本并使功耗最小化。可以在非交叠驱动模式和交叠驱动模式下来驱动这样的选通驱动器。
图1是例示现有技术的非交叠驱动模式的波形图。图2是例示现有技术的交叠驱动模式的波形图。
参照图1，依次与第一时钟信号CLK1和第二时钟信号CLK2（第一时钟信号CLK1和第二时钟信号CLK2彼此交替地在单个水平间隔中维持高电平）同步地将选通高压施加于选通线。更具体地讲，与第一时钟信号CLK1同步地将选通高压施加于第一选通线GL1。另外，与第二时钟信号CLK2同步地将选通高压施加于第二选通线GL2。
参照图2，在两个水平间隔中将选通高压施加于各选通线。施加于各选通线的选通高压与第一时钟信号CLK1和第二时钟信号CLK2（第一时钟信号CLK1和第二时钟信号CLK2各自在两个水平间隔中维持高电平）同步。
与第一时钟信号CLK1相比，第二时钟信号CLK2的相位延迟了单个水平同步间隔。因此，第一时钟信号CLK1和第二时钟信号CLK2彼此交叠了单个水平同步间隔。
据此，施加于第一选通线GL1的选通高压的宽度与施加于第二选通线GL2的选通高压的宽度部分交叠。这源自这样的事实：第一选通线GL1上的选通高压与第一时钟信号CLK1的高电平间隔同步，第二选通线GL2上的选通高压与第二时钟信号CLK2的高电平间隔同步。换言之，第一选通线GL1上的选通高压与第二选通线GL2上的选通高压交叠了单个水平同步间隔。这样，交叠驱动模式允许施加于选通线的选通高压彼此部分交叠。
与非交叠驱动模式相比，交叠驱动模式在更长的间隔期间施加选通高压。因此，可得到对选通线预充电的效果。预充电效果可防止由于选通线上的阻容延迟所导致的选通脉冲的上升时间的延迟而引起的问题。
然而，交叠驱动模式难以解决由选通脉冲的下降时间的延迟引起的问题。因此，可能产生信号失真和纵向线缺陷。
发明内容
根据本发明的一个方面，提供了一种显示面板，该显示面板包括：多个选通线；第一时钟线和第二时钟线；以及选通驱动器，其被配置为包括连接到所述多个选通线的多个级，其中所述多个级分组成多个第一种编号的级和多个第二种编号的级，所述多个第一种编号的级的一端连接到所述第一时钟线，另一端连接到对应的补偿晶体管，使得显示区位于第一种编号的级与对应的补偿晶体管之间，所述多个第二种编号的级的一端连接到所述第二时钟线，另一端连接到对应的补偿晶体管，使得显示区位于第二种编号的级与对应的补偿晶体管之间。
附图说明
附图被包括在内以提供对实施方式的进一步理解，并且并入本文中并构成此申请的一部分，附图示出本公开的实施方式，并与说明书一起用于说明本公开。在附图中：
图1是例示了现有技术的非交叠驱动模式的波形图；
图2是例示了现有技术的交叠驱动模式的波形图；
图3是示出了根据本公开实施方式的LCD装置的框图；
图4的详细电路图示出了根据本公开第一实施方式的LCD装置的选通驱动器；
图5是示出了从图4的选通驱动器输出的选通脉冲的波形图；
图6的详细电路图示了出根据本公开第二实施方式的LCD装置的选通驱动器；
图7的波形图示出了从根据本公开的第一和第二实施方式的各选通驱动器输出的选通脉冲的下降沿特性；以及
图8的详细电路图示出了根据本公开第三实施方式的选通驱动器。
具体实施方式
在本公开中，将理解，当在实施方式中诸如基底、层、区域、膜或电极之类的元件被称作形成在另一元件“上”或“下”时，其可直接在该另一元件上或下，或者可存在中间元件（非直接）。元件的术语“上”或“下”将基于附图确定。
如本文所述，本发明可以按许多不同的形式实施。然而，并非所有示出的部件均需要，相对于本公开中所明确描述的那些，一些实现方式可包括另外的、不同的或更少的部件。在不脱离本文所阐述的权利要求的精神或范围的情况下，部件的布置方式和类型可变化。
现在将更详细地描述实施方式，附图中例示了这些实施方式的示例。在附图中，为了清晰和说明方便，元件的尺寸和厚度可能被夸大、省略或简化，其并不表示元件的实际尺寸。
根据本实施方式的第一一般方面的LCD面板可通过在n个水平同步间隔期间施加选通高压来以交叠驱动模式驱动。此LCD面板可包括：多个选通线；选通驱动器，其被配置为包括连接到多个选通线的多个级。该多个级分成多个级组，每一级组包括n级。奇数编号的级组均允许n级按照Z形排列，显示区位于其之间。偶数编号的级组均允许n级按照倒Z形排列，显示区位于其之间。
液晶显示面板还可包括多个补偿晶体管，其连接到多个选通线并被配置为将选通低压施加到选通线。
该多个补偿晶体管的第k补偿晶体管可通过第(k+n)选通线上的电压导通/截止。
补偿晶体管可与级相对地设置，显示区位于补偿晶体管与级之间。
第k补偿晶体管的栅极可在与第(k+n)级相邻的区域中电连接到第(k+n)选通线。
选通驱动器可包括设置在显示区两侧的第一选通驱动器和第二选通驱动器。
第一选通驱动器可包括：奇数编号的级组内的奇数编号的级和偶数编号的补偿晶体管；以及偶数编号的级组内的偶数编号的级和奇数编号的补偿晶体管。
第二选通驱动器可包括：奇数编号的级组内的偶数编号的级和奇数编号的补偿晶体管；和偶数编号的级组内的奇数编号的级和偶数编号的补偿晶体管。
数量“n”可为2的倍数。
第一选通驱动器可包括：用于传输时钟信号的第一时钟线；用于传输选通高压的第一电压线；和用于传输选通低压的第二电压线。
第二选通驱动器可包括：用于传输时钟信号的第二时钟线；用于传输选通高压的第一电压线；和用于传输选通低压的第二电压线。
根据本实施方式的第二一般方面的LCD面板可通过在两个水平同步间隔期间施加选通高压来以交叠驱动模式驱动。此LCD面板可包括：多个选通线；选通驱动器，其被配置为包括连接到该多个选通线的多个级。该多个级包括：第(4k-3)级和第(4k-2)级，彼此交替排列，显示区位于其之间；第(4k-1)级和第(4k)级，彼此交替排列，显示区位于其之间。
第(4k-3)和第(4k-2)级排列在显示区的左侧和右侧。第(4k-1)和第(4k)级排列在显示区的右侧和左侧。
液晶显示面板还可包括多个补偿晶体管，其连接到多个选通线并被配置为将选通低压施加到选通线。
该多个补偿晶体管中的第n补偿晶体管可通过第(n+2)选通线上的电压来导通/截止。
补偿晶体管可与级相对地设置，显示区位于其之间。
第n补偿晶体管的栅极可在与(k+n)级相邻的区域中电连接到第(n+2)选通线。
选通驱动器可包括设置在显示区两侧的第一和第二选通驱动器。
第一选通驱动器可包括：第(4k-3)和第(4k)级；和多个补偿晶体管当中的第(4k-2)和第(4k-1)补偿晶体管。
第二选通驱动器可包括：第(4k-2)和第(4k-1)级；和多个补偿晶体管当中的第(4k-3)和第(4k)补偿晶体管。
图3是示出了根据本公开实施方式的LCD装置的框图。
参照图3，根据本公开实施方式的LCD装置包括LCD面板1、选通驱动器10和数据驱动器30。选通驱动器10形成在LCD面板1上。
多个选通线GL1～GLn形成在LCD面板1上。另外，多个数据线DL1～DLm在与多个选通线GL1～GLn交叉的方向上形成在LCD面板1上。
彼此交叉的多个选通线GL1～GLn和多个数据线DL1～DLm限定多个像素区。多个薄膜晶体管T可连接到多个选通线GL1～GLn和多个数据线DL1～DLm。
每一薄膜晶体管可包括栅极、源极和漏极。栅极可连接到选通线GL1～GLn中的一个，源极可连接到数据线DL1～DLm中的一个。栅极可形成在与选通线GL合并的单体（single body）中。源极可形成在与数据线DL合并的单体中。漏极可连接到像素区中的像素电极。
LCD面板1可被限定为显示区AA和非显示区NA。显示区AA可用于显示图像。非显示区NA不显示任何图像。非显示区NA位于显示区AA的外侧。
选通驱动器10可形成在非显示区NA上。另外，数据驱动器30可形成在非显示区NA上。
选通驱动器10可包括第一选通驱动器21和第二选通驱动器22。第一选通驱动器21可位于非显示区NA的一侧边缘中。第二选通驱动器22可位于非显示区NA的另一边缘中。换言之，第一选通驱动器21和第二选通驱动器22可以彼此面对的方式形成在非显示区NA上。
第一选通驱动器21可电连接到多个选通线GL1～GLn的一端。第二选通驱动器22可电连接到多个选通线GL1～GLn的另一端。
选通驱动器10可将选通脉冲施加到多个选通线GL1～GLn。基于显示区AA的中心轴线，第一选通驱动器21可将选通脉冲施加到选通线GL1～GLn的一部分，该部分位于显示区AA的、与第一选通驱动器21相邻的一个域中。基于显示区AA的中心轴线，第二选通驱动器22可将选通脉冲施加到选通线GL1～GLn的另一部分，该另一部分位于显示区AA的、与第二选通驱动器22的另一域中。换言之，第一选通驱动器21和第二选通驱动器22可将选通脉冲施加到多个选通线GL1～GLn的根据显示区AA的域分割的部分。这样，选通驱动器10形成在多个选通线GL1～GLn的两侧，并将选通脉冲施加到多个选通线GL1～GLn。结果，大尺寸显示装置中由线电阻引起的阻容延迟可最小化。因此，大尺寸显示装置的图像品质可提高。
数据驱动器30可电连接到多个数据线DL1～DLm。数据驱动器30可与通过选通脉冲导通晶体管T的时间点同步地通过数据线DL1～DLm将数据电压施加到薄膜晶体管T。这样的数据驱动器30可位于非显示区NA中。
图4是示出了根据本公开第一实施方式的LCD装置的选通驱动器的详细电路图。
参照图4，根据本公开第一实施方式的LCD装置的LCD面板1可被限定为显示区AA和非显示区NA。非显示区NA可位于显示区AA的外侧。
为了方便说明，附图中将显示区AA显示为尺寸比非显示区NA小。然而，本实施方式不限于此。
选通驱动器10可形成在非显示区NA上。选通驱动器10包括第一选通驱动器21和第二选通驱动器22。选通驱动器10包括多个级。例如，选通驱动器10可包括第一级11至第八级18。尽管图中示出具有八个级的选通驱动器10，但级的数量取决于选通线的数量。因此，级的数量不限于此。
第一选通驱动器21包括奇数编号的级。例如，第一选通驱动器21可包括第一级11、第三级13、第五级15和第七级17。另外，第一选通驱动器21可包括第一时钟线CLK1、第一电压线VGH和第二电压线VGL。
此外，第一选通驱动器21可包括偶数编号的补偿晶体管。例如，第一选通驱动器21可包括第二补偿晶体管TR2、第四补偿晶体管TR4、第六补偿晶体管TR6和第八补偿晶体管TR8。
第一时钟线CLK1可用于传输时钟信号。尽管图中仅示出第一时钟线CLK1，但第一选通驱动器21中可包括用于传输频率彼此不同的时钟信号的多个时钟线。
第一电压线VGH可用于传输第一电压，第二电压线VGL可用于传输第二电压。第一电压和第二电压可被设定为彼此不同的电平。例如，第一电压可成为选通高压，第二电压可成为选通低压。
第二选通驱动器22包括偶数编号的级。例如，第二选通驱动器22可包括第二级12、第四级14、第六级16和第八级18。另外，第二选通驱动器22可包括第二时钟线CLK2、第一电压线VGH和第二电压线VGL。
另外，第二选通驱动器22可包括奇数编号的补偿晶体管。例如，第二选通驱动器22可包括第一补偿晶体管TR1、第三补偿晶体管TR3、第五补偿晶体管TR5和第七补偿晶体管TR7。
第二时钟线CLK2可用于传输时钟信号。尽管图中仅示出第二时钟线CLK1，但第二选通驱动器22中可包括用于传输频率彼此不同的时钟信号的多个时钟线。
第一电压线VGH可用于传输第一电压，第二电压线VGL可用于传输第二电压。第一电压和第二电压可被设定为彼此不同的电平。例如，第一电压可成为选通高压，第二电压可成为选通低压。
第一级11、第三级13、第五级15和第七级17可电连接到第一时钟线CLK1、第一电压线VGH和第二电压线VGL。
第二级12、第四级14、第六级16和第八级18可电连接到第二时钟线CLK2、第一电压线VGH和第二电压线VGL。
级11～18中的每一个可响应于时钟线CLK上的时钟信号选择性地利用选通高压和选通低压产生选通脉冲。另外，级11～18中的每一个可将产生的选通脉冲施加到相应的选通线GL。
第一级11可电连接到第一选通线GL1。第二级12可电连接到第二选通线GL2。第三级13可电连接到第三选通线GL3。第四级14可电连接到第四选通线GL4。第五级15可电连接到第五选通线GL5。第六级16可电连接到第六选通线GL6。第七级17可电连接到第七选通线GL7。第八级18可电连接到第八选通线GL8。
第一选通线GL1可电连接到第一级11和第二选通驱动器22的第二电压线VGL。第一补偿晶体管TR1的漏极可连接到第二选通驱动器22的第二电压线VGL。第一补偿晶体管TR1的源极可电连接到第一选通线GL1的与第二选通驱动器22的第二电压线VGL相邻的一端。第一补偿晶体管TR1的栅极可电连接到第五选通线GL5。更具体地讲，第一补偿晶体管TR1的栅极可电连接到第五选通线GL5的与第二选通驱动器22的第二电压线VGL相邻的一端。连接第一补偿晶体管TR1的栅极和第五选通线GL5的导线可形成在与选通线GL1～GL8不同的层中，并与选通线GL1～GL8电隔离。
第二选通线GL2可电连接到第二级12和第一选通驱动器21的第二电压线VGL。第二补偿晶体管TR2的漏极可连接到第一选通驱动器21的第二电压线VGL。第二补偿晶体管TR2的源极可电连接到第二选通线GL2的与第一选通驱动器21的第二电压线VGL相邻的另一端。第二补偿晶体管TR2的栅极可电连接到第六选通线GL6。更具体地讲，第二补偿晶体管TR2的栅极可电连接到第六选通线GL6的与第一选通驱动器21的第二电压线VGL相邻的该另一端。
第三选通线GL3可电连接到第三级13。另外，第三选通线GL3可经由第三补偿晶体管TR3电连接到第二选通驱动器22的第二电压VGL。
第四选通线GL4可电连接到第四级14。另外，第四选通线GL4可经由第四补偿晶体管TR4电连接到第一选通驱动器21的第二电压VGL。
第五选通线GL5可电连接到第五级15。另外，第五选通线GL5可经由第五补偿晶体管TR5电连接到第二选通驱动器22的第二电压VGL。
第六选通线GL6可电连接到第六级16。另外，第六选通线GL6可经由第六补偿晶体管TR6电连接到第一选通驱动器21的第二电压VGL。
第七选通线GL7可电连接到第七级17。另外，第七选通线GL7可经由第七补偿晶体管TR7电连接到第二选通驱动器22的第二电压VGL。
第八选通线GL8可电连接到第八级18。另外，第八选通线GL8可经由第八补偿晶体管TR8电连接到第一选通驱动器21的第二电压VGL。
补偿晶体管TR1～TR8中的每一个可通过不同选通线的信号来导通/截止。例如，第n补偿晶体管可通过第(n+4)选通线上的信号导通/截止。这源自这样的事实：第n补偿晶体管可电连接到第(n+4)选通线。
图5是示出从图4的选通驱动器输出的选通脉冲的波形图。
参照图5，根据本公开第一实施方式的LCD装置的选通驱动器10在四个水平同步间隔期间将选通高压施加到每一选通线。另外，选通驱动器10按照与信号水平同步间隔对应的时间差依次将选通高压施加到选通线GL1～GL8。因此，选通线GL1～GL8可以按交叠驱动模式驱动，使得它们之间具有单个水平同步间隔的时间差。
第一补偿晶体管TR1通过从第五选通线GL5施加的选通高压来导通，并将第二电压线VGL上的选通低压传输到第一选通线GL1。换言之，与第五选通线GL5上的选通高压同步地将选通低压施加到第一选通线GL1。因此，在过去四个水平同步间隔之后选通脉冲的下降时间可减小。更具体地讲，可通过经第一补偿晶体管TR1将选通低压施加到第一选通线GL可以减小由于第一级11在供应选通高压达四个水平同步间隔之后将选通低压施加到第一选通线GL1时的阻容延迟引起的下降时间的延迟。
这样，可与第五选通线GL5上的选通高压同步地将选通低压施加到第一选通线GL1。类似地，也可与不同选通线上的选通高压同步地将选通低压施加到每一选通线。换言之，可与将选通高压施加到第(n+4)选通线的时间同步地将选通低压施加到第n选通线。因此，选通脉冲的下降时间可减小。
此外，与将两个级连接到各选通线的两端的其他构型不同，选通驱动器10允许级和补偿晶体管连接到各选通线的两端。因此，级的数量可减少。据此，选通驱动器和非显示区的尺寸可减小。这样，可实现窄边框。
图6是示出了根据本公开第二实施方式的LCD装置的选通驱动器的详细电路图。
除了级和补偿晶体管的位置上的交换之外，第二实施方式的选通驱动器具有与第一实施方式相同的构型。因此，第二实施方式与第一实施方式重复的描述将省略。
参照图6，根据本公开第二实施方式的LCD装置的LCD面板1可被限定为显示区AA和非显示区NA。非显示区NA可位于显示区AA的外侧。
选通驱动器110可形成在非显示区NA上。选通驱动器110包括第一选通驱动器121和第二选通驱动器122。选通驱动器110可包括第一级111至第八级118。
第一级111至第四级114可构成第一级组123，第五级115至第八级118可构成第二级组124。第一级组123可具有Z形的级排列，第二级组124可具有倒Z形级排列。
第一选通驱动器121可包括第一级组123内的奇数编号的级和第二级组124内的偶数编号的级。例如，第一选通驱动器121包括第一级111、第三级113、第六级116和第八级118。第一选通驱动器121还可包括第一时钟线CLK1、第一电压线VGH和第二电压线VGL。
第二选通驱动器122可包括第一级组123内的偶数编号的级和第二级组124内的奇数编号的级。例如，第二选通驱动器122包括第二级112、第四级114、第五级115和第七级117。第二选通驱动器122还可包括第二时钟线CLK2、第一电压线VGH和第二电压线VGL。
多个补偿晶体管可形成在与多个级相对的区域中。例如，第二补偿晶体管TR2、第四补偿晶体管TR4、第五补偿晶体管TR5和第七补偿晶体管TR7可形成在第一选通驱动器121内。第一补偿晶体管TR1、第三补偿晶体管TR3、第六补偿晶体管TR6和第八补偿晶体管TR8可形成在第二选通驱动器122内。换言之，与第一级组123相对的第一至第四补偿晶体管TR1至TR4可按照倒Z形排列，与第二级组124相对的第五至第八补偿晶体管TR5至TR8可按照Z形排列。
第一级111、第三级113、第六级116和第八级118可电连接到第一时钟线CLK1、第一电压线VGH和第二电压线VGL。
第二级112、第四级114、第五级115和第七级117可电连接到第二时钟线CLK2、第一电压线VGH和第二电压线VGL。
第一补偿晶体管TR1可通过第五选通线GL5上的信号导通/截止。为此，第一补偿晶体管TR1的栅极可电连接到第五选通线GL5。更具体地讲，第一补偿晶体管TR1的栅极可电连接到第五选通线GL5的在与第五级115相邻的区域中的一端。
第一级组123具有Z形级排列，第二级组124可具有倒Z形级排列。另外，第n补偿晶体管的栅极可在与第(n+4)级相邻的区域中电连接到第(n+4)选通线。
上述连接构型可减小选通脉冲的下降时间的延迟，如图7所示。在图7中，①是通过第二实施方式产生的选通脉冲的下降曲线，②是通过第一实施方式产生的选通脉冲的下降曲线。
在第二实施方式的LCD装置中，第n补偿晶体管的栅极在与第(n+4)级相邻的区域中连接到第n+4选通线。因此，当从第(n+4)级输出选通高压时，选通低压可没有任何时间延迟地立即施加到第n选通线。实际上，在第二实施方式中第n补偿晶体管的栅极与第(n+4)级之间的距离可变得比第一实施方式小。据此，可防止由于第(n+4)选通线的电阻引起的信号延迟，可将选通低压更快速地施加到第n选通线。因此，可防止或最小化选通脉冲的下降时间的延迟，另外可提高图像品质。
图8是示出了根据本公开第三实施方式的选通驱动器的详细电路图。
根据本公开第三实施方式的LCD装置的选通驱动器可实现交叠驱动模式，其以单个水平同步间隔的时间差依次在两个水平同步间隔中将选通高压施加到选通线。因此，除了级和补偿晶体管的位置上的交换之外，第三实施方式的选通驱动器具有与第一实施方式相同的构型。因此，第三实施方式与第一实施方式重复的描述将省略。
参照图8，根据本公开第三实施方式的LCD装置的LCD面板1可被限定为显示区AA和非显示区NA。非显示区NA可位于显示区AA的外侧。
选通驱动器210可形成在非显示区NA上。选通驱动器210可包括第一选通驱动器221和第二选通驱动器222。选通驱动器210可包括多个级。尽管如图所示说明了选通驱动器210包括第一级211至第四级214，但选通驱动器210不限于此。
多个级中的第(4k-3)和第(4k-2)级可设置在显示区AA的左侧和右侧，显示区AA位于之间。术语“k”是自然数。另外，多个级中的第(4k)和第(4k-1)级可设置在显示区AA的左侧和右侧，显示区AA位于之间。因此，第(4k-1)级可设置在(4k-2)级下方。
现在参照附图，第一级211和第二级212可设置在显示区AA的左侧和右侧，显示区AA位于之间。第三级213和第四级214也可设置在显示区AA的右侧和左侧，显示区AA位于之间。因此，第三级213可设置在第二级212下方。
第一选通驱动器221可包括第(4k-3)级和第(4k)级。第二选通驱动器222可包括第(4k-2)级和第(4k-1)级。
换言之，第一选通驱动器221可包括第一级211和第二级212。第二选通驱动器222可包括第三级213和第四级214。
第一选通驱动器221还可包括第一时钟线CLK1、第一电压线VGH和第二电压线VGL。第二选通驱动器221还可包括第二时钟线CLK2、第一电压线VGH和第二电压线VGL。
多个补偿晶体管可形成在与多个级相对的区域中。第一补偿晶体管TR1可通过第一选通线GL1连接到第一级211。第二补偿晶体管TR2可通过第二选通线GL2连接到第二级212。第三补偿晶体管TR3可通过第三选通线GL3连接到第三级213。第四补偿晶体管TR4可通过第四选通线GL4连接到第四级214。
补偿晶体管中的第(4k-2)和第(4k-1)补偿晶体管可包括在第一选通驱动器221中。补偿晶体管中的第(4k-3)和第(4k)补偿晶体管可包括在第二选通驱动器222中。例如，第一选通驱动器221可包括第二补偿晶体管TR2和第三补偿晶体管TR3，第二选通驱动器222可包括第一补偿晶体管TR1和第四补偿晶体管TR4。
第n补偿晶体管的栅极可电连接到与第(n+2)级连接的第(n+2)选通线。换言之，第n补偿晶体管的栅极可在与第(n+2)级相邻的区域中电连接到(n+2)选通线。例如，第一补偿晶体管TR1的栅极可在与第三级213相邻的区域中电连接到第三选通线GL3。
这样，第n补偿晶体管的栅极可电连接到与第(n+2)级连接的第(n+2)选通线。因此，选通驱动器210可以按交叠驱动模式驱动选通线，其允许选通高压以与单个水平同步间隔对应的时间差依次在两个水平同步间隔中施加到选通线。
另外，第n补偿晶体管的栅极可在与第(n+2)级相邻的区域中电连接到第(n+2)选通线。因此，选通低压可在将选通高压从第(n+2)级施加到第(n+2)选通线的时间点，没有任何时间延迟地立即施加到第k选通线。据此，可防止或最小化选通脉冲的下降时间的延迟，另外可提高图像品质。
根据本实施方式的LCD面板允许包括在选通驱动器中的级按照Z形和倒Z形中的一种排列。另外，LCD面板使得补偿晶体管能够连接到不同级的相邻区域中的选通线，这些区域与相应的级相对。因此，可防止或最小化由选通线上的阻容延迟引起的选通脉冲的下降时间的延迟。因此，可提高图像品质。
尽管仅就上述实施方式有限地说明了本公开，但本领域普通技术人员应该理解，本公开不限于这些实施方式，在不脱离本公开的精神的情况下，可对本公开进行各种改变或修改。因此，本公开的范围应仅由所附权利要求及其等同物确定。
本申请要求提交于2012年10月29日的韩国专利申请No.10-2012-0120413的优先权，该韩国专利申请以引用的方式全部并入本文。

Claims (20)

1.一种显示面板，所述显示面板包括：
多个选通线；
第一时钟线和第二时钟线；以及
选通驱动器，其被配置为包括连接到所述多个选通线的多个级，其中所述多个级分组成多个第一种编号的级和多个第二种编号的级，所述多个第一种编号的级的一端连接到所述第一时钟线，另一端连接到对应的补偿晶体管，使得显示区位于第一种编号的级与对应的补偿晶体管之间，所述多个第二种编号的级的一端连接到所述第二时钟线，另一端连接到对应的补偿晶体管，使得显示区位于第二种编号的级与对应的补偿晶体管之间。
2.根据权利要求1所述的显示面板，其中，所述多个级分成第一级组和第二级组，所述第一级组由以交替方式连接的第一种编号的级和第二种编号的级构成，并且所述第二级组由以交替方式连接的第一种编号的级和第二种编号的级构成。
3.根据权利要求2所述的显示面板，其中，所述第一级组中的第k补偿晶体管的栅极被配置为电连接到所述第二级组中的第k选通线。
4.根据权利要求2所述的显示面板，其中，所述第一级组的最后一级是第二种编号的级，所述第二级组的第一级是第二种编号的级，使得所述第二级组跟随所述第一级组。
5.根据权利要求2所述的显示面板，其中，在与所述第一级组中的级的数量对应数量的水平同步间隔将高压提供给包括在所述第一级组中的选通线。
6.根据权利要求2所述的显示面板，其中，从所述第二级组的第一级供应的高压被供应给所述第一级组的第一级的对应的补偿晶体管。
7.根据权利要求6所述的显示面板，其中，从所述第二级组的第一级供应的高压是从所述第二级组的第一级与显示区之间的节点提供的。
8.根据权利要求6所述的显示面板，其中，从所述第二级组的第一级供应的高压是从相邻区域的非显示区中的节点向显示区提供的。
9.根据权利要求6所述的显示面板，其中，供应给所述第一级组的第一级的对应的补偿晶体管的高压使所述对应的补偿晶体管导通。
10.根据权利要求9所述的显示面板，其中，如果所述第一级组的第一级的对应的补偿晶体管导通，则将低压供应给与所述第一级组的第一级对应的选通线。
11.根据权利要求1所述的显示面板，所述显示面板还包括：
被配置在所述显示区的第一侧的第一选通驱动器以及被配置在所述显示区的与所述第一侧相对的第二侧的第二选通驱动器，其中所述第一选通驱动器包括用于传输时钟信号的第一时钟线；
用于传输高压的第一电压线；以及
用于传输低压的第二电压线。
12.根据权利要求11所述的显示面板，其中，所述第二选通驱动器包括用于传输时钟信号的第二时钟线；
用于传输选通高压的第一电压线；以及
用于传输选通低压的第二电压线。
13.一种驱动显示面板的方法，所述方法包括以下步骤：
将选通驱动器配置为包括连接到多个选通线的多个级，其中所述多个级分组成多个第一种编号的级和多个第二种编号的级；
驱动所述第一种编号的级，所述第一种编号的级的一端包括第一时钟线，另一端包括对应的补偿晶体管，其中显示区位于第一种编号的级与对应补的偿晶体管之间；以及
驱动所述第二种编号的级，所述第二种编号的级的一端包括第二时钟线，另一端包括对应的补偿晶体管，使得其中显示区位于第二种编号的级与对应的补偿晶体管之间。
14.根据权利要求13所述的方法，所述方法还包括以下步骤：
驱动由以交替方式连接的第一种编号的级和第二种编号的级构成的第一级组，以及
驱动由以交替方式连接的第一种编号的级和第二种编号的级构成的第二级组。
15.根据权利要求14所述的方法，其中，驱动所述第一级组包括驱动所述第一级组的最后一级，所述最后一级是第二种编号的级，并且
其中，驱动所述第二级组包括驱动所述第二级组的第一级，所述第一级是第二种编号的级，其中所述第二级组跟随所述第一级组。
16.根据权利要求14所述的方法，其中，驱动所述第一级组和第二级组包括驱动所述第一级组中的第k补偿晶体管的栅极，所述栅极电连接到所述第二级组中的第k选通线。
17.根据权利要求14所述的方法，其中，驱动所述第一级组包括在与所述第一级组中的级的数量对应数量的水平同步间隔用高压驱动包括在所述第一级组中的选通线。
18.根据权利要求14所述的方法，其中，驱动所述第一级组和第二级组包括驱动所述第二级组的第一级以将高压供应给所述第一级组的第一级的对应的补偿晶体管。
19.根据权利要求18所述的方法，其中，从所述第二级组的第一级供应的高压是从所述第二级组的第一级与显示区之间的节点提供的。
20.根据权利要求18所述的方法，其中，从所述第二级组的第一级供应的高压是从相邻区域的非显示区中的节点向显示区提供的。
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