CN103745922A - GaN高电子迁移率晶体管复合介质绝缘栅的制造方法 - Google Patents
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Abstract
本发明公开了一种GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其通过热氧化方法将AlGaN表面氧化为氧化铝,能够有效降低介质与半导体之间的界面态。通过选择合适的钛金属,提高了HEMT器件的跨导。整个制造工艺与现有GaN HEMT工艺完全兼容。
Description
技术领域
本发明涉及一种GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,属于半导体工艺领域。
背景技术
第三代半导体材料GaN相对于硅(Si)材料具有禁带宽度宽、临界击穿场强大、饱和漂移速度高、介电常数小以及良好的化学稳定性等特点,尤其是基于GaN材料的铝镓氮/氮化镓(AlGaN/GaN)异质结构更是具有高电子迁移率的特点。使得基于AlGaN/GaN结构的高电子迁移率晶体管(High Electron MobilityTransistor,HEMT)功率电子器件具有高频率、高耐压、高工作温度和小体积等优点,使其在高性能、低成本的新型功率电子器件研究中成为热点。增强型器件是电力电子系统的首选器件,可以简化电路结构,提高系统的安全性。而传统的GaN HEMT器件均为耗尽型器件,无法满足系统需求。在AlGaN/GaN异质结材料上实现增强型器件的途径主要有以下几种:1.通过势垒层减薄,降低栅下沟道二维电子气浓度,实现增强型;2.通过在栅下方进行氟(F)离子注入,降低二维电子气浓度,实现增强型;3.通过外延的方法生长P型帽层,通过器件工艺仅保留栅下方的P型帽层,实现增强型。其中,势垒层减薄的方法具有工艺简单,要求材料结构简单等优点,但是过薄的势垒层容易引起较大的栅漏电,并降低器件的击穿电压。因此,在采用势垒层减薄法实现增强型GaN HEMT器件时,通常在栅下引入介质实现金属-绝缘体-半导体(Metal-Insulator-Semiconductor,MIS)的绝缘栅结构。
比较有代表性的MIS结构GaN HEMT功率电子器件是日本富士通公司报道的采用原子层淀积(ALD)制作的氧化铝(Al2O3)绝缘栅介质的MIS结构GaN HEMT。而采用常规方法制作绝缘栅介质,容易在介质和半导体之间产生较高的界面态。界面态将严重的影响器件性能,如引起器件阈值电压漂移等,严重影响器件的可靠性。
发明内容
发明目的:本发明提出一种GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,
技术方案:本发明采用的技术方案为一种GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,选用已完成欧姆金属制作的AlGaN/GaN异质材料基片,包括以下步骤:
1)在所述基片上生长氮化硅层;
2)通过光刻工艺和刻蚀工艺,于所述氮化硅层中刻蚀栅脚图形;
3)在与所述栅脚图形对应的AlGaN层中刻蚀接触槽;
4)所述接触槽表面氧化形成氧化铝层;
5)在整个基片表面淀积金属层,然后将该金属层氧化;
6)在所述接触槽和栅脚图形内制做栅帽。
作为本发明的一种改进,所述步骤1)中在基片上使用PECVD工艺生长氮化硅层。所述步骤2)中使用RIE工艺于所述氮化硅层中刻蚀栅脚。所述步骤3)中在与所述栅脚图形对应的AlGaN层中利用ICP工艺刻蚀接触槽。
作为本发明的又一种改进,所述步骤5)中利用电子束蒸镀工艺在整个基片表面淀积金属层。所述步骤5)中淀积的金属层为钛金属层。
作为本发明的更进一步改进,所述步骤6)中使用电子束蒸镀工艺制做栅帽。
有益效果:本发明通过热氧化方法将AlGaN表面氧化为氧化铝,能够有效降低介质与半导体之间的界面态。通过选择合适的钛金属,提高了HEMT器件的跨导。整个制造工艺与现有GaN HEMT工艺完全兼容。
附图说明
图1至图10为本发明制造形成半导体器件的示意图。
具体实施方式
下面结合附图和具体实施例,进一步阐明本发明,应理解这些实施例仅用于说明本发明而不用于限制本发明的范围,在阅读了本发明之后,本领域技术人员对本发明的各种等同形式的修改均落于本申请所附权利要求所限定的范围。
如图1所示,首先选取已完成欧姆金属制作的AlGaN/GaN异质材料基片,所述基片最下层为GaN层1,该GaN层1上方为AlGaN层2。所述AlGaN层2上通过合金工艺形成源、漏欧姆接触,源漏极3为钛/铝/钛/金结构。GaN层1与AlGaN层2之间的异质结界面处形成三角形势肼,电子在三角形势肼中的迁移率很高。在所述基片上利用等离子增强型化学气相沉积工艺生长厚度为150nm的氮化硅层4,该氮化硅层4覆盖了AlGaN层2和源漏极3。
图2所示,经过涂布光刻胶、曝光显影后,在所述氮化硅层4上形成具有栅脚图案的光刻胶层5。
图3中以该光刻胶层5为掩膜,使用反应离子刻蚀(RIE)工艺在氮化硅层4中刻蚀栅脚图形6,刻蚀时间100s。刻蚀完成后用丙酮超声去除基片表面残余的光刻胶,形成氮化硅层4中的栅脚图形6,如图4所示。
此时AlGaN层2中与所述栅脚图形6相对应的一部分露出,使用电感耦合等离子体刻蚀(ICP)工艺在氯气氛围中将上述露出部分的AlGaN层2刻蚀掉7nm,刻蚀时间为120s,如图5所示。
如图6所示,为了降低栅帽与AlGaN材料之间的界面态,使用氧化炉在氧气氛围、550摄氏度的条件下,将位于露出部被刻蚀后的AlGaN层2平面部分氧化成氧化铝层7。氧化炉是以10℃/min的速率缓慢地从室温加热到550℃。
利用电子束蒸镀工艺在整个基片表面淀积一层10nm的金属钛层8,如图7所示,所述金属钛层8覆盖了栅脚图形6以外的氮化硅层4、栅脚图形6的侧面以及所述氧化铝层7。
如图8所示,然后再次利用氧化炉在氧气氛围中,从室温以10℃/min的速率缓慢加热到550℃,将金属钛层8氧化为二氧化钛层9。
最后一步是制作栅帽11,先经过光刻胶涂布、曝光显影后获得带有栅帽图案光刻胶层10,图9所示。
再利用电子束蒸镀和剥离工艺在栅脚图形6内由下而上地淀积Ti和Au金属形成Ti/Au结构,厚度分别为20nm和200nm,并去除多余的带有栅帽图案光刻胶层10,最后形成Ti/Au结构的栅帽11,图10所示。值得注意的是,二氧化钛层9与氧化铝层7由上至下地位于栅帽11与AlGaN层2之间,其中二氧化钛层9能够有效提升器件的跨导。
Claims (7)
1.一种GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,选用已完成欧姆
金属制作的AlGaN/GaN异质材料基片,其特征在于,包括以下步骤:
1)在所述基片上生长氮化硅层;
2)通过光刻工艺和刻蚀工艺,于所述氮化硅层中刻蚀栅脚图形;
3)在与所述栅脚图形对应的AlGaN层中刻蚀接触槽;
4)所述接触槽表面氧化形成氧化铝层;
5)在整个基片表面淀积金属层,然后将该金属层氧化;
6)在所述接触槽和栅脚内制做栅帽。
2.根据权利要求1所述的GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其特征在于,所述步骤1)中在基片上使用PECVD工艺生长氮化硅层。
3.根据权利要求1所述的GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其特征在于,所述步骤2)中使用RIE工艺于所述氮化硅层中刻蚀栅脚。
4.根据权利要求1所述的GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其特征在于,所述步骤3)中在与所述栅脚图形对应的AlGaN层中利用ICP工艺刻蚀接触槽。
5.根据权利要求1所述的GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其特征在于,所述步骤5)中利用电子束蒸镀工艺在整个基片表面淀积金属层。
6.根据权利要求5所述的GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其特征在于,所述步骤5)中淀积的金属层为钛金属层。
7.根据权利要求1所述的GaN高电子迁移率晶体管复合介质绝缘栅的制造方法,其特征在于,所述步骤6)中使用电子束蒸镀工艺制做栅帽。
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C12 | Rejection of a patent application after its publication | ||
RJ01 | Rejection of invention patent application after publication |
Application publication date: 20140423 |