CN102707525A - 一种阵列基板、液晶显示面板和液晶显示装置 - Google Patents

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Abstract

本发明实施例涉及液晶显示技术领域，特别涉及一种阵列基板、液晶显示面板和液晶显示装置，用于解决现有的阵列基板中亚像素进行反转模式驱动时，在彩色显示画面下，会造成能量的损耗的问题。本发明实施例的阵列基板，包括：设置于衬底基板上的数据线、栅线及像素阵列；每条数据线连接像素阵列中至少一种类型的亚像素，且连接于同一条数据线上的同一类型的亚像素的极性相同，且同一条数据线上连接的每个亚像素连接于不同的栅线。本发明实施例通过改变阵列基板中亚像素与数据线和栅线的连接方式，使阵列基板在极性反转模式驱动时，能够大大降低能量的损耗。

Description

一种阵列基板、液晶显示面板和液晶显示装置
技术领域
本发明涉及液晶显示技术领域，特别涉及一种阵列基板、液晶显示面板和液晶显示装置。
背景技术
液晶显示器（LCD，Liquid Crystal Display）具有功耗低、辐射低及制造成本低等特点，已被广泛应用于各种电子设备中，如显示器、电视、手机、数码相机等数字电子设备。其中，TFT-LCD（Thin Film Transistor Liquid CrystalDisplay，薄膜晶体管液晶显示器）是一种主要的平板显示装置（FPD，Flat PanelDisplay）。
液晶显示器的显示原理是通过液晶分子的偏转来改变屏幕上显示的画面灰度。在液晶显示面板正常工作时，为了避免显示画面闪烁而影响显示画面的品质，液晶分子驱动一般采用正、负极性反转方式，常见的像素阵列极性反转方式为点反转（Dot Inversion）。
点反转驱动模式要求液晶显示面板的阵列基板的像素阵列中的每个亚像素（R亚像素或G亚像素或B亚像素）所存储的电压极性（即亚像素的极性）都与其上下左右相邻的亚像素的极性相反，亚像素所存储的电压高于公共电极上的电压（Vcom）时称为正极性，亚像素所存储的电压低于Vcom时称为负极性；点反转驱动模式下，阵列基板中亚像素与数据线和栅线的连接的结构如图1所示，阵列基板的像素阵列中的每个亚像素通过TFT晶体管分别与数据线（S1~S6）和栅线（G1~G4）连接，像素阵列中位于同一水平位置的亚像素为一像素行，位于同一垂直位置的亚像素为一像素列；每一根数据线（S1~S6）连接一种类型的亚像素，如数据线S1连接正极性的R亚像素和负极性的R亚像素，数据线S2连接正极性的G亚像素和负极性的G亚像素等，点反转方式下，每条数据线所连接的亚像素在每一次行扫描时都会进行正、负偏转电压的切换；但点反转方式下，由于数据线上的驱动电压始终在最大的幅值下进行切换，则液晶分子频繁的偏转会造成能量的损耗，进而增大液晶显示面板的整体功耗，如图2所示，在红色显示画面下，以数据线S2为例，在一个时钟周期内，数据线S2上的驱动电压始终在Gamma1（最大Gamma电压）和Gamma14（最小Gamma电压）之间进行切换，在这样的频繁偏转过程中会造成能量的大量损耗，从而增大液晶显示面板的整体功耗。
为了解决上述问题，提出了Z型反转（Z-Inversion），Z型反转驱动模式下，需要将阵列基板的像素阵列中相邻两列中极性相同的亚像素连接到同一条数据线上。传统的Z型反转驱动模式下，阵列基板中亚像素与数据线和栅线的连接结构如图3所示，数据线S1连接第一列中的负极性的R亚像素，数据线S2连接第一列和第二列中的正极性的R亚像素和G亚像素，数据线S3连接第二列和第三列中的负极性的G亚像素和B亚像素，……，数据线S7连接第六列中的负极性的B亚像素。Z型反转方式仅能在黑色和白色显示画面下的降低功耗，在彩色显示画面下，数据线上的电压仍然会发生比较大的电位变化，如图4所示，同样以红色画面为例，在一个时钟周期内，数据线S2上的驱动电压始终在Gamma1（最大Gamma电压）和Vcom（公共电极上的电压）之间进行切换，在这样的频繁偏转过程中会仍会造成能量的损耗，从而增大液晶显示面板的整体功耗。
综上所述，现有的阵列基板中亚像素与数据线和栅线的连接结构进行反转模式驱动时，在彩色显示画面下，会造成能量的损耗，从而增大液晶显示面板的整体功耗。
发明内容
本发明实施例提供了一种阵列基板、液晶显示面板和液晶显示装置，用于解决现有的阵列基板中亚像素与数据线和栅线的连接结构进行反转模式驱动时，在彩色显示画面下，会造成能量的损耗，从而增大液晶显示面板的整体功耗的问题。
本发明实施例提供了一种阵列基板，包括：
设置于衬底基板上的数据线、栅线及像素阵列；
其中，每条所述数据线连接所述像素阵列中至少一种类型的亚像素，且连接于同一条数据线上的同一类型的亚像素的极性相同且连接于不同的栅线。
本发明实施例提供了一种包括上述阵列基板的液晶显示面板。
本发明实施例提供了一种包括上述液晶显示面板的液晶显示装置。
本发明实施例阵列基板中每条数据线连接至少一种类型的亚像素，且连接在同一条数据线上的同一类型的亚像素的极性相同且连接于不同的栅线，通过改变阵列基板中亚像素与数据线和栅线的连接方式，使阵列基板在极性反转模式驱动时，能够大大降低能量的损耗，即使在彩色显示画面下，也能够大大降低能量的损耗，从而降低了液晶显示面板的整体功耗。
附图说明
图1为背景技术中第一种阵列基板的结构示意图；
图2为背景技术中第一种阵列基板中的亚像素进行反转时数据线上的电压示意图；
图3为背景技术中第二种阵列基板的结构示意图；
图4为背景技术中第二种阵列基板中的亚像素进行反转时数据线上的电压示意图；
图5为本发明实施例的第一种阵列基板的结构示意图；
图6为本发明实施例的第二种阵列基板的结构示意图；
图7为本发明实施例的第一种阵列基板中的亚像素进行反转时数据线上的电压示意图；
图8为本发明实施例的第三种阵列基板的结构示意图；
图9为本发明实施例的第四种阵列基板的结构示意图；
图10为本发明实施例的第五种阵列基板的结构示意图；
图11为本发明实施例的第六种阵列基板的结构示意图；
图12为本发明实施例的第七种阵列基板的结构示意图。
具体实施方式
本发明实施例通过改变阵列基板中亚像素与数据线和栅线的连接方式，使阵列基板在极性反转模式驱动时，能够大大降低能量的损耗，即使在彩色显示画面下，也能够大大降低能量的损耗，从而降低了液晶显示面板的整体功耗。
本发明实施例阵列基板包括：
设置于衬底基板上的数据线（source line）、栅线（gate line）及像素阵列，其中，每条数据线连接该像素阵列中至少一种类型的亚像素，且连接于同一条数据线上的同一类型的亚像素的极性相同且连接于不同的栅线。
本发明实施例像素阵列中的每个像素单元包括至少三种不同类型的亚像素，即R（Red，红色）亚像素、G（Green，绿色）亚像素和B（Blue，蓝色）亚像素；
本发明实施例阵列基板的数据线和栅线纵横交叉形成多个像素区域，每个像素区域中包括一个亚像素和一个开关元件（如薄膜晶体管TFT），TFT晶体管的栅极与阵列基板的栅线连接，TFT晶体管的源极与阵列基板的数据线连接，TFT晶体管的漏极与阵列基板的亚像素连接，其中，本发明实施例阵列基板中的所有亚像素按特定方式进行排列，从而形成像素阵列。
下面结合说明书附图对本发明实施例阵列基板作进一步详细描述。需要说明的是，以下实施例均以亚像素的类型包括R亚像素、G亚像素和B亚像素为例进行说明，其他情况与此类似，此处不再一一举例说明；另外，为了便于说明本发明实施例的结构，本发明实施例提供的附图均是以特定数量的数据线、栅线、亚像素为例进行说明的，该数量并非是对阵列基板中的数据线、栅线及亚像素数量的限定；阵列基板中的数据线、栅线及亚像素的数量是根据产品的设计需要而设定的。
实施例一、本发明实施例阵列基板包括：设置于衬底基板上的多条数据线、多条栅线及像素阵列，像素阵列中的每个亚像素通过开关元件分别与数据线和栅线连接；该阵列基板的像素阵列的同一像素列中的所有亚像素的类型相同，相邻两个像素列中的亚像素的类型不同，并且任一亚像素的极性与该亚像素相邻的且位于像素阵列的同一像素行及同一像素列的亚像素的极性相反；
如图5所示，本发明实施例的第一种阵列基板，其像素阵列为4（行）×6（列），第一像素列中的亚像素均为R亚像素，第二像素列中的亚像素均为G亚像素，第三像素列中的亚像素均为B亚像素，第四像素列中的亚像素均为R亚像素，依次类推；
其中，像素阵列中任一亚像素的极性与该亚像素相邻的且位于像素阵列的同一像素行及同一像素列的亚像素的极性相反，如图5所示的像素阵列中位于第二像素行第二像素列的G亚像素的极性为正极性（G+），与其相邻的且位于同一像素行（即第二像素行）的亚像素为位于第二像素行第一像素列的负极性R亚像素（R-）及位于第二像素行第三像素列的负极性B亚像素（B-），与其相邻的且位于同一像素列（即第二像素列）的亚像素为位于第一像素行第二像素列的负极性G亚像素（G-）及位于第三像素行第二像素列的负极性G亚像素（G-）。
本实施例中每条数据线连接至少一个像素列中类型相同且极性相同的亚像素，且与同一条数据线连接的亚像素连接于不同的栅线。如图5所示的第一种阵列基板，其数据线S1连接负极性R亚像素，数据线S2连接正极性G亚像素，数据线S3连接负极性B亚像素，数据线S4连接正极性R亚像素，数据线S5连接负极性G亚像素，数据线S6连接正极性B亚像素；栅线G1~G4分别连接像素阵列中第一像素行、第二像素行、第三像素行和第四像素行。
优选的，每条数据线连接两个像素列中类型相同且极性相同的亚像素。
如图5所示的第一种阵列基板，数据线S1连接第一像素列中的负极性R亚像素（R-）和第四像素列中的R-，数据线S2连接第二像素列中的正极性G亚像素（G+）和第五像素列中的G+，数据线S3连接第三像素列中的负极性B亚像素（B-）和第六像素列中的B-，数据线S4连接第一像素列中的正极性R亚像素（R+）和第四像素列中的R+，数据线S5连接第二像素列中的负极性G亚像素（G-）和第五像素列中的G-，数据线S6连接第三像素列中的正极性B亚像素（B+）和第六像素列中的B+。
如图6所示的第二种阵列基板，其像素阵列为4（行）×12（列），数据线S1连接第一像素列中的R-和第四像素列中的R-，数据线S2连接第二像素列中G+和第五像素列中的G+，数据线S3连接第三像素列中的B-和第六像素列中的B-，数据线S4连接第一像素列中的R+和第四像素列中的R+，数据线S5连接第二像素列中的G-和第五像素列中的G-，数据线S6连接第三像素列中的B+和第六像素列中的B+，依次类推。
需要说明的是，只要能够保证同一条数据线连接的同一类型的亚像素连接于不同的栅线，同一条数据线可以连接任意两个像素列；如图6中的数据线S1还可以连接第一像素列中的R+和第十像素列中的R+；但图6中的数据线S1不能连接第一像素列中的R+和第七像素列中的R+。
需要说明的是，图5和图6所示的实施例均以同一条数据线连接两个同类型像素列中极性相同的亚像素为例进行说明的，同一条数据线连接三个及三个以上同类型像素列中极性相同的亚像素的情况与其类此，此处不再赘述。
优选的，本实施例的每条数据线连接两个像素列中类型相同且极性相同的亚像素，且与该数据线连接的所有亚像素连接不同的栅线。
以图5所示的第一种阵列基板为例，对其亚像素进行反转时数据线上的电压进行说明。
与第一种阵列基连接的TCON（Timing Controller，时序控制器）内部进行数据的色度控制等处理时，会将显示画面按照各亚像素转换为对应的TTL（Transistor-to-Transistor Logic）数字信号，在TTL数字信号输出之前再将其转换为mini-LVDS（LVDS，Low Voltage Differential Signaling）格式，即依照需要加载到液晶显示面板上的亚像素顺序，将各数字信号按照mini-LVDS的格式进行映射，并将处理后的数据信号、控制信号及时钟信号传送至Source DriverIC（源驱动器IC），TCON的功能是色度控制和时序控制，具有数据反转、像素极性反转功能。
图5所示的第一种阵列基板TCON采用如表1所示的Data mapping（数据映射），以1366*768分辨率为例进行说明；
表1
其中，表1中所示的LV0~LV5分别表示mini-LVDS信号的六对差分数据线S1~S6，表1中各单元格的内容表示mini-LVDS信号线上传输的数据，一列单元格中的数据表示同一时刻由TCON传输到Driver IC时需要显示的内容；1st Line表示液晶显示面板扫描第一像素行时，数据线上需要加载的数据，2ndLine表示液晶显示面板扫描第二像素行时，数据线上需要加载的数据，依次类推；其中，每个单元格内的数字部分表示亚像素在像素阵列中对应的位置。
采用表1所示的Data mapping，第一像素行对应的TFT开启时，S1~S6数据线上依次对应表1中第一列的数据，即2R、2G、2B、1R、1G、1B，依次类推，通过阵列基板上数据线，将电压信号加载到该数据线连接的第一像素行中的各亚像素。
如图5所示的第一种阵列基板中的亚像素进行反转时，数据线上的电压变化如图7所示，同样以红色显示画面为例，在一个时钟周期内，数据线S2上的驱动电压能够在较长的时间内保持在Gamma1电压，大大减小了能量的损耗，从而能够降低液晶显示器的整体功耗。
同时图5所示的第一种阵列基板与背景技术中图3所示的阵列基板相比，在相同分辨率下，图5所示的第一种阵列基板采用六条数据线，而图3所示的阵列基板采用七条数据线，即需要额外添加一条数据线，通常Driver IC通道数与显示像素的数量一一对应，图5所示的连接方法不需要额外的数据线，传统的Driver IC即可使用，而背景技术中图3所示的阵列基板中需要额外的至少一个数据通道，则需要在传统的Driver IC基础上修改增加通道数，因此，图5所示的第一种阵列基板增强了Source Driver IC的通用性。
实施例二、其阵列基板的像素阵列的排列与实施例一相同，该阵列基板还包括额外增加的至少三条特殊数据线，额外增加的特殊数据线的数量与亚像素类型的数量相等，例如，若亚像素类型包括三种（R亚像素、G亚像素和B亚像素），则需要额外增加三条数据线；又如，若亚像素类型包括四种（R亚像素、G亚像素、B亚像素和W亚像素），则需要额外增加四条数据线；本实施例以亚像素类型包括R亚像素、G亚像素和B亚像素为例进行说明，其他情况与此类似，此处不再赘述。
该阵列基板额外增加的三条特殊数据线分别为第一特殊数据线、第二特殊数据线和第三特殊数据线；其中，第一特殊数据线、第二特殊数据线与第三特殊数据线分别与同一像素单元中的不同类型的亚像素连接，且与第一特殊数据线、第二特殊数据线与第三特殊数据线连接的所有像素单元中同一类型的亚像素极性相同，且与第一特殊数据线、第二特殊数据线与第三特殊数据线连接的所有像素单元中的亚像素分别位于第一像素列、第二像素列和第三像素列。
如图8所示的本发明实施例第三种阵列基板，包括：数据线S1~S6、栅线G1~G3和像素阵列（3×6），其中像素阵列中的每个亚像素通过开关元件分别与数据线S1~S6和栅线G1~G3连接；
该第三种阵列基板的像素阵列中同一像素列中的所有亚像素的类型相同，且该第三种阵列基板的任意相邻两个像素列中的亚像素的类型不同，如图8所示，第一像素列中的亚像素均为R亚像素，第二像素列中的亚像素均为G亚像素，第三像素列中的亚像素均为B亚像素，依次类推；且该第三种阵列基板的像素阵列中任一亚像素的极性与该亚像素相邻的且位于像素阵列的同一像素行及同一像素列的亚像素的极性相反；
该第三种阵列基板还包括额外增加的三条特殊数据线，如图8所示，第一特殊数据线Sa、第二特殊数据线Sb和第三特殊数据线Sc；其中，第一特殊数据线Sa与像素阵列的第一像素列第二像素行中的R-连接，第二特殊数据线Sb与第二像素列第二像素行中的G+连接，第三特殊数据线Sc与第三像素列第二像素行中的B-连接，位于同一像素行且位于相邻的三个像素列的亚像素组成一个像素单元，如图8中位于第一像素行且分别位于第一像素列、第二像素列和第三像素列的R+、G-和B+组成一个像素单元，位于第二像素行且分别位于第一像素列、第二像素列和第三像素列的R+、G-和B+组成一个像素单元，依次类推；
当然，阵列基板中的第一特殊数据线Sa也可以与像素阵列的第一像素列中的R+连接，第二特殊数据线Sb也可以与第二像素列中同G-连接，第三特殊数据线Sc与第三像素列中B+连接。
该第三种阵列基板的数据线S1~S6、栅线G1~G3与像素阵列中的各个亚像素的连接与图5所示的阵列基板类似，此处不再赘述。
图8所示的第三种阵列基板对应的Data mapping如表2所示，仍以1366*768分辨率为例进行说明。
Figure BDA00001677939800091
表2
需要说明的是，表2中各物理量含义与表1相同，此处不再赘述。其中，在显示信号前端增加DUMMY（空）信号，如图8所示的阵列基板，第一像素行的亚像素加载信号时，由于数据线Sa~Sc没有连接第一像素行中的亚像素，因此需要在显示的有效数据前插入DUMMY（空）信号。以上数据处理的过程，皆在TCON内部进行数据映射的阶段完成。
如图9所示的本发明实施例第四种阵列基板，包括：数据线S1~S9、栅线G1~G3和像素阵列（3×9），其中像素阵列中的每个亚像素通过开关元件分别与数据线S1~S9和栅线G1~G3连接；
如图9所示的第四种阵列基板的像素阵列中同一像素列中的所有亚像素的类型相同，且该第三种阵列基板的任意相邻两个像素列中的亚像素的类型不同；且任一亚像素的极性与该亚像素相邻的且位于像素阵列的同一像素行及同一像素列的亚像素的极性相反；
如图9所示的第四种阵列基板还包括额外增加的三条数据线，即第一特殊数据线Sa、第二特殊数据线Sb和第三特殊数据线Sc；其中，第一特殊数据线Sa与像素阵列的第一像素列及第二像素行中的R-连接，第二特殊数据线Sb与第二像素列第二像素行中的G+连接，第三特殊数据线Sc与第三像素列第二像素行的中B-连接；当然，本实施例的第一特殊数据线Sa也可以与像素阵列的第一像素列第一像素行中的R+连接，第二特殊数据线Sb也可以与第二像素列第一像素行中的同G-连接，第三特殊数据线Sc与第三像素列第一像素行中的B+连接。
该第四种阵列基板的数据线S1~S9、栅线G1~G3与像素阵列中的各个亚像素的连接与图5所示的阵列基板类似，此处不再赘述。
优选的，本实施例阵列基板中每条数据线（不包括额外增加的特殊数据线）连接两个像素列中类型相同且极性相同的亚像素，且与该数据线连接的所有亚像素连接不同的栅线。
具体的，可以将三个相邻且分别包含R亚像素、G亚像素和B亚像素的像素列设为一组，依次将多个像素列分成多个组，则与同一条数据线连接的至少两个像素列可以是相邻的组中亚像素类型相同的像素列，如图8和图9所示的阵列基板，也可以是不相邻的组中亚像素类型相同的像素列。
需要说明的是，图8和图9所示的实施例均以同一条数据线连接两个同类型像素列中极性相同的亚像素为例进行说明的，同一条数据线连接三个及三个以上同类型像素列中极性相同的亚像素的情况与其类此，此处不再赘述。
本发明实施例二的阵列基板在现有的阵列基板（图1所示的阵列基板）的基础上额外增加了三条数据线，分别连接像素的R、G、B三个亚像素；与实施例一的阵列基板的连接方式相比，其优点在于Array走线区域更容易实现，可以兼容使用常规Z-Inversion Data mapping。
实施例三、本实施例提供的阵列基板包括：设置于衬底基板上的数据线、栅线及像素阵列，像素阵列中的每个亚像素通过开关元件分别与数据线和栅线连接；本实施例阵列基板的像素阵列的排列方式与实施例一不同，本实施例像素阵列中位于同一像素行中的所有亚像素的类型相同，且每个像素列包括至少一个像素单元，其中每个所述像素单元至少包括R亚像素、G亚像素和B亚像素。
本实施例阵列基板中每条数据线连接至少一个像素列的至少一个像素单元，且与同一条数据线连接的所有像素单元中同一类型的亚像素的极性相同。
如图10所示的第五种阵列基板，包括：数据线S1~S4、栅线G1~G9和像素阵列，其中像素阵列为9（行）×3（列），第一像素行中的亚像素均为R亚像素，第二像素行中的亚像素均为G亚像素，第三像素行中的亚像素均为B亚像素，第四像素行中的亚像素均为R亚像素，依次类推；第一像素列包括三个像素单元，第一个像素单元包括第一像素行第一像素列中的R+、第二像素行第一像素列中的G-和第三像素行第一像素列中的B+；第二个像素单元包括第四像素行第一像素列中的R-、第五像素行第一像素列中的G+和第六像素行第一像素列中的B-；第三个像素单元包括第七像素行第一像素列中的R+、第八像素行第一像素列中的G-和第九像素行第一像素列中的B+，依次类推。
本实施例数据线S1连接第一像素列的第二个像素单元；数据线S2连接第一像素列的第一个像素单元、第三个像素单元和第二像素列的第二个像素单元，依次类推；其中，与每条数据线连接的所有像素单元中同一类型的亚像素的极性相同，如图10所示，与数据线S2连接的三个像素单元中R亚像素均为负极、G亚像素均为正极和B亚像素均为负极。
优选的，每条数据线连接两个像素列中同一类型的亚像素的极性相同的像素单元；如图10所示，数据线S2连接第一像素列和第二像素列中的像素单元，数据线S3连接第二像素列和第三像素列中的像素单元。
需要说明的是，与同一条数据线连接的两个像素列可以为相邻的像素列，也可以为不相邻的像素列。
图10所示的第五种阵列基板对应的Data mapping如表3所示。
Figure BDA00001677939800121
表3
表3中各物理量的含义与表1、表2相同，此处不再赘述。由于图10所示的阵列基板中像素阵列的排列方式与图5和图8所示的阵列基板不同，图10所示的像素阵列中同一像素行的亚像素类型相同，如第一像素行为R亚像素，第二像素行为G亚像素，第三像素行为B亚像素，依次类推。因此，在TCON内部进行数据映射时，将第一像素行中所有的R亚像素数据映射到mini-LVDS的第一行对应的数据位上，依次类推。
本实施例阵列基板中像素阵列的像素列采用R亚像素、G亚像素、B亚像素依次垂直排列的方式，将相邻的三个亚像素（R亚像素、G亚像素和B亚像素）作为一个整体，并与数据线连接，其优点在于改变像素阵列的排列方式，能够进一步简化Array走线难度，同时减少source output channel数量，能够很大程度上降低成本。
实施例四、本实施例提供的阵列基板的像素阵列的排列方式与实施例一相同，但像素阵列中的每个亚像素与数据线、栅线的连接方式不同，具体为：
每条数据线连接至少一个像素列的至少一个像素单元，且与同一条数据线连接的所有像素单元中同一类型的亚像素的极性相同，其中，每个像素列包括至少一个像素单元，其中每个像素单元包括R亚像素、G亚像素和B亚像素。
如图11所示的第六种阵列基板，包括：数据线S 1~S3、栅线G1~G9和像素阵列，其中像素阵列为3（行）×6（列），第一像素列中的亚像素均为R亚像素，第二像素列中的亚像素均为G亚像素，第三像素列中的亚像素均为B亚像素，第四像素列中的亚像素均为R亚像素，依次类推；第一像素行包括两个像素单元，第一个像素单元包括第一像素行第一像素列的R+、第一像素行第二像素列的G-和第一像素行第三像素列的B+；第二像素单元包括第一像素行第四像素列的R-、第一像素行第五像素列的G+和第一像素行第六像素列的B-；依次类推；
本实施例中数据线S1连接第二像素行的第一个像素单元；数据线S2连接第一像素行的第一个像素单元、第二像素行的第二个像素单元和第三像素行的第一个像素单元；数据线S3连接第一像素行的第二个亚像素组和第三像素行的第二个亚像素组；其中，与每条数据线连接的所有像素单元中同一类型的亚像素的极性相同，如图11所示，与数据线S2连接的所有像素单元中的R亚像素均为正极、G亚像素均为负极和B亚像素均为正极。
优选的，每条所述数据线连接两个像素列中同一类型的亚像素的极性相同的像素单元，如图11所示，数据线S2连接第一像素行、第二像素行和第三像素行中的像素单元，数据线S3连接第二像素列和第三像素列中的像素单元。
需要说明的是，与同一条数据线连接的两个像素行可以为相邻的像素行，也可以为不相邻的像素行。
本实施例的阵列基板与实施例三的阵列基板采用相同的Data mapping，如表3所示，此处不再赘述。
本实施例阵列基板中像素阵列的像素行采用R亚像素、G亚像素、B亚像素依次水平排列的方式，将相邻的三个亚像素（R亚像素、G亚像素和B亚像素）作为一个整体，并与数据线连接，能够进一步简化Array走线难度，同时减少source output channel数量，能够很大程度上降低成本。
本发明实施例亚像素的类型至少包括R亚像素、B亚像素和G亚像素，亚像素的类型还可能包括W（White，白色）亚像素、Y（Yellow，黄色）亚像素等其他类型的亚像素。
下面仅以图5的连接方式为例，对像素阵列包括R亚像素、B亚像素、G亚像素和W亚像素的阵列基板进行说明，需要说明的是，像素阵列包括其他类型亚像素或更多的亚像素类型都与此类似，此处不再一一举例；像素阵列包括其他类型亚像素或更多的亚像素类型的情况下，各亚像素与数据线及栅线的其他连接方式均与上述实施例类似，此处不再一一举例。
如图12所示，本发明实施例的第七种阵列基板，其像素阵列为4（行）×8（列），第一像素列中的亚像素均为R亚像素，第二像素列中的亚像素均为G亚像素，第三像素列中的亚像素均为B亚像素，第四像素列中的亚像素均为W亚像素，第五像素列中的亚像素均为R亚像素，依次类推；
其中，像素阵列中任一亚像素的极性与该亚像素相邻的且位于像素阵列的同一像素行及同一像素列的亚像素的极性相反，如图12所示的像素阵列中位于第二像素行第二像素列的G亚像素的极性为正极性（G+），与其相邻的且位于同一像素行（即第二像素行）的亚像素为位于第二像素行第一像素列的负极性R亚像素（R-）及位于第二像素行第三像素列的负极性B亚像素（B-），与其相邻的且位于同一像素列（即第二像素列）的亚像素为位于第一像素行第二像素列的负极性G亚像素（G-）及位于第三像素行第二像素列的负极性G亚像素（G-）。
本实施例中每条数据线连接至少一个像素列中类型相同且极性相同的亚像素，且与同一条数据线连接的亚像素连接于不同的栅线。如图12所示的阵列基板，数据线S1连接负极性R亚像素，数据线S2连接正极性G亚像素，数据线S3连接负极性B亚像素，数据线S4连接正极性W亚像素，数据线S5连接正极性R亚像素，数据线S6连接负极性G亚像素；数据线S7连接正极性B亚像素；数据线S8连接负极性W亚像素；栅线G1~G4分别连接像素阵列中第一像素行、第二像素行、第三像素行和第四像素行。
优选的，每条数据线连接两个像素列中类型相同且极性相同的亚像素。
如图12所示的阵列基板，数据线S1连接第一像素列中的负极性R亚像素（R-）和第五像素列中的R-，数据线S2连接第二像素列中的正极性G亚像素（G+）和第六像素列中的G+，数据线S3连接第三像素列中的负极性B亚像素（B-）和第七像素列中的B-，数据线S4连接第四像素列中的正极性W亚像素（R+）和第八像素列中的R+，依次类推。
本发明实施例提供了一种液晶显示面板，包括上述任一结构的阵列基板。
本发明实施例提供了一种液晶显示装置，包括上述的液晶显示面板。
尽管已描述了本发明的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例作出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本发明范围的所有变更和修改。
本发明实施例阵列基板中每条数据线连接至少一种类型的亚像素，且连接在同一条数据线上的同一类型的亚像素的极性相同且连接于不同的栅线，通过改变阵列基板中亚像素与数据线和栅线的连接方式，使阵列基板在极性反转模式驱动时，能够大大降低能量的损耗，即使在彩色显示画面下，也能够大大降低能量的损耗，从而降低了液晶显示面板的整体功耗。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (12)

1.一种阵列基板，其特征在于，该阵列基板包括：
设置于衬底基板上的数据线、栅线及像素阵列；
其中，每条所述数据线连接所述像素阵列中至少一种类型的亚像素，且连接于同一条数据线上的同一类型的亚像素的极性相同，且同一条数据线上连接的每个亚像素连接于不同的栅线。
2.如权利要求1所述的阵列基板，其特征在于，所述像素阵列中同一像素列中的所有亚像素的类型相同，且相邻两个像素列中的亚像素的类型不同。
3.如权利要求2所述的阵列基板，其特征在于，每条所述数据线连接至少一个像素列中类型相同且极性相同的亚像素。
4.如权利要求3所述的阵列基板，其特征在于，每条所述数据线连接两个像素列中类型相同且极性相同的亚像素。
5.如权利要求2所述的阵列基板，其特征在于，每条所述数据线连接至少一个像素列的至少一个像素单元，且与同一条数据线连接的所有像素单元中同一类型的亚像素的极性相同；其中，每个所述像素单元至少包括R亚像素、G亚像素和B亚像素。
6.如权利要求5所述的阵列基板，其特征在于，每条所述数据线连接两个像素列中同一类型的亚像素的极性相同的像素单元。
7.如权利要求1所述的阵列基板，其特征在于，所述像素阵列的同一像素行中的所有亚像素的类型相同，且每个像素列包括至少一个像素单元，其中每个所述像素单元至少包括R亚像素、G亚像素和B亚像素。
8.如权利要求7所述的阵列基板，其特征在于，每条所述数据线连接至少一个像素列的至少一个像素单元，且与同一条数据线连接的所有像素单元中同一类型的亚像素的极性相同。
9.如权利要求8所述的阵列基板，其特征在于，每条所述数据线连接两个像素列中同一类型的亚像素的极性相同的像素单元。
10.如权利要求1~9任一所述的阵列基板，其特征在于，所述亚像素的类型至少包括R亚像素、G亚像素和B亚像素。
11.一种液晶显示面板，其特征在于，该液晶显示面板包括如权利要求1~10任一所述的阵列基板。
12.一种液晶显示装置，其特征在于，该液晶显示装置包括如权利要求11所述的液晶显示面板。
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