CN101047130B - 使用纳米颗粒的顶栅薄膜晶体管及其制造方法 - Google Patents

使用纳米颗粒的顶栅薄膜晶体管及其制造方法 Download PDF

Info

Publication number
CN101047130B
CN101047130B CN2007100007763A CN200710000776A CN101047130B CN 101047130 B CN101047130 B CN 101047130B CN 2007100007763 A CN2007100007763 A CN 2007100007763A CN 200710000776 A CN200710000776 A CN 200710000776A CN 101047130 B CN101047130 B CN 101047130B
Authority
CN
China
Prior art keywords
film
nano
substrate
resilient coating
gate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
CN2007100007763A
Other languages
English (en)
Other versions
CN101047130A (zh
Inventor
金相植
赵庚娥
金东垣
张宰源
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Industry Academy Collaboration Foundation of Korea University
Original Assignee
Industry Academy Collaboration Foundation of Korea University
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Priority claimed from KR1020060098467A external-priority patent/KR100792407B1/ko
Application filed by Industry Academy Collaboration Foundation of Korea University filed Critical Industry Academy Collaboration Foundation of Korea University
Publication of CN101047130A publication Critical patent/CN101047130A/zh
Application granted granted Critical
Publication of CN101047130B publication Critical patent/CN101047130B/zh
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0657Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
    • H01L29/0665Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body the shape of the body defining a nanostructure
    • H01L29/0669Nanowires or nanotubes
    • BPERFORMING OPERATIONS; TRANSPORTING
    • B82NANOTECHNOLOGY
    • B82YSPECIFIC USES OR APPLICATIONS OF NANOSTRUCTURES; MEASUREMENT OR ANALYSIS OF NANOSTRUCTURES; MANUFACTURE OR TREATMENT OF NANOSTRUCTURES
    • B82Y10/00Nanotechnology for information processing, storage or transmission, e.g. quantum computing or single electron logic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0657Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
    • H01L29/0665Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body the shape of the body defining a nanostructure
    • H01L29/0669Nanowires or nanotubes
    • H01L29/0673Nanowires or nanotubes oriented parallel to a substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/78681Thin film transistors, i.e. transistors with a channel being at least partly a thin film having a semiconductor body comprising AIIIBV or AIIBVI or AIVBVI semiconductor materials, or Se or Te
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/78696Thin film transistors, i.e. transistors with a channel being at least partly a thin film characterised by the structure of the channel, e.g. multichannel, transverse or longitudinal shape, length or width, doping structure, or the overlap or alignment between the channel and the gate, the source or the drain, or the contacting structure of the channel

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Nanotechnology (AREA)
  • Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Materials Engineering (AREA)
  • Mathematical Physics (AREA)
  • Theoretical Computer Science (AREA)
  • Thin Film Transistor (AREA)

Abstract

本发明涉及制造使用纳米颗粒的薄膜晶体管的方法以及通过该方法制造的薄膜晶体管。在衬底上沉积亲水性缓冲层,以促进纳米颗粒膜的形成。将烧结的纳米颗粒用作有源层,将高介电系数的介电材料用作栅极介电层,以在栅极介电层上形成顶栅电极,由此能够实现低电压运行和低温制造。

Description

使用纳米颗粒的顶栅薄膜晶体管及其制造方法
技术领域
本发明涉及制造使用纳米颗粒的薄膜晶体管的方法以及通过该方法制造的薄膜晶体管。更具体而言,本发明涉及在柔性衬底上使用纳米颗粒形成的顶栅薄膜晶体管及其制造方法,其中在衬底上沉积亲水性缓冲层,以促进纳米颗粒膜的形成,并且利用烧结的纳米颗粒作为薄膜晶体管的沟道层,还利用高介电常数的介电材料作为栅极层,以在栅极介电层上形成顶栅电极(top gate electrode),由此能够实现低电压运行和低温制造。
背景技术
通常,目前用于包括液晶显示器(LCD)的平板显示器中的场效应薄膜晶体管是通过利用非晶硅(a-Si:H)或多晶硅作为沟道层以及利用氧化硅或氮化硅作为栅极介电层来制造的。
近年来,已经对使用有机材料例如并五苯或六噻吩制造薄膜晶体管进行了大量的研究,以期能够实现低温处理和低成本制造。但是,这种有机薄膜晶体管在迁移率、物理和化学稳定性等方面具有内在的缺陷。此外,难于将有机薄膜晶体管直接应用于目前为无机半导体所研究的工艺中。
为了克服这些困难,B.A.Ridley,B.Nivi和J.M.Jacobson在MIT于1999年使用CdSe纳米颗粒来制造薄膜晶体管(参见Science,vol.286,p.746)。
在该研究中,已经制造了具有约1cm2/Vsec的场效应迁移率和104或更大的开/关电流比的代表性晶体管,从而提出具有由纳米颗粒组成的沟道的薄膜晶体管的可能性。在2005年,D.V.Talapin和C.B.Murray在IBM也制造出具有由PbSe纳米颗粒组成的沟道的薄膜晶体管(参见Science,vo1.310,p.86)。
在该研究中,在纳米颗粒膜上对肼进行化学处理,以改善膜的导电性。此外,通过热处理制造n-或p-沟道晶体管。当以这种方式使用无机半导体纳米颗粒时,可以获得如有机薄膜晶体管中的溶液态的工艺优点,并且还可以解决与有机材料有关的基本问题。
但是,迄今为止使用无机半导体纳米颗粒研制的晶体管,包括大多数有机薄膜晶体管,是背栅晶体管,其使用SiO2即氧化硅衬底作为栅极介电层。因此,需要几十伏或更高的栅极电压来使晶体管运行。
发明内容
构思本发明以解决现有技术中的上述问题。本发明的一个目的是提供具有在柔性衬底上形成的由纳米颗粒膜组成的沟道的顶栅薄膜晶体管及其制造方法,其中在柔性衬底上沉积亲水性缓冲层,以促进纳米颗粒膜的形成,使用烧结的纳米颗粒作为沟道层并在纳米颗粒膜上形成栅极介电层,由此能够实现低电压运行和低温制造。
为了实现该目的,根据本发明,提供一种制造使用纳米颗粒的薄膜晶体管的方法,包括以下步骤:在衬底上形成纳米颗粒膜并烧结该膜;在纳米颗粒膜上形成源和漏电极;在其上形成有源和漏电极的纳米颗粒膜上沉积介电材料以形成栅极介电层;和在栅极介电层上形成顶栅电极。
本发明的方法还包括使用亲水性材料在衬底和纳米颗粒膜之间沉积缓冲层的步骤。
优选的是,衬底选自硅衬底、玻璃衬底和柔性衬底。
优选的是,柔性衬底是塑料衬底,并且塑料衬底是PET(聚对苯二甲酸乙二醇酯)、PEN(聚萘二酸乙二醇酯Polyethyle Napthalate)、PC(聚碳酸酯)和PES(聚醚砜)中的一种。
缓冲层可以由亲水性无机材料或亲水性有机材料形成。优选的是,亲水性无机材料选自Al2O3、HfO2、Ta2O5、La2O3和SiO2
亲水性无机材料可以利用原子层沉积(ALD)法或溅射法或金属有机化学气相沉积(MOCVD)法来形成。
优选的是,有机材料选自AIDCN、聚苯胺、Cd-AA(花生酸盐)、PVP、PVA和PEDOT。此外,可以通过使用O3作为反应气体的紫外处理或使用O2作为反应气体的等离子体处理来使有机材料的表面亲水化。
有机材料可以通过旋涂法、喷涂法、Langmuir-Blodgett法和印刷法中的任意一种来沉积。
优选的是,缓冲层具有2~20nm的厚度。
优选的是,缓冲层在100~150℃的温度下沉积在衬底上。
形成纳米颗粒膜的步骤包括以下步骤:通过将纳米颗粒分散在溶剂中来制备纳米颗粒溶液;将沉淀剂和纳米颗粒溶液混合;和将含有沉淀剂的纳米颗粒溶液沉积在衬底上。
优选的是,纳米颗粒选自HgTe、HgSe、HgS、CdTe、CdSe、CdS、ZnTe、ZnSe、ZnS、PbTe、PbSe、PbS和ZnO。含有沉淀剂的纳米颗粒溶液可以通过旋涂法、深涂(deep coating)法、冲压法、喷涂法、Langmuir-Blodgett法以及印刷法中的任意一种来沉积在衬底上。
优选的是,烧结步骤在100~185℃的温度下进行10~200分钟。
优选的是,通过在纳米颗粒膜上沉积高介电常数的介电材料来形成栅极介电层,并且介电材料是无机材料例如Al2O3、HfO2、Ta2O5、La2O3、SiO2中的任意一种,或者是有机材料例如AIDCN、聚苯胺、花生酸盐、PVP、PVA、PEDOT中的任意一种。
优选的是,当高介电常数的介电材料沉积在纳米颗粒膜上时,衬底具有100~185℃的温度并且栅极介电层具有10~500nm的厚度。
根据本发明的另一方面,提供具有由纳米颗粒组成的沟道的顶栅薄膜晶体管,其包含:通过在柔性衬底上沉积亲水性材料而形成的缓冲层;在缓冲层上沉积并烧结的纳米颗粒膜;形成在纳米颗粒膜上的源和漏电极;通过在其上形成有源和漏电极的纳米颗粒膜上沉积介电材料而形成的栅极介电层;和形成在栅极介电层上的顶栅电极。
附图说明
通过结合附图对优选实施方案的下列描述,本发明的上述和其它目的、特征和优点将变得显而易见,其中:
图1~4是说明根据本发明的实施方案,使用纳米颗粒在柔性衬底上制造顶栅薄膜晶体管的方法的截面图;
图5是表示根据本发明实施方案,在150℃下烧结180分钟的HgTe纳米颗粒膜的电流的测量图;
图6是表示根据本发明实施方案的顶栅薄膜晶体管的光学显微图;
图7是表示根据本发明实施方案,使用塑料衬底制造的顶栅晶体管的光学显微图;
图8是表示根据本发明实施方案,使用塑料衬底制造的顶栅晶体管的弯曲状态的光学显微图;和
图9和10是表示根据本发明实施方案形成在塑料衬底上的顶栅晶体管的特性图。
具体实施方式
下文中,将参考附图详细说明根据本发明制造使用纳米颗粒的薄膜晶体管的方法的优选实施方案。
根据本发明的制造使用纳米颗粒的薄膜晶体管的方法基本包括以下步骤:在衬底上形成纳米颗粒膜并烧结该纳米颗粒膜,在纳米颗粒膜上形成源和漏电极,通过在形成有源和漏电极的纳米颗粒膜上沉积介电材料来形成栅极介电层,和在栅极介电层上形成顶栅电极。
根据本发明的制造使用纳米颗粒的薄膜晶体管的方法还包括使用亲水性材料在衬底和纳米颗粒膜之间沉积缓冲层的步骤。此时,衬底可以是硅衬底、玻璃衬底和柔性衬底中的任意一种。
下文中,将仅描述根据本发明制造使用纳米颗粒的薄膜晶体管的方法,其包括在衬底和纳米颗粒膜之间使用亲水性材料形成的缓冲层。但是,下面的说明同样适用于制造使用纳米颗粒但不包括缓冲层的薄膜晶体管的方法。
图1~4是说明根据本发明制造使用纳米颗粒的顶栅薄膜晶体管的方法的截面图。
如图1所示,使用亲水性材料在柔性衬底10上形成缓冲层15。多种衬底可用作柔性衬底10,只要它们仅仅为柔性即可。例如,可以使用柔性塑料衬底。
由于本发明的薄膜晶体管可以在低温过程中制造,因此可以使用塑料衬底。在使用柔性塑料衬底作为柔性衬底10的情况下,可以使用诸如PET(聚对苯二甲酸乙二醇酯)、PEN(聚萘二酸乙二醇酯)、PC(聚碳酸酯)和PES(聚醚砜)的任意一种塑料衬底。
形成在塑料衬底10上的缓冲层15由亲水性无机材料和亲水性有机材料形成。亦即,缓冲层15可以由无机或有机材料形成。优选的是,缓冲层由亲水性材料形成。
在缓冲层15由亲水性无机材料形成的情况下,可以使用诸如Al2O3、HfO2、Ta2O5、La2O3和SiO2的任意一种无机材料。可以通过多种方法来沉积亲水性无机材料,Al2O3。在本发明中,可使用ALD、MOCVD和溅射在塑料衬底10上沉积诸如Al2O3、HfO2、Ta2O5、La2O3和SiO2的任意一种无机材料,使得可形成缓冲层15。
一方面,在缓冲层15由亲水性有机材料形成的情况下,其选自诸如AIDCN、聚苯胺、Cd-AA(花生酸盐)、PVP、PVA和PEDOT的任意一种有机材料。应该处理有机材料以表现出亲水性能。因此,通过使用O3作为反应气体的紫外处理或使用O2作为反应气体的等离子体处理来处理有机材料,以使其具有亲水表面。
亲水性有机材料可以通过多种方法来沉积。本发明可以采用旋涂法、喷涂法、Langmuir-Blodgett法和印刷法中的任意一种。
可以形成具有多种厚度的缓冲层15。优选沉积具有2~20nm厚度的缓冲层15。当形成具有上述厚度的缓冲层15时,其在100~150℃的相对低的沉积温度下沉积在衬底上。
通过在塑料衬底10上形成缓冲层15,可以实现下面的有益效果。即,可以克服将在下文中说明的纳米颗粒溶液由于其疏水性而不能适当沉积在塑料衬底10上的问题。
以这种方法在塑料衬底10上形成缓冲层15之后,在缓冲层15上形成纳米颗粒膜20,如图2所示。
下文中将详细说明在缓冲层15上形成纳米颗粒膜的方法。
首先,将所需纳米颗粒分散在溶剂中,以制备纳米颗粒溶液。此时,纳米颗粒的浓度优选为0.01~1mg/μl。然后,使沉淀剂例如2-丙醇与纳米颗粒溶液混合。
此时,混合物的体积比为1∶100~1∶1。然后,将含有沉淀剂的纳米颗粒溶液沉积在缓冲层15上,以在缓冲层15上形成纳米颗粒膜20。
在上述方法中,可以使用多种纳米颗粒。在本发明中,可以使用包括HgTe、HgSe、HgS、CdTe、CdSe、CdS、ZnTe、ZnSe、ZnS、PbTe、PbSe、PbS、ZnO等的半导体纳米颗粒中的任意一种。
另外,可以通过利用旋涂法、深涂法、冲压法、喷涂法、印刷法和其它各种溶液处理技术,通过使含有沉淀剂的纳米颗粒溶液沉积在缓冲层15上,可以在缓冲层15上形成纳米颗粒膜20。
以上述相同的方法在缓冲层15上形成纳米颗粒膜20之后,在预定温度下热处理和烧结纳米颗粒膜20。根据纳米颗粒的种类,该烧结过程在100~185℃的温度下进行10~200分钟。由于目前可用的柔性PES塑料衬底具有185℃的熔化温度,因此纳米颗粒膜可以在如上所述的较低温下烧结。
该烧结过程不仅仅用于改善纳米颗粒膜的结晶度并因此提高迁移率,而且还改善纳米颗粒膜和衬底之间的粘附力,即防止可能在光刻过程中发生的由于粘附力下降而导致的纳米颗粒层和衬底相互分离。
图5是表示在150℃下烧结180分钟的HgTe纳米颗粒膜的电流的测量图。如图5所示,当将烧结膜(曲线‘b’)与制成态的(as-prepared)膜(曲线‘a’)比较时,可以看出,烧结膜的电流增加105倍或更大。烧结纳米颗粒膜20可用作沟道层。
以这种方式烧结纳米颗粒膜之后,利用电子束或光刻法或金属掩模在纳米颗粒膜20上形成源和漏电极31和32,如图3所示。
以这种方式在纳米颗粒膜20上形成源和漏电极31和32之后,在其上形成有源和漏电极31和32的纳米颗粒膜20上沉积高介电常数的介电材料,由此形成栅极介电层40。然后,利用电子束或光刻法或金属掩模在栅极介电层40上形成栅电极50。
通过在纳米颗粒膜20上沉积高介电常数的介电材料来形成栅极介电层40。优选的是,这种介电材料是包括Al2O3、HfO2、Ta2O5、La2O3、SiO2等的无机材料中的任意一种,或者是包括AIDCN、聚苯胺、花生酸盐、PVP、PVA、PEDOT等的有机材料中的任意一种。
当介电材料沉积在纳米颗粒膜上时,优选衬底温度为100~185℃并且栅极介电层的厚度为10~500nm。
图6是表示利用如此构建的塑料衬底来制造的顶栅薄膜晶体管的光学显微图。图7表示根据本发明实施方案在透明塑料衬底上制造的顶栅晶体管的照片,以及图8是表示根据本发明实施方案在透明塑料衬底上制造的顶栅晶体管的弯曲状态的照片。如图7和8所示,在利用透明塑料衬底来制造顶栅薄膜晶体管的情况下,顶栅薄膜晶体管可具有透明性和柔性。
图9和10是表示根据本发明实施方案在塑料衬底上形成的顶栅晶体管的特性图。在此,HgTe纳米颗粒膜被用作沟道层,并且通过ALD法沉积的60nm厚的Al2O3栅极介电层被用作顶栅极。源极-漏极距离为10μm并且宽度为1000μm。
图9表示相对于不连续栅极电压(VG),漏极电流(ID)对施加到漏和源电极的电压(VDS)的依赖性。当栅极电压下降时,漏极电流增加。因此,它是指p-沟道晶体管。
图10表示栅极电压对漏极电流的图。在固定的VDS=10V时,场效应迁移率为0.88cm2/Vs,它由
Figure S07100776320070125D000071
对VG曲线的斜率来计算。此外,使用纳米颗粒溶液在塑料衬底上制造顶栅薄膜晶体管的实例还没有报道。因此,在本发明中首次进行尝试。
根据使用纳米颗粒的顶栅薄膜晶体管及其制造方法,在衬底上沉积亲水性缓冲层,以促进纳米颗粒膜的形成。此外,纳米颗粒膜用作塑料衬底上的沟道层,高介电常数的介电材料用作顶栅介电层,由此形成能够进行低电压工作的顶栅薄膜晶体管。因此,由于可以在低温下实施制作过程,因此本发明可应用于柔性塑料衬底或透明衬底。另外,由于可以在溶液状态下实施该过程,因此薄膜晶体管的制造成本可以降低。
此外,由于可以使用塑料衬底,因此可获得透明和柔性的薄膜晶体管。具体而言,由于可获得大尺寸晶体管并且可以在室温下沉积纳米颗粒层,因此不需要昂贵的真空设备。因此,实现降低的制造成本和高的工业实用性。
此外,由于使用无机半导体纳米颗粒来制造半导体薄膜晶体管,因此制造的晶体管可表现出高电荷迁移率、高化学稳定性、高耐热性和强的耐高压性。
另外,形成在塑料衬底上的传统半导体薄膜晶体管的沟道是非晶体或多晶体。但是,根据本发明,使用纳米颗粒在塑料衬底上形成的半导体薄膜晶体管的沟道几乎由单晶材料形成,产生更高的电荷迁移率。
虽然已经结合优选实施方案阐述和说明了使用纳米颗粒的顶栅薄膜晶体管的结构和运行以及该晶体管的制造方法,但这仅是用于示例性说明的目的。对本领域技术人员而言,显而易见的是,可以对本发明做出各种修改和变化,而不偏离由所附权利要求所限定的精神和范围。

Claims (20)

1.一种制造使用纳米颗粒的薄膜晶体管的方法,包括以下步骤:
使用亲水性材料在衬底上沉积缓冲层;
在所述缓冲层上形成选自HgTe、HgSe、HgS、ZnTe、ZnSe、ZnS、PbTe、PbSe、PbS和ZnO的纳米颗粒的膜并通过烧结所述选自HgTe、HgSe、HgS、ZnTe、ZnSe、ZnS、PbTe、PbSe、PbS和ZnO的纳米颗粒的膜形成沟道层;
在纳米颗粒膜上形成源和漏电极;
通过在其上形成有源和漏电极的纳米颗粒膜上沉积介电材料来形成栅极介电膜;和
在栅极介电膜上形成顶栅电极。
2.权利要求1的方法,其中衬底选自硅衬底、玻璃衬底和柔性衬底。
3.权利要求2的方法,其中柔性衬底包括塑料衬底。
4.权利要求3的方法,其中塑料衬底是PET(聚对苯二甲酸乙二醇酯)、PEN(聚萘二酸乙二醇酯)、PC(聚碳酸酯)和PES(聚醚砜)中的一种。
5.权利要求1的方法,其中缓冲层由亲水性无机材料或亲水性有机材料形成。
6.权利要求5的方法,其中亲水性无机材料选自Al2O3、HfO2、Ta2O5、La2O3和SiO2
7.权利要求6的方法,其中亲水性无机材料是利用原子层沉积(ALD)法或溅射法形成的。
8.权利要求5的方法,其中有机材料选自AIDCN、聚苯胺、Cd-AA(花生酸盐)、PVP、PVA和PEDOT。
9.权利要求8的方法,其中通过使用O3作为反应气体的紫外处理或使用O2作为反应气体的等离子体处理来使有机材料的表面成为亲水性的。
10.权利要求9的方法,其中通过旋涂法、喷涂法和印刷法中的任意一种来沉积有机材料。
11.权利要求1的方法,其中缓冲层具有2~20nm的厚度。
12.权利要求1的方法,其中缓冲层在100~150℃的温度下沉积在衬底上。
13.权利要求1的方法,其中形成纳米颗粒膜的步骤包括以下步骤:
通过将纳米颗粒分散在溶剂中来制备纳米颗粒溶液;
混合沉淀剂和纳米颗粒溶液;
将含有沉淀剂的纳米颗粒溶液沉积在衬底上。
14.权利要求13的方法,其中通过旋涂法、深涂法、冲压法、喷涂法和印刷法中的任意一种来使含有沉淀剂的纳米颗粒溶液沉积在衬底上。
15.权利要求1的方法,其中烧结步骤在100~185℃的温度下进行10~200分钟。
16.权利要求1的方法,其中通过在纳米颗粒膜上沉积高介电常数的介电材料来形成栅极绝缘膜,并且介电材料是无机材料或者是有机材料。
17.权利要求16的方法,其中所述无机材料是Al2O3、HfO2、Ta2O5、La2O3、SiO2中的任意一种。
18.权利要求16的方法,其中所述有机材料是AIDCN、聚苯胺、Cd-AA(花生酸盐)、PVP、PVA和PEDOT中的任意一种。
19.权利要求16到18任一项的方法,其中当高介电常数的介电材料沉积在纳米颗粒膜上时,衬底具有100~185℃的温度并且栅极介电膜具有10~500nm的厚度。
20.一种使用纳米颗粒的顶栅薄膜晶体管,包含:
缓冲层,其通过在柔性衬底上沉积亲水性材料而形成;
沉积并烧结在缓冲层上的选自HgTe、HgSe、HgS、ZnTe、ZnSe、ZnS、PbTe、PbSe、PbS和ZnO的纳米颗粒的膜;
源和漏电极,其形成在纳米颗粒膜上;
栅极介电膜,其通过在其上形成有源和漏电极的纳米颗粒膜上沉积介电材料而形成;和
顶栅电极,其形成在栅极介电层上。
CN2007100007763A 2006-03-30 2007-01-19 使用纳米颗粒的顶栅薄膜晶体管及其制造方法 Expired - Fee Related CN101047130B (zh)

Applications Claiming Priority (6)

Application Number Priority Date Filing Date Title
KR1020060029098A KR100777265B1 (ko) 2006-03-30 2006-03-30 나노 입자를 이용한 전면 게이트 박막 트랜지스터 및 그제조 방법
KR1020060029098 2006-03-30
KR10-2006-0029098 2006-03-30
KR1020060098467A KR100792407B1 (ko) 2006-10-10 2006-10-10 플렉시블 기판 상에 나노 입자를 이용한 전면 게이트 박막트랜지스터 및 그 제조 방법
KR1020060098467 2006-10-10
KR10-2006-0098467 2006-10-10

Publications (2)

Publication Number Publication Date
CN101047130A CN101047130A (zh) 2007-10-03
CN101047130B true CN101047130B (zh) 2011-01-19

Family

ID=38771561

Family Applications (1)

Application Number Title Priority Date Filing Date
CN2007100007763A Expired - Fee Related CN101047130B (zh) 2006-03-30 2007-01-19 使用纳米颗粒的顶栅薄膜晶体管及其制造方法

Country Status (2)

Country Link
KR (1) KR100777265B1 (zh)
CN (1) CN101047130B (zh)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100951946B1 (ko) * 2007-11-30 2010-04-09 한양대학교 산학협력단 투명하고 플렉서블한 탄소나노튜브 박막 트랜지스터 및이의 제조방법
CN103928531B (zh) * 2013-01-11 2017-04-12 纳米及先进材料研发院有限公司 基于自组装纳米颗粒的rfid标签
TW201624708A (zh) * 2014-11-21 2016-07-01 半導體能源研究所股份有限公司 半導體裝置及記憶體裝置
EP3564741B1 (en) * 2017-01-04 2023-11-22 Shih-Hsien Tseng Pixel unit structure
TWI740325B (zh) * 2018-12-28 2021-09-21 鴻海精密工業股份有限公司 氣體感測器及其製備方法
CN113437144A (zh) * 2021-05-22 2021-09-24 兰州大学 一种基于二硫化铼的场效应管及其制造方法
CN114024212B (zh) * 2021-10-19 2023-12-05 东南大学 一种基于n-ZnO/PEDOT/HfO2/p-GaN的紫外激光二极管及制备方法

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1541524A2 (en) * 2003-12-11 2005-06-15 Xerox Corporation Nanoparticle deposition process
CN1669160A (zh) * 2002-03-20 2005-09-14 国际商业机器公司 自对准纳米管场效应晶体管及其制造方法
CN1728404A (zh) * 2004-07-21 2006-02-01 三星Sdi株式会社 Tft、有该tft的电子器件及有该tft的平板显示器件

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11130867A (ja) 1997-10-30 1999-05-18 Hitachi Ltd 改善されたオルガノシリコンナノクラスター及びその製造方法
US6867081B2 (en) 2003-07-31 2005-03-15 Hewlett-Packard Development Company, L.P. Solution-processed thin film transistor formation method
KR100603352B1 (ko) * 2004-06-25 2006-07-20 삼성에스디아이 주식회사 박막 트랜지스터, 이를 구비한 평판 표시장치

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1669160A (zh) * 2002-03-20 2005-09-14 国际商业机器公司 自对准纳米管场效应晶体管及其制造方法
EP1541524A2 (en) * 2003-12-11 2005-06-15 Xerox Corporation Nanoparticle deposition process
CN1728404A (zh) * 2004-07-21 2006-02-01 三星Sdi株式会社 Tft、有该tft的电子器件及有该tft的平板显示器件

Non-Patent Citations (3)

* Cited by examiner, † Cited by third party
Title
S.J.Wind,J.Appenzeller,Ph.Avouris.Lateral Scaling in Carbon-Nanotube Field-Effect Transistors.PHYSICAL REVIEW LETTERS91 5.2003,058301-1.
S.J.Wind,J.Appenzeller,Ph.Avouris.Lateral Scaling in Carbon-Nanotube Field-Effect Transistors.PHYSICAL REVIEW LETTERS91 5.2003,058301-1. *
US 2004/0004982 A1,说明书第[0016]段.

Also Published As

Publication number Publication date
KR100777265B1 (ko) 2007-11-20
KR20070097999A (ko) 2007-10-05
CN101047130A (zh) 2007-10-03

Similar Documents

Publication Publication Date Title
Liu et al. High‐performance flexible transparent thin‐film transistors using a hybrid gate dielectric and an amorphous zinc indium tin oxide channel
CN101047130B (zh) 使用纳米颗粒的顶栅薄膜晶体管及其制造方法
US8395150B2 (en) Inorganic-organic hybrid thin-film transistors using inorganic semiconducting films
JP5647900B2 (ja) 溶液処理型高移動度無機薄膜トランジスタ
US7666764B2 (en) Compound semiconductor material and method for forming an active layer of a thin film transistor device
US8847313B2 (en) Transparent electronics based on transfer printed carbon nanotubes on rigid and flexible substrates
AU2003283973B2 (en) Large-area nanoenabled macroelectronic substrates and uses therefor
Kim et al. Effect of metallic composition on electrical properties of solution-processed indium-gallium-zinc-oxide thin-film transistors
US7381586B2 (en) Methods for manufacturing thin film transistors that include selectively forming an active channel layer from a solution
US20150357480A1 (en) Stable metal-oxide thin film transistor and method of making
US8258021B2 (en) Protecting semiconducting oxides
Wang et al. Flexible inorganic/organic hybrid thin‐film transistors using all‐transparent component materials
US20110175081A1 (en) Thin film transistor and display
Li et al. Performance improvement for solution-processed high-mobility ZnO thin-film transistors
US20050032268A1 (en) Organic thin film transistor and method of manufacturing the same
EP1976019A1 (en) Thin film transistor including titanium oxides as active layer and method of manufacturing the same
US7972931B2 (en) Top-gate thin-film transistors using nanoparticles and method of manufacturing the same
You Indium doping concentration effects in the fabrication of zinc-oxide thin-film transistors
Wu et al. Transparent thin-film transistors using ZnMgO as dielectrics and channel
Song et al. Low-temperature solution-deposited oxide thin-film transistors based on solution-processed organic–inorganic hybrid dielectrics
Jung et al. Enhanced contact properties of spray-coated AgNWs source and drain electrodes in oxide thin-film transistors
KR100792407B1 (ko) 플렉시블 기판 상에 나노 입자를 이용한 전면 게이트 박막트랜지스터 및 그 제조 방법
CN101373791B (zh) 通过湿法化学沉积制造的场效应晶体管
Opoku et al. Solution processable nanowire field-effect transistors
Carcia Application of transparent oxide semiconductors for flexible electronics

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
C14 Grant of patent or utility model
GR01 Patent grant
CF01 Termination of patent right due to non-payment of annual fee
CF01 Termination of patent right due to non-payment of annual fee

Granted publication date: 20110119

Termination date: 20200119