JPH10112673A - Ｒａｋｅ受信方法とその受信機 - Google Patents
Ｒａｋｅ受信方法とその受信機Info
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- JPH10112673A JPH10112673A JP26327096A JP26327096A JPH10112673A JP H10112673 A JPH10112673 A JP H10112673A JP 26327096 A JP26327096 A JP 26327096A JP 26327096 A JP26327096 A JP 26327096A JP H10112673 A JPH10112673 A JP H10112673A
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- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D30/00—Reducing energy consumption in communication networks
- Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks
Abstract
(57)【要約】
【課題】 消費電力が少なく、かつ回路構成も簡単なＲ
ＡＫＥ受信機を実現する。 【解決手段】 マッチトフィルタ１０１をパイロット信
号入力時にのみ作動させてその遅延プロファイルを遅延
プロファイル生成回路１０２で生成する。有効パス検出
回路１０４は、パイロット信号位置の有効パス位置を上
記生成された遅延プロファイルから求めるとともに、そ
の他のシンボル位置の有効パス位置を、そのシンボルの
前後のパイロット信号の有効パス位置から補間により求
めて出力する。コリレータ１０６〜１０８は、各有効パ
ス毎の有効パス位置を受け取り、その位置の受信信号を
復調し、これらは位相補間回路１１０でそれぞれ位相補
償された後に同相合成回路１１１で合成される。
ＡＫＥ受信機を実現する。 【解決手段】 マッチトフィルタ１０１をパイロット信
号入力時にのみ作動させてその遅延プロファイルを遅延
プロファイル生成回路１０２で生成する。有効パス検出
回路１０４は、パイロット信号位置の有効パス位置を上
記生成された遅延プロファイルから求めるとともに、そ
の他のシンボル位置の有効パス位置を、そのシンボルの
前後のパイロット信号の有効パス位置から補間により求
めて出力する。コリレータ１０６〜１０８は、各有効パ
ス毎の有効パス位置を受け取り、その位置の受信信号を
復調し、これらは位相補間回路１１０でそれぞれ位相補
償された後に同相合成回路１１１で合成される。
Description
【０００１】
【発明の属する技術分野】本発明は、直接スペクトル拡
散による符号分割多元接続方式（ＣＤＭＡ：CodeDivisi
on Multiple Access）に於けるＲＡＫＥ受信方法とその
受信機に関するものである。
散による符号分割多元接続方式（ＣＤＭＡ：CodeDivisi
on Multiple Access）に於けるＲＡＫＥ受信方法とその
受信機に関するものである。
【０００２】
【従来の技術】直接スペクトル拡散通信のマルチパスフ
ェージングに対処する方法の１つにパスダイバーシチが
ある。これは、パイロットシンボルを送信してその逆拡
散信号を電力化した遅延プロファイルから各空間パスの
遅延時間を検出して、前記遅延時間に基づいて前記逆拡
散信号から各空間パスの位相回転量を検出し、その量に
より受信信号から各空間パスを経由してきた信号成分を
取り出し同相合成するもので、ＲＡＫＥ受信方法と呼ば
れている。
ェージングに対処する方法の１つにパスダイバーシチが
ある。これは、パイロットシンボルを送信してその逆拡
散信号を電力化した遅延プロファイルから各空間パスの
遅延時間を検出して、前記遅延時間に基づいて前記逆拡
散信号から各空間パスの位相回転量を検出し、その量に
より受信信号から各空間パスを経由してきた信号成分を
取り出し同相合成するもので、ＲＡＫＥ受信方法と呼ば
れている。
【０００３】図３は、かかる受信方法を具備した従来の
ＲＡＫＥ受信機の構成例を示すブロック図で、マッチド
フィルタ３０１、遅延プロファイル生成回路３０２、メ
モリ３０３、３０５、３０６、有効パス検出回路３０
４、位相補償回路３０７、同相合成回路３０８、及び判
定回路３０９よりなっている。以下この動作を述べる。
ＲＡＫＥ受信機の構成例を示すブロック図で、マッチド
フィルタ３０１、遅延プロファイル生成回路３０２、メ
モリ３０３、３０５、３０６、有効パス検出回路３０
４、位相補償回路３０７、同相合成回路３０８、及び判
定回路３０９よりなっている。以下この動作を述べる。
【０００４】マッチドフィルタは、受信信号と逆拡散用
符号との相関により受信信号のインパルスレスポンスを
生成し、遅延プロファイル生成回路３０２はこのインパ
ルスレスポンスを電力化することで遅延プロファイルを
生成してメモリ３０３へ書き込む。図４はこの遅延プロ
ファイルの例を示しており、縦軸は電力、横軸は遅延時
間で、遅延時間ｔ１、ｔ２、ｔ３に大きなピークが現れ
ていて、３つのパスを介して到達した信号をそれぞれ表
している。なお、このような遅延プロファイルは、１回
の測定だけではノイズ成分による誤差が生じ易いので、
間近の何回かの測定値の平均をとってメモリ３０３に再
格納するようにして、ノイズ成分の抑圧を行うようにし
てもよい。
符号との相関により受信信号のインパルスレスポンスを
生成し、遅延プロファイル生成回路３０２はこのインパ
ルスレスポンスを電力化することで遅延プロファイルを
生成してメモリ３０３へ書き込む。図４はこの遅延プロ
ファイルの例を示しており、縦軸は電力、横軸は遅延時
間で、遅延時間ｔ１、ｔ２、ｔ３に大きなピークが現れ
ていて、３つのパスを介して到達した信号をそれぞれ表
している。なお、このような遅延プロファイルは、１回
の測定だけではノイズ成分による誤差が生じ易いので、
間近の何回かの測定値の平均をとってメモリ３０３に再
格納するようにして、ノイズ成分の抑圧を行うようにし
てもよい。
【０００５】有効パス検出回路３０４は、メモリ３０３
から遅延プロファイルを読み出し、予め定められた域値
をこえているピークの遅延時間を伝播に寄与している有
効なパスの遅延時間を表す有効パス位置として検出す
る。一方、メモリ３０５は、マッチドフィルタ３０１か
ら出力されたインパルスレスポンスを１シンボルにわた
って記憶するとともに、前記有効パス検出回路３０４に
より検出された有効パス位置がタイミング信号としてメ
モリ３０５へ与えられ、各有効パス位置に対応したイン
パルスレスポンスの値がそのパス対応の復調信号として
取り出され、メモリ３０６に書き込まれる。
から遅延プロファイルを読み出し、予め定められた域値
をこえているピークの遅延時間を伝播に寄与している有
効なパスの遅延時間を表す有効パス位置として検出す
る。一方、メモリ３０５は、マッチドフィルタ３０１か
ら出力されたインパルスレスポンスを１シンボルにわた
って記憶するとともに、前記有効パス検出回路３０４に
より検出された有効パス位置がタイミング信号としてメ
モリ３０５へ与えられ、各有効パス位置に対応したイン
パルスレスポンスの値がそのパス対応の復調信号として
取り出され、メモリ３０６に書き込まれる。
【０００６】ところで、図５に示したように、受信信号
には周期的にパイロット信号（Pilot）が含まれてい
て、そのパイロットシンボルは予め定められたパターン
であるから、受信側では送信側から送られたパイロット
シンボルのベクトルが受信時にどれだけ位相回転してい
るかを各マルチパス波の位相からパスごとに知ることが
できる。そこで、位相補償回路３０７は、受信信号に周
期的に挿入されているパイロットシンボルを受信したと
きに前記パイロットシンボルの各マルチパス波の位相を
メモリ３０６に格納された復調信号から検出する。さら
に、パイロットシンボルと次のパイロットシンボルの間
に伝送されてくる各シンボルの位相回転量は、そのシン
ボルの前後のパイロットシンボルの位相回転量を各マル
チパス波についてそれぞれ補間した補間位相回転量とし
て推定することができる。そこで、位相補償回路３０７
は、各有効パスについての位相回転量の推定値により当
該パス対応の復調シンボルの位相回転量を補償し、各パ
スの信号を同相化して出力する。この同相に補正された
各有効パスの信号は、同相合成回路３０８で合成され、
こうしてパスダイバーシチ受信が行われ、マルチパスフ
ェージングによる受信パワーの変動を抑圧するとともに
ＳＮＲの改善が行える。
には周期的にパイロット信号（Pilot）が含まれてい
て、そのパイロットシンボルは予め定められたパターン
であるから、受信側では送信側から送られたパイロット
シンボルのベクトルが受信時にどれだけ位相回転してい
るかを各マルチパス波の位相からパスごとに知ることが
できる。そこで、位相補償回路３０７は、受信信号に周
期的に挿入されているパイロットシンボルを受信したと
きに前記パイロットシンボルの各マルチパス波の位相を
メモリ３０６に格納された復調信号から検出する。さら
に、パイロットシンボルと次のパイロットシンボルの間
に伝送されてくる各シンボルの位相回転量は、そのシン
ボルの前後のパイロットシンボルの位相回転量を各マル
チパス波についてそれぞれ補間した補間位相回転量とし
て推定することができる。そこで、位相補償回路３０７
は、各有効パスについての位相回転量の推定値により当
該パス対応の復調シンボルの位相回転量を補償し、各パ
スの信号を同相化して出力する。この同相に補正された
各有効パスの信号は、同相合成回路３０８で合成され、
こうしてパスダイバーシチ受信が行われ、マルチパスフ
ェージングによる受信パワーの変動を抑圧するとともに
ＳＮＲの改善が行える。
【０００７】合成された各シンボルの信号は判定回路３
０９で判定され、復号される。図６は、上記同相合成の
様子を示したもので、３つのパスの位相回転量がθ１、
θ２、θ３であったときに、その分だけ各シンボルのベ
クトルを逆に回転させて同相（位相θ）の信号とした状
態、つまり位相補償を行った状態を示している。
０９で判定され、復号される。図６は、上記同相合成の
様子を示したもので、３つのパスの位相回転量がθ１、
θ２、θ３であったときに、その分だけ各シンボルのベ
クトルを逆に回転させて同相（位相θ）の信号とした状
態、つまり位相補償を行った状態を示している。
【０００８】図７は、従来のＲＡＫＥ受信機の別の構成
例を示すブロック図で、図３の従来構成と同一の回路に
は同一符号が付されている。異なっているのは、マッチ
ドフィルタに代わってサーチャ７０１、ＤＬＬ（Delay
Locked Loop）７０３〜７０５、及びコリレータ７０６
〜７０８等が用いられている点である。この構成では、
受信信号はサーチャ７０１に入力され、１シンボル入力
されると逆拡散用符号との相関が１サンプル分求められ
る。次の１シンボルが入力されると前回より１サンプル
ずれた逆拡散用符号との相関が１サンプル分求められ、
これを１シンボル長のインパルスレスポンスが生成され
るまで繰り返される。こうしてインパルスレスポンスが
求められると、それからマルチパスフェージングの各パ
スの遅延時間を表す有効パス位置が遅延プロファイル生
成回路３０２、メモリ３０３、及び有効パス検出回路３
０４で検出されるのは図３の場合と同様である。
例を示すブロック図で、図３の従来構成と同一の回路に
は同一符号が付されている。異なっているのは、マッチ
ドフィルタに代わってサーチャ７０１、ＤＬＬ（Delay
Locked Loop）７０３〜７０５、及びコリレータ７０６
〜７０８等が用いられている点である。この構成では、
受信信号はサーチャ７０１に入力され、１シンボル入力
されると逆拡散用符号との相関が１サンプル分求められ
る。次の１シンボルが入力されると前回より１サンプル
ずれた逆拡散用符号との相関が１サンプル分求められ、
これを１シンボル長のインパルスレスポンスが生成され
るまで繰り返される。こうしてインパルスレスポンスが
求められると、それからマルチパスフェージングの各パ
スの遅延時間を表す有効パス位置が遅延プロファイル生
成回路３０２、メモリ３０３、及び有効パス検出回路３
０４で検出されるのは図３の場合と同様である。
【０００９】前述した図３の場合には、マッチドフィル
タによりインパルスレスポンスを生成していたため、１
シンボル長の遅延プロファイルは１シンボル毎に生成さ
れていた。しかし、図７のＲＡＫＥ受信機の構成例で
は、単数もしくは複数のコリレータから成るサーチャ７
０１によってインパルスレスポンスが生成されているた
め、１シンボル長の遅延プロファイルが完成するまでに
長時間を有してしまう。そのため、有効パス判定回路か
ら出力された遅延時間だけで各パスに含まれる拡散符号
の位相を追跡するのは不十分であり、前記検出された各
パスの遅延時間はＤＬＬ７０３〜７０５に於ける同期引
き込みにのみ用いられる。即ち、ＤＬＬ７０３〜７０５
は有効パス毎にそれぞれ独立に設置され、前記遅延時間
に基づいて同期引き込みを行った後に、各マルチパス波
の位相追跡を行う（同期保持）。そしてその同期した復
調タイミングをコリレータ７０６〜７０９へそれぞれ出
力する。コリレータ７０６〜７０９は、前記復調タイミ
ングに基づいて受信パス毎の復調を行い、その復調信号
をメモリ３０６に書き込む。
タによりインパルスレスポンスを生成していたため、１
シンボル長の遅延プロファイルは１シンボル毎に生成さ
れていた。しかし、図７のＲＡＫＥ受信機の構成例で
は、単数もしくは複数のコリレータから成るサーチャ７
０１によってインパルスレスポンスが生成されているた
め、１シンボル長の遅延プロファイルが完成するまでに
長時間を有してしまう。そのため、有効パス判定回路か
ら出力された遅延時間だけで各パスに含まれる拡散符号
の位相を追跡するのは不十分であり、前記検出された各
パスの遅延時間はＤＬＬ７０３〜７０５に於ける同期引
き込みにのみ用いられる。即ち、ＤＬＬ７０３〜７０５
は有効パス毎にそれぞれ独立に設置され、前記遅延時間
に基づいて同期引き込みを行った後に、各マルチパス波
の位相追跡を行う（同期保持）。そしてその同期した復
調タイミングをコリレータ７０６〜７０９へそれぞれ出
力する。コリレータ７０６〜７０９は、前記復調タイミ
ングに基づいて受信パス毎の復調を行い、その復調信号
をメモリ３０６に書き込む。
【００１０】こうして各パス毎の復調信号がメモリ３０
６に得られると、図３の場合と同様にしてパイロット信
号の位相回転量の検出と、その検出値を用いた各シンボ
ルの位相回転量の推定、合成が行われ、パスダイバーシ
チ受信によるＳＮＲの改善が行われる。
６に得られると、図３の場合と同様にしてパイロット信
号の位相回転量の検出と、その検出値を用いた各シンボ
ルの位相回転量の推定、合成が行われ、パスダイバーシ
チ受信によるＳＮＲの改善が行われる。
【００１１】
【発明が解決しようとする課題】上記した従来の図３の
構成の場合には、復調のためにマッチドフィルタを用い
ているが、これは拡散符号の符号長が長くなるとそれだ
け多くのタップを有した回路構成となり、しかもこの回
路を常時動作させているので消費電力が非常に大きくな
るという問題があった。
構成の場合には、復調のためにマッチドフィルタを用い
ているが、これは拡散符号の符号長が長くなるとそれだ
け多くのタップを有した回路構成となり、しかもこの回
路を常時動作させているので消費電力が非常に大きくな
るという問題があった。
【００１２】また、図７に示した構成の場合には、図３
の場合のような大きな消費電力を必要としない。しか
し、ＤＬＬはコリレータ２個から成っており、電波のパ
スの数だけのＤＬＬとコリレータを用意する、即ち１パ
スにつき３個のコリレータを必要とする。このため、回
路規模が大きくなってしまうという問題があった。
の場合のような大きな消費電力を必要としない。しか
し、ＤＬＬはコリレータ２個から成っており、電波のパ
スの数だけのＤＬＬとコリレータを用意する、即ち１パ
スにつき３個のコリレータを必要とする。このため、回
路規模が大きくなってしまうという問題があった。
【００１３】本発明の目的は、回路構成が比較的簡単で
かつ小さい消費電力で動作するようにしたＲＡＫＥ受信
方法とその受信機を提供することにある。
かつ小さい消費電力で動作するようにしたＲＡＫＥ受信
方法とその受信機を提供することにある。
【００１４】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明においては、受信信号のうち信号周期毎に
挿入されているパイロット信号と逆拡散用符号との相関
処理により得られたインパルスレスポンスから前記パイ
ロット信号の遅延プロファイルを生成し、前記パイロッ
ト信号以外のシンボルの遅延プロファイルは、当該シン
ボルのシンボルの前後に受信されたパイロット信号から
生成された遅延プロファイルから補間により推定した遅
延プロファイルとして生成し、こうして得られた各シン
ボル毎の遅延プロファイルからその有効パス位置を取り
出し、その有効パス位置に於ける受信信号を各パス経由
の信号として復調したのち同相合成して復号することを
特徴とするＲＡＫＥ受信方法を開示する。
めに、本発明においては、受信信号のうち信号周期毎に
挿入されているパイロット信号と逆拡散用符号との相関
処理により得られたインパルスレスポンスから前記パイ
ロット信号の遅延プロファイルを生成し、前記パイロッ
ト信号以外のシンボルの遅延プロファイルは、当該シン
ボルのシンボルの前後に受信されたパイロット信号から
生成された遅延プロファイルから補間により推定した遅
延プロファイルとして生成し、こうして得られた各シン
ボル毎の遅延プロファイルからその有効パス位置を取り
出し、その有効パス位置に於ける受信信号を各パス経由
の信号として復調したのち同相合成して復号することを
特徴とするＲＡＫＥ受信方法を開示する。
【００１５】また、本発明は、各タップに逆拡散用符号
が書き込まれ、信号周期毎に挿入されたパイロットシン
ボルを受信したときに前記逆拡散用符号との相関を求め
てインパルスレスポンスを生成し、パイロットシンボル
以外のシンボルを受信したときはその動作を停止すると
ころのマッチドフィルタと、前記パイロット信号に対し
て生成されたインパルスレスポンスからその遅延プロフ
ァイルを生成するための遅延プロファイル生成回路と、
該回路により生成された遅延プロファイルの予め定めら
れた域値をこえる極大点を与える遅延時間を前記パイロ
ット信号位置における有効パスを与える有効パス位置と
して検出するとともに、前記パイロット信号以外のシン
ボルの有効パス位置を、当該シンボルの前後のパイロッ
ト信号に対して生成された有効パス位置から補間により
算出した値として推定するための有効パス検出回路と、
該有効パス検出回路により検出・推定された各有効パス
毎に設けられ、当該有効パス毎の有効パス位置における
受信信号を復調するためのコリレータと、前記パイロッ
ト信号のインパルスレスポンスからその位相回転量を検
出するとともに、前記パイロット信号以外のシンボルの
位相回転量を、当該シンボルの前後のパイロット信号に
対して生成された位相回転量から補間により算出した値
として推定し、こうして検出・推定した位相回転量によ
り前記コリレータにより復調された各有効パスの復調シ
ンボルの位相補償を行うための位相補償回路と、該回路
により位相補償された各有効パスの復調シンボルを同期
合成するための合成回路と、を備えたことを特徴とする
ＲＡＫＥ受信機を開示する。
が書き込まれ、信号周期毎に挿入されたパイロットシン
ボルを受信したときに前記逆拡散用符号との相関を求め
てインパルスレスポンスを生成し、パイロットシンボル
以外のシンボルを受信したときはその動作を停止すると
ころのマッチドフィルタと、前記パイロット信号に対し
て生成されたインパルスレスポンスからその遅延プロフ
ァイルを生成するための遅延プロファイル生成回路と、
該回路により生成された遅延プロファイルの予め定めら
れた域値をこえる極大点を与える遅延時間を前記パイロ
ット信号位置における有効パスを与える有効パス位置と
して検出するとともに、前記パイロット信号以外のシン
ボルの有効パス位置を、当該シンボルの前後のパイロッ
ト信号に対して生成された有効パス位置から補間により
算出した値として推定するための有効パス検出回路と、
該有効パス検出回路により検出・推定された各有効パス
毎に設けられ、当該有効パス毎の有効パス位置における
受信信号を復調するためのコリレータと、前記パイロッ
ト信号のインパルスレスポンスからその位相回転量を検
出するとともに、前記パイロット信号以外のシンボルの
位相回転量を、当該シンボルの前後のパイロット信号に
対して生成された位相回転量から補間により算出した値
として推定し、こうして検出・推定した位相回転量によ
り前記コリレータにより復調された各有効パスの復調シ
ンボルの位相補償を行うための位相補償回路と、該回路
により位相補償された各有効パスの復調シンボルを同期
合成するための合成回路と、を備えたことを特徴とする
ＲＡＫＥ受信機を開示する。
【００１６】
【発明の実施の形態】以下、本発明の実施の形態を説明
する。図１は、本発明になるＲＡＫＥ受信機の構成例を
示すブロック図で、マッチドフィルタ１０１、遅延プロ
ファイル生成回路１０２、メモリ１０３、１０５、１０
９、有効パス検出回路１０４、コリレータ１０６〜１０
８、位相補償回路１１０、同相合成回路１１１、及び判
定回路１１２から成っている。
する。図１は、本発明になるＲＡＫＥ受信機の構成例を
示すブロック図で、マッチドフィルタ１０１、遅延プロ
ファイル生成回路１０２、メモリ１０３、１０５、１０
９、有効パス検出回路１０４、コリレータ１０６〜１０
８、位相補償回路１１０、同相合成回路１１１、及び判
定回路１１２から成っている。
【００１７】図１に於て、図示は省略したが、判定回路
１１２で得られたディジタル信号から検出されたパイロ
ットシンボル位置を示す信号ＰＬがマッチドフィルタ１
０１に与えられている。マッチドフィルタ１０１は、こ
の信号ＰＬが与えられているときだけ、即ちパイロット
信号が受信されているときだけ作動し、その各タップに
書き込まれた逆拡散用符号と受信信号の相関を求めるこ
とによりパイロット信号のインパルスレスポンスを生成
し、その他のシンボルの受信時には作動を停止する。遅
延プロファイル生成回路１０２は、このマッチドフィル
タ１０１により求められたインパルスレスポンスから従
来と同様にして遅延プロファイルを生成してメモリ１０
３へ書き込む。
１１２で得られたディジタル信号から検出されたパイロ
ットシンボル位置を示す信号ＰＬがマッチドフィルタ１
０１に与えられている。マッチドフィルタ１０１は、こ
の信号ＰＬが与えられているときだけ、即ちパイロット
信号が受信されているときだけ作動し、その各タップに
書き込まれた逆拡散用符号と受信信号の相関を求めるこ
とによりパイロット信号のインパルスレスポンスを生成
し、その他のシンボルの受信時には作動を停止する。遅
延プロファイル生成回路１０２は、このマッチドフィル
タ１０１により求められたインパルスレスポンスから従
来と同様にして遅延プロファイルを生成してメモリ１０
３へ書き込む。
【００１８】有効パス検出回路１０４は、メモリ１０３
に格納された遅延プロファイルから各有効パスの遅延時
間、即ち有効パス位置を従来と同様にして求めるが、マ
ッチドフィルタ１０１が出力するのは本構成ではパイロ
ット信号のインパルスレスポンスのみであるので、有効
パス検出回路１０４が直接検出できるのはパイロット信
号受信時の有効パス位置のみである。そこで有効パス検
出回路１０４では、パイロット信号以外のシンボル時点
の有効パス位置を、そのシンボルを挟む２つのパイロッ
ト信号の有効パス位置から内挿補間により推定する。こ
の補間方法としては、例えば図５に示したように１スロ
ットに１個のパイロット信号とＮ−１個のシンボルが含
まれているとして、１つのスロットのパイロット信号か
ら求められたパスｉの遅延時間をｔij、次のスロットの
パイロット信号から求められたパスｉの遅延時間をｔij
+1としたとき、シンボルｋのパスｉの遅延時間Ｓijkを
に格納された遅延プロファイルから各有効パスの遅延時
間、即ち有効パス位置を従来と同様にして求めるが、マ
ッチドフィルタ１０１が出力するのは本構成ではパイロ
ット信号のインパルスレスポンスのみであるので、有効
パス検出回路１０４が直接検出できるのはパイロット信
号受信時の有効パス位置のみである。そこで有効パス検
出回路１０４では、パイロット信号以外のシンボル時点
の有効パス位置を、そのシンボルを挟む２つのパイロッ
ト信号の有効パス位置から内挿補間により推定する。こ
の補間方法としては、例えば図５に示したように１スロ
ットに１個のパイロット信号とＮ−１個のシンボルが含
まれているとして、１つのスロットのパイロット信号か
ら求められたパスｉの遅延時間をｔij、次のスロットの
パイロット信号から求められたパスｉの遅延時間をｔij
+1としたとき、シンボルｋのパスｉの遅延時間Ｓijkを
【数１】Ｓijk＝｛(Ｎ−ｋ−１)・(ｔij)＋(ｋ)・(ｔij
+1)｝／(Ｎ−１)， １≦ｋ≦Ｎ−１ により推定する。ここで添字ｉはパスの番号、ｊはスロ
ットの番号である。この推定により得た遅延時間Ｓijk
は、次のスロットｊ＋１のシンボルｋに於けるパスｉの
遅延時間（有効パス位置）として用いられる。
+1)｝／(Ｎ−１)， １≦ｋ≦Ｎ−１ により推定する。ここで添字ｉはパスの番号、ｊはスロ
ットの番号である。この推定により得た遅延時間Ｓijk
は、次のスロットｊ＋１のシンボルｋに於けるパスｉの
遅延時間（有効パス位置）として用いられる。
【００１９】一方、受信信号はそのままメモリ１０５に
記憶される。コリレータ１０６〜１０８は、マルチパス
の各パス毎に設置され、有効パス検出回路１０４で１ス
ロット前に検出・推定された有効パス位置に対応する時
刻をタイミング情報として与えられると、その時刻位置
の受信信号をメモリ１０５から読み出し、逆拡散処理を
行ってそのパス対応の復調信号を出力する。この各パス
対応の復調信号はメモリ１０９へ書き込まれ、以下は従
来と同様にして位相補償回路１１０による位相回転量の
検出・推定とそれに基づく各パスの復調信号に対する位
相補償、その位相補償された各復調信号の同相合成回路
１１１での合成によりパスダイバーシチ合成が行われ
る。
記憶される。コリレータ１０６〜１０８は、マルチパス
の各パス毎に設置され、有効パス検出回路１０４で１ス
ロット前に検出・推定された有効パス位置に対応する時
刻をタイミング情報として与えられると、その時刻位置
の受信信号をメモリ１０５から読み出し、逆拡散処理を
行ってそのパス対応の復調信号を出力する。この各パス
対応の復調信号はメモリ１０９へ書き込まれ、以下は従
来と同様にして位相補償回路１１０による位相回転量の
検出・推定とそれに基づく各パスの復調信号に対する位
相補償、その位相補償された各復調信号の同相合成回路
１１１での合成によりパスダイバーシチ合成が行われ
る。
【００２０】以上に説明した図１の構成によると、マッ
チドフィルタ１０１はパイロット信号の受信時のみ動作
し、他のシンボル受信時にはその動作を停止するから、
図３の従来例のように大きな電力を消費することはなく
なり、例えば図５のように１スロットＮシンボルの場合
には、マッチドフィルタの消費電力は図３の場合の１／
Ｎとなる。また、マッチドフィルタの出力からパイロッ
ト信号の遅延プロファイルを求めているので、その算出
は即時に行え、図７の従来例のように各パスにＤＬＬを
設ける必要がないので、回路構成も簡単になる。一方、
パイロット信号以外のシンボルの遅延プロファイル、位
相回転量の双方を補間により推定し、次のスロットでの
復調・合成に用いているが、一般にマルチパスフェージ
ングの変動が、信号の１スロット周期の間で十分遅くな
るようにスロット周期が与えられるので、上記のようで
ほぼ正確な復調が行える。
チドフィルタ１０１はパイロット信号の受信時のみ動作
し、他のシンボル受信時にはその動作を停止するから、
図３の従来例のように大きな電力を消費することはなく
なり、例えば図５のように１スロットＮシンボルの場合
には、マッチドフィルタの消費電力は図３の場合の１／
Ｎとなる。また、マッチドフィルタの出力からパイロッ
ト信号の遅延プロファイルを求めているので、その算出
は即時に行え、図７の従来例のように各パスにＤＬＬを
設ける必要がないので、回路構成も簡単になる。一方、
パイロット信号以外のシンボルの遅延プロファイル、位
相回転量の双方を補間により推定し、次のスロットでの
復調・合成に用いているが、一般にマルチパスフェージ
ングの変動が、信号の１スロット周期の間で十分遅くな
るようにスロット周期が与えられるので、上記のようで
ほぼ正確な復調が行える。
【００２１】図２は、本発明になるＲＡＫＥ受信機の別
の構成例を示すブロック図である。本構成例が図１の場
合と異なっているのは、図１では各有効パス毎にコリレ
ータを設けているが、これを１個のコリレータ２０１と
し、この１個のコリレータによって各パスの信号の復調
を時分割で行うように構成した点であり、他は同じ構成
である。この構成によれば、図１の場合と同様に少ない
消費電力とすることができるとともに、復調用のコリレ
ータを１個とすることでさらに回路構成を簡単にできる
という特徴がある。
の構成例を示すブロック図である。本構成例が図１の場
合と異なっているのは、図１では各有効パス毎にコリレ
ータを設けているが、これを１個のコリレータ２０１と
し、この１個のコリレータによって各パスの信号の復調
を時分割で行うように構成した点であり、他は同じ構成
である。この構成によれば、図１の場合と同様に少ない
消費電力とすることができるとともに、復調用のコリレ
ータを１個とすることでさらに回路構成を簡単にできる
という特徴がある。
【００２２】なお、以上では有効パス検出回路１０４に
於ける有効パス位置の補間は、（数１）で示したように
一次内挿補間を用いるものとしたが、これは他の補間方
法、例えば零次、二次内挿補間や外挿補間を用いるよう
にしてもよい。
於ける有効パス位置の補間は、（数１）で示したように
一次内挿補間を用いるものとしたが、これは他の補間方
法、例えば零次、二次内挿補間や外挿補間を用いるよう
にしてもよい。
【００２３】また、図５で説明したように、既知の波形
を有したパイロット信号は１スロットに１個だけ伝送す
るものとして説明したが、１個だけではノイズ等のため
に遅延プロファイルや位相回転量を正確に検出できない
場合もある。このような場合には、１スロットにパイロ
ット信号を２個あるいはそれ以上続けて挿入し、これら
のパイロット信号から求めた遅延プロファイルや位相回
転量を平均化することにより雑音を抑圧して、より正確
な検出が可能となる。
を有したパイロット信号は１スロットに１個だけ伝送す
るものとして説明したが、１個だけではノイズ等のため
に遅延プロファイルや位相回転量を正確に検出できない
場合もある。このような場合には、１スロットにパイロ
ット信号を２個あるいはそれ以上続けて挿入し、これら
のパイロット信号から求めた遅延プロファイルや位相回
転量を平均化することにより雑音を抑圧して、より正確
な検出が可能となる。
【００２４】
【発明の効果】本発明によれば、マッチドフィルタの消
費電力を大幅に低減できるとともに、信号復調のための
コリレータも各有効パスについて１個あればよいので、
回路規模の減少が図れる効果がある。
費電力を大幅に低減できるとともに、信号復調のための
コリレータも各有効パスについて１個あればよいので、
回路規模の減少が図れる効果がある。
【図１】本発明になるＲＡＫＥ受信機の一構成例を示す
ブロック図である。
ブロック図である。
【図２】本発明になるＲＡＫＥ受信機の他の構成例を示
すブロック図である。
すブロック図である。
【図３】従来のＲＡＫＥ受信機の一構成例を示すブロッ
ク図である。
ク図である。
【図４】遅延プロファイルの例を示す図である。
【図５】伝送信号のフォーマットの説明図である。
【図６】各パスにおける位相補償の説明図である。
【図７】従来のＲＡＫＥ受信機の他の構成例を示すブロ
ック図である。
ック図である。
１０１ マッチドフィルタ １０２ 遅延プロファイル生成回路 １０３、１０５、１０９ メモリ １０４ 有効パス検出回路 １０６〜１０８、２０１ コリレータ １１０ 位相補償回路 １１１ 同相合成回路 １１２ 判定回路
Claims (5)
- 【請求項１】 受信信号のうち信号周期毎に挿入されて
いるパイロット信号と逆拡散用符号との相関処理により
得られたインパルスレスポンスから前記パイロット信号
の遅延プロファイルを生成し、 前記パイロット信号以外のシンボルの遅延プロファイル
は、当該シンボルの前後に受信されたパイロット信号か
ら生成された遅延プロファイルから補間により推定した
遅延プロファイルとして生成し、 こうして得られた各シンボル毎の遅延プロファイルから
その有効パス位置を取り出し、その有効パス位置に於け
る受信信号を各パス経由の信号として復調したのち同相
合成して復号することを特徴とするＲＡＫＥ受信方法。 - 【請求項２】 前記有効パス位置毎の受信信号の復調
を、前記有効パス位置毎に１つのコリレータを用いて行
うことを特徴とする請求項１記載のＲＡＫＥ受信方法。 - 【請求項３】 前記有効パス位置毎の受信信号の復調
を、１つのコリレータの時分割処理により行うことを特
徴とする請求項１記載のＲＡＫＥ受信方法。 - 【請求項４】 各タップに逆拡散用符号が書き込まれ、
信号周期毎に挿入されたパイロットシンボルを受信した
ときに前記逆拡散用符号との相関を求めてインパルスレ
スポンスを生成し、パイロットシンボル以外のシンボル
を受信したときはその動作を停止するところのマッチド
フィルタと、 前記パイロット信号に対して生成されたインパルスレス
ポンスからその遅延プロファイルを生成するための遅延
プロファイル生成回路と、 該回路により生成された遅延プロファイルの予め定めら
れた域値をこえる極大点を与える遅延時間を前記パイロ
ット信号位置における有効パスを与える有効パス位置と
して検出するとともに、前記パイロット信号以外のシン
ボルの有効パス位置を、当該シンボルの前後のパイロッ
ト信号に対して生成された有効パス位置から補間により
算出した値として推定するための有効パス検出回路と、 該有効パス検出回路により検出・推定された各有効パス
毎に設けられ、当該有効パス毎の有効パス位置における
受信信号を復調するためのコリレータと、 前記パイロット信号のインパルスレスポンスからその位
相回転量を検出するとともに、前記パイロット信号以外
のシンボルの位相回転量を、当該シンボルの前後のパイ
ロット信号に対して生成された位相回転量から補間によ
り算出した値として推定し、こうして検出・推定した位
相回転量により前記コリレータにより復調された各有効
パスの復調シンボルの位相補償を行うための位相補償回
路と、 該回路により位相補償された各有効パスの復調シンボル
を同相合成するための合成回路と、 を備えたことを特徴とするＲＡＫＥ受信機。 - 【請求項５】 各タップに逆拡散用符号が書き込まれ、
信号周期毎に挿入されたパイロットシンボルを受信した
ときに前記逆拡散用符号との相関を求めてインパルスレ
スポンスを生成し、パイロットシンボル以外のシンボル
を受信したときはその動作を停止するところのマッチド
フィルタと、 前記パイロット信号に対して生成されたインパルスレス
ポンスからその遅延プロファイルを生成するための遅延
プロファイル生成回路と、 該回路により生成された遅延プロファイルの予め定めら
れた域値をこえる極大点を与える遅延時間を前記パイロ
ット信号位置に於ける有効パスを与える有効パス位置と
して検出するとともに、前記パイロット信号以外のシン
ボルの有効パス位置を、当該シンボルの前後のパイロッ
ト信号に対して生成された有効パス位置から補間により
算出した値として推定するための有効パス検出回路と、 該有効パス検出回路により検出・推定された各有効パス
毎の有効パス位置に於ける受信信号の復調を各有効パス
毎に時分割で実行するための１台のコリレータと、 前記パイロット信号のインパルスレスポンスからその位
相回転量を検出するとともに、前記パイロット信号以外
のシンボルの位相回転量を、当該シンボルの前後のパイ
ロット信号に対して生成された位相回転量から補間によ
り算出した値として推定し、こうして検出・推定した位
相回転量により前記コリレータにより復調された各有効
パスの復調シンボルの位相補償を行うための位相補償回
路と、 該回路により位相補償された各有効パスの復調シンボル
を同相合成するための合成回路と、 を備えたことを特徴とするＲＡＫＥ受信機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26327096A JP3103311B2 (ja) | 1996-10-03 | 1996-10-03 | Ｒａｋｅ受信機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26327096A JP3103311B2 (ja) | 1996-10-03 | 1996-10-03 | Ｒａｋｅ受信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10112673A true JPH10112673A (ja) | 1998-04-28 |
| JP3103311B2 JP3103311B2 (ja) | 2000-10-30 |
Family
ID=17387135
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26327096A Expired - Fee Related JP3103311B2 (ja) | 1996-10-03 | 1996-10-03 | Ｒａｋｅ受信機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3103311B2 (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1118177A1 (en) * | 1997-02-24 | 2001-07-25 | Golden Bridge Technology, Inc. | Spread spectrum multipath combining subsystem and method |
| KR100307004B1 (ko) * | 1998-09-03 | 2001-11-05 | 가네꼬 히사시 | 보간 동기 검출 방법 및 무선 통신 시스템 |
| AU760220B2 (en) * | 1998-09-24 | 2003-05-08 | Lenovo Innovations Limited (Hong Kong) | CDMA receiver, path detection method and recording medium on which path detection control program is recorded |
| US6795422B2 (en) | 1998-09-30 | 2004-09-21 | Nec Corporation | Method of providing hysteresis in detection of path timing by multiplying delay profile by weighting coefficient |
| WO2004112270A1 (ja) * | 2003-06-10 | 2004-12-23 | Matsushita Electric Industrial Co., Ltd. | 受信装置 |
| US6968197B2 (en) | 2000-04-06 | 2005-11-22 | Ntt Docomo, Inc. | Apparatus and method for acquisition of communication quality |
-
1996
- 1996-10-03 JP JP26327096A patent/JP3103311B2/ja not_active Expired - Fee Related
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1118177A1 (en) * | 1997-02-24 | 2001-07-25 | Golden Bridge Technology, Inc. | Spread spectrum multipath combining subsystem and method |
| EP1118177A4 (en) * | 1997-02-24 | 2006-02-01 | Golden Bridge Tech Inc | SUBSYSTEM AND METHOD FOR MULTI-WAY COMBINATION OF A SPREADING SPECTRUM DEVICE |
| KR100307004B1 (ko) * | 1998-09-03 | 2001-11-05 | 가네꼬 히사시 | 보간 동기 검출 방법 및 무선 통신 시스템 |
| AU760220B2 (en) * | 1998-09-24 | 2003-05-08 | Lenovo Innovations Limited (Hong Kong) | CDMA receiver, path detection method and recording medium on which path detection control program is recorded |
| US6768729B1 (en) | 1998-09-24 | 2004-07-27 | Nec Corporation | CDMA receiver, path detection method, and recording medium on which path detection control program is recorded |
| US6795422B2 (en) | 1998-09-30 | 2004-09-21 | Nec Corporation | Method of providing hysteresis in detection of path timing by multiplying delay profile by weighting coefficient |
| US6968197B2 (en) | 2000-04-06 | 2005-11-22 | Ntt Docomo, Inc. | Apparatus and method for acquisition of communication quality |
| WO2004112270A1 (ja) * | 2003-06-10 | 2004-12-23 | Matsushita Electric Industrial Co., Ltd. | 受信装置 |
| CN100452672C (zh) * | 2003-06-10 | 2009-01-14 | 松下电器产业株式会社 | 接收器 |
| US7643462B2 (en) | 2003-06-10 | 2010-01-05 | Panasonic Corporation | Selective storing order method in CDMA receiver |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3103311B2 (ja) | 2000-10-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |