WO2018163359A1 - 送信装置、受信装置、通信システムおよび送信方法 - Google Patents

送信装置、受信装置、通信システムおよび送信方法 Download PDF

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WO2018163359A1
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signal
data
fixed sequence
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文大 長谷川
彰浩 岡崎
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三菱電機株式会社
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    • H04L27/34—Amplitude- and phase-modulated carrier systems, e.g. quadrature-amplitude modulated carrier systems
    • H04L27/36—Modulator circuits; Transmitter circuits

Definitions

  • the present invention relates to a transmission device, a reception device, a communication system, and a transmission method for transmitting a digital signal.
  • transmission path frequency selectivity and time variation occur due to multipath fading caused by reflection of a transmission signal on a building or the like or Doppler fluctuation caused by movement of a communication device.
  • a signal received by a communication device is a signal in which a transmission symbol that directly arrives from a transmission source communication device interferes with a symbol that arrives after being reflected by a building or the like.
  • an OFDM (Orthogonal Frequency Division Multiplexing) transmission method for example, the following non-patent patent
  • a multicarrier (Multiple Carrier: MC) block transmission. Reference 1) may be used.
  • the present invention has been made in view of the above, and an object of the present invention is to obtain a transmission apparatus capable of suppressing out-of-band power and improving transmission efficiency.
  • the present invention is a transmission apparatus compatible with a multicarrier block transmission system, a fixed sequence generation unit that generates a fixed sequence, and a data symbol as a time domain signal. And a data series generation unit that converts and generates a data signal.
  • the transmission apparatus divides the fixed sequence into two and arranges them at the beginning and end of the block, and generates a block signal by arranging the data sequence that is an output signal from the data sequence generation unit between the two fixed sequences.
  • a multiplexing unit that performs the interpolation process on the block signal.
  • the transmission device according to the present invention has an effect of suppressing out-of-band power and improving transmission efficiency.
  • FIG. 3 is a diagram illustrating a configuration example of a conversion unit and an interpolation unit according to the first embodiment.
  • the flowchart which shows an example of the operation
  • 1 is a diagram illustrating an example of a control circuit that realizes a base station according to a first embodiment
  • 1 is a diagram illustrating an example of dedicated hardware for realizing a base station according to a first embodiment
  • FIG. The figure which shows the structural example of the base station concerning Embodiment 3.
  • FIG. 5 The figure which shows the structural example of the terminal concerning Embodiment 5.
  • FIG. 5 The figure which shows the structural example of the receiver concerning Embodiment 5.
  • FIG. The flowchart which shows an example of the operation
  • FIG. 6 The figure which shows the structural example of the receiver concerning Embodiment 6.
  • FIG. 1 is a diagram of a configuration example of a communication system according to the first embodiment of the present invention.
  • a communication system 3 according to the first embodiment includes a base station 1 and a plurality of terminals 2 1 to 2 n .
  • terminals 2 1 to 2 n when there is no need to distinguish between the plurality of terminals 2 1 to 2 n, they are referred to as terminals 2.
  • the terminal 2 is a communication device also called a user terminal or UE (User Equipment).
  • a transmission path from the base station 1 to the terminal 2 is called a downlink, and a transmission path from the terminal 2 to the base station 1 is called an uplink.
  • the base station 1 is a transmitting device and the terminal 2 is a receiving device.
  • the terminal 2 is a transmitting device and the base station 1 is a receiving device.
  • the OFDM scheme is used for downlink communication.
  • the base station 1 is a transmitting device and the terminal 2 is a receiving device.
  • FIG. 2 is a diagram of a configuration example of the base station 1 according to the first embodiment.
  • the base station 1 includes a data generation unit 11, a conversion unit 12, an adjustment unit 13, a fixed sequence generation unit 14, a multiplexing unit 15, an interpolation unit 16, a transmission unit 17, a reception unit 21, a demodulation unit 22, an information extraction unit 23, and a control.
  • An information generation unit 31, a control unit 32, and an information management unit 33 are provided.
  • Data generation unit 11, conversion unit 12, adjustment unit 13, fixed sequence generation unit 14, multiplexing unit 15, interpolation unit 16, and transmission unit 17 constitute transmission apparatus 10.
  • the data generation unit 11, the conversion unit 12, and the adjustment unit 13 constitute a data series generation unit 18.
  • the receiving unit 21, the demodulating unit 22, and the information extracting unit 23 constitute a receiving device 20.
  • the data generation unit 11 generates a data symbol based on the information series transmitted to the terminal 2.
  • the data symbol generated by the data generation unit 11 is, for example, a data symbol such as a PSK (Phase Shift Keying) symbol or a QAM (Quadrature Amplitude Modulation) symbol. Error correction processing may be performed on the information series used for generating the data symbols.
  • the information sequence transmitted to the terminal 2 may include control information.
  • the conversion unit 12 generates a data signal that is a multicarrier signal by converting the data symbol generated by the data generation unit 11 into a signal in the time domain. The output signal of the conversion unit 12 becomes the input signal of the adjustment unit 13.
  • the adjustment unit 13 adjusts the time-domain signal (hereinafter referred to as a time-domain signal) input from the conversion unit 12 so that the signal length is instructed by the control unit 32.
  • the adjustment of the length of the time domain signal by the adjusting unit 13 is performed by reducing the number of samples of the time signal domain signal.
  • the process in which the adjustment unit 13 adjusts the length of the time domain signal will be described separately.
  • the adjustment unit 13 does not perform the process of reducing the number of signal samples when the length of the signal instructed from the control unit 32 is the same as the length of the input time domain signal.
  • the control unit 32 may instruct the adjusting unit 13 not to adjust the length of the time domain signal but to the number of samples to be reduced from the input time domain signal.
  • the output signal of the adjustment unit 13 becomes the input signal of the multiplexing unit 15.
  • the time domain signal output from the adjustment unit 13 is referred to as a data series.
  • the fixed sequence generation unit 14 generates a fixed sequence composed of a plurality of fixed symbols to be inserted into the transmission signal.
  • a fixed symbol is a symbol with a predetermined signal value.
  • the fixed series may be any series.
  • a zero sequence formed by zero symbols can be a fixed sequence.
  • the output signal of the fixed sequence generation unit 14 becomes the input signal of the multiplexing unit 15.
  • the multiplexing unit 15 generates a block signal by arranging the output of the fixed sequence generation unit 14 and the output of the adjustment unit 13 in a block composed of a prescribed number of transmission symbols.
  • the block signal output from the multiplexing unit 15 is referred to as a block X.
  • the length of the block X is N samples. Therefore, the total of the length of the fixed sequence output from the fixed sequence generation unit 14 and the length of the data sequence output from the adjustment unit 13 is N samples.
  • the multiplexing unit 15 divides the input fixed sequence into two and arranges them at both ends in the block X.
  • the lengths of the two fixed sequences after the division into two may be any length.
  • the respective lengths may be T 1 and T 2 .
  • the multiplexing unit 15 arranges the data series input from the adjustment unit 13 in the center of the block X, that is, between the fixed series divided into two.
  • the adjustment unit 13 adjusts the length of the time domain signal using a digital filter or the like.
  • the processing that ends up can be considered.
  • the data series that is the signal y ′ after the filtering process is represented by the equation (1).
  • the adjustment unit 13 outputs a certain number of samples at both ends, that is, the remaining samples other than the zero sample to the multiplexing unit 15.
  • the adjustment unit 13 does not have to change the signal length.
  • the length of the input signal to the adjustment unit 13 and the length of the output signal of the adjustment unit 13 are the same, and the output signal to the multiplexing unit 15 is in a state where zeros are added to both ends.
  • the multiplexing unit 15 deletes zeros at both ends of the input signal, and then adds a fixed series divided into two to both ends.
  • the length at which the fixed sequence is divided is the length of the two fixed sequences after being divided, and the length T of the fixed sequence before being divided are the maximum delay time and the out-of-band power in the multipath transmission line. May be determined based on the desired suppression amount.
  • the maximum delay time in the multipath transmission path is the maximum delay time added in the transmission path to the signal transmitted from the transmission apparatus 10 to the terminal 2. For example, when the length T of the fixed sequence before being divided is determined based on the maximum delay time, the terminal 2 as a receiving apparatus measures the maximum delay time and feeds back to the base station 1. The base station 1 determines the fixed sequence length T so as to be longer than the fed back maximum delay time.
  • the amount of suppression of out-of-band power is determined by the ratio of the lengths of the two fixed sequences after division, that is, the ratio of T 1 and T 2 . Therefore, the base station 1 determines the lengths T 1 and T 2 so that the ratio can achieve the desired amount of suppression.
  • the control unit 32, the control information generation unit 31, or the upper layer determines the length at which the fixed sequence is divided and the fixed sequence length T.
  • the control unit 32 gives an operation instruction to the fixed sequence generation unit 14, the adjustment unit 13, and the multiplexing unit 15 based on the determination result.
  • the control unit 32 instructs the fixed sequence generation unit 14 about the length T of the fixed sequence to be generated, instructs the adjustment unit 13 the length of the data sequence to be output, and instructs the multiplexing unit 15
  • the lengths T 1 and T 2 of the two fixed sequences after the division into two are indicated.
  • the instruction from the control unit 32 to the multiplexing unit 15 may be the length of one of the two fixed sequences after the division or the ratio of the lengths of the two fixed sequences. Note that the type and value of the sequence used as a fixed sequence, the ratio between T 1 and T 2 , and the value of T are reported from the base station 1 to the terminal 2 using a control channel or the like.
  • the control channel is a channel used when the base station 1 transmits control information necessary for demodulation of the data signal and other control information to the terminal 2.
  • Control information is transmitted to the terminal 2 using dedicated symbols or subcarriers.
  • LTE Long Term Evolution
  • PDCCH Physical Downlink Control Channel
  • a specific example of the block X output from the multiplexing unit 15 is shown below.
  • p 0, p 1 the output of the fixed sequence generation unit 14, ..., p T-1 , the output of the adjusting unit 13 s 0, s 1, ... , a s M-1.
  • the multiplexing unit 15 divides the input fixed sequence into two parts having the same length.
  • the block X is represented by the equation (2).
  • FIG. 3 a fixed sequence A and a fixed sequence B are fixed sequences after being divided into two in the multiplexing unit 15, and an adjustment unit output is a data sequence output from the adjustment unit 13. As shown in FIG. 3, the adjustment unit output is arranged so as to be sandwiched between fixed series A and fixed series B after being divided into two.
  • the block X output from the multiplexing unit 15 becomes an input signal of the interpolation unit 16.
  • the interpolation unit 16 performs an interpolation process on the block X, which is a time domain signal, and generates a transmission signal.
  • F is an integer or a fraction of 1 or more, for example, 3/2, 4/3, or the like.
  • N1 is an integer
  • a block output from the interpolation unit 16 is a block Y, and the number of samples of the block Y is N1.
  • the interpolating unit 16 applies a process that causes a recursive cyclicity to the phase of each signal in the block Y. For example, if interpolation processing is performed using a signal interpolation formula described in the document “B. Porat,“ A Course in Digital Signal Processing ”, John Wiley and Sons Inc., 1997” (hereinafter referred to as the “Porat document”). Then, a recursive cyclicity occurs in the phase of each signal in the block Y.
  • the aliasing cyclicity is a state in which the phases of y 0 and y N1-1 are continuous, that is, y refers to the state where the phase continuous phase and y 0 of N1-1. That is, when a fixed sequence is inserted at both ends of a block as in this embodiment, the phase of y N1-1 at the end of the first block adjacent on the time axis and the beginning y of the second block The phase of 0 is continuous, and the phase is continuous between the two blocks.
  • the interpolation processing is generally called oversampling processing. Therefore, an interpolated sample is inserted between N samples of the block X, and a signal obtained as N1 samples is a block Y.
  • the transmission apparatus 10 performs each process performed in the above-described conversion unit 12 to interpolation unit 16 for each block. That is, the same fixed sequence is inserted at the same location in each block. For example, assuming that the sequence output from the adjustment unit 13 in the process for the Kth block is s k, 0 , s k, 1 ,..., S k, M ⁇ 10 , the block X output from the multiplexing unit 15 is expressed by equation (3). ).
  • m is a block number.
  • the range of block numbers is generally determined by the frame length or burst length.
  • One frame is composed of one or more block signals, and one burst is composed of one or more frames.
  • the block Y output by the interpolation unit 16 becomes an input signal of the transmission unit 17.
  • the transmission unit 17 performs digital-analog conversion processing, frequency conversion processing, and the like on the input block Y, and then transmits it to the terminal 2.
  • the transmission unit 17 does not need to perform a process of adding CP (Cyclic Prefixing) that is required in a conventional OFDM transmission device.
  • CP Cyclic Prefixing
  • the reason why the process of adding the CP is not necessary is that the multiplexing unit 15 inserts a fixed sequence at the beginning and end of the OFDM signal of each block. That is, it seems that the CP is inserted by the fixed series arranged at the end of the block before the two consecutive blocks and the head of the subsequent block.
  • FIG. 4 is a diagram illustrating a configuration example of the conversion unit 12 and the interpolation unit 16 according to the first embodiment. In FIG. 4, other components constituting the base station 1 are also described.
  • the conversion unit 12 includes an IDFT (Inverse Discrete Fourier Transform) unit 121.
  • the IDFT unit 121 performs N-point IDFT processing on the input signal to convert it into a time domain signal.
  • the output of the IDFT unit 121 is N points.
  • the interpolation unit 16 includes a DFT (Discrete Fourier Transform) unit 161, a zero insertion unit 162, and an IDFT unit 163.
  • the DFT unit 161 is a frequency domain conversion unit that performs N-point DFT processing on an input signal and converts the input signal into a frequency domain signal.
  • the output of the DFT unit 161 is N points.
  • the zero insertion unit 162 inserts zero into the input signal.
  • Zero insertion processing in the frequency domain is equivalent to interpolation processing in the time domain. There is no restriction on the zero insertion point.
  • the zero insertion unit 162 inserts zeros into the input signal using, for example, the technique described in the Porat document.
  • the number of zeros inserted by the zero insertion unit 162 is assumed to be KN points. That is, the zero insertion unit 162 inserts zeros into the N-point input signal to generate a K-point signal, and outputs this signal.
  • the IDFT unit 163 is a time domain conversion unit that performs K-point IDFT processing on an input signal and converts the input signal into a time domain signal.
  • the receiving unit 21 receives the uplink signal transmitted from the terminal 2, and performs frequency conversion processing, analog-digital conversion processing, and the like on the received uplink signal.
  • the output signal of the reception unit 21 becomes an input signal of the demodulation unit 22.
  • the demodulator 22 demodulates the input signal from the receiver 21.
  • the demodulator 22 performs a decoding process on the demodulated signal to restore the information transmitted from the terminal 2.
  • the information restored by the demodulation unit 22 becomes an input signal of the information extraction unit 23.
  • the information extraction unit 23 extracts information required by the subsequent control information generation unit 31 from the input information.
  • the information extraction unit 23 extracts transmission path information from the information restored by the demodulation unit 22 and outputs the transmission path information to the control information generation unit 31.
  • the transmission path information is information indicating the state of the transmission path between the base station 1 and the terminal 2, that is, the state of the downlink transmission path.
  • the transmission path information includes, but is not limited to, information indicating the state of the transmission path in a complex number, a ratio of received signal power to noise power, the number of paths in a multipath transmission path, and the like.
  • the transmission path information extracted by the information extraction unit 23 becomes an input signal of the control information generation unit 31.
  • the control information generation unit 31 determines a parameter of the transmission signal based on the state of the transmission path indicated by the input transmission path information.
  • the parameters of the transmission signal here are the length of the fixed sequence generated by the fixed sequence generation unit 14, the length of the fixed sequence after division when the multiplexing unit 15 divides the fixed sequence into two, and the like.
  • the control information generation unit 31 generates control information indicating the determined parameter and outputs it to the control unit 32.
  • the control information generation unit 31 determines the parameter of the transmission signal, but the control unit 32 may determine it. In that case, the control information generation unit 31 outputs the transmission path information to the control unit 32.
  • the control information generation unit 31 generates control signals to be output to the conversion unit 12, the adjustment unit 13, the fixed sequence generation unit 14, and the multiplexing unit 15, and the generated control signals are transmitted from the control information generation unit 31. You may make it output to each part.
  • the fixed sequence may be read from a storage unit such as a memory.
  • the fixed sequence generation unit 14 shown in FIG. 2 serves as a storage unit
  • the control signal from the control unit 32 to the storage unit serves as a control signal that instructs the output of the fixed sequence.
  • the fixed series is arranged at both ends of the block, that is, at the beginning and end of the block. However, if necessary, the fixed series is arranged at the beginning and end, and other than the beginning and end. Another fixed series may be arranged at a predetermined position. In this case, a position other than the head and the end is specified from the control unit 32 to the multiplexing unit 15, and the multiplexing unit 15 places the fixed sequence generated by the fixed sequence generation unit 14 at the specified position.
  • the positions other than the head and the tail are positions corresponding to the center of the N symbols input to the multiplexing unit 15.
  • the control unit 32 may notify the data generation unit 11 and the fixed sequence generation unit 14 of the block number where q i is arranged, that is, the block number m in the equation (3).
  • the symbol length of the output signal of the adjustment unit 13 is NTT ′.
  • the output symbol length of the data generation unit 11 is set to N, and the adjustment unit 13 sets the total T symbols at both ends and the T ′ symbol centered on the position specified by the control unit 32 to zero for a total of T + T ′ symbols. You can do it.
  • the output symbol length of the data generation unit 11 may be NT ′, and the adjustment unit 13 may set the total T symbols at both ends to zero.
  • the control information generator 31 may receive a signal from the information manager 33.
  • the information management unit 33 manages control information received from an upper layer.
  • the upper layer here may be an upper device or other base station that manages the base station 1 including the transmission device 10, but the upper layer is not limited to this.
  • the control information received from the upper layer includes, for example, the number N of OFDM block samples and the length T of the fixed sequence generated by the fixed sequence generation unit 14. In this case, these pieces of information, that is, the number of samples N and the length T are determined by the upper layer.
  • the upper layer also determines the length when the adjustment unit 13 shortens the input signal, that is, the number of samples of the adjusted signal or the number of samples to be reduced by the adjustment process, and information on the determined length is obtained from the upper layer.
  • the information may be input to the information management unit 33.
  • fixed series values and arrangement position information may be input from an upper layer to the information management unit 33, and the information management unit 33 may output this information to the control information generation unit 31.
  • control information instructing to always use a fixed value and a fixed position of a parameter, or control information instructing to use a fixed value and a fixed position of a parameter for a plurality of designated blocks and block sections is an upper layer.
  • the control information is generated based on the network congestion status. For example, when the network is congested, it is difficult to transmit a large amount of data. Therefore, it is conceivable to generate control information instructing to configure a transmission frame with a short block length.
  • the control unit 32 Based on the control information input from the control information generation unit 31, the control unit 32 outputs control signals to the data generation unit 11, the conversion unit 12, the adjustment unit 13, the fixed sequence generation unit 14, and the multiplexing unit 15. Is generated. As already described, the control unit 32 instructs the fixed sequence generation unit 14 about the length T of the fixed sequence to be generated, instructs the adjustment unit 13 the length of the data sequence to be output, It instructs the multiplexing unit 15 about the lengths T 1 and T 2 of the two fixed sequences after the division into two. The control unit 32 also designates the length of the signal to be deleted and the deletion method for the adjustment unit 13. A specific example of the deletion method is deletion using a digital filter. The control unit 32 may instruct whether to adjust the length of the input signal in the instruction to the adjustment unit 13. The length of the data series output by the adjustment unit 13, that is, the number of points that the adjustment unit 13 deletes from the input signal may be variable.
  • control unit 32 instructs the data generation unit 11 to determine the number of data symbols to be generated and the number of data symbols to be generated.
  • the control unit 32 instructs the conversion unit 12 to convert the input data symbol.
  • the content of the transmission process performed by the base station 1 is parameterized and transmitted from the base station 1 to the terminal 2 as control information.
  • the terminal 2 performs reception processing using the parameter received as control information from the base station 1.
  • the base station 1 transmits control information to the terminal 2 in accordance with, for example, an RRC (Radio Resource Control) protocol defined in the 3GPP LTE standard.
  • the control information may include parameters that specify the data length, the type of fixed sequence, and the like.
  • the base station 1 includes parameters that do not change over a long period of time in control information transmitted in an upper layer and transmits the parameters to the terminal 2.
  • the base station 1 includes the adaptively changing parameter in the control information that is periodically transmitted and transmits the parameter to the terminal 2. For example, since the PDCCH defined in the 3GPP LTE standard can be used for transmission of control information that is periodically transmitted to the terminal, the base station 1 transmits the control information using the PDCCH.
  • FIG. 5 is a flowchart illustrating an example of an operation in which the base station 1 transmits a downlink signal.
  • the base station 1 first generates control information to be transmitted to the terminal 2 (step S11).
  • the control information transmitted to the terminal 2 is a parameter necessary for the terminal 2 to demodulate the data signal, for example.
  • This parameter corresponds to a parameter indicating a modulation scheme applied to a data signal, a coding scheme, a length of a fixed sequence included in one block, a type of fixed sequence, and the like.
  • the control information is generated by the control unit 32. In this case, the control information is input from the control unit 32 to the data generation unit 11 and transmitted as a data symbol.
  • the control information generation unit 31 may generate control information to be transmitted to the terminal 2.
  • control information generation unit 31 may output the generated control information to the control unit 32 and transmit the generated control information to the terminal 2 via the data generation unit 11, or the generated control information may be transmitted to the terminal 2 via the multiplexing unit 15. May be sent to.
  • control information generating unit 31 When transmitting control information via the multiplexing unit 15, the control information generating unit 31 generates a data symbol including the control information and outputs the data symbol to the multiplexing unit 15.
  • the base station 1 generates a fixed sequence (step S12), and further generates a data symbol (step S13).
  • the fixed sequence generation is performed by the fixed sequence generation unit 14, and the data symbol generation is performed by the data generation unit 11. Note that the order in which step S12 and step S13 are executed may be reversed. Further, these two steps may be executed in parallel.
  • the data generation unit 11 generates the number of data symbols instructed from the control unit 32, and the fixed sequence generation unit 14 generates the number of fixed symbols instructed from the control unit 32.
  • the base station 1 converts the data symbol generated in step S13 into a time domain signal to generate a time domain data signal (step S14).
  • the conversion unit 12 performs the process in step S14.
  • the base station 1 adjusts the length of the data signal that is the data symbol after being converted into the time domain signal (step S15).
  • the adjustment unit 13 performs the process in step S15.
  • the adjustment unit 13 adjusts the length of the input data signal to the length designated by the control unit 32 and outputs the adjusted data signal.
  • the base station 1 multiplexes the fixed sequence generated in step S12 and the data sequence that is the data signal after adjusting the length in step S15 (step S16).
  • the multiplexing unit 15 performs the process in step S16.
  • the multiplexing unit 15 divides the fixed sequence into two fixed sequences having a length designated by the control unit 32 and arranges the fixed sequence on the block head side and the tail side, and arranges the data sequence between the two fixed sequences and blocks X is generated.
  • the base station 1 performs an interpolation process on the block X generated by multiplexing the fixed sequence and the data sequence (step S17).
  • the processing in step S17 is performed by the interpolation unit 16.
  • the interpolation unit 16 converts the block X into a frequency domain signal, inserts zeros, and converts the block X back into a time domain signal, thereby generating a signal having a predetermined length.
  • the base station 1 transmits the signal generated in step S17 to the terminal 2 (step S18).
  • the transmission unit 17 performs the process in step S18.
  • transmitting apparatus 10 constituting base station 1 arranges two fixed sequences obtained by dividing the fixed sequence into two at the beginning and end of the block, and the central portion of the block That is, a block signal having a configuration in which data symbols are arranged between two fixed sequences is generated. Further, the transmission device 10 inserts zero in the frequency domain with respect to the block signal, performs interpolation processing, and generates a transmission signal. Thereby, the phase becomes continuous between two consecutive block signals, and the out-of-band power of the transmission signal can be suppressed. Moreover, since it is not necessary to add a CP by arranging fixed sequences at the head and tail of the block signal, transmission efficiency can be improved. Further, when the fixed sequence is non-zero, that is, not a zero sequence, the receiving side can estimate the transmission path using the fixed sequence, and there is no need to transmit a reference signal to the block. Therefore, the transmission efficiency can be further improved.
  • Each component of the base station 1 is realized by a processing circuit.
  • the processing circuit may be a circuit in which a processor executes software, or may be a dedicated circuit. Further, some components may be realized by a circuit in which a processor executes software, and the remaining components may be realized by a dedicated circuit.
  • FIG. 6 is a diagram illustrating an example of a control circuit that implements the base station 1.
  • the control circuit includes an input unit 101, a processor 102, a memory 103, and an output unit 104.
  • the input unit 101 is a circuit that receives data input from the outside.
  • the output unit 104 is a circuit that transmits data to the outside.
  • the processor 102 is a CPU (Central Processing Unit, central processing unit, processing unit, arithmetic unit, microprocessor, microcomputer, processor, DSP (Digital Signal Processor)).
  • the memory 103 is nonvolatile or volatile, such as RAM (Random Access Memory), ROM (Read Only Memory), flash memory, EPROM (Erasable Programmable Read Only Memory), EEPROM (Electrically Erasable Programmable Read Only Memory), etc. Semiconductor memory, magnetic disk, flexible disk, optical disk, compact disk, mini disk, DVD (Digital Versatile Disk), etc. are applicable.
  • the processing circuit that realizes the components of the base station 1 is the control circuit shown in FIG. 6, the processor 102 reads and executes the program corresponding to each component of the base station 1 stored in the memory 103. Thus, each component is realized.
  • the memory 103 is also used as a temporary memory in each process performed by the processor 102.
  • FIG. 7 is a diagram illustrating an example of dedicated hardware for realizing the base station 1.
  • the dedicated circuit illustrated in FIG. 7 includes an input unit 101, a processing circuit 110, and an output unit 104.
  • the input unit 101 and the output unit 104 are the same circuits as the input unit 101 and the output unit 104 shown in FIG.
  • the processing circuit 110 is a single circuit, a composite circuit, a programmed processor, a parallel programmed processor, an ASIC (Application Specific Integrated Circuit), an FPGA (Field Programmable Gate Array), or a combination thereof.
  • Embodiment 2 a transmission apparatus according to the second embodiment will be described.
  • the transmission apparatus according to the present embodiment configures the base station 1 of the communication system illustrated in FIG. 1, similarly to the transmission apparatus 10 described in the first embodiment.
  • the base station concerning Embodiment 2 is described as the base station 1a.
  • differences from the first embodiment will be described.
  • FIG. 8 is a diagram of a configuration example of the base station 1a according to the second embodiment.
  • the base station 1a is obtained by replacing the transmission device 10 and the control unit 32 of the base station 1 according to the first embodiment with a transmission device 10a and a control unit 32a.
  • the transmission device 10a includes a data generation unit 11, a conversion unit 12, an adjustment unit 13, a multiplexing unit 15, an interpolation unit 16, a transmission unit 17, a zero sequence generation unit 41, a fixed sequence generation unit 42, and a synthesis unit 43.
  • the data generation unit 11, the conversion unit 12, the adjustment unit 13, the multiplexing unit 15, the interpolation unit 16, and the transmission unit 17 of the transmission device 10a are configured with the same components as those of the transmission device 10 according to the first embodiment. A similar process is executed. Therefore, description of these components is omitted.
  • the zero sequence generation unit 41 generates the number of zero symbols specified by the control unit 32a and outputs the zero symbols to the multiplexing unit 15 as a zero sequence. Note that the multiplexing unit 15 divides the zero sequence input from the zero sequence generation unit 41 into two and arranges them at the beginning and end of the block.
  • the zero sequence generation unit 41 is a first fixed sequence generation unit in the transmission device 10a.
  • the fixed sequence generation unit 42 which is a second fixed sequence generation unit in the transmission device 10a, generates a fixed sequence composed of a plurality of fixed symbols.
  • the fixed sequence generated by the fixed sequence generation unit 42 is a fixed sequence after processing similar to the interpolation processing performed by the interpolation unit 16 on the block X input from the multiplexing unit 15 is performed.
  • the fixed sequence generation unit 42 generates a non-zero fixed sequence, performs, for example, the interpolation processing described in the DCChu literature described above on the generated fixed sequence, and outputs the fixed sequence after the interpolation processing .
  • FIG. 9 is a diagram illustrating a configuration example of the fixed sequence generation unit 42.
  • the fixed sequence generation unit 42 includes a fixed symbol generation unit 421, a zero symbol generation unit 422, a multiplexing unit 423, and an interpolation unit 424.
  • the fixed symbol generation unit 421 generates a plurality of fixed symbols and outputs them to the multiplexing unit 423.
  • the zero symbol generation unit 422 generates a plurality of zero symbols and outputs them to the multiplexing unit 423. Note that the fixed symbol generation unit 421 generates the same number of fixed symbols as the plurality of zero symbols generated by the zero sequence generation unit 41.
  • the zero symbol generation unit 422 generates the same number of zero symbols as the data symbols output from the adjustment unit 13 to the multiplexing unit 15.
  • the multiplexing unit 423 performs the same process as the multiplexing unit 15.
  • the multiplexing unit 423 divides a plurality of fixed symbols into two and arranges them at the beginning and end of the block, and arranges a plurality of zero symbols at the center of the block. Note that the multiplexing unit 423 divides a plurality of fixed symbols into two at the same ratio as the ratio at which the multiplexing unit 15 divides the zero sequence into two.
  • the interpolation unit 424 performs the same interpolation processing as the interpolation unit 16 as an input signal from the multiplexing unit 423, that is, a signal in which a plurality of fixed symbols are arranged at the beginning and end of a block and a plurality of zero symbols are arranged in the center. , Run against. That is, the number of output symbols from the interpolation unit 424 is equal to the number of output symbols from the interpolation unit 16.
  • the fixed sequence generation unit 42 may be configured to hold a fixed sequence after interpolation processing in a memory, and read and output this.
  • the fixed sequence generation unit 42 may hold a plurality of types of fixed sequences in a memory and output any one of the fixed sequences in accordance with an instruction from the control unit 32a.
  • the synthesis unit 43 synthesizes the input signal from the interpolation unit 16 and the input signal from the fixed sequence generation unit 42. Specifically, the synthesis unit 43 includes the post-interpolation zero sequence included in the input signal from the interpolation unit 16 and the post-interpolation processing included in the input signal from the fixed sequence generation unit 42. Replace with a fixed series. As a result, a signal similar to the signal output from the interpolation unit 16 of the transmission apparatus 10 according to the first embodiment is generated. The output signal of the synthesis unit 43 becomes the input signal of the transmission unit 17.
  • the control unit 32a outputs a control signal instructing the operation to be performed to the data generation unit 11, the conversion unit 12, the adjustment unit 13, the multiplexing unit 15, the zero sequence generation unit 41, and the fixed sequence generation unit 42. To do.
  • the configuration of the conversion unit 12 and the interpolation unit 16 of the transmission device 10a is the same as the configuration of the conversion unit 12 and the interpolation unit 16 of the transmission device 10, as shown in FIG.
  • the interpolation unit 424 of the fixed sequence generation unit 42 shown in FIG. 9 includes a DFT unit 241, a zero insertion unit 242, and an IDFT unit 243, as shown in FIG.
  • the DFT unit 241 performs N-point DFT processing on the input signal.
  • the zero insertion unit 242 inserts zero into the input signal.
  • the zero insertion unit 242 inserts zero into the input signal in the same manner as the zero insertion unit 162 of the interpolation unit 16.
  • the number of zeros inserted by the zero insertion unit 242 is set to KN points as in the zero insertion unit 162 of the interpolation unit 16.
  • the IDFT unit 243 performs K-point IDFT processing on the input signal.
  • the multiplexing unit 15 generates a block signal in which the zero sequence is arranged at the beginning and the end and the data sequence is arranged at the center. Interpolate the block signal.
  • the fixed sequence generation unit 42 generates a fixed sequence after the interpolation process, and the synthesis unit 43 combines the block signal after the interpolation process and the fixed sequence after the interpolation process to generate a transmission signal. Similar to the transmission device 10 according to the first embodiment, the transmission device 10a according to the present embodiment can suppress the out-of-band power of the transmission signal and can improve the transmission efficiency.
  • the transmission device 10a according to the present embodiment can be realized by the hardware having the configuration illustrated in FIG. 6 or FIG. 7, as with the transmission device 10 according to the first embodiment.
  • the fixed series is arranged at both ends of the block, that is, at the beginning and end of the block.
  • the fixed series is arranged at the beginning and end, and other than the both ends can be determined.
  • Another fixed series may be arranged at a different position.
  • the control unit 32a designates positions other than both ends to the fixed sequence generation unit 42, and the fixed sequence generation unit 42 generates a signal in which the fixed sequences are arranged at both ends of the block and the designated positions.
  • An interpolation process is performed to generate a fixed series after the interpolation process.
  • the sequence generated by the fixed sequence generation unit 42 is combined with the signal output from the interpolation unit 16 by the combining unit 43.
  • the positions other than both ends are positions corresponding to the center of N symbols inputted to the multiplexing unit 15.
  • the data series generation unit 18 and the multiplexing unit 15 generate a block signal in which the sample at the beginning and the end of the block is set to zero and the area around the place specified by the control unit 32a is also set to zero.
  • the fixed symbol generation unit 421 generates q i and p i
  • the multiplexing unit 423 places q i and p i at the designated location.
  • q i and p i are different series.
  • T ′ is the length of the fixed sequence q i and is determined by the control unit 32a.
  • p i is divided and arranged in the multiplexing unit 423 at the beginning and end of the block.
  • Q i is arranged by the multiplexing unit 423 at a place other than both ends of the block.
  • the reason why the block is arranged at both ends of the block is that if a fixed sequence is arranged at the center of the block other than both ends for phase noise correction and Doppler shift correction, the terminal 2 uses the fixed sequence for phase noise correction and Doppler shift. This is because frequency correction such as correction can be performed. Note that fixed symbols arranged at locations other than both ends need not be inserted into all blocks.
  • control unit 32a sends the block number where q i is arranged, that is, the block number m in the equation (3) to the data generation unit 11, the zero sequence generation unit 41, and the fixed sequence generation unit 42. Just notify.
  • Embodiment 3 FIG. Next, a transmission apparatus according to the third embodiment will be described.
  • the transmission apparatus according to the present embodiment configures the base station 1 of the communication system shown in FIG.
  • the transmission apparatus according to the present embodiment is a modification of the transmission apparatus 10 described in the first embodiment.
  • the base station according to the third embodiment is referred to as a base station 1b in the following description.
  • differences from the first embodiment will be described.
  • FIG. 12 is a diagram of a configuration example of the base station 1b according to the third embodiment.
  • the base station 1b is obtained by replacing the transmission device 10 and the control unit 32 of the base station 1 according to the first embodiment with a transmission device 10b and a control unit 32b.
  • the transmission device 10b is obtained by deleting the adjustment unit 13 from the transmission device 10 and replacing the conversion unit 12 with a conversion unit 12b. Since components other than the conversion unit 12b of the transmission device 10b are the same as those of the transmission device 10 with the same reference numerals, the description thereof is omitted.
  • the data generation unit 11 and the conversion unit 12b constitute a data series generation unit 18b.
  • the conversion unit 12b includes an IDFT unit 121b that performs MFT IDFT processing on an input signal.
  • the output of the IDFT unit 121b is M points. Therefore, the conversion unit 12b generates and outputs a time domain signal having the same length as the signal output from the adjustment unit 13 of the transmission apparatus 10 according to the first embodiment.
  • data generation unit 11 generates and outputs M sample data symbols
  • conversion unit 12b converts the M sample data symbols input from data generation unit 11 into M sample data symbols.
  • M-point IDFT processing is executed to generate a time domain signal of M samples.
  • the control unit 32b generates control signals to be output to the data generation unit 11, the conversion unit 12b, the fixed sequence generation unit 14, and the multiplexing unit 15, respectively.
  • the control signal generated by the control unit 32b is the same as the control signal output to the data generation unit 11, the conversion unit 12, the fixed sequence generation unit 14, and the multiplexing unit 15 by the control unit 32 of the first embodiment.
  • the control unit 32b outputs a control signal for instructing the data generation unit 11 to generate a data sequence having M series.
  • the transmission apparatus 10b according to the present embodiment can be realized by the hardware having the configuration illustrated in FIG. 6 or FIG. 7, as with the transmission apparatus 10 according to the first embodiment.
  • the fixed series is arranged at both ends of the block, that is, at the beginning and end of the block. However, if necessary, the fixed series is arranged at the beginning and end, and other than the beginning and end. Another fixed series may be arranged at a predetermined position. In this case, a position other than the beginning and end is specified from the control unit 32b to the multiplexing unit 15, and the multiplexing unit 15 arranges the fixed sequence generated by the fixed sequence generation unit 14 at the specified position.
  • the positions other than the head and the tail are positions corresponding to the center of the M symbols input to the multiplexing unit 15.
  • control unit 32b may notify the data generation unit 11 and the fixed sequence generation unit 14 of the block number where q i is arranged, that is, the block number m in the equation (3).
  • the symbol length of the output signal of the data series generation unit 18b is MTT ′.
  • Embodiment 4 FIG. Next, a transmission apparatus according to the fourth embodiment will be described.
  • the transmission apparatus according to the present embodiment configures the base station 1 of the communication system 3 illustrated in FIG. 1, similarly to the transmission apparatus 10 described in the first embodiment.
  • the transmission apparatus according to the present embodiment is a modification of the transmission apparatus 10a described in the second embodiment.
  • the base station according to the fourth embodiment is referred to as a base station 1c in the following description.
  • differences from the second embodiment will be described.
  • FIG. 13 is a diagram of a configuration example of the base station 1c according to the fourth embodiment.
  • the base station 1c is obtained by replacing the transmission device 10a and the control unit 32a of the base station 1a according to the second embodiment with a transmission device 10c and a control unit 32c.
  • the transmission device 10c is obtained by deleting the adjustment unit 13 from the transmission device 10a and replacing the conversion unit 12 with a conversion unit 12c. Since the components other than the conversion unit 12c of the transmission device 10c are the same as those of the transmission device 10a having the same reference numerals, the description thereof is omitted.
  • the conversion unit 12c includes an IDFT unit 121c that performs MFT IDFT processing on an input signal.
  • the output of the IDFT unit 121c is M points. Therefore, the conversion unit 12c generates and outputs a time domain signal having the same length as the signal output from the adjustment unit 13 of the transmission device 10a according to the second embodiment.
  • the data generation unit 11 generates and outputs a data sequence having the number of sequences M
  • the conversion unit 12c outputs the data sequence input from the data generation unit 11 to the data sequence.
  • M point IDFT processing is then performed to generate an M sample time domain signal.
  • the control unit 32c generates control signals to be output to the data generation unit 11, the conversion unit 12c, the fixed sequence generation unit 14, and the multiplexing unit 15, respectively.
  • the control signal generated by the control unit 32c is the same as the control signal output to the data generation unit 11, the conversion unit 12a, the fixed sequence generation unit 42, and the multiplexing unit 15 by the control unit 32a of the second embodiment.
  • the control unit 32c outputs a control signal instructing the data generation unit 11 to generate a data sequence with the number of sequences M.
  • the transmission device 10c according to the present embodiment can be realized by the hardware having the configuration illustrated in FIG. 6 or FIG. 7, as with the transmission device 10 according to the first embodiment.
  • the fixed series is arranged at both ends of the block, that is, at the beginning and end of the block.
  • the fixed series is arranged at the beginning and end, and other than the both ends can be determined.
  • Another fixed series may be arranged at a different position.
  • the control unit 32c designates positions other than both ends to the fixed sequence generation unit 42, and the fixed sequence generation unit 42 generates a signal in which the fixed sequences are arranged at both ends of the block and the designated positions.
  • An interpolation process is performed to generate a fixed series after the interpolation process.
  • the sequence generated by the fixed sequence generation unit 42 is combined with the signal output from the interpolation unit 16 by the combining unit 43.
  • the positions other than both ends are positions corresponding to the center of N symbols inputted to the multiplexing unit 15.
  • the data series generation unit 18b and the multiplexing unit 15 generate a block signal in which the sample at the beginning and the end of the block is set to zero and the area around the place specified by the control unit 32c is also set to zero.
  • the fixed symbol generation unit 421 generates q i and p i
  • the multiplexing unit 423 places q i and p i at the designated location.
  • q i and p i are different series.
  • T ′ is the length of the fixed sequence q i and is determined by the control unit 32c.
  • p i is divided and arranged in the multiplexing unit 423 at the beginning and end of the block.
  • Q i is arranged by the multiplexing unit 423 at a place other than both ends of the block.
  • the reason why the block is arranged at both ends of the block is that if a fixed sequence is arranged at the center of the block other than both ends for phase noise correction and Doppler shift correction, the terminal 2 uses the fixed sequence for phase noise correction and Doppler shift. This is because frequency correction such as correction is possible. Note that fixed symbols arranged at locations other than both ends need not be inserted into all blocks. In the case of such a configuration, the control unit 32c may notify the data generation unit 11 and the fixed sequence generation unit 42 of the block number where q i is arranged, that is, the block number m in the equation (3).
  • Embodiment 5 FIG. In the fifth embodiment, a terminal 2 that receives a signal transmitted by the base stations 1 and 1a described in the first and second embodiments will be described.
  • FIG. 14 is a diagram of a configuration example of the terminal 2 according to the fifth embodiment.
  • the terminal 2 includes a reception unit 61, a control information extraction unit 62, a control unit 63, a signal waveform restoration unit 64, a signal extraction unit 65, a conversion cancellation unit 66, a demodulation unit 67, a transmission path estimation unit 68, and a transmission path information generation unit 71. And a transmission unit 72.
  • the reception unit 61, the control information extraction unit 62, the control unit 63, the signal waveform restoration unit 64, the signal extraction unit 65, the conversion cancellation unit 66, the demodulation unit 67, and the transmission path estimation unit 68 constitute a reception device 60.
  • the transmission path information generation unit 71 and the transmission unit 72 constitute a transmission device 70.
  • the receiving unit 61 receives a downlink signal transmitted from the base station, and performs frequency conversion processing, analog-digital conversion processing, and the like on the received downlink signal.
  • the output signal of the receiving unit 61 becomes an input signal to the control information extracting unit 62, the signal waveform restoring unit 64, and the transmission path estimating unit 68.
  • the control information extraction unit 62 extracts control signal information included in the reception signal output from the reception unit 61 and outputs the control signal information to the control unit 63.
  • PDCCH corresponds to a signal including control information.
  • the control information extraction unit 62 extracts the PDCCH, extracts control information from the PDCCH, and outputs the control information to the control unit 63.
  • the control information output to the control unit 63 is a parameter necessary for demodulating the data signal.
  • the control information is a modulation scheme, a coding scheme, and a fixed block included in one block. Indicates the length of the sequence, the type of fixed sequence, etc.
  • the control unit 63 generates control signals to be output to the signal waveform restoration unit 64, the signal extraction unit 65, and the demodulation unit 67 based on the control information input from the control information extraction unit 62.
  • the control unit 63 generates a control signal that instructs execution of a process opposite to the interpolation process executed on the transmission device side, that is, the transmission device 10 or 10a, as a control signal to be output to the signal waveform restoration unit 64.
  • the control unit 63 generates a control signal indicating the content of the interpolation processing executed on the transmission device side as a control signal output to the signal waveform restoration unit 64.
  • control unit 63 generates control information indicating the number of zeros inserted in the interpolation process, the insertion position, and the like, and outputs the control information to the signal waveform restoration unit 64.
  • the control unit 63 generates a control signal indicating the contents of the multiplex processing executed on the transmission device side as the control signal output to the signal extraction unit 65.
  • control unit 63 generates control information indicating the number of points of the data signal to be extracted, the position of the data signal, and the like, and outputs the control information to the signal extraction unit 65.
  • the control unit 63 generates a control signal indicating the modulation scheme applied to the data signal as a control signal output to the demodulation unit 67.
  • the signal waveform restoration unit 64 cancels the interpolation processing performed on the transmission device side. That is, the signal waveform restoration unit 64 removes the zero inserted by the interpolation process from the received signal. Specifically, the signal waveform restoration unit 64 first converts the received signal into a frequency domain signal, and then removes zeros from the converted signal. In addition, the signal waveform restoration unit 64 performs equalization processing in the frequency domain on the received signal from which zeros have been removed, and removes interference components added in the multipath transmission path from the received signal. When the equalization processing in the frequency domain is completed, the signal waveform restoration unit 64 converts the equalized signal into a time domain signal and outputs it. The output signal of the signal waveform restoration unit 64 becomes the input signal of the signal extraction unit 65.
  • the signal extraction unit 65 extracts a data signal that is a signal to be demodulated from the input signal and outputs the data signal to the conversion cancellation unit 66.
  • transmitting apparatuses 10 and 10a multiplex a data sequence and a fixed sequence or a zero sequence, and obtain a signal to be subjected to interpolation processing, that is, a signal before interpolation processing is performed. Is generated. Therefore, the signal extraction unit 65 extracts a data signal that is a data series from the input signal.
  • the conversion cancellation unit 66 executes a process of canceling the conversion performed on the transmission device side, that is, a process of converting the input signal from the signal extraction unit 65 into a frequency domain signal.
  • the output signal of the conversion cancellation unit 66 becomes the input signal of the demodulation unit 67.
  • the demodulator 67 demodulates the input signal from the conversion canceler 66 to obtain a demodulated data signal.
  • the transmission apparatuses 10 and 10a described in the first and second embodiments are signal transmission sources, a part of the signal is deleted in the adjustment unit 13 of the transmission apparatuses 10 and 10a. Then, demodulation using iterative processing is performed.
  • the demodulator 67 is, for example, the documents “DNLiu, MPFitz,“ Iterative MAP equalization and decoding in wireless mobile coded OFDM ”, IEEE Trans. On Commun., Vol.57, no.7, July 2009, pp.2042- The received signal is demodulated by performing the iterative processing described in “2051”.
  • the transmission path estimation unit 68 performs transmission path estimation based on a fixed sequence included in the reception signal output from the reception unit 61 and outputs an estimation result to the transmission path information generation unit 71.
  • FIG. 15 is a diagram of a configuration example of the receiving device 60 according to the fifth embodiment.
  • the signal waveform restoration unit 64 of the reception device 60 includes a DFT unit 641, a signal extraction unit 642, an FDE (Frequency Domain Equalizer) unit 643, and an IDFT unit 644. Further, the conversion cancellation unit 66 of the receiving device 60 includes a DFT unit 661.
  • the DFT unit 641 performs K point DFT processing on the input signal to convert it to a frequency domain signal.
  • the signal extraction unit 642 extracts, from the input signal, a signal before zero is inserted by the interpolation processing in the transmission device 10 or 10a, that is, a data signal. The position where the signal extracted by the signal extraction unit 642 is inserted is notified to the signal extraction unit 642 by a control signal output from the control unit 63.
  • the FDE unit 643 performs FDE, that is, frequency domain equalization, on the data signal extracted by the signal extraction unit 642. For example, the FDE unit 643 performs FDE using the technique described in Non-Patent Document 1 described above.
  • the IDFT unit 644 performs N-point IDFT processing on the input signal to convert it into a time domain signal.
  • the DFT unit 661 performs N-point DFT processing on the input signal to convert it to a frequency domain signal.
  • the transmission path information generation unit 71 generates transmission path information indicating the estimation result by the transmission path estimation unit 68.
  • the transmission path information is transmitted from the transmission unit 72 to the base stations 1 and 1a as control information.
  • the transmission path information generation unit 71 generates a control signal including transmission path information required by the base stations 1 and 1a.
  • the transmitting unit 72 performs digital analog conversion processing, frequency conversion processing, and the like on the input control signal, and then transmits the control signal to the base stations 1 and 1a.
  • FIG. 16 is a flowchart illustrating an example of an operation in which the terminal 2 receives a downlink signal.
  • the terminal 2 first extracts control information from the received signal (step S21).
  • the control information extraction unit 62 performs the process of step S21.
  • the terminal 2 performs a process reverse to the interpolation process performed on the transmission device side to cancel the interpolation, that is, removes the zero inserted by the interpolation process (step S22).
  • the terminal 2 further performs equalization processing on the received signal after canceling the interpolation to remove the interference component received on the multipath transmission path (step S23).
  • the signal waveform restoration unit 64 performs the processes in steps S22 and S23.
  • the signal waveform restoration unit 64 cancels interpolation and removes interference components in the frequency domain.
  • the terminal 2 extracts a data signal from the received signal (step S24), and executes processing for canceling the conversion performed on the data signal by the transmission device, specifically, processing for conversion to a frequency domain signal. (Step S25).
  • the process of step S24 is performed by the signal extraction unit 65, and the process of step S25 is performed by the conversion cancellation unit 66.
  • the terminal 2 then demodulates the data signal after the conversion cancellation (step S26).
  • the demodulator 67 performs the processing in step S26.
  • the reception device 60 configuring the terminal 2 performs signal conversion processing, multiplexing processing, interpolation processing, and the like executed by the transmission devices 10 and 10a configuring the base stations 1 and 1a.
  • the processing reverse to each processing is performed on the received signal, and the information sequence transmitted by the downlink signal can be demodulated.
  • Each component of the terminal 2 can be realized by the hardware shown in FIG. 6 or FIG. 7, similarly to the base stations 1, 1a, 1b, and 1c described in the first to fourth embodiments.
  • Some components of the terminal 2 may be realized by a circuit in which a processor executes software, and the remaining components may be realized by a dedicated circuit.
  • Embodiment 6 FIG.
  • a terminal 2 that receives signals transmitted by the base stations 1b and 1c described in the third and fourth embodiments will be described.
  • the difference between the terminal 2 of the fifth embodiment and the terminal 2 of the sixth embodiment is the configuration of the receiving device, and the configuration of the transmitting device is the same. Therefore, in this embodiment, the configuration of the receiving apparatus and the processing to be executed will be described.
  • FIG. 17 is a diagram of a configuration example of the receiving device 60b according to the sixth embodiment.
  • the receiving device 60b is obtained by replacing the conversion cancellation unit 66 of the receiving device 60 described in the fifth embodiment with a conversion cancellation unit 66b.
  • the conversion cancellation unit 66b of the reception device 60b includes a DFT unit 662 that performs M-point DFT processing on the input signal and converts the input signal into a frequency domain signal.
  • the receiving device 60b configuring the terminal 2 performs signal conversion processing, multiplexing processing, interpolation processing, and the like executed by the transmitting devices 10b and 10c configuring the base stations 1b and 1c.
  • the processing reverse to each processing is performed on the received signal, and the information sequence transmitted by the downlink signal can be demodulated.
  • the receiving device 60b according to the present embodiment can be realized by the hardware having the configuration shown in FIG. 6 or FIG. 7, as with the receiving device 60 according to the fifth embodiment.
  • the configuration described in the above embodiment shows an example of the contents of the present invention, and can be combined with another known technique, and can be combined with other configurations without departing from the gist of the present invention. It is also possible to omit or change the part.

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Abstract

本発明は、マルチキャリアブロック伝送方式に対応した送信装置（１０）であって、固定系列を生成する固定系列生成部（１４）と、データシンボルを時間領域の信号に変換してデータ信号を生成するデータ系列生成部（１８）と、固定系列を２分割してブロックの先頭および末尾に配置し、データ系列生成部からの出力信号であるデータ系列を２分割した固定系列の間に配置してブロック信号を生成する多重部（１５）と、ブロック信号に対して補間処理を行う補間部（１６）と、を備える。

Description

送信装置、受信装置、通信システムおよび送信方法
　本発明は、デジタル信号を送信する送信装置、受信装置、通信システムおよび送信方法に関する。
　デジタル通信システムにおいて、送信信号が建物などに反射して起こるマルチパスフェージングまたは通信装置の移動によって起こるドップラ変動によって、伝送路の周波数選択性および時間変動が発生する。マルチパスフェージングが発生するマルチパス環境において、通信装置が受信する信号は、送信元の通信装置から直接届く送信シンボルと建物などで反射してから遅れて届くシンボルとが干渉した信号となる。
　周波数選択性のある伝送路においては、最良の受信特性を得るため、マルチキャリア（Multiple　Carrier：ＭＣ）ブロック伝送であるＯＦＤＭ（Orthogonal　Frequency　Division　Multiplexing：直交周波数分割多重）伝送方式（例えば、下記非特許文献１参照）が用いられる場合がある。
Ｗ.Ｙ.Ｚｏｕ　ａｎｄ　Ｙ.Ｗｕ，"ＣＯＦＤＭ：ＡＮ　ＯＶＥＲＶＩＥＷ"，ＩＥＥＥ　Ｔｒａｎｓ.　ｏｎ　Ｂｒｏａｄｃａｓｔｉｎｇ,　ｖｏｌ.４１,　ｎｏ.１,　Ｍａｒｃｈ　１９９５,　ｐｐ.１－８．
　ＯＦＤＭ伝送方式においては、ブロック間で位相の不連続性が発生し、送信信号の帯域外電力が増加してしまう問題がある。また、ＯＦＤＭ伝送方式においては伝送路推定およびブロック同期といった処理を行うために必要な参照信号をブロックに挿入するが、参照信号を挿入すると伝送効率が低下するという問題がある。
　本発明は、上記に鑑みてなされたものであって、帯域外電力の抑制および伝送効率の向上を実現可能な送信装置を得ることを目的とする。
　上述した課題を解決し、目的を達成するために、本発明は、マルチキャリアブロック伝送方式に対応した送信装置であり、固定系列を生成する固定系列生成部と、データシンボルを時間領域の信号に変換してデータ信号を生成するデータ系列生成部と、を備える。また、送信装置は、固定系列を２分割してブロックの先頭および末尾に配置し、データ系列生成部からの出力信号であるデータ系列を２分割した固定系列の間に配置してブロック信号を生成する多重部と、ブロック信号に対して補間処理を行う補間部と、を備える。
　本発明にかかる送信装置は、帯域外電力の抑制および伝送効率の向上を実現できる、という効果を奏する。
実施の形態１にかかる通信システムの構成例を示す図 実施の形態１にかかる基地局の構成例を示す図 実施の形態１にかかる多重部が出力するブロックＸの構成を示す図 実施の形態１にかかる変換部および補間部の構成例を示す図 実施の形態１にかかる基地局がダウンリンク信号を送信する動作の一例を示すフローチャート 実施の形態１にかかる基地局を実現する制御回路の一例を示す図 実施の形態１にかかる基地局を実現する専用のハードウェアの一例を示す図 実施の形態２にかかる基地局の構成例を示す図 実施の形態２にかかる固定系列生成部の構成例を示す図 実施の形態２にかかる変換部および補間部の構成例を示す図 実施の形態２にかかる固定系列生成部の構成例を示す図 実施の形態３にかかる基地局の構成例を示す図 実施の形態４にかかる基地局の構成例を示す図 実施の形態５にかかる端末の構成例を示す図 実施の形態５にかかる受信装置の構成例を示す図 実施の形態５にかかる端末がダウンリンク信号を受信する動作の一例を示すフローチャート 実施の形態６にかかる受信装置の構成例を示す図
　以下に、本発明の実施の形態にかかる送信装置、受信装置、通信システムおよび送信方法を図面に基づいて詳細に説明する。なお、この実施の形態によりこの発明が限定されるものではない。
実施の形態１．
　図１は、本発明の実施の形態１にかかる通信システムの構成例を示す図である。実施の形態１にかかる通信システム３は、基地局１および複数の端末２1～２nを備える。なお、以下の説明において、複数の端末２1～２nを区別する必要が無い場合、端末２と記載する。
　端末２は、ユーザ端末またはＵＥ（User　Equipment）とも呼ばれる通信装置である。基地局１から端末２に向けた伝送路はダウンリンクと呼ばれ、端末２から基地局１に向けた伝送路はアップリンクと呼ばれる。ダウンリンクの通信においては、基地局１が送信装置であり、端末２が受信装置である。アップリンクの通信においては、端末２が送信装置であり、基地局１が受信装置である。本実施の形態にかかる通信システム３においては、ダウンリンクの通信でＯＦＤＭ方式を用いる。アップリンクで用いる通信方式についての制約はない。端末２から基地局１に対して必要な情報を伝送できるのであれば、どのような通信方式をアップリンクで用いても構わない。以下では、ダウンリンクの通信について主に説明する。したがって、以下の説明では、基地局１が送信装置であり、端末２が受信装置である。
　図２は、実施の形態１にかかる基地局１の構成例を示す図である。基地局１は、データ生成部１１、変換部１２、調整部１３、固定系列生成部１４、多重部１５、補間部１６、送信部１７、受信部２１、復調部２２、情報抽出部２３、制御情報生成部３１、制御部３２および情報管理部３３を備える。データ生成部１１、変換部１２、調整部１３、固定系列生成部１４、多重部１５、補間部１６および送信部１７は、送信装置１０を構成する。また、データ生成部１１、変換部１２および調整部１３はデータ系列生成部１８を構成する。受信部２１、復調部２２および情報抽出部２３は、受信装置２０を構成する。
　データ生成部１１は、端末２へ送信する情報系列に基づいてデータシンボルを生成する。データ生成部１１が生成するデータシンボルは、例えば、ＰＳＫ（Phase　Shift　Keying）シンボルまたはＱＡＭ（Quadrature　Amplitude　Modulation）シンボルといったデータシンボルである。データシンボルの生成に用いる情報系列に誤り訂正処理が実施されてもよい。端末２へ送信する情報系列には制御情報が含まれる場合がある。変換部１２は、データ生成部１１で生成されたデータシンボルを時間領域の信号に変換することにより、マルチキャリア信号であるデータ信号を生成する。変換部１２の出力信号は調整部１３の入力信号となる。
　調整部１３は、変換部１２から入力された時間領域の信号（以下、時間領域信号とする）を、制御部３２により指示される信号長となるように調整する。調整部１３による時間領域信号の長さの調整は、時間信領域信号のサンプル数を削減することにより行う。調整部１３が時間領域信号の長さを調整する処理については別途説明する。なお、調整部１３は、制御部３２から指示される信号の長さが入力された時間領域信号の長さと同じ場合、信号のサンプル数を削減する処理は行わない。また、制御部３２は、調整部１３に対して、調整後の時間領域信号の長さではなく、入力された時間領域信号から削減するサンプル数を指示するようにしてもよい。調整部１３の出力信号は多重部１５の入力信号となる。以下、調整部１３から出力された時間領域信号をデータ系列と呼ぶ。
　固定系列生成部１４は、送信信号に挿入する複数の固定シンボルからなる固定系列を生成する。固定シンボルは信号値が予め定められたシンボルである。固定系列はどの様な系列でもよい。例えば、ゼロシンボルによって成り立つゼロ系列を固定系列とすることができる。また、文献「D.C.Chu，“Polyphase　Codes　With　Good　Periodic　Correlation　Properties”，IEEE　Transactions　on　Information　Theory，vol.18，no.4，Jul.　1972，pp.531-532.」（以下、D.C.Chu文献という）に記載されている系列を固定系列として用いてもよい。
　固定系列生成部１４の出力信号は多重部１５の入力信号となる。多重部１５は、固定系列生成部１４の出力と調整部１３の出力とを、規定数の送信シンボルで構成されるブロック内に配置してブロック信号を生成する。以下の説明では、多重部１５から出力されるブロック信号をブロックＸと呼ぶ。また、ブロックＸの長さをＮサンプルとする。よって、固定系列生成部１４から出力される固定系列の長さと調整部１３から出力されるデータ系列の長さとの合計はＮサンプルとなる。また、調整部１３から出力されるデータ系列の長さをＭサンプル、固定系列生成部１４から出力される固定系列の長さをＴ＝Ｎ－Ｍ（サンプル）とする。多重部１５は、入力された固定系列を２分割してブロックＸ内の両端に配置する。２分割後の２つの固定系列の長さは、其々どのような長さでもよい。例えば、２つを同じ長さ、すなわち其々の長さをＴ／２としてもよいし、２つを異なる長さ、すなわち、Ｔ＝Ｔ1＋Ｔ2かつＴ1≠Ｔ2となるように、其々の長さをＴ1およびＴ2としてもよい。多重部１５は、ブロックＸ内の中央に、すなわち２分割した固定系列の間に、調整部１３から入力されたデータ系列を配置する。
　ここで、調整部１３が時間領域信号の長さを調整する処理について説明する。調整部１３は、デジタルフィルタなどによって時間領域信号の長さを調整する。例えば、長さがＮサンプルの信号ｙ＝[ｙ0，ｙ1，ｙ2，…，ｙN-1]Tの長さを調整するフィルタリング処理の一例として、両端の一定数のサンプルをゼロにしてしまう処理などが考えられる。この場合、フィルタリング処理後の信号ｙ’であるデータ系列は式（１）で示したものとなる。調整部１３は、両端の一定数のサンプル、すなわちゼロにしたサンプル以外の残りのサンプルを多重部１５へ出力する。
Figure JPOXMLDOC01-appb-M000001
　例えば、Ｎ＝８，Ｍ＝４，Ｔ１＝Ｔ２＝２とした場合、フィルタリング処理後のデータ系列は、ｙ’＝[０，０，ｙ2，ｙ3，ｙ4，ｙ5，０，０]Tとなる。なお、調整部１３は信号の長さを変えなくてもよい。その場合、調整部１３への入力信号の長さと調整部１３の出力信号の長さは同じであり、多重部１５への出力信号は両端にゼロが付加された状態となる。多重部１５は、入力信号の両端のゼロを削除した後、２分割した固定系列を両端に付加する。
　固定系列が分割される長さ、すなわち分割された後の２つの固定系列の長さと、分割される前の固定系列の長さＴとは、マルチパス伝送路における最大遅延時間および帯域外の電力の希望抑圧量に基づいて決定してもよい。マルチパス伝送路における最大遅延時間とは、送信装置１０が端末２に向けて送信した信号に対して伝送路で付加される遅延時間の最大値である。例えば、分割される前の固定系列の長さＴを最大遅延時間に基づいて決定する場合、受信装置である端末２が最大遅延時間を測定し、基地局１にフィードバックする。基地局１は、フィードバックされた最大遅延時間よりも長くなるよう固定系列長Ｔを決定する。また、帯域外電力の抑圧量は、分割後の２つの固定系列の長さの比、すなわちＴ1とＴ2の比によって決まる。そのため、基地局１は、希望の抑圧量が達成できる比となるよう、長さＴ1およびＴ2を決定する。基地局１においては、制御部３２、制御情報生成部３１または上位レイヤが、固定系列が分割される長さおよび固定系列長Ｔを決定する。制御部３２は、決定結果に基づいて、固定系列生成部１４、調整部１３および多重部１５に対する動作指示を行う。制御部３２は、固定系列生成部１４に対して、生成する固定系列の長さＴを指示し、調整部１３に対して、出力するデータ系列の長さを指示し、多重部１５に対して、２分割後の２つの固定系列の長さＴ1およびＴ2を指示する。制御部３２から多重部１５に対する指示は、分割後の２つの固定系列の一方の長さ、または、２つの固定系列の長さの比であってもよい。なお、固定系列として用いる系列の種類、値、Ｔ1とＴ2との比、およびＴの値は、制御チャネルなどを用いて基地局１から端末２に通知される。制御チャネルは、基地局１が、データ信号の復調に必要な制御情報およびその他の制御情報を端末２へ送信する際に使用するチャネルである。制御情報は専用のシンボル又はサブキャリアを用いて端末２に伝達される。例えば、３ＧＰＰ（3rd　Generation　Partnership　Project）　ＬＴＥ（Long　Term　Evolution）規格においては、ＰＤＣＣＨ（Physical　Downlink　Control　Channel）などが、基地局１から端末２への制御情報の伝送で使用する制御チャネルに該当する。
　多重部１５が出力するブロックＸの具体例を以下に示す。なお、固定系列生成部１４の出力をｐ0，ｐ1，…，ｐT-1、調整部１３の出力をｓ0，ｓ1，…，ｓM-1とする。また、多重部１５では、入力された固定系列を同じ長さに２分割するものとする。この場合、ブロックＸは、式（２）で示したものとなる。
Figure JPOXMLDOC01-appb-M000002
　また、多重部１５が出力するブロックＸの構成は図３に示したものとなる。図３において、固定系列Ａおよび固定系列Ｂは、多重部１５において２分割された後の固定系列であり、調整部出力は、調整部１３から出力されたデータ系列である。図３に示したように、調整部出力は、２分割された後の固定系列Ａおよび固定系列Ｂに挟まれるように配置される。
　多重部１５が出力するブロックＸは補間部１６の入力信号となる。補間部１６は、時間領域の信号であるブロックＸに対して補間処理を行い、送信信号を生成する。補間部１６は、補間処理において、ブロックＸの長さを、入力時の整数倍又は分数倍にする。すなわち、補間部１６は、送信信号である出力信号の長さをＮ１＝Ｎ×Ｆとする。Ｆは、整数又は１以上の分数、例えば３／２、４／３等の値となる。ただし、Ｎ１は整数とし、Ｎ１≧Ｎとする。
　補間部１６から出力されるブロックをブロックＹとし、ブロックＹのサンプル数をＮ１とする。補間部１６は、ブロックＹ内の各信号の位相に、折り返し巡回性が発生するような処理を与える。例えば、文献「B．Porat，“A　Course　in　Digital　Signal　Processing”，John　Wiley　and　Sons　Inc．，1997」（以下、Porat文献という）に記載されている信号補間式等を用いて補間処理を行えば、ブロックＹ内の各信号の位相に折り返し巡回性が発生する。折り返し巡回性とは、具体的には、ブロックＹの信号をｙ0，ｙ1，…，ｙN1-1とすると、ｙ0とｙN1-1の位相に連続性がある状態、すなわち、ｙN1-1の位相とｙ0の位相とが連続した状態を指す。すなわち、本実施の形態のように固定系列をブロックの両端に挿入すると、時間軸上で隣り合った１つ目のブロックの末尾のｙN1-1の位相と２つ目のブロックの先頭のｙ0の位相とが連続し、２つのブロック間で位相が連続することになる。補間処理は、一般的にオーバサンプリング処理とも呼ばれる。よって、ブロックＸのＮサンプルの間に補間サンプルが挿入されてＮ１サンプルとされた信号がブロックＹとなる。
　なお、本実施の形態にかかる送信装置１０は、上述した変換部１２～補間部１６において行う各処理を、毎ブロックに対して実施する。すなわち、各ブロックの同じ箇所に同じ固定系列が挿入される。例えば、Ｋ番目のブロックに対する処理で調整部１３が出力する系列をｓk,0，ｓk,1，…，ｓk,M-10とすると、多重部１５が出力するブロックＸは式（３）で表される。式（３）において、ｍはブロック番号となる。ブロック番号の範囲は一般的にフレーム長またはバースト長によって決まる。１フレームは１つ以上のブロック信号で構成され、１バーストは１つ以上のフレームで構成される。
Figure JPOXMLDOC01-appb-M000003
　補間部１６が出力するブロックＹは送信部１７の入力信号となる。送信部１７は、入力されたブロックＹに対してデジタルアナログ変換処理、周波数変換処理などを実行した後、端末２に向けて送信する。なお、送信部１７は、従来のＯＦＤＭ方式の送信装置で必要とされているＣＰ（Cyclic　Prefixing）を付加する処理を行う必要はない。ＣＰを付加する処理が必要ない理由は、多重部１５において各ブロックのＯＦＤＭ信号の先頭および末尾に固定系列が挿入されるためである。すなわち、連続する２つのブロックの前のブロックの末尾と後のブロックの先頭に配置された固定系列によって、ＣＰが挿入されているように見えるからである。
　ここで、変換部１２および補間部１６の具体例について説明する。図４は、実施の形態１にかかる変換部１２および補間部１６の構成例を示す図である。図４では、基地局１を構成しているその他の構成要素についても記載している。
　図４に示したように、変換部１２は、ＩＤＦＴ（Inverse　Discrete　Fourier　Transform）部１２１で構成される。ＩＤＦＴ部１２１は、入力信号に対してＮ点のＩＤＦＴ処理を実行して時間領域の信号に変換する。ＩＤＦＴ部１２１の出力はＮ点となる。補間部１６は、ＤＦＴ（Discrete　Fourier　Transform）部１６１、ゼロ挿入部１６２およびＩＤＦＴ部１６３で構成される。ＤＦＴ部１６１は、入力信号に対してＮ点のＤＦＴ処理を実行して周波数領域の信号に変換する周波数領域変換部である。ＤＦＴ部１６１の出力はＮ点となる。ゼロ挿入部１６２は、入力信号に対してゼロを挿入する。周波数領域におけるゼロ挿入処理は時間領域における補間処理と同等の処理である。ゼロの挿入箇所についての制限は無い。ゼロ挿入部１６２は、例えば、Porat文献に記載されている手法を用いて、入力信号にゼロを挿入する。ゼロ挿入部１６２が挿入するゼロの数をＫ－Ｎ点とする。すなわち、ゼロ挿入部１６２は、Ｎ点の入力信号に対してゼロを挿入してＫ点の信号を生成し、この信号を出力する。ＩＤＦＴ部１６３は、入力信号に対してＫ点のＩＤＦＴ処理を実行して時間領域の信号に変換する時間領域変換部である。上記のPorat文献において説明されているように、ＤＦＴ処理、ゼロ挿入処理およびＩＤＦＴ処理を実行して信号点の調整を行うことにより、補間部１６から出力されるブロックＹ内の先頭と末尾の信号であるｙ0とｙN1-1の位相に連続性がある現象が起きる。すなわち、ブロックＹ内の各信号の位相に折り返し巡回性が発生する。
　図２の説明に戻り、受信部２１は、端末２から送信されるアップリンク信号を受信し、受信したアップリンク信号に対して周波数変換処理、アナログデジタル変換処理などを実行する。受信部２１の出力信号は、復調部２２の入力信号となる。復調部２２は、受信部２１からの入力信号を復調する。端末２が送信系列に対して符号化を行っている場合、復調部２２は復調後の信号に対して復号処理を実行して端末２から送信された情報を復元する。復調部２２で復元された情報は情報抽出部２３の入力信号となる。情報抽出部２３は、入力された情報から後段の制御情報生成部３１が必要とする情報を抽出する。具体的には、情報抽出部２３は、復調部２２で復元された情報から伝送路情報を抽出して制御情報生成部３１へ出力する。伝送路情報は、基地局１と端末２との間の伝送路の状態、すなわちダウンリンクの伝送路の状態を示す情報である。伝送路情報は、伝送路の状態を複素数で示した情報、受信信号電力対雑音電力の比、マルチパス伝送路のパス数などが該当するがこれらに限定されない。情報抽出部２３が抽出した伝送路情報は制御情報生成部３１の入力信号となる。制御情報生成部３１は、入力された伝送路情報が示す伝送路の状況に基づいて送信信号のパラメタを決定する。ここでの送信信号のパラメタとは、固定系列生成部１４が生成する固定系列の長さ、多重部１５が固定系列を２分割する際の分割後の固定系列の長さ、などである。制御情報生成部３１は、決定したパラメタを示す制御情報を生成して制御部３２へ出力する。なお、ここでは制御情報生成部３１が送信信号のパラメタを決定することとしたが、制御部３２が決定してもよい。その場合、制御情報生成部３１は、伝送路情報を制御部３２へ出力する。また、変換部１２、調整部１３、固定系列生成部１４および多重部１５の其々に対して出力する制御信号を制御情報生成部３１が生成し、生成した制御信号を制御情報生成部３１から各部へ出力するようにしてもよい。
　なお、固定系列の長さおよび固定系列の値が一定区間同じである場合、メモリなどの記憶部から固定系列を読み出してもよい。その場合、図２に示した固定系列生成部１４は記憶部となり、制御部３２から記憶部への制御信号は、固定系列の出力を指示する制御信号となる。
　また、本実施の形態においては、固定系列をブロックの両端すなわちブロックの先頭および末尾に配置することとしたが、必要であれば、先頭および末尾に固定系列を配置すると共に、先頭および末尾以外の決められた位置に別の固定系列を配置してもよい。この場合、制御部３２から多重部１５へ、先頭および末尾以外の位置を指定し、多重部１５は固定系列生成部１４で生成される固定系列を指定された位置に配置する。先頭および末尾以外の位置とは多重部１５に入力されるＮシンボルの中央などに相当する位置である。例えば、上記の式（２）の例を用い、Ｍを偶数とした場合、多重部１５は、ｓ0，ｓ1，…，ｓM-1において、ｓM/2-1の位置を中心としてｑ0，ｑ1，…，ｑT'-1を配置する。ｑiはｐiとは別の系列であり、固定系列生成部１４より出力される。Ｔ’は固定系列ｑiの長さであり、制御部３２によって決められる。ブロックの両端以外に配置される理由は、位相雑音補正およびドップラシフト補正用に、固定系列を両端以外にブロックの中央などに配置すれば、端末２は固定系列を用いて位相雑音補正、ドップラシフト補正などの周波数補正が可能となるからである。なお、両端以外の場所に配置される固定シンボルはすべてのブロックに対して挿入される必要はない。このような構成とする場合、制御部３２は、ｑiが配置されるブロックの番号、すなわち式（３）におけるブロック番号ｍをデータ生成部１１および固定系列生成部１４に通知すればよい。ｑiが配置される場合、調整部１３の出力信号のシンボル長はＮ－Ｔ－Ｔ’となる。データ生成部１１の出力シンボル長をＮとし、調整部１３において、両端の合計Ｔシンボルと、制御部３２から指定された位置を中心としたＴ’シンボルとを合わせた、合計Ｔ＋Ｔ’シンボルだけゼロにしてよい。また、データ生成部１１の出力シンボル長をＮ－Ｔ’とし、調整部１３において、両端の合計Ｔシンボルだけゼロにしてもよい。
　制御情報生成部３１には情報管理部３３からの信号が入力される場合もある。情報管理部３３は、上位レイヤから受け取る制御情報を管理する。ここでの上位レイヤとは、送信装置１０を備えている基地局１を管理している上位の装置または他の基地局が考えられるが上位レイヤをこれに限定するものではない。上位レイヤから受け取る制御情報は、例えば、ＯＦＤＭブロックのサンプル数Ｎと、固定系列生成部１４が生成する固定系列の長さＴとを含む。この場合、これらの情報すなわちサンプル数Ｎおよび長さＴは上位レイヤで決定される。また、調整部１３が入力信号を短縮する際の長さ、すなわち、調整後の信号のサンプル数または調整処理で削減するサンプル数も上位レイヤが決定し、決定した長さの情報が上位レイヤから情報管理部３３に入力されるようにしてもよい。また、固定系列の値および配置位置の情報が上位レイヤから情報管理部３３に入力され、この情報を情報管理部３３が制御情報生成部３１に出力するようにしてもよい。また、パラメタの固定値および固定位置を常に用いるよう指示する制御情報、または、パラメタの固定値および固定位置を指定された複数のブロック、およびブロック区間に対して用いるよう指示する制御情報が上位レイヤから情報管理部３３に入力されてもよい。上位レイヤにおいては、制御情報をネットワークの混雑状況などに基づいて生成する。例えば、ネットワークが混雑している場合は、大容量データの送信が困難であるため、ブロック長を短くして送信フレームを構成するよう指示する制御情報を生成することが考えられる。
　制御部３２は、制御情報生成部３１から入力される制御情報に基づいて、データ生成部１１、変換部１２、調整部１３、固定系列生成部１４および多重部１５の其々に出力する制御信号を生成する。既に説明したように、制御部３２は、固定系列生成部１４に対して、生成する固定系列の長さＴを指示し、調整部１３に対して、出力するデータ系列の長さを指示し、多重部１５に対して、２分割後の２つの固定系列の長さＴ1およびＴ2を指示する。なお、制御部３２は、調整部１３に対しては、削除される信号の長さおよび削除方法も指定する。削除方法の具体例はデジタルフィルタを用いた削除である。制御部３２は、調整部１３に対する指示において、入力された信号の長さを調整するか否かを指示するようにしてもよい。調整部１３が出力するデータ系列の長さ、すなわち調整部１３が入力信号から削除するポイント数を可変としてもよい。
　また、制御部３２は、データ生成部１１に対して、生成するデータシンボルの多値数および生成するデータシンボル数を指示する。制御部３２は、変換部１２に対して、入力されるデータシンボルを変換する手法を指示する。
　基地局１が送信した信号を端末２が受信して元のデータを復元するためには、基地局１が行う送信処理の内容を知る必要がある。基地局１が行う送信処理の内容はパラメタ化され、基地局１から端末２へ制御情報として送信される。端末２は、基地局１から制御情報として受信したパラメタを使用して受信処理を行う。基地局１は、例えば、３ＧＰＰ　ＬＴＥ規格で定義されているＲＲＣ（Radio　Resource　Control）プロトコルに従い、制御情報を端末２へ伝送する。制御情報の中にデータ長、固定系列の種類などを指定するパラメタが含まれていてもよい。基地局１は、一般的に長期間にわたって変わらないパラメタは上位レイヤで伝送される制御情報に含めて端末２へ伝送する。また、基地局１は、適応的に変わるパラメタは定期的に送信される制御情報に含めて端末２へ伝送する。例えば、３ＧＰＰ　ＬＴＥ規格で定義されているＰＤＣＣＨは、定期的に端末に向けて送信される制御情報の伝送で用いることができるため、基地局１は、ＰＤＣＣＨを使用して制御情報を伝送する。
　次に、基地局１がダウンリンク信号を送信する動作について、図５を参照しながら説明する。図５は、基地局１がダウンリンク信号を送信する動作の一例を示すフローチャートである。
　基地局１は、まず、端末２へ送信する制御情報を生成する（ステップＳ１１）。端末２へ送信する制御情報は、例えば、端末２がデータ信号を復調するために必要なパラメタである。このパラメタは、データ信号に適用されている変調方式、符号化方式、１ブロックに含まれる固定系列の長さ、固定系列の種類、などを示すパラメタが該当する。制御情報は、制御部３２が生成する。この場合、制御情報は制御部３２からデータ生成部１１に入力され、データシンボルとして送信されることになる。端末２へ送信する制御情報を制御情報生成部３１が生成してもよい。この場合、制御情報生成部３１は、生成した制御情報を制御部３２へ出力し、データ生成部１１経由で端末２へ送信してもよいし、生成した制御情報を多重部１５経由で端末２へ送信してもよい。多重部１５経由で制御情報を送信する場合、制御情報生成部３１は、制御情報を含んだデータシンボルを生成して多重部１５へ出力する。
　基地局１は、次に、固定系列を生成し（ステップＳ１２）、さらに、データシンボルを生成する（ステップＳ１３）。上述したように、固定系列の生成は固定系列生成部１４が行い、データシンボルの生成はデータ生成部１１が行う。なお、ステップＳ１２およびステップＳ１３を実行する順番は逆であってもよい。また、これら２つのステップを並列に実行しても構わない。データ生成部１１は制御部３２から指示された数のデータシンボルを生成し、固定系列生成部１４は制御部３２から指示された数の固定シンボルを生成する。
　基地局１は、次に、ステップＳ１３で生成したデータシンボルを時間領域の信号に変換して時間領域のデータ信号を生成する（ステップＳ１４）。このステップＳ１４の処理は変換部１２が行う。
　基地局１は、次に、時間領域の信号に変換後のデータシンボルであるデータ信号の長さを調整する（ステップＳ１５）。このステップＳ１５の処理は調整部１３が行う。調整部１３は、入力されたデータ信号の長さを制御部３２から指示された長さに調整して出力する。
　基地局１は、次に、ステップＳ１２で生成した固定系列とステップＳ１５で長さを調整した後のデータ信号であるデータ系列とを多重する（ステップＳ１６）。このステップＳ１６の処理は多重部１５が行う。多重部１５は、固定系列を制御部３２から指示された長さの２つの固定系列に分割してブロック先頭側および末尾側に配置し、２つの固定系列の間にデータ系列を配置してブロックＸを生成する。
　基地局１は、次に、固定系列とデータ系列とを多重して生成されたブロックＸに対して補間処理を行う（ステップＳ１７）。このステップＳ１７の処理は補間部１６が行う。補間部１６は、ブロックＸを周波数領域の信号に変換した後、ゼロを挿入し、時間領域の信号に再度変換することにより、予め決められた長さの信号を生成する。
　基地局１は、次に、ステップＳ１７で生成した信号を端末２へ送信する（ステップＳ１８）。このステップＳ１８の処理は送信部１７が行う。
　以上のように、本実施の形態にかかる基地局１を構成する送信装置１０は、固定系列を２分割して得られた２つの固定系列をブロックの先頭および末尾に配置し、ブロックの中央部分すなわち２つの固定系列の間にデータシンボルを配置した構成のブロック信号を生成する。また、送信装置１０は、ブロック信号に対して周波数領域でゼロを挿入して補間処理を行い、送信信号を生成する。これにより、連続する２つのブロック信号の間で位相が連続した状態となり、送信信号の帯域外電力を抑制できる。また、ブロック信号の先頭および末尾に固定系列を配置したことによりＣＰを付加する必要が無くなるため伝送効率を向上させることができる。また、固定系列が非ゼロ、すなわちゼロ系列ではない場合、受信側では固定系列を利用して伝送路を推定することが可能となり、ブロックに参照信号を送信する必要が無くなる。そのため、伝送効率をさらに向上させることができる。
　次に、実施の形態１にかかる基地局１のハードウェア構成について説明する。基地局１の各構成要素は、処理回路により実現される。処理回路は、プロセッサがソフトウェアを実行する回路であってもよいし、専用の回路であってもよい。また、一部の構成要素をプロセッサがソフトウェアを実行する回路で実現し、残りの構成要素を専用の回路で実現してもよい。
　処理回路がソフトウェアにより実現される場合、処理回路は、例えば、図６に示す制御回路である。図６は、基地局１を実現する制御回路の一例を示す図である。制御回路は、入力部１０１、プロセッサ１０２、メモリ１０３および出力部１０４を備える。入力部１０１は、外部から入力されたデータを受信する回路である。出力部１０４は、データを外部へ送信する回路である。
　プロセッサ１０２は、ＣＰＵ（Central　Processing　Unit、中央処理装置、処理装置、演算装置、マイクロプロセッサ、マイクロコンピュータ、プロセッサ、ＤＳＰ（Digital　Signal　Processor）ともいう）である。メモリ１０３は、例えば、ＲＡＭ（Random　Access　Memory）、ＲＯＭ（Read　Only　Memory）、フラッシュメモリー、ＥＰＲＯＭ（Erasable　Programmable　Read　Only　Memory）、ＥＥＰＲＯＭ（Electrically　Erasable　Programmable　Read　Only　Memory）等の、不揮発性または揮発性の半導体メモリ、磁気ディスク、フレキシブルディスク、光ディスク、コンパクトディスク、ミニディスク、ＤＶＤ（Digital　Versatile　Disk）等が該当する。基地局１の構成要素を実現する処理回路が図６に示す制御回路である場合、プロセッサ１０２がメモリ１０３に記憶された、基地局１の各々の構成要素に対応するプログラムを読み出して実行することにより各構成要素が実現される。また、メモリ１０３は、プロセッサ１０２が実施する各処理における一時メモリとしても使用される。
　基地局１の構成要素のうち、専用のハードウェアで実現されるものは、図７に示す回路により実現される。図７は、基地局１を実現する専用のハードウェアの一例を示す図である。図７に示した専用の回路は、入力部１０１、処理回路１１０および出力部１０４を備える。入力部１０１および出力部１０４は、図６に示した入力部１０１および出力部１０４と同じ回路である。処理回路１１０は、単一回路、複合回路、プログラム化したプロセッサ、並列プログラム化したプロセッサ、ＡＳＩＣ（Application　Specific　Integrated　Circuit）、ＦＰＧＡ（Field　Programmable　Gate　Array）、またはこれらを組み合わせたものである。
実施の形態２．
　次に、実施の形態２にかかる送信装置について説明する。本実施の形態にかかる送信装置は、実施の形態１で説明した送信装置１０と同様に、図１に示した通信システムの基地局１を構成する。なお、実施の形態１で説明した基地局１と区別するために、以下の説明では実施の形態２にかかる基地局を基地局１ａと記載する。以下、実施の形態１と異なる点を説明する。
　図８は、実施の形態２にかかる基地局１ａの構成例を示す図である。基地局１ａは、実施の形態１にかかる基地局１の送信装置１０および制御部３２を、送信装置１０ａおよび制御部３２ａに置き換えたものである。送信装置１０ａは、データ生成部１１、変換部１２、調整部１３、多重部１５、補間部１６、送信部１７、ゼロ系列生成部４１、固定系列生成部４２および合成部４３を備える。送信装置１０ａのデータ生成部１１、変換部１２、調整部１３、多重部１５、補間部１６および送信部１７は、実施の形態１にかかる送信装置１０の同じ符号が付された各構成要素と同様の処理を実行する。そのため、これらの構成要素については説明を省略する。
　ゼロ系列生成部４１は、制御部３２ａから指示された数のゼロシンボルを生成してゼロ系列として多重部１５へ出力する。なお、多重部１５は、ゼロ系列生成部４１から入力されたゼロ系列を２分割してブロックの先頭および末尾に配置する。ゼロ系列生成部４１は、送信装置１０ａにおける第１の固定系列生成部である。
　送信装置１０ａにおける第２の固定系列生成部である固定系列生成部４２は、複数の固定シンボルからなる固定系列を生成する。ただし、固定系列生成部４２が生成する固定系列は、補間部１６が多重部１５から入力されたブロックＸに対して行う補間処理と同様の処理が行われた後の固定系列とする。固定系列生成部４２は、非ゼロの固定系列を生成し、生成した固定系列に対して、例えば、上述したD.C.Chu文献に記載されている補間処理を行い、補間処理後の固定系列として出力する。図９は、固定系列生成部４２の構成例を示す図である。固定系列生成部４２は、固定シンボル生成部４２１、ゼロシンボル生成部４２２、多重部４２３および補間部４２４を備える。固定シンボル生成部４２１は、複数の固定シンボルを生成して多重部４２３へ出力する。ゼロシンボル生成部４２２は、複数のゼロシンボルを生成して多重部４２３へ出力する。なお、固定シンボル生成部４２１は、ゼロ系列生成部４１が生成する複数のゼロシンボルと同じ数の固定シンボルを生成する。ゼロシンボル生成部４２２は、調整部１３から多重部１５へ出力されるデータシンボルと同じ数のゼロシンボルを生成する。多重部４２３は、多重部１５と同様の処理を行う。具体的には、多重部４２３は、複数の固定シンボルを２分割してブロックの先頭および末尾に配置し、複数のゼロシンボルをブロックの中央に配置する。なお、多重部４２３は、多重部１５がゼロ系列を２分割する比率と同じ比率で複数の固定シンボルを２分割する。補間部４２４は、補間部１６と同様の補間処理を、多重部４２３からの入力信号、すなわち、ブロックの先頭および末尾に複数の固定シンボルが配置され、中央に複数のゼロシンボルが配置された信号、に対して実行する。すなわち、補間部４２４の出力シンボル数と補間部１６の出力シンボル数は等しくなる。
　なお、固定系列生成部４２は、補間処理後の固定系列をメモリで保持し、これを読み出して出力する構成であってもよい。この場合、固定系列生成部４２は、複数種類の固定系列をメモリで保持しておき、いずれか一つの固定系列を制御部３２ａからの指示に従って出力するようにしてもよい。
　合成部４３は、補間部１６からの入力信号と固定系列生成部４２からの入力信号とを合成する。具体的には、合成部４３は、補間部１６からの入力信号に含まれている、補間処理後のゼロ系列を、固定系列生成部４２からの入力信号に含まれている、補間処理後の固定系列に置き換える。この結果、実施の形態１にかかる送信装置１０の補間部１６が出力する信号と同様の信号が生成される。合成部４３の出力信号は送信部１７の入力信号となる。
　制御部３２ａは、データ生成部１１、変換部１２、調整部１３、多重部１５、ゼロ系列生成部４１および固定系列生成部４２に対して、其々が実行する動作を指示する制御信号を出力する。
　また、送信装置１０ａの変換部１２および補間部１６の構成は、図１０に示したように、送信装置１０の変換部１２および補間部１６と同様の構成である。
　また、図９に示した固定系列生成部４２の補間部４２４は、図１１に示したように、ＤＦＴ部２４１、ゼロ挿入部２４２およびＩＤＦＴ部２４３で構成される。ＤＦＴ部２４１は、補間部１６のＤＦＴ部１６１と同様に、入力信号に対してＮ点のＤＦＴ処理を実行する。ゼロ挿入部２４２は、入力信号に対してゼロを挿入する。ゼロ挿入部２４２は、補間部１６のゼロ挿入部１６２と同様の手法で入力信号にゼロを挿入する。ゼロ挿入部２４２が挿入するゼロの数は、補間部１６のゼロ挿入部１６２と同様にＫ－Ｎ点とする。ＩＤＦＴ部２４３は、補間部１６のＩＤＦＴ部１６３と同様に、入力信号に対してＫ点のＩＤＦＴ処理を実行する。
　以上のように、本実施の形態にかかる送信装置１０ａにおいて、多重部１５は、ゼロ系列が先頭および末尾に配置され、中央にデータ系列が配置されたブロック信号を生成し、補間部１６は、ブロック信号に対して補間処理を行う。固定系列生成部４２は、補間処理後の固定系列を生成し、合成部４３は、補間処理後のブロック信号と補間処理後の固定系列を合成して送信信号を生成する。本実施の形態にかかる送信装置１０ａは、実施の形態１にかかる送信装置１０と同様に、送信信号の帯域外電力を抑制できるとともに、伝送効率の向上を実現できる。
　なお、本実施の形態にかかる送信装置１０ａは、実施の形態１にかかる送信装置１０と同様に、図６または図７に示した構成のハードウェアで実現することができる。
　また、本実施の形態においては、固定系列をブロックの両端すなわちブロックの先頭および末尾に配置することとしたが、必要であれば、先頭および末尾に固定系列を配置すると共に、両端以外の決められた位置に別の固定系列を配置してもよい。この場合、制御部３２ａは、固定系列生成部４２に両端以外の位置を指定し、固定系列生成部４２は、ブロックの両端および指定された位置に固定系列が配置された信号を生成した後、補間処理を行って補間処理後の固定系列を生成する。固定系列生成部４２で生成される系列は、合成部４３において、補間部１６から出力される信号と合成される。両端以外の位置とは多重部１５に入力されるＮシンボルの中央などに相当する位置である。データ系列生成部１８および多重部１５は、前述の通り、ブロックの先頭および末尾のサンプルをゼロとし、制御部３２ａから指定された場所周辺もゼロとしたブロック信号を生成する。そして固定系列生成部４２において、固定シンボル生成部４２１はｑiとｐiとを生成し、多重部４２３が、ｑiとｐiとを指定された場所に配置する。ｑiとｐiは別の系列である。Ｔ’は固定系列ｑiの長さであり、制御部３２ａによって決められる。例えば、ｐiは分割され、ブロックの先頭および末尾に多重部４２３にて配置される。そして、ｑiはブロックの両端以外の場所に多重部４２３にて配置される。ブロックの両端以外に配置される理由は、位相雑音補正およびドップラシフト補正用に、固定系列を両端以外にブロックの中央などに配置すれば、端末２は固定系列を用いて位相雑音補正、ドップラシフト補正などの周波数補正が可能となるからである。なお、両端以外の場所に配置される固定シンボルはすべてのブロックに対して挿入される必要はない。このような構成とする場合、制御部３２ａは、ｑiが配置されるブロックの番号、すなわち式（３）におけるブロック番号ｍをデータ生成部１１、ゼロ系列生成部４１および固定系列生成部４２に通知すればよい。
実施の形態３．
　次に、実施の形態３にかかる送信装置について説明する。本実施の形態にかかる送信装置は、実施の形態１で説明した送信装置１０と同様に、図１に示した通信システムの基地局１を構成する。また、本実施の形態にかかる送信装置は、実施の形態１で説明した送信装置１０の変形例である。なお、実施の形態１で説明した基地局１および実施の形態２で説明した基地局１ａと区別するために、以下の説明では実施の形態３にかかる基地局を基地局１ｂと記載する。以下、実施の形態１と異なる点を説明する。
　図１２は、実施の形態３にかかる基地局１ｂの構成例を示す図である。基地局１ｂは、実施の形態１にかかる基地局１の送信装置１０および制御部３２を、送信装置１０ｂおよび制御部３２ｂに置き換えたものである。送信装置１０ｂは、送信装置１０から調整部１３を削除し、変換部１２を変換部１２ｂに置き換えたものである。送信装置１０ｂの変換部１２ｂ以外の構成要素は送信装置１０の同じ符号が付された構成要素と同様であるため、説明を省略する。なお、データ生成部１１および変換部１２ｂは、データ系列生成部１８ｂを構成する。
　変換部１２ｂは、入力信号に対してＭ点のＩＤＦＴ処理を実行するＩＤＦＴ部１２１ｂを備える。ＩＤＦＴ部１２１ｂの出力はＭ点となる。よって、変換部１２ｂは、実施の形態１にかかる送信装置１０の調整部１３が出力する信号と同じ長さの時間領域信号を生成して出力する。
　すなわち、本実施の形態にかかる送信装置１０ｂにおいて、データ生成部１１は、Ｍサンプルのデータシンボルを生成して出力し、変換部１２ｂは、データ生成部１１から入力されたＭサンプルのデータシンボルに対してＭ点のＩＤＦＴ処理を実行してＭサンプルの時間領域信号を生成する。
　制御部３２ｂは、データ生成部１１、変換部１２ｂ、固定系列生成部１４および多重部１５の其々に出力する制御信号を生成する。制御部３２ｂが生成する制御信号は、実施の形態１の制御部３２がデータ生成部１１、変換部１２、固定系列生成部１４および多重部１５の其々に出力する制御信号と同様である。ただし、制御部３２ｂは、データ生成部１１に対して、系列数がＭのデータ系列を生成するよう指示する制御信号を出力する。
　本実施の形態にかかる送信装置１０ｂの構成を適用した場合にも実施の形態１と同様の効果を得ることができる。
　なお、本実施の形態にかかる送信装置１０ｂは、実施の形態１にかかる送信装置１０と同様に、図６または図７に示した構成のハードウェアで実現することができる。
　また、本実施の形態においては、固定系列をブロックの両端すなわちブロックの先頭および末尾に配置することとしたが、必要であれば、先頭および末尾に固定系列を配置すると共に、先頭および末尾以外の決められた位置に別の固定系列を配置してもよい。この場合、制御部３２ｂから多重部１５へ、先頭および末尾以外の位置を指定し、多重部１５は固定系列生成部１４で生成される固定系列を指定された位置に配置する。先頭および末尾以外の位置とは多重部１５に入力されるＭシンボルの中央などに相当する位置である。例えば、上記の式（２）の例を用い、Ｍを偶数とした場合、多重部１５は、ｓ0，ｓ1，…，ｓM-1において、ｓM/2-1の位置を中心としてｑ0，ｑ1，…，ｑT’-1を配置する。ｑiはｐiとは別の系列であり、固定系列生成部１４より出力される。Ｔ’は固定系列ｑiの長さであり、制御部３２ｂによって決められる。ブロックの両端以外に配置される理由は、位相雑音補正およびドップラシフト補正用に、固定系列を両端以外にブロックの中央などに配置すれば、端末２は固定系列を用いて位相雑音補正、ドップラシフト補正などの周波数補正が可能となるからである。なお、ブロックの両端以外の場所に配置される固定シンボルはすべてのブロックに対して挿入される必要はない。このような構成とする場合、制御部３２ｂは、ｑiが配置されるブロックの番号、すなわち式（３）におけるブロック番号ｍをデータ生成部１１および固定系列生成部１４に通知すればよい。ｑiが配置される場合、データ系列生成部１８ｂの出力信号のシンボル長はＭ－Ｔ－Ｔ’となる。
実施の形態４．
　次に、実施の形態４にかかる送信装置について説明する。本実施の形態にかかる送信装置は、実施の形態１で説明した送信装置１０と同様に、図１に示した通信システム３の基地局１を構成する。また、本実施の形態にかかる送信装置は、実施の形態２で説明した送信装置１０ａの変形例である。なお、実施の形態１～３で説明した基地局と区別するために、以下の説明では実施の形態４にかかる基地局を基地局１ｃと記載する。以下、実施の形態２と異なる点を説明する。
　図１３は、実施の形態４にかかる基地局１ｃの構成例を示す図である。基地局１ｃは、実施の形態２にかかる基地局１ａの送信装置１０ａおよび制御部３２ａを、送信装置１０ｃおよび制御部３２ｃに置き換えたものである。送信装置１０ｃは、送信装置１０ａから調整部１３を削除し、変換部１２を変換部１２ｃに置き換えたものである。送信装置１０ｃの変換部１２ｃ以外の構成要素は送信装置１０ａの同じ符号が付された構成要素と同様であるため、説明を省略する。
　変換部１２ｃは、入力信号に対してＭ点のＩＤＦＴ処理を実行するＩＤＦＴ部１２１ｃを備える。ＩＤＦＴ部１２１ｃの出力はＭ点となる。よって、変換部１２ｃは、実施の形態２にかかる送信装置１０ａの調整部１３が出力する信号と同じ長さの時間領域信号を生成して出力する。
　すなわち、本実施の形態にかかる送信装置１０ｃにおいて、データ生成部１１は、系列数がＭのデータ系列を生成して出力し、変換部１２ｃは、データ生成部１１から入力されたデータ系列に対してＭ点のＩＤＦＴ処理を実行してＭサンプルの時間領域信号を生成する。
　制御部３２ｃは、データ生成部１１、変換部１２ｃ、固定系列生成部１４および多重部１５の其々に出力する制御信号を生成する。制御部３２ｃが生成する制御信号は、実施の形態２の制御部３２ａがデータ生成部１１、変換部１２ａ、固定系列生成部４２および多重部１５の其々に出力する制御信号と同様である。ただし、制御部３２ｃは、データ生成部１１に対して、系列数がＭのデータ系列を生成するよう指示する制御信号を出力する。
　本実施の形態にかかる送信装置１０ｃの構成を適用した場合にも実施の形態２と同様の効果を得ることができる。
　なお、本実施の形態にかかる送信装置１０ｃは、実施の形態１にかかる送信装置１０と同様に、図６または図７に示した構成のハードウェアで実現することができる。
　また、本実施の形態においては、固定系列をブロックの両端すなわちブロックの先頭および末尾に配置することとしたが、必要であれば、先頭および末尾に固定系列を配置すると共に、両端以外の決められた位置に別の固定系列を配置してもよい。この場合、制御部３２ｃは、固定系列生成部４２に両端以外の位置を指定し、固定系列生成部４２は、ブロックの両端および指定された位置に固定系列が配置された信号を生成した後、補間処理を行って補間処理後の固定系列を生成する。固定系列生成部４２で生成される系列は、合成部４３において、補間部１６から出力される信号と合成される。両端以外の位置とは多重部１５に入力されるＮシンボルの中央などに相当する位置である。データ系列生成部１８ｂおよび多重部１５は、前述の通り、ブロックの先頭および末尾のサンプルをゼロとし、制御部３２ｃから指定された場所周辺もゼロとしたブロック信号を生成する。そして固定系列生成部１４において、固定シンボル生成部４２１はｑiとｐiとを生成し、多重部４２３が、ｑiとｐiとを指定された場所に配置する。ｑiとｐiは別の系列である。Ｔ’は固定系列ｑiの長さであり、制御部３２ｃによって決められる。例えば、ｐiは分割され、ブロックの先頭および末尾に多重部４２３にて配置される。そして、ｑiはブロックの両端以外の場所に多重部４２３にて配置される。ブロックの両端以外に配置される理由は、位相雑音補正およびドップラシフト補正用に、固定系列を両端以外にブロックの中央などに配置すれば、端末２は固定系列を用いて位相雑音補正、ドップラシフト補正など周波数補正が可能となるからである。なお、両端以外の場所に配置される固定シンボルはすべてのブロックに対して挿入される必要はない。このような構成とする場合、制御部３２ｃは、ｑiが配置されるブロックの番号、すなわち式（３）におけるブロック番号ｍをデータ生成部１１および固定系列生成部４２に通知すればよい。
実施の形態５．
　実施の形態５では、実施の形態１，２で説明した基地局１，１ａが送信した信号を受信する端末２について説明する。
　図１４は、実施の形態５にかかる端末２の構成例を示す図である。端末２は、受信部６１、制御情報抽出部６２、制御部６３、信号波形復元部６４、信号抽出部６５、変換解除部６６、復調部６７、伝送路推定部６８、伝送路情報生成部７１および送信部７２を備える。受信部６１、制御情報抽出部６２、制御部６３、信号波形復元部６４、信号抽出部６５、変換解除部６６、復調部６７および伝送路推定部６８は、受信装置６０を構成する。伝送路情報生成部７１および送信部７２は、送信装置７０を構成する。
　受信部６１は、基地局から送信されるダウンリンク信号を受信し、受信したダウンリンク信号に対して周波数変換処理、アナログデジタル変換処理などを実行する。受信部６１の出力信号は、制御情報抽出部６２、信号波形復元部６４および伝送路推定部６８への入力信号となる。
　制御情報抽出部６２は、受信部６１から出力される受信信号に含まれる制御信号情報を抽出して制御部６３へ出力する。例えば、３ＧＰＰ　ＬＴＥ規格において、ＰＤＣＣＨが制御情報を含む信号に相当する。受信信号にＰＤＣＣＨが含まれる場合、制御情報抽出部６２は、ＰＤＣＣＨを抽出し、さらに、ＰＤＣＣＨから制御情報を抽出して制御部６３へ出力する。制御部６３へ出力する制御情報は、データ信号を復調するために必要なパラメタであり、実施の形態１で説明したように、制御情報は、変調方式、符号化方式、１ブロックに含まれる固定系列の長さ、固定系列の種類、などを示す。
　制御部６３は、制御情報抽出部６２から入力される制御情報に基づいて、信号波形復元部６４、信号抽出部６５および復調部６７の其々に出力する制御信号を生成する。制御部６３は、信号波形復元部６４に出力する制御信号として、送信装置側、すなわち送信装置１０または１０ａで実行された補間処理と逆の処理の実行を指示する制御信号を生成する。制御部６３は、信号波形復元部６４に出力する制御信号として、送信装置側で実行された補間処理の内容を示す制御信号を生成する。例えば、制御部６３は、補間処理で挿入されたゼロの数、挿入位置などを示す制御情報を生成して信号波形復元部６４に出力する。制御部６３は、信号抽出部６５に出力する制御信号として、送信装置側で実行された多重処理の内容を示す制御信号を生成する。例えば、制御部６３は、抽出すべきデータ信号のポイント数、データ信号の位置などを示す制御情報を生成して信号抽出部６５に出力する。制御部６３は、復調部６７に出力する制御信号として、データ信号に適用されている変調方式を示す制御信号を生成する。
　信号波形復元部６４は、送信装置側で実施された補間処理を解除する。すなわち、信号波形復元部６４は、補間処理で挿入されたゼロを受信信号から除去する。具体的には、信号波形復元部６４は、まず、受信信号を周波数領域の信号に変換し、次に、変換後の信号からゼロを除去する。また、信号波形復元部６４は、ゼロを除去した後の受信信号に対して周波数領域で等化処理を行い、マルチパス伝送路において付加された干渉成分を受信信号から除去する。信号波形復元部６４は、周波数領域での等化処理が完了すると等化後の信号を時間領域の信号に変換して出力する。信号波形復元部６４の出力信号は信号抽出部６５の入力信号となる。
　信号抽出部６５は、入力信号から復調対象の信号であるデータ信号を抽出して変換解除部６６へ出力する。実施の形態１，２で説明したように、送信装置１０，１０ａは、データ系列と、固定系列またはゼロ系列とを多重化し、補間処理の対象とする信号すなわち補間処理が行われる前の信号を生成している。そのため、信号抽出部６５は、データ系列であるデータ信号を入力信号から抽出する。
　変換解除部６６は、信号抽出部６５からの入力信号に対して、送信装置側で実施された変換を解除する処理、すなわち周波数領域の信号に変換する処理を実行する。変換解除部６６の出力信号は復調部６７の入力信号となる。
　復調部６７は、変換解除部６６からの入力信号を復調して復調後のデータ信号を得る。なお、実施の形態１，２で説明した送信装置１０，１０ａが信号の送信元である場合、送信装置１０，１０ａの調整部１３において、信号の一部が削除されるため、復調部６７は、繰り返し処理を用いた復調を行う。復調部６７は、例えば、文献「D.N.Liu，M.P.Fitz，“Iterative　MAP　equalization　and　decoding　in　wireless　mobile　coded　OFDM”，IEEE　Trans.　On　Commun.,　vol.57，no.7，July　2009，pp.2042-2051.」に記載されている繰り返し処理を行うことにより受信信号を復調する。
　伝送路推定部６８は、受信部６１から出力される受信信号に含まれる固定系列に基づいて伝送路推定を行い、推定結果を伝送路情報生成部７１へ出力する。
　信号波形復元部６４および変換解除部６６の具体例について説明する。図１５は、実施の形態５にかかる受信装置６０の構成例を示す図である。
　図１５に示したように、受信装置６０の信号波形復元部６４は、ＤＦＴ部６４１、信号抽出部６４２、ＦＤＥ（Frequency　Domain　Equalizer）部６４３およびＩＤＦＴ部６４４を備える。また、受信装置６０の変換解除部６６はＤＦＴ部６６１を備える。
　ＤＦＴ部６４１は、入力信号に対してＫ点のＤＦＴ処理を実行して周波数領域の信号に変換する。信号抽出部６４２は、入力信号から、送信装置１０または１０ａでの補間処理でゼロが挿入される前の信号、すなわちデータ信号を抽出する。信号抽出部６４２が抽出する信号が挿入された位置は、制御部６３から出力される制御信号により信号抽出部６４２に通知される。ＦＤＥ部６４３は、信号抽出部６４２で抽出されたデータ信号に対してＦＤＥ、すなわち周波数領域等化を行う。ＦＤＥ部６４３は、例えば、上記の非特許文献１に記載されている手法を用いてＦＤＥを行う。ＩＤＦＴ部６４４は、入力信号に対してＮ点のＩＤＦＴ処理を実行して時間領域の信号に変換する。
　ＤＦＴ部６６１は、入力信号に対してＮ点のＤＦＴ処理を実行して周波数領域の信号に変換する。
　伝送路情報生成部７１は、伝送路推定部６８による推定結果を示す伝送路情報を生成する。伝送路情報は制御情報として送信部７２から基地局１，１ａへ送信されることになる。伝送路情報は複数種類存在する。例えば、マルチパス伝送路におけるパス数、最大遅延時間、伝送路行列の固有値および固有ベクトル、送信側でプリコーディングを行う場合に用いるプリコーダー行列の候補を示す候補番号などが伝送路情報に該当する。伝送路情報生成部７１は、基地局１，１ａが必要としている伝送路情報を含んだ制御信号を生成する。
　送信部７２は、入力された制御信号に対してデジタルアナログ変換処理、周波数変換処理などを実行した後、基地局１，１ａに向けて送信する。
　次に、端末２がダウンリンク信号を受信する動作について、図１６を参照しながら説明する。図１６は、端末２がダウンリンク信号を受信する動作の一例を示すフローチャートである。
　端末２は、まず、受信信号から制御情報を抽出する（ステップＳ２１）。このステップＳ２１の処理は制御情報抽出部６２が行う。
　端末２は、次に、送信装置側で実施された補間処理と逆の処理を受信信号に実行して補間を解除、すなわち補間処理で挿入されたゼロを除去する（ステップＳ２２）。端末２は、さらに、補間を解除した後の受信信号に対して等化処理を実行してマルチパス伝送路で受けた干渉成分を除去する（ステップＳ２３）。これらのステップＳ２２およびＳ２３の処理は信号波形復元部６４が行う。なお、信号波形復元部６４は、周波数領域で補間の解除および干渉成分の除去を行う。
　端末２は、次に、受信信号からデータ信号を抽出し（ステップＳ２４）、送信装置がデータ信号に対して実施した変換を解除する処理、具体的には周波数領域の信号に変換する処理を実行する（ステップＳ２５）。ステップＳ２４の処理は信号抽出部６５が行い、ステップＳ２５の処理は変換解除部６６が行う。
　端末２は、次に、変換解除後のデータ信号を復調する（ステップＳ２６）。このステップＳ２６の処理は復調部６７が行う。
　以上のように、本実施の形態にかかる端末２を構成する受信装置６０は、基地局１，１ａを構成する送信装置１０，１０ａで実行された信号変換処理、多重化処理、補間処理などの各処理と逆の処理を受信信号に実行し、ダウンリンク信号で伝送された情報系列を復調することができる。
　次に、実施の形態５にかかる端末２のハードウェア構成について説明する。端末２の各構成要素は、実施の形態１から４で説明した基地局１，１ａ，１ｂ，１ｃと同様に、図６または図７に示したハードウェアにより実現することが可能である。端末２の一部の構成要素をプロセッサがソフトウェアを実行する回路で実現し、残りの構成要素を専用の回路で実現してもよい。
実施の形態６．
　実施の形態５では、実施の形態３，４で説明した基地局１ｂ，１ｃが送信した信号を受信する端末２について説明する。なお、実施の形態５の端末２と実施の形態６の端末２との違いは、受信装置の構成であり、送信装置の構成は同じである。そのため、本実施の形態では受信装置の構成および実行する処理について説明する。
　図１７は、実施の形態６にかかる受信装置６０ｂの構成例を示す図である。受信装置６０ｂは、実施の形態５で説明した受信装置６０の変換解除部６６を変換解除部６６ｂに置き換えたものである。受信装置６０ｂの変換解除部６６ｂは、入力信号に対してＭ点のＤＦＴ処理を実行して周波数領域の信号に変換するＤＦＴ部６６２を備える。
　以上のように、本実施の形態にかかる端末２を構成する受信装置６０ｂは、基地局１ｂ，１ｃを構成する送信装置１０ｂ，１０ｃで実行された信号変換処理、多重化処理、補間処理などの各処理と逆の処理を受信信号に実行し、ダウンリンク信号で伝送された情報系列を復調することができる。
　なお、本実施の形態にかかる受信装置６０ｂは、実施の形態５にかかる受信装置６０と同様に、図６または図７に示した構成のハードウェアで実現することができる。
　以上の実施の形態に示した構成は、本発明の内容の一例を示すものであり、別の公知の技術と組み合わせることも可能であるし、本発明の要旨を逸脱しない範囲で、構成の一部を省略、変更することも可能である。
　１，１ａ，１ｂ，１ｃ　基地局、２1～２n　端末、３　通信システム、１０，１０ａ，１０ｂ，１０ｃ，７０　送信装置、１１　データ生成部、１２　変換部、１３　調整部、１４，４２　固定系列生成部、１５，４２３　多重部、１６，４２４　補間部、１７，７２　送信部、１８，１８ｂ　データ系列生成部、２０，６０，６０ｂ　受信装置、２１，６１　受信部、２２，６７　復調部、２３　情報抽出部、３１　制御情報生成部、３２，３２ａ，６３　制御部、３３　情報管理部、４１　ゼロ系列生成部、４３　合成部、６２　制御情報抽出部、６５，６４２　信号抽出部、６６　変換解除部、６８　伝送路推定部、７１　伝送路情報生成部、１２１，１２１ｂ，１６３，２４３，６４４　ＩＤＦＴ部、１６１，２４１，６４１　ＤＦＴ部、１６２，２４２　ゼロ挿入部、４２１　固定シンボル生成部、４２２　ゼロシンボル生成部、６４３　ＦＤＥ部。

Claims (12)

  1. 　マルチキャリアブロック伝送方式に対応した送信装置であって、
    　固定系列を生成する固定系列生成部と、
    　データシンボルを時間領域の信号に変換してデータ信号を生成するデータ系列生成部と、
    　前記固定系列を２分割してブロックの先頭および末尾に配置し、前記データ系列生成部からの出力信号であるデータ系列を前記２分割した固定系列の間に配置してブロック信号を生成する多重部と、
    　前記ブロック信号に対して補間処理を行う補間部と、
    　を備えることを特徴とする送信装置。
  2. 　前記固定系列生成部は、非ゼロの固定系列を生成する、
    　ことを特徴とする請求項１に記載の送信装置。
  3. 　前記固定系列生成部を、ゼロ系列を生成する第１の固定系列生成部とし、
    　非ゼロの固定系列を生成するとともに、生成した非ゼロの固定系列に対して補間処理を行って補間処理後の固定系列を生成する第２の固定系列生成部と、
    　前記補間部で補間処理が行われた後の前記ブロック信号と、前記補間処理後の固定系列とを合成する合成部と、
    　をさらに備えることを特徴とする請求項１に記載の送信装置。
  4. 　前記データ系列生成部は、
    　前記データシンボルを生成するデータ生成部と、
    　前記データシンボルを前記データ信号に変換する変換部と、
    　前記データ信号の長さを、前記ブロック信号の長さと前記固定系列の長さとの差に等しくなるように調整する前記データ系列を生成する調整部と、
    　を備えることを特徴とする請求項１から３のいずれか一つに記載の送信装置。
  5. 　前記データ系列生成部は、
    　前記データシンボルを生成するデータ生成部と、
    　前記データシンボルを、前記ブロック信号の長さと前記固定系列の長さとの差と同じ長さの前記データ信号に変換して前記データ系列を生成する変換部と、
    　を備えることを特徴とする請求項１から３のいずれか一つに記載の送信装置。
  6. 　前記補間部は、前記ブロック信号を周波数領域の信号に変換する周波数領域変換部と、
    　前記周波数領域の信号にゼロを挿入するゼロ挿入部と、
    　前記ゼロ挿入部でゼロが挿入された後の前記周波数領域の信号を時間領域の信号に変換する時間領域変換部と、
    　を備えることを特徴とする請求項１から５のいずれか一つに記載の送信装置。
  7. 　前記固定系列生成部が生成する固定系列の長さを、前記ブロック信号を受信する受信装置との間の伝送路の状態に基づいて決定された長さとする、
    　ことを特徴とする請求項１から６のいずれか一つに記載の送信装置。
  8. 　前記伝送路の状態を、前記送信装置が送信する信号に対して前記伝送路で付加される遅延時間の最大値とする、
    　ことを特徴とする請求項７に記載の送信装置。
  9. 　前記多重部が前記固定系列を２分割して得られる分割後の２つの固定系列の長さを、前記送信装置が送信する信号の帯域外電力の抑圧量に基づいて決定された長さとする、
    　ことを特徴とする請求項１から８のいずれか一つに記載の送信装置。
  10. 　請求項１から９のいずれか一つに記載の送信装置から送信された信号を受信する受信装置であって、
    　前記補間部が行う補間処理と逆の処理を受信信号に実行し、得られた信号に対して周波数領域等化を実行する信号波形復元部と、
    　前記周波数領域等化を実行して得られた信号から前記データ系列を抽出する信号抽出部と、
    　前記信号抽出部が抽出した前記データ系列を復調する復調部と、
    　を備えることを特徴とする受信装置。
  11. 　請求項１から９のいずれか一つに記載の送信装置を備えた基地局と、
    　請求項１０に記載の受信装置を備えた端末と、
    　を備えることを特徴とする通信システム。
  12. 　マルチキャリアブロック伝送方式に対応した送信装置が実行する送信方法であって、
    　固定系列を生成する固定系列生成ステップと、
    　データシンボルを時間領域の信号に変換してデータ信号を生成するデータ信号生成ステップと、
    　前記データ信号に基づいてデータ系列を生成するデータ系列生成ステップと、
    　前記固定系列を２分割してブロックの先頭および末尾に配置し、前記データ系列を前記２分割した固定系列の間に配置してブロック信号を生成する多重ステップと、
    　前記ブロック信号に対して補間処理を行う補間ステップと、
    　を含むことを特徴とする送信方法。
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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN111901278A (zh) * 2020-07-07 2020-11-06 中兴通讯股份有限公司 一种数据调制方法、设备及储存介质

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010034672A (ja) * 2008-07-25 2010-02-12 Mitsubishi Electric Corp 受信装置および復調方法
WO2017022056A1 (ja) * 2015-08-03 2017-02-09 三菱電機株式会社 送信装置
WO2017022059A1 (ja) * 2015-08-03 2017-02-09 三菱電機株式会社 送信装置

Family Cites Families (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100510551B1 (ko) * 2003-10-10 2005-08-26 삼성전자주식회사 Ｏｆｄｍ 신호 심볼의 공통 위상 에러(ｃｐｅ)를 제거하는ｏｆｄｍ 디모듈레이터 및 그 ｃｐｅ 제거 방법
US20070183386A1 (en) * 2005-08-03 2007-08-09 Texas Instruments Incorporated Reference Signal Sequences and Multi-User Reference Signal Sequence Allocation
KR100979598B1 (ko) * 2006-06-26 2010-09-01 교세라 가부시키가이샤 Ｏｆｄｍ 통신 장치 및 가드 인터벌 길이 결정 방법
US8681833B2 (en) * 2008-04-23 2014-03-25 Sharp Kabushiki Kaisha Communication system, transmitter, receiver and communication method
CN101582739A (zh) * 2008-06-27 2009-11-18 北京新岸线移动多媒体技术有限公司 数字广播信号的发送装置、发送方法和发送系统
CN101651647B (zh) * 2008-08-12 2011-12-28 清华大学 时域同步正交频分复用系统中的cp-ofdm信号重构方法及装置
EP2333994B1 (en) * 2008-09-18 2017-03-29 Mitsubishi Electric Corporation Transmission device
JP2011223546A (ja) * 2010-03-26 2011-11-04 Fujitsu Ltd 受信装置
CN103139125B (zh) * 2011-12-02 2016-04-13 华为技术有限公司 下行数据发送、接收方法及基站与用户终端
US9485127B2 (en) * 2012-10-18 2016-11-01 Commonwealth Scientific And Industrial Research Organisation OFDM communications
CN108737316B (zh) * 2013-03-13 2021-04-23 三菱电机株式会社 发送装置和发送方法
CN103581096B (zh) * 2013-03-25 2017-05-10 上海数字电视国家工程研究中心有限公司 Ofdm调制解调方法及数字信号发射、接收系统

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010034672A (ja) * 2008-07-25 2010-02-12 Mitsubishi Electric Corp 受信装置および復調方法
WO2017022056A1 (ja) * 2015-08-03 2017-02-09 三菱電機株式会社 送信装置
WO2017022059A1 (ja) * 2015-08-03 2017-02-09 三菱電機株式会社 送信装置

Non-Patent Citations (6)

* Cited by examiner, † Cited by third party
Title
B. PORAT: "A Course in Digital Signal Processing", 1997, JOHN WILEY AND SONS INC.
D. C. CHU: "Polyphase Codes With Good Periodic Correlation Properties", IEEE TRANSACTIONS ON INFORMATION THEORY, vol. 18, no. 4, July 1972 (1972-07-01), pages 531 - 532, XP003015230, doi:10.1109/TIT.1972.1054840
D. N. LIUM. P. FITZ: "Iterative MAP equalization and decoding in wireless mobile coded OFDM", IEEE TRANS. ON COMMUN., vol. 57, no. 7, July 2009 (2009-07-01), pages 2042 - 2051
FUMIHIRO HASEGAWA ET AL.: "Static Sequence Assisted Out-of-Band Power Suppression for DFT-s-OFDM", 2015 IEEE 26TH ANNUAL INTERNATIONAL SYMPOSIUM ON PERSONAL, INDOOR, AND MOBILE RADIO COMMUNICATIONS (PIMRC), 30 August 2015 (2015-08-30), pages 61 - 66, XP032821953, DOI: 10.1109/PIMRC.2015.7343269 *
HASEGAWA, FUMIHIRO ET AL.: "Static sequence embedded DFT-s-OFDM", IEICE TECHNICAL REPORT, vol. 114, no. 490, 25 February 2015 (2015-02-25), pages 147 - 152, XP009504767 *
W. Y. ZOUY. WU: "COFDM: AN OVERVIEW", IEEE TRANS. ON BROADCASTING, vol. 41, no. 1, March 1995 (1995-03-01), pages 1 - 8

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