WO2018078893A1 - 化合物半導体デバイス - Google Patents
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Abstract
基板(1)上に半導体層(2,3)が形成されている。半導体層(3)上にゲート電極(4)、ソース電極(5)及びドレイン電極(6)が形成されている。ゲート電極(4)とソース電極(5)との間に強相関電子系材料(12)が接続されている。
Description
本発明は、高エネルギーの粒子に曝される過酷な環境下においても破壊及び劣化され難い化合物半導体デバイスに関する。
MES-FET又はHEMTなどの電界効果トランジスタとして化合物半導体デバイスが用いられている(例えば、特許文献1~3参照)。デバイスが過酷な環境下に曝され、高エネルギー粒子が入射して、パッシベーション膜、ソースフィールドプレート、デバイスの活性領域を通過し基板まで達する場合がある。この時、高エネルギー粒子が通過した軌跡周辺に多量の電子・正孔対が発生し、材料の易動度、再結合速度、印加電圧に応じて拡散、再結合する。
ソースフィールドプレートのドレイン電極側の端部とAlGaNチャネル層との間に高い電界がかかる。このため、高エネルギーの粒子が入射してパッシベーション膜内に多量の電子・正孔対が発生すると、その部分に導通パスが形成されて破壊に至る。または、半導体内に発生した電子・正孔対の拡散、再結合過程で半導体表面付近の正孔濃度が上昇し、電位の上昇又は正孔電流の増加を引き起こし破壊に至るか、又は劣化し易いという問題があった。同様に、ゲート電極のドレイン電極側の端部とAlGaNチャネル層との間にも高い電界がかかり、破壊又は劣化しやすいという問題があった。
また、高周波特性を向上させるため、ゲート電極とソース電極との間にSiNキャパシタを接続する場合もあった。しかし、SiNは絶縁体のため、半導体内で発生した電子・正孔対の電荷をSiNキャパシタを介して除去することはできなかった。
本発明は、上述のような課題を解決するためになされたもので、その目的は高エネルギーの粒子に曝される過酷な環境下においても破壊及び劣化され難い化合物半導体デバイスを得るものである。
本発明に係る化合物半導体デバイスは、基板と、前記基板上に形成された半導体層と、前記半導体層上に形成されたゲート電極、ソース電極及びドレイン電極と、前記ゲート電極と前記ソース電極との間に接続された強相関電子系材料とを備えることを特徴とする。
本発明では、デバイス内で電子・正孔対が発生した時、ゲート電極に接続された強相関電子系材料がデバイス内の電位変動を感じ、短時間で絶縁体から導電体へ相転位する。デバイス内で発生した電子・正孔対が、導電性に変化した強相関電子系材料を通過してアースへ流れ、デバイスへのダメージを低減させることができる。よって、本発明に係る化合物半導体デバイスは、高エネルギーの粒子に曝される過酷な環境下においても破壊及び劣化され難い。
本発明の実施の形態に係る化合物半導体デバイスについて図面を参照して説明する。同じ又は対応する構成要素には同じ符号を付し、説明の繰り返しを省略する場合がある。
実施の形態1.
図1は、本発明の実施の形態1に係る化合物半導体デバイスを示す断面図である。SiC基板1上にGaNバッファ層2が形成されている。GaNバッファ層2上にAlGaNチャネル層3が形成されている。AlGaNチャネル層3上にゲート電極4、ソース電極5及びドレイン電極6が形成されている。
図1は、本発明の実施の形態1に係る化合物半導体デバイスを示す断面図である。SiC基板1上にGaNバッファ層2が形成されている。GaNバッファ層2上にAlGaNチャネル層3が形成されている。AlGaNチャネル層3上にゲート電極4、ソース電極5及びドレイン電極6が形成されている。
第1のパッシベーション膜7がゲート電極4及びAlGaNチャネル層3を覆っている。ソースフィールドプレート9が第1のパッシベーション膜7上に形成され、ソース電極5からゲート電極4とドレイン電極6との間まで延びている。ソースフィールドプレート9は、ゲート電極4とドレイン電極6との間の電界を緩和し高電圧動作を可能にし、さらに寄生容量を低減することで高周波特性を向上させる。デバイス全体を保護するために第2のパッシベーション膜10が第1のパッシベーション膜7及びソースフィールドプレート9を覆っている。
ソース電極5とドレイン電極6との間に電圧を印加し、ゲート電極4に所望のバイアス電圧を印加した状態でゲート電極4に高周波を入力すると、二次元電子ガス11内の電子が高速で移動し、ドレイン電極6から増幅された高周波電力が得られるアンプとして動作する。
図2は、本発明の実施の形態1に係る化合物半導体デバイスを示す平面図である。図3は、本発明の実施の形態1に係る化合物半導体デバイスの回路図である。ゲート電極4とソース電極5との間に強相関電子系材料12が接続されている。ソース電極5はアースに接続されている。
強相関電子系材料12の代表例は、VO2、SrTiO3、LaVO3、SrOなどであり、銅酸化物系、Fe系、Mn系、超伝導系など多くの強相関を示す材料が報告されている。強相関電子系材料12は、通常の状態では電子で満たされているにも関わらず、電子同士の相関が強すぎるため自由に動くことができず絶縁性を示すMOTT絶縁体である。強相関電子系材料12に電圧、温度、光などの刺激を与えると導電性材料に相転移することが知られている。強相関電子系材料12はPLD法などの通常半導体プロセスで用いる手法で形成、加工することができるため、既存の半導体製造プロセスに組込むことが容易である。
デバイスに高エネルギー粒子が入射すると第2のパッシベーション膜10、ソースフィールドプレート9、第1のパッシベーション膜7、AlGaNチャネル層3、GaNバッファ層2を通過しSiC基板1まで達する場合がある。飛来する粒子は重粒子、プロトン、電子、中性子、ミュオンなどであり、1keVから100GeV程度のエネルギーを持っている。高エネルギー粒子が通過した軌跡周辺では多量の電子・正孔対が発生する。従来の構造では発生した電子・正孔対がデバイス内で拡散、ドリフト、再結合し消滅していく過程で半導体に大きなダメージを与え破壊又は劣化させてしまう。
本実施の形態では、デバイス内で電子・正孔対が発生した時、ゲート電極4に接続された強相関電子系材料12がデバイス内の電位変動を感じ、短時間で絶縁体から導電体へ相転位する。デバイス内で発生した電子・正孔対が、導電性に変化した強相関電子系材料12を通過してアースへ流れ、デバイスへのダメージを低減させることができる。よって、本実施の形態に係る化合物半導体デバイスは、高エネルギーの粒子に曝される過酷な環境下においても破壊及び劣化され難い。
図4は、本発明の実施の形態1に係る強相関電子系材料を示す断面図である。SiC基板1上に下地電極13が配置されている。下地電極13はゲート電極4に接続されている。下地電極13上に強相関電子系材料12の薄膜が形成されている。強相関電子系材料12上に上地電極14が形成されている。上地電極14はソース電極5に接続されている。このようにキャパシタと同様の簡単な構造で強相関電子系材料12をソース電極5とドレイン電極6との間に接続することができる。また、強相関電子系材料12をSiC基板1上に配置することでデバイスの小型化を実現できる。なお、強相関電子系材料12の両端にそれぞれソース電極5とドレイン電極6を接続する構造でもよい。
実施の形態2.
図5は、本発明の実施の形態2に係る化合物半導体デバイスの回路図である。本実施の形態では、実施の形態1の構成に加えて、ソース電極5とドレイン電極6との間に強相関電子系材料15が接続されている。これにより、電荷が抜けるパスが増えるので効果が増す。なお、ソース側の強相関電子系材料12を省略してドレイン側の強相関電子系材料15のみ設けてもよく、実施の形態1と同様の効果を得ることができる。
図5は、本発明の実施の形態2に係る化合物半導体デバイスの回路図である。本実施の形態では、実施の形態1の構成に加えて、ソース電極5とドレイン電極6との間に強相関電子系材料15が接続されている。これにより、電荷が抜けるパスが増えるので効果が増す。なお、ソース側の強相関電子系材料12を省略してドレイン側の強相関電子系材料15のみ設けてもよく、実施の形態1と同様の効果を得ることができる。
1 SiC基板、2 GaNバッファ層、3 AlGaNチャネル層、4 ゲート電極、5 ソース電極、6 ドレイン電極、12,15 強相関電子系材料、13 下地電極、14 上地電極
Claims (4)
- 基板と、
前記基板上に形成された半導体層と、
前記半導体層上に形成されたゲート電極、ソース電極及びドレイン電極と、
前記ゲート電極と前記ソース電極との間に接続された強相関電子系材料とを備えることを特徴とする化合物半導体デバイス。 - 基板と、
前記基板上に形成された半導体層と、
前記半導体層上に形成されたゲート電極、ソース電極及びドレイン電極と、
前記ソース電極と前記ドレイン電極との間に接続された強相関電子系材料とを備えることを特徴とする化合物半導体デバイス。 - 前記強相関電子系材料は、前記基板上に配置されていることを特徴とする請求項1又は2に記載の化合物半導体デバイス。
- 前記強相関電子系材料は下地電極と上地電極の間に挟まれていることを特徴とする請求項1~3の何れか1項に記載の化合物半導体デバイス。
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WWE | Wipo information: entry into national phase |
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121 | Ep: the epo has been informed by wipo that ep was designated in this application |
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122 | Ep: pct application non-entry in european phase |
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