WO2014181613A1 - Esd保護装置 - Google Patents

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貴之 今田
孝之 築澤
足立 淳
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株式会社村田製作所
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Definitions

  • the present invention relates to an ESD protection device for protecting an electronic device from ESD (Electro-Static-Discharge), and more specifically, the tips of first and second discharge electrodes are disposed in a ceramic multilayer substrate.
  • ESD Electro-Static-Discharge
  • the present invention relates to an opposing ESD protection device.
  • Patent Document 1 discloses an ESD protection device that can lower a discharge start voltage.
  • Patent Documents 1 and 2 at least a pair of discharge electrodes are arranged in a ceramic multilayer substrate. At least the ends of the pair of discharge electrodes are opposed to each other with a gap therebetween.
  • An auxiliary electrode including a conductive material coated with a non-conductive material and a ceramic material is provided so as to connect the discharge electrodes.
  • the discharge electrode tends to shrink greatly during firing to obtain a ceramic multilayer substrate. Therefore, there is a problem that the gap between the tips of the discharge electrodes is widened and the discharge start voltage is increased.
  • An object of the present invention is to provide an ESD protection device that enables a discharge start voltage to be lowered.
  • the ESD protection device includes a ceramic multilayer substrate and first and second discharge electrodes.
  • the first and second discharge electrodes are provided so that the tips thereof are opposed to each other at a certain height position of the ceramic multilayer substrate.
  • the first and second discharge electrodes include a metal and a shrinkage-suppressing material having a shrinkage rate at a firing temperature for obtaining a ceramic multilayer substrate that is smaller than that of the metal.
  • the shrinkage suppression material is made of an inorganic substance having a sintering temperature higher than that of the metal contained in the first and second discharge electrodes.
  • the shrinkage suppression material may be formed of a semiconductor. In that case, the discharge start voltage can be further effectively reduced.
  • the shrinkage suppression material may be an insulating material.
  • the ESD protection apparatus preferably further includes an auxiliary electrode disposed in the ceramic multilayer substrate so as to be continuous with the first discharge electrode and the second discharge electrode.
  • a conductive material coated with an insulating material In this case, the discharge start voltage can be further reduced.
  • the auxiliary electrode may further contain a ceramic material, more preferably a ceramic material made of semiconductor ceramics.
  • the shrinkage of the first and second discharge electrodes can be suppressed when firing to obtain the ceramic multilayer substrate. it can. Therefore, when the tips of the first and second discharge electrodes are opposed to each other, it is difficult to spread during firing. Therefore, it is possible to effectively reduce the discharge start voltage.
  • FIG. 1 is a front sectional view of an ESD protection apparatus according to an embodiment of the present invention.
  • FIG. 2 is a partially enlarged front sectional view showing a main part of the ESD protection apparatus according to one embodiment of the present invention.
  • FIG. 1 is a front sectional view of an ESD protection apparatus according to an embodiment of the present invention.
  • the ESD protection device 1 has a ceramic multilayer substrate 2.
  • the ceramic multilayer substrate 2 has a rectangular parallelepiped shape.
  • a cavity 3 is provided inside the ceramic multilayer substrate 2.
  • a first discharge electrode 4 and a second discharge electrode 5 are formed on a plane at a certain height in the ceramic multilayer substrate 2.
  • the front end 4 a of the first discharge electrode 4 and the front end 5 a of the second discharge electrode 5 face each other in the cavity 3.
  • a portion where the tip 4a and the tip 5a face each other is a facing portion.
  • the cavity 3 can be formed using a resin paste that disappears when the ceramic multilayer substrate 2 is fired. That is, the resin paste may be added to the ceramic green sheet laminate, and the resin paste disappeared during firing to obtain a ceramic multilayer substrate.
  • a resin constituting such a resin paste a paste containing an appropriate resin that can disappear during firing can be used. Examples of the resin include polyethylene terephthalate (PET), polypropylene, and acrylic resin.
  • PET polyethylene terephthalate
  • the hollow portion may be formed using another material that disappears at a firing temperature, such as carbon or paraffin.
  • the auxiliary electrode 6 is provided so as to connect the first and second discharge electrodes 4 and 5. As shown in FIG. 2 in an enlarged manner, the auxiliary electrode 6 has a structure in which metal particles 6a whose surfaces are coated with an inorganic material having no conductivity and semiconductor ceramic particles 6b are dispersed.
  • a lower seal layer 10 is provided below the cavity 3.
  • the auxiliary electrode 6 described above is formed on the lower seal layer 10.
  • an upper seal layer 11 is provided on the upper surface side of the cavity 3.
  • the lower seal layer 10 and the upper seal layer 11 are made of ceramics having a higher sintering temperature than the ceramics constituting the ceramic multilayer substrate 2. Note that the lower seal layer 10 and the upper seal layer 11 are not necessarily provided.
  • the first discharge electrode 4 is electrically connected to the first external electrode 12 formed on the outer surface of the ceramic multilayer substrate 2 at a portion not shown.
  • the second discharge electrode 5 is electrically connected to the second external electrode 13 provided on the outer surface of the ceramic multilayer substrate 2 at a portion not shown.
  • the feature of the ESD protection apparatus 1 of the present embodiment is that the first and second discharge electrodes 4 and 5 include a metal and a shrinkage suppression material.
  • the shrinkage-suppressing material is a material having a shrinkage rate at a firing temperature for obtaining the ceramic multilayer substrate 2 smaller than that of the metal contained in the discharge electrode.
  • the shrinkage-suppressing material is not particularly limited as long as the shrinkage rate at the firing temperature is smaller than that of the metal contained in the discharge electrodes 4 and 5.
  • the shrinkage suppression material is preferably made of an inorganic substance. More preferably, the shrinkage suppression material is made of a semiconductor. In the case of a shrinkage-suppressing material made of a semiconductor, the conductivity of the first and second discharge electrodes 4 and 5 is difficult to decrease.
  • Semiconductors include carbides such as titanium carbide, zirconium carbide, molybdenum carbide, tungsten carbide, nitrides such as titanium nitride, zirconium nitride, chromium nitride, vanadium nitride, tantalum nitride, titanium silicide, zirconium silicide, tungsten silicide, Silicides such as molybdenum silicide and chromium silicide, titanium borides, zirconium borides, chromium borides, lanthanum borides, molybdenum borides such as molybdenum borides, oxides such as zinc oxide and strontium titanate But you can. Moreover, only 1 type may be used among these semiconductors, and 2 or more types may be used together.
  • the shrinkage suppressing material may be an insulating material such as alumina.
  • the first and second discharge electrodes 4 and 5 are unlikely to shrink during firing to obtain the ceramic multilayer substrate 2. Therefore, the gap between the tip 4a of the first discharge electrode 4 and the tip 5a of the second discharge electrode 5 is difficult to widen during firing. Therefore, an increase in the discharge start voltage can be suppressed. As a result, it is possible to reliably provide the ESD protection device 1 having a low discharge start voltage.
  • the auxiliary electrode 6 since the auxiliary electrode 6 is provided, it is possible to reduce the discharge start voltage.
  • the auxiliary electrode 6 has a structure in which metal particles 6a whose surfaces are coated with an inorganic material having no conductivity and semiconductor ceramic particles 6b are dispersed, as shown in an enlarged view in FIG.
  • the auxiliary electrode 6 is configured by such a dispersion structure.
  • the auxiliary electrode 6 can be formed by printing and baking a paste containing metal particles 6a whose surfaces are coated with an inorganic material having no conductivity, semiconductor ceramic particles 6b, and a binder.
  • the auxiliary electrode 6 may include only a conductive material coated with an inorganic material that does not have conductivity, and even in that case, the discharge start voltage can be effectively reduced.
  • the auxiliary electrode 6 desirably includes a conductive material coated with an inorganic material having no conductivity and a ceramic material, and more preferably has a conductivity as described above. It is desirable to include a conductive material coated with an inorganic material that is not applied and semiconductor ceramics. Thereby, the discharge start voltage can be further reduced.
  • FIG. 1 shows the first discharge electrode 4 and the second discharge electrode 5, that is, the pair of discharge electrodes 4 and 5, in the ESD protection device of the present invention, a plurality of pairs of discharge electrodes are arranged. May be. Even in such a case, according to the present invention, if each discharge electrode contains a shrinkage suppression material, the discharge start voltage can be effectively reduced.
  • the first and second discharge electrodes 4 and 5 are opposed to each other at one height position of the ceramic multilayer substrate 2, but at least a pair of discharges are respectively provided at a plurality of height positions.
  • the electrodes may be provided so as to face each other. That is, in addition to the first and second discharge electrodes 4 and 5, a discharge electrode pair facing each other at other height positions may be provided.
  • the ceramic material constituting the ceramic multilayer substrate is not limited to the BAS material, and forsterite added with glass, CuZrO 3 added with ceramic, or the like can be used as appropriate.
  • the semiconductor material used for the auxiliary electrode 6 is not limited to silicon carbide, but a carbide such as titanium carbide, a nitride such as titanium nitride, a silicide such as titanium silicide, a boride such as titanium boride, and an oxide such as lead oxide. May be used. Moreover, only 1 type may be used for semiconductor ceramics and it may use 2 or more types together.
  • the metal material forming the discharge electrodes 4 and 5 and the external electrode is not particularly limited. Not only Cu but Ag, Pd, Pt, Al, Ni, W, or an alloy mainly composed of these may be used. Further, a semiconductor material such as SiC may be used as the electrode material.
  • the nonconductive material that coats the conductive material is not particularly limited as long as it does not have conductivity.
  • an inorganic material is used.
  • the inorganic material include Al 2 O 3 , Zr 2 O 3 , and SiO 2 .
  • a mixture such as a BAS material may be used.
  • a BAS material which is a material composed of Ba, Al, and Si, was prepared as a ceramic material. Toluene was added as an organic solvent to the ceramic powder constituting the BAS material and mixed, and further a binder and a plasticizer were added and mixed to obtain a slurry. The obtained slurry was molded by a doctor blade method to obtain a mother ceramic green sheet having a thickness of 50 ⁇ m.
  • auxiliary electrode paste Cu powder with an average particle diameter of about 2 ⁇ m coated with Al 2 O 3 and SiC powder with an average particle diameter of about 0.5 ⁇ m are blended in a ratio of 1:10 by weight, and a binder resin and a solvent are added and mixed. did. In this way, an auxiliary electrode paste was obtained. In addition, in this auxiliary electrode paste, each component in which the binder resin and the solvent account for 20% by weight and the remaining 80% by weight is occupied by the Cu powder and the SiC powder was blended.
  • discharge electrode paste Cu powder having an average particle diameter of about 2 ⁇ m and Al 2 O 3 powder as an inorganic powder as a shrinkage suppression material are weighed in the proportions shown in Table 1 below, and further, a binder resin and an organic solvent are added, mixed, and paste No. 1 to 10 discharge electrode pastes were obtained.
  • the average particle size of the Al 2 O 3 powder used is about 0.5 ⁇ m.
  • the binder resin and the organic solvent occupy 20% by weight, and the remaining 80% by weight is composed of Cu powder and Al 2 O 3 powder.
  • the auxiliary electrode paste was printed on a mother ceramic green sheet by screen printing.
  • the discharge electrode paste was printed to form first and second discharge electrode portions.
  • the discharge electrode paste was printed so that the width of the discharge electrode was 100 ⁇ m and the dimension of the gap between the first and second discharge electrodes was 30 ⁇ m. Furthermore, a resin paste for forming a cavity was applied.
  • the mother laminate was cut in the thickness direction to obtain a ceramic laminate for each ESD protection device unit. In this way, a ceramic laminate having a size of 1.0 mm ⁇ 0.5 mm ⁇ thickness 0.3 mm was obtained. Thereafter, a conductive paste for forming external electrodes was applied to both end faces of the ceramic laminate.
  • the ceramic laminate was fired in nitrogen gas to obtain an ESD protection device 1. That is, the ceramic laminate was fired to obtain the ceramic multilayer substrate 2, and the resin paste was removed to form the cavity 3. Also, the auxiliary electrode paste and the discharge electrode paste were baked by firing to form the auxiliary electrode 6 and the first and second discharge electrodes 4 and 5.
  • the ESD protection device was created as described above.
  • the paste numbers 1 to 10 shown in Table 1 were used, respectively, and ESD protection devices of sample numbers 1 to 10 were prepared.
  • the discharge responsiveness was evaluated for each 100 ESD protection devices obtained as described above. That is, the discharge responsiveness was evaluated by the electrostatic discharge immunity test defined in IDC61000-4-2. It was determined by the following evaluation symbol according to the magnitude of the peak voltage detected on the protection circuit side. The results are shown in Table 2 below.
  • Peak voltage is 700 V or more and discharge response is good.
  • Peak voltage is 500 V or more and less than 700 V, discharge response is better.
  • Peak voltage is less than 500 V, discharge response is particularly good.

Abstract

 放電開始電圧を低め得る、ESD保護装置を提供する。 セラミック多層基板2と、セラミック多層基板2のある高さ位置において、先端4a,5a同士が対向するように設けられた第1,第2の放電電極4,5とを備え、第1,第2の放電電極4,5が、金属と、セラミック多層基板2を得るための焼成時の温度における収縮率が該金属よりも小さい収縮抑制材料とを含む、ESD保護装置1。

Description

ESD保護装置
 本発明は、ESD(Electro-Static-Discharge;静電気放電)から電子機器を保護するためのESD保護装置に関し、より詳細には、第1,第2の放電電極の先端同士がセラミック多層基板内で対向しているESD保護装置に関する。
 ESD保護装置では、より低い電圧のESDから電子機器を保護することが求められている。下記の特許文献1には、放電開始電圧を低め得るESD保護装置が開示されている。特許文献1,2では、セラミック多層基板内に、少なくとも一対の放電電極が配置されている。少なくとも一対の放電電極の先端同士がギャップを隔てて対向されている。また、放電電極間を接続するように、非導電性材料でコーティングされた導電性材料とセラミック材料とを含む補助電極が設けられている。
WO2008/146514 WO2009/136535
 従来のESD保護装置では、セラミック多層基板を得るための焼成時に放電電極が大きく収縮しがちであった。そのため、放電電極の先端間のギャップが拡がり、放電開始電圧が高くなるという問題があった。
 本発明の目的は、放電開始電圧を低めることを可能とする、ESD保護装置を提供することにある。
 本発明に係るESD保護装置は、セラミック多層基板と、第1,第2の放電電極とを備える。第1,第2の放電電極は、前記セラミック多層基板のある高さ位置において、先端同士が対向するように設けられている。本発明では、前記第1,第2の放電電極が、金属と、セラミック多層基板を得るための焼成時の温度における収縮率が該金属よりも小さい収縮抑制材料とを含む。
 本発明に係るESD保護装置では、好ましくは、前記収縮抑制材料が、前記第1,第2の放電電極に含有されている金属よりも焼結温度が高い無機物質からなる。
 本発明に係るESD保護装置において、上記収縮抑制材料は半導体により形成されていてもよい。その場合には、放電開始電圧をより一層効果的に低めることができる。
 本発明に係るESD保護装置では、上記収縮抑制材料は絶縁性材料であってもよい。
 本発明に係るESD保護装置では、好ましくは、前記第1の放電電極と前記第2の放電電極とに連なるように前記セラミック多層基板内に配置されている補助電極をさらに備え、該補助電極が、絶縁性材料によりコーティングされた導電性材料を含む。この場合には、放電開始電圧をより一層低めることができる。
 上記補助電極は、さらにセラミック材料を含んでいてもよく、より好ましくは半導体セラミックスからなるセラミック材料が含まれていてもよい。
 本発明に係るESD保護装置では、第1,第2の放電電極が収縮抑制材料を含むため、セラミック多層基板を得るための焼成に際し、第1,第2の放電電極の収縮を抑制することができる。従って、第1,第2の放電電極の先端同士が対向している場合、焼成に際して拡がり難い。よって、放電開始電圧を効果的に低めることが可能となる。
図1は、本発明の一実施形態に係るESD保護装置の正面断面図である。 図2は、本発明の一実施形態に係るESD保護装置の要部を示す部分拡大正面断面図である。
 以下、図面を参照しつつ、本発明の具体的な実施形態を説明することにより、本発明を明らかにする。
 図1は、本発明の一実施形態に係るESD保護装置の正面断面図である。
 ESD保護装置1は、セラミック多層基板2を有する。セラミック多層基板2は、本実施形態では、直方体状の形状を有する。セラミック多層基板2の内部には空洞部3が設けられている。
 セラミック多層基板2内のある高さ位置の平面上に、第1の放電電極4と、第2の放電電極5とが形成されている。第1の放電電極4の先端4aと、第2の放電電極5の先端5aとが空洞部3内において対向している。先端4aと先端5aとが対向している部分が対向部である。
 上記空洞部3は、セラミック多層基板2の焼成に際し消失する樹脂ペーストを用いて形成することができる。すなわち、セラミックグリーンシート積層体中に樹脂ペーストを添加しておき、セラミック多層基板を得るための焼成に際し、樹脂ペーストを消失させればよい。このような樹脂ペーストを構成する樹脂としては、焼成時に消失し得る適宜の樹脂を含むペーストを用いることができる。樹脂としては、ポリエチレンテレフタレート(PET)、ポリプロピレン、アクリル樹脂などを挙げることができる。なお、樹脂ペーストに代えて、カーボンやパラフィンなどの焼成時の温度で消失する他の材料を用いて空洞部を形成してもよい。
 本実施形態では、第1,第2の放電電極4,5を接続するように、補助電極6が設けられている。図2に拡大して示すように、補助電極6は、導電性を有しない無機材料により表面をコーティングされた金属粒子6aと、半導体セラミック粒子6bとが分散されている構造を有する。
 図1に戻り、本実施形態では空洞部3の下方においては、下部シール層10が設けられている。下部シール層10上に、上述した補助電極6が形成されている。さらに、空洞部3の上面側には、上部シール層11が設けられている。下部シール層10及び上部シール層11は、セラミック多層基板2を構成しているセラミックスよりも焼結温度が高いセラミックスからなる。なお、下部シール層10及び上部シール層11は必ずしも設けられずともよい。
 第1の放電電極4は、図示されていない部分において、セラミック多層基板2の外表面に形成された第1の外部電極12に電気的に接続されている。同様に、第2の放電電極5は、セラミック多層基板2の外表面に設けられた第2の外部電極13に、図示しない部分において電気的に接続されている。
 本実施形態のESD保護装置1の特徴は、第1,第2の放電電極4,5が、金属と、収縮抑制材料とを含むことにある。収縮抑制材料は、セラミック多層基板2を得るための焼成時の温度における収縮率が放電電極に含まれている上記金属よりも小さい材料である。
 上記収縮抑制材料としては、焼成時の温度における収縮率が上記放電電極4,5に含まれている金属よりも小さい限り、特に限定されない。焼成温度に耐え得るため、収縮抑制材料は、好ましくは、無機物質からなる。より好ましくは、収縮抑制材料は、半導体からなる。半導体からなる収縮抑制材料の場合、第1,第2の放電電極4,5の導電性が低くなり難い。半導体としては、炭化チタン、炭化ジルコニウム、炭化モリブデン、炭化タングステン等の炭化物、窒化チタン、窒化ジルコニウム、窒化クロム、窒化バナジウム、窒化タンタル等の窒化物、ケイ化チタン、ケイ化ジルコニウム、ケイ化タングステン、ケイ化モリブデン、ケイ化クロム等のケイ化物、ホウ化チタン、ホウ化ジルコニウム、ホウ化クロム、ホウ化ランタン、ホウ化モリブデン、ホウ化タングステン等のホウ化物、酸化亜鉛、チタン酸ストロンチウム等の酸化物でもよい。また、これらの半導体のうち、1種のみを用いてもよく、2種以上を併用してもよい。
 もっとも、収縮抑制材料は、アルミナなどの絶縁性材料であってもよい。
 本実施形態のESD保護装置1では、上記収縮抑制材料が含有されているため、セラミック多層基板2を得るための焼成に際し、第1,第2の放電電極4,5が収縮し難い。そのため、第1の放電電極4の先端4aと、第2の放電電極5の先端5aとの間のギャップが焼成に際して拡がり難い。よって、放電開始電圧の上昇を抑制することができる。ひいては、放電開始電圧の低いESD保護装置1を確実に提供することが可能となる。
 また、本実施形態では、上記補助電極6が設けられているため、それによっても放電開始電圧を低めることが可能とされている。
 上記補助電極6は、本実施形態では、図2に拡大して示すように、導電性を有しない無機材料により表面をコーティングされた金属粒子6aと、半導体セラミック粒子6bとが分散されている構造を有する。このような分散構造により、補助電極6が構成されている。補助電極6は、具体的には、導電性を有しない無機材料により表面がコーティングされた金属粒子6aと、半導体セラミック粒子6bと、バインダーとを含むペーストを印刷し、焼き付けることにより形成され得る。
 なお、上記補助電極6は、導電性を有しない無機材料によりコーティングされた導電性材料のみを含んでいてもよく、その場合においても、放電開始電圧を効果的に低めることができる。好ましくは、上記のように、補助電極6は、導電性を有しない無機材料によりコーティングされた導電性材料と、セラミック材料とを含むことが望ましく、より好ましくは上記のように、導電性を有しない無機材料によりコーティングされた導電性材料と、半導体セラミックスとを含むことが望ましい。それによって、放電開始電圧をより一層低めることができる。
 なお、図1では、第1の放電電極4と第2の放電電極5、すなわち一対の放電電極4,5を示したが、本発明におけるESD保護装置では、複数対の放電電極が配置されていてもよい。その場合においても、本発明に従って、各放電電極が収縮抑制材料を含有していれば、放電開始電圧を効果的に低めることができる。
 さらに、ESD保護装置1では、セラミック多層基板2の1つの高さ位置において第1,第2の放電電極4,5が対向されていたが、複数の高さ位置において、それぞれ、少なくとも一対の放電電極が対向するように設けられていてもよい。すなわち、第1,第2の放電電極4,5に加えて、他の高さ位置で対向している放電電極対が設けられていてもよい。
 上記セラミック多層基板を構成するセラミック材料については、BAS材に限らず、フォルステライトにガラスを加えたものや、CuZrOにガラスを加えたセラミックスなどを適宜用いることができる。
 補助電極6に用いる半導体材料は炭化ケイ素に限定されず、炭化チタンなどの炭化物、窒化チタンなどの窒化物、ケイ化チタンなどのケイ化物、ホウ化チタンなどのホウ化物、酸化鉛などの酸化物を用いてもよい。また、半導体セラミックスは1種のみを用いてもよく、2種以上を併用してもよい。
 また、放電電極4,5や外部電極を形成する金属材料についても特に限定されない。Cuに限らず、Ag、Pd、Pt、Al、Ni、Wまたはこれらを主体とする合金を用いてもよい。さらに、電極材料として、SiCなどの半導体材料を用いてもよい。
 上記導電材料をコートしている非導電性の材料については、導電性を有しない限り特に限定されない。好ましくは、無機材料が用いられる。無機材料としては、Al、Zr、SiOなどが挙げられる。あるいは、BAS材などの混合剤を用いてもよい。
 次に、具体的な実験例につき説明する。
 (セラミックグリーンシート)
 Ba、Al及びSiを中心とする組成からなる材料であるBAS材をセラミック材料として用意した。BAS材を構成するセラミック粉末に有機溶媒としてトルエンを加え混合し、さらにバインダー及び可塑剤を加え混合し、スラリーを得た。得られたスラリーをドクターブレード法により成形し、厚さ50μmのマザーのセラミックグリーンシートを得た。
 (補助電極用ペースト)
 Alでコーティングされた平均粒径約2μmのCu粉末と、平均粒径約0.5μmのSiC粉を重量比1対10の割合で配合し、さらにバインダー樹脂及び溶剤を添加し、混合した。このようにして、補助電極用ペーストを得た。なお、この補助電極用ペーストにおいては、バインダー樹脂と溶剤とが20重量%を占め、残りの80重量%をCu粉末及びSiC粉末が占めている、各成分を配合した。
 (放電電極用ペースト)
 平均粒径約2μmのCu粉末と、収縮抑制材料としての無機粉末としてAl粉末とを下記の表1に示す割合で秤量し、さらにバインダー樹脂及び有機溶剤を添加し、混合し、ペーストNo1~10の放電電極用ペーストを得た。なお、使用したAl粉末の平均粒径は約0.5μmである。
 上記のようにして得た放電電極用ペーストでは、バインダー樹脂及び有機溶剤が20重量%を占め、残りの80重量%が、Cu粉末及びAl粉末からなる。
Figure JPOXMLDOC01-appb-T000001
 (空洞形成用ペースト)
 空洞部3を形成するための樹脂ペーストとして、平均粒径1μmの架橋アクリル樹脂ビーズ40重量%と、エチルセルロースをジヒドロターピニルアセテートに溶解して作製した有機ビヒクル60重量%とを調合し、混練したものを用いた。
 (製造工程)
 以下の製造工程においては、個々のESD保護装置のセラミック多層基板単位の積層体を得るまでの工程はマザーの状態で行った。
 すなわち、マザーのセラミックグリーンシート上に、補助電極用ペーストを、スクリーン印刷により印刷した。次に、放電電極用ペーストを印刷し、第1,第2の放電電極部分を形成した。ここでは、放電電極の幅が100μm、第1,第2の放電電極間のギャップの寸法が30μmとなるように放電電極用ペーストを印刷した。さらに、空洞部を形成するための樹脂ペーストを塗布した。
 しかる後、上記補助電極用ペースト、第1,第2の放電電極用ペースト及び樹脂ペーストが印刷されたセラミックグリーンシートの上下に、マザーのセラミックグリーンシートを複数枚積層し、圧着した。このようにして、厚み0.3mmのマザーの積層体を得た。
 上記マザーの積層体を厚み方向に切断し、個々のESD保護装置単位のセラミック積層体を得た。このようにして、1.0mm×0.5mm×厚み0.3mmのセラミック積層体を得た。しかる後、外部電極を形成するための導電ペーストをセラミック積層体の両端面に塗布した。
 次に、上記セラミック積層体を窒素ガス中で焼成し、ESD保護装置1を得た。すなわち、セラミック積層体を焼成し、セラミック多層基板2を得るとともに、樹脂ペーストを消失させ空洞部3を形成した。また焼成により、補助電極用ペースト及び放電電極用ペーストを焼き付け、補助電極6及び第1,第2の放電電極4,5を形成した。
 上記のようにして、ESD保護装置を作成した。
 なお、放電電極用ペーストとしては、上述した表1に記載のペーストナンバー1~10をそれぞれ用い、試料番号1~10のESD保護装置を作成した。
 上記のようにして得たESD保護装置各100個につき、放電応答性を評価した。すなわち、IDC61000-4-2に定められている静電気放電イミュニティ試験により、放電応答性を評価した。保護回路側で検出されたピーク電圧の大きさに応じて、下記の評価記号により判定した。結果を下記の表2に示す。
 △:ピーク電圧が700V以上、放電応答性が良好
 ○:ピーク電圧が500V以上700V未満、放電応答性がより良好
 ◎:ピーク電圧が500V未満、放電応答性が特に良好
 また、セラミックグリーンシートに第1,第2の放電電極を形成するための放電電極用ペーストを印刷した後、放電電極間のギャップの寸法を実際に6カ所で測定し、平均値を求めた。すなわち、設計値が30μmであるのに対し、実際に印刷された印刷後ギャップの寸法を求めた。結果を下記の表2に示す。
 さらに、焼成後に最終的に得られたESD保護装置各10個を抜き取り、研磨により放電部を露出させた。露出した放電電極間のギャップを測定した。10個のギャップの平均値及び最大値を求めた。結果を下記の表2に示す。
Figure JPOXMLDOC01-appb-T000002
 表2から明らかなように、Alを含有させない場合に比べ、Alを含有させることにより、ギャップの拡大を抑制し、しかも放電応答性を高め得ることができる。なお、Al粉末は、Cu粉末とAl粉末の合計100重量%中、2~15重量%の範囲であることがより望ましいことがわかる。これは、この範囲内であれば、収縮を抑制して放電応答性を高め、さらに絶縁物であるAlの含有割合が多くなりすぎないため、放電応答性が良好であるためと考えられる。
1…ESD保護装置
2…セラミック多層基板
3…空洞部
4,5…放電電極
4a,5a…先端
6…補助電極
6a…金属粒子
6b…半導体セラミック粒子
10…下部シール層
11…上部シール層
12…第1の外部電極
13…第2の外部電極

Claims (7)

  1.  セラミック多層基板と、
     前記セラミック多層基板のある高さ位置において、先端同士が対向するように設けられた第1,第2の放電電極とを備え、
     前記第1,第2の放電電極が、金属と、セラミック多層基板を得るための焼成時の温度における収縮率が該金属よりも小さい収縮抑制材料とを含む、ESD保護装置。
  2.  前記収縮抑制材料が、前記第1,第2の放電電極に含有されている金属よりも焼結温度が高い無機物質からなる、請求項1に記載のESD保護装置。
  3.  前記収縮抑制材料が、半導体である、請求項1または2に記載のESD保護装置。
  4.  前記収縮抑制材料が絶縁性材料である、請求項1または2に記載のESD保護装置。
  5.  前記第1の放電電極と前記第2の放電電極とに連なるように前記セラミック多層基板内に配置されている補助電極をさらに備え、該補助電極が、絶縁性材料によりコーティングされた導電性材料を含む、請求項1~4のいずれか1項に記載のESD保護装置。
  6.  前記補助電極が、セラミック材料をさらに含む、請求項5に記載のESD保護装置。
  7.  前記セラミック材料が、半導体セラミックスである、請求項6に記載のESD保護装置。
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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7031678B2 (ja) 2017-09-20 2022-03-08 株式会社村田製作所 セラミック基板の製造方法、セラミック基板、及び、モジュール

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002260812A (ja) * 2001-02-28 2002-09-13 Mitsubishi Materials Corp サージアブソーバの製造方法及びサージアブソーバ
JP2007317542A (ja) * 2006-05-26 2007-12-06 Mitsubishi Materials Corp サージアブソーバ
JP2011243492A (ja) * 2010-05-20 2011-12-01 Murata Mfg Co Ltd Esd保護デバイス及びその製造方法

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5594613A (en) * 1992-10-09 1997-01-14 Cooper Industries, Inc. Surge arrester having controlled multiple current paths
WO2008146514A1 (ja) 2007-05-28 2008-12-04 Murata Manufacturing Co., Ltd. Esd保護デバイス
WO2009098944A1 (ja) * 2008-02-05 2009-08-13 Murata Manufacturing Co., Ltd. Esd保護デバイス
KR101199681B1 (ko) 2008-05-08 2012-11-08 가부시키가이샤 무라타 세이사쿠쇼 Esd 보호 기능 내장 기판
WO2011145598A1 (ja) * 2010-05-20 2011-11-24 株式会社村田製作所 Esd保護デバイス
JP5459295B2 (ja) * 2011-03-14 2014-04-02 株式会社村田製作所 Esd保護デバイスおよびその製造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002260812A (ja) * 2001-02-28 2002-09-13 Mitsubishi Materials Corp サージアブソーバの製造方法及びサージアブソーバ
JP2007317542A (ja) * 2006-05-26 2007-12-06 Mitsubishi Materials Corp サージアブソーバ
JP2011243492A (ja) * 2010-05-20 2011-12-01 Murata Mfg Co Ltd Esd保護デバイス及びその製造方法

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