WO2010095348A1 - 表示装置及び駆動装置 - Google Patents

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WO2010095348A1
WO2010095348A1 PCT/JP2010/000237 JP2010000237W WO2010095348A1 WO 2010095348 A1 WO2010095348 A1 WO 2010095348A1 JP 2010000237 W JP2010000237 W JP 2010000237W WO 2010095348 A1 WO2010095348 A1 WO 2010095348A1
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source bus
switch
source
bias
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PCT/JP2010/000237
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水巻秀隆
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シャープ株式会社
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Definitions

  • the present invention relates to a drive device for a display device such as a liquid crystal display device, and a display device including the drive device. More specifically, the present invention reduces an inrush current generated at the time of polarity reversal in an active matrix liquid crystal display device.
  • the present invention relates to a drive device and a liquid crystal display device that can be operated.
  • FIG. 12 is a block configuration of a TFT (Thin Film Transistor) type liquid crystal display device which is a typical example of an active matrix type disclosed in Patent Document 1.
  • TFT Thin Film Transistor
  • the liquid crystal display device 900 includes a liquid crystal display unit and a liquid crystal driving device that drives the liquid crystal display unit.
  • the liquid crystal display unit is a TFT liquid crystal panel 901 provided with a liquid crystal display element (not shown) and a counter electrode (common electrode) 906.
  • the liquid crystal driving device includes a source driver 902 and a gate driver 903, each composed of an IC (Integrated Circuit), a controller 904, and a liquid crystal driving power source 905 that supplies a liquid crystal panel display voltage to the source driver 902 and the gate driver 903. It has.
  • the controller 904 outputs the digitized display data D (for example, RGB signals corresponding to red, green, and blue) and various control signals to the source driver 902, and outputs various control signals to the gate driver 903. is doing.
  • the main control signals to the source driver 902 include a horizontal synchronization signal, a start pulse signal, a source driver clock signal, and the like, which are indicated by S1 in the drawing.
  • main control signals to the gate driver 903 include a vertical synchronization signal and a gate driver clock signal, which are indicated by S2 in the drawing.
  • a power source for driving each IC is omitted.
  • the source driver 902 latches the digital display data D input through the controller 904 in a time-sharing manner, and then synchronizes with a horizontal synchronization signal (also referred to as a latch signal LS) input from the controller 904. Perform digital-to-analog conversion. Then, the source driver 902 drives the liquid crystal drive from the liquid crystal drive voltage output terminal via the source bus line (not shown) from the analog voltage for gray scale display (gray scale display voltage) obtained by DA conversion. The voltage is output to a liquid crystal display element (not shown) in the liquid crystal panel 901 corresponding to the voltage output terminal.
  • a horizontal synchronization signal also referred to as a latch signal LS
  • the output stage of the source driver 902 includes an output circuit 828, a pulse width adjustment circuit 829, a switch circuit 830, and a 1 / n frequency dividing circuit 831 as shown in FIG.
  • the switch circuit 830 has an analog switch as shown in FIG. 13, and R between the output terminals is set based on the hold signal LSA output from the pulse width adjustment circuit 829 before outputting the liquid crystal applied voltage. , G and B for each color, and a switch 830a for short-circuiting, and an output terminal for separating the output terminal from the output circuit 828 and forcing the output terminal to a floating state. It is configured to enable charge sharing operation. Note that charge sharing is a type of pre-charging, in which the source bus line is pre-charged in a subsequent horizontal period using charges accumulated in the source bus line in a certain horizontal period.
  • Pre-charging means pre-charging in which a voltage is applied to the source bus line in advance before setting the potential of the source bus line to the source signal potential in the horizontal period, and by applying the voltage, The object is to reach a desired source signal potential at an earlier time.
  • Japanese Patent Publication Japanese Patent Laid-Open No. 2005-208551 (published on August 4, 2005)”
  • noise is generated in the AM band at the inversion timing in dot inversion driving.
  • the noise is regarded as a problem as unnecessary radiation because it is a horizontal synchronization frequency component.
  • FIG. 14 compares the waveforms of the latch signal LS, the polarity inversion signal REV, and the source bus line current Is in the configuration of Patent Document 1.
  • FIG. 14 shows that an inrush current flows at the inversion timing. Specifically, it was found that inrush current flows at the rising timing and falling edge timing of the latch period (charge share period). Analyzing these two inrush currents, one inrush current is that the switch 830a shown in FIG.
  • the present invention has been made in view of the above problems, and a main object of the present invention is a driving device capable of reducing noise generated at the inversion timing in dot inversion driving even in the case of an in-vehicle module. And a display device including the driving device.
  • a first driving device is a driving device that drives a display unit by applying a voltage to a picture element of a display unit of the display device in order to solve the above-described problem.
  • the output circuit for applying a voltage to the picture element every horizontal period at the source signal potential, which is the potential applied to the source bus line, and the connection between the output circuit and the source bus line are disconnected.
  • a first source bus line that is a source bus line having a positive source signal potential and a second source bus line that is a source bus line having a negative source signal potential are connected to each other.
  • a switch circuit having a switch wherein the switch circuit connects the first source bus line and the second source bus line to each other by the switch.
  • the drive device includes the switch circuit provided with the current suppression element for suppressing the current generated due to the potential difference between the source bus lines connected to each other. Therefore, it is possible to suppress the inrush current generated in the source bus line at the inversion timing in the dot inversion driving, that is, at the time of charge transfer between the source bus line and the source bus line of the same color pixel of the adjacent pixel. It becomes. Therefore, by mounting the drive device according to the present invention on a display device, it is possible to provide a display device in which noise caused by inrush current is reduced.
  • the source bus lines of the same color picture elements of adjacent pixels are in a reverse polarity relationship, and by providing a switch circuit, the respective lines are charged before the polarity inversion. It is configured to cancel out the charged charges.
  • this switch circuit can only cancel the charges charged in each other before polarity inversion, the source bus line of the same color pixel of the adjacent pixel is turned on by the switch. At this time, an inrush current corresponding to the potential difference between the two lines is generated, and the above-described problem occurs.
  • the drive device when the current suppression element having the above-described configuration is provided in the switch circuit, the source bus line of the same color pixel of the adjacent pixel is turned on by the switch. It is possible to limit the current flowing between both lines by the current suppressing element, and the generation of this inrush current can be suppressed.
  • “equal” includes not only the case where they are completely equal, but also the case where the potentials of the two lines are substantially equal to the extent that a problem caused by the inrush current does not occur.
  • a second driving device is a driving device that drives a display unit by applying a voltage to a picture element of a display unit of the display device in order to solve the above problem.
  • the output circuit for applying a voltage to the picture element every horizontal period at the source signal potential, which is the potential applied to the source bus line, and the connection between the output circuit and the source bus line are disconnected.
  • a first source bus line that is a source bus line having a positive source signal potential and a second source bus line that is a source bus line having a negative source signal potential are connected to each other.
  • a switch circuit having a switch further comprising bias control means for suppressing a bias current of the output circuit, wherein the bias control means includes the bias control.
  • Stage is characterized by having a bias current control terminal which is an external connection terminal to be adjustable from outside the bias control signal to be supplied to the output circuit.
  • the driving device according to the present invention since the driving device according to the present invention includes the bias current control terminal, at the time of inversion in the dot inversion driving, that is, the source of the same color pixel of the pixel adjacent to the source bus line. It is possible to suppress an inrush current generated in the source bus line at the time of charge transfer with the bus line. Therefore, even when the drive device according to the present invention is mounted on a display device, it is possible to provide a display device in which noise caused by inrush current is significantly reduced.
  • the source bus lines of the same color picture elements of adjacent pixels are in a reverse polarity relationship, and by providing a switch circuit, the respective lines are charged before the polarity inversion. It is configured to cancel out the charged charges.
  • this switch circuit can cancel the charges charged in each other line before polarity inversion, while when the source bus line of the same color picture element of the adjacent pixel is turned on by the switch, An inrush current corresponding to the potential difference is generated, and the above-described problem occurs. Therefore, the drive device according to the present invention can suppress the occurrence of the inrush current by providing the bias control means for suppressing the bias current of the output circuit.
  • the bias control means by providing the bias control means, the current supplied from the bias control means to the output circuit is reduced, and the bias current of the output circuit is adjusted to be small. As a result, the output slew rate of the output circuit can be reduced, and the occurrence of inrush current can be suppressed even when the source bus line of the same color picture element of the adjacent pixel is turned on by the switch.
  • the bias control means has a bias current control terminal which is an external connection terminal that allows adjustment of a bias control signal given to the output circuit by the bias control means.
  • EMI unnecessary radiation
  • a display device driven by a driving device having the above-described configuration is also included in the scope of the present invention.
  • the first driving device is a driving device that drives the display unit by applying a voltage to the picture element of the display unit of the display device, and the source is based on the display data signal.
  • the output circuit for applying a voltage to the picture element every horizontal period at a source signal potential that is a potential applied to the bus line is disconnected from the output circuit and the source bus line, and the source circuit is connected during the same horizontal period.
  • a switch circuit having a switch for connecting a first source bus line, which is a source bus line having a positive signal potential, and a second source bus line, which is a source bus line having a negative source signal potential, to each other
  • the switch circuit includes the switch when the first source bus line and the second source bus line are connected to each other by the switch.
  • Current suppressing element for suppressing a current flowing through the switch is, is characterized in that it is connected in series with the switch.
  • the second drive device is a drive device that drives the display unit by applying a voltage to the picture element of the display unit of the display device, as described above, based on the display data signal.
  • the output circuit for applying a voltage to the picture element every horizontal period at a source signal potential that is a potential applied to the source bus line is disconnected from the output circuit and the source bus line, and in the same horizontal period
  • a bias control unit that suppresses a bias current of the output circuit, and the bias control unit is configured so that the bias control unit includes the output of the output circuit. It is characterized by having a bias current control terminal which is an external connection terminal that allows adjusting the bias control signal to be applied to road externally.
  • the inrush current described above can be suppressed, and noise can be reduced.
  • FIG. 4 is a circuit diagram of a switch circuit provided in the source driver shown in FIG. 3.
  • FIG. 5 is a diagram showing timing of the switch circuit shown in FIG. 4. It is a figure which shows the characteristic of the source driver shown in FIG. It is the figure which showed another form of the source driver with which the liquid crystal display device carrying the drive device concerning this invention is equipped. It is a figure which shows the characteristic of the source driver shown in FIG.
  • FIGS. 1 An embodiment of a drive device according to the present invention will be described below with reference to FIGS.
  • a liquid crystal display device will be described as an example of a display device
  • a liquid crystal driving device will be described as an example of a driving device.
  • the configuration of a liquid crystal display device equipped with a driving device according to the present invention will be described with reference to FIG.
  • FIG. 1 shows a block configuration of an active matrix type liquid crystal display device in the present embodiment.
  • Reference numeral 1 denotes a TFT liquid crystal panel (display unit)
  • 2 denotes a plurality of source drivers
  • 3 denotes a plurality of gate drivers
  • 4 denotes a control circuit
  • 5 denotes a liquid crystal driving power source.
  • the source driver 2, the gate driver 3, the control circuit 4, and the liquid crystal driving power source 5 constitute a liquid crystal driving device (driving device).
  • the control circuit 4 sends a horizontal synchronization signal to the source driver 2 and the gate driver 3.
  • Display data input from outside (here, display data separated into R, G, and B) is input to the source driver 2 as a digital signal via the control circuit 4.
  • the source driver 2 latches the input display data inside in a time-sharing manner, and then performs digital / analog conversion in synchronization with the horizontal synchronizing signal from the control circuit 4 and performs gradation display from the liquid crystal drive output terminal. An analog voltage is output.
  • the control circuit 4 may be configured to send a vertical synchronization signal to the gate driver 3.
  • FIG. 2 shows the configuration of the liquid crystal panel 1.
  • the liquid crystal panel 1 includes a picture element electrode 11, a liquid crystal capacitor 12, an auxiliary capacitor Cs, a TFT 13 as an element for turning on / off voltage application to the picture element, a source bus line 14, a gate bus line 15, and a counter electrode of the liquid crystal panel. 16 (corresponding to the counter electrode in FIG. 1) is provided.
  • a region indicated by A is a liquid crystal display element for one picture element.
  • the source bus line 14 is supplied with a gradation display voltage from the source driver 2 according to the brightness of the picture element to be displayed.
  • the gate bus line 15 is supplied with a scanning signal from the gate driver 3 so that the TFTs 13 arranged in the vertical direction are sequentially turned on.
  • the voltage of the source bus line 14 is applied to the pixel electrode 11 connected to the drain of the TFT 13 through the TFT 13 in the on state, charges are accumulated in the liquid crystal capacitor 12 between the pixel electrode 11 and the counter electrode 16. As a result, the light transmittance of the liquid crystal changes and display is performed.
  • the source driver 2 and the gate driver 3 provided in the liquid crystal driving device are in the form of COG (Tip On Glass), and are mounted on the ITO (Indium Tin Oxide) terminal of the liquid crystal panel. It is connected.
  • the present invention is not limited to this, and the source driver 2 and the gate driver 3 may be in the form of a TCP (Tape Carrier Package) in which the previous IC chip is mounted on a film with wiring.
  • TCP Transmission Carrier Package
  • FIG. 3 shows a block configuration of the source driver 2. Only the relevant source driver will be described here. Since a known gate driver is used, description thereof is omitted here.
  • the source driver includes a shift register 21, an input latch circuit 22, a sampling memory 23, a hold memory 24, a level shifter 25, a DA conversion circuit 26, a reference voltage generation circuit 27, an output circuit 28, and a bias control unit 29. (Bias control means) and a switch circuit 30 are provided.
  • the shift register 21 shifts the input start pulse SP in synchronization with the input clock signal CK. Control signals are output to the sampling memory 23 from each stage of the shift register 21.
  • the start pulse SP is a signal synchronized with the horizontal synchronizing signal LS of the data signal D (display data DR / DG / DB).
  • the start pulse SP shifted in the shift register 21 is input as the start pulse SP to the shift register 21 in the adjacent source driver, and is similarly shifted. Then, the data is transferred to the shift register in the source driver farthest from the control circuit 4.
  • the input latch circuit 22 temporarily latches each 6-bit display data DR, DG, DB, for example, which is serially input to the input terminals corresponding to the respective colors, and sends them to the sampling memory 23.
  • the sampling memory 23 uses display signals DR, DG, DB (R, G, B, 6 bits each) sent from the input latch circuit 22 in a time-sharing manner using output signals from each stage of the shift register 21. In this case, a total of 18 bits) is sampled, and the display data DR, DG, and DB are stored until the display data DR, DG, and DB for one horizontal synchronization period are obtained.
  • the hold memory 24 latches the input display data DR / DG / DB based on the latch signal LS.
  • the display data DR, DG, and DB are held until the next horizontal synchronization signal LS is input, and output to the level shifter 25.
  • the level shifter 25 is a circuit for converting the signal level of the display data DR / DG / DB by boosting or the like in order to adapt to the DA conversion circuit 26 of the next stage that processes the voltage level applied to the liquid crystal panel 1.
  • Display data D′ R, D′ G, and D′ B are output from the level shifter 25.
  • the reference voltage generation circuit 27 generates an analog voltage of 64 levels used for gradation display based on the reference voltage VR from the liquid crystal drive power supply 5 (see FIG. 1), and outputs the analog voltage to the DA conversion circuit 26.
  • the DA conversion circuit 26 selects one of 64 levels of voltage in accordance with 6-bit display data D′ R, D′ G, and D′ B (digital) for each of RGB input from the level shifter 25. The analog voltage is converted and output to the output circuit 28. The DA conversion circuit 26 selects one of the 64-level voltages input from the reference voltage generation circuit 27 by selecting switches corresponding to the 6-bit display data D′ R, D′ G, and D′ B, respectively. One will be selected.
  • the output circuit 28 is configured to change the analog signal selected by the DA conversion circuit 26 into a low impedance signal and output the signal to the switch circuit 30 and is configured by a circuit called a buffer or a voltage follower.
  • the bias control unit 29 corresponds to a control unit that determines the current output capability of the output circuit 28, and outputs a bias control signal to the output circuit 28.
  • the bias control unit 29 includes NPN transistors Tr1, Tr2, and Tr3.
  • the base of the transistor Tr1 is connected to the power supply Vcc
  • the collector of the Tr1 is connected to the power supply Vcc
  • the emitter of the transistor Tr1 is connected to the bases of the transistors Tr2 and Tr3.
  • the collector of the transistor Tr2 is connected to the power supply Vcc, and the emitter of Tr2 is grounded.
  • the collector of the transistor Tr3 is connected to the power supply Vcc, and the emitter of Tr3 is grounded.
  • the output terminal 29b of the bias controller 29 is provided between the collector of the transistor Tr3 and the power supply Vcc.
  • FIG. 4 is a circuit diagram of the switch circuit 30 and includes the configuration around the switch circuit 30 for convenience of explanation.
  • FIG. 4 shows only a circuit for two output terminals.
  • the switch circuit 30 has an analog switch, and before outputting the liquid crystal application voltage, based on the latch signal LS, between the (two) source bus lines of the same color picture elements of adjacent pixels.
  • a connection switch 31a connected to each other, and a disconnect switch 31b that disconnects the output terminal from the output circuit 28 and puts the output terminal into a floating state, and charges (two) source bus lines of the same color picture elements of adjacent pixels
  • a resistor (current suppressing element) 32 connected in series with the connection switch 31a is provided.
  • a source bus line having a positive source signal potential and a source bus line having a negative source signal potential exist (that is, basically dot inversion driving).
  • Such source bus lines are connected to each other. Accordingly, the precharging operation can be assisted by positive and negative charges existing on the data line of the liquid crystal panel. That is, the liquid crystal driving power can be reduced by utilizing the residual charges in the liquid crystal panel.
  • FIG. 5 is a timing chart for explaining the timing of the switch circuit 30.
  • a period between t1 and t3 is a high period of the latch signal LS.
  • the source bus line A and the source bus line B in FIG. 5 are arbitrary source bus lines in which the directions of the electric fields applied to the liquid crystal are opposite to each other in the dot inversion driving, and correspond to the latch signal LS. The source signal potentials of these source bus lines are shown.
  • time t1 is the start time of one horizontal period.
  • the latch signal LS is at a low level, the disconnect switch 31b is in a closed state (on), and the connection switch 31a is in an open state (off).
  • the horizontal period start time t1 is set to coincide with the rising edge of the latch signal LS.
  • the latch signal LS is switched to the high level “H”, the disconnect switch 31b is turned off, and the connection switch 31a is turned on.
  • the disconnect switch 31b is turned off, the output circuit 28 and the output terminal are electrically disconnected, and when the connection switch 31a is turned on, the source bus lines are electrically connected. At this time, the charge is transferred between the source bus lines.
  • time t2 the time passes (time t2).
  • the source bus line A and the source bus line B have the same potential.
  • the time from time t1 to time t2 is a charge / discharge time determined by the load capacity, and is determined by the size of the load capacity.
  • the source driver since the charge moves between the source bus lines between t1 and t2, the source driver does not consume power.
  • the latch signal LS is switched to the low level “L”, the disconnection switch 31b is turned on, and the connection switch 31a is turned off.
  • the circuit 28 charges and discharges the charge of the load capacity of the source bus line, and power is consumed.
  • time t4 the signal potentials of the source bus line A and the source bus line B are set to desired potentials (source signal potentials).
  • the time from time t3 to time t4 is a charge / discharge time determined by the load capacity, and is determined by the size of the load capacity.
  • FIG. 6 shows the waveforms of the latch signal LS, the polarity inversion signal REV, and the source bus line current Is in comparison.
  • FIG. 6 also shows the source bus line current Is of the source driver having the conventional configuration shown in FIG.
  • the occurrence of the inrush current is suppressed at the rising timing of the latch period (charge share period) in which the inrush current has occurred in the conventional configuration. This is because the current at the moment when the source bus line of the same color pixel of the adjacent pixel is turned on by the switch can be suppressed to the value of (potential difference between both lines) / (resistance value of the resistor) by the resistor 32. It is because.
  • the liquid crystal display device 10 (FIG. 1) of the present embodiment can reduce noise generated in the AM band at the inversion timing in the dot inversion driving.
  • the present invention is not limited to this, and an electric field that is known as a MOS resistor or the like, in which the voltage applied to the gate is adjusted. It may be an effect transistor. Thereby, the resistance between the source and drain (here, channel resistance) of the field effect transistor can be adjusted, and the same effect as the above-described resistor 32 can be obtained.
  • FIG. 7 shows a circuit diagram of the bias control unit 29, and for the sake of convenience of explanation, the configuration around the bias control unit 29 is also shown.
  • the resistor 32 is connected in series with the connection switch 31a of the switch circuit 30.
  • the source driver 2 of the liquid crystal driving device of the present embodiment does not have the resistor 32 provided in the switch circuit 30 of the first embodiment as shown in FIG.
  • a bias control resistor 33 is connected to the bias control terminal 29 a of the unit 29. Further, the bias control resistor 33 is exposed to the outside of the bias control unit 29, and specifically, is located on the control circuit 4.
  • the bias controller 29 includes NPN transistors Tr1, Tr2, Tr3.
  • the base of the transistor Tr1 is connected to the power supply Vcc via the bias control resistor 33, the collector of Tr1 is connected to the power supply Vcc, and the emitter of the transistor Tr1 is connected to the bases of the transistors Tr2 and Tr3.
  • the collector of the transistor Tr2 is connected to the power supply Vcc via the bias control resistor 33, and the emitter of Tr2 is grounded.
  • the collector of the transistor Tr3 is connected to the power supply Vcc, and the emitter of Tr3 is grounded.
  • the output terminal 29b of the bias controller 29 is provided between the collector of the transistor Tr3 and the power supply Vcc.
  • bias control resistor 33 By adding a resistor (bias control resistor 33) to the bias control terminal 29a of the bias control unit 29, in order to determine the bias current of the output circuit 28, specifically, the output slew rate in the output circuit 28.
  • the current on the output side of the transistor provided to function as a current source of the differential pair can be controlled.
  • FIG. 8 shows the effect of the bias control resistor 33.
  • FIG. 8 shows the waveforms of the latch signal LS, the polarity inversion signal REV, and the source bus line current Is in comparison. 8 also shows the source bus line current Is of the source driver of the conventional configuration shown in FIG. 14 for comparison, as in FIG. 6 of the first embodiment.
  • the source bus line current Is in the present embodiment is inverted in polarity when the separation switch 830b (FIG. 13) is turned on at the falling timing of the latch period (charge share period) in the conventional configuration. Generation of an inrush current flowing due to the supply of the source signal is suppressed.
  • the bias control resistor 33 shown in FIG. 7 the current supplied from the output terminal 29 b of the bias control unit 29 to the output circuit 28 is reduced, and the bias current of the output circuit 28 is adjusted to be small. This is because the slew rate of the output of the output circuit 28 can be reduced.
  • the size of the resistor (bias control resistor 33) can be varied to increase the bias current of the output circuit 28. Can be adjusted.
  • the liquid crystal display device According to the configuration of the present embodiment, it is possible to effectively suppress the inrush current that occurs at the falling timing of the latch period (charge share period) in the conventional configuration. Thereby, the liquid crystal display device according to the present embodiment can reduce noise generated in the AM band at the inversion timing in the dot inversion driving.
  • FIG. 9 shows a circuit diagram of the bias control unit 29 and the switch circuit 30, and for the sake of convenience of description, the peripheral configuration is also included.
  • the resistor 32 is connected in series with the connection switch 31a of the switch circuit 30.
  • the source driver 2 of the liquid crystal driving device of the present embodiment has a bias applied to the bias control terminal 29a of the bias control unit 29 in addition to the resistor 32 provided in the switch circuit 30, as shown in FIG. A control resistor 33 is connected. Further, the bias control resistor 33 is exposed to the outside of the bias control unit 29, and specifically, is located on the control circuit 4.
  • bias control resistor 33 By connecting a resistor (bias control resistor 33) to the bias control terminal 29a of the bias control unit 29, the bias current of the output circuit 28, specifically, the current on the output side of the transistor provided in the output circuit 28 is obtained. Can be controlled. Since the specific configuration of the bias control unit 29 is the same as that of the second embodiment, description thereof is omitted here.
  • FIG. 10 shows the effect produced by the provision of the resistor 32 of the switch circuit 30 and the bias control resistor 33 of the bias controller 29.
  • FIG. 10 shows the waveforms of the latch signal LS, the polarity inversion signal REV, and the source bus line current Is in comparison. 10 also shows the source bus line current Is of the source driver having the conventional configuration shown in FIG. 14 for comparison, as in FIG. 6 of the first embodiment.
  • the source bus line current Is in this embodiment is suppressed from occurring at the rise and fall timings of the latch period (charge share period) in which the inrush current occurs in the conventional configuration. Yes.
  • the generation of the inrush current at the rise timing of the latch period can be suppressed because the current at the moment when the source bus line of the same color pixel of the adjacent pixel is turned on by the switch is set by the resistor 32 (the potential difference between the two lines). ) / (Resistance value of the resistor).
  • the generation of the inrush current at the falling timing of the latch period can be suppressed by supplying the bias control resistor 33 to the output circuit 28 from the output terminal 29b of the bias control unit 29. This is because the slew rate of the output of the output circuit 28 can be reduced by adjusting the bias current of the output circuit 28 to be small.
  • bias control resistor 33 is arranged on the control circuit 4, even after the driver is mounted, the magnitude of the resistor (bias control resistor 33) can be varied, and the bias current of the output circuit 28 can be changed. It is advantageous in that the size of can be adjusted.
  • the liquid crystal display device according to the present embodiment performs AM at the inversion timing in dot inversion driving. Noise generated in the band can be further reduced.
  • FIG. 11 is a circuit diagram of the switch circuit 30 and includes the peripheral configuration for the convenience of explanation.
  • connection switch 31a and the resistor 32 are arranged between the source bus lines of the same color picture elements of adjacent pixels.
  • the source driver 2 of the liquid crystal driving device of the present embodiment has two sets of connection switches 31a and resistors 32 (suppressors) in parallel between the source bus lines of the same color picture elements of adjacent pixels.
  • the resistors 32a and 32b of each set have different resistances.
  • a selection element 34 having an OR (logical sum) gate is provided in the source driver so that at least one of these sets can be selected. Note that LS1 and LS2 in FIG. 11 do not indicate different signals, but are described to distinguish input terminals for inputting LS signals.
  • the switch circuit 30 of the present embodiment includes two connection switches 31a-1 and 31a-2 connected in parallel between the source bus lines of the same color picture elements of adjacent pixels.
  • One connection switch 31a-1 is provided with a resistor 32a of 20 k ⁇ , for example, connected in series with the connection switch 31a-1.
  • the other connection switch 31a-2 is provided with a resistor 32b of 10 k ⁇ , for example, connected in series with the connection switch 31a-2.
  • the selection element 34 includes an input terminal 34a-1 for inputting LS1 which is a control signal for the connection switch 31a-1, an input terminal 34a-2 for inputting LS2 which is a control signal for the connection switch 31a-2, and a disconnecting switch 31b. And an output terminal 34b for outputting a signal for controlling.
  • the selection element 34 controls the separation switch 31b using LS1 and / or LS2 input from the input terminals 34a-1 and 34a-2.
  • the selection element 34 is configured to output High when at least one of a plurality of inputs is inputted, and to output Low when there is no High.
  • two types of resistors are inserted between the source bus lines AB.
  • the present invention is not limited to this, and three or more types of resistors are inserted in the same manner as described above. It is also possible to cope with any source bus resistance.
  • the first drive device is a drive device that drives the display unit by applying a voltage to the picture element of the display unit of the display device in order to solve the above-described problem.
  • An output circuit for applying a voltage to the picture element every horizontal period at a source signal potential that is a potential applied to the source bus line based on the display data signal, and a connection between the output circuit and the source bus line.
  • a first source bus line that is a source bus line having a positive source signal potential and a second source bus line that is a source bus line having a negative source signal potential are connected to each other in the same horizontal period.
  • a switch circuit having a switch for switching between the first source bus line and the second source bus line by the switch.
  • the current suppressing element for suppressing the current flowing through the switch when connected to the switch is connected in series to the switch, and in this configuration, the current suppressing element can be a resistor. .
  • the current at the moment when the source bus line of the same color pixel of the adjacent pixel is turned on by the switch is suppressed to the value of (potential difference between both lines) / (resistance value of resistance) by the resistance. be able to. Thereby, it is possible to suppress the occurrence of an inrush current at the rising timing of the latch period (charge share period).
  • the current suppression element may be a field effect transistor, and the current flowing through the switch may be suppressed by the channel resistance of the field effect transistor.
  • the first drive device further includes bias current control means for controlling the bias current of the output circuit, and the bias current control means includes the bias control means. It is preferable to have a bias current control terminal which is an external connection terminal that enables adjustment of a bias control signal applied to the output circuit from the outside.
  • the drive device includes the bias current control terminal in addition to the current suppression element, and thus more effectively suppress the inrush current generated in the source bus line. Is possible.
  • a resistor or a power source is connected to the terminal, and the bias control means outputs the output circuit.
  • the bias current of the output circuit can be reduced by reducing the current supplied to the output circuit, and the slew rate of the output of the output circuit can be reduced. Thereby, it is possible to suppress the occurrence of an inrush current at the falling timing of the latch period.
  • inrush current is generated at the rise of the latch period (charge share period) in which the inrush current occurs in the conventional configuration and at the timing of starting the output of the source signal from the source driver. Can be suppressed.
  • this bias current control terminal is arranged outside the driving device, it is possible to observe unnecessary radiation while viewing the display section after mounting a flexible substrate (FPC: Flexible Printed Circuit), a source driver, a gate driver, etc. ( It is possible to make adjustments while examining EMI).
  • FPC Flexible Printed Circuit
  • the first drive device includes a control board in addition to the above-described configuration, and the bias current control terminal is provided in the control board.
  • the bias current control terminal is mounted on the control board, it is possible to easily control the bias current even after the driver is mounted.
  • the first driving device includes a plurality of series circuits of the switch and the current suppressing element, the first source bus line and the second source bus line. Are provided in parallel with each other, and the current suppressing elements have different magnitudes for suppressing the current flowing through the switches connected in series, and the switches are controlled independently of each other. It is preferable that it is comprised so that.
  • a plurality of types of resistors can be realized between the source bus lines of the same color picture element of the adjacent pixel, and the source bus line of the same color picture element of the adjacent pixel is selected by the switch using the desired resistance.
  • the current at the moment of conduction can be suppressed.
  • a second driving device is a driving device that drives a display unit by applying a voltage to a picture element of a display unit of the display device in order to solve the above problem.
  • the output circuit for applying a voltage to the picture element every horizontal period at the source signal potential, which is the potential applied to the source bus line, and the connection between the output circuit and the source bus line are disconnected.
  • a first source bus line that is a source bus line having a positive source signal potential and a second source bus line that is a source bus line having a negative source signal potential are connected to each other.
  • a switch circuit having a switch further comprising bias control means for suppressing a bias current of the output circuit, wherein the bias control means includes the bias control.
  • the stage has a bias current control terminal which is an external connection terminal that allows adjustment of a bias control signal applied to the output circuit from the outside, and a resistor is connected to the bias current control terminal be able to.
  • a direct current directly inputted to the bias control means may be connected to the bias current control terminal.
  • the second drive device includes the control device including a control board, and the bias current control terminal is provided in the control board. preferable.
  • the drive device according to the present invention can be widely used as a drive device for a display device such as a liquid crystal display device, and can be suitably used for, for example, a vehicle-mounted module.

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Abstract

　本発明に係る液晶駆動装置は、出力回路（２８）、当該出力回路（２８）のバイアス電流を抑制するバイアス制御部（２９）、及び、隣接する画素の同色絵素のソースバスライン同士を互いに接続するスイッチ回路（３０）を備え、＜１＞ソースバスライン同士をスイッチによって互いに接続したときに当該スイッチに流れる電流を抑制するための抵抗を、スイッチ回路（３０）のスイッチに直列に接続させる構成、及び、＜２＞バイアス制御部（２９）が出力回路（２８）に与えるバイアス制御信号を外部から調節可能とするバイアス電流制御端子を設けた構成、の少なくとも何れかを採用する。これにより、ＡＭ帯域に発生するノイズを低減させることができる、表示装置用の駆動装置を提供する。

Description

表示装置及び駆動装置
　本発明は、液晶表示装置等の表示装置の駆動装置、及び、当該駆動装置を備えた表示装置に関し、より詳細には、アクティブマトリクス型の液晶表示装置において、極性反転時に発生する突入電流を低減させることが可能な駆動装置及び液晶表示装置に関する。
　図１２は、特許文献１に開示されているアクティブマトリクス型の代表例であるＴＦＴ（薄膜トランジスタ）方式の液晶表示装置のブロック構成である。
　この液晶表示装置９００は、液晶表示部と、それを駆動する液晶駆動装置とで構成されている。上記液晶表示部は、図示しない液晶表示素子と、対向電極（共通電極）９０６とが設けられたＴＦＴ方式の液晶パネル９０１である。一方、上記液晶駆動装置は、それぞれＩＣ（Integrated Circuit）からなるソースドライバ９０２およびゲートドライバ９０３と、コントローラ９０４と、ソースドライバ９０２およびゲートドライバ９０３へ液晶パネル表示用電圧を供給する液晶駆動電源９０５とを備えている。
　コントローラ９０４は、デジタル化された表示データＤ（例えば、赤、緑、青に対応するＲＧＢの各信号）および各種制御信号をソースドライバ９０２に出力すると共に、各種制御信号をゲートドライバへ９０３に出力している。ソースドライバ９０２ヘの主な制御信号は、水平同期信号、スタートパルス信号およびソースドライバ用クロック信号等があり、図中ではＳ１で示されている。一方、ゲートドライバ９０３ヘの主な制御信号は、垂直同期信号やゲートドライバ用クロック信号等があり、図中ではＳ２で示されている。尚、図中、各ＩＣを駆動するための電源は省略している。
　ソースドライバ９０２は、コントローラ９０４を介して入力されたデジタル表示データＤを時分割で内部にラッチし、その後、コントローラ９０４から入力される水平同期信号（ラッチ信号ＬＳとも言う）に同期してＤＡ（デジタル－アナログ）変換を行う。そして、ソースドライバ９０２は、ＤＡ変換によって得られた階調表示用のアナログ電圧（階調表示電圧）を、液晶駆動電圧出力端子から、ソースバスライン（図示せず）を介して、その液晶駆動電圧出力端子に対応した、液晶パネル９０１内の液晶表示素子（図示せず）へそれぞれ出力する。
　上記ソースドライバ９０２の出力段には、図１３に示すように、出力回路８２８、パルス幅調整回路８２９、スイッチ回路８３０および１／ｎ分周回路８３１を備えている。
　このうち上記スイッチ回路８３０は、図１３に示すように、アナログスイッチを有し、液晶印加電圧を出力する前に上記パルス幅調整回路８２９から出力されるホールド信号ＬＳＡに基づき、出力端子間をＲ、Ｇ、Ｂ同色毎にそれぞれ短絡するスイッチ８３０ａと、出力端子を出力回路８２８から切り離して出力端子を浮遊状態にする切り離しスイッチ８３０ｂとを備え、出力端子間をＲ、Ｇ、Ｂ同色毎にそれぞれチャージシェア動作が可能となるよう構成されている。なお、チャージシェアとは、予備充電の一種であり、ある水平期間にソースバスラインに貯まった電荷を利用して、その後の水平期間においてソースバスラインを予備充電することである。予備充電とは、ソースバスラインの電位をその水平期間のソース信号電位にする前に、予めソースバスラインに電圧を印加する予備充電を行うものであり、その電圧を印加しておくことで、より早い時期に所望のソース信号電位にまで到達させることを目的とするものである。
　図１３に示すスイッチ回路８３０においては、同一の水平期間において、ソース信号電位が正のソースバスラインと、ソース信号電位が負のソースバスラインとが存在する様態（すなわち、基本的にはドット反転駆動）であり、そのようなソースバスライン同士を短絡させている。これにより、液晶パネルのデータ線上に存在する正極性、負極性の電荷で予備充電動作を補助することができる。つまり、液晶パネル内の残留電荷を利用することで液晶駆動電力を低減することが可能となっている。
日本国公開特許公報「特開２００５－２０８５５１号公報（２００５年８月４日公開）」
　ところで、例えば車載用のモジュールの場合において、ドット反転駆動における反転タイミング時にＡＭ帯域にノイズが発生することが知られている。当該ノイズは、水平同期の周波数成分であることから不要輻射として問題視されている。
　本願発明者は、上述した特許文献１の構成において、ドット反転駆動における反転タイミング時に、すなわち、ソースバスラインと隣接する画素の同色絵素のソースバスラインとの電荷の受け渡し時にソースバスラインに突入電流が流れることに着目した。図１４は、特許文献１の構成における、ラッチ信号ＬＳと、極性反転信号ＲＥＶと、ソースバスライン電流Ｉｓとの波形を対比させたものである。図１４をみると、反転タイミングで、突入電流が流れていることがわかる。具体的には、ラッチ期間（チャージシェア期間）の立ち上がりのタイミングと、立ち下がりエッジのタイミングとにおいて、突入電流が流れていることがわかった。これら２回の突入電流を分析すると、一方の突入電流は、ラッチ期間（チャージシェア期間）の立ち上がり時に、図１３に示すスイッチ８３０ａがオンになり（切り離しスイッチ８３０ｂはオフ）、ソースバスライン同士が短絡することによって流れることがわかった。また、他方の突入電流は、ラッチ期間（チャージシェア期間）の立ち下がり時に、切り離しスイッチ８３０ｂがオンになり（スイッチ８３０ａはオフ）、極性の反転したソース信号が供給されることによって流れることがわかった。そして本願発明者は、これらの突入電流が、上記ノイズの原因であることを突き止めた。
　しかしながら、これまで、ラッチ期間（チャージシェア期間）の立ち上がりのタイミングで生じる突入電流の有用な除去（低減）手段、及び、立ち下がりエッジのタイミングで生じる突入電流の有用な除去（低減）手段のいずれも知られていない。
　本発明は、上記の問題に鑑みてなされたものであり、その主たる目的は、車載用のモジュールの場合であっても、ドット反転駆動における反転タイミング時に発生するノイズを低減させることができる駆動装置、及び当該駆動装置を備えた表示装置を提供することである。
　すなわち、本発明に係る第１の駆動装置は、上記の課題を解決するために、表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、上記スイッチ回路には、上記第１のソースバスラインと上記第２のソースバスラインとを上記スイッチによって互いに接続したときに、当該スイッチに流れる電流を抑制するための電流抑制素子が、当該スイッチに直列に接続されていることを特徴としている。
　上記の構成によれば、本発明に係る駆動装置は、互いに接続しているソースバスライン同士の電位差に因って生じる電流を抑制するための電流抑制素子が設けられているスイッチ回路を具備していることから、ドット反転駆動における反転タイミング時に、すなわち、ソースバスラインと隣接する画素の同色絵素のソースバスラインとの電荷の受け渡し時に、ソースバスラインに生じる突入電流を抑制することが可能となる。そのため、本発明に係る駆動装置を表示装置に搭載することにより、突入電流に起因するノイズを低減させた表示装置を提供することができる。
　具体的には、本発明に係る駆動装置は、隣接する画素の同色絵素のソースバスラインが反転極性の関係にあり、スイッチ回路を設けることによって、極性反転前に、互いのラインに充電された電荷を相殺することができるように構成されている。ここで仮に、このスイッチ回路が、極性反転前に、互いのラインに充電された電荷を相殺することができるだけのものであると、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した際、両ライン間の電位差に応じた突入電流が生じて、上述した問題が起こる。これに対して、本発明に係る駆動装置は、スイッチ回路に上記した構成を有する電流抑制素子が配設されていることにより、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した際、電流抑制素子によって両ライン間に流れる電流を制限することが可能となり、この突入電流の発生を抑制することができる。尚、ここで「等しい」とは、完全に等しい場合のほか、突入電流に因る問題が生じない程度に当該両ラインの電位が実質的に等しい場合も含まれる。
　また、本発明に係る第２の駆動装置は、上記の課題を解決するために、表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、上記出力回路のバイアス電流を抑制するバイアス制御手段を更に備えており、上記バイアス制御手段は、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有していることを特徴としている。
　上記の構成によれば、本発明に係る駆動装置は、バイアス電流制御端子を具備していることから、ドット反転駆動における反転タイミング時に、すなわち、ソースバスラインと隣接する画素の同色絵素のソースバスラインとの電荷の受け渡し時に、ソースバスラインに生じる突入電流を抑制することが可能となる。そのため、本発明に係る駆動装置を表示装置に搭載した場合であっても、突入電流に起因するノイズを著しく低減させた表示装置を提供することができる。
　具体的には、本発明に係る駆動装置は、隣接する画素の同色絵素のソースバスラインが反転極性の関係にあり、スイッチ回路を設けることによって、極性反転前に、互いのラインに充電された電荷を相殺することができるように構成されている。しかし、このスイッチ回路によって、極性反転前に、互いのラインに充電された電荷を相殺することができる一方、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した際、両ライン間の電位差に応じた突入電流が生じることになり、上述した問題が起こる。そこで、本発明に係る駆動装置は、上記出力回路のバイアス電流を抑制するバイアス制御手段が配設されていることにより、この突入電流の発生を抑制することができる。具体的には、上記バイアス制御手段が配設されていることにより、バイアス制御手段から出力回路に供給される電流が減少し、出力回路のバイアス電流が小さくなるように調整される。これにより、出力回路の出力のスルーレートを小さくすることができ、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した際にも、突入電流の発生を抑制することが可能となる。
　また、上記バイアス制御手段が、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有している。これにより、フレキシブル基板（ＦＰＣ：Flexible Printed Circuit）やソースドライバ、ゲートドライバ等の実装後に表示部を見ながら、あるいは不要輻射（ＥＭＩ）の検討を行ないながら、その調整を行なうことが可能となる。
　また上記の構成を具備する駆動装置によって駆動される表示装置も本発明の範疇に含まれる。
　本発明の他の目的、特徴、および優れた点は、以下に示す記載によって十分分かるであろう。また、本発明の利点は、添付図面を参照した次の説明で明白になるであろう。
　本発明に係る第１の駆動装置は、以上のように、表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、上記スイッチ回路には、上記第１のソースバスラインと上記第２のソースバスラインとを上記スイッチによって互いに接続したときに、当該スイッチに流れる電流を抑制するための電流抑制素子が、当該スイッチに直列に接続されていることを特徴としている。
　また、本発明に係る第２の駆動装置は、以上のように、表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、上記出力回路のバイアス電流を抑制するバイアス制御手段を更に備えており、上記バイアス制御手段は、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有していることを特徴としている。
　これにより、上述の突入電流を抑制することができ、ノイズを低減させることができるという効果を奏する。
本発明に係る駆動装置を搭載した液晶表示装置の一実施形態の構成を示した図である。 図１に示す液晶表示装置に具備される液晶パネルの構成を示した図である。 図１に示す液晶表示装置に具備されるソースドライバのブロック構成を示している。 図３に示すソースドライバに設けられたスイッチ回路の回路図を示している。 図４に示すスイッチ回路のタイミングを示す図である。 図３に示すソースドライバの特性を示す図である。 本発明に係る駆動装置を搭載した液晶表示装置に具備されるソースドライバの別の形態を示した図である。 図７に示すソースドライバの特性を示す図である。 本発明に係る駆動装置を搭載した液晶表示装置に具備されるソースドライバの更に別の形態を示した図である。 図９に示すソースドライバの特性を示す図である。 本発明に係る駆動装置を搭載した液晶表示装置に具備されるソースドライバの更に別の形態を示した図である。 従来技術を示す図である。 従来技術を示す図である。 従来技術を示す図である。
　〔実施の形態１〕
　本発明に係る駆動装置の一実施形態について、図１～図６を参照しつつ以下に説明する。本実施形態では、表示装置として液晶表示装置を例にとり、また、駆動装置として液晶駆動装置を例にとって説明する。まず、本発明に係る駆動装置を搭載した液晶表示装置の構成について、図１を参照して説明する。
　図１に、本実施形態における、アクティブマトリックス方式の液晶表示装置のブロック構成を示す。１はＴＦＴ方式の液晶パネル（表示部）を示し、２は複数のソースドライバを示し、３は複数のゲートドライバを示し、４はコントロール回路を示し、５は液晶駆動電源を示す。ソースドライバ２、ゲートドライバ３、コントロール回路４、及び、液晶駆動電源５が、液晶駆動装置（駆動装置）を構成している。
　上記コントロール回路４は、ソースドライバ２及びゲートドライバ３へ水平同期信号を送る。外部から入力された表示データ（ここでは、Ｒ、Ｇ、Ｂに分離された各表示データ）は、コントロール回路４を介してデジタル信号でソースドライバ２へ入力される。ソースドライバ２は、入力された表示データを時分割で内部にラッチし、その後、コントロール回路４からの水平同期信号に同期してデジタル／アナログ変換を行ない、液晶駆動出力端子から階調表示用のアナログ電圧を出力するようになっている。尚、コントロール回路４は、ゲートドライバ３へ垂直同期信号を送るように構成されていてもよい。
　＜液晶パネル＞
　図２は、液晶パネル１の構成を示している。液晶パネル１には、絵素電極１１、液晶容量１２、補助容量Ｃｓ、絵素への電圧印加をオン／オフする素子としてのＴＦＴ１３、ソースバスライン１４、ゲートバスライン１５、液晶パネルの対向電極１６（図１の対向電極に相当）が設けられている。図中、Ａで示す領域が１絵素分の液晶表示素子である。
　ソースバスライン１４には、ソースドライバ２から、表示対象の絵素の明るさに応じた階調表示電圧が与えられる。ゲートバスライン１５には、ゲートドライバ３から、縦方向に並んだＴＦＴ１３が順次オンするように走査信号が与えられる。オン状態のＴＦＴ１３を通して、該ＴＦＴ１３のドレインに接続された絵素電極１１にソースバスライン１４の電圧が印加されると、絵素電極１１と対向電極１６との間の液晶容量１２に電荷が蓄積され、液晶の光透過率が変化し、表示が行われる。
　＜液晶駆動装置＞
　液晶駆動装置に設けられているソースドライバ２及びゲートドライバ３は、ＣＯＧ（Tip On Glass）の形態をなしており、液晶パネルのＩＴＯ（Indium Tin Oxide；インジウムすず酸化膜）端子上に実装して接続されている。しかしながら、本発明はこれに限定されるものではなく、ソースドライバ２やゲートドライバ３は、配線のあるフィルム上に先のＩＣチップを搭載したＴＣＰ（Tape Carrier Package）の形態をなしていてもよい。あるいは、ＣＯＧ（Tip On Glass）の形態において、先のＩＣチップをＡＣＦ（Anisotropic Conductive Film；異方性導電膜）を介して直接、液晶パネルのＩＴＯ端子に熱圧着して実装し、接続する方法で構成されていてもよい。
　図３は、上記ソースドライバ２のブロック構成を示している。ここでは関連するソースドライバのみを説明する。ゲートドライバは公知のものを使用するので、ここでは説明を省略する。ソースドライバは、図３に示すように、シフトレジスタ２１、入力ラッチ回路２２、サンプリングメモリ２３、ホールドメモリ２４、レベルシフタ２５、ＤＡ変換回路２６、基準電圧発生回路２７、出力回路２８、バイアス制御部２９（バイアス制御手段）、及び、スイッチ回路３０を備えている。
　シフトレジスタ２１は、入力されるスタートパルスＳＰを、入力されるクロック信号ＣＫにて同期をとってシフトさせる。シフトレジスタ２１の各段からは、制御信号がサンプリングメモリ２３に出力される。尚、スタートパルスＳＰは、データ信号Ｄ（表示データＤＲ・ＤＧ・ＤＢ）の水平同期信号ＬＳと同期がとられた信号である。また、シフトレジスタ２１においてシフトされたスタートパルスＳＰは、隣のソースドライバにおけるシフトレジスタ２１にスタートパルスＳＰとして入力され、同様にシフトされる。そして、最もコントロール回路４から遠いソースドライバにおけるシフトレジスタまで転送される。
　入力ラッチ回路２２は、各色に対応した入力端子にそれぞれシリアルに入力される例えば各６ビットの表示データＤＲ・ＤＧ・ＤＢを一時的にラッチし、サンプリングメモリ２３に送る。
　サンプリングメモリ２３は、シフトレジスタ２１の各段からの出力信号を用いて、入力ラッチ回路２２から時分割して送られてくる表示データＤＲ・ＤＧ・ＤＢ（Ｒ・Ｇ・Ｂ各６ビットである場合は合計１８ビット）をサンプリングし、１水平同期期間分の表示データＤＲ・ＤＧ・ＤＢが揃うまで、各表示データＤＲ・ＤＧ・ＤＢを記憶している。
　ホールドメモリ２４は、ラッチ信号ＬＳに基づき、入力された表示データＤＲ・ＤＧ・ＤＢをラッチする。そして、表示データＤＲ・ＤＧ・ＤＢを、次の水平同期信号ＬＳが入力されるまでの間、保持し、レベルシフタ２５に出力する。
　レベルシフタ２５は、液晶パネル１への印加電圧レベルを処理する次段のＤＡ変換回路２６に適合させるため、表示データＤＲ・ＤＧ・ＤＢの信号レベルを昇圧等により変換する回路である。レベルシフタ２５からは、表示データＤ´Ｒ・Ｄ´Ｇ・Ｄ´Ｂが出力される。
　基準電圧発生回路２７は、液晶駆動電源５（図１参照）からの参照電圧ＶＲに基づき、階調表示に用いる６４レベルのアナログ電圧を発生させ、ＤＡ変換回路２６に出力する。
　ＤＡ変換回路２６は、レベルシフタ２５より入力されるＲＧＢそれぞれ６ビットの表示データＤ´Ｒ・Ｄ´Ｇ・Ｄ´Ｂ（デジタル）に応じて６４レベルの電圧の内の１つを選択することでアナログ電圧に変換して出力回路２８に出力する。ＤＡ変換回路２６は、６ビットの表示データＤ´Ｒ・Ｄ´Ｇ・Ｄ´Ｂに応じたスイッチをそれぞれ選択することにより、基準電圧発生回路２７から入力された６４レベルの電圧の内の１つを選択することとなる。
　出力回路２８は、ＤＡ変換回路２６により選択されたアナログ信号を低インピーダンス信号に変えて、スイッチ回路３０に出力するように構成されており、いわゆるバッファとかボルテージフォロワと呼ばれる回路によって構成されている。
　バイアス制御部２９は、出力回路２８の電流出力能力を決定する制御部に相当し、バイアス制御信号を出力回路２８に出力する。バイアス制御部２９は、ＮＰＮ型のトランジスタＴｒ１、Ｔｒ２、Ｔｒ３を備えている。トランジスタＴｒ１のベースは電源Ｖｃｃに接続され、Ｔｒ１のコレクタは電源Ｖｃｃに接続され、トランジスタＴｒ１のエミッタは、トランジスタＴｒ２、Ｔｒ３のベースに接続されている。トランジスタＴｒ２のコレクタは電源Ｖｃｃに接続され、Ｔｒ２のエミッタは接地されている。トランジスタＴｒ３のコレクタは電源Ｖｃｃに接続され、Ｔｒ３のエミッタは接地されている。バイアス制御部２９の出力端子２９ｂは、トランジスタＴｒ３のコレクタと電源Ｖｃｃとの間に設けられている。
　次に、スイッチ回路３０について、図４に基づいて説明する。図４は、スイッチ回路３０の回路図であり、説明の便宜上、当該スイッチ回路３０の周辺の構成も含めて示している。尚、図４では、２出力端子分の回路のみを示している。
　スイッチ回路３０は、図４に示すように、アナログスイッチを有し、液晶印加電圧を出力する前に、ラッチ信号ＬＳに基づき、隣接する画素の同色絵素の（２つの）ソースバスライン間を互いに接続する接続スイッチ３１ａと、当該出力端子を出力回路２８から切り離して出力端子を浮遊状態にする切り離しスイッチ３１ｂとを備えて互いに隣接する画素の同色絵素の（２つの）ソースバスラインにチャージシェア動作が可能となるよう構成されているのに加えて、接続スイッチ３１ａと直列に接続される抵抗（電流抑制素子）３２を備えている。
　ここでは、上述の通り、同一の水平期間において、ソース信号電位が正のソースバスラインとソース信号電位が負のソースバスラインとが存在する様態（すなわち、基本的にはドット反転駆動）であり、そのようなソースバスライン同士を互いに接続させる。これにより、液晶パネルのデータ線上に存在する正極性、負極性の電荷で予備充電動作を補助することができる。つまり、液晶パネル内の残留電荷を利用することで液晶駆動電力を低減することができる。
　スイッチ回路３０の接続スイッチ３１ａ及び切り離しスイッチ３１ｂの動作の詳細を図５に基づいて説明すれば、次の通りである。図５は、スイッチ回路３０のタイミングを説明するためのタイミング図であり、ｔ１～ｔ３の間がラッチ信号ＬＳのハイ期間である。図５のソースバスラインＡ及びソースバスラインＢは、ドット反転駆動における、液晶に印加される電界の方向が互いに逆方向になっている任意のソースバスラインであり、ラッチ信号ＬＳと対応させて、これらソースバスラインのソース信号電位を示している。
　図５中の時刻ｔ１が１水平期間の開始時期である。時刻ｔ１までは、ラッチ信号ＬＳがローレベルで、切り離しスイッチ３１ｂは閉状態（オン）、接続スイッチ３１ａは開状態（オフ）である。そして、まず、水平期間の開始時期ｔ１と、ラッチ信号ＬＳの立ち上がりとを一致させるように設定する。その結果、時刻ｔ１のタイミングで、ラッチ信号ＬＳがハイレベル"Ｈ"に切り換わり、切り離しスイッチ３１ｂはオフし、接続スイッチ３１ａはオンする。切り離しスイッチ３１ｂがオフすることにより、出力回路２８と出力端子とが電気的に切り離され、接続スイッチ３１ａがオンすることにより、ソースバスライン間が電気的に接続される。このとき、ソースバスライン間において電荷の移動が起こるが、接続スイッチ３１ａと直列に抵抗３２が接続されていることにより、接続スイッチ３１ａを流れる電流が抑制されて、ある時間が経つと（時刻ｔ２とする）でソースバスラインＡ及びソースバスラインＢの電位が同電位となる。時刻ｔ１から時刻ｔ２までの時間は、負荷容量で決定される充放電時間であり、負荷容量の大きさによって決まる。
　ここで、ｔ１～ｔ２間はソースバスライン間で電荷が移動するため、ソースドライバは電力消費しない。
　次に、時刻ｔ３のタイミングで、ラッチ信号ＬＳがローレベル"Ｌ"に切り換わり、切り離しスイッチ３１ｂはオンし、接続スイッチ３１ａはオフすることにより、時刻ｔ１までの回路状態と同じになり、出力回路２８がソースバスラインの負荷容量の電荷を充放電し、電力が消費され、ある時刻（時刻ｔ４とする）でソースバスラインＡ及びソースバスラインＢの信号電位は所望の電位（ソース信号電位）となる。時刻ｔ３から時刻ｔ４までの時間は、負荷容量で決定される充放電時間であり、負荷容量の大きさによって決まる。
　このようにして、
（ａ）：１水平期間の開始時期に、ソースバスラインとソースドライバとの切り離し
（ｂ）：（ａ）と同時に、ソースバスライン同士の接続
（ｃ）：（ｂ）の後、ソースバスライン同士の接続解除
（ｄ）：（ｃ）と同時に、ソースバスラインとソースドライバとの再接続
という処理が行われる。
　抵抗３２の効果について、図６を用いて説明する。図６は、ラッチ信号ＬＳと、極性反転信号ＲＥＶと、ソースバスライン電流Ｉｓとの波形を対比させて示したものである。尚、図６には、比較対照のため、図１４に示した従来構成のソースドライバのソースバスライン電流Ｉｓも併せて示す。
　図６に示すように、本実施形態におけるソースバスライン電流Ｉｓは、従来構成において突入電流が生じていたラッチ期間（チャージシェア期間）の立ち上がりのタイミングにおいて突入電流の発生が抑制されている。これは、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した瞬間の電流を、抵抗３２によって、（両ラインの電位差）／（抵抗の抵抗値）の値に抑制することができたことによるものである。
　以上のように、本実施形態の構成によれば、従来構成においてラッチ期間（チャージシェア期間）の立ち上がりのタイミングで生じていた突入電流を効果的に抑制することができる。これにより、本実施形態の液晶表示装置１０（図１）は、ドット反転駆動における反転タイミング時にＡＭ帯域に生じていたノイズを低減させることができる。
　尚、本実施形態では、スイッチ回路３０に抵抗３２を挿入する構成について説明したが、本発明はこれに限定されるものではなく、ＭＯＳ抵抗などとして知られる、ゲートの印加電圧が調節された電界効果トランジスタであってもよい。これにより、電界効果トランジスタのソース・ドレイン間抵抗（ここではチャネル抵抗）を調節することができ、上述した抵抗３２と同様の効果を奏することができる。
　〔実施の形態２〕
　本発明に係る他の実施形態について、図７及び図８に基づいて説明すれば以下の通りである。尚、本実施形態では、上記実施の形態１との相違点について説明するため、説明の便宜上、実施の形態１で説明した部材と同一の機能を有する部材には同一の部材番号を付し、その説明を省略する。
　図７は、バイアス制御部２９の回路図を示しており、説明の便宜上、当該バイアス制御部２９の周辺の構成も含めて示している。
　上記実施の形態１では、図４に示したように、スイッチ回路３０の接続スイッチ３１ａに直列になるように接続された抵抗３２を備えた構成である。これに対して、本実施形態の液晶駆動装置のソースドライバ２は、図７に示すように、実施の形態１のスイッチ回路３０に設けられている抵抗３２は無く、これに代えて、バイアス制御部２９のバイアス制御端子２９ａにバイアス制御抵抗３３が接続されている。更には、このバイアス制御抵抗３３が、バイアス制御部２９外部に露出しており、具体的には、コントロール回路４上に位置している。
　バイアス制御部２９は、ＮＰＮ型のトランジスタＴｒ１、Ｔｒ２、Ｔｒ３を備えている。トランジスタＴｒ１のベースは、バイアス制御抵抗３３を介して電源Ｖｃｃに接続され、Ｔｒ１のコレクタは、電源Ｖｃｃに接続され、トランジスタＴｒ１のエミッタは、トランジスタＴｒ２、Ｔｒ３のベースに接続されている。トランジスタＴｒ２のコレクタは、バイアス制御抵抗３３を介して電源Ｖｃｃに接続され、Ｔｒ２のエミッタは接地されている。トランジスタＴｒ３のコレクタは電源Ｖｃｃに接続され、Ｔｒ３のエミッタは接地されている。バイアス制御部２９の出力端子２９ｂは、トランジスタＴｒ３のコレクタと電源Ｖｃｃとの間に設けられている。
　バイアス制御部２９のバイアス制御端子２９ａに抵抗（バイアス制御抵抗３３）を付加することにより、出力回路２８のバイアス電流、具体的には、出力回路２８内部に、出力のスルーレートを決定するために差動対の電流源として機能するように設けられたトランジスタの出力側の電流を制御することができる。
　図８は、バイアス制御抵抗３３の効果を示したものである。図８は、ラッチ信号ＬＳと、極性反転信号ＲＥＶと、ソースバスライン電流Ｉｓとの波形を対比させて示したものである。尚、図８でも、実施の形態１の図６と同様に、比較対照のため、図１４に示した従来構成のソースドライバのソースバスライン電流Ｉｓも併せて示す。
　図８に示すように、本実施形態におけるソースバスライン電流Ｉｓは、従来構成においてラッチ期間（チャージシェア期間）の立ち下がりのタイミングで切り離しスイッチ８３０ｂ（図１３）がオンになって極性の反転したソース信号が供給されることによって流れる突入電流の発生が抑制されている。図７に示すバイアス制御抵抗３３が配設されたことによって、バイアス制御部２９の出力端子２９ｂから出力回路２８に供給される電流が減少し、出力回路２８のバイアス電流が小さくなるように調整されたことにより、出力回路２８の出力のスルーレートを小さくすることができることによる。
　また、特に、バイアス制御抵抗３３をコントロール回路４上に配置することにより、ドライバ実装後であっても、抵抗（バイアス制御抵抗３３）の大きさを可変させて、出力回路２８のバイアス電流の大きさを調整することができる。
　本実施形態の構成によれば、従来構成においてラッチ期間（チャージシェア期間）の立ち下がりのタイミングで生じていた突入電流を効果的に抑制することができる。これにより、本実施形態の液晶表示装置は、ドット反転駆動における反転タイミング時にＡＭ帯域に生じていたノイズを低減させることができる。
　〔実施の形態３〕
　本発明に係る他の実施形態について、図９及び図１０に基づいて説明すれば以下の通りである。尚、本実施形態では、上記実施の形態１との相違点について説明するため、説明の便宜上、実施の形態１で説明した部材と同一の機能を有する部材には同一の部材番号を付し、その説明を省略する。
　図９は、バイアス制御部２９及びスイッチ回路３０の回路図を示しており、説明の便宜上、これらの周辺の構成も含めて示している。
　上記実施の形態１では、図４に示したように、スイッチ回路３０の接続スイッチ３１ａに直列になるように接続された抵抗３２を備えた構成である。これに対して、本実施形態の液晶駆動装置のソースドライバ２は、図９に示すように、スイッチ回路３０に設けられている抵抗３２に加えて、バイアス制御部２９のバイアス制御端子２９ａにバイアス制御抵抗３３が接続されている。また、このバイアス制御抵抗３３は、バイアス制御部２９外部に露出しており、具体的には、コントロール回路４上に位置している。
　バイアス制御部２９のバイアス制御端子２９ａに抵抗（バイアス制御抵抗３３）を接続することにより、出力回路２８のバイアス電流、具体的には、出力回路２８内部に設けられたトランジスタの出力側の電流を制御することができる。バイアス制御部２９の具体的な構成は、上記実施の形態２と同様であるため、ここでは説明を省略する。
　図１０は、スイッチ回路３０の抵抗３２と、バイアス制御部２９のバイアス制御抵抗３３とが配設されていることにより奏する効果を示したものである。図１０は、ラッチ信号ＬＳと、極性反転信号ＲＥＶと、ソースバスライン電流Ｉｓとの波形を対比させて示したものである。尚、図１０でも、実施の形態１の図６と同様に、比較対照のため、図１４に示した従来構成のソースドライバのソースバスライン電流Ｉｓも併せて示す。
　図１０に示すように、本実施形態におけるソースバスライン電流Ｉｓは、従来構成において突入電流が生じていたラッチ期間（チャージシェア期間）の立ち上がり及び立ち下がりのタイミングにおいて突入電流の発生が抑制されている。ラッチ期間の立ち上がりのタイミングにおいて突入電流の発生を抑制することができるのは、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した瞬間の電流を、抵抗３２によって、（両ラインの電位差）／（抵抗の抵抗値）の値に抑制することができるためである。また、ラッチ期間の立ち下がりのタイミングにおいて突入電流の発生を抑制することができるのは、バイアス制御抵抗３３が配設されたことによって、バイアス制御部２９の出力端子２９ｂから出力回路２８に供給される電流が減少し、出力回路２８のバイアス電流が小さくなるように調整されたことにより、出力回路２８の出力のスルーレートを小さくすることができることによる。
　また、特に、バイアス制御抵抗３３がコントロール回路４上に配置されていることにより、ドライバ実装後であっても、抵抗（バイアス制御抵抗３３）の大きさを可変させて、出力回路２８のバイアス電流の大きさを調整することができる点で有利である。
　本実施形態の構成によれば、抵抗３２及びバイアス制御抵抗３３を具備することにより、従来構成においてラッチ期間（チャージシェア期間）の立ち上がりのタイミングで生じていた突入電流、及び立ち下がりのタイミングで生じていた突入電流を双方とも抑制することができる。そのため、上述した実施の形態１及び実施の形態２と比較して、突入電流の発生を効果的に抑制することができるため、本実施形態の液晶表示装置は、ドット反転駆動における反転タイミング時にＡＭ帯域に生じていたノイズをよい一層低減させることができる。
　〔実施の形態４〕
　本発明に係る他の実施形態について、図１１に基づいて説明すれば以下の通りである。尚、本実施形態では、上記実施の形態１との相違点について説明するため、説明の便宜上、実施の形態１で説明した部材と同一の機能を有する部材には同一の部材番号を付し、その説明を省略する。
　図１１は、スイッチ回路３０の回路図を示しており、説明の便宜上、周辺の構成も含めて示している。
　上記実施の形態１では、図４に示したように、隣接する画素の同色絵素のソースバスラインの間に、接続スイッチ３１ａと抵抗３２とのセットが１セット配設された構成であったのに対して、本実施形態の液晶駆動装置のソースドライバ２は、隣接する画素の同色絵素のソースバスラインの間に、接続スイッチ３１ａ及び抵抗３２（抑制体）のセットが並列に２つ配設されており、各セットの抵抗３２ａ・３２ｂ同士は互いに抵抗の大きさが異なった構成となっている。また、本実施形態では、これらのセットのうちの少なくとも一方を選択することができるように、ソースドライバ内に、ＯＲ(論理和)ゲートを有する選択素子３４が設けられている。尚、図１１中のＬＳ１及びＬＳ２は異なる信号を示しているのではなく、ＬＳ信号を入力する入力端子を区別するために記載している。
　具体的には、本実施形態のスイッチ回路３０には、隣接する画素の同色絵素のソースバスラインの間に、並列に接続された２つの接続スイッチ３１ａ－１、３１ａ－２があり、その一方の接続スイッチ３１ａ－１には、当該接続スイッチ３１ａ－１と直列になるように接続された例えば２０ｋΩの抵抗３２ａが設けられている。また、他方の接続スイッチ３１ａ－２には、当該接続スイッチ３１ａ－２と直列になるように接続された例えば１０ｋΩの抵抗３２ｂが設けられている。
　選択素子３４は、接続スイッチ３１ａ－１の制御信号であるＬＳ１を入力する入力端子３４ａ－１と、接続スイッチ３１ａ－２の制御信号であるＬＳ２を入力する入力端子３４ａ－２と、切り離しスイッチ３１ｂを制御する信号を出力する出力端子３４ｂとを有している。選択素子３４は、入力端子３４ａ－１、３４ａ－２から入力したＬＳ１及び／またはＬＳ２を用いて、切り離しスイッチ３１ｂを制御している。具体的には、選択素子３４は、複数の入力のうち１つでもＨｉｇｈが入力されればＨｉｇｈを出力し、１つもＨｉｇｈが無ければＬｏｗを出力するように構成されている。図１１では、ＬＳ１がＬｏｗ（ＧＮＤ）、ＬＳ２がＨｉｇｈであるので、出力はＨｉｇｈとなり、その出力が切り離しスイッチ３１ｂに入力される（切り離しスイッチ３１ｂをオフにする信号）。ＬＳ１がＬｏｗであるので抵抗３２ａと直列の接続スイッチ３１ａ－１は開状態（オフ）し、ＬＳ２がＨｉｇｈであるので抵抗３２ｂと直列の接続スイッチ３１ａ－２は閉状態（オン）となる。抵抗３２ｂと直列の接続スイッチ３１ａ－２を使用する場合には、ＬＳ１をＨｉｇｈ、ＬＳ２をＬｏｗ（ＧＮＤ）にする。切り離しスイッチ３１ｂをＯＮにする場合には、ＬＳ１・ＬＳ２の両方をＬｏｗにする。また、ＬＳ１・ＬＳ２の両方をＨｉｇｈにすることによって、接続スイッチ３１ａ－１、３１ａ－２を双方とも使用することも可能であり、これにより、それぞれ１つずつの抵抗を用いるよりも低い抵抗を実現することもできる。
　尚、本実施形態では、２種類の抵抗をソースバスラインＡＢ間に挿入しているが、本発明はこれに限定されるものではなく、３種類以上の抵抗を上記と同様の形態で挿入することも可能であり、このように構成することにより、あらゆるソースバス抵抗に対応可能となる。
　以上のように、本発明に係る第１の駆動装置は、上記の課題を解決するために、表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、上記スイッチ回路には、上記第１のソースバスラインと上記第２のソースバスラインとを上記スイッチによって互いに接続したときに、当該スイッチに流れる電流を抑制するための電流抑制素子が、当該スイッチに直列に接続されていることを特徴としており、この構成において上記電流抑制素子を抵抗とすることができる。
　上記の構成によれば、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した瞬間の電流を、上記抵抗によって、（両ラインの電位差）／（抵抗の抵抗値）の値に抑制することができる。これにより、ラッチ期間（チャージシェア期間）の立ち上がりのタイミングにおいて突入電流の発生を抑制することができる。
　また別の構成としては、上記電流抑制素子が電界効果トランジスタであり、上記電界効果トランジスタのチャネル抵抗によって、上記スイッチに流れる電流を抑制するように構成されていてもよい。
　上記の構成によれば、上記電界効果トランジスタのゲートの印加電圧を調節することによってチャネル抵抗を変えて、隣接する画素の同色絵素のソースバスラインがスイッチによって導通した瞬間の、スイッチに流れる電流を抑制することができる。
　また、本発明に係る第１の駆動装置は、上記の構成に加えて、上記出力回路のバイアス電流を制御するバイアス電流制御手段を更に備えており、上記バイアス電流制御手段は、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有していることが好ましい。
　上記の構成によれば、本発明に係る駆動装置は、電流抑制素子に加えて、バイアス電流制御端子を具備していることから、ソースバスラインに生じる突入電流をより一層効果的に抑制することが可能となる。
　具体的には、上記出力回路に与えるバイアス制御信号を外部から調節可能とするバイアス電流制御端子が配設されていることにより、当該端子に抵抗や電源を接続して、バイアス制御手段から出力回路に供給される電流を減少させて、出力回路のバイアス電流を小さくすることができ、出力回路の出力のスルーレートを小さくすることができる。これにより、ラッチ期間の立ち下がりのタイミングにおいて突入電流の発生を抑制することができる。
　そのため、上記電流抑制素子と併せて備えることにより、従来構成において突入電流が生じていたラッチ期間（チャージシェア期間）の立ち上がり、及び、ソースドライバからのソース信号の出力開始のタイミングにおいて突入電流の発生を抑制することができる。
　また、このバイアス電流制御端子が駆動装置の外部に配設されていることから、フレキシブル基板（ＦＰＣ：Flexible Printed Circuit）やソースドライバ、ゲートドライバ等の実装後に表示部を見ながら、あるいは不要輻射（ＥＭＩ）の検討を行ないながら、その調整を行なうことが可能となる。
　具体的には、本発明に係る第１の駆動装置は、上記の構成に加えて、コントロール基板を備えており、上記バイアス電流制御端子は、上記コントロール基板内に設けられていることが好ましい。
　上記の構成によれば、上記バイアス電流制御端子が上記コントロール基板に実装されているため、ドライバ実装後であっても、バイアス電流の制御を容易に行なうことが可能となる。
　また、本発明に係る第１の駆動装置は、上記の構成に加えて、上記スイッチと上記電流抑制素子との直列回路が、複数、上記第１のソースバスラインと上記第２のソースバスラインとの間に互いに並列に設けられており、各上記電流抑制素子は、直列に接続された上記スイッチに流れる電流を抑制する大きさが互いに異なっており、各上記スイッチが互いに独立して制御されるように構成されていることが好ましい。
　これにより、隣接する画素の同色絵素のソースバスライン間に複数種の抵抗を実現することができ、その中から所望の抵抗を用いて隣接する画素の同色絵素のソースバスラインがスイッチによって導通した瞬間の電流を抑制することができる。
　また、本発明に係る第２の駆動装置は、上記の課題を解決するために、表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、上記出力回路のバイアス電流を抑制するバイアス制御手段を更に備えており、上記バイアス制御手段は、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有していることを特徴としており、上記バイアス電流制御端子には、抵抗体を接続することができる。
　これにより、バイアス制御手段から出力回路に供給される電流を減少させて、出力回路のバイアス電流を小さくすることが可能となる。
　また、上記抵抗体に代えて、上記バイアス電流制御端子には、上記バイアス制御手段に直接入力される直流電流を接続してもよい。
　これにより、接続された電源の出力電流や出力電圧の設定を変えるだけで、バイアス制御部の出力を調節することができる。
　また、本発明に係る第２の駆動装置は、上記の構成に加えて、上記駆動装置が、コントロール基板を備えており、上記バイアス電流制御端子が、上記コントロール基板内に設けられていることが好ましい。
　これにより、ドライバ実装後であっても、バイアス電流を容易に制御することが可能となる。
　なお、発明の詳細な説明の項においてなされた具体的な実施形態または実施例は、あくまでも、本発明の技術内容を明らかにするものであって、そのような具体例にのみ限定して狭義に解釈されるべきものではなく、本発明の精神と次に記載する請求の範囲内で、いろいろと変更して実施することができるものである。
　本発明に係る駆動装置は、液晶表示装置等の表示装置の駆動装置として幅広く利用することができ、例えば車載用のモジュールに好適に用いることができる。
　１　液晶パネル（表示部）
　２　ソースドライバ
　３　ゲートドライバ
　４　コントロール回路
　５　液晶駆動電源
１０　液晶表示装置（駆動装置）
１１　絵素電極
１２　液晶容量
１３　ＴＦＴ
１４　ソースバスライン
１５　ゲートバスライン
１６　対向電極
２１　シフトレジスタ
２２　入力ラッチ回路
２３　サンプリングメモリ
２４　ホールドメモリ
２５　レベルシフタ
２６　ＤＡ変換回路
２７　基準電圧発生回路
２８　出力回路
２９　バイアス制御部（バイアス制御手段）
２９ａ　バイアス制御端子
２９ｂ　出力端子
３０　スイッチ回路
３１ａ　接続スイッチ
３１ａ－１　接続スイッチ
３１ａ－２　接続スイッチ
３１ｂ　切り離しスイッチ
３２　抵抗（電流抑制素子）
３２ａ　抵抗（電流抑制素子）
３２ｂ　抵抗（電流抑制素子）
３３　バイアス制御抵抗
３４　選択素子
３４ａ－１　入力端子
３４ａ－２　入力端子
３４ｂ　出力端子

Claims (11)

  1. 　表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、
    　表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、
    　上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、
    　上記スイッチ回路には、上記第１のソースバスラインと上記第２のソースバスラインとを上記スイッチによって互いに接続したときに、当該スイッチに流れる電流を抑制するための電流抑制素子が、当該スイッチに直列に接続されていることを特徴とする駆動装置。
  2. 　上記電流抑制素子は、抵抗であることを特徴とする請求項１に記載の駆動装置。
  3. 　上記電流抑制素子は、電界効果トランジスタであり、
    　上記電界効果トランジスタのチャネル抵抗によって、上記スイッチに流れる電流を抑制するように構成されていることを特徴とする請求項１に記載の駆動装置。
  4. 　上記駆動装置は、上記出力回路のバイアス電流を制御するバイアス電流制御手段を更に備えており、
    　上記バイアス電流制御手段は、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有していることを特徴とする請求項１から３までの何れか１項に記載の駆動装置。
  5. 　上記駆動装置は、コントロール基板を備えており、
    　上記バイアス電流制御端子は、上記コントロール基板内に設けられていることを特徴とする請求項４に記載の駆動装置。
  6. 　上記スイッチと上記電流抑制素子との直列回路が、複数、上記第１のソースバスラインと上記第２のソースバスラインとの間に互いに並列に設けられており、
    　各上記電流抑制素子は、直列に接続された上記スイッチに流れる電流を抑制する大きさが互いに異なっており、
    　各上記スイッチが互いに独立してＯＮ／ＯＦＦ制御タイミングの設定が可能なように構成されていることを特徴とする請求項１から５までの何れか１項に記載の駆動装置。
  7. 　表示装置の表示部の絵素に電圧を印加して当該表示部を駆動する駆動装置であって、
    　表示データ信号に基づいて、ソースバスラインに印加される電位であるソース信号電位にて水平期間ごとに上記絵素に電圧を印加する出力回路と、
    　上記出力回路とソースバスラインとの接続を切り離し、同一の水平期間においてはソース信号電位が正となるソースバスラインである第１のソースバスラインと、ソース信号電位が負となるソースバスラインである第２のソースバスラインとを互いに接続するためのスイッチを有したスイッチ回路とを備えており、
    　上記出力回路のバイアス電流を抑制するバイアス制御手段を更に備えており、
    　上記バイアス制御手段は、当該バイアス制御手段が上記出力回路に与えるバイアス制御信号を外部から調節可能とする外部接続端子であるバイアス電流制御端子を有していることを特徴とする駆動装置。
  8. 　上記バイアス電流制御端子には、抵抗体が接続されていることを特徴とする請求項７に記載の駆動装置。
  9. 　上記バイアス電流制御端子には電源の出力が接続されていることを特徴とする請求項７に記載の駆動装置。
  10. 　上記駆動装置は、コントロール基板を備えており、
    　上記バイアス電流制御端子は、上記コントロール基板内に設けられていることを特徴とする請求項７から９までの何れか１項に記載の駆動装置。
  11. 　請求項１から１０までの何れか１項に記載の駆動装置によって駆動される表示装置。
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