WO2009069621A1 - Dispositif et procédé de traitement de données - Google Patents

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Takashi Yokokawa
Makiko Yamamoto
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Sony Corporation
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Abstract

L'invention concerne un dispositif et un procédé de traitement de données dont la résistance à une erreur de bit de code d'un code LDPC telle qu'une erreur de rafale ou une erreur d'effacement peut être améliorée. Si deux ou plusieurs bits de code du code LDPC (vérification de parité à faible densité) représentent un symbole, un entrelaceur (24) de torsion de colonne exécute un traitement de réarragement qui réarrange les bits de code du code LDPC de manière que les bits de code correspondant à 1 dans une rangée arbitraire d'une matrice de vérification ne soient pas mappés par ce symbole. Le dispositif et le procédé de traitement de données peuvent s'appliquer, par exemple, à un dispositif de transmission destiné à transmettre un code LDPC.
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2690791A1 (fr) * 2012-07-27 2014-01-29 Panasonic Corporation Entrelacement de composant pour constellations rotatives avec codes LDPC quasi-cycliques
CN115995249A (zh) * 2023-03-24 2023-04-21 南京大学 一种基于dram的矩阵转置运算装置

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9952831B1 (en) * 2017-02-16 2018-04-24 Google Llc Transposing in a matrix-vector processor

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006254466A (ja) * 2005-03-11 2006-09-21 Samsung Electronics Co Ltd 低密度のパリティ検査符号を用いる通信システムにおけるチャンネルインタリービング／デインタリービング装置およびその制御方法

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006254466A (ja) * 2005-03-11 2006-09-21 Samsung Electronics Co Ltd 低密度のパリティ検査符号を用いる通信システムにおけるチャンネルインタリービング／デインタリービング装置およびその制御方法

Non-Patent Citations (2)

* Cited by examiner, † Cited by third party
Title
ROBERT D. MADDOCK ET AL.: "Reliability-Based Coded Modulation With Low-Density Parity-Check Codes", IEEE TRANSACTIONS ON COMMUNICATIONS, vol. 54, no. 3, March 2006 (2006-03-01), pages 403 - 406 *
STEPHANE Y. LE GOFF: "Signal Constellations for Bit-Interleaved Coded Modulation", IEEE TRANSACTIONS ON INFORMATION THEORY, vol. 49, no. 1, January 2003 (2003-01-01), pages 307 - 313 *

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2690791A1 (fr) * 2012-07-27 2014-01-29 Panasonic Corporation Entrelacement de composant pour constellations rotatives avec codes LDPC quasi-cycliques
CN115995249A (zh) * 2023-03-24 2023-04-21 南京大学 一种基于dram的矩阵转置运算装置

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