TWI827099B - 印刷電路板與其製作方法 - Google Patents
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Abstract
一種印刷電路板,包含一第一基板、至少一第一導線層、與至少一第二導線層。第一基板具有第一表面與第二表面,第一表面與第二表面沿軸向而呈相對。第一導線層形成於第一基板的第一表面且/或第二表面上,且第一導線層上具有蝕刻而成的至少一第一導線及該第一導線旁由蝕刻而成的至少一第一孔隙。第二導線層形成於第一導線層上,第二導線層上具有蝕刻而成的至少一第二導線及第二導線旁由蝕刻而成的至少一第二孔隙。第一導線與第二導線沿軸向相互接合,以形成一疊合導線。其中,第一導線、第二導線與疊合導線的蝕刻因子皆大於等於4.6。
Description
本發明是一種印刷電路板與其製作方法,且特別是一種其導線具有較高蝕刻因子的印刷電路板與其製作方法。
所謂的厚銅印刷電路板是指其導線是由較一般印刷電路板的導線為厚的印刷電路板,近年來隨著電動車等相關產業帶動下,應用於高散熱、高電流等產品的厚銅印刷電路板的需求也逐漸增加。目前,厚銅印刷電路板一般是採用多次蝕刻方法來製作。但是,由於銅層須經過多次蝕刻,除了產能會因此降低,也會導致蝕刻因子較小。而且,蝕刻因子較小除了會影響到線路設計的布局外,在印刷電路板的內層的導線也容易產生尖端放電,而有短路或絕緣破壞的情況發生。
因此,如何製作出其導線具有較高蝕刻因子的印刷電路板便是本領域具有通常知識者值得去思量地。
本發明之目的在於提供一印刷電路板與其製作方法,能使印刷電路板中的導線具有較高的蝕刻因子。
基於上述目的與其他目的,本發明提供一印刷電路板,此印刷電路板包含一第一基板、至少一第一導線層、與至少一第二導線層。第一基板具有一第一表面與一第二表面,該第一表面與該第二表面沿一軸向而呈相對。第一導線層形成於第一基板的第一表面且/或第二表面上,且第一導線層上具有蝕刻而成的
至少一第一導線及該第一導線旁由蝕刻所形成的至少一第一孔隙。其中,第一導線的蝕刻因子大於等於2.3。第二導線層形成於第一導線層上,該第二導線層上具有蝕刻而成的至少一第二導線及該第二導線旁由蝕刻所形成的至少一第二孔隙,其中第二導線的蝕刻因子大於等於2.3。其中,第一導線與第二導線沿軸向相互接合,以形成一疊合導線,且該疊合導線的蝕刻因子大於等於4.6。
在上述之印刷電路板中,第一導線與第二導線之間的接合是運用一低溫銅對銅接合(Low Temperature Copper Bonding)技術。
在上述之印刷電路板中,第一導線與第二導線之間是藉由一導電膠而接合。
在上述之印刷電路板中,第一孔隙與第二孔隙是沿該軸向而相互貫通,且第一孔隙與第二孔隙填充有一介電材料。
在上述之印刷電路板中,第一導線與第二導線之間的接合是包含運用一平坦化技術。而且,平坦化技術例如為化學機械研磨技術。
在上述之印刷電路板中,於第二導線層且/或疊合導線的一外表面上形成一防焊油墨。
在上述之印刷電路板中,第二導線層設置於一第二基板表面上。
基於上述目的與其他目的,本發明再提供一印刷電路板的製作方法,此印刷電路板的製作方法包含以下步驟:提供一第一基板,該第一基板具有一第一表面與一第二表面,該第一表面與該第二表面沿一軸向而呈相對;形成至少一第一導線層,在第一基板的第一表面且/或第二表面上。其中,第一導線層上具有蝕刻而成的至少一第一導線,及第一導線旁由蝕刻所形成的至少一第一孔隙,其中該第一導線的蝕刻因子大於等於2.3;
形成至少一第二導線層,在第一導線層上。其中,第二導線層上具有蝕刻而成的至少一第二導線,及第二導線旁由蝕刻所形成的至少一第二孔隙。其中,第二導線的蝕刻因子大於等於2.3;及形成一疊合導線,該疊合導線為該第一導線與該第二導線沿該軸向接合而成,該疊合導線的蝕刻因子大於等於4.6。
在上述之印刷電路板的製作方法中,第一導線與第二導線之間的接合是運用一低溫銅對銅接合技術。
在上述之印刷電路板的製作方法中,第一導線與第二導線之間是藉由一導電膠而接合。
在上述之印刷電路板的製作方法中,第一孔隙與第二孔隙沿該軸向而相互貫通,且第一孔隙與第二孔隙填充有一介電材料。
在上述之印刷電路板的製作方法中,第一導線與第二導線之間的接合是運用一低溫銅對銅接合技術。
在上述之印刷電路板的製作方法中,第一導線與第二導線之間的接合是包含運用一平坦化技術。而且,平坦化技術例如為化學機械研磨技術。
在上述之印刷電路板的製作方法中,包含於第二導線層且/或該疊合導線之外表面,進行一表面處理(Surface treatment)步驟。
在上述之印刷電路板的製作方法中,第二導線層設置於一第二基板表面上。
綜上所述,在對本發明的印刷電路板進行製作時,由於是對各別的導電層進行蝕刻,故可得到導線具有較高蝕刻因子的印刷電路板。
為讓本發明之上述特徵和優點能更明顯易懂,下文特舉較佳實施例,並配合所附圖式,作詳細說明如下。
100、200、300、400:印刷電路板
1:第一基板
10:第一表面
12:第二表面
2:第一導線層
20:第一導線
22:第一孔隙
3:第二導線層
30:第二導線
32:第二孔隙
40:疊合導線
4、4a、4b:介電材料
5:導電膠
6:第二基板
7:表面保護層
8:防焊油墨
9:黏著層
Y:軸向
圖1A~圖1G所繪示為本發明之印刷電路板的製作方法的第一實施例。
圖2A~圖2F所繪示為本發明之印刷電路板的製作方法的第二實施例。
圖3A~圖3H所繪示為本發明之印刷電路板的製作方法的第三實施例。
圖4所繪示為本發明之印刷電路板的第四實施例。
參照本文闡述的詳細內容和附圖說明是最好理解本發明。下面參照附圖會討論各種實施例。然而,本領域具有通常知識者將容易理解,這裡關於附圖給出的詳細描述僅僅是為了解釋的目的,且不代表真實的元件比例,而本發明所要保護的物和/或方法可超出所描述的實施例。例如,所給出的教導和特定應用的需求可能產生多種可選的和合適的方法來實現在此描述的任何細節的功能。因此,任何本發明所要保護的物和/或方法可延伸超出所描述的以下實施例中的特定實施選擇範圍。
請參閱圖1A~圖1G,圖1A~圖1G所繪示為本發明之印刷電路板的製作方法的第一實施例。首先,請參照圖1A,提供一第一基板1,第一基板1具有一第一表面10與一第二表面12,此第一表面10與此第二表面12沿一軸向Y而呈彼此相對。在此,第一表面10與第二表面12沿軸向Y而呈彼此相對是指:第一表面10與第二表面12是位在軸向Y的不同高度上,且第一表面10所朝向的方向與第二表面12所朝向的方向彼此相反。在本實施例中,第一基板1例如為聚丙烯基板。然而,在其他實施例中,第一基板1也可為聚醯亞胺基板、聚甲基丙烯酸甲酯基板、玻璃基板、陶瓷基板、或絕緣矽基板。
再來,請參閱圖1B,於第一基板1的第一表面10與第二表面12上分別形成一第一導線層2。在本實施例中,第一導線層2的材質為銅,但在其他實施例中第一導線層2的材質也可為其他導電材質,例如:鋁。此外,在其他實施例中,第一導線層2也可僅形成在第一表面10或第二表面12上。
之後,請參閱圖1C,對第一導線層2進行蝕刻(例如:濕式蝕刻),以形成多條第一導線20。在蝕刻完成後,於第一導線20旁具有由蝕刻所形成的第一孔隙22,第一孔隙22的孔徑或寬度的大小是朝向基板1漸縮並會露出第一基板1的表面(亦即:第一表面10與第二表面12)。在本實施例中,第一導線20的蝕刻因子大於等於2.3;換句話說,第一孔隙22的孔壁的蝕刻因子大於等於2.3。在本發明中,蝕刻因子的定義可為:2*被蝕刻層厚度/(被蝕刻層下方寬度-被蝕刻層上方寬度)。舉例來說,第一導線20的蝕刻因子可定義為:2*第一導線20的厚度/(第一導線20的下方寬度-第一導線20的上方寬度)。或者,在本發明中,蝕刻因子也可定義為:被蝕刻層厚度/孔壁側向蝕刻的寬度。
然後,請參閱圖1D與圖1E,提供至少一第二導線層3,並將第二導線層3疊合在已形成多條第一導線20的第一導線層2上。在圖1D中,箭頭所示為疊合的方向。在本實施例中,此第二導線層3為一金屬板,此金屬板的材質為銅。而且,在本實施例中,在第二導線層3疊合到第一導線層2上前,第二導線層3與第一導線層2的表面皆經過平坦化技術的處理。在本實施例中,平坦化技術為化學機械研磨技術。
再來,請繼續參照圖1E,第一導線層2與第二導線層3的疊合是可以使用一低溫銅對銅接合技術。關於低溫銅對銅接合技術,可參考以下的文獻:Chien-Min Liu,Han-Wen Lin,Yi-Sa Huang,Yi-Cheng Chu,Chih Chen,Dian-Rong Lyu,Kuan-Neng Chen & King-Ning Tu.(2015).Low-temperature direct copper-to-copper bonding enabled by creep on(111)surfaces of nanotwinned Cu.Scientific Reports,5:09734.doi:10.1038/srep09734
在上述文件中,銅對銅接合的最低工作溫度是150℃,所需時間為1小時;若溫度是250℃,所需時間需要10分。在電路板產業中,工作溫度一般是小於200℃。在本實施例中,工作溫度為190~200℃。
接著,請參閱圖1F,對第二導線層3進行蝕刻,以在第二導線層3上形成多個第二導線30。在蝕刻完成後,於第二導線30旁具有由蝕刻所形成的第二孔隙32。在本實施例中,第二孔隙32是貫穿第二導線層3,且第一孔隙22與第二孔隙32是沿著軸向Y而相互貫通,第二孔隙32的孔徑或寬度是從上朝向第一孔隙22漸縮。在本實施例中,第二導線30的蝕刻因子大於等於2.3;換句話說,第二孔隙32的孔壁的蝕刻因子大於等於2.3。由於第一導線20與第二導線30的蝕刻因子皆大於等於2.3,故由第一導線20與第二導線30沿軸向Y相互接合而成的疊合導線40,其蝕刻因子也就會大於等於4.6。此外,在本實施例或其他的實施例中,第一孔隙22與第二孔隙32可以是指孔洞(hole)或導線之間的間隙(gap)。
值得一提的是,圖1D與圖1F所示的步驟可以重複執行,以製造出蝕刻因子更高的疊合導線40。舉例來說,可在第二導線30上再疊合一導電層後,再對該導電層進行蝕刻,以形成蝕刻因子更高的疊合導線40。
之後,請參照圖1G,於第一孔隙22與第二孔隙32中填充有一介電材料4,此介電材料4例如為樹脂、環氧樹脂、阻焊層或其他黏合材料,填充介電材料4的好處在於能更好的避免各疊合導線40間的短路或絕緣破壞的情況發生。再來,請繼續參照圖1G。在本實施例中,於介電材料4填充完成後,可在介電材料4與疊合導線40(精確來說是在第二導線層3)之外表面進行一表面處理,此表面處理例如為在介電材料4與疊合導線40之外表面上形成有表面保護層7與防焊油墨8,其中表面保護層7是設置在疊合導線40上,而防焊油墨8是設置在介電材料4上,且防焊油墨8覆蓋疊合導線40的部分表面。表面保護層7用以保護疊合導線40,且表面保護層7的材質例如為化鎳鈀浸金(ENEPIG)、有機保銲劑(organic solderability preservatives,OSP)層或無電鍍鎳浸金(Electroless Nickel Immersion Gold,ENIG),但不以此為限。
如此一來,便完成了印刷電路板100的製作,此印刷電路板100的導線(亦即:疊合導線40)具有較高蝕刻因子。在上述印刷電路板100的製作過程中,是對各別的導電層(亦即:第一導線層2與第二導線層3)進行蝕刻,故可得到導線具有較高蝕刻因子的印刷電路板100。
以下,將對本發明之印刷電路板的製作方法的第二實施例進行介紹,請參閱圖2A~圖2F。在第二實施例中,與第一實施例相同或相似的元件將標以相同的元件符號。首先,請參照圖2A,提供一第一基板1,第一基板1具有一第一表面10與一第二表面12,此第一表面10與此第二表面12沿一軸向Y而呈彼此相對。再來,請參閱圖2B,於第一基板1的第一表面10與第二表面12上分別形成一第一導線層2。之後,請參閱圖2C,對第一導線層2進行蝕刻,以形成多條第一導線20。在蝕刻完成後,於第一導線20旁具有由蝕刻所形成的第一孔隙22,第一孔隙22會露出第一基板1的表面(亦即:第一表面10與第二表面12)。在本實施例中,第一導線20的蝕刻因子大於等於2.3;換句話說,第一孔隙22的孔壁的蝕刻因子大於等於2.3。之後,將對已形成多條第一導線20的第一導線層2的表面進行平坦化技術的處理。在本實施例中,平坦化技術為化學機械研磨技術。接著,請參閱2D,於第一孔隙22中填充介電材料4a。
再來,請參照圖2E,提供一第二基板6,且於第二基板6的相對的二個表面上各形成有一第二導線層3。此外,第二導線層3上具有蝕刻而成的多條第二導線30,且於第二導線30旁具有由蝕刻所形成的第二孔隙32,其中第二導線30的蝕刻因子大於等於2.3。此外,在第二孔隙32內則填充有介電材料4b。在本實施例中,第二基板6上的第二導線30、第二孔隙32、與介電材料4b的形成方式,可與第一基板1上的第一導線20、第一孔隙22、與介電材料4a的形成方式相同;因此,第二導線30、第二孔隙32、與介電材料4b的形成方式在此將不再詳加介紹。
之後,請繼續參照圖2E,將第二基板6其中一表面上的第二導線30與第一基板1其中一表面上的第一導線20沿著軸向Y相結合。在結合時,第一孔隙22與第二孔隙32的位置會彼此相對應,也就是說在結合後第一孔隙22與第二孔隙32是沿著軸向Y而相互貫通(如圖2F所示);此外,第一導線20和第二導線30的位置也會彼此相對應。須注意的是,於結合前,會於第二導線30的表面上施以一平坦化技術,此平坦化技術為化學機械研磨技術。在本實施例中,是使用低溫銅對銅接合技術將第二導線30與第一導線20相結合。
再來,請參照圖2F,第二導線30與第一導線20相結合後會形成疊合導線40。由於第一導線20與第二導線30的蝕刻因子皆大於等於2.3,故由第一導線20與第二導線30沿軸向Y相互接合而成的疊合導線40,其蝕刻因子也就會大於等於4.6。在完成疊合導線40的製作後,可對第二基板6的另外一表面上的第二導線30的外表面與第一基板1的另外一表面上的第一導線20的外表面進行表面處理。在本實施例中,此表面處理的步驟包括加上表面保護層7與防焊油墨8,其中表面保護層7是設置在第一導線20及第二導線30上,以用於保護第一導線20及第二導線30。而防焊油墨8是設置在介電材料4a及介電材料4b上,且防焊油墨8覆蓋部分的第一導線20及部分的第二導線30。
如此一來,便完成了印刷電路板200的製作,此印刷電路板200的導線(亦即:疊合導線40)具有較高蝕刻因子。相較於第一實施例,在本實施例中是先對第二導線層3進行蝕刻後再與第一導線層2相結合,但由於仍是對各別的導電層(亦即:第一導線層2與第二導線層3)進行蝕刻,故可得到導線具有較高蝕刻因子的印刷電路板200。
以下,將對本發明之印刷電路板的製作方法的第三實施例進行介紹,請參閱圖3A~圖3H。在第三實施例中,與第二實施例相同或相似的元件將標以相同的元件符號。首先,請參照圖3A,提供一第一基板1,第一基板1具有一第一表
面10與一第二表面12,此第一表面10與此第二表面12沿一軸向Y而呈彼此相對。再來,請參閱圖3B,於第一基板1的第一表面10與第二表面12上分別形成一第一導線層2。之後,請參閱圖3C,對第一導線層2進行蝕刻,以形成多條第一導線20。在蝕刻完成後,於第一導線20旁具有由蝕刻所形成的第一孔隙22,第一孔隙22會露出第一基板1的表面(亦即:第一表面10與第二表面12)。在本實施例中,第一導線20的蝕刻因子大於等於2.3;換句話說,第一孔隙22的孔壁的蝕刻因子大於等於2.3。接著,請參閱3D,於第一孔隙22中填充介電材料4a。
之後,請參閱圖3E,將第一表面10上的介電材料4a塗布上一黏著層9。此黏著層9的材質主要為樹脂、環氧樹脂或其他不具導電性的粘著材料。接著,請參閱圖3F,將第一表面10上的第一導線20塗布上一導電膠5,此導電膠5例如為導電銅膏(Cu paste)。在本實施例中,導電膠5可用印刷的方式而塗布在第一導線20上。
然後,請參閱圖3G,提供一第二基板6,且於第二基板6的相對的二個表面上各形成有一第二導線層3。此外,第二導線層3上具有蝕刻而成的多條第二導線30,且於第二導線30旁具有由蝕刻所形成的第二孔隙32,其中第二導線30的蝕刻因子大於等於2.3。此外,在第二孔隙32內則填充有介電材料4b。在本實施例中,第二基板6上的第二導線30、第二孔隙32、與介電材料4b的形成方式,可與第一基板1上的第一導線20、第一孔隙22、與介電材料4a的形成方式相同;因此,第二導線30、第二孔隙32、與介電材料4b的形成方式在此將不再詳加介紹。
之後,請繼續參照圖3G,藉由黏著層9和導電膠5,將第二基板6其中一表面上的第二導線30與第一基板1其中一表面上的第一導線20沿著軸向X相結合。在結合時,第一孔隙22與第二孔隙32的位置會彼此相對應,且第一導線20和第
二導線30的位置也會彼此相對應。而且,第二導線30與第一導線20的結合例如是在一特定溫度下進行,以使黏著層9和導電膠5固化。
再來,請參照圖3H,第二導線30、導電膠5、與第一導線20相結合後會形成疊合導線40。由於第一導線20與第二導線30的蝕刻因子皆大於等於2.3,故由第一導線20與第二導線30沿軸向X相互接合而成的疊合導線40,其蝕刻因子也就會大於等於4.6。在完成疊合導線40的製作後,可對第二基板6的另外一表面上的第二導線30與第一基板1的另外一表面上的第一導線20進行表面處理。在本實施例中,此表面處理的步驟包括加上表面保護層7與防焊油墨8。
如此一來,便完成了印刷電路板300的製作,此印刷電路板300的導線(亦即:疊合導線40)具有較高蝕刻因子。相較於第二實施例,在本實施例中是藉由導電膠5來將第二導線層3與第一導線層2相結合,而非使用低溫銅對銅接合技術。而且,在本實施例中也可無需使用化學機械研磨等平坦化技術。在本實施例中,由於仍是對各別的導電層(亦即:第一導線層2與第二導線層3)進行蝕刻,故可得到導線具有較高蝕刻因子的印刷電路板300。
在上述的實施例中,於第一基板1的第一表面10與第二表面12皆設置有第一導電層2,但也可只在第一基板1的其中一表面(第一表面10或第二表面12)設置第一導電層2。請參照圖4,圖4所繪示為本發明之印刷電路板的第四實施例。在本實施例中,印刷電路板400包括一第一基板1、一第一導線層2、與一第二導線層3。其中,第一基板1具有一第一表面10與一第二表面12,而第一表面10與第二表面12沿軸向X而呈相對。第一導線層2形成於該第一基板1的第一表面10上,第一導線層2具有至少一第一導線20(在本實施例為多個),且第一導線20旁設置有至少一第一孔隙22(在本實施例為多個),第一孔隙22是經由蝕刻而成。其中,第一導線20的蝕刻因子大於等於2.3。另外,第二導線層3形成於第一導線層2上,第二導線層3具有至少一第二導線30(在本實施例為多
個),且第二導線30設置至少一第二孔隙32(在本實施例為多個)。其中,第二導線30的蝕刻因子大於等於2.3。此外,第一孔隙22與第二孔隙32沿軸向Y而相互貫通,且第一孔隙22與第二孔隙32填充有介電材料4。其中,第一導線20與第二導線30是沿軸向Y相互接合以形成疊合導線40,且此疊合導線40的蝕刻因子大於等於4.6。此外,在介電材料4與疊合導線40之外表面上形成有表面保護層7與防焊油墨8,其中表面保護層7是設置在疊合導線40上,而防焊油墨8是設置在介電材料4上,且防焊油墨8覆蓋疊合導線40的部分表面。印刷電路板400的製作方法與印刷電路板100的製作方法(如圖1A~圖1G)實質相同,主要的差異在於:印刷電路板400在製作時,無須在第二表面12上製作任何元件,因此印刷電路板400的製作方法在此不再詳細介紹。
綜上所述,在對本發明的印刷電路板進行製作時,由於是對各別的導電層進行蝕刻,故可得到導線具有較高蝕刻因子的印刷電路板。此外,在上述的實施例中,皆有在第一孔隙22與第二孔隙32填充介電材料4,以增加各疊合導線40間的絕緣性,但本領域具有通常知識者也可選擇不在第一孔隙22與第二孔隙32填充介電材料4。
雖然本發明已以較佳實施例揭露如上,然其並非用以限定本發明,任何所屬技術領域中具有通常知識者,在不脫離本發明之精神和範圍內,當可作些許之更動與潤飾,因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
400:印刷電路板
1:第一基板
10:第一表面
12:第二表面
2:第一導線層
20:第一導線
22:第一孔隙
3:第二導線層
30:第二導線
32:第二孔隙
40:疊合導線
4:介電材料
Claims (16)
- 一種印刷電路板,包含:一第一基板,具有一第一表面與一第二表面,該第一表面與該第二表面沿一軸向而呈相對;至少一第一導線層,形成於該第一基板的該第一表面且/或該第二表面上,該第一導線層上具有蝕刻而成的至少一第一導線,及該第一導線旁由蝕刻所形成的至少一第一孔隙,其中該第一導線的蝕刻因子大於等於2.3;及至少一第二導線層,形成於第一導線層上,該第二導線層上具有蝕刻而成的至少一第二導線,及該第二導線旁由蝕刻所形成的至少一第二孔隙,其中該第二導線的蝕刻因子大於等於2.3;其中,該第一導線與該第二導線沿該軸向相互接合,以形成一疊合導線,且該疊合導線的蝕刻因子大於等於4.6。
- 如請求項1所述之印刷電路板,其中該第一導線與該第二導線之間的接合,運用一低溫銅對銅接合技術。
- 如請求項1所述之印刷電路板,其中該第一導線與該第二導線之間,藉由一導電膠而接合。
- 如請求項1所述之印刷電路板,其中該第一孔隙與該第二孔隙沿該軸向而相互貫通,且該第一孔隙與該第二孔隙填充有一介電材料。
- 如請求項2所述之印刷電路板,其中該第一導線與該第二導線之間的接合,包含運用一平坦化技術。
- 如請求項5所述之印刷電路板,其中該平坦化技術為化學機械研磨技術。
- 如請求項1所述之印刷電路板,其中該第二導線層且/或該疊合導線的一外表面上,形成一防焊油墨。
- 如請求項1所述之印刷電路板,其中該第二導線層設置於一第二基板表面上。
- 一種印刷電路板的製作方法,包含:提供一第一基板,該第一基板具有一第一表面與一第二表面,該第一表面與該第二表面沿一軸向而呈相對;形成至少一第一導線層,在該第一基板的該第一表面且/或該第二表面上,其中,該第一導線層上具有蝕刻而成的至少一第一導線,及該第一導線旁由蝕刻所形成的至少一第一孔隙,其中該第一導線的蝕刻因子大於等於2.3;形成至少一第二導線層,在該第一導線層上,其中,該第二導線層上具有蝕刻而成的至少一第二導線,及該第二導線旁由蝕刻所形成的至少一第二孔隙,其中該第二導線的蝕刻因子大於等於2.3;及形成一疊合導線,該疊合導線為該第一導線與該第二導線沿該軸向接合而成,該疊合導線的蝕刻因子大於等於4.6。
- 如請求項9所述印刷電路板的製作方法,其中該第一導線與該第二導線之間的接合,是運用一低溫銅對銅接合技術。
- 如請求項9所述印刷電路板的製作方法,其中該第一導線與該第二導線之間,藉由一導電膠而接合。
- 如請求項9所述印刷電路板的製作方法,其中該第一孔隙與該第二孔隙沿該軸向而相互貫通,且該第一孔隙與該第二孔隙填充有一介電材料。
- 如請求項9所述印刷電路板的製作方法,其中該第一導線與該第二導線之間的接合,包含運用一平坦化技術。
- 如請求項13所述印刷電路板的製作方法,其中該平坦化技術為化學機械研磨技術。
- 如請求項9所述印刷電路板的製作方法,包含於該第二導線層且/或該疊合導線之外表面,進行一表面處理步驟。
- 如請求項9所述印刷電路板的製作方法,其中該第二導線層設置於一第二基板表面上。
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Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20130087365A1 (en) * | 2011-10-05 | 2013-04-11 | Harris Corporation | Method for making electrical structure with air dielectric and related electrical structures |
CN104684281A (zh) * | 2013-11-29 | 2015-06-03 | 深南电路有限公司 | 电路板系统的制作方法及电路板系统 |
CN105163486A (zh) * | 2015-10-07 | 2015-12-16 | 江西景旺精密电路有限公司 | 一种高层厚铜电路板及制作工艺 |
CN107404798A (zh) * | 2016-05-20 | 2017-11-28 | 株洲中车时代电气股份有限公司 | 一种多层电路连接板及其制造方法 |
CN108282967A (zh) * | 2018-01-25 | 2018-07-13 | 鹤山市中富兴业电路有限公司 | 一种局部厚铜pcb及其制作工艺 |
US20210125958A1 (en) * | 2019-10-24 | 2021-04-29 | Flex Ltd | Embedded copper structure for microelectronics package |
Family Cites Families (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TW484228B (en) * | 1999-08-31 | 2002-04-21 | Toshiba Corp | Non-volatile semiconductor memory device and the manufacturing method thereof |
KR101343729B1 (ko) * | 2010-02-22 | 2013-12-19 | 제이엑스 닛코 닛세키 킨조쿠 가부시키가이샤 | 플렉시블 라미네이트 기판에 대한 회로 형성 방법 |
US9532466B2 (en) * | 2011-12-22 | 2016-12-27 | Haesung Ds Co., Ltd. | Method of manufacturing multi-layer circuit board and multi-layer circuit board manufactured by using the method |
TWI506751B (zh) * | 2012-05-29 | 2015-11-01 | Shih Hua Technology Ltd | 觸控面板 |
CN105228343A (zh) * | 2015-09-22 | 2016-01-06 | 广东欧珀移动通信有限公司 | 一种软硬结合板及其制作方法 |
KR102423813B1 (ko) * | 2015-11-27 | 2022-07-22 | 삼성전자주식회사 | 반도체 소자 |
JP6912080B2 (ja) * | 2017-06-09 | 2021-07-28 | 株式会社Joled | 有機el表示パネル |
US10757801B2 (en) * | 2018-09-10 | 2020-08-25 | Hewlett Packard Enterprise Development Lp | Solder mask void regions for printed circuit boards |
CN112314061B (zh) * | 2019-05-30 | 2023-08-04 | 宏恒胜电子科技(淮安)有限公司 | 电路板、制备方法及背光板 |
CN110493968A (zh) * | 2019-08-14 | 2019-11-22 | 江西景旺精密电路有限公司 | 一种厚铜板的制作方法 |
CN110678014A (zh) * | 2019-08-23 | 2020-01-10 | 李龙凯 | 一种多层柔性线路板的制作方法及其制品 |
CN113543465B (zh) * | 2020-04-22 | 2023-01-17 | 宏启胜精密电子(秦皇岛)有限公司 | 多层电路板及其制作方法 |
CN113630977B (zh) * | 2020-05-06 | 2023-01-17 | 鹏鼎控股(深圳)股份有限公司 | 厚铜电路板及其制作方法 |
-
2022
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Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20130087365A1 (en) * | 2011-10-05 | 2013-04-11 | Harris Corporation | Method for making electrical structure with air dielectric and related electrical structures |
CN104684281A (zh) * | 2013-11-29 | 2015-06-03 | 深南电路有限公司 | 电路板系统的制作方法及电路板系统 |
CN105163486A (zh) * | 2015-10-07 | 2015-12-16 | 江西景旺精密电路有限公司 | 一种高层厚铜电路板及制作工艺 |
CN107404798A (zh) * | 2016-05-20 | 2017-11-28 | 株洲中车时代电气股份有限公司 | 一种多层电路连接板及其制造方法 |
CN108282967A (zh) * | 2018-01-25 | 2018-07-13 | 鹤山市中富兴业电路有限公司 | 一种局部厚铜pcb及其制作工艺 |
US20210125958A1 (en) * | 2019-10-24 | 2021-04-29 | Flex Ltd | Embedded copper structure for microelectronics package |
Also Published As
Publication number | Publication date |
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