TWI617966B - 觸控面板 - Google Patents

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TWI617966B
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Abstract

一種觸控面板，包括一第一閘極驅動電路、一第一觸控電路、一第二閘極驅動電路及一第二觸控電路。其中，第一觸控電路連接至第一閘極驅動電路，第一觸控電路具有一第一電容。第二觸控電路連接至第二閘極驅動電路，第二觸控電路具有一第二電容，其中，第一電容與第二電容並聯連接。

Description

觸控面板
本發明是有關於一種觸控面板。
第1A圖繪示現有技術之觸控面板的結構圖，第1B圖繪示第1A圖電路輸出的訊號波型圖。以內嵌式觸控的現有技術而言，正在執行內嵌式觸控感測時，為避免其他雜訊干擾造成感測錯誤，因而要求此時陣列上閘極驅動電路(Gate driver on array circuit，GOA)訊號暫停輸出，亦即時序訊號CLK1~CLK4及觸發訊號STV在感測期間內均為低電位。待感測結束後，延續前一筆暫停之後的訊號開始輸出。在此種情況下，若不作任何變動，則在執行內嵌式觸控感測時，GOA內部的下拉電路會產生漏電流，使得當級GOA的Q點電位會因為觸控感測時間過長，而從高電位變成低電位。當感測完畢後而訊號開始輸出時，該級電路會因為Q點電位過低，而產生較差的閘極輸出。情況嚴重者，會造成該級閘極無輸出，導致電路功能異常。以第1A圖及第1B圖為例，當G(002)輸出完之後，此時G(003)該級的Q點(Q003)已預先充電至高電位，內嵌式觸控在此時開始作感測，在觸控感測輸入訊號(ITP)偵測區間內，所有GOA訊號都是無輸出，由於ITP偵測區間長達200微秒，因此Q(003) 會因該級下拉電路的漏電導致電位一路從高電位往下降。當感測結束後而時序訊號CLK3輸入時，G(003)開始輸出，但由於Q(003)電位不足，所以G(003)脈波會變差或是無輸出，如此一來，將會導致後續閘級無法順利依序輸出。
本發明提供一種觸控面板，將兩級以上的閘極驅動電路及觸控電路並聯，以達到電容共享的目的。在電容共享的作用下，各級觸控電路所包括的電容值就可以倍數減小。如此一來，即可避免因為外加大容量電容，相應電路板面積需增加，而導致製造成本提高之問題。
本發明之一實施方式提供一種觸控面板，包括一第一閘極驅動電路、一第一觸控電路、一第二閘極驅動電路及一第二觸控電路。其中，第一觸控電性耦接至第一閘極驅動電路，第一觸控電路具有一第一電容。第二觸控電路連接至第二閘極驅動電路，第二觸控電路具有一第二電容，其中，第一電容與第二電容並聯連接。
於部分實施方式中，其中，第一觸控電路更包括一第一開關，第一電容透過第一開關與第一閘極驅動電路電性連接。
於部分實施方式中，其中，第二觸控電路更包括一第二開關，第二電容透過第二開關與第二閘極驅動電路電性連接。
於部分實施方式中，第一閘極驅動電路更包括一 第一時序電路及一第一下拉電路。其中，第一下拉電路分別電性耦接於該第一時序電路與該第一觸控電路，且該第一電容透過該第一開關連接至該第一下拉電路。
於部分實施方式中，該第一時序電路接收一第一時序訊號，而該第一觸控電路接收一觸控感測輸入訊號，當該觸控感測輸入訊號為高電位時，則該第一時序訊號為低電位。
於部分實施方式中，第二閘極驅動電路更包括一第二時序電路及一第二下拉電路。其中，第二下拉電路分別耦接至該第二時序電路及該第二觸控電路，且該第二電容透過該第二開關連接至該第二下拉電路。
本發明之一實施方式提供一種觸控面板，包括：複數個閘極驅動電路、複數個觸控電路、複數個電容及N個時序訊號。其中，複數個觸控電路分別電性連接至該些閘極驅動電路，使得該些閘級驅動電路與該些觸控電路可形成多級觸控閘極驅動電路。複數個電容分別設置於該些觸控電路中，且具有M個電容以並聯方式連接。N個時序訊號分別電性傳遞至該些閘極驅動電路，其中N、M皆為正整數，且M小於N。
於部分實施方式中，該些閘極驅動電路則以串接方式連接以形成一多級移位暫存器電路，且該N個時序訊號依序且周期性排列地輸入至該多級移位暫存器電路。
於部分實施方式中，該些觸控電路分別包含一第一開關，而該些觸控電路分別藉由該第一開關而與該複數 個閘極驅動電路連接。
於部分實施方式中，該些電容分別具有一第一端與一第二端，而該第二端電性耦接至設於相同之該些觸控電路中的該第一開關，且M個電容之該第一端皆相互電性連接以形成並聯。
205‧‧‧第一閘極驅動電路
210‧‧‧第一時序電路
220‧‧‧第一下拉電路
230‧‧‧第一觸控電路
232‧‧‧第一電容
234‧‧‧第一開關
236‧‧‧薄膜電晶體
237‧‧‧薄膜電晶體
238‧‧‧薄膜電晶體
255‧‧‧第二閘極驅動電路
260‧‧‧第二時序電路
270‧‧‧第二下拉電路
280‧‧‧第二觸控電路
282‧‧‧第二電容
284‧‧‧第二開關
286‧‧‧薄膜電晶體
305‧‧‧第三閘極驅動電路
310‧‧‧第三時序電路
320‧‧‧第三下拉電路
330‧‧‧第三觸控電路
332‧‧‧第三電容
334‧‧‧第三開關
336‧‧‧薄膜電晶體
410、420、430、440、450、460‧‧‧下拉電路
412、422、432、442、452、462‧‧‧電容
510‧‧‧第一薄膜電晶體
520‧‧‧第二薄膜電晶體
530‧‧‧第三薄膜電晶體
540‧‧‧第四薄膜電晶體
550‧‧‧第一電容
560‧‧‧第五薄膜電晶體
C‧‧‧電容
G‧‧‧電晶體
ITP‧‧‧觸控感測輸入訊號
CLK、CLK0、CLK1、CLK2、CLK3、CLK4‧‧‧時序訊號
Vst‧‧‧初始觸發訊號
Vss‧‧‧電壓源
Reset‧‧‧重置訊號
F(000)~F(007)‧‧‧訊號
F(n-2)、F(n-1)、F(n)、F(n+1)‧‧‧訊號
G(001)~G(006)‧‧‧訊號
G(n)、G(n+1)、G(n+2)、G(n+3)‧‧‧訊號
G(1)~G(6)、F(1)~F(7)‧‧‧訊號
第1A圖繪示現有技術之觸控面板的結構圖。
第1B圖繪示第1A圖電路輸出的訊號波型圖。
第2圖繪示本發明第一實施方式之觸控面板的結構圖。
第3圖繪示本發明第二實施方式之觸控面板的結構圖。
第4A圖繪示本發明第三實施方式之觸控面板的結構圖。
第4B圖繪示第4A圖電路輸出的訊號波型圖。
第5A圖、第5B圖及第5C圖繪示本發明其他實施例之觸控電路的結構圖。
以下將以圖式揭露本發明之複數個實施方式，為明確說明起見，許多實務上的細節將在以下敘述中一併說明。然而，應瞭解到，這些實務上的細節不應用以限制本發明。也就是說，在本發明部分實施方式中，這些實務上的細節是非必要的。此外，為簡化圖式起見，一些習知慣用的結構與元件在圖式中將以簡單示意的方式繪示之。
關於本文中所使用之『包含』、『包括』、『具有』、『含有』等等，均為開放性的用語，即意指包含但不限於。
關於本文中所使用之『及/或』，係包括所述事物的任一或全部組合。另，關於本文中所使用之『連接』、『電性連接』、『電性耦接』，如有說明必須為直接時，則視為兩物件之間的連接關係為直接。
第2圖繪示本發明第一實施方式之觸控面板的結構圖，本發明所提出的觸控面板包括複數個閘級驅動電路以及複數組觸控電路，其中每一個閘極驅動電路可分別連接一組觸控電路，以形成單級觸控閘極驅動電路，使得觸控面板包含多級觸控閘極驅動電路。為了便於說明，各級觸控閘極驅動電路的輸出或輸入訊號則以n來表示某一級的訊號，舉例說明，n為大於零之整數，以第n級來作說明，而其產出的輸出訊號則為G(n)。如第2圖的第一實施例所示，其包括：電壓源Vss、觸控感測輸入訊號ITP、時序訊號CLK1及CLK2、觸發訊號F(n-1)及F(n)、輸出訊號G(n)及G(n+1)、輸入訊號G(n+2)及G(n+3)、第一閘極驅動電路205、第二閘級驅動電路255、第一觸控電路230、第二觸控電路280。其中，第一觸控電路230與第一閘極驅動電路205相接於Q1，而第二觸控電路280與第二閘級驅動電路255相接於Q2。換言之，第一閘極驅動電路205與第一觸控電路230電性耦接，而第二閘極驅動電路255與第二觸控電路230電性耦接。此外，第一閘極驅動電路205與第二閘極驅動電路255分別各自接收不同的時序訊 號CLK1及CLK2。於本實施例中，第一閘極驅動電路205與第一觸控電路230可視為當級(第n級)觸控閘極驅動電路，而第二閘級驅動電路255與第二觸控電路280則可視為下一級(第n+1級)觸控閘極驅動電路。於當級(第n級)觸控閘極驅動電路中，可接收觸發訊號F(n-1)，即為前一級觸控閘極驅動電路所產生之觸發訊號，且當級(第n級)觸控閘極驅動電路可產生觸發訊號F(n)，其可作為下一級(第n+1級)觸控閘極驅動電路所接收之觸發訊號，依此類推。同樣地，於當級(第n級)觸控閘極驅動電路中，可產生輸出訊號G(n)，其可作為前兩級(第n-2級)觸控閘極驅動電路所接收的輸入訊號G(n)(第n-2級並未繪示)，依此類推。
於本實施例中，第一觸控電路230為四個薄膜電晶體與一個電容所組成的架構。舉例而言，第一觸控電路230包含第一開關234、第一電容232、薄膜電晶體236、薄膜電晶體237與薄膜電晶體238。其中，第一電容232透過第一開關234與第一閘極驅動電路205連接，其中第一開關234可以是一個二極體。第一觸控電路230可接收觸控感測輸入訊號ITP、觸發訊號F(n-1)與輸入訊號G(n+2)。詳言之，薄膜電晶體237之第一端接收觸控感測輸入訊號ITP，而薄膜電晶體237之第二端則電性耦接第一開關234，且薄膜電晶體237之閘極控制端為電性耦接薄膜電晶體238，其中第一電容232則分別電性連接於薄膜電晶體237之第二端與閘極控制端。此外，薄膜電晶體238之第一端與閘極控制端相互電性連接以接收觸發訊號F(n-1)，而薄膜電晶體238 之第二端則電性耦接於薄膜電晶體236。薄膜電晶體236之閘極控制端則接收輸入訊號G(n+2)，且薄膜電晶體236之第二端則電性耦接電壓源Vss。但本發明不以此為限，可依不同設計與需求而有不同電晶體或電容數量所組成之觸控電路。
第一閘極驅動電路205包括第一時序電路210及第一下拉電路220，其中，第一時序電路210接收第一時序訊號CLK1與觸發訊號F(n-1)。當第一觸控電路230執行感測時，為了避免其他雜訊干擾而造成感測錯誤，亦即輸入至第一時序電路210的第一時序訊號CLK1與觸發訊號F(n-1)之輸出須為低電位。此外，第一觸控電路230、第一時序電路210與第一下拉電路220彼此透過Q1點而電性耦接，使得可產生輸出訊號G(n)與觸發訊號F(n)，其中觸發訊號F(n)可作為下一級閘極驅動電路的觸發訊號。如第2圖之實施例所示，第一閘級驅動電路210所產生之觸發訊號F(n)可作為下一級之第二閘級驅動電路255的輸入訊號，如觸發訊號F(n)。
如第2圖所示之實施例中，第二觸控電路280具有一第二電容282及第二開關284。第二電容282透過第二開關284與第二閘極驅動電路255連接，其中第二開關284可以是一個二極體。具體而言，第二觸控電路280與上述之第一觸控電路230大致相同，僅差異在輸入訊號的不同，如第二觸控電路280係接收輸入訊號G(n+3)與觸發訊號F(n)。第二閘極驅動電路255亦包括第二時序電路260及第二下拉電路270，其中，第二時序電路260接收第二時序訊 號CLK2與觸發訊號F(n)。同樣地，當第二觸控電路280執行感測時，為了避免其他雜訊干擾而造成感測錯誤，第二時序訊號CLK2之輸出須為低電位。
請參閱第2圖之第一實施例，第一觸控電路230之A1點與第二觸控電路280之A2點相互連接，形成第一電容232和第二電容282並聯連接。詳細說明，以第1圖的習知架構中，假設至少須提供具有一大電容值為C之觸控電路，才可達到預期Q點保持高電位，而根據第一觸控電路230與第二觸控電路280的電容並聯，使得第一電容232及第二電容282的電容值分別只需要C/2，即可達到預期防止電量漏光效果。換言之，第一電容232及第二電容282兩者並聯之後，每一級觸控電路之電容效應所產生的電容值仍是C，仍可避免因觸控感測時間過久，所造成的電量Q漏電問題。因此，於本實施例中，透過第一觸控電路230與第二觸控電路280的電容並聯設計，使得各觸控電路中之電容所需的電容值變小，進而減少相應設置電容的面積。同時，當將此設計應用於陣列上閘極驅動電路(Gate driver on array circuit,GOA)之結構時，可利用較小的基板面積來設置閘極驅動電路，以達到窄邊框(slim boarder)的優勢。
第3圖繪示本發明第二實施方式之觸控面板的結構圖，第3圖所揭示的實施例包括三個閘極驅動電路及觸控電路。本發明第3圖實施例中，除了第2圖所揭示的兩個閘極驅動電路及觸控電路，尚包括第三閘極驅動電路305及第三觸控電路330。第三閘極驅動電路305包括第三時序電路 310及第三下拉電路320。同樣地，於第3圖之實施例中，第三閘極驅動電路305與第三觸控電路330與第2圖之實施例所說明之閘極驅動電路與觸控電路大致相同。於本實施例中，第三閘級驅動電路305與第三觸控電路330可視為當級觸控閘級驅動電路，而第一閘級驅動電路205與第一觸控電路230為下一級觸控閘級驅動電路，第二閘級驅動電路255與第二觸控電路280則為下二級觸控閘級驅動電路。
於第3圖中，每一級之觸控電路皆可接收觸控感測輸入訊號ITP、觸發訊號F(n)與輸出訊號G(n)，舉例說明，以當級之第三觸控電路330來說，其可輸入觸控感測輸入訊號ITP、觸發訊號F(n-2)與後級之輸出訊號G(n+1)。同樣地，下一級之第一觸控電路230來說，則可接收觸控感測輸入訊號ITP、觸發訊號F(n-1)與後級之輸出訊號G(n+2)，後續觸控電路的輸入訊號則依此類推，不贅述。另外，每一級之時序電路皆可接收觸發訊號F(n)與時序訊號，且產生輸出訊號G(n)。如以當級之第三時序電路310來說明，則其可接收觸發訊號F(n-2)與時序訊號CLK0，且可產生輸出訊號G(n-1)。同樣地，下一級之第三時序電路210則可接收觸發訊號F(n-1)與時序訊號CLK1，而產生輸出訊號G(n)。後續時序電路的輸入與輸出訊號則依此類推，在此不贅述。此外，每一級之觸控電路、時序電路與下拉電路220彼此透過Q點而電性耦接，使得可產生輸出訊號G(n)與觸發訊號F(n)，其中觸發訊號F(n)可作為下一級閘極驅動電路的觸發訊號。如第3圖之實施例所示，第三閘級驅 動電路305所產生之觸發訊號F(n-1)可作為下一級之第一閘級驅動電路205的輸入訊號，如觸發訊號F(n-1)。
請參閱第3圖的實施例，第三觸控電路330之A0點、第一觸控電路230之A1點及第二觸控電路280之A2點相互連接，形成第三電容332、第一電容232及第二電容282並聯連接。詳細說明，以第1圖的架構中，假設至少須提供具有一大電容值為C之觸控電路，才可達到預期Q點保持高電位，而根據第一觸控電路230、第二觸控電路280及第三觸控電路330的電容並聯，使得第一電容232、第二電容282及第三電容332的電容值分別只需要C/3，即可達到預期防止電量漏光效果。換言之，第一電容232、第二電容282及第三電容332三者並聯之後，每一級觸控電路之電容效應所產生的電容值仍是C，仍可避免因觸控感測時間過久，所造成的電量Q漏電問題。因此，於本實施例中，透過第一觸控電路230、第二觸控電路280及第三處控電路330的電容並聯設計，使得各觸控電路中之電容所需的電容值變小，進而減少相應設置電容的面積。同時，當將此設計應用於陣列上閘極驅動電路之結構時，可利用較小的基板面積來設置閘極驅動電路，以達到窄邊框的優勢。
具體而言，本發明之實施例中的觸控面板可包括：複數個閘極驅動電路、複數個觸控電路、複數個電容及N個時序訊號，而複數個觸控電路，分別連接至該些閘極驅動電路，且複數個電容分別設置於該些觸控電路中。如此一來，每一個閘極驅動電路搭配一個觸控電路可形成一級觸控 閘極驅動電路，使得觸控面板可具有多級觸控閘極驅動電路。另外，於多級觸控閘極電路中，有M個電容以並聯方式連接，且可接收N個時序訊號，其中N、M皆為正整數，而M大於1，且M小於N。
換言之，多個閘極驅動電路以串接方式連接以形成一多級移位暫存器電路，且N個時序訊號依序且周期性排列地輸入至多級移位暫存器電路。於本實施例中，電容之第二端電性耦接至設於相同之該些觸控電路中的第一開關，且有M個電容之第一端皆相互電性連接以形成並聯。
第4A圖繪示本發明第三實施方式之觸控面板的示意圖，第4B圖繪示第4A圖電路輸出的訊號波型圖，其中為便於說明，第4A圖及第4B圖之實施例是繪示出六級觸控閘級驅動電路(或六級移位暫存器電路)來說明。於本實施例中，時序訊號為四種時序訊號，分別為CLK1、CLK2、CLK3與CLK4，且依序、週期性地輸出多級移位暫存器電路(第一級閘級驅動電路、第二級閘級驅動電路、第三級閘極驅動電路、第四級閘級驅動電路、第五級閘極驅動電路、第六級閘極驅動電路...)。於第4A圖所示，第一級觸控閘極驅動電路接收一初始觸發信號Vst(第一級觸控閘極驅動電路所接收的觸發訊號則為初始觸發信號Vst)，而第一級觸控閘極驅動電路能產生觸發信號F(1)，以作為第二級觸控閘極驅動電路所接收的觸發訊號。依此類推，每一級觸控閘極驅動電路可接收前一級觸控閘極驅動電路所產生之觸發訊號F(n-1)，且產生觸發訊號F(n)，如以第4A圖之第二級觸控閘極驅動電路來說明，第二級觸控 閘極驅動電路可接收觸發訊號F(1)，而產生觸發訊號F(2)，以作為第三級觸控閘級驅動電路之接收的觸發訊號。在第4A圖及第4B圖的實施例中，各閘極驅動電路與各觸控電路的連接方式，如前述之實施例所呈現，故不再贅述。然而，第三實施例在並聯態樣與前二實施例有部分差異，將詳述如下。
在第4A圖的實施例中，前四級閘極驅動電路為一組，其時序訊號分別是CLK1、CLK2、CLK3及CLK4(虛線框示)，後兩級閘極驅動電路為另一組，其時序訊號分別是CLK1、CLK2。第一級觸控電路具有電容412，第二級觸控電路具有電容422，第三級觸控電路具有電容432，且電容412、電容422及電容432透過B1、B2及B3點進行並聯，以達到可以縮減電容面積的效果。
本實施例之時序訊號有四個，分別是CLK1、CLK2、CLK3及CLK4，以每四級之閘級驅動電路為一組，且分別輸入不同的時序訊號，即N=4。以觸控電路之電容並聯的角度來看時，則是以每三級之觸控電路來形成電容並聯，即M=3，但本發明不以此為限，以四個時序訊號來說，則可以每兩級或每三級之觸控電路來形成電容並聯，滿足M小於N即可。因此，觸控電路之電容並聯的級數需小於或等於時序訊號的個數，觸控面板效能才能維持在最佳狀態。舉例說明，當以八個時序訊號作為輸入訊號時，則可有每二級至每七級之觸控電路來形成電容並聯，而以十六個時序訊號作為輸入訊號時，則可有每二級至每十五級之觸控電路來形成電容並聯。
於上述的實施例中，觸控電路以四個電晶體與一個電容所組成的電路架構來說明，但發明不以此為限，請參閱第5A、5B與5C圖，其中第5A、5B與5C分別為觸控電路之不同實施例，且為便於說明，各級觸控閘極驅動電路的輸出或輸入訊號則以n來表示某一級的訊號，舉例說明，n為大於零之整數，以第n級來作說明，而其產出的輸出訊號則為G(n)。如第5A圖所示，觸控電路可為四個電晶體與一個電容所組成，且可接收輸入訊號G(n-1)、輸入訊號G(n)、觸控感測輸入訊號ITP、電壓源Vss所提供的電壓與重置訊號Reset，而Q點則連接至閘極驅動電路。詳細來說，於第5A圖之實施例中，觸控電路具有第一薄膜電晶體510、第二薄膜電晶體520、第三薄膜電晶體530、第四薄膜電晶體540與第一電容550。第一薄膜電晶體510之第一端可接收觸控感測輸入訊號ITP、第二端可電性連接第二薄膜電晶體520之第一端，而閘極控制端則可接收輸入訊號G(n-1)。第二薄膜電晶體520之第二端可接收電壓源Vss所提供的電壓，而閘極控制端則可接收輸入訊號G(n)。第三薄膜電晶體530之第一端可接收重置訊號Reset，閘極控制端則電性連接第一薄膜電晶體510之第二端。第四薄膜電晶體540之第一端電性連接第三薄膜電晶體530之第二端，閘極控制端則輸入重置訊號Reset，而第二端則為Q點，其中Q點係作為電性連接至同級之閘極驅動電路(未繪示)。另外，第一電容550之兩端則分別電性連接第三薄膜電晶體530之閘極控制端與第二端，使得P點形成於第一電容550之一端，其中P點係 作為電性連接至不同級之觸控電路的第一電容，以形成多個電容的並聯效果。原則上，各訊號的操作與前述相同，而重置訊號Reset係為進行觸控感應(觸控感測輸入訊號ITP作動)時，才啟動為高電位，進而使得Q點能夠保持高電位。於本實施例中，重置訊號Reset為高電位時，可補充電荷於Q點，避免因觸控感應時間長而造成Q點電位下降，使得觸控感應後而無法正常將閘極驅動電路的輸出訊號傳遞至下級。
第5B圖所描述的觸控電路結構大致上同於第5A圖，差異僅在於在第二薄膜電晶體520的閘極控制端為接收時序訊號CLK，電路運作及功效同於第5A圖說明，此處不再贅述。相較於第5A圖，第5C圖的主要差異在於其所揭示的觸控電路實施例，結構上更加上第五薄膜電晶體560。在第5C圖的實施例中，第五薄膜電晶體560的閘極控制端為接收時序訊號CLK，且第五薄膜電晶體560的第一端與第一薄膜電晶體510的第二端相連接，第五薄膜電晶體560第二端則接收電壓源Vss所提供的電壓，電路運作及功效同於第5A圖說明，此處不再贅述。
本發明所提出的觸控面板，將兩級以上的閘極驅動電路及觸控電路並聯，以達到電容共享的目的。在電容共享的作用下，各級觸控電路所包括的電容值就可以倍數減小。如此一來，即可避免因為外加大容量電容，相應電路板面積需增加，而導致製造成本提高之問題。
雖然本發明已以多種實施方式揭露如上，然其並 非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作各種之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
205‧‧‧第一閘極驅動電路
210‧‧‧第一時序電路
220‧‧‧第一下拉電路
230‧‧‧第一觸控電路
232‧‧‧第一電容
234‧‧‧第一開關
236‧‧‧薄膜電晶體
237‧‧‧薄膜電晶體
238‧‧‧薄膜電晶體
255‧‧‧第二閘極驅動電路
260‧‧‧第二時序電路
270‧‧‧第二下拉電路
280‧‧‧第二觸控電路
282‧‧‧第二電容
284‧‧‧第二開關
286‧‧‧薄膜電晶體
ITP‧‧‧觸控感測輸入訊號
CLK1、CLK2‧‧‧時序訊號
F(n-1)、F(n)、F(n+1)‧‧‧訊號
G(n)、G(n+1)、G(n+2)、G(n+3)‧‧‧訊號
Vss‧‧‧電壓源

Claims (10)

  1. 一種觸控面板，包括：一第一閘極驅動電路；一第一觸控電路，電性耦接至該第一閘極驅動電路，且該第一觸控電路具有一第一電容；一第二閘極驅動電路；以及一第二觸控電路，電性耦接至該第二閘極驅動電路，且該第二觸控電路具有一第二電容，其中，該第一電容與該第二電容並聯連接。
  2. 如申請專利範圍第1項的觸控面板，其中該第一觸控電路更包括：一第一開關，該第一電容透過該第一開關與該第一閘極驅動電路而電性連接。
  3. 如申請專利範圍第1項的觸控面板，其中該第二觸控電路更包括：一第二開關，該第二電容透過該第二開關與該第二閘極驅動電路而電性連接。
  4. 如申請專利範圍第2項的觸控面板，其中該第一閘極驅動電路更包括：一第一時序電路；以及一第一下拉電路，分別電性耦接於該第一時序電路與 該第一觸控電路，且該第一電容透過該第一開關連接至該第一下拉電路。
  5. 如申請專利範圍第4項的觸控面板，其中該第一時序電路接收一第一時序訊號，而該第一觸控電路接收一觸控感測輸入訊號，當該觸控感測輸入訊號為高電位時，則該第一時序訊號為低電位。
  6. 如申請專利範圍第3項的觸控面板，其中該第二閘極驅動電路更包括：一第二時序電路；以及一第二下拉電路，分別耦接至該第二時序電路及該第二觸控電路，且該第二電容透過該第二開關連接至該第二下拉電路。
  7. 一種觸控面板，包括：複數個閘極驅動電路；複數個觸控電路，分別電性連接至該些閘極驅動電路，使得該些閘極驅動電路與該些觸控電路可形成一多級觸控閘極驅動電路；複數個電容，分別設置於該些觸控電路中，且具有M個電容以並聯方式連接；以及N個時序訊號，分別電性傳遞至該些閘極驅動電路，其中N、M皆為正整數，M大於1，且M小於N。
  8. 如申請專利範圍第7項的觸控面板，其中該些閘極驅動電路則以串接方式連接以形成一多級移位暫存器電路，且該N個時序訊號依序且周期性排列地輸入至該多級移位暫存器電路。
  9. 如申請專利範圍第7項的觸控面板，該些觸控電路分別包含一第一開關，而該些觸控電路分別藉由該第一開關而與該複數個閘極驅動電路連接。
  10. 如申請專利範圍第9項的觸控面板，其中該些電容分別具有一第一端與一第二端，而該第二端電性耦接至設於相同之該些觸控電路中的該第一開關，且M個電容之該第一端皆相互電性連接以形成並聯。
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