TWI556217B - 電源管理電路及其閘極脈衝調變電路 - Google Patents
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Description
本發明係有關於一種電源管理電路及其閘極脈衝調變電路,尤其關於一種可提升電源轉換效率的電源管理電路及其閘極脈衝調變電路。
一般來說,液晶顯示(liquid crystal display,LCD)裝置中任一子畫素包含有一薄膜電晶體(Thin film transistor,TFT)及一液晶電容,而由於薄膜電晶體之閘極與源極間存在有一寄生電容,因此液晶電容所儲存之電荷於放電期間會受寄生電容耦合影響,而影響所欲顯示之影像資料。
舉例來說,請參考第1圖,第1圖為習知一液晶顯示裝置中一子畫素10之示意圖。如第1圖所示,子畫素10包含有一薄膜電晶體100及一液晶電容102,薄膜電晶體100之閘極與源極間存在有一寄生電容CGD。液晶顯示裝置之一時序控制器進行時序控制,使得一掃描線GL之一閘極驅動電壓於一閘極高準位電壓VGH時可導通薄膜電晶體100,因此一資料線SL可將液晶電容102充電至所欲顯示之準位以顯示影像資料。然而,於掃描線GL之閘極驅動電壓切換至一閘極低準位電壓VGL以關閉薄膜電晶體100時,由於薄膜電晶體100之閘極與源極間存在有一寄生電容CGD,因此薄膜電晶體100之閘極的電壓切換(即由閘極高準位電壓VGH至閘極低準位電壓VGL),會透過寄生電容CGD耦合至薄膜電晶體100之源極而影響液晶電容102所儲存之電位,進而影響所欲顯示之影像資料。
在此情況下,請參考第2A圖,第2A圖為習知降低如第1圖所示寄生電容CGD耦合效應之示意圖。如第2A圖所示,相較於直接將掃描線GL由閘極高準位電壓VGH切換至閘極低準位電壓VGL(如左半部所示),為了降低寄生電容CGD耦合效應,習知掃描線GL由閘極高準位電壓VGH切換至閘極低準位電壓VGL以關閉薄膜電晶體100的過程中,會由閘極高準位電壓VGH先以一放電斜率降至0V後再降至閘極低準位電壓VGL(如右半部所示)。如此一來,寄生電容CGD兩端瞬間跨壓變化降低,因此可有效降低薄膜電晶體100之閘極對薄膜電晶體100之源極的耦合效應。
細言之,請參考第2B圖,第2B圖為用來實現第2A圖右半部功能之一閘極脈衝調變(Gate Pulse Modulation)電路20之方塊示意圖。如第2B圖所示,閘極脈衝調變電路20包含有腳位200~206,腳位200用來接收一開關控制訊號VFLK(可由時序控制器提供),腳位202用來接收閘極高準位電壓VGH,腳位204耦接一放電電阻RE至地(0V),腳位206用來輸出一閘極控制訊號VGHM予液晶顯示裝置中所有子畫素之薄膜電晶體之閘極,其中,一等效總合寄生電容C_VGHM可等效為所有子畫素之薄膜電晶體之閘極與源極間寄生電容之總合,因此閘極控制訊號VGHM會同時對等效總合寄生電容C_VGHM充放電。
關於閘極脈衝調變電路20之具體操作,於一閘極充電期間,開關控制訊號VFLK為高準位,致使閘極控制訊號VGHM為閘極高準位電壓VGH,同時將等效總合寄生電容C_VGHM充電至閘極高準位電壓VGH。另外,於一閘極放電期間,開關控制訊號VFLK為低準位,致使閘極控制訊號VGHM一開始等於等效總合寄生電容C_VGHM之電壓,且此電壓會經由放電電阻RE而放電至0V。
然而,習知做法閘極脈衝調變電路20係於閘極放電期間將等效總合寄生電容C_VGHM所儲存之電荷放電至地,無法有效利用。有鑑於此,習知技術實有改進之必須,以增加電源效率。
因此,本發明之目的之一即在於提供一種可於一閘極放電期間將寄生電容上所儲存之寄生電荷轉移至電源管理晶片之任一輸入電壓或輸出電壓循環使用,以提升電源之轉換效率的電源管理電路及其閘極脈衝調變電路。
於一實施例中,揭露一種電源管理電路,用於一液晶顯示裝置中。該電源管理電路包含有一至多個電源產生電路,分別接收一至多個輸入電壓,以及產生一至多個輸出電壓;一閘極脈衝調變電路,耦接於一閘極高準位電壓源與一放電控制端之間,用以產生一閘極控制訊號;以及一放電控制器,耦接至該放電控制端,用以提供該閘極脈衝調變電路之一放電路徑,其中該閘極脈衝調變電路與該放電控制器當中之一者係更耦接至一供應電源,以使該閘極脈衝調變電路於一閘極放電期間放電至該供應電源,以及該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者。
於另一實施例中,揭露一種電源管理電路,用於一液晶顯示裝置中。該電源管理電路包含有一至多個電源產生電路、一閘極脈衝調變電路以及一放電控制器。該一至多個電源產生電路分別接收一至多個輸入電壓,以及產生一至多個輸出電壓;該閘極脈衝調變電路包含有一充電開關,耦接一閘極高準位電壓源與一閘極控制端之間;以及一放電開關,耦接於該閘極控制端與一放電控制端之間。該放電控制器,耦接至該放電控制端與一供應電源之間,用以提供該閘極脈衝調變電路之一放電路徑,其中該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者。
於更另一實施例中,揭露一種閘極脈衝調變電路,用於產生一液晶顯示裝置之閘極控制訊號。該閘極脈衝調變電路包含有一充電開關,耦接至一閘極高準位電壓源與一閘極控制訊號輸出端之間;一電流鏡,耦接於該閘極控制訊號輸出端以及該放電控制端之間;以及一放電開關,耦接於電流鏡與一供應電源之間。
於更另一實施例中,揭露一種電源管理電路,該電源管理電路包含有上述之閘極脈衝調變電路電源管理電路;以及一至多個電源產生電路,分別接收一至多個輸入電壓,以及產生一至多個輸出電壓。
請參考第3圖,第3圖為本發明實施例中用於一液晶顯示裝置之一電源管理電路30之示意圖,如第3圖所示,電源管理電路30可實施為一晶片,並包括一閘極脈衝調變(Gate Pulse Modulation)電路308,其接收並調變一閘極高準位電壓源VIN5。一放電控制器310(譬如以一放電電阻RE’實施)可耦接於一放電控制端與一供應電源(具有供應電壓VSUP)之間,用於提供閘極脈衝調變電路308一放電路徑。另外,電源管理電路30更包含一至多個電源產生電路,譬如是下列電路當中至少之一者:一直流對直流轉換器(DC/DC converter)300、一低壓降穩壓器(Low drop out regulator,LDO regulator)302、一電壓緩衝器304、以及一其它電源產生電路306,其分別接收輸入電壓VIN1~VIN4,以及依據所接收之輸入電壓來提供輸出電壓VOUT1~VOUT4。
此實施例之一主要特徵在於閘極脈衝調變電路308之供應電源係選為輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者。在此配置下,閘極脈衝調變電路308可於一閘極放電期間,經由放電電阻RE’將一閘極控制訊號VGHM’(即一等效總合寄生電容C_VGHM’之電壓)放電至該供應電源。值得注意的是,此實施例係繪示放電控制器310設置於電源管理電路30之外部,但其他實施例可設置於內部。
相較於圖2中閘極脈衝調變電路20於一閘極放電期間,放電至0V而無法有效利用等效總合寄生電容C_VGHM所儲存之電荷,本實施例之放電電阻RE’耦接至供應電源,而供應電源係直接取用輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者,因此本實施例除了可降低液晶顯示裝置中所有子畫素之薄膜電晶體之閘極對源極間的耦合效應外,還可將等效總合寄生電容C_VGHM’所儲存之寄生電荷循環使用,從而在毋須額外設置其他的電壓源以提供供應電源的情況下就可以提升電源之轉換效率。
細言之,請參考第4A圖,第4A圖為依據一實施例之第3圖中閘極脈衝調變電路308之方塊示意圖。如第4A圖所示,閘極脈衝調變電路308包含有腳位400~406,腳位400用來接收一開關控制訊號VFLK’(可由時序控制器提供),腳位402用來接收一閘極高準位電壓VGH’,腳位404耦接放電電阻RE’至供應電源之供應電壓VSUP,腳位406用來輸出閘極控制訊號VGHM’予液晶顯示裝置中複數個(譬如為全部)子畫素之薄膜電晶體之閘極。等效總合寄生電容C_VGHM’可等效為複數個(譬如全部)子畫素之薄膜電晶體之閘極與源極間寄生電容之總合,因此閘極控制訊號VGHM’可同時對等效總合寄生電容C_VGHM’充放電。另外,閘極高準位電壓VGH’可視為第3圖中之閘極高準位電壓源VIN5。在此配置下,閘極控制訊號VGHM’是放電到電源管理電路30的其中一個輸入或輸出電壓。換言之,閘極控制訊號VGHM’在儲存階段(開關控制訊號VFLK='HI')所儲存的電荷,會回收給電源管理電路30的其中一個輸入或輸出電壓,因此可提升電源管理電路30的轉換效率。
具體而言,請參考第4B圖與第4C圖,第4B圖為依據一實施例如第4A圖所示之閘極脈衝調變電路308之電路示意圖,第4C圖為依據一實施例如第4B圖所示之閘極脈衝調變電路308之操作示意圖。如第4B圖所示,閘極脈衝調變電路308內包含有一充電開關408以及一放電開關410。另外,放電開關410可透過放電控制器310(譬如為放電電阻RE’)耦接至供應電源。充電開關408耦接於一閘極高準位電壓源(提供閘極高準位電壓VGH’)與液晶顯示裝置之等效總合寄生電容容C_VGHM’(即閘極控制訊號輸出端VGHM’)之間。放電開關410耦接於等效總合寄生電容C_VGHM’與該放電控制端之間。放電控制器310耦接於該放電控制端與供應電源之間,其中供應電源為輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者。另外,充電開關408與放電開關410係分別由開關控制訊號VFLK’及開關控制訊號VFLK’之一反相訊號VFLK_INV’進行控制。
在此情況下,如第4C圖所示,於一閘極充電期間,開關控制訊號VFLK’為高準位而反相訊號VFLK_INV’為低準位,充電開關408導通而放電開關410關閉,因此閘極控制訊號VGHM’為閘極高準位電壓VGH’,同時將等效總合寄生電容C_VGHM’充電至閘極高準位電壓VGH’。接下來,於一閘極放電期間,開關控制訊號VFLK’轉為低準位而反相訊號VFLK_INV’轉為高準位,充電開關408關閉而放電開關410導通,因此閘極控制訊號VGHM’一開始會等於等效總合寄生電容C_VGHM’先前所儲存之電壓,亦即閘極高準位電壓VGH’,繼而等效總合寄生電容C_VGHM’會經由放電控制器310由閘極高準位電壓VGH’放電至供應電壓VSUP。換言之,此階段是將等效總合寄生電容C_VGHM’所儲存之寄生電荷轉移至供應電源之一電容C_SUP進行儲存。
其中,在閘極放電期間閘極控制訊號VGHM’(等效總合寄生電容C_VGHM’之電壓)由閘極高準位電壓VGH’放電至供應電壓VSUP之一放電斜率可由等效總合寄生電容C_VGHM’之電容值及放電電阻RE’之電阻值所決定。因此,藉由調整放電電阻RE’之電阻值,可以調整放電斜率而達到所欲顯示效果。如此一來,由於閘極控制訊號VGHM’透過可調整之放電斜率進行切換放電斜率,因此跨壓變化可較小,進而有效降低所有子畫素之薄膜電晶體之閘極對源極間的耦合效應。另外,由於供應電壓為輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者,因此可將等效總合寄生電容C_VGHM’所儲存之寄生電荷循環使用,以提升電源之轉換效率。
值得注意的是,本實施例之主要精神在於於閘極放電期間將閘極控制訊號VGHM’(即等效總合寄生電容C_VGHM’之電壓)放電至供應電源,且此供應電源為電源管理電路30之輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者,因此可將等效總合寄生電容C_VGHM’所儲存之寄生電荷循環使用,以提升電源之轉換效率。本領域具通常知識者當可據以修飾或變化,而不限於此。舉例來說,上述實施例係繪示供應電源透過腳位404外接於閘極脈衝調變電路308之晶片外部,然而實際上供應電源亦可直接接於電源管理電路30之內部進行利用。此外,供應電源亦不限於電源管理電路30之輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者,可為電源管理電路30其它輸入電壓或輸出電壓,且亦可為一系統應用電路之至少一輸入電壓及至少一輸出電壓當中一者,以供系統應用電路循環使用。再者,放電控制器310之實現方式亦不限於上述以耦接於等效總合寄生電容C_VGHM’與供應電源之間之放電電阻RE’實施,而可以其它方式實施,只要能於閘極放電期間控制閘極控制訊號VGHM’(即等效總合寄生電容C_VGHM’之電壓)之放電斜率即可。
舉例來說,請參考第5A圖至第5D圖,第5A圖為本發明另一實施例中用於一液晶顯示裝置之另一電源管理電路50之示意圖。第5B圖為如第5A圖所示之一閘極脈衝調變電路508之方塊示意圖,第5C圖為如第5A圖所示之閘極脈衝調變電路508之電路示意圖,第5D圖為如第5A圖所示之閘極脈衝調變電路508之操作示意圖。電源管理電路50及閘極脈衝調變電路508之架構與運作原理與電源管理電路30及閘極脈衝調變電路308部分相似,因此用途相同的元件及信號沿用相同符號,以求簡潔。如第5A圖及第5B圖所示,閘極脈衝調變電路508與閘極脈衝調變電路308之主要差別在於,相較於閘極脈衝調變電路308透過腳位404耦接放電電阻RE’至供應電源之供應電壓VSUP(即由放電控制器310耦接至供應電源),閘極脈衝調變電路508以一腳位502耦接一放電電阻RE’至地(0V),再新增一腳位500耦接供應電源之供應電壓VSUP。換言之,即由閘極脈衝調變電路508本身額外耦接至供應電源。值得注意的是,此實施例係繪示放電控制器310或放電電阻RE’設置於電源管理電路50之外部,但其他實施例可設置於內部。
在此情況下,如第5C圖所示,其為依據一實施例之如第5B圖所示之閘極脈衝調變電路508之電路實施方式。閘極脈衝調變電路508之架構主要與閘極脈衝調變電路308類似,但另包含一電流鏡506耦接於等效總合寄生電容C_VGHM’(即閘極控制訊號輸出端)以及該放電控制端之間。換言之,閘極脈衝調變電路508包含一充電開關408,其耦接至一閘極高準位電壓源VGH’與一閘極控制訊號輸出端(輸出閘極控制訊號VGHM’)之間,以及一電流鏡506,耦接於閘極控制訊號輸出端以及一放電控制端(用於耦接至放電控制器310之端點)之間,以及一放電開關410,耦接於電流鏡506與供應電源之間。另外,閘極脈衝調變電路508可透過同樣耦接於該放電控制端之放電控制器310(譬如以一放電電阻RE’實施)而耦接至一地電位,同時透過放電開關410耦接於至供應電源。
於一實施例中,電流鏡506用於鏡射來自寄生電容C_VGHM’之放電電流成為另一路電路透過放電控制端而流動至地。舉例而言,電流鏡506可包含有電晶體M1、M2,電晶體M1之控制端與電晶體M2之控制端係互相耦接。另外,電晶體M1耦接於等效總合寄生電容C_VGHM’與放電開關410之間,而電晶體M2耦接於一電壓與該放電控制端之間。因此,電晶體M1透過放電開關410而耦接至供應電壓,而電晶體M2透過放電電阻RE’而耦接至地。透過調整放電電阻RE’之一電阻值大小,可調整電晶體M2之電流大小,而電晶體M1之電流大小亦會隨之改變,因此亦可達到於閘極放電期間控制閘極控制訊號VGHM’(即等效總合寄生電容C_VGHM’之電壓)之放電斜率之效果。閘極脈衝調變電路508其它操作,可由閘極脈衝調變電路308之操作類推而得,在此不另作贅述。
閘極脈衝調變電路308及閘極脈衝調變電路508之操作可歸納為一電荷循環流程60,如第6圖所示,其包含以下步驟:
步驟600:開始。
步驟602:根據開關控制訊號VFLK’,於閘極充電期間將液晶顯示裝置之等效總合寄生電容C_VGHM’充電至閘極高準位電壓VGH’。
步驟604:根據開關控制訊號VFLK’之一反相訊號VFLK_INV’,於閘極放電期間將等效總合寄生電容C_VGHM’放電至供應電源之供應電壓VSUP。
步驟606:控制等效總合寄生電容C_VGHM於閘極放電期間由閘極高準位電壓VGH’放電至供應電壓之放電斜率;其中,供應電源係電源管理電路30之至少一輸入電壓及至少一輸出電壓當中一者。
步驟608:結束。
其中各步驟之細節可由閘極脈衝調變電路308及閘極脈衝調變電路508之對應組件之操作類推而得,在此不另作贅述。
在習知技術中,閘極脈衝調變電路20係於閘極放電期間將等效總合寄生電容C_VGHM所儲存之電荷放電至地,無法有效利用。相較之下,上述實施例於閘極放電期間將閘極控制訊號VGHM’(即等效總合寄生電容C_VGHM’之電壓)放電至供應電源,且供應電源為電源管理電路30之輸入電壓VIN1~VIN4及輸出電壓VOUT1~VOUT4當中一者,因此可將等效總合寄生電容C_VGHM’所儲存之寄生電荷循環使用,以提升電源之轉換效率。
以上所述僅為本發明之較佳實施例,凡依本發明申請專利範圍所做之均等變化與修飾,皆應屬本發明之涵蓋範圍。
10...子畫素
100...薄膜電晶體
102...液晶電容
20、308、508...閘極脈衝調變電路
200~206、400~406、500、502...腳位
208、408...充電開關
210、410...放電開關
30、50...電源管理電路
300...直流對直流轉換器
302...低壓降穩壓器
304...電壓緩衝器
306...其它電源產生電路
310...放電控制器
506...電流鏡
60...電荷循環流程
600~608...步驟
CGD...寄生電容
GL...掃描線
SL...資料線
VGH、VGH’、VIN5...閘極高準位電壓
VGL...閘極低準位電壓
VFLK、VFLK’...開關控制訊號
RE、RE’...放電電阻
VGHM、VGHM’...閘極控制訊號
C_VGHM、C_VGHM’...等效總合寄生電容
VFLK_INV’...反相訊號
VIN1~VIN4...輸入電壓
VOUT1~VOUT4...輸出電壓
VSUP...供應電壓
C_SUP...電容
M1、M2...電晶體
第1圖為習知一液晶顯示裝置中一子畫素之示意圖。
第2A圖為習知降低如第1圖所示一寄生電容耦合效應之示意圖。
第2B圖為用來實現第2A圖右半部功能之一閘極脈衝調變電路之方塊示意圖。
第3圖為本發明實施例中用於一液晶顯示裝置之一電源管理電路之示意圖。
第4A圖為依據一實施例第3圖中一閘極脈衝調變電路之方塊示意圖。
第4B圖為依據一實施例如第4A圖所示之閘極脈衝調變電路之電路示意圖。
第4C圖為依據一實施例如第4A圖所示之閘極脈衝調變電路之操作示意圖。
第5A圖為本發明另一實施例中用於一液晶顯示裝置之一電源管理電路之示意圖。
第5B圖為依據一實施例如第5A圖所示之一閘極脈衝調變電路之方塊示意圖。
第5C圖為依據一實施例如第5A圖所示之閘極脈衝調變電路之電路示意圖。
第5D圖為依據一實施例如第5A圖所示之閘極脈衝調變電路之操作示意圖。
第6圖為本發明實施例一電荷循環流程之示意圖。
308‧‧‧閘極脈衝調變電路
408‧‧‧充電開關
410‧‧‧放電開關
310‧‧‧放電控制器
VGH’‧‧‧閘極高準位電壓
VFLK’‧‧‧開關控制訊號
RE’‧‧‧放電電阻
VGHM’‧‧‧閘極控制訊號
C_VGHM’‧‧‧等效總合寄生電容
VFLK_INV’‧‧‧反相訊號
VSUP‧‧‧供應電壓
Claims (19)
- 一種電源管理電路,用於一液晶顯示裝置中,包含有:一至多個電源產生電路,分別接收一至多個輸入電壓,以及產生一至多個輸出電壓;一閘極脈衝調變(Gate Pulse Modulation)電路,耦接於一閘極高準位電壓源與一放電控制端之間,用以產生一閘極控制訊號;以及一放電控制器,耦接至該放電控制端,用以提供該閘極脈衝調變電路之一放電路徑,其中該閘極脈衝調變電路與該放電控制器當中之一者係更耦接至一供應電源,以使該閘極脈衝調變電路於一閘極放電期間放電至該供應電源,以及該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者使得該一至多個電源產生電路當中對應一者循環使用所放電之電荷。
- 如請求項1所述之電源管理電路,其中該閘極脈衝調變電路包含有:一充電開關,耦接至該閘極高準位電壓源與一閘極控制訊號輸出端之間;一放電開關,耦接於該閘極控制訊號輸出端與該放電控制端之間。
- 如請求項2所述之電源管理電路,其中該放電控制器係耦接於該放電控制端與該供應電源之間。
- 如請求項1所述之電源管理電路,其中該閘極脈衝調變電路包含有:一充電開關,耦接至該閘極高準位電壓源與一閘極控制訊號輸出端之間;一電流鏡,耦接於該閘極控制訊號輸出端以及該放電控制端之間,用來鏡射來自該閘極控制訊號輸出端之一電流成為另一路電流流通該放電控制端;以及一放電開關,耦接於該電流鏡與該供應電源之間。
- 如請求項4所述之電源管理電路,其中該放電控制器係耦接於該放電控制端與一地電位之間。
- 如請求項1所述之電源管理電路,其中該一至多個電源產生電路係包括一直流對直流轉換器、一低壓降穩壓器、以及一電壓緩衝器當中至少之一者。
- 如請求項1所述之電源管理電路,其中該放電控制器包含有一放電電阻,其耦接於該放電控制端與該供應電源之間。
- 如請求項1所述之電源管理電路,其中該放電控制器包含有一放電電阻,其耦接於該放電控制端與一地電位之間以形成另一放電路徑。
- 如請求項4所述之電源管理電路,其中於一閘極充電期間,回應於一開關控制訊號之第一位準而該充電開關導通以及該放電開關關閉,以將閘極控制訊號輸出端充電,以及於該閘極放電期間,回應於該開關控制訊號之第二位準而該充電開關關閉以及該放電開關導通,以將該閘極控制訊號輸出端之電壓放電至該供應電壓。
- 一種電源管理電路,用於一液晶顯示裝置中,包含有:一至多個電源產生電路,分別接收一至多個輸入電壓,以及產生一至多個輸出電壓;一閘極脈衝調變電路,包含有:一充電開關,耦接至一閘極高準位電壓源與一閘極控制端之間;一放電開關,耦接於該閘極控制端與一放電控制端之間;以及一放電控制器,耦接至該放電控制端與一供應電源之間,用以提供該閘極脈衝調變電路之一放電路徑,其中該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者使得該一至多個電源產生電路當中對應一者循環使用 所放電之電荷。
- 如請求項10所述之電源管理電路,其中該放電控制器包含有一放電電阻,其耦接於該放電控制端與該供應電源之間。
- 如請求項10所述之電源管理電路,其中該一至多個電源產生電路係包括一直流對直流轉換器、一低壓降穩壓器、以及一電壓緩衝器當中至少之一者。
- 一種閘極脈衝調變電路,用以接收一至多個電源產生電路之供電而產生一液晶顯示裝置之閘極控制訊號,該一至多個電源產生電路係分別接收一至多個輸入電壓,以及產生一至多個輸出電壓,該閘極脈衝調變電路包含有:一充電開關,耦接至一閘極高準位電壓源與一閘極控制訊號輸出端之間;一電流鏡,耦接於該閘極控制訊號輸出端以及一放電控制端之間,用來鏡射來自該閘極控制訊號輸出端之一電流成為另一路電流流通該放電控制端;以及一放電開關,耦接於電流鏡與一供應電源之間,其中該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者使得該一至多個電源產生電路當中對應一者循環使用所放電之電荷。
- 一種電源管理電路,包含有:一至多個電源產生電路,分別接收一至多個輸入電壓,以及產生一至多個輸出電壓;以及一閘極脈衝調變電路,包含有:一充電開關,耦接至一閘極高準位電壓源與一閘極控制訊號輸出端之間;一電流鏡,耦接於該閘極控制訊號輸出端以及一放電控制端之間,用來鏡射來自該閘極控制訊號輸出端之一放電電流成為另一路電流流通該放電控制端;以及一放電開關,耦接於電流鏡與一供應電源之間,該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者,其中該供應電源係該一至多個輸入電壓與該一至多個輸出電壓當中之一者使得該一至多個電源產生電路當中對應一者循環使用所放電之電荷。
- 如請求項14所述之電源管理電路,更包括:一放電控制器,耦接至該放電控制端,用以提供該閘極脈衝調變電路之一放電路徑。
- 如請求項15所述之電源管理電路,其中該放電控制器係耦接於該放電控制端與一地電位之間。
- 如請求項15所述之電源管理電路,其中該放電控制器包含有一 放電電阻,其耦接於該放電控制端與一地電位之間。
- 如請求項14所述之電源管理電路,其中該一至多個電源產生電路係包括一直流對直流轉換器、一低壓降穩壓器、以及一電壓緩衝器當中至少之一者。
- 如請求項14所述之電源管理電路,其中該電流鏡係包括:第一電晶體,其耦接於該閘極控制訊號輸出端與該放電開關之間;以及第二電晶體,其具有一控制端耦接至該第一電晶體之一控制端,且其耦接於一電源與該放電控制端之間。
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