TWI383353B - 平面顯示器及其驅動方法 - Google Patents

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Description

平面顯示器及其驅動方法
本發明是有關於一種平面顯示器及其驅動方法，且特別是有關於一種可以降低額緣寬度之平面顯示器及其驅動方法。
請參照第1圖，其繪示乃傳統平面顯示器之閘極驅動單元之位移暫存器之電路圖。於位移暫存器100中，當第一電晶體T1及第三電晶體T3之汲極端接收一相當大之高準位偏壓時，例如為16伏特，則節點P1會被偏壓在此相當大之高準位偏壓。
然而，節點P1之高準位偏壓會對第二電晶體T2及第六電晶體T6之閘極造成過度的偏壓，導致第二電晶體T2及第六電晶體T6各自之臨界電壓隨著時間而發生相當程度的上升。隨著臨界電壓的上升，第二電晶體T2對節點P2之放電能力減弱，故要花費更多的時間以截止第五電晶體T5。這將導致輸出端OUT歸屬之掃描訊號線接收錯誤的資料，閘極驅動器因而產生誤動作。
為了解決上述之問題，故於第三電晶體T3之汲極端提供一額外的直流電壓源，以額外提供一工作電壓Vdd，其值小於原本最高準位電壓，以降低第二電晶體T2及第六電晶體T6之閘極偏壓。然而，需額外製作一電路以提供此直流電壓源。如此一來，附加於玻璃基板邊緣並用以 傳導之大寬度電壓源走線(power line)將增加玻璃基板之額緣寬度，並且額外的直流電壓源亦增加整體成本。
本發明係有關於一種平面顯示器及其驅動方法，利用位移暫存器內之簡單電路以提供一直流準位電壓，不需額外的直流電壓源，即可降低位移暫存器內之電晶體之閘極偏壓，因此可以降低額緣寬度與成本。
根據本發明之第一方面，提出一種平面顯示器，包括玻璃基板、源極驅動單元以及閘極驅動單元。玻璃基板具有多個畫素。源極驅動單元電性連接至此些畫素。閘極驅動單元具有一非晶矽閘極結構，閘極驅動單元具有N個位移暫存器，N為正整數。第n位移暫存器包括上拉單元、驅動單元、下拉單元及驅動控制單元，n為1~N之正整數。上拉單元耦接至一輸出端。驅動單元驅動上拉單元。下拉單元耦接至輸出端。驅動控制單元提供一直流準位電壓並驅動下拉單元。其中，當驅動單元依據一觸發訊號導通上拉單元，上拉單元依據一第一時脈訊號使得輸出端輸出一第n輸出訊號時，驅動控制單元截止下拉單元，觸發訊號為一第n-1輸出訊號。其中，輸出端輸出第n輸出訊號後，驅動控制單元依據一第二時脈訊號提供直流準位電壓以驅動下拉單元，下拉單元依據一低準位電壓使得輸出端輸出低準位電壓，第二時脈訊號為第一時脈訊號之反相訊 號。
根據本發明之第二方面，提出一種平面顯示器驅動方法，平面顯示器具有玻璃基板、源極驅動單元以及閘極驅動單元。玻璃基板具有多個畫素，源極驅動單元電性連接至此些畫素。閘極驅動單元具有一非晶矽閘極結構，閘極驅動單元具有N個位移暫存器，N為正整數。第n位移暫存器包括上拉單元、驅動單元、下拉單元及驅動控制單元，n為1~N之正整數。上拉單元耦接至一輸出端，驅動單元驅動上拉單元，下拉單元耦接至輸出端，驅動控制單元提供一直流準位電壓並驅動下拉單元。平面顯示器驅動方法包括，首先，當驅動單元依據一觸發訊號導通上拉單元，上拉單元依據一第一時脈訊號使得輸出端輸出一第n輸出訊號時，驅動控制單元截止下拉單元，觸發訊號為一第n-1輸出訊號。之後，當輸出端輸出第n輸出訊號後，驅動控制單元依據一第二時脈訊號提供直流準位電壓以驅動下拉單元，下拉單元依據一低準位電壓使得輸出端輸出低準位電壓，第二時脈訊號為第一時脈訊號之反相訊號。
為讓本發明之上述內容能更明顯易懂，下文特舉一較佳實施例，並配合所附圖式，作詳細說明如下：
本發明係提供一種平面顯示器及其驅動方法，利用閘極驅動單元之位移暫存器內之自身電路，提供一直流準位 電壓，如此一來，不需要額外增加直流電壓源，即可降低位移暫存器內之電晶體之閘極偏壓，因此可以降低額緣寬度與周邊電路複雜度，進而節省成本。
請參照第2圖，其繪示乃依照本發明較佳實施例之平面顯示器之示意圖。平面顯示器200包括一玻璃基板210、一源極驅動單元220以及一閘極驅動單元230。玻璃基板210具有多個畫素(未繪示於圖)。源極驅動單元220電性連接至此些畫素。閘極驅動單元230位於玻璃基板210上，且電性連接至此些畫素。閘極驅動單元230具有一移位暫存器結構。
閘極驅動單元230具有N個位移暫存器，N為正整數。請參照第3圖，其繪示乃依照本發明較佳實施例之閘極驅動單元230之示意圖。閘極驅動單元230內具有多個位移暫存器(Shift Register)23n(x=1~N)。請參照第4圖，其繪示乃依照本發明較佳實施例之位移暫存器23n之第一例之示意圖。位移暫存器23n包括一上拉單元(pull-up unit)410、一驅動單元420、一下拉單元(pull-down unit)430以及驅動控制單元440。
上拉單元410耦接至一輸出端OUT。驅動單元420用以驅動上拉單元410。下拉單元430耦接至輸出端OUT。驅動控制單元440用以提供一直流準位電壓並驅動下拉單元430。當驅動單元420依據一觸發訊號Tri導通上拉單元410，上拉單元410依據一第一時脈訊號C1使得輸出端OUT輸出一第n輸出訊號Out_n時，驅動控制單元440截 止下拉單元430。其中，當n=1時，觸發訊號Tri為一起始訊號STV，當n大於1時，觸發訊號Tri為一第n-1輸出訊號Out_n-1。
當輸出端輸出第n輸出訊號Out_n後，驅動控制單元440依據一第二時脈訊號C2提供直流準位電壓以驅動下拉單元430。下拉單元430依據一低準位電壓Vss使得輸出端OUT輸出低準位電壓Vss。其中，第二時脈訊號C2為第一時脈訊號C1之反相訊號。
於位移暫存器23n中，上拉單元410包括一第一電晶體T1，第一電晶體T1係生成於玻璃基板210上。第一電晶體T1之第一端，例如為汲極，接收第一時脈訊號C1，第一電晶體T1之第二端，例如為源極，耦接至輸出端OUT。驅動單元420包括一第二電晶體T2，第二電晶體T2係生成於玻璃基板210上。第二電晶體T2之第一端，例如為汲極，接收觸發訊號Tri並耦接至第二電晶體T2之控制端，例如閘極，第二電晶體T2之第二端，例如為源極，耦接至第一電晶體T1之控制端，例如為閘極，。
下拉單元430包括一第三電晶體T3，第三電晶體T3係生成於玻璃基板210上。第三電晶體T3之第一端，例如為汲極，耦接至輸出端OUT，第三電晶體T3之第二端，例如為源極，接收低準位電壓Vss。驅動控制單元440包括一第四電晶體T4、一第五電晶體T5及一第六電晶體T6。第四電晶體T4係生成於玻璃基板210上，第四電晶體T4之第一端，例如為汲極，耦接至第二電晶體T2之第 二端，第四電晶體T4之第二端，例如為源極，接收低準位電壓Vss，第四電晶體T4之控制端，例如為閘極，耦接至第三電晶體T3之控制端，例如為閘極。
第五電晶體T5係生成於玻璃基板210上，第五電晶體T5之第一端，例如為汲極，接收第二時脈訊號C2，第五電晶體T5之第二端，例如為源極，耦接至第三電晶體T3之控制端，第五電晶體T5之控制端，例如為閘極，耦接至第二電晶體T2之第二端。第六電晶體T6係生成於玻璃基板210上，第六電晶體T6之第一端，例如為汲極，耦接至第五電晶體T5之第二端，第六電晶體T6之第二端，例如為源極，接收低準位電壓Vss或第一時脈訊號C1，第六電晶體T6之控制端，例如為閘極，接收觸發訊號Tri。其中，第六電晶體T6之尺寸需大於第五電晶體T5之尺寸，其比例至少為5：1。
請參照第5圖，其繪示乃依照本發明較佳實施例之位移暫存器23n之波形圖。於一第一時序階段t1，觸發訊號Tri為一高準位電壓Vdd，第一時脈訊號C1為低準位電壓Vss，第二時脈訊號C2為高準位電壓Vdd。因為觸發訊號Tri為高準位電壓Vdd，第二電晶體T2及第六電晶體T6導通，使得第一電晶體T1導通。因此，節點P1之電壓由低準位電壓Vss轉變為高準位電壓Vdd與第二電晶體T2之臨界電壓之差(Vdd-Vth2)，使得第五電晶體T5導通。
因為第五電晶體T5及第六電晶體T6之元件特性(寬長比)被設計得不同，故當第五電晶體T5及第六電晶體T6 均導通時，節點P2之電壓會被拉為低準位電壓Vss，使得第三電晶體T3及第四電晶體T4截止，輸出端OUT輸出第一時脈訊號C1為第n輸出訊號Out_n。此時，第一時脈訊號C1為低準位電壓Vss，亦即於第一時序階段t1，第n輸出訊號Out_n為低準位電壓Vss。
於一第二時序階段t2，觸發訊號Tri為低準位電壓Vss，第一時脈訊號C1為高準位電壓Vdd，第二時脈訊號C2為低準位電壓Vss。其中，第二時序階段t2相鄰且接續於第一時序階段t1之後。因為觸發訊號Tri為低準位電壓Vss，第二電晶體T2及第六電晶體T6截止，使得節點P1的電壓受本身之寄生電容及第二電晶體T2之源閘極寄生電容的影響，基於自舉效應(boot-strapping effect)而提高為(Vdd-Vth2+△v)，其中，。
因為節點P1的電壓大於第一電晶體T1及第五電晶體T5之源極電壓均超過一個臨界電壓，故第一電晶體T1及第五電晶體T5導通。因為第二時脈訊號C2為低準位電壓Vss，故節點P2之電壓為低準位電壓Vss，使得第三電晶體T3及第四電晶體T4截止。因此，輸出端OUT輸出第一時脈訊號C1為第n輸出訊號Out_n。此時，第一時脈訊號C1為高準位電壓Vdd，亦即於第二時序階段t2，第n輸出訊號Out_n為高準位電壓Vdd。
於一第三時序階段t3，觸發訊號Tri為低準位電壓Vss，第一時脈訊號C1為低準位電壓Vss，第二時脈訊號 C2為高準位電壓Vdd。其中，第二時序階段t3相鄰且接續於第二時序階段t2之後。因為觸發訊號Tri為低準位電壓Vss，第二電晶體T2及第六電晶體T6截止。
因為第二時脈訊號C2由低準位電壓Vss轉變為高準位電壓Vdd，故節點P2之電壓升高。當節點P2之電壓高到使得第五電晶體T5之源閘極電壓差小於一個臨界電壓時，第五電晶體T5截止。此時，節點P2之電壓維持在一直流準位電壓Vc，此直流準位電壓Vc約介於正閘極電壓的2/3與負閘極電壓的2/3之間。
因為第五電晶體T5及第六電晶體T6均截止，故節點P2的電壓不受其他電壓影響，可以穩定地維持在直流準位電壓Vc，直到下一次觸發訊號Tri由低準位電壓Vss轉變為高準位電壓Vdd為止。直流準位電壓Vc使得第三電晶體T3及第四電晶體T4導通。因為第四電晶體T4導通，節點P1之電壓轉變為低準位電壓Vss，故第一電晶體T1截止。又第三電晶體T3導通，故輸出端OUT輸出低準位電壓Vss為第n輸出訊號Out_n，亦即於第三時序階段t3，第n輸出訊號Out_n為低準位電壓Vss。
上述之位移暫存器23n，係利用內部之驅動控制單元440提供直流準位電壓Vc，如此一來，不需要額外增加直流電壓源與複雜的周邊電路，即可降低位移暫存器23n內之第三電晶體T3及第四電晶體T4之閘極偏壓，因此可以降低額緣寬度與成本。此外，因為第三電晶體T3及第四電晶體T4之閘極偏壓不會過高，故亦可以降低第三電晶 體T3及第四電晶體T4之臨界電壓上升速度，使得第三電晶體T3及第四電晶體T4之產品生命週期延長，提高市場競爭力。
請參照第6圖，其繪示乃依照本發明較佳實施例之位移暫存器23n之第二例之示意圖。位移暫存器23n包括一上拉單元410、一驅動單元420、一下拉單元430、一驅動控制單元440以及第七電晶體T7。第七電晶體T7係生成於玻璃基板210上，第七電晶體T7之第一端，例如為汲極，耦接至輸出端OUT，第七電晶體T7之第二端，例如為源極，接收低準位電壓Vss，第七電晶體T7之控制端，例如為閘極，接收一第n+1輸出訊號Out_n+1。第七電晶體T7實質上係用以依據第n+1輸出訊號Out_n+1，維持輸出端OUT輸出低準位電壓Vss，以防止受到雜訊干擾，確保電路運作正常，避免誤動作的產生。
請參照第7圖，其繪示乃依照本發明較佳實施例之位移暫存器23n之第三例之示意圖。位移暫存器23n包括一上拉單元410、一驅動單元420、一下拉單元430、一驅動控制單元440以及第八電晶體T8。第八電晶體T8係生成於玻璃基板210上，第八電晶體T8之第一端，例如為汲極，耦接至第二電晶體T2之第二端，第八電晶體T8之第二端，例如為源極，接收低準位電壓Vss，第八電晶體T8之控制端，例如為閘極，接收一第n+1輸出訊號Out_n+1或一第n+2輸出訊號Out_n+2。第八電晶體T8實質上係用以依據第n+1輸出訊號Out_n+1或第n+2輸出 訊號Out_n+2，維持輸出端OUT輸出低準位電壓Vss，以防止受到雜訊干擾，確保電路運作正常，避免誤動作的產生。
請參照第8圖，其繪示乃依照本發明較佳實施例之位移暫存器23n之第四例之示意圖。位移暫存器23n包括一上拉單元410、一驅動單元420、一下拉單元430、一驅動控制單元440、第七電晶體T7以及第八電晶體T8。第七電晶體T7係生成於玻璃基板210上，第七電晶體T7之第一端耦接至輸出端OUT，第七電晶體T7之第二端接收低準位電壓Vss，第七電晶體T7之控制端接收一第n+1輸出訊號Out_n+1。
第八電晶體T8係生成於玻璃基板210上，第八電晶體T8之第一端耦接至第二電晶體T2之第二端，第八電晶體T8之第二端接收低準位電壓Vss，第八電晶體T8之控制端接收一第n+1輸出訊號Out_n+1或一第n+2輸出訊號Out_n+2。第七電晶體T7及第八電晶體T8實質上係用以依據第n+1輸出訊號Out_n+1或第n+2輸出訊號Out_n+2，維持輸出端OUT輸出低準位電壓Vss，以防止受到雜訊干擾，確保電路運作正常，避免誤動作的產生。
本實施例亦揭露一種平面顯示器驅動方法，平面顯示器具有玻璃基板、源極驅動單元以及閘極驅動單元。玻璃基板具有多個畫素，源極驅動單元電性連接至此些畫素。閘極驅動單元具有一非晶矽閘極結構，閘極驅動單元具有N個位移暫存器，N為正整數。第n位移暫存器包括上拉 單元、驅動單元、下拉單元及驅動控制單元，n為1~N之正整數。上拉單元耦接至一輸出端，驅動單元驅動上拉單元，下拉單元耦接至輸出端，驅動控制單元提供一直流準位電壓並驅動下拉單元。
請參照第9圖，其繪示乃依照本發明較佳實施例之平面顯示器驅動方法之流程圖。首先，於步驟910中，當驅動單元依據一觸發訊號導通上拉單元，上拉單元依據一第一時脈訊號使得輸出端輸出一第n輸出訊號時，驅動控制單元截止下拉單元。其中，觸發訊號為一第n-1輸出訊號。
之後，於步驟920中，當輸出端輸出第n輸出訊號後，驅動控制單元依據一第二時脈訊號提供直流準位電壓以驅動下拉單元，下拉單元依據一低準位電壓使得輸出端輸出低準位電壓。其中，第二時脈訊號為第一時脈訊號之反相訊號。上述之平面顯示器驅動方法之運作原理，係已詳述於位移暫存器23n中，故於此不再重述。
本發明上述實施例所揭露之平面顯示器及其驅動方法，利用內部之簡單電路產生一直流準位電壓，故不需要額外周邊電路或外灌直流電壓源，即可提供位移暫器內之電晶體之閘極偏壓，因此可以降低電路複雜度與額緣寬度。此外，直流準位電壓係介於正閘極電壓的2/3與負閘極電壓的2/3之間，因此電晶體之閘極偏壓不會過高，故亦可以降低電晶體之臨界電壓上升速度，使得電晶體之產品生命週期延長，提高市場競爭力。
綜上所述，雖然本發明已以一較佳實施例揭露如上，然其並非用以限定本發明。本發明所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可作各種之更動與潤飾。因此，本發明之保護範圍當視後附之申請專利範圍所界定者為準。
100、231~23N、23n‧‧‧位移暫存器
200‧‧‧平面顯示器
210‧‧‧玻璃基板
220‧‧‧源極驅動單元
230‧‧‧閘極驅動單元
410‧‧‧上拉單元
420‧‧‧驅動單元
430‧‧‧下拉單元
440‧‧‧驅動控制單元
910‧‧‧步驟
920‧‧‧步驟
第1圖繪示傳統平面顯示器之閘極驅動單元之位移暫存器之電路圖。
第2圖繪示依照本發明較佳實施例之平面顯示器之示意圖。
第3圖繪示依照本發明較佳實施例之閘極驅動單元之示意圖。
第4圖繪示依照本發明較佳實施例之位移暫存器之第一例之示意圖。
第5圖繪示依照本發明較佳實施例之位移暫存器之波形圖。
第6圖繪示依照本發明較佳實施例之位移暫存器之第二例之示意圖。
第7圖繪示依照本發明較佳實施例之位移暫存器之第三例之示意圖。
第8圖繪示依照本發明較佳實施例之位移暫存器之第四例之示意圖。
第9圖繪示依照本發明較佳實施例之平面顯示器驅動方法之流程圖。
23n‧‧‧位移暫存器
410‧‧‧上拉單元
420‧‧‧驅動單元
430‧‧‧下拉單元
440‧‧‧驅動控制單元

Claims (17)

  1. 一種平面顯示器，包括：一玻璃基板，具有複數個畫素；一源極驅動單元，電性連接至該些畫素；以及一閘極驅動單元，具有一非晶矽閘極結構，該閘極驅動單元具有N個位移暫存器，N為正整數，該第n位移暫存器包括：一上拉單元，包括：一第一電晶體，生成於該玻璃基板上，該第一電晶體之第一端接收一第一時脈訊號，該第一電晶體之第二端耦接至一輸出端；一驅動單元，包括：一第二電晶體，生成於該玻璃基板上，該第二電晶體之第一端接收一觸發訊號並耦接至該第二電晶體之控制端，該第二電晶體之第二端耦接至該第一電晶體之控制端；一下拉單元，包括：一第三電晶體，生成於該玻璃基板上，該第三電晶體之第一端耦接至該輸出端，該第三電晶體之第二端接收一低準位電壓；及一驅動控制單元，包括：一第四電晶體，生成於該玻璃基板上，該第四電晶體之第一端耦接至該第二電晶體之第二端，該第四電晶體之第二端接收該低準位電壓，該第四電晶體之控制端 耦接至該第三電晶體之控制端；一第五電晶體，生成於該玻璃基板上，該第五電晶體之第一端接收一第二時脈訊號，該第五電晶體之第二端耦接至該第三電晶體之控制端，該第五電晶體之控制端耦接至該第二電晶體之第二端；以及一第六電晶體，生成於該玻璃基板上，該第六電晶體之第一端耦接至該第五電晶體之第二端，該第六電晶體之第二端接收該低準位電壓或該第一時脈訊號，該第六電晶體之控制端接收該觸發訊號；其中，當該驅動單元依據該觸發訊號導通該上拉單元，該上拉單元依據該第一時脈訊號使得該輸出端輸出一第n輸出訊號時，該驅動控制單元截止該下拉單元，該觸發訊號為一第n-1輸出訊號，n為1~N之正整數；其中，當該輸出端輸出該第n輸出訊號後，該驅動控制單元依據該第二時脈訊號提供一直流準位電壓以驅動該下拉單元，該下拉單元依據該低準位電壓使得該輸出端輸出該低準位電壓，該第二時脈訊號為該第一時脈訊號之反相訊號。
  2. 如申請專利範圍第1項所述之平面顯示器，其中該第一位移暫存器之觸發訊號為一起始訊號。
  3. 如申請專利範圍第1項所述之平面顯示器，其中該第五電晶體及該第六電晶體之元件特性不同。
  4. 如申請專利範圍第3項所述之平面顯示器，其中於一第一時序階段，該觸發訊號為一高準位電壓，該第一 時脈訊號為該低準位電壓，該第二時脈訊號為該高準位電壓，該第二電晶體及該第六電晶體導通，使得該第一電晶體及該第五電晶體導通，該第三電晶體及該第四電晶體截止，該輸出端輸出該低準位電壓。
  5. 如申請專利範圍第4項所述之平面顯示器，其中於一第二時序階段，該觸發訊號為該低準位電壓，該第一時脈訊號為該高準位電壓，該第二時脈訊號為該低準位電壓，該第二電晶體及該第六電晶體截止，該第一電晶體及該第五電晶體導通，該第五電晶體之第二端之電壓準位使得該第三電晶體及該第四電晶體截止，該輸出端輸出該高準位電壓為該第n輸出訊號，該第二時序階段相鄰且接續於該第一時序階段之後。
  6. 如申請專利範圍第5項所述之平面顯示器，其中於一第三時序階段，該觸發訊號為該低準位電壓，該第一時脈訊號為該低準位電壓，該第二時脈訊號為該高準位電壓，該第二電晶體及該第六電晶體截止，該第五電晶體截止，該第五電晶體之第二端提供該直流準位電壓使得該第三電晶體及該第四電晶體導通，該第一電晶體截止，該輸出端輸出該低準位電壓，該第三時序階段相鄰且接續於該第二時序階段之後。
  7. 如申請專利範圍第1項所述之平面顯示器，更包括：一第七電晶體，生成於該玻璃基板上，該第七電晶體之第一端耦接至該輸出端，該第七電晶體之第二端接收該 低準位電壓，該第七電晶體之控制端接收一第n+1輸出訊號。
  8. 如申請專利範圍第1項所述之平面顯示器，更包括：一第八電晶體，生成於該玻璃基板上，該第八電晶體之第一端耦接至該第二電晶體之第二端，該第八電晶體之第二端接收該低準位電壓，該第八電晶體之控制端接收一第n+1輸出訊號或一第n+2輸出訊號。
  9. 如申請專利範圍第1項所述之平面顯示器，更包括：一第七電晶體，生成於該玻璃基板上，該第七電晶體之第一端耦接至該輸出端，該第七電晶體之第二端接收該低準位電壓，該第七電晶體之控制端接收一第n+1輸出訊號；以及一第八電晶體，生成於該玻璃基板上，該第八電晶體之第一端耦接至該第二電晶體之第二端，該第八電晶體之第二端接收該低準位電壓，該第八電晶體之控制端接收一第n+1輸出訊號或一第n+2輸出訊號。
  10. 一種平面顯示器驅動方法，該平面顯示器具有一玻璃基板、一源極驅動單元以及一閘極驅動單元，該玻璃基板具有複數個畫素，該源極驅動單元電性連接至該些畫素，該閘極驅動單元具有一非晶矽閘極結構，該閘極驅動單元具有N個位移暫存器，N為正整數，該第n位移暫存器包括一上拉單元、一驅動單元、一下拉單元及一驅動控 制單元，n為1~N之正整數，該上拉單元耦接至一輸出端，該驅動單元驅動該上拉單元，該下拉單元耦接至該輸出端，該驅動控制單元提供一直流準位電壓並驅動該下拉單元，該平面顯示器驅動方法包括：當該驅動單元依據一觸發訊號導通該上拉單元，該上拉單元依據一第一時脈訊號使得該輸出端輸出一第n輸出訊號時，該驅動控制單元截止該下拉單元，該觸發訊號為一第n-1輸出訊號；以及當該輸出端輸出該第n輸出訊號後，該驅動控制單元依據一第二時脈訊號提供該直流準位電壓以驅動該下拉單元，該下拉單元依據一低準位電壓使得該輸出端輸出該低準位電壓，該第二時脈訊號為該第一時脈訊號之反相訊號；其中，該上拉單元包括一第一電晶體，該第一電晶體生成於該玻璃基板上，該第一電晶體之第一端接收該第一時脈訊號，該第一電晶體之第二端耦接至該輸出端，該驅動單元包括一第二電晶體，該第二電晶體生成於該玻璃基板上，該第二電晶體之第一端接收該觸發訊號並耦接至該第二電晶體之控制端，該第二電晶體之第二端耦接至該第一電晶體之控制端，該下拉單元包括一第三電晶體，該第三電晶體生成於該玻璃基板上，該第三電晶體之第一端耦接至該輸出端，該第三電晶體之第二端接收該低準位電壓，該驅動控制單元包括一第四電晶體、一第五電晶體及一第六電晶體，該第四電晶體生成於該玻璃基板上，該第 四電晶體之第一端耦接至該第二電晶體之第二端，該第四電晶體之第二端接收該低準位電壓，該第四電晶體之控制端耦接至該第三電晶體之控制端，該第五電晶體生成於該玻璃基板上，該第五電晶體之第一端接收該第二時脈訊號，該第五電晶體之第二端耦接至該第三電晶體之控制端，該第五電晶體之控制端耦接至該第二電晶體之第二端，該第六電晶體生成於該玻璃基板上，該第六電晶體之第一端耦接至該第五電晶體之第二端，該第六電晶體之第二端接收該低準位電壓或該第一時脈訊號，該第六電晶體之控制端接收該觸發訊號。
  11. 如申請專利範圍第10項所述之平面顯示器驅動方法，其中該第一位移暫存器之觸發訊號為一起始訊號。
  12. 如申請專利範圍第10項所述之平面顯示器驅動方法，其中該第五電晶體及該第六電晶體之元件特性不同。
  13. 如申請專利範圍第12項所述之平面顯示器驅動方法，更包括：於一第一時序階段，該觸發訊號轉變為一高準位電壓，該第一時脈訊號轉變為該低準位電壓，該第二時脈訊號轉變為該高準位電壓，該第二電晶體及該第六電晶體導通，使得該第一電晶體及該第五電晶體導通，該第三電晶體及該第四電晶體截止，該輸出端輸出該低準位電壓。
  14. 如申請專利範圍第13項所述之平面顯示器驅動方法，更包括： 於一第二時序階段，該觸發訊號轉變為該低準位電壓，該第一時脈訊號轉變為該高準位電壓，該第二時脈訊號轉變為該低準位電壓，該第二電晶體及該第六電晶體截止，該第一電晶體及該第五電晶體導通，該第五電晶體之第二端之電壓準位使得該第三電晶體及該第四電晶體截止，該輸出端輸出該高準位電壓為該第n輸出訊號，該第二時序階段相鄰且接續於該第一時序階段之後。
  15. 如申請專利範圍第14項所述之平面顯示器驅動方法，更包括：於一第三時序階段，該觸發訊號保持為該低準位電壓，該第一時脈訊號轉變為該低準位電壓，該第二時脈訊號轉變為該高準位電壓，該第二電晶體及該第六電晶體截止，該第五電晶體截止，該第五電晶體之第二端提供該直流準位電壓使得該第三電晶體及該第四電晶體導通，該第一電晶體截止，該輸出端輸出該低準位電壓，該第三時序階段相鄰且接續於該第二時序階段之後。
  16. 如申請專利範圍第10項所述之平面顯示器驅動方法，更包括：依據一第n+1輸出訊號提供該低準位電壓至該輸出端。
  17. 如申請專利範圍第10項所述之平面顯示器驅動方法，更包括：依據一第n+1輸出訊號或一第n+2輸出訊號截止該第一電晶體，使得該輸出端輸出該低準位電壓。
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