TW201636950A - 用以從單一影像產生各種解析度影像之縮放器電路與包括該縮放器電路之裝置 - Google Patents
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Abstract
提供一種縮放器電路。該縮放器電路包括有組配來在一第一垂直比例縮放操作後進行一第一水平比例縮放操作的一第一縮放器、組配來在一第二垂直比例縮放操作後進行一第二水平比例縮放操作的一第二縮放器、以及由該第一縮放器與該第二縮放器所共享的一線記憶體。該第一縮放器及該第二縮放器中的每一者分別產生一第一影像及一第二影像，該第一影像及該第二影像具有不同於使用該線記憶體之一單一影像的解析度。
Description
本申請案依據35 U.S.C.§ 119(a)主張2015年2月12日提出申請之韓國專利申請案第10-2015-0021800號的優先權，其完整揭露係以參考方式併入本文。
本發明係有關於用以從單一影像產生各種解析度影像之縮放器電路與包括該縮放器電路之裝置。
一或多項例示性實施例係有關於一種縮放器電路，並且更具體而言，係有關於一種採用一平行方式從單一影像產生具有不同縮放比之影像的縮放器電路、以及具有該縮放器電路之裝置。
一影像縮放器可以是一能夠比例放大(或放大尺度)或比例縮小(縮小尺度)一影像或影像資料的電路、或能夠進行一演算法使一影像放大尺度或縮小尺度的軟體。舉例而言，一影像處理應用(或應用程式)可為了諸如預覽、記錄、擷取、及縮圖等各種目的，將單一影像調整尺寸成複
數個影像。
使用一從該單一輸入影像產生單一輸出影像的影像縮放器從該單一輸入影像產生複數個經調整尺寸之影像時，該影像縮放器必須藉由讀取一記憶體中儲存之同一影像複數次來產生複數個經調整尺寸之影像。為了在給定時間內從該單一輸入影像產生複數個經調整尺寸之影像，一供應至該影像縮放器之時脈信號必須是一高頻信號。因此，一使用一具有一高頻之時脈信號的影像縮放器造成該影像縮放器、及一具有該影像縮放器之影像處理系統所消耗的電量升高。
根據一例示性實施例之一態樣，提供一種縮放器電路。該縮放器電路包括有在第一垂直比例縮放操作後進行一第一水平比例縮放操作的一第一縮放器、在一第二垂直比例縮放操作後進行一第二水平比例縮放操作的一第二縮放器、及由該第一縮放器與該第二縮放器共享的一線記憶體，其中該第一縮放器與該第二縮放器中的每一者分別產生一第一影像及一第二影像，該第一影像及該第二影像與使用該線記憶體之單一影像具有不同解析度。該縮放器電路更包括有一線記憶體控制器，該線記憶體控制器將該單一影像中包括之像素中的每一者上的位置資訊傳送至該第一縮放器及該第二縮放器。
該第一縮放器使用各該像素上之該位置資訊，在該等像素中，選擇待儲存於該線記憶體中之該第一影像
有關之第一像素，而該第二縮放器使用各該像素上之該位置資訊，在該等像素中，選擇與待儲存於該線記憶體中之該第二影像有關之第二像素。
該第一縮放器使用各該像素上之該位置資訊，判定該線記憶體中儲存之該等第一像素的第一讀取時序，而該第二縮放器使用各該像素上之該位置資訊，判定該線記憶體中儲存之該等第二像素的第二讀取時序。
該線記憶體控制器根據該第一縮放器之一控制，在該線記憶體中儲存該等第一像素，並根據該等第一讀取時序讀取該線記憶體中儲存之該等第一像素，而且還根據該第二縮放器之一控制，在該線記憶體中儲存該等第二像素，並根據該等第二讀取時序讀取該線記憶體中儲存之該等第二像素。
該第一縮放器包括有垂直比例縮放傳送自該線記憶體控制器之該等第一像素的一第一垂直縮放器、及水平比例縮放輸出自該第一垂直縮放器之像素用以產生該第一影像的一第一水平縮放器。該第二縮放器包括有垂直比例縮放傳送自該線記憶體控制器之該等第二像素的一第二垂直縮放器、及水平比例縮放輸出自該第二垂直縮放器之像素用以產生該第二影像的一第二水平縮放器。
該縮放器電路更包括有比例縮小藉由該第一縮放器所產生之該第一影像的一第一後縮放器、及比例縮小藉由該第二縮放器所產生之該第二影像的一第二後縮放器。
該縮放器電路更包括有一線記憶體控制器，該線記憶體控制器在該線記憶體中儲存該等像素中之該第一影像有關之第一像素，並根據該第一縮放器之一控制讀取該線記憶體中儲存之該等第一像素，而且在該線記憶體中儲存該等像素中之該第二影像有關之第二像素，並根據該第二縮放器之一控制讀取該線記憶體中儲存之該等第二像素。
該縮放器電路更包括有一FIFO控制器、一藉由該FIFO控制器或該線記憶體控制器存取之線緩衝器、及一提供該FIFO控制器之一輸入影像或該FIFO控制器之一輸出影像作為該單一影像之選擇器。
當該第一影像及該第二影像係比例縮小影像、且該單一影像係該FIFO控制器之該輸出影像時，該第一縮放器及該第二縮放器各分別使用該線記憶體產生該第一影像及該第二影像。當該第一影像及該第二影像係比例放大影像、且該單一影像係該FIFO控制器之該輸入影像時，該第一縮放器及該第二縮放器各分別使用該線記憶體及該線緩衝器產生該第一影像及該第二影像。
根據另一例示性實施例之一態樣，提供一種應用處理器。該應用處理器包括有一匯流排、及一連接至該匯流排之縮放器電路，其中該縮放器電路包括有一在一垂直比例縮放操作後進行一水平比例縮放操作的第一縮放器、一在一垂直比例縮放操作後進行一水平比例縮放操作的第二縮放器、及一由該第一縮放器與該第二縮放器共享的
線記憶體。該第一縮放器及該第二縮放器各分別產生一第一影像及一第二影像，該第一影像及該第二影像具有與使用該線記憶體之一單一影像不同的解析度。
根據另一例示性實施例之一態樣，提供一種行動運算裝置。該行動運算裝置包括有一影像感測器、一外部記憶體、及一連接至該影像感測器與該外部記憶體之應用處理器，其中該應用處理器包括有一匯流排及一連接至該匯流排之縮放器電路。該縮放器電路包括有一在一垂直比例縮放操作後進行一水平比例縮放操作的第一縮放器、一在一垂直比例縮放操作後進行一水平比例縮放操作的第二縮放器、及一由該第一縮放器與該第二縮放器所共享的線記憶體。該第一縮放器及該第二縮放器各分別產生一第一影像及一第二影像，該第一影像及該第二影像具有與使用該線記憶體之一單一影像不同的解析度。
該行動運算裝置更包括有一將該單一影像中包括之各像素上的位置資訊傳送至該第一縮放器及該第二縮放器的線記憶體控制器，該第一縮放器使用各該像素之該位置資訊，在該等像素中，選擇待儲存於該線記憶體中之該第一影像有關之第一像素，而該第二縮放器使用各該像素上之該位置資訊，在該等像素中，選擇與待儲存於該線記憶體中之該第二影像有關之第二像素。
根據一例示性實施例之一態樣，提供一種縮放器電路。該縮放器電路包括有一組配來儲存一單一影像的線記憶體、一組配來從該線記憶體讀取該單一影像、及藉
由在該單一影像上進行一第一水平比例縮放操作與一第一垂直比例縮放操作來產生一第一影像的第一縮放器、以及一組配來從該線記憶體讀取該單一影像、及藉由在該單一影像上進行一第二水平比例縮放操作與一第二垂直比例縮放操作來產生一第二影像的第二縮放器。該第一影像及該第二影像具有與該單一影像不同的解析度。
100‧‧‧資料處理系統
200‧‧‧資料處理裝置
203‧‧‧匯流排
210‧‧‧CPU
220‧‧‧介面
230‧‧‧影像信號處理器
240、240A‧‧‧縮放器電路
250‧‧‧記憶體控制器
260‧‧‧顯示控制器
270‧‧‧使用者介面
300‧‧‧影像感測器
310‧‧‧記憶體
320‧‧‧顯示器
330‧‧‧使用者輸入裝置
401‧‧‧選擇器
403‧‧‧讀取DMA控制器
405-1~405-n‧‧‧寫入DMA控制器
407-1~407-n‧‧‧後縮放器
410、410A、410B‧‧‧一輸入多輸出縮放器
410-1‧‧‧縮放器核心
420‧‧‧線記憶體控制器
421‧‧‧位置資訊計算器
423‧‧‧寫入控制電路
425‧‧‧讀取控制電路
427‧‧‧停頓控制電路
430‧‧‧線記憶體
431‧‧‧寫入請求信號產生器
433‧‧‧讀取請求信號產生器
435‧‧‧停頓指示信號產生器
440-1~440-n、441-1~441-n‧‧‧縮放器
442-1‧‧‧垂直比例縮放控制器
443-1‧‧‧開關電路
444-1‧‧‧垂直比例縮放核心
445-1‧‧‧第一水平縮放器
445-2‧‧‧第二水平縮放器
445-n‧‧‧第n水平縮放器
450‧‧‧先進先出(FIFO)控制器
451‧‧‧第一選擇器
453‧‧‧第二選擇器
455‧‧‧線緩衝器
501‧‧‧線記憶體
503‧‧‧垂直縮放器
505‧‧‧水平縮放器
S110~S124、S210~S230‧‧‧操作
例示性實施例之這些及/或其他態樣及優點經由以下例示性實施例說明、並搭配附圖而變為顯而易見且得以更加輕易了解，在附圖中：圖1係根據一例示性實施例之一資料處理系統的方塊圖；圖2係展示圖1所示一縮放器電路之一例示性實施例的方塊圖；圖3係展示圖2所示一一輸入多輸出縮放器之一例示性實施例的方塊圖；圖4係圖3所示一第一垂直縮放器的方塊圖；圖5係展示圖2所示該一輸入多輸出縮放器之另一例示性實施例的方塊圖；圖6概念性展示一原始影像中包括的不同區域；圖7A至7C係描述處理圖6中所示該原始影像中包括之一第一區域與一第二區域之一程序的概念圖；圖8A及8B概念性展示一比例放大及一比例縮小；
圖9係展示圖1所示該縮放器電路之另一例示性實施例的方塊圖；圖10係圖9所示一後縮放器的方塊圖；圖11係描述圖1所示該資料處理系統之一操作的流程圖；以及圖12係描述圖2所示該縮放器電路之一操作的流程圖。
現將詳細參照例示性實施例，此等例示性實施例是在附圖中繪示，其中相似的參考符號全文意指為相似的元件。下文說明此等例示性實施例以便參照這些圖說明本廣義發明概念。
圖1係根據一例示性實施例之一資料處理系統的方塊圖。請參照圖1，一資料處理系統100可包括有一資料處理裝置200、一影像感測器300、一記憶體310、一顯示器320、及一使用者輸入裝置330。影像感測器300及記憶體310各可進行一影像源之一功能。資料處理系統100可具體實現為一個人電腦(PC)或一行動運算裝置。該行動運算裝置可具體實現為一膝上型電腦、一行動電話、一平板PC、一個人數位助理器(PDA)、一企業數位助理器(EDA)、一數位相機、一數位攝影機、一可攜式多媒體播放器(PMP)、一個人導航裝置或可攜式導航裝置(PND)、一手持式遊戲主控台、一行動上網裝置(MID)、一穿戴式電腦、一
物聯網(IoT)裝置、一萬物聯網(IoE)裝置、一無人靶機、或一電子書。
資料處理裝置200可包括有一CPU210、一匯流排架構或匯流排203、一介面220、一影像信號處理器230、一縮放器電路240、一記憶體控制器250、一顯示控制器260、及一使用者介面(或使用者輸入介面)270。資料處理裝置200可具體實現為一積體電路(IC)、一主機板、一系統晶片、一應用處理器(AP)、或一行動AP；但該資料處理裝置不受限於此。
資料處理裝置200可同時或採用一平行方式比例縮放具有不同縮放比之影像、具有不同解析度之影像、或來自單一輸入影像之經調整尺寸之影像，並且產生該等經比例縮放之影像。
CPU210大致可控制資料處理裝置200之一操作。CPU210可回應於傳送自使用者介面270之一比例放大信號、一比例縮小信號、或一指示一旋轉之偵檢信號，控制影像信號處理器230之一操作、縮放器電路240之一操作、及/或記憶體控制器250之一操作。舉例而言，縮放器電路240可具體實現為影像信號處理器230。
CPU210、介面220、影像信號處理器230、縮放器電路240、記憶體控制器250、及顯示控制器260、以及使用者介面270彼此間可透過匯流排架構203，傳送或接收命令及/或資料至或自另一者。
匯流排架構203可具體實現為一使用一先進微控
制器匯流排架構(AMBA)協定之匯流排、一使用一先進高效能匯流排(AHB)協定之匯流排、一使用一先進週邊匯流排(APB)協定之匯流排、或一使用一AMBA可擴充互連(AXI)協定之匯流排；但匯流排架構203不受限於此。圖1所示的匯流排架構203係以例示方式展示，而且根據一例示性實施例之匯流排架構203不受限於此。
介面220可接收一輸出自影像感測器300之像素，例如具有拜耳(Bayer)圖型之像素，並且傳送接收到的像素至影像信號處理器230。舉例而言，該像素可以是RGB資料。
當影像感測器300係具體實現為一相機模組時，介面220可具體實現為一相機介面。根據一例示性實施例，影像感測器300可具體實現為一CMOS影像感測器；但該影像感測器不受限於此。根據一例示性實施例，影像感測器300所產生之像素可透過一行動產業處理器介面(MIPI)相機串列介面(CSI)傳送至介面220。
影像信號處理器230可將輸出自影像感測器300之像素的一第一資料格式轉換成一第二資料格式。舉例而言，該第一資料格式可以是一拜耳圖型(或RGB資料)，而該第二資料格式可以是YUV資料(或YCbCr)；但不受限此。
當一待由縮放器電路240處理之影像(或影像資料)中包括的像素比例放大(或上取樣)時，影像信號處理器230可根據CPU210之一控制，透過匯流排架構203，將輸
出自介面220之像素傳送至記憶體控制器250。
記憶體控制器250可在記憶體310中儲存輸出自影像信號處理器230之像素，例如影像。記憶體310中儲存之該等像素，例如影像，可透過匯流排架構203傳送至縮放器電路240。讀取一次該儲存於記憶體310中之影像。縮放器電路240可使用該經讀取一次之影像，同時或採用平行方式，比例縮放具有不同縮放比之影像、具有不同解析度之影像、及經調整尺寸之影像，並且產生該等經比例縮放之影像。舉例而言，圖框資料可包括有該等像素。
舉例而言，比例放大一待由縮放器電路240處理之影像中包括的像素時，縮放器電路240可產生一停頓指示信號，並且將該產生之停頓指示信號傳送至影像信號處理器230。因此，影像信號處理器230可停頓待傳送至縮放器電路240之像素，或回應於該停頓指示信號，透過匯流排架構203傳送該等像素至記憶體控制器250。
然而，比例縮小一待由縮放器電路240處理之影像(或影像資料)中包括的該等像素時，影像信號處理器230可根據CPU210之一控制，傳送輸出自介面220之像素至縮放器電路240。縮放器電路240可即時比例縮放輸出自影像感測器300之像素。
當一使用者透過使用者輸入裝置330比例放大或比例縮小一對應影像時，使用者介面270可偵檢一透過使用者輸入裝置330輸入之使用者輸入，並且透過匯流排架構203傳送一偵檢信號至CPU210。舉例而言，一比例縮放
操作可以圖框為單位來進行。
舉例而言，如圖8A所示，當一使用者將顯示器320上顯示之一原始影像OIM中包括之一第一影像區域SRC比例放大或擴大成一第二影像區域SUI時，使用者輸入裝置330可感測該比例放大或擴大，並且將一與該感測之一結果對應的信號傳送至使用者介面270。使用者介面270可回應於該信號，透過匯流排架構203傳送一指示一比例放大之偵檢信號至CPU210。
如圖8B所示，當一使用者將顯示器320上顯示之該原始影像OIM中包括的一第三影像區域SRC比例縮小或縮小尺寸成一第四影像區域SDI時，使用者輸入裝置330可感測該比例縮小或該縮小尺寸，並且將一與該感測之一結果對應的信號傳送至使用者介面270。使用者介面270可回應於該信號，透過匯流排架構203傳送一指示一比例縮小之偵檢信號至CPU210。
CPU210可產生一指示一比例放大或一比例縮小之選擇信號，並且回應於一輸出自使用者介面270之偵檢信號，透過匯流排架構203傳送該選擇信號至影像信號處理器230、縮放器電路240、及/或記憶體控制器250。
縮放器電路240可根據CPU210之一控制，在一傳送自影像信號處理器230之影像(或該影像中包括之像素OTFI)、或一透過匯流排架構203輸出自記憶體310之影像(或像素)上進行一比例縮放操作。
可稱為一記憶體介面之記憶體控制器250可根據
CPU210之一控制，儲存輸出自影像信號處理器230之一影像或像素於記憶體310中，或透過匯流排架構203傳送該儲存於記憶體310中之影像(或像素)至縮放器電路240。本說明書中之一影像可以是影像資料，而一像素可以是像素資料。
顯示控制器260可根據CPU210之一控制，將透過匯流排架構203傳送之資料(或像素、經比例放大之像素、或經比例縮小之像素)傳送至顯示器320。
根據一例示性實施例，顯示控制器260可透過一MIPI®顯示串列介面(DSI)，將傳送自匯流排架構203之資料傳送至顯示器320。根據一例示性實施例，一介於顯示控制器260與顯示器320之間的介面可具體實現為一支援一嵌入式DisplayPort(eDP)協定或一高畫質多媒體介面(HDMI)之介面；但該介面不受限於此。
使用者介面270可感測一透過使用者輸入裝置330輸入之使用者輸入，並且透過匯流排架構203將一與該感測之一結果對應之偵檢信號傳送至CPU210。
記憶體310可具體實現為一依電性記憶體及/或一非依電性記憶體。該依電性記憶體可具體實現為一隨機存取記憶體(RAM)、一動態RAM(DRAM)、或一靜態RAM(SRAM)。該非依電性記憶體可具體實現為一基於快閃技術之記憶體、一相變RAM(PRAM)、一磁阻RAM(RRAM)、或一自旋轉移磁矩隨機存取記憶體(STT-MRAM)；但該非依電性記憶體不受限於此。
圖1中雖然展示一個記憶體控制器250及一個記憶體310；然而，根據例示性實施例，資料處理系統100仍可包括有複數個記憶體控制器、及複數個與該複數個記憶體控制器對應之記憶體。該複數個記憶體可以是不同類型的記憶體。舉例而言，當該複數個記憶體包括有一DRAM及一基於快閃技術之記憶體時，複數個記憶體控制器可包括有一DRAM控制器及一基於快閃技術之記憶體控制器。
顯示器320可具體實現為一平板顯示器。該平板顯示器可具體實現為一薄膜電晶體-液晶顯示器(TFT-LCD)、一發光二極體(LED)顯示器、一有機LED(OLED)顯示器、一主動矩陣OLED(AMOLED)顯示器、或一撓性顯示器、一雙面顯示器、或一透明顯示器。
使用者輸入裝置330可具體實現為一觸控螢幕、一觸控螢幕面板、或一觸控螢幕控制器。使用者輸入裝置330可以是一可透過一觸碰手勢進行感測之電子視覺顯示器，該觸碰手勢是在一使用者使用一觸控筆或至少一根手指觸碰顯示器320時出現。
因此，顯示器320及使用者輸入裝置330可具體實現為一個模組。一使用者使用顯示器320及/或使用者輸入裝置330以便縮放顯示器320上顯示之一影像或一文字。舉例而言，圖8A可以是放大，而且圖8B可以是縮小。
圖2係展示圖1所示一縮放器電路之一例示性實施例的方塊圖。請參照圖1及圖2，縮放器電路240可包括有一選擇器401、一讀取直接記憶體存取(DMA)控制器403
、複數個寫入DMA控制器405-1至405-n，其中n是三或更大的自然數，還包括有一一輸入多輸出縮放器410。圖2中也一起展示匯流排203、影像信號處理器230、縮放器電路240、記憶體控制器250、及記憶體310。
在比例縮小操作期間，一藉由影像信號處理器230處理之影像(或該影像中包括的像素OTFI)可透過一第一路徑PATH1及選擇器401，即時傳送至縮放器電路240。
選擇器401可回應於一由CPU210在一比例縮小操作期間所產生之選擇信號SEL，傳送影像信號處理器230所處理之像素OTFI至上輸入多輸出縮放器410。然而，該由影像信號處理器230所處理之影像(或該影像中包括的像素DMI)可在一比例放大操作期間，透過一第二路徑PATH2傳送至縮放器電路240。第二路徑PATH2可包括有匯流排架構203、記憶體控制器250、記憶體310、讀取DMA控制器403、及選擇器401。舉例而言，像素OTFI及像素DMI彼此可以是相同的像素。
在比例放大操作期間，影像信號處理器230可根據CPU210之一控制，透過匯流排架構203傳送像素DMI至記憶體控制器250。記憶體控制器250可根據CPU210之一控制，在記憶體310中儲存像素DMI。讀取DMA控制器403可讀取或擷取記憶體310中儲存之像素DIM，並且傳送毒取的像素DIM至選擇器401。
選擇器401可回應於一由CPU210在比例放大期間產生之選擇信號SEL，將輸出自讀取DMA控制器403之
像素DIM傳送至一輸入多輸出縮放器410。選擇器401之一第一輸入端可連接至第一路徑PATH1，而選擇器401之一第二輸入端可連接至第二路徑PATH2。
舉例而言，CPU210可在該比例縮小操作期間產生一具有一第一位準之選擇信號SEL，該第一位準例如是一低位準或邏輯0，並且CPU210可在該比例放大期間產生一具有一第二位準之選擇信號SEL，該第二位準例如是一高位準或邏輯1。選擇信號SEL可藉由CPU210來產生。
一輸入多輸出縮放器410可接收循序輸出自選擇器401之像素IM，並且同時或採用一平行方式，輸出各以一不同的縮放比進行比例縮放之像素HS1至HSn。也就是說，一輸入多輸出縮放器410可同時或採用一平行方式，產生複數個由單一影像IM經調整尺寸後之影像HS1至HSn。
一第一寫入DMA控制器405-1可根據CPU210之一控制，透過匯流排架構203傳送以一第一縮放比進行比例縮放之像素HS1至記憶體控制器250、及/或顯示控制器260。
一第二寫入DMA控制器405-2可根據CPU210之一控制，與第一寫入DMA控制器405-1同時或採用一平行方式，透過匯流排架構203傳送以一第二縮放比進行比例縮放之像素HS2至記憶體控制器250、及/或顯示控制器260。
一第n寫入DMA控制器405-n可根據CPU210之一控制，與第二寫入DMA控制器405-2同時或採用一平行方
式，透過匯流排架構203傳送以一第n縮放比進行比例縮放之像素HSn至記憶體控制器250、及/或顯示控制器260。舉例而言，記憶體控制器250可在記憶體310中寫入像素HS1、HS2及/或HSn。
影像信號處理器230可回應於一輸出自一輸入多輸出縮放器410之停頓指示信號STALL，停止或延遲傳送像素OTFI。舉例而言，一輸入多輸出縮放器410可在該比例放大操作期間產生一具有一第二位準之停頓指示信號STALL。因此，影像信號處理器230可回應於具有一第二位準之停頓指示信號STALL，停止或延遲傳送像素OTFI。
圖3係展示圖2所示該一輸入多輸出縮放器之一例示性實施例的方塊圖。請參照圖3，一一輸入多輸出縮放器410A可包括有一縮放器核心410-1及一線記憶體430。圖3所示的一輸入多輸出縮放器410A雖然包括有線記憶體430，但線記憶體430仍可設置於一輸入多輸出縮放器410A外。線記憶體430可具體實現為一線緩衝器，該線緩衝器可儲存對應於至少一條線的線資料。
縮放器核心410-1可包括有可進行一比例縮放操作之電路或邏輯電路。縮放器核心410-1可包括有一線記憶體控制器420、一寫入請求信號產生器431、一讀取請求信號產生器433、一停頓指示信號產生器435、及複數個縮放器440-1至440-n。複數個縮放器440-1至440-n各可在一垂直比例縮放操作後進行一水平比例縮放操作。
請參照圖2及圖3，線記憶體控制器420可接收透
過第一路徑PATH1及第二路徑PATH2循序輸入之像素IM，並且將接收到的像素IM中於不同時間點輸入之一目前像素的位置資訊CPU傳送至複數個縮放器440-1至440-n之各者。
線記憶體控制器420可回應於一輸出自寫入請求信號產生器431之寫入請求信號WR，將像素IM中的第一像素寫入線記憶體430。舉例而言，線記憶體控制器420在寫入請求信號WR維持一第二位準時，將像素IM中的第一像素寫入線記憶體430。此外，線記憶體控制器420可回應於輸出自讀取請求信號產生器433之讀取請求信號RR，讀取線記憶體430中儲存的第二像素，並且傳送該等讀取之第二像素至複數個縮放器440-1至440-n之各者作為影像資料DATA。
線記憶體控制器420可將一輸出自停頓指示信號產生器435之停頓指示信號STALL傳送至影像信號處理器230。也就是說，根據一例示性實施例之線記憶體控制器420可不將全部的像素IM都儲存在線記憶體430中，而只是選擇性地根據寫入請求信號WR來儲存像素。
線記憶體控制器420可包括有一位置資訊計算器421、一寫入控制電路423、一讀取控制電路425、及一停頓控制電路427。
位置資訊計算器421可在像素IM之各者上產生位置資訊CPI。根據一例示性實施例，位置資訊計算器421可計算像素IM中之一目前像素，並且將與該計算之一結果
對應的位置資訊CPI傳送至複數個縮放器440-1至440-n之各者。一目前像素可以是像素IM中一於一特定時間點輸入之像素。
寫入控制電路423可回應於一寫入請求信號WR，在線記憶體430中儲存像素IM中待於複數個縮放器440-1至440-n之各者中處理的第一像素。讀取控制電路425可回應於一讀取請求信號RR，讀取線記憶體430中所儲存之該等像素中待於複數個縮放器440-1至440-n之各者中處理的第二像素，並且將該等讀取之第二像素傳送至複數個縮放器440-1至440-n之各者。
停頓控制電路427可控制對影像處理處理器230之停頓指示信號STALL之一傳送。線記憶體430可根據線記憶體控制器420之一控制，儲存像素IM中該等待於複數個縮放器440-1至440-n之各者中處理之第一像素，或讀取線記憶體430中儲存之該等像素中待於複數個縮放器440-1至440-n中處理之第二像素。
根據一例示性實施例，線記憶體430可具體實現為一RAM、一DRAM、或一SRAM；但該線記憶體不受限於此。線記憶體430可由複數個縮放器440-1至440-n所共享。舉例而言，線記憶體430可由複數個縮放器441-1至441-n所共享。
寫入請求信號產生器431可基於從縮放器440-1至440-n之各者輸出之寫入請求信號WR1至WRn之各者，產生一寫入請求信號WR。舉例而言，寫入請求信號產生
器431可具體實現為一或閘；但該寫入請求信號產生器不受限於此。讀取請求信號產生器433可基於從縮放器440-1至440-n之各者輸出之讀取請求信號RR1至RRn之各者，產生一讀取請求信號RR。舉例而言，讀取請求信號產生器433可具體實現為該或閘；但該讀取請求信號產生器不受限於此。
停頓指示信號產生器435可基於從縮放器440-1至440-n之各者輸出之停頓指示信號ST1至STn之各者，產生一停頓指示信號STALL。舉例而言，停頓請求信號產生器435可具體實現為該或閘；但該停頓請求信號產生器不受限於此。
第一縮放器440-1可根據一第一縮放比，比例縮放一原始影像之一第一區域中包括的像素，並且產生該經比例縮放之像素HS1。
第一縮放器440-1可包括有一第一垂直縮放器441-1及一第一水平縮放器445-1。第一垂直縮放器441-1可根據該第一垂直縮放比垂直比例縮放該第一區域中包括的該等像素，並且輸出經垂直比例縮放的像素VS1。第一水平縮放器445-1可根據一第一水平縮放比水平比例縮放從第一垂直縮放器441-1輸出之經垂直比例縮放之像素VS1，並且輸出經水平比例縮放之像素HS1。
該第一縮放比可根據該第一垂直縮放比及該第一水平縮放比來判定。舉例而言，該第一垂直縮放比及該第一水平縮放比分別可以是一用於一比例放大或一比例縮
小之比率。
當第一水平縮放器445-1比例放大從第一垂直縮放器441-1輸出之經垂直比例縮放之像素VS1時，第一水平縮放器445-1可輸出第一停頓指示信號ST1至第一垂直縮放器441-1。第一垂直縮放器441-1可回應於第一停頓指示信號ST1，停止或延遲傳送經垂直比例縮放之像素VS1至第一水平縮放器445-1。此外，第一垂直縮放器441-1可回應於從第一水平縮放器445-1輸出之第一停頓指示信號ST1，傳送第一停頓指示信號ST1至停頓指示信號產生器435。
線記憶體控制器420之一停頓控制電路427可輸出一停頓指示信號STALL至影像處理處理器230。因此，影像處理處理器230可回應於停頓指示信號STALL，停止或延遲傳送像素OTFI至縮放器電路240。
當第一垂直縮放器441-1比例放大與輸出自線記憶體控制器420之該第一區域中包括之該等像素對應的影像資料DATA時，第一垂直縮放器441-1可傳送第一停頓指示信號ST1至停頓指示信號產生器435。因此，線記憶體控制器420之停頓控制電路427可輸出停頓指示信號STALL至影像處理處理器230。因此，影像處理處理器230可回應於停頓指示信號STALL，停止或延遲傳送像素OTFI至縮放器電路240。
如上述，當第一垂直縮放器441-1與第一水平縮放器445-1中之至少一者進行一比例放大操作時，停頓指示信號產生器435可產生停頓指示信號STALL。
第二縮放器440-2可與第一縮放器440-1同時或採用一平行方式，根據一第二縮放比，比例縮放該原始影像之該第二區域中包括的像素，並且產生經比例縮放的像素HS2。
第二縮放器440-2可包括有一第二垂直縮放器441-2及一第二水平縮放器445-2。第二垂直縮放器441-2可根據一第二垂直縮放比垂直比例縮放該第二區域中包括的該等像素，並且輸出經垂直比例縮放的像素VS2。第二水平縮放器445-2可根據一第二水平縮放比水平比例縮放從第二垂直縮放器441-2輸出之經垂直比例縮放之像素VS2，並且輸出經水平比例縮放之像素HS2。
該第二縮放比可根據該第二垂直縮放比及該第二水平縮放比來判定。舉例而言，該第二垂直縮放比及該第二水平縮放比分別可以是一用於一比例放大或一比例縮小之比率。
當第二水平縮放器445-2比例放大從第二垂直縮放器441-2輸出之經垂直比例縮放之像素VS2時，第二水平縮放器445-2可輸出一第二停頓指示信號ST2至第二垂直縮放器441-2。第二垂直縮放器441-2可回應於第二停頓指示信號ST2，停止或延遲傳送經垂直比例縮放之像素VS2至第二水平縮放器445-2。此外，第二垂直縮放器441-2可回應於從第水平縮放器445-2輸出之第二停頓指示信號ST2，傳送第二停頓指示信號ST2至停頓指示信號產生器435。
線記憶體控制器420之停頓控制電路427可輸出
一停頓指示信號STALL至影像處理處理器230。因此，影像處理處理器230可回應於停頓指示信號STALL，停止或延遲傳送像素OTFI至縮放器電路240。
當第二垂直縮放器441-2比例放大與輸出自線記憶體控制器420之該第二區域中包括之該等像素對應的影像資料DATA時，第二垂直縮放器441-2可傳送第二停頓指示信號ST2至停頓指示信號產生器435。因此，線記憶體控制器420之停頓控制電路427可輸出停頓指示信號STALL至影像處理處理器230。因此，影像處理處理器230可回應於停頓指示信號STALL，停止或延遲傳送像素OTFI至縮放器電路240。
如上述，當第二垂直縮放器441-2與第二水平縮放器445-2中之至少一者進行一比例放大操作時，停頓指示信號產生器435可產生一停頓指示信號STALL。
第n縮放器440-n可與第二縮放器440-2之一操作同時或採用一平行方式，根據一第n縮放比，比例縮放該原始影像之一第n區域中包括的像素，並且產生經比例縮放的像素HSn。
第n縮放器440-n可包括有一第n垂直縮放器441-n及一第n水平縮放器445-n。第n垂直縮放器441-n可根據一第n垂直縮放比垂直比例縮放該第n區域中包括的該等像素，並且輸出經垂直比例縮放的像素VSn。第n水平縮放器445-n可水平比例縮放從第n垂直縮放器441-n輸出之經垂直比例縮放之像素VSn，並且輸出經水平比例縮放之像素HSn。
該第n縮放比可根據該第n垂直縮放比及該第n水平縮放比來判定。舉例而言，該第n垂直縮放比及該第n水平縮放比分別可以是一用於一比例放大或一比例縮小之比率。
當第n水平縮放器445-n比例放大從第n垂直縮放器441-n輸出之經垂直比例縮放之像素VSn時，第n水平縮放器445-n可輸出一第n停頓指示信號STn至第n垂直縮放器441-n。第n垂直縮放器441-n可回應於一第n停頓指示信號STn，停止或延遲傳送經垂直比例縮放之像素VSn至第n水平縮放器445-n。此外，第n垂直縮放器441-n可回應於第n停頓指示信號STn，傳送第n停頓指示信號STn至停頓指示信號產生器435。
線記憶體控制器420之停頓控制電路427可輸出停頓指示信號STALL至影像處理處理器230。因此，影像處理處理器230可回應於停頓指示信號STALL，停止或延遲傳送像素OTFI至縮放器電路240。
當第n垂直縮放器441-n比例放大與輸出自線記憶體控制器420之該第二區域中包括之該等像素對應的影像資料DATA時，第n垂直縮放器441-n可傳送第n停頓指示信號STn至停頓指示信號產生器435。因此，線記憶體控制器420之停頓控制電路427可輸出停頓指示信號STALL至影像處理處理器230。因此，影像處理處理器230可回應於停頓指示信號STALL，停止或延遲傳送像素OTFI至縮放器電路240。
如上述，當第n垂直縮放器441-n與第n水平縮放器445-n中之至少一者進行一比例放大操作時，停頓指示信號產生器435可產生停頓指示信號STALL。
垂直縮放器440-1至440-n之各者所處理的對應區域彼此在尺寸方面可不同。此外，縮放器440-1至440-n之縮放比彼此間可不同。縮放器440-1至440-n各可同時或採用一平行方式，處理分配予縮放器440-1至440-n之各者之一區域中包括的像素。
垂直縮放器441-1至441-n各可包括有儲存裝置REG1-1至REG1-n之各者，該等儲存裝置儲存用於操作垂直縮放器441-1至441-n之各者所必要的資料或資訊。舉例而言，儲存裝置REG1-1至REG1-n各可以是一可藉由CPU210來設定或規劃的記憶體。根據一例示性實施例，儲存裝置REG1-1至REG1-n各可具體實現為一暫存器，例如一特殊功能暫存器(SFR)，但該暫存器不受限於此。儲存裝置REG1-1至REG1-n各可儲存區域資訊及一縮放比。
水平縮放器445-1至445-n各可包括有儲存裝置REG2-1至REG2-n之各者，該等儲存裝置儲存用於操作水平縮放器445-1至445-n之各者所必要的資料或資訊。儲存裝置REG2-1至REG2-n各可以是一可藉由CPU210來設定或規劃的記憶體。根據一例示性實施例，儲存裝置REG2-1至REG2-n各可具體實現為一暫存器，例如一特殊功能暫存器(SFR)，但該暫存器不受限於此。儲存裝置REG2-1至REG2-n各可儲存一縮放比。
圖4係圖3所示一第一垂直縮放器的方塊圖，圖6概念性展示該原始影像中包括的不同區域，圖7A至7C係描述處理圖6中所示該原始影像中包括之一第一區域與一第二區域之一程序的概念圖，並且圖8A及8B概念性展示一比例放大及一比例縮小。
由於垂直縮放器441-1至441-n在結構與操作方面彼此相同或類似，第一垂直縮放器441-1之一結構與一操作將會參照圖1至圖8詳細說明。
第一垂直縮放器441-1可包括有一垂直比例縮放控制器442-1、一開關電路443-1、一垂直比例縮放核心444-1、及一儲存裝置REG1-1。
該原始影像可藉由一寬度IMAGEW及一高度IMAGEH來判定。寬度IMAGEW及高度IMAGEH各可根據像素的數量來判定。
假設第一縮放器440-1在該原始影像中包括的該等像素中之一第一區域SC0中所包括的像素上進行一比例縮放操作，而第二縮放器440-2在該原始影像中包括的該等像素中之一第二區域SC1中所包括的像素上進行一比例縮放操作。
假設一包括於第一縮放器440-1中的儲存裝置REG1-1包括有一儲存第一區域資訊之第一儲存區域RI、及一儲存一第一縮放比之第二儲存區域SR。亦假設一包括於第二縮放器440-2中的儲存裝置REG1-2包括有一儲存第二區域資訊之第一儲存區域RI、及一儲存一第二縮放比之第二
儲存區域SR。
儲存裝置REG1-1之第一儲存區域RI可儲存第一區域SC0之一尺寸或該尺寸上的資訊。舉例而言，該尺寸可包括有第一區域SC0之一第一開始坐標SP1、第一區域SC0之一第一寬度SW1、第一區域SC0之一第一高度SH1。舉例而言，第一區域SC0之一第一結束坐標EP1可由第一開始坐標SP1、第一寬度SW1、及第一高度SH1來判定。根據一例示性實施例，儲存裝置REG1-1之第一儲存區域RI可儲存第一區域SC0之第一開始坐標SP1、及第一區域SC0之第一結束坐標EP1；但不受限於此。
儲存裝置REG1-2之第一儲存區域RI可儲存第二區域SC1之一尺寸或該尺寸上的資訊。舉例而言，該尺寸可包括有第二區域SC1之一第二開始坐標SP2、第二區域SC1之一第二寬度SW2、第二區域SC1之一第二高度SH2。舉例而言，第二區域SC1之一第二結束坐標EP2可由第二開始坐標SP2、第二寬度SW2、及第二高度SH2來判定。根據一例示性實施例，儲存裝置REG1-2之第一儲存區域RI可儲存第二區域SC1之第二開始坐標SP2、及第二區域SC1之第二結束坐標EP2；但不受限於此。
儲存裝置REG1-1及REG1-2之各者之第一儲存區域RI只要儲存可界定各該區域SC0及SC1之一尺寸便已足夠。根據一例示性實施例，區域SC0及SC1可以或可不重疊。
第一縮放器440-1之垂直比例縮放控制器442-1
可控制一開關信號SC0_VALID之一啟動時序、一第一寫入請求信號WR1之一啟動時序、一第一讀取請求信號RR1之一啟動時序、及一第一停頓指示信號ST1之一啟動時序。在這裡，啟動可以是一高位準及一低位準其中一者；然而，圖7A至圖7C中之一啟動位準係假設為一高位準。
第二縮放器440-2之一垂直比例縮放控制器可使用儲存裝置REG1-2中儲存之資料或資訊，控制一開關信號SC1_VALID之一啟動時序、一第二寫入請求信號WR2之一啟動時序、一第二讀取請求信號RR2之一啟動時序、及一第二停頓指示信號ST2之一啟動時序。
第一縮放器440-1之垂直比例縮放控制器442-1可使用儲存裝置REG1-1之第二儲存區域SR中儲存之資料，控制垂直比例縮放核心441-1之一垂直縮放比。第二縮放器440-2之一垂直比例縮放控制器可使用儲存裝置REG1-2之該第二儲存區域中儲存之資料，控制垂直比例縮放核心441-2之一垂直縮放比。
該原始影像或一原始圖框中包括的像素IM可循序輸入至線記憶體控制器420。位置資訊計算器421可計算像素IM中之一目前像素之一位置(1,1)，並且將與經計算之位置對應的位置資訊CPI傳送至垂直縮放器441-1至441-n之各者。
第一垂直縮放器441-1之垂直比例縮放控制器442-1可比較對應於位置資訊CPI之一目前坐標(1,1)與一第一開始坐標SP1=(3,4)，並且根據該比較之一結果，輸出具有
一低位準之第一寫入請求信號WR1至寫入請求信號產生器431。此外，垂直比例縮放控制器442-1可根據該比較之一結果，輸出具有一低位準之第一讀取請求信號RR1至讀取請求信號產生器433。另外，垂直比例縮放控制器442-1可根據該比較之一結果，輸出具有一低位準之一開關信號SC0_VALID至開關電路443-1。
在這裡，(x,y)展示一像素之一坐標(或位置)；然而，為了方便說明，係假設(x,y)為一坐標或一像素。因此，寫入請求信號產生器431產生具有一低位準之一寫入請求信號WR，使得寫入控制電路423不在腺記憶體430中儲存一目前像素(1,1)。根據一例示性實施例，可捨棄目前像素(1,1)。
根據一例示性實施例，即使目前像素(1,1)係傳送至第一垂直縮放器441-1，垂直比例縮放控制器442-1仍輸出具有一低位準之一開關信號SC0_VALID，目前像素(1,1)並不傳送至垂直比例縮放核心444-1。
不包括於第一區域SC0中之各別像素(1,2)、(3,1)、(3,2)、(3,3)、(3,10)、(3,11)、(4,1)、(4,2)、(4,3)、(4,10)、(4,11)、(5,10)、(5,11)、(6,10)、(6,11)、(7,10)、(7,11)、(8,10)、(8,11)、(9,4)、及類似者之處理與不包括於第一區域SC0之像素(1,1)之處理相同，因此將不詳細說明各別像素(1,2)、(3,1)、(3,2)、(3,3)、(3,10)、(3,11)、(4,1)、(4,2)、(4,3)、(4,10)、(4,11)、(5,10)、(5,11)、(6,10)、(6,11)、(7,10)、(7,11)、(8,10)、(8,11)、(9,4)之處理。
然而，位置資訊計算器421可計算像素IM中之一目前像素(3,4)之一位置，並且將與經計算之位置對應的位置資訊CPI傳送至垂直縮放器441-1至441-n之各者。
第一垂直縮放器441-1之垂直比例縮放控制器442-1比較對應於位置資訊CPI之一目前坐標(3,4)與一第一開始坐標SP1=(3,4)，並且根據該比較之一結果，輸出具有一高位準之第一寫入請求信號WR1至寫入請求信號產生器431。此外，垂直比例縮放控制器442-1可根據該比較之一結果，輸出具有一低位準之第一讀取請求信號RR1至讀取請求信號產生器433。另外，垂直比例縮放控制器442-1可根據該比較之一結果，輸出具有一低位準之一開關信號SC0_VALID至開關電路443-1。寫入請求信號產生器431產生具有一高位準之一寫入請求信號WR，使得寫入控制電路423可不在線記憶體430中儲存目前像素(3,4)。
包括於第一區域SC0中之各別像素(3,5)至(3,9)、(4,4)至(4,9)、(5,4)至(5,9)、(6,4)至(6,9)、(7,4)至(7,9)、及(8,4)至(8,9)之處理與包括於第一區域SC0中之像素(3,4)之處理相同，因此將不詳細說明各別像素(3,5)至(3,9)、(4,4)至(4,9)、(5,4)至(5,9)、(6,4)至(6,9)、(7,4)至(7,9)、及(8,4)至(8,9)之處理。
一讀取操作係假設以4*6像素為單位來進行。當一目前像素(7,4)是在4*6像素(3,4)至(3,9)、(4,4)至(4,9)、(5,4)至(5,9)、及(6,4)至(6,9)儲存於線記憶體430後於第一時間點T1輸入至線記憶體控制器420時，位置資訊計算
器421可計算目前像素(7,4)之一位置，並且傳送與該經計算之位置對應之位置資訊CPI至垂直縮放器441-1至441-n之各者。
第一垂直縮放器441-1之垂直比例縮放控制器442-1可於一第一時間點T1，基於與位置資訊CPI對應之目前坐標(7,4)，產生一具有一高位準之第一寫入請求信號WR1、一具有一高位準之第一讀取請求信號RR1、及一具有一高位準之開關信號SC0_VALID。
因此，寫入控制電路423可將目前像素(7,4)寫入線記憶體430，讀取控制電路425可讀取線記憶體430中儲存的4*6像素(3,4)至(3,9)、(4,4)至(4,9)、(5,4)至(5,9)、及(6,4)至(6,9)，並且傳送與該等讀取之像素對應之影像資料DATA至垂直縮放器441-1至441-n之各者。
第一垂直縮放器441-1之垂直比例縮放控制器442-1產生一具有一高位準之開關信號SC0_VALID，使得開關電路443-1可回應於具有一高位準之開關信號SC0-VALID，傳送與4*6像素(3,4)至(3,9)、(4,4)至(4,9)、(5,4)至(5,9)、及(6,4)至(6,9)對應之影像資料DATA至垂直比例縮放核心444-1。影像資料DATA可包括有如圖7B所示之複數個影像資料SC0_DATA0至SC0_DATA3。舉例而言，這複數個影像資料SC0_DATA0至SC0_DATA3可採用一平行方式來傳送。
垂直比例縮放核心444-1可根據第一儲存區域SR中儲存之第一垂直縮放比，垂直比例縮放與4*6像素(3,4)
至(3,9)、(4,4)至(4,9)、(5,4)至(5,9)、及(6,4)至(6,9)對應之影像資料DATA，並且輸出經垂直比例縮放之像素VS1。像素(7，5)至(7,9)各採用與在線記憶體430儲存像素(7,4)一樣的方式儲存於線記憶體430中。
當一目前像素(8,4)是在4*6像素(4,4)至(4,9)、(5,4)至(5,9)、(6,4)至(6,9)、及(7,4)至(7,9)儲存於線記憶體430後於第二時間點T2輸入至線記憶體控制器420時，位置資訊計算器421可計算目前像素(8,4)之一位置，並且傳送與該經計算之位置對應之位置資訊CPI至垂直縮放器441-1至441-n之各者。
第一垂直縮放器441-1之垂直比例縮放控制器442-1可基於與位置資訊CPI對應之目前坐標(8,4)，產生一具有一高位準之第一寫入請求信號WR1、一具有一高位準之第一讀取請求信號RR1、及一具有一高位準之開關信號SC0_VALID。
因此，寫入控制電路423可將目前像素(8,4)寫入線記憶體430，讀取控制電路425可讀取線記憶體430中儲存的4*6像素(4,4)至(4,9)、(5,4)至(5,9)、及(6,4)至(6,9)、及(7,4)至(7,9)，並且傳送與讀取之像素(4,4)至(4,9)、(5,4)至(5,9)、及(6,4)至(6,9)、及(7,4)至(7,9)對應之影像資料DATA至垂直縮放器441-1至441-n之各者。
由於第一垂直縮放器441-1之垂直比例縮放控制器442-1產生一具有一高位準之開關信號SC0_VALID，因此開關電路443-1可回應於具有一高位準之開關信號SC0-
VALID，傳送與4*6像素(4,4)至(4,9)、(5,4)至(5,9)、(6,4)至(6,9)、及(7,4)至(7,9)對應之影像資料DATA至垂直比例縮放核心444-1。影像資料DATA可包括有如圖7B所示之複數個影像資料SC0_DATA0至SC0_DATA3。舉例而言，這複數個影像資料SC0_DATA0至SC0_DATA3可採用一平行方式來傳送。
垂直比例縮放核心444-1可根據第一儲存區域SR中儲存之第一垂直縮放比，垂直比例縮放與4*6像素(4,4)至(4,9)、(5,4)至(5,9)、(6,4)至(6,9)、及(7,4)至(7,9)對應之影像資料DATA，並且輸出經垂直比例縮放之像素VS1。
第二縮放器440-2可產生一具有一高位準之第二寫入請求信號WR2，以便在線記憶體430中儲存該原始影像中包括之像素IM中之一第二區域SC1中所包括的像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、(7,5)至(7,10)、及(8,5)至(8,10)。
當一目前像素(8,5)是在第二區域SC1中包括之像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、(7,5)至(7,10)、及(8,5)至(8,10)中的4*6像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、及(7,5)至(7,10)儲存於線記憶體430後於一第三時間點T3輸入至線記憶體控制器420時，位置資訊計算器421可計算目前像素(8,5)之一位置，並且傳送與該經計算之位置對應之位置資訊CPI至垂直縮放器441-1至441-n之各者。
第二垂直縮放器441-2之垂直比例縮放控制器可
於一第三時間點T3，基於與位置資訊CPI對應之目前坐標(8,5)，產生一具有一高位準之第二寫入請求信號WR2、一具有一高位準之第二讀取請求信號RR2、及一具有一高位準之開關信號SC1_VALID。
因此，寫入控制電路423可將目前像素(8,5)寫入線記憶體430，讀取控制電路425可讀取線記憶體430中儲存的4*6像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、及(7,5)至(7,10)，並且傳送與讀取之像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、及(7,5)至(7,10)對應之影像資料DATA至垂直縮放器441-1至441-n之各者。
由於第二垂直縮放器441-2之該垂直比例縮放控制器產生一具有一高位準之開關信號SC1_VALID，第二垂直縮放器441-2之一開關電路可回應於具有一高位準之開關信號SC1_VALID，傳送與4*6像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、及(7,5)至(7,10)對應之影像資料DATA至第二垂直縮放器441-2之一垂直比例縮放核心。影像資料DATA可包括有如圖7C所示之複數個影像資料SC1_DATA0至SC1_DATA3。舉例而言，這複數個影像資料SC1_DATA0至SC1_DATA3可採用一平行方式來傳送。
第二垂直縮放器441-2之垂直比例縮放核心可根據該第一儲存區域中儲存之一第二垂直縮放比，垂直比例縮放與4*6像素(4,5)至(4,10)、(5,5)至(5,10)、及(6,5)至(6,10)、及(7,5)至(7,10)對應之該影像資料DATA，並輸出垂直比例縮放像素VS2。
於一第三時間點T3，可採用一平行方式進行第一垂直縮放器441-1之一操作及第二垂直縮放器441-2之一操作。也就是說，對於從第三時間點T3起算之給定時間，可採用一平行方式進行第一縮放器440-1之一操作及第二縮放器440-2之一操作。舉例而言，第一縮放器440-1之該操作可與第二縮放器440-2之該操作部分或整體重疊。
圖5係展示圖2所示該一輸入多輸出縮放器之另一例示性實施例的方塊圖。請參照圖2及圖5，一一輸入多輸出縮放器410B可包括有縮放器核心410-1、線記憶體430、一先進先出(FIFO)控制器450、一第一選擇器451、一第二選擇器453、及一線緩衝器455。舉例而言，FIFO可包括有FIFO控制器450及線緩衝器455。
除了輸入像素由IM變成PO外，圖3之縮放器核心410-1之一結構及一操作與圖5之縮放器核心410-1之一結構及一操作相同，因而將會省略對圖5之縮放器核心410-1的一詳細說明。
一能夠以K個像素為單位進行一比例縮小操作的縮放器需要K個線緩衝器以便進行一比例放大操作(或一上取樣操作)，並且需要(K-1)個線緩衝器以便進行一比例縮小操作(或降低取樣操作)，其中K為二或二以上的自然數。K個像素可以是該原始影像中包括之同一列或同一行中所包括的像素。
假設縮放器核心410-1以四個像素為單位進行一比例縮放操作，線記憶體430包括有三個線緩衝器430-1、
430-2、及430-3，而FIFO包括有一個線緩衝器455。假設一選擇信號SEL在該比例放大操作期間具有一第一位準，而選擇信號SEL在該比例縮小期間具有一第二位準。假設選擇信號SEL之一位準是基於一暫存器，例如SFR，中儲存的資料或資訊來判定。依照一縮放比之資料或資訊係假設儲存於SFR中。
產生一具有一第一位準(例如邏輯0)之選擇信號時，線緩衝器455係透過第一選擇器451連接至縮放器核心410-1。因此，縮放器核心410-1可在該比例放大操作期間使用四個線緩衝器430-1、430-2、430-3、及455。也就是說，縮放器核心410-1可在四個線緩衝器430-1、430-2、430-3、及455中儲存的像素上進行一比例縮放操作。
產生一具有一第一位準之選擇信號SEL時，從圖2之選擇器401(循序)輸出的像素IM可透過第二選擇器453，輸入至縮放器核心410-1作為輸入像素FO。也就是說，像素IM旁通FIFO控制器450。
產生一具有一第二位準之選擇信號SEL時，線緩衝器455係透過第一選擇器451連接至FIFO控制器450。因此，縮放器核心410-1在該比例縮小操作期間，可僅存取三個線緩衝器430-1、430-2、及430-3。
從圖2之選擇器401(循序)輸出的像素IM可透過FIFO控制器450、線緩衝器455、及第二選擇器453，輸入至縮放器核心410-1作為輸入像素FO。因此，一一輸入多輸出縮放器410B可在該比例縮小操作期間，透過FIFO操
作為一硬即時系統。舉例而言，當以K個像素為單位進行處理之一輸入多輸出縮放器410B操作為一硬即時系統時，用於一比例縮小所需之線緩衝器數量為(K-1)，使得一剩餘的線緩衝器(例如455)可當作一緩衝器用於該硬即時系統。
第一選擇器451可具體實現為一解多工器，而第二選擇器453可具體實現為一多工器。透過根據選擇信號SEL之一位準操作之第一選擇器451，FIFO控制器450及縮放器核心410-1可使用線緩衝器455。也就是說，線緩衝器455可當作一共享線緩衝器使用。
FIFO在該比例縮小操作期間，可克服諸如一記憶體310之中斷等潛伏或延遲，或解決一記憶體管理單元(MMU)之變換失誤。當記憶體310係具體實現為一DRAM時，該中斷可在因為該DRAM之一重新整理而無法將資料寫入該DRAM時產生。FIFO係具體實現為一輸入多輸出縮放器410B，藉此可縮減DMA FIFO之可由複數個寫入DMA控制器405-1至405-n中之至少一者使用之一區域。
透過根據選擇信號SEL之一位準操作之第二選擇器453，可提供FIFO控制器450之輸入像素IM、或FIFO控制器450之輸出像素作為縮放器核心410-1之輸入像素FO。
圖9係展示圖1所示該縮放器電路之另一例示性實施例的方塊圖。請參照圖9，縮放器電路240A可包括有選擇器401、讀取DMA控制器403、複數個寫入DMA控制器405-1至405-n、一輸入多輸出縮放器410、及複數個後縮
放器407-1至407-n。
後縮放器407-1至407-n各可垂直及水平比例縮小輸出自一輸入多輸出縮放器410之經比例縮放之像素HS1至HSn之各者，並且傳送經比例縮小之像素HS1’至HSn’至複數個DMA控制器405-1至405-n。也就是說，後縮放器407-1至407-n各可僅進行該比例縮小操作。
為了在一小面積裡具體實現一具有一縮小比之縮放器電路240A，可在兩個步驟中進行該比例縮小操作。該兩個步驟中之一第一步驟是藉由一輸入多輸出縮放器410來進行，而該兩個步驟中之一第二步驟是藉由後縮放器407-1至407-n來進行。舉例而言，當縮放器電路240A之一縮小比可以是1/8時，一輸入多輸出縮放器410之一縮小比可以是1/4，而後縮放器407-1至407-n之各者之一縮小比可以是1/2。
後縮放器407-1至407-n之各者之一最大輸入頻寬可藉由一輸入多輸出縮放器410之一最大輸入頻寬、及一輸入多輸出縮放器410之一最大縮小比來判定。舉例而言，後縮放器407-1至407-n之各者之該最大輸入頻寬可藉由將一輸入多輸出縮放器410之該最大輸入頻寬乘以一輸入多輸出縮放器410之一最大縮小比來判定。
一輸入多輸出縮放器410之一輸入影像必須是該原始影像，而記憶體430必須要得以共享，使得用於後比例縮放之後縮放器407-1至407-n必須連接至一輸入多輸出縮放器410之一輸出端。
圖10係圖9所示一後縮放器的方塊圖。請參照圖10，複數個後縮放器407-1至407-n在結構及操作方面實質相同或類似，因而將會說明一第一後縮放器407-1之一結構及一操作。
第一後縮放器407-1可包括有一線記憶體501、一垂直縮放器503、及一水平縮放器505。
垂直縮放器503可接收從圖3之第一縮放器440-1之第一水平縮放器445-1輸出的經比例縮放之像素HS1，並且在線記憶體501中儲存經比例縮放之像素HS1。當用於處理所需的經比例縮放之像素HS1儲存於線記憶體501中時，垂直縮放器503可從線記憶體501讀取經比例縮放之像素HS1、根據一垂直縮放比垂直比例縮小所讀取之經比例縮放之像素HS1、並輸出經垂直比例縮小之像素VS1’至水平縮放器505。
水平縮放器505可根據一水平縮放比水平比例縮小經垂直比例縮放之像素VS1’，並且輸出經水平比例縮小之像素HS1’至第一寫入DMA控制器405。第一後縮放器407-1之一縮放比可根據垂直縮放器503之一垂直縮放比(例如一縮小比)、及水平縮放器505之一水平縮放比(例如一縮小比)來判定，該垂直縮放器及該水平縮放器係包括第一後縮放器407-1中。
第二後縮放器407-2之一縮放比可根據一垂直縮放器之一垂直縮放比(例如一縮小比)、及水平縮放器之一水平縮放比(例如一縮小比)來判定，該垂直縮放器及該水
平縮放器係包括第二後縮放器407-2中。
一第n後縮放器407-n之一縮放比可根據一垂直縮放器之一垂直縮放比(例如一縮小比)、及水平縮放器之一水平縮放比(例如一縮小比)來判定，該垂直縮放器及該水平縮放器係包括於第n後縮放器407-n中。
第一後縮放器407-1之縮放比、第二後縮放器407-2之縮放比、及第n縮放器407-n之縮放比彼此間可不同。
如圖3所示，後縮放器407-1至407-n之各者中包括的各垂直縮放器可包括有一儲存一垂直縮小比之儲存裝置，並且後縮放器407-1至407-n之各者中包括的各水平縮放器可包括有一儲存一水平縮小比之儲存裝置。此外，該各垂直縮放器及該各水平縮放器可包括有一可控制一比例縮放操作之比例縮放控制器。
圖11係描述圖1所示該資料處理系統之一操作的流程圖。請參照圖1至圖11，一影像感測器300可產生對應於一原始影像(或原始影像資料)之像素，並且傳送該等產生之像素至介面220(操作S110)。影像信號處理器230可轉換透過介面220接收到的像素之一格式(操作S112)。
當該原始影像中包括之至少一個區域中所包括的像素比例放大(操作S114判斷為「是」)時，影像信號處理器230可透過一第二路徑PATH2在一記憶體310中儲存像素RIM(操作S116)。一讀取DMA控制器403可根據CPU210之一控制讀取(或擷取)記憶體310中儲存的像素RIM，並且透過選擇器401傳送經讀取之像素RIM至一輸入多輸出縮
放器410(操作S118)。
一輸入多輸出縮放器410中包括之縮放器440-1至440-n各可在待由縮放器440-1至440-n之各者處理之各區域中所包括的像素上進行一比例縮放操作(例如比例放大操作)(操作S120)。舉例而言，當縮放器440-1至440-n中之至少一者進行一比例放大操作時，可進行操作S114至S120。
可根據複數個寫入DMA控制器405-1至405-n中之至少一者之一控制，在記憶體310中儲存藉由縮放器440-1至440-n中之至少一者所比例放大之像素(操作S124)。
當與該原始影像中所包括之至少一個區域對應的像素進行比例縮小時(操作S114判斷為「否」)，影像信號處理器230可透過一第一路徑PATH1傳送像素OTFI至選擇器401。選擇器401可傳送輸入像素OTFI至一輸入多輸出縮放器410作為輸出像素IM。
一輸入多輸出縮放器410可即時比例縮放輸出自選擇器401之像素IM(操作S122)。也就是說，一輸入多輸出縮放器410中包括之縮放器440-1至440-n各可在待由縮放器440-1至440-n之各者處理之一區域中所包括的像素上，即時進行一比例縮放操作(例如一比例縮小操作)(操作S122)。
可根據複數個寫入DMA控制器405-1至405-n中之至少一者之一控制，在記憶體310中儲存藉由縮放器440-1至440-n中之至少一者所比例縮小之像素(操作S124)。舉
例而言，操作S114至S124可以圖框或圖框資料為單位來處理。
圖12係描述圖2所示該縮放器電路之一操作的流程圖。請參照圖1至圖12，一輸入多輸出縮放器410可接收與一原始影像(或原始影像資料)對應之像素IM中的一目前像素(操作S210)。像素IM可透過複數條路徑PATH1及PATH2其中一者，以像素為單位循序輸入。一個像素可用複數個位元來表達。
位置資訊計算器421之位置資訊可計算一目前像素(操作S212)之位置資訊CPI，例如一目前坐標。一目前像素之經計算之位置資訊CPI，例如該等目前坐標，可傳送至縮放器440-1至440-n之各者之垂直縮放器441-1至441-n之各者(操作S214)。
如參照圖6、圖7A、圖7B及圖7C所述，垂直縮放器441-1至441-n各可判斷該等接收到的目前坐標與儲存裝置REG1-1至REG1-n之各者中儲存之各區域之開始坐標(或各區域中之坐標)是否相同(操作S216)。
當目前坐標是待由垂直縮放器441-1至441-n中之至少一者處理之一區域中之開始坐標(或一區域中之坐標)時，垂直縮放器441-1至441-n中之至少一者可產生一經啟動寫入請求信號(操作S218)。舉例而言，無論該等目前坐標是否為待由垂直縮放器441-1至441-n之各者處理之一區域中之坐標，位置資訊計算器421都可在各時間點計算目前坐標(操作S212)。
寫入控制電路423可將輸入至線記憶體控制器420之像素寫入線記憶體430，而寫入請求信號WR仍維持一高位準(操作S220)。舉例而言，寫入控制電路423可將第一區域SC0中包括的像素寫入線記憶體430，並且將第二區域SC1中包括的像素寫入線記憶體430。
根據一例示性實施例，當該等目前坐標是待由垂直縮放器441-1至441-n中之至少一者處理之一區域的結束坐標時，垂直縮放器441-1至441-n中之至少一者可產生一讀取請求信號(操作S222)。根據另一例示性實施例，如參照圖7A至圖7C所述，將待處理像素，例如4*6像素，儲存於線記憶體430中之後，垂直縮放器441-1至441-n中之至少一者可產生一經啟動讀取請求信號。
讀取控制電路425可讀取區域SC0及SC1之各者中所包括且線記憶體430中所儲存的像素，並且將該等讀取之像素傳送至垂直縮放器441-1至441-n之各者(操作S224)。
垂直縮放器441-1至441-n中可將第一區域SC0中所包括的該等像素進行比例縮放的第一垂直縮放器441-1可根據第一垂直縮放器441-1之一垂直縮放比來垂直比例縮放該等像素(操作S226)。
垂直縮放器441-1至441-n中可將第二區域SC1中所包括的該等像素進行比例縮放的第二垂直縮放器441-2可根據第二垂直縮放器441-2之一垂直縮放比來垂直比例縮放該等像素(操作S226)。垂直縮放器441-1、441-2、及
441-n可同時或採用一平行方式進行一比例縮放操作。
第一水平縮放器445-1可根據第一水平縮放器445-1之一水平縮放比，水平比例縮放該等藉由第一垂直縮放器441-1垂直比例縮放之像素(操作S228)。第二水平縮放器445-2可根據第一水平縮放器445-2之一水平縮放比，水平比例縮放該等藉由第二垂直縮放器441-2垂直比例縮放之像素(操作S228)。一第n水平縮放器445-n可根據第n水平縮放器445-n之一水平縮放比，水平比例縮放該等藉由第二垂直縮放器441-2垂直比例縮放之像素(操作S228)。
第一寫入DMA控制器405-1可透過匯流排架構203，將輸出自第一水平縮放器445-1之經比例縮放之像素HS1輸出至一週邊電路，例如一記憶體控制器250及/或一顯示器330(操作S230)。第二寫入DMA控制器405-2可透過匯流排架構203，將輸出自第二水平縮放器445-2之經比例縮放之像素HS2輸出至一週邊電路，例如一記憶體控制器250及/或一顯示器330。
一第n寫入DMA控制器405-n可透過匯流排架構203，將輸出自第n水平縮放器445-n之經比例縮放之像素HSn輸出至一週邊電路，例如一記憶體控制器250及/或一顯示器330(操作S230)。
一例示性實施例並不受限於此，仍可包括有一或多個在一電腦可讀記錄媒體上具體實現成電腦可讀碼的單元。該電腦可讀記錄媒體是任何一種可儲存可在之後藉由一電腦系統讀取之資料的資料儲存裝置。該電腦可讀記
錄媒體之實例包括有唯讀記憶體(ROM)、隨機存取記憶體(RAM)、CD-ROM、磁帶、軟式磁片、及光學資料儲存裝置。該電腦可讀記錄媒體亦可分布於網路耦合之電腦系統，以使得該電腦可讀碼係以一分布方式來儲存並執行。一例示性實施例亦可寫成一透過一諸如一載波之電腦可讀傳輸媒體傳送之電腦程式，並且接收於及實施成執行該等程式之通用或特殊用途數位電腦。一根據一例示性實施例之縮放器電路及具有該縮放器電路之裝置可採用一平行方式，從單一影像產生具有不同比例縮放之影像、具有不同解析度之影像、經調整尺寸之影像。因此，縮放器電路及包括有該縮放器之裝置可以降低電力消耗量。
雖然已展示並且說明一些例示性實施例概念，所屬技術領域中具有通常知識者仍將了解的是，這些例示性實施例中仍可施作各種變更，但不會脫離廣義發明概念之原理及精神，該廣義發明概念的範疇係界定於隨附申請專利範圍及其均等論述內。
410A‧‧‧一輸入多輸出縮放器
410-1‧‧‧縮放器核心
420‧‧‧線記憶體控制器
421‧‧‧位置資訊計算器
423‧‧‧寫入控制電路
425‧‧‧讀取控制電路
427‧‧‧停頓控制電路
430‧‧‧線記憶體
431‧‧‧寫入請求信號產生器
433‧‧‧讀取請求信號產生器
435‧‧‧停頓指示信號產生器
440-1~440-n、441-1~441-n‧‧‧縮放器
445-1‧‧‧第一水平縮放器
445-2‧‧‧第二水平縮放器
445-n‧‧‧第n水平縮放器
Claims (25)
- 一種縮放器電路，其包含有；一第一縮放器，其受阻配為可在一第一垂直比例縮放操作後進行一第一水平比例縮放操作；一第二縮放器，其受阻配為可在一第二垂直比例縮放操作後進行一第二水平比例縮放操作；以及一線記憶體，其可由該第一縮放器與該第二縮放器所共享，其中，該第一縮放器及該第二縮放器中的每一者分別產生一第一影像及一第二影像中的每一者，該第一影像及該第二影像具有不同於使用該線記憶體之一單一影像的解析度。
- 如請求項1之縮放器電路，其更包含有一線記憶體控制器，其受阻配為可把該單一影像中所包括之像素中的每一者上之位置資訊傳送至該第一縮放器及該第二縮放器。
- 如請求項2之縮放器電路，其中，該第一縮放器受阻配為可從使用該等像素中的每一者上之該位置資訊的該等像素中選擇出第一像素，該等第一像素與待儲存於該線記憶體中之該第一影像有關，以及其中，該第二縮放器受阻配為可在使用該等像素中的每一者上之該位置資訊的該等像素中選擇出第二像素，該第二像素與待儲存於該線記憶體中之該第二影像 有關。
- 如請求項3之縮放器電路，其中該第一縮放器受阻配為可判定出使用該等像素中的每一者上之該位置資訊且儲存於該線記憶體中之該等第一像素的第一讀取時序，以及其中，該第二縮放器受阻配為可判定出使用該等像素中的每一者上之該位置資訊且儲存於該線記憶體中之該等第二像素的第二讀取時序。
- 如請求項4之縮放器電路，其中，該第一縮放器受阻配為可控制該線記憶體控制器，以在該線記憶體中儲存該等第一像素，並且根據該等第一讀取時序而讀取該線記憶體中所儲存之該等第一像素，以及其中，該第二縮放器受阻配為可控制該線記憶體控制器，以在該線記憶體中儲存該等第二像素，並且根據該等第二讀取時序而讀取該線記憶體中所儲存之該等第二像素。
- 如請求項5之縮放器電路，其中該第一縮放器包括一第一垂直縮放器，其受阻配為可垂直比例縮放從該線記憶體控制器傳送出之該等第一像素；以及一第一水平縮放器，其受阻配為可水平比例縮放從該第一垂直縮放器所輸出之像素以產生該第一影像，其中該第二縮放器包括有一第二垂直縮放器，其受阻配為可垂直比例縮放從該線記憶體控制器傳送出之該等第二像素；以及 一第二水平縮放器，其受阻配為可水平比例縮放從該第二垂直縮放器所輸出之像素以產生該第二影像。
- 如請求項1之縮放器電路，其更包含有：一第一後縮放器，其受阻配為可將該第一縮放器所產生之該第一影像比例縮小；以及一第二後縮放器，其受阻配為可將該第二縮放器所產生之該第二影像比例縮小。
- 如請求項1之縮放器電路，其更包含有一線記憶體控制器，其受阻配為可在該線記憶體中儲存該等像素中與該第一影像有關的多個第一像素，並根據該第一縮放器之一控制而讀取該線記憶體中所儲存的該等第一像素，以及在該線記憶體中儲存該等像素中與該第二影像有關之第二像素，並根據該第二縮放器之一控制而讀取該線記憶體中所儲存之該等第二像素。
- 如請求項8之縮放器電路，其中該第一縮放器包括有一第一垂直縮放器，其受阻配為可垂直比例縮放從該線記憶體控制器傳送出之該等第一像素；以及一第一水平縮放器，其受阻配為可水平比例縮放輸出自該第一垂直縮放器之像素以產生該第一影像，其中該第二縮放器包括有一第二垂直縮放器，其受阻配為可垂直比例縮放從該腺記憶體控制器傳送出之該等第二像素的；以及一第二水平縮放器，其受阻配為可水平比例縮放從 該第二垂直縮放器所輸出之像素以產生該第二影像。
- 如請求項8之縮放器電路，其更包含有：一FIFO控制器；一線緩衝器，其可供該FIFO控制器或該線記憶體控制器存取；以及一選擇器，其受阻配為可提供該FIFO控制器之一輸入影像或該FIFO控制器之一輸出影像以作為該單一影像。
- 如請求項10之縮放器電路，其中，當該第一影像及該等第二影像為比例放大之影像、且該單一影像係該FIFO控制器之該輸出影像時，該第一縮放器及該第二縮放器中的每一者分別使用該線記憶體產生該第一影像及該第二影像，以及當該第一影像及該等第二影像係比例放大影像、且該單一影像係該FIFO控制器之該輸入影像時，該第一縮放器及該第二縮放器中的每一者使用該線記憶體及該線緩衝器以分別產生該第一影像及該第二影像。
- 一種應用處理器，其包含：一匯流排；以及一縮放器電路，該縮放器電路連接至該匯流排，其中該縮放器電路包括一第一縮放器，其受阻配為可在一第一垂直比例縮放操作後進行一第一水平比例縮放操作，一第二縮放器，其受阻配為可在一第二垂直比例縮 放操作後進行一第二水平比例縮放操作，以及一線記憶體，其可由該第一縮放器與該第二縮放器所共享，其中該第一縮放器及該第二縮放器中的每一者分別產生一第一影像及一第二影像，該第一影像及該第二影像分別具有不同於使用該線記憶體之一單一影像的解析度。
- 如請求項12之應用處理器，其更包含有一線記憶體控制器，其受阻配為可把該單一影像中所包括之像素中的每一者上之位置資訊傳送至該第一縮放器及該第二縮放器，其中該第一縮放器受阻配為可在使用該等像素中的每一者上之該位置資訊的該等像素中選擇出第一像素，該第一像素與待儲存於該線記憶體中之該第一影像有關，以及該第二縮放器受阻配為可在使用該等像素中的每一者上之該位置資訊的該等像素中選擇出第二像素，該第二像素與待儲存於該線記憶體中之該第二影像有關。
- 如請求項13之應用處理器，其中該第一縮放器受阻配為可判定出使用該等像素中的每一者上之該位置資訊，且儲存於該線記憶體中之該等第一像素的第一讀取時序，其中該第二縮放器受阻配為可判定出使用該等像 素中的每一者上之該位置資訊且儲存於該線記憶體中之該等第二像素的第二讀取時序，其中第一縮放器受阻配為可控制該線記憶體控制器，用以在該線記憶體中儲存該等第一像素，並且用以根據該等第一讀取時序而讀取該線記憶體中所儲存之該等第一像素，以及其中，該第二縮放器受阻配為可控制該線記憶體控制器，以在該線記憶體中儲存該等第二像素，並且根據該等第二讀取時序而讀取該線記憶體中所儲存之該等第二像素。
- 如請求項14之應用處理器，其中該第一縮放器包括有一第一垂直縮放器，其受阻配為可垂直比例縮放從該線記憶體控制器傳送出之該等第一像素；以及一第一水平縮放器，其受阻配為可水平比例縮放從該第一垂直縮放器所輸出之像素以產生該第一影像，該第二縮放器包括有一第二垂直縮放器，其受阻配為可垂直比例縮放從該線記憶體控制器傳送出之該等第二像素；以及一第二水平縮放器，其受阻配為可水平比例縮放從該第二垂直縮放器所輸出之像素以產生該第二影像。
- 如請求項12之應用處理器，其更包含有一線記憶體控制器，其受阻配為可在該線記憶體中儲存該等像素中與該第一影像有關之第一像素，並根據該第一縮放器之一控制而讀取該線記憶體中所儲存的該等第一像素，而且在 該線記憶體中儲存該等像素中與該第二影像有關之第二像素，並根據該第二縮放器之一控制而讀取該線記憶體中儲存之該等第二像素。
- 一種行動運算裝置，其包含有：一影像感測器；一外部記憶體；以及一應用處理器，該應用處理器連接至該影像感測器及該外部記憶體，其中該應用處理器包括有一匯流排；以及一縮放器電路，該定標器電路連接至該匯流排，其中該縮放器電路包括有一第一縮放器，其受阻配為可在一第一垂直比例縮放操作後進行一第一水平比例縮放操作；一第二縮放器，其受阻配為可在一第二垂直比例縮放操作後進行一第二水平比例縮放操作；以及一線記憶體，該線記憶體可由該第一縮放器與該第二縮放器所共享，其中該第一縮放器及該第二縮放器中的每一者分別產生一第一影像及一第二影像，該第一影像及該第二影像分別具有不同於使用該線記憶體之一單一影像的解析度。
- 如請求項17之行動運算裝置，其更包含有一線記憶體控制器，其受阻配為可把該單一影像中所包括之像素中的 每一者上之位置資訊傳送至該第一縮放器及該第二縮放器的，該第一縮放器受阻配為可在使用該等像素中的每一者上之該位置資訊的該等像素中選擇出第一像素，該第一像素與待儲存於該線記憶體中之該第一影像有關，以及該第二縮放器受阻配為可在使用該等像素中的每一者上之該位置資訊的該等像素中選擇出第二像素，該第二像素與待儲存於該線記憶體中之該第二影像有關。
- 如請求項17之行動運算裝置，其更包含有一線記憶體控制器，該線記憶體控制器受阻配為可在該線記憶體中儲存該等像素中與該第一影像有關之第一像素，並根據該第一縮放器之一控制而讀取該線記憶體中所儲存之該等第一像素，而且在該線記憶體中儲存該等像素中與該第二影像有關之第二像素，並根據該第二縮放器之一控制而讀取該線記憶體中儲存之該等第二像素。
- 如請求項19之行動運算裝置，其中該第一縮放器包括有一第一垂直縮放器，其受阻配為可垂直比例縮放從該線記憶體控制器傳送出之該等第一像素；以及一第一水平縮放器，其器受阻配為可水平比例縮放輸出自該第一垂直縮放器之像素以產生該第一影像，其中該第二縮放器包括有一第二垂直縮放器，其受阻配為可垂直比例縮放從 該線記憶體控制器傳送出之該等第二像素；以及一第二水平縮放器，其受阻配為可水平比例縮放輸出自該第二垂直縮放器之像素以產生該第二影像。
- 一種縮放器電路，其包含有；一線記憶體，其受阻配為可儲存一單一影像；一第一縮放器，其受阻配為可從該線記憶體讀取該單一影像、及藉由在該單一影像上進行一第一水平比例縮放操作與一第一垂直比例縮放操作來產生一第一影像；以及一第二縮放器，其受阻配為可從該線記憶體讀取該單一影像、及藉由在該單一影像上進行一第二水平比例縮放操作與一第二垂直比例縮放操作來產生一第二影像。其中該第一影像及該第二影像具有不同於該單一影像的解析度。
- 如請求項21之縮放器電路，其更包含有一線記憶體控制器，其受阻配為可把該單一影像中所包括之像素上之位置資訊傳送至該第一縮放器及該第二縮放器。
- 如請求項22之縮放器電路，其中該第一縮放器受阻配為可在使用該位置資訊的該等像素中，選擇出待儲存於該線記憶體中之該第一影像的第一像素，以及其中該第二縮放器受阻配為可在使用該位置資訊的該等像素中，選擇出待儲存於該線記憶體中之該第二影像的第二像素。
- 如請求項23之縮放器電路，其中該第一縮放器受阻配為可判定出使用該位置資訊且儲存於該線記憶體中之該等第一像素的第一讀取時序，以及其中該第二縮放器受阻配為可判定出使用該位置資訊且儲存於該線記憶體中之該等第二像素的第二讀取時序。
- 如請求項24之縮放器電路，其中該第一縮放器受阻配為可控制該線記憶體控制器，用以在該線記憶體中儲存該等第一像素，並且用以根據該等第一讀取時序而讀取該線記憶體中所儲存之該等第一像素，以及其中該第二縮放器受阻配為可控制該線記憶體控制器，用以在該線記憶體中儲存該等第二像素，並且用以根據該等第二讀取時序而讀取該線記憶體中所儲存之該等第二像素。
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