TW201617630A - 檢測電路及半導體裝置 - Google Patents
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Abstract
提供一種即使因電源電壓的變動等,負載短
路檢測電路與負載開路檢測電路進行錯誤檢測,亦可防止輸出錯誤的檢測結果的具備有檢測電路之半導體裝置。
形成為以下構成:具備有:檢測負載的
短路的負載短路檢測電路;檢測負載的開路的負載開路檢測電路;及將負載短路檢測電路及負載開路檢測電路的輸出訊號輸出至輸出端子的邏輯電路,邏輯電路係當負載開路檢測電路及負載短路檢測電路的輸出為檢測邏輯時,對輸出端子輸出非檢測邏輯的訊號。
Description
本發明係關於檢測所被連接的負載的開路及短路的檢測電路及半導體裝置。
圖3係習知之具備有檢測電路之半導體裝置的電路圖。習知之具備有檢測電路之半導體裝置係具備有:被連接在電壓輸入端子T1與電壓輸出端子T2之間的MOS電晶體1、控制電路2、檢測被連接在電壓輸出端子T2的負載與接地端子的短路的負載短路檢測電路3、檢測負載的開路的負載開路檢測電路4、及將該等檢測電路的輸出訊號輸出至輸出端子T3的邏輯電路5。
習知之具備有檢測電路之半導體裝置係若負載短路檢測電路3檢測被連接在電壓輸出端子T2的負載與接地端子的短路,或若負載開路檢測電路4檢測負載的開路,邏輯電路5(OR電路)對輸出端子T3輸出該等檢測電路的輸出訊號。
〔專利文獻1〕日本特開平6-289087號公報
具備有檢測電路之半導體裝置係若輸出負載的短路或開路的檢測訊號,接收該訊號的電路係將電源電壓遮斷、或停止動作,來進行供安全用的處理。
但是,上述具備有檢測電路之半導體裝置係例如因電源電壓的變動等,而有負載短路檢測電路3與負載開路檢測電路4發生錯誤檢測的可能性,但是會有無關於是否為同時輸出檢測訊號的明顯錯誤檢測,邏輯電路5(OR電路)會輸出至輸出端子T3的課題。半導體裝置係若進行供安全用的處理,會有停止動作、或受到不會恢復成平常動作的損傷的情形。
本發明係為解決如以上所示之課題而研創者,提供不會有輸出錯誤的檢測結果的情形的具備有檢測電路之半導體裝置者。
為解決習知之課題,本發明之具備有檢測電路之半導體裝置係形成為如以下所示之構成。
形成為以下構成:具備有:檢測負載的短路的負載短路檢測電路;檢測負載的開路的負載開路檢測電路;及將
負載短路檢測電路及負載開路檢測電路的輸出訊號輸出至輸出端子的邏輯電路,邏輯電路係當負載開路檢測電路及負載短路檢測電路的輸出訊號為檢測邏輯時,對輸出端子輸出非檢測邏輯的訊號。
藉由本發明之具備有檢測電路之半導體裝置,即使因電源電壓的變動等,短路檢測電路與開路檢測電路進行錯誤檢測,亦可防止輸出錯誤的檢測結果。
1‧‧‧MOS電晶體
2‧‧‧控制電路
3‧‧‧負載短路檢測電路
4‧‧‧負載開路檢測電路
10、20‧‧‧邏輯電路
11、14‧‧‧OR電路
12、13‧‧‧反相器
15‧‧‧AND電路
20‧‧‧邏輯電路
21、22‧‧‧反相器
23、24‧‧‧AND電路
25‧‧‧OR電路
T1‧‧‧電壓輸入端子
T2‧‧‧電壓輸出端子
T3‧‧‧輸出端子
圖1係本實施形態之具備有檢測電路之半導體裝置的電路圖。
圖2係顯示本實施形態之具備有檢測電路之半導體裝置的其他例的電路圖。
圖3係習知之具備有檢測電路之半導體裝置的電路圖。
以下參照圖示,說明本實施形態。
圖1係本實施形態之具備有檢測電路之半導體裝置的電路圖。
本實施形態之具備有檢測電路之半導體裝置係具備
有:電壓輸入端子T1、電壓輸出端子T2、輸出端子T3、MOS電晶體1、控制電路2、負載短路檢測電路3、負載開路檢測電路4、及邏輯電路10。邏輯電路10係具備有:OR電路11、14、反相器12、13、及AND電路15。
檢測電路係檢測與電壓輸出端子T2相連接的負載脫落(負載開路)、或短路(負載短路),而對輸出端子T3輸出檢測訊號。
電壓輸入端子T1係被輸入電源電壓。電壓輸出端子T2係透過MOS電晶體1被輸出電壓輸入端子T1所輸入的電源電壓。控制電路2係控制MOS電晶體1,來控制電壓輸出端子T2的輸出電壓。負載短路檢測電路3係在檢測出異常時,輸出檢測訊號。負載開路檢測電路4係在檢測出異常時,輸出檢測訊號。邏輯電路10係將該等檢測訊號輸出至輸出端子T3。此外,邏輯電路10係將該等檢測訊號亦輸出至控制電路2。
MOS電晶體1係被連接在電壓輸入端子T1與電壓輸出端子T2之間。控制電路2係輸出端子被連接在MOS電晶體1的閘極。負載短路檢測電路3係輸入端子被連接在電壓輸出端子T2。負載開路檢測電路4係輸入端子被連接在電壓輸出端子T2。邏輯電路10係第一輸入端子被連接在負載短路檢測電路3的輸出端子,第二輸入端子被連接在負載開路檢測電路4的輸出端子,輸出端子被連接在輸出端子T3。OR電路11係輸入端子被連接在第一輸入端子及第二輸入端子。反相器12係輸入端子被
連接在第一輸入端子。反相器13係輸入端子被連接在第二輸入端子。OR電路14係輸入端子被連接在反相器12、13的輸出端子。AND電路15係輸入端子被連接在OR電路11、14的輸出端子,輸出端子被連接在輸出端子T3。
接著,說明本實施形態之檢測電路的動作。將負載短路檢測電路3與負載開路檢測電路4的檢測訊號形成為Hi位準來進行說明。
負載短路檢測電路3或負載開路檢測電路4的任一者檢測出異常時,OR電路11、14係由於任一者的輸入訊號為Hi,因此輸出訊號係成為檢測邏輯的Hi。因此,AND電路15係對輸出端子T3輸出檢測邏輯的Hi位準的訊號。
接著,說明因電源電壓的變動等,負載短路檢測電路3及負載開路檢測電路4進行錯誤檢測的情形。此時,負載短路檢測電路3及負載開路檢測電路4係同時輸出Hi位準的檢測訊號。第一輸入端子及第二輸入端子同時被輸入Hi位準時,OR電路11係輸出Hi位準的檢測訊號,但是OR電路14係任一者的輸入訊號亦為Lo,因此輸出Lo位準的非檢測訊號。因此,AND電路15係對輸出端子T3輸出非檢測邏輯的Lo位準的訊號。
如以上說明所示,本實施形態之具備有檢測電路的半導體裝置係即使因電源電壓的變動等,負載短路檢測電路與負載開路檢測電路進行錯誤檢測,亦可防止輸
出錯誤的檢測結果。
圖2係顯示本實施形態之具備有檢測電路之半導體裝置之其他例的電路圖。
圖2之具備有檢測電路之半導體裝置係具備有:電壓輸入端子T1、電壓輸出端子T2、輸出端子T3、MOS電晶體1、控制電路2、負載短路檢測電路3、負載開路檢測電路4、及邏輯電路20。邏輯電路20係具備有:反相器21、22、AND電路23、24、及OR電路25。
邏輯電路20係第一輸入端子被連接在負載短路檢測電路3的輸出端子,第二輸入端子被連接在負載開路檢測電路4的輸出端子,輸出端子被連接在輸出端子T3。反相器21係輸入端子被連接在第二輸入端子。反相器22係輸入端子被連接在第一輸入端子。AND電路23係輸入端子被連接在第一輸入端子及反相器21的輸出端子。AND電路24係輸入端子被連接在第二輸入端子及反相器22的輸出端子。OR電路25係輸入端子被連接在AND電路23、24的輸出端子,輸出端子係被連接在輸出端子T3。
若如上所示構成邏輯電路20,負載開路檢測電路4的輸出訊號處於檢測邏輯時,係將負載短路檢測電路3的輸出設為非檢測邏輯,負載短路檢測電路3的輸出訊號處於檢測邏輯時,則將負載開路檢測電路4的輸出設為非檢測邏輯。
因此,圖2的檢測電路係當負載開路檢測電
路及負載短路檢測電路的輸出為檢測邏輯時,由輸出端子T3輸出非檢測邏輯的訊號。亦即,可得與圖1的檢測電路相同的效果。
1‧‧‧MOS電晶體
2‧‧‧控制電路
3‧‧‧負載短路檢測電路
4‧‧‧負載開路檢測電路
10‧‧‧邏輯電路
11、14‧‧‧OR電路
12、13‧‧‧反相器
15‧‧‧AND電路
T1‧‧‧電壓輸入端子
T2‧‧‧電壓輸出端子
T3‧‧‧輸出端子
Claims (3)
- 一種檢測電路,其係檢測與電壓輸出端子相連接之負載的開路及短路的檢測電路,其特徵為:具備有:檢測前述負載的短路的負載短路檢測電路;檢測前述負載的開路的負載開路檢測電路;及將前述負載短路檢測電路及前述負載開路檢測電路的輸出訊號輸出至輸出端子的邏輯電路,前述邏輯電路係當前述負載開路檢測電路及前述負載短路檢測電路的輸出訊號為檢測邏輯時,由前述輸出端子輸出非檢測邏輯的訊號。
- 如申請專利範圍第1項之檢測電路,其中,當前述負載開路檢測電路的輸出訊號處於檢測邏輯時,將前述負載短路檢測電路的輸出訊號設為非檢測邏輯,當前述負載短路檢測電路的輸出訊號處於檢測邏輯時,則將前述負載開路檢測電路的輸出訊號設為非檢測邏輯。
- 一種半導體裝置,其係具備有如申請專利範圍第1項或第2項之檢測電路的半導體裝置。
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