SU648972A1 - Устройство дл сопр жени - Google Patents
Устройство дл сопр жениInfo
- Publication number
- SU648972A1 SU648972A1 SU762397613A SU2397613A SU648972A1 SU 648972 A1 SU648972 A1 SU 648972A1 SU 762397613 A SU762397613 A SU 762397613A SU 2397613 A SU2397613 A SU 2397613A SU 648972 A1 SU648972 A1 SU 648972A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- block
- input
- output
- signal
- elements
- Prior art date
Links
Landscapes
- Monitoring And Testing Of Exchanges (AREA)
Description
(54) УСТРОЙСТВО ДЛЯ СОПРЯЖЕНИЯ
Поставленна цель достигаетс тем,
что в устройство введены блок групповой синхронизации, три блока влементов ИЛИ и два блока элементов И, причем первый и второй входы блока групповой синхронизации подключены к соответствующим входам вызова устройства , а первый и второй выходы - к соответствукмцим выходам вызова устройства , третий выход блока групповой синхронизации соединен с третьим входом блока анализа состо ни и вторым блоком индикации неисправности, третий вход ко.торого подключен к выходу дешифратора команды, первому входу первого блока элементов ИЛИ, управл ющим входам первого и второго блоков элементов И и четвертому входу блока анализа состо ни , первым, вторым и третьим выходами соединенного соответственно со вторым, третьим и -четвертым входами первого блока элементов ИЛИ, выход первого блока элементов ИЛИ соединен со вторым управл51ющим входом первого блока элементов И, первый вход и выход третьего блока элементов И подключены соответственно к командным входу и выходу устройства, первый выход дешифратора группового обращени соединен с первым входом четвертого блока элементов И, четвертым входом блока индикации неисправности , вторым входом третьего блока элементов И и третьим входом блока групповой синхронизации, четвертый вход которого подключен к третьему входу третьего блока элементов И п тому входу блока анализа неисправностей , второму входу четвертого блока элементов И и выходу второго блока элементов ИЛИ, первый вход которого подключен.к первому выходу дешифратора адреса, а второй - ко второму выходу блока группового обращени и шестому входу блока индикации неисправности , сед1А«)Й вход блока индикации неисправности соединен с третьим выхо дом дешв4ч аторй группового обращени и первым входом третьего блока элементов ИЛИ, второй вход и выход которого подключены соответственно со вторым выходом дешифратора адреса в вьк ходом адреса функционального элемента устройства, третий вход и выход четвертого блока элементов И соединены соответственно с адресным входом устройства и адресом канала устройства , вход дешифратора группового рбращени подключен ко входу дешифратора адреса.
На фиг. 1 - представлена электрическа структурна схема устройства; на фиг. 2 - временные диаграммы обмена информацией с функциональными элементами дл приемника; на фиг. 3 - то же,лл источника; на фиг. 4 - схема подключени функциональных элементов к устройству.
Устройство дл сопр жени содержит дешифратор 1 адреса, дешифратор 2 группового обращени , блок 3 элементов И, блок 4 и 5 элементов ИЛИ, дешифратор 6 команды, блок 7 элементов И, блок 8 групповой синхронизации, блок 9 индикации неисправности, блок 10 анализа состо ни , блок 11 элементов ИЛИ, блоки 12 и 13 элементов И,
Устройство работает следующим образом . .
В начале цикла обмена на межблочно интерфейсе (МБИ) устанавливаютс адресные сигналы МА, программные сигналы МП, а при обращении к приемнику информации « также сигналы данных МИ. Адресные сигналы МА поступают на вход дешифратора 1, дешифратора 2 и блока 3. Дешифратор 1 осуществл ет распознавание индивидуального адреса и перекодировку представленного в двоичном коде адреса функционального элемента (ФЭ) в позиционный код. Дешкс ь. ратор 2 распознает групповой адрес функциональных блоков, групповой адрес функциональных элементов и распознает собственный адрес устройства сопр « жени . По этому адресу осуществл етс клапан кровен ие всех сигналов МБИ на внутриблочный интерфейс (ВБИ). По сигналам, полученным с выхода дешифраторов I и 2, в блоке 5 адрес блока а на выходе блока 4 формируетс адрес ВЭ, характеризующий обращение ко всем или выбранному ФЭ данного блока.
Claims (2)
- Блок 3 осуществл ет блокирование прохождени сигналов адреса каналов на ВБИ в случае наличи в устройстве сопр жени сигнала только на первом выходе дешифратора 2.. Через врем ТШ (см. фиг. 2 и 3), необходимое дл окончана в интерфейсной магистрали переходного процесса при опозваванви блоком, элементом и каналом прв своенного ему адреса н подготовки соответствующих цепей на интерфейсной магистрали межблочного интерфейса, вырабатываетс сигнал вызов I (МБ i) 5 Сигнал MB 1 поступает на блок 8 и в зависимости от состо ни стробирую щих сигналов на выходах дешифраторов 1 и 2 преобразуетс в сигнал ВВ1, ко торый выдаетс в магистраль ВБИ и разблокирует цепи известительных сигналов (Ю, ВС, ВН). Одновременно формируетс ВЦ, который испол зуетс как стробируюпшй при операци х , производимых внутри устройства. При обращении к какому-либо функциональному элементу (элементам) сигнал ВВ1 подготавливает цепи приема интерфейсного сигнала ВО блока 8 и при поступлении ВО формирует сигнал МО на интерфейсной магистрали МБИ. Функциональные элементы (фиг, 4, ФЭ1 - ФЭ ) могут иметь разное быстродействие (различное Tg , см. фиг. 2 и 3). Сигнал ВО во всех функциональных элементах выводитс на магистральную шину внутриблочного интерфейса. В результате при организации обмена с группой функциональных элементов по влени сигнала ВО на шине интерфейсной магистрали свидетельствует о том что наиболее быстродействующий из ад ресованных функциональных элементов закончил выполнение команды ВВ1. Считывание сигнала ВО с шины интерфейсной магистрали характеризует окон чание выполнени команды ВВ1 в последнем (самом медленном) из адресованных функциональных элементов. Блок 8 ретранслирует сигнал ВО в виде сигнала МО на интерфейсную магистраль МБИ. По сигналу МО формируетс ответный сигнал вызов 2 (МВ2), который поступает на вход бло ка 8 и при наличии соответствующих сигналов преобразуетс в сигнал ВВ2, выдаваемый в магистраль ВБИ. Программные сигналы МП поступаю на входы дешифратора 6 и блока 7. При этом в зависимости от программы осуществл етс занесение информации, ущзавление режимами, проверка состо ний , тестова операци во всех одновременно адресованных ФБ (ФЗ). Программные сигналы МП поступают на вход блока 7, где стробируютс сигналами с выхода дешифратора 2. С выхода блока 7 программные сигналы поступают на магистраль ВБИ. Сигнал запрос (ВЗ) поступает на блок 10, где ретранслируетс с шиныВ 72 ВБИ на шину МЗ магистрали МБИ. Наличие на интерфейсной магистрали МБИ сигнала ВЗ характеризует наличие требовани св зи в ФБ. Сигнал состо ни (ВС) ретранслируетс с шины ВС внутрибло.чного интерфейса на шину МС магистрали МБИ блоком 10. Разблокирование сигнала состо ни в блоке 10 осуществл етс сигналом ВЦ. При обращении непосредственно к устройству сопр жени формируетс соответствующий сигнал состо ни устройства, который выдаетс на шину МС. Поскольку устройство сопр жени всегда готово к обмену информацией , сигнал состо ни травслируетс на МБИ, При групповом обращении один из сигналов состо ни , сигнал запроса св зи, сигнал состо ни блока 10 в зависимости от программного сигнала поступает на блок 11 и с его выхода на одну из выбранных информационных щин межблочного интерфейса. По этой же шине через блок 11 передаетс сигнал тестовой операции от дешифратора 6. При обращении к ФЭ по внутриблоч- ному интерфейсу сигнал ошибка ретранслируетс с шин ВН на шину МН магистрали МБИ через блок 9 индикации неисправности. Информационные сигналы МИ (ВИ) принимаютс из магистрали МБИ (ВБИ) и через блоки 12 и 13 в зависимости от программных сигналов передаютс с одной интерфейсной магистрали на другую. Направление передачи определ етс программными сигналами. Таким образом, предложенное устройство позвол ет выполн ть групповое обращение к нескольким функциональным блокам и элементам одновременно, параллельный съем сигналов запросов св зи и сигналов состо ни нескольких функциональных элементов, последовательный анализ сигналов состо ни по программе , анализ проведени тестовых операций контрол одновременно несколькими функциональными блоками, благодар чему повышаетс быстродействие устройтва . Формула изобретеив Устройство дл сопр жени , содержащее дешифратор адреса, соединенный входом с адресным входом устройства, дешифратор группового обращени , дещифратар команды, подключенный входом к командному входу устро ;тва,выхоп сигвапа ошибки которого соедиВ8ев с выходом блока индюшции невспpaBH«X3TH , первый вход которого подключен к входу снгнапа ошибкн устройства , . два блока BneMeHTCiB И, первые ввформацновные входы первого в ато рого блоков елемевтов И соедшевы соответственно с первым и вторым информапвоввыми входамв устройства, ВфороЁ внформагшовный вход в выход первого блока алементов И соединены с х тввэд твенно с выходом и вторым внформаввонным входом второго блока влементов И, первый в второй выходы блока анелвэа состо нв подключены соответственно к выходам запроса и состо ни устройства, а первый и второй Ёхоаы - соответс-шевно к входам запроса н состо ни устройства, о т лвчающеес тем, что, с целью по&ышенв быстродействи устройства, в вего введевы блок групповой синхронвдаавв , три блока влементов ИЛИ и два блока влементов И, причем первый и второй входы блока групповой синхро ввзаавн воаключены к соответствующим входам Ёызоаа устройства, а первый и второй выкопы к соответствуюшвм выходам вызова устройства, третвй выход блока груткзвой сввЕхронизадии соедв вюв с третьем входом блока анализа состо в в вторым блоком индикации вевспра зоств, чретвй вход которого водвлючен к выходу дешифратора коман ды, первому входу первого блока элементов ИЛИ, управл ющим входам первого в Второго блоков влементов И и четвертому входу блока анализа состо ни первым, вторым и третьим выходами соедивенного соответственно со Bropы, третьем и четвертым (входами первого блока влементов ИЛИ, выход первого блока влементов ИЛИ соединенсо в-торым управл ющим входом первого блока 9лементов И, первый вход и выход третьего блока влементов И подключены соответственно к командным входу и выходу устройства, первый выход дешифратора группового обращени соединен с первым входом четвертого блока элементов И, четвертым входом блока индикации неисправности, вторым Входом третьего блока элементов И и третьим входом блока групповой синхро нвзации, четвертый вход которого подключен к третьему входу третьего блок влементов И, п тому входу блока анализа неисправностей, второму входу четвертого блока элементов И и выходу Второго блока элементов ИЛИ, первый вход которого подключен к первом выходу дешифратора адреса, а второйко второму выходу блока группового обращени и шестому входу блока индикации неисправности, седьмой вход блока индикации неисправности соединен с третьим выходом дешифратора группового обращени и первым входом третьего блока элементов ИЛИ, второй вход и выход которого подключены соответственно со вторым выходом дешифратора адреса и выходом адреса функционального впемента устройства, третий вход и выход четвертого блока элементов И соединены соответственно с адресным входом устройства и адресом канала устройства, вход дешифратора группового обращени подключен ко входу дешифратора адреса.Источники информации, прин тые во внимание прв експертизе1,Авторское свидетельство СССР № 443385, кл. Q 06 F 3/О4, 1971.
- 2.Авторское свидетельство СССР № 558274, кл. ( Об F 3/О4, 1974.нНН) ((ии иг.14 ,1г I§1 Iiл 5«оСц«о tQ Ч)С;5 OQJ§(JQ «О 41nffs i ff ff J/fga Kff ftffdfffsuiHfjg
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU762397613A SU648972A1 (ru) | 1976-08-23 | 1976-08-23 | Устройство дл сопр жени |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU762397613A SU648972A1 (ru) | 1976-08-23 | 1976-08-23 | Устройство дл сопр жени |
Publications (1)
Publication Number | Publication Date |
---|---|
SU648972A1 true SU648972A1 (ru) | 1979-02-25 |
Family
ID=20674585
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU762397613A SU648972A1 (ru) | 1976-08-23 | 1976-08-23 | Устройство дл сопр жени |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU648972A1 (ru) |
-
1976
- 1976-08-23 SU SU762397613A patent/SU648972A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR920007480B1 (ko) | 데이터전송시스템 | |
US4271465A (en) | Information handling unit provided with a self-control type bus utilization unit | |
US3953717A (en) | Test and diagnosis device | |
SU648972A1 (ru) | Устройство дл сопр жени | |
US3992696A (en) | Self-checking read and write circuit | |
US5657328A (en) | Scan design with expanded access capability | |
JPS61272668A (ja) | システムlsi | |
CN113934673B (zh) | 一种数据传输隔离电路及数据传输设备 | |
US7188010B2 (en) | Device and method for converting a diagnostic interface to SPI standard | |
DE2619661A1 (de) | Verfahren und anordnung zum aufeinanderfolgenden ausfuehren von datenverarbeitungsinstruktionen in funktionseinheiten eines rechners | |
US4031316A (en) | Apparatus for the time division multiplex transmission of binary signals | |
SU1318945A1 (ru) | Автоматизированна система контрол и диагностики неисправностей электронных цифровых блоков | |
JPS59121434A (ja) | 論理回路装置 | |
SU1236474A2 (ru) | Устройство управлени | |
SU1156083A1 (ru) | Устройство дл сопр жени | |
SU789990A1 (ru) | Устройство дл сопр жени | |
JPS583014A (ja) | チヤネル自動診断装置 | |
SU805296A1 (ru) | Устройство дл сопр жени двух вычислитель-НыХ МАшиН | |
SU1037235A1 (ru) | Адаптер канал-канал | |
KR890000982B1 (ko) | Pcm 방식 교환기의 통화로 고장 진단방법 | |
SU953626A1 (ru) | Устройство дл цифрового программного управлени объектом | |
SU669921A1 (ru) | Устройство дл диагностики каналов ввода-вывода | |
SU650080A1 (ru) | Устройство дл диагностики блоков электронных вычислительных машин | |
SU786067A1 (ru) | Устройство приемо-передачи сигналов управлени и взаимодействи | |
SU1166107A1 (ru) | Устройство управлени |