SU1545329A1 - Преобразователь кодовых форм - Google Patents
Преобразователь кодовых форм Download PDFInfo
- Publication number
- SU1545329A1 SU1545329A1 SU884450025A SU4450025A SU1545329A1 SU 1545329 A1 SU1545329 A1 SU 1545329A1 SU 884450025 A SU884450025 A SU 884450025A SU 4450025 A SU4450025 A SU 4450025A SU 1545329 A1 SU1545329 A1 SU 1545329A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- converter
- modulo
- output
- adder
- Prior art date
Links
Landscapes
- Error Detection And Correction (AREA)
Abstract
Изобретение относитс к атоматике и вычислительной технике и может быть использовано в гибких АСУ и ЭВМ дл проебразовани минимальной формы числа в оптимальную форму этого же числа. Изобретение позвол ет расширить область применени за счет преобразовани информации из минимальной формы в оптимальную форму T1 системы счислени . Преобразователь дл восьмиразр дного числа содержит элементы И 21 - 24, сумматоры 31 - 38 по модулю два, элементы ИЛИ 41 - 46, входы 11 - 17 преобразовател , выходы 51 - 57 преобразовател . При подаче на входы 11 - 17 кода минимальной формы число единиц в (S-1)-м, (S-6)-м разр дах этого кода посредством элементов И 2 и сумматоров 3 по модулю два преобразуетс в одну единицу, поступающую на соответствующие входы элементов ИЛИ 4, выходы которых св заны с выходами 51 - 57 преобразовател дл получени оптимальной формы числа. Комбинационный преобразователь кодовых форм может примен тьс в гибких вычислительных средствах с перестраиваемой информационной структурой. 1 ил., 1 табл.
Description
Изобретение относитс к автоматике и вычислительной технике и может быть использовано в гибких вычислительных машинах дл преобразовани информации из минимальной формы в оптимальную t, системы счислени .
Целью изобретени вл етс расширение области применени за счет преобразовани информации из минимальной формы в оптимальную форму t, системы счислени .
На чертеже представлена схема комбинационного преобразовател кодовых форм (дл п 8, п - разр дность ко- да).
Преобразователь содержит с первого по седьмой входы 1, - 17 соответственно , с первого по четвертый элементы И 2j - 2 соответственно, с первого по восьмой сумматоры З-i - 3j соответственно, с первого по шестой элементы ИЛИ 4t - 4t соответственно, с первого по седьмой выходы 5, - 57 соответственно.
Лобое натуральное число А в избыточной t, системе счислени представлено многочленно
5.1
),
где п - разр дность кода, y(s) - вес s-ro разр да кода, ц, (s) - V,(s-2) + v,(s-3)i V (0) V(D - I
Дл представлени натурального р да чисел в минимальной форме имеет место соотношение
1, при у,(з+2) 4 А - X akvk
v(s+2)/„
0, при if,(s+1) - A- jr a ,4iK( 1)
причем минимальна форма характеризуетс в общем случае наличием в п ти соседних разр дах не более одной единицы. Дл представлени натурального р да чисел в оптимальной форме имеет место соотношение
1 , при Ф,( Ks+1); О, при Ф,
п ,(s) Ј А - 2 а„ VK
кг
,(s) А - И akvk,(2)
L, «
KrS
где «I /s) - вес s-го разр да в оптимальной форме
Ф,(з) Ф, (в - 2) + ,(s -3) + 1,
причем в общем случае оптимальна форма характеризуетс наличием между соседними единицами не менее одного и не более двух нулей.
Использу таблицу, где X - входные кодовые комбинации, Y - выходные кодовые комбинации, дл п 8 строитс комбинационный преобразователь кодовых форм.
1
1
1
1
Дл задани минимальной формы используют условие (1), дл оптимальной формы - условие (2).
Вес разр дов чисел в оптимальной и минимальной формах одинаковый, кодовые комбинации различаютс наличием нулей между соседними единицами.
В данном случае используетс восемь разр дов дл представлени чисел от J 1 до 11, причем второй разр д как посто нно равный нулю на вход пре- рбразовател не подаетс .
15
Преобразователь работает следующим образом.
Работа преобразовател заключаетс в подаче на вход кодовой комбинации минимальной формы и получении кодовой комбинации оптимальной формы на 20 выходе.
Рассмотрим примеры преобразовани чисел 4, 11.
На вход преобразовател подаетс соответствующий сигнал: дл числа 4 - на вход 14, отвечающий кодовой комбинации в минимальной Лорме. Сигнал поступает на элементы ИЛИ 4.,, 4«, выходы которых вл ютс выходами преобразовател .
При этом выходы элементов ИЛИ 4,. 4 соответствуют дл получени кодовой комбинации в оптимальной форме. Произведено преобразование кодовых комбинаций.
Дл получени числа 8 чспочьзу- етс элемент И 24, так как кодова комбинаци (таблица) 1 О О О О О 1 О составлена из двух единичных сигналов,
30
35
комбинации числа 8, этот с.р д имеет нулевое значение, поэтому, ес ли там было единичное эг.аченме, ег необходимо исправить ча нулевое при помощи сумматора 3f) выход которого соединен с входом элемента ИЛИ 4. Сумматор 3, срабатывает при поступлении на его входы сигналов с выход элемента И 24 с входа 1t.
Дл получени 1 на элементе
ИЛИ 4Э необходимо поступление сигна с входа 14. В результате един ные сигналы на рыходах элементов ИЛИ 4, , 43 и 4«.
Число 11 в минимальной форме р лизуетс с помощью элемента И 2, входы которого соединены с входами 1 -, и 1 г преобразоватеп , Вькод элемента И 2г соединен с входами сумма 25 торов 3 г и 37 и выходом 5-, преобразовател , соответствующего весу раз р да 7 дл получени единичного
си.нала. Сумматор Зг обеспечивает нулевое значение в шементе ИЛИ 4-, что отвечает весу разр да 2, вход сумматора соединены с жодом 1 . пре образовател и внходом элемента И 2г. Сумматор 37 обеспечивает значение нул ь эчементе ЫИ 4Ь, который соответствует весу разр да 5. Сиггалы поступают на пходы сумматор 37 с выхоча элемента И 2t и нхода 1 преобразовател . С входа 17 сигм проходит на вход элемента ИЛИ 4 j,
поступающих с входов 1, и 1 преобра- 4Q что соответствует весу разр да 3,
а также на вход cvi матора 3t, выход его соединен с входом элемента ИЛИ 4, , обеспечивающий единичное зн чение на выходе элемента ИШ1 Д1 .
эовател .
Дл получени кодовой комГинации в оптимальной форме 10100100 необходимо, чтобы поступили единичные
сигналы на элементы ИЛИ 4.
и 4
б При срабатывании элемента И 2« с
выхода поступает сигнал на вход элемента ИЛИ 4t, входы сумматоров 3$ и 3.4. С входа 1, сигнал проходит через сумматор 3} и поступает на вход элемента ИЛИ
1
Вход элемента ИЛИ 4,
соединен с выходом сумматора 34, который срабатывает при поступлении сигналов на вход сумматора с входа 1t и выхода элемента И 24, что обеспечивает нулевой сигнал на входе элемента ИЛИ 4 ,.
Работа преобразовател построена так, что дл записи новой кодовой
комбинации предыдуща стираетс , :,о- мощью сумматоров по моцулч) .
Элемент ИЛИ 4f соответструе jecy
разр да
но при записи к довой
Q
5
комбинации числа 8, этот с.р д имеет нулевое значение, поэтому, если там было единичное эг.аченме, его необходимо исправить ча нулевое при помощи сумматора 3f) выход которого соединен с входом элемента ИЛИ 4. Сумматор 3, срабатывает при поступлении на его входы сигналов с выхода элемента И 24 с входа 1t.
Дл получени 1 на элементе
ИЛИ 4Э необходимо поступление сигнала с входа 14. В результате единичные сигналы на рыходах элементов ИЛИ 4, , 43 и 4«.
Число 11 в минимальной форме реализуетс с помощью элемента И 2, входы которого соединены с входами 1 -, и 1 г преобразоватеп , Вькод элемента И 2г соединен с входами сумма- 5 торов 3 г и 37 и выходом 5-, преобразовател , соответствующего весу разр да 7 дл получени единичного
си.нала. Сумматор Зг обеспечивает нулевое значение в шементе ИЛИ 4-, что отвечает весу разр да 2, входы сумматора соединены с жодом 1 . преобразовател и внходом элемента И 2г. Сумматор 37 обеспечивает значение нул ь эчементе ЫИ 4Ь, который соответствует весу разр да 5. Сиггалы поступают на пходы сумматора 37 с выхоча элемента И 2t и нхода 1 преобразовател . С входа 17 сигмал, проходит на вход элемента ИЛИ 4 j,
что соответствует весу разр да 3,
а также на вход cvi матора 3t, выход его соединен с входом элемента ИЛИ 4, , обеспечивающий единичное значение на выходе элемента ИШ1 Д1 .
Claims (1)
- Формула изобретениПреобразователь кодовых форм, содержащий с первого по четвертым i ie - менты И, первый и второй сумматоры по модулю два, с первого rio шестой элементы ИЛИ, причем выходы с первого по четвертый элементов ИЛИ вл ютс соответствуюшими выходами преобразовател , первый вход которого соединен с первым входом первого элемента И, второй вход преобратовател соединен с первым входом второго элемента И и с первым входом второмсумматора по модулю два, третий вход преобразовател соединен с первым входом первого элемента ИЛИ, первые входы третьего и четвертого элементов И соединены с первым входом преобразовател , выход первого элемента И соединен с первым входом второго элемента ИЛИ, четвертый вход преобразовател соединен с первым входом четвертого элемента ИЛИ, п тый вход преобразовател соединен с первым входом первого сумматора по модулю два, отличающийс тем, что, с целью расширени области при- менени за счет преобразовани информации из минимальной формы в оптимальную форму Ц системы счислени , он содержит с третьего по восьмой сумматоры по модулю два, причем первый вход преобразовател соединен с первым входом третьего сумматора по модулю два, третий вход преобразовател соединен с первым входом третьего элемента ИЛИ, четвертый вход преоб- разовател соединен с вторым входом первого элемента ИЛИ, п тый вход преобразовател соединен с вторым входом первого элемента И, шестой вход преобразовател соединен с вторым входом четвертого элемента И, первыми входами четвертого и п того сумматоров по модулю два и вторым входом третьего элемента ИЛИ, седьмой вход i преобразовател соединен с вторыми входами второго и третьего эпемен- тов И, первыми входами шестого и седьмого сумматоров по модулю два и вторым входом четвертого элементаИЛИ, выход первого элемента И соединен с вторым входом первого сумматора по модулю два, первым -ходом восьмого сумматора по модулю два и первым входом п того элемента ИЛИ, второй вход которого соединен с выходом п того сумматора по модулю два, второй вход которого соединен с вторым входом четвертого сумматора по модулю два, первым входом шестого элемента ИЛИ и выходом четвертого элемента И, выходы п того и шестого элементов ИЛИ и выход второго элемента И вл ютс соответственно п тым, шестым и седьмым выходами преобразовател , выход второго элемента И соединен с вторым входом второго сумматора по модулю два и вторым входом седьмого сумматора по модулю два, выход которого соединен с вторым входом шестого элемента ИЛИ, выход третьего элемента И соединен с вторыми входами третьего и шестого сумматоров по модулю два и вторым входом второго элемента ИЛИ, третий вход которого соединен с РЫХОДОМ второго сумматора по модулю два, выход третьего сумматора по модулю два соединен с вторым входом восьмого сумматора по модулю два, выход которого соединен с третьим входом первого элемента ИЛИ, четвертый и п тый входы которого соединены соответственно с выходами четвертого и шестого сумматоров по модулю два, пыход первого сумматора по модулю два соединен с четвертым входом второго и третьим входом четвертого олементов ИЛИ.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU884450025A SU1545329A1 (ru) | 1988-05-25 | 1988-05-25 | Преобразователь кодовых форм |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU884450025A SU1545329A1 (ru) | 1988-05-25 | 1988-05-25 | Преобразователь кодовых форм |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1545329A1 true SU1545329A1 (ru) | 1990-02-23 |
Family
ID=21385338
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU884450025A SU1545329A1 (ru) | 1988-05-25 | 1988-05-25 | Преобразователь кодовых форм |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1545329A1 (ru) |
-
1988
- 1988-05-25 SU SU884450025A patent/SU1545329A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР № 1092489, кл. Н 03 М 7/30, 1932. Авторское свидетельство СССР V 1427573, кл. Н ОТ М 7/30. 25.03.87. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
MY123934A (en) | Sample rate converter | |
CA2019821A1 (en) | Signal conversion circuit | |
JPS6247008B2 (ru) | ||
SU1545329A1 (ru) | Преобразователь кодовых форм | |
EP0297581A3 (en) | Pseudo-noise sequence generator | |
JPS5632851A (en) | Coding and decoding system for binary information | |
SU368598A1 (ru) | Преобразователь двоично-десятичного кода «12222» в унитарный код | |
SU1587638A1 (ru) | Кодирующее устройство | |
SU732852A1 (ru) | Преобразователь позиционного кода в код с большим основанием | |
JPS57104371A (en) | Profile code converter | |
SU1584107A2 (ru) | Преобразователь кодов | |
SU630627A1 (ru) | Преобразователь двоичных дес тиразр дных чисел в двоично-дес тичные | |
SU809150A1 (ru) | Преобразователь двоичного кодаВ дВОичНО-дЕС ТичНый | |
SU526884A1 (ru) | Преобразователь кодов | |
JPS57207457A (en) | Sc bit superimposing system | |
SU549801A1 (ru) | Устройство дл преобразовани двоично-дес тичного кода в двоичный | |
SU1559413A1 (ru) | Комбинационный преобразователь форм кода | |
JPS6332292B2 (ru) | ||
SU1488967A1 (ru) | Преобразователь кода | |
SU894699A1 (ru) | Преобразователь двоичного кода в двоично-дес тичный | |
SU1396139A1 (ru) | Суммирующее устройство | |
RU2012135C1 (ru) | Преобразователь кодов | |
SU1001078A1 (ru) | Преобразователь числоимпульсного кода в двоичный | |
SU1269271A1 (ru) | Преобразователь двоичного кода в код системы остаточных классов | |
SU842784A1 (ru) | Преобразователь двоичного кода вдВОичНО-дЕС ТичНый |