SU1288624A1 - Цифровой фазовый дискриминатор - Google Patents
Цифровой фазовый дискриминатор Download PDFInfo
- Publication number
- SU1288624A1 SU1288624A1 SU853919423A SU3919423A SU1288624A1 SU 1288624 A1 SU1288624 A1 SU 1288624A1 SU 853919423 A SU853919423 A SU 853919423A SU 3919423 A SU3919423 A SU 3919423A SU 1288624 A1 SU1288624 A1 SU 1288624A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- trigger
- counter
- inputs
- Prior art date
Links
Landscapes
- Measuring Frequencies, Analyzing Spectra (AREA)
Abstract
Изобретение относитс к радиотехнике . Цель изобретени - повьшеФиг .1 ние точности измерени . Дискримина- ;тор содержит формирователи 1 и 2, триггеры 3 и 4, элементы И 5, 6 и 7, счетчик 8, регистры 9 и 11, делитель 10 частоты, генератор 12, ограничители , дифференцирующую цепь, элемент ИЛИ и RS-триггеры. Введение сумматора 13 по модулю два, элемента И 14, порогового блока 16, счетчика 15 и конкретное выполнение порогового блока 16 повьшают достоверность обнаружени слабых прот женных сигнапов с практически любой наперед заданной веро тностью. 1 з.п. ф-лы, 2 ил. to 00 00 О5 ГчЭ
Description
25
Изобретение относитс к радиотех- нике, в частности к цифровым фазовым искриминаторам.
Цель изобретени - повышение точности измерени за счет повьпиени 5 остоверности обнаружени слабых игналов с определенным фазовым сдвигом- ,
На фиг. 1 приведена структурна электрическа схема цифрового фазо- О ого дискриминатора; на фиг. 2с1 - Ь- реализаци формирователей импульсов опорного и измер емого синусоидальных сигналов и порогового блока.
Цифровой фазовый дискриминатор содержит первый 1 и второй 2 формиователи , первый 3 и второй 4 триггеры , первый 5, второй 6 и третий 7 элементы И, счетчик 8, регистр 9, елитель 10 частоты, второй регистр 0 11, генератор 12, сумматор 13 по модулю два, четвертьш элемент И 14, второй счетчик 15, пороговый блок 16, первый ограничитель 17, дифференцирующую цепь 18, второй ограничитель 19, элемент ИЛИ 20, RS-тригге- ры 21 и 22 и элемент И 23.
Цри этом первый вход устройства через последовательно подключенные первый формирователь 1, первый RS- триггер 3, первый 5 и второй 6 элементы И соединён со сче тным входом счетчика 8, второй вход устройства через последовательно включенные второй формирователь 2, второй RS-триг- . 35 гер 4, третий элемент И 7, делитель 10 и первый регистр 9 соединен с R-входом счетчика 8, Вторые выходы формирователей 1 и 2 подключены к входу сумматора 13 по модулю два,вы- 40 од которого через четвертый элемент 14 соединен со счетным входом счетчика 15.Выход первого счетчика 8 через второй регистр 11 соединен с выходом устройства, а выход второ- 45 го счетчика 15 через пороговьш блок 16 соединен с вторьм выходом устройства , при этом первый выход вто- рого формировател 2 соединен с R-входом первого триггера 3, а К-вход 50 второго триггера соединен с первым вькодом делител 10 и вторым входом второго регистра 11.
Кроме того, второй выход делител 10 частоты соединен с R-входом второ- 55 го счетчика 15 и вторым входом порогового блока 16. Выход генератора 12 соединен с вторыми входами второго, третьего и четвертого элементов И, а
5
5
О
0
5 0 5 0
5
второй вход первого элемента И 5 соединен с инв€ ,рсным вьсходом второго триггера 4. Каждый из двух формирователей 1 и 2 содержит первьА ограничитель 17, выход которого подключен к входам дифференцирующей цепи 18 и вл етс вторым выходом каждого формировател , выход дифференцирующей цепи 18 через второй ограничитель 19 соединен с первым выходом формировател .
Первые входы порогового блока 16 через элемент ИЛИ 20 соединены с первыми входами триггеров 21 и 22, второй вход блока 16 соединен с вторыми входами первого триггера 21 и вторым входом элемента И 23, выход которого соединен с вторым входом второго триггера 22, выход которого вл етс выходом порогового блока 16, а выход первого триггера 21 соединен с первым входом элемента И 23.
Устройство работает следующим образом .
Синусоидальные сигналы с опорной и измер емой Ч фазами преобразуютс в формировател х 1 и 2 в импульсы той же частоты, соответствующие пересечению синусоидального сигнала нулевого уровн . Это производитс с помощью двух цепей, состо щих из последовательно соединенных первого ограничител 17, ди41ференцирующей цепочки 18 и второго ограничител 19. Цри этом на вторых выходах формирователей 1 и 2 формируютс сигналы типа меандр
и, sign|cos(27l f -ьЧ„ )1, Uj (2ri f +Ч Л ,
сдвинутые относительно друг друга пропорционально фазовому углу
V o - -Эти сигналы поступают на входы сумматора 13 по модулю два, на выходе которого формируетс сигнал, открывающий элемент И 14, на второй вход которого поступают счетные импульсы с выхода генератора 12. В результате на элемент И 14 проход т пачки импульсов, количество которых в пачке равно:
1с.
l - I J
fsK.
)М - т -
где N - - число счетных нмпуль- о сов за период опорной
частоты.
Эти импульсы поступают на счетньй вход счетчика 15, где накапливаютс за врем Т N2/f„, которое задаетс выходными импульсами делител 10 частоты , периодически обнул ющими разр ды счетчика 15. С выходами разр дов счетчика 15 соединены соответствующие входы порогового блока 16, который в момент достижени выходного числа заданного порога формирует выходной сигнал, соответствующий наличию во входной смеси регул рной составл ющей измер емого сигнала.При достижении в счетчике 15 числа,соответствующего заданному порогу ,
на выходе элемента ИЛИ 20 формируют
с импульсы, устанавливающие единич-
ные выходы триггеров 21 и 22 в еди- .ничное состо ние (захват сигнала), а нулевой выход триггера 21 - в нулевое состо ние. В результате импульсы опроса, поступающие на второй вход элемента И 23, не проход т на его выход. Сигнал захвата снимаетс только в том случае, когда на очередном интервале оценки Т N /f выходной сигнал не достигнет заданного порога, следовательно, на этом интервале не сформируетс очередной импульс, запирающий с помощью триггера 21 элемент И 23, в результате чего элемент И 23 останетс открытым и очередной импульс формирует на его выходе импульс, переключающий тригге 22 в нулевое состо ние.
Предлагаемое устройство позвол ет одновременно с оценкой рассогласо вани фазы измер емого сигнала относительно опорного с требуемой достоверностью оценить вл етс ли измер емый сигнал смесью сигнала и шума либо только узкополосным шумом.
Количественной мерой этой достоверности может служить степень уменьшени дисперсии распределени фазы смеси сигнала и шума и только шума, котора характеризуетс среднеквад- ратическим отклонением среднего значени числа в счетчике 15 в зависимости от числа Nj накапливаемьк выборок
,sA ,3 1/ 2
где б - среднеквадратичное отклонение выходного числа NJ
л
10
15
25
5 20
35
-
30
40
сумматора 13 относительно его среднего значени N /2, характеризующее отклонени фазы измер емого сигнала относительно опорного. В силу закона больших чисел распределение суммы выборок нормальньос случайных величин с конечной дисперсией при сходитс по веро тности к нормальной величине, а при конечном N2 50 - асимпотически нормальной. При этом веро тность ложной тревоги с/, или пропуска сигнала В оцениваютс как
oL i-F( ПРР .n) i-F( )
((JJ-g.- P-) i-F( ) ,
где F(x) - табулированные значени интеграла веро тностей. Поскольку разность (N - -N) и (N, - Nnop) увеличиваетс пропорционально N, а , и 6. пропорциональ1f о
но 5 то с увеличением N относительна дисперси распределений U
f
и Wj уменьшаетс пропорционально
.
I - «
Таким образом, предлагаемое устройство за счет выбора соответственного интервала накоплени позвол ет обнаружить достаточно слабый , но прот женный сигнал с практически любой наперед заданной веро тностью .
Claims (2)
1. Цифровой фазовый дискриминатор, содержащий два формировател , входы которых вл ютс входами устройства, два триггера, два регистра, три элемента И, генератор, делитель частоты и счетчик, при этом первый выход первого формировател соединен с S-входом первого триггера, R-вход которого соединен с первым выходом второго формировател и S-входом второго триггера, инверсный выход которого соединен с первым входом -первого элемента И, второй вход которого соединен с пр мым выходом первого триггера, а выход первого элемента И соединен с первым входом второго элемента И, выход которого соединен со счетный входом счетчика, первый вход трУетьего элемента Н соединен с пр мым выходом второго триггера, а
вторые входы второго и третьего элементов И соединены с генератором, выход третьего элемента И соединен с генератором, выход третьего элемента И через последовательно соединенные делитель частоты и первый регистр , соединен с R-входом счетчика, информационные выходы которого соединены с входом второго регистра, второй вход которого соединен с R-входом второго триггера и первым выходом де- .лител частоты, а выход вл етс первым выходом дискриминатора, отличающийс тем, что, с целью
увеличени точности, в него введены сумматор по модулю два, дополнительный элемент И, счетчик и пороговый блок, при этом вторые выходы первого и второго формирователей соответственно соединены с входами сумматора по модулю два,выход которого через введенный элемент И ; соединен со счетным входом введенного счетчика, информационные выходы
7
-1
rr -if78 - fJi
Редактор А. Шандор
Составитель В. Шубин Техред М. Ходанич.
Заказ 7804/44Тираж 752Подписное
ВНИИПИ Государственного комитета СССР
по делам изобретений и открытий 113035, Москва, Ж-35, Раушска наб.,д. 4/5
Производственно-полиграфическое предпри тие, г. Ужгород, ул. Проектна , 4
которого соединены с входом порогог вого блока, R-входы порогового блока и введенного счетчика объединены и соединены с вторым выход ом делител частоты, второй выход введенного элемента И соединен с генератором, а выход порогового блока вл етс вторым выходом устройства.
2. Дискриминатор по п., отличающийс тем, что пороговый блок выполнен в виде последовательно соединенных элемента ИЛИ, входы которого вл ютс входами порогового блока, первого триггера , элемента И и второго триггера, S-вход которого соединен с тем же входом первого триггера и вькодом элемента ИЛИ, инверсный выход первого триггера соединен через элемент И с R-входом второго триггера, выход которого вл етс выходом порогового блока, а второй вход элемента И и R-вход первого триггера объединены и вл ютс вторым входом порогового блока.
1
Корректор С. Ыекмар
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU853919423A SU1288624A1 (ru) | 1985-05-08 | 1985-05-08 | Цифровой фазовый дискриминатор |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU853919423A SU1288624A1 (ru) | 1985-05-08 | 1985-05-08 | Цифровой фазовый дискриминатор |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1288624A1 true SU1288624A1 (ru) | 1987-02-07 |
Family
ID=21185741
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU853919423A SU1288624A1 (ru) | 1985-05-08 | 1985-05-08 | Цифровой фазовый дискриминатор |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1288624A1 (ru) |
-
1985
- 1985-05-08 SU SU853919423A patent/SU1288624A1/ru active
Non-Patent Citations (1)
Title |
---|
. Патент JP № 55-16276, кл. G 01 R 25/00, 1975. Авторское свидетельство СССР № 349007, кл. G 01 R 25/00, 1972. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
CA1065417A (en) | Sampled signal detector | |
SU1288624A1 (ru) | Цифровой фазовый дискриминатор | |
US4107916A (en) | Electronic watch having an alarm means | |
SU1182483A1 (ru) | Цифровой измеритель длительности импульсов | |
SU1067610A2 (ru) | Детектор частотно-манипулированных сигналов | |
SU1142897A1 (ru) | Устройство измерени количества проскальзываний | |
SU1676076A1 (ru) | Устройство дл контрол серий импульсов | |
SU1465827A1 (ru) | Устройство дл измерени отношени сигнал/шум | |
SU1265642A1 (ru) | Устройство дл определени знака разности фаз | |
SU1566317A1 (ru) | Устройство дл фазовой коррекции последовательности временных сигналов | |
SU815862A1 (ru) | Частотный дискриминатор | |
SU660275A1 (ru) | Устройство дл контрол состо ни каналов св зи | |
SU1042189A1 (ru) | Устройство дл приема сигналов с импульсной модул цией | |
SU1099288A1 (ru) | Устройство дл контрол периода колебани | |
SU1504807A1 (ru) | Устройство для измерения характеристик дискретного канала связи 2 | |
SU1672382A1 (ru) | Устройство дл измерени сдвига фаз | |
SU1177920A1 (ru) | Устройство дл измерени коэффициента ошибок в цифровых системах передачи | |
SU1354125A1 (ru) | Устройство распознавани частоты | |
SU1064445A1 (ru) | Устройство дл контрол серий импульсов | |
SU1221613A1 (ru) | Цифровой фазометр дл измерени мгновенного значени угла сдвига фаз | |
SU1531024A1 (ru) | Цифровой фазометр | |
SU560360A1 (ru) | Устройство дл демодул ции частотноманипулированных сигналов | |
SU1275321A1 (ru) | Устройство дл определени ортогональности двух электрических сигналов | |
SU1338028A2 (ru) | Устройство выделени одиночного @ -го импульса | |
SU1108439A1 (ru) | Устройство дл перемножени кодов |