RU2012148583A - Трансформация прерывистых спецификаторов команд в непрерывные спецификаторы команд - Google Patents

Трансформация прерывистых спецификаторов команд в непрерывные спецификаторы команд Download PDF

Info

Publication number
RU2012148583A
RU2012148583A RU2012148583/08A RU2012148583A RU2012148583A RU 2012148583 A RU2012148583 A RU 2012148583A RU 2012148583/08 A RU2012148583/08 A RU 2012148583/08A RU 2012148583 A RU2012148583 A RU 2012148583A RU 2012148583 A RU2012148583 A RU 2012148583A
Authority
RU
Russia
Prior art keywords
field
bits
command
continuous
register
Prior art date
Application number
RU2012148583/08A
Other languages
English (en)
Other versions
RU2568241C2 (ru
Inventor
Карл ГШВИНД Майкл
Original Assignee
Интернэшнл Бизнес Машинз Корпорейшн
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Интернэшнл Бизнес Машинз Корпорейшн filed Critical Интернэшнл Бизнес Машинз Корпорейшн
Publication of RU2012148583A publication Critical patent/RU2012148583A/ru
Application granted granted Critical
Publication of RU2568241C2 publication Critical patent/RU2568241C2/ru

Links

Classifications

    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/44—Arrangements for executing specific programs
    • G06F9/455—Emulation; Interpretation; Software simulation, e.g. virtualisation or emulation of application or operating system execution engines
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30181—Instruction operation extension or modification
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F8/00—Arrangements for software engineering
    • G06F8/40—Transformation of program code
    • G06F8/52—Binary to binary
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30003—Arrangements for executing specific machine instructions
    • G06F9/30007—Arrangements for executing specific machine instructions to perform operations on data operands
    • G06F9/30036—Instructions to perform operations on packed data, e.g. vector, tile or matrix operations
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30098—Register arrangements
    • G06F9/3012—Organisation of register space, e.g. banked or distributed register file
    • G06F9/30138—Extension of register space, e.g. register cache
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30145—Instruction analysis, e.g. decoding, instruction word fields
    • G06F9/3016—Decoding the operand specifier, e.g. specifier format
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/3017—Runtime instruction translation, e.g. macros
    • G06F9/30174—Runtime instruction translation, e.g. macros for non-native instruction set, e.g. Javabyte, legacy code
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/34—Addressing or accessing the instruction operand or the result ; Formation of operand address; Addressing modes
    • G06F9/342—Extension of operand address space
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00—Arrangements for program control, e.g. control units
    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/44—Arrangements for executing specific programs
    • G06F9/455—Emulation; Interpretation; Software simulation, e.g. virtualisation or emulation of application or operating system execution engines
    • G06F9/45504—Abstract machines for programme code execution, e.g. Java virtual machine [JVM], interpreters, emulators
    • G06F9/45516—Runtime code conversion or optimisation

Landscapes

  • Engineering & Computer Science (AREA)
  • Software Systems (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Mathematical Physics (AREA)
  • Executing Machine-Instructions (AREA)
  • Advance Control (AREA)

Abstract

1. Компьютерный программный продукт для трансформации спецификаторов команд вычислительной среды, компьютерный программный продукт содержит:считываемую компьютером запоминающую среду, считываемую обрабатывающим устройством и хранящую команды для выполнения обрабатывающим устройством для выполнения метода, содержащего:получение процессором из первой команды, определенной для первой архитектуры компьютера, прерывистого спецификатора, причем прерывистый спецификатор имеет первую часть и вторую часть, причем получение включает получение первой части из первого поля команды и второй части из второго поля команды, а первое поле отделено от второго поля;создание непрерывного спецификатора используя первую часть и вторую часть, причем создание использует одно или более правил, основанных на коде операции первой команды; ииспользование непрерывного спецификатора для указания ресурса для использования при выполнении второй команды, причем вторая команда определена для второй архитектуры компьютера, отличной от первой архитектуры компьютера и эмулирует функцию первой команды.2. Компьютерный программный продукт по п.1, в котором процессор включает эмулятор и в котором первая часть включает первые один или более бит, а вторая часть включает вторые один или более бит, и создание включает составление вторых одного или более бит с первыми одним или более битами с образованием непрерывного спецификатора, причем вторые один или более бит являются самыми старшими битами непрерывного спецификатора.3. Компьютерный программный продукт по п.2, в котором первое поле содержит положение операнда, связанного с ним, а в

Claims (20)

1. Компьютерный программный продукт для трансформации спецификаторов команд вычислительной среды, компьютерный программный продукт содержит:
считываемую компьютером запоминающую среду, считываемую обрабатывающим устройством и хранящую команды для выполнения обрабатывающим устройством для выполнения метода, содержащего:
получение процессором из первой команды, определенной для первой архитектуры компьютера, прерывистого спецификатора, причем прерывистый спецификатор имеет первую часть и вторую часть, причем получение включает получение первой части из первого поля команды и второй части из второго поля команды, а первое поле отделено от второго поля;
создание непрерывного спецификатора используя первую часть и вторую часть, причем создание использует одно или более правил, основанных на коде операции первой команды; и
использование непрерывного спецификатора для указания ресурса для использования при выполнении второй команды, причем вторая команда определена для второй архитектуры компьютера, отличной от первой архитектуры компьютера и эмулирует функцию первой команды.
2. Компьютерный программный продукт по п.1, в котором процессор включает эмулятор и в котором первая часть включает первые один или более бит, а вторая часть включает вторые один или более бит, и создание включает составление вторых одного или более бит с первыми одним или более битами с образованием непрерывного спецификатора, причем вторые один или более бит являются самыми старшими битами непрерывного спецификатора.
3. Компьютерный программный продукт по п.2, в котором первое поле содержит положение операнда, связанного с ним, а вторые один или более бит являются подмножеством множества бит второго поля, и в котором получение включает выбор вторых одного или более бит из множества бит второго поля на основе положения операнда первого поля.
4. Компьютерный программный продукт по п.3, в котором положение операнда первого поля является первым операндом и в котором вторые один или более бит выбираются из крайней левой ячейки второго поля.
5. Компьютерный программный продукт по п.1, в котором первое поле состоит из поля регистра, второе поле состоит из поля расширения, первая часть состоит из множества бит из поля регистра, вторая часть состоит из бита из поля расширения в ячейке команды, соответствующей полю регистра, а создание включает составление бита из поля расширения с битами из поля регистра для получения непрерывного спецификатора.
6. Компьютерный программный продукт по п.1, в котором использование непрерывного спецификатора для указания ресурса включает использование непрерывного спецификатора для указания на регистр, который будет использоваться второй командой.
7. Компьютерный программный продукт по п.6, в котором регистр, на который указывает непрерывный спецификатор, имеет то же значение, что и непрерывный спецификатор.
8. Компьютерный программный продукт по п.6, в котором регистр, на который указывает непрерывный спецификатор, имеет значение, отличающееся от непрерывного спецификатора.
9. Компьютерный программный продукт по п.1, в котором первая компьютерная архитектура включает набор команд, содержащий первые команды, имеющие поля регистров для доступа к подразделу пространства регистров первой компьютерной архитектуры, и имеющий вторые команды, имеющие прерывистые поля регистров для доступа к этому подразделу и остальным подразделам пространства регистров, а доступ первых команд к остальным подразделам исключен.
10. Компьютерный программный продукт по п.1, в котором первое поле состоит из поля регистра, второе поле состоит из поля расширения, первая часть состоит из множества бит из поля регистра, вторая часть состоит из бита из поля расширения в ячейке команды, соответствующей полю регистра, а создание включает составление бита из поля расширения с битами из поля регистра для получения непрерывного спецификатора, включающий также:
получение процессором, из первой команды, другого прерывистого спецификатора, причем другой прерывистый спецификатор имеет другую первую часть и другую вторую часть, причем получение включает получение другой первой части из другого первого поля команды и другой второй части из другого бита поля расширения, а другое первое поле отделено от первого поля и поля расширения;
создание другого непрерывного спецификатора используя другую первую часть и другой бит, причем создание использует одно или более правил, основанных на коде операции первой команды; и
использование другого непрерывного спецификатора для указания ресурса для использования при выполнении второй команды.
11. Компьютерная система для трансформации спецификаторов команд вычислительной среды, компьютерная система содержит:
память; и
процессор, сообщающийся с памятью, причем компьютерная система настроена для осуществления метода, причем указанный метод включает:
получение процессором из первой команды, определенной для первой архитектуры компьютера, прерывистого спецификатора, причем прерывистый спецификатор имеет первую часть и вторую часть, указанное получение включает получение первой части из первого поля команды и второй части из второго поля команды, а первое поле отделено от второго поля;
создание непрерывного спецификатора используя первую часть и вторую часть, причем создание использует одно или более правил, основанных на коде операции первой команды; и
использование непрерывного спецификатора для указания ресурса для использования при выполнении второй команды, причем вторая команда определена для второй архитектуры компьютера, отличной от первой архитектуры компьютера и эмулирует функцию первой команды.
12. Компьютерная система по п.11, в которой процессор включает эмулятор и в которой первая часть включает первые один или более бит, а вторая часть включает вторые один или более бит, и создание включает составление вторых одного или более бит с первыми одним или более битами с образованием непрерывного спецификатора, причем вторые один или более бит являются самыми старшими битами непрерывного спецификатора.
13. Компьютерная система по п.12, в которой первое поле содержит положение операнда, связанного с ним, а вторые один или более бит являются подмножеством множества бит второго поля, и в которой получение включает выбор вторых одного или более бит из множества бит второго поля на основе положения операнда первого поля.
14. Компьютерная система по п.13, в которой положение операнда первого поля является первым операндом и в которой вторые один или более бит выбираются из крайней левой ячейки второго поля.
15. Компьютерная система по п.11, в которой первое поле содержит поле регистра, второе поле содержит поле расширения, первая часть содержит множество бит из поля регистра, вторая часть содержит бит из поля расширения в ячейке, соответствующей полю регистра, а создание включает составление бита из поля расширения с битами из поля регистра для получения непрерывного спецификатора.
16. Компьютерная система по п.11, в которой использование непрерывного спецификатора для указания ресурса включает использование непрерывного спецификатора для указания на регистр, который будет использоваться второй командой.
17. Компьютерная система по п.16, в которой регистр, на который указывает непрерывный спецификатор, имеет либо то же значение, что и непрерывный спецификатор, либо значение, отличное от непрерывного спецификатора.
18. Метод трансформирования спецификаторов команд вычислительной среды, метод содержит:
получение процессором из первой команды, определенной для первой архитектуры компьютера, прерывистого спецификатора, причем прерывистый спецификатор имеет первую часть и вторую часть, причем указанное получение включает получение первой части из первого поля команды и второй части из второго поля команды, а первое поле отделено от второго поля;
создание непрерывного спецификатора с помощью первой части и второй части, причем создание использует одно или более правил, основанных на коде операции первой команды; и
использование непрерывного спецификатора для указания ресурса для использования при выполнении второй команды, причем вторая команда определена для второй архитектуры компьютера, отличной от первой архитектуры компьютера и эмулирует функцию первой команды.
19. Метод по п.18, в котором процессор включает эмулятор и в котором первая часть включает первые один или более бит, а вторая часть включает вторые один или более бит, и создание включает составление вторых одного или более бит с первыми одним или более битами с образованием непрерывного спецификатора, где вторые один или более бит являются самыми старшими битами непрерывного спецификатора.
20. Метод по п.18, в котором первое поле содержит поле регистра, второе поле содержит поле расширения, причем первая часть содержит множество бит из поля регистра, вторая часть содержит бит из поля расширения в ячейке, соответствующей полю регистра, а создание включает составление бита из поля расширения с битами из поля регистра для получения непрерывного спецификатора.
RU2012148583/08A 2012-03-15 2012-11-15 Трансформация прерывистых спецификаторов команд в непрерывные спецификаторы команд RU2568241C2 (ru)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US13/421,657 2012-03-15
US13/421,657 US9280347B2 (en) 2012-03-15 2012-03-15 Transforming non-contiguous instruction specifiers to contiguous instruction specifiers

Publications (2)

Publication Number Publication Date
RU2012148583A true RU2012148583A (ru) 2014-05-20
RU2568241C2 RU2568241C2 (ru) 2015-11-10

Family

ID=49158813

Family Applications (1)

Application Number Title Priority Date Filing Date
RU2012148583/08A RU2568241C2 (ru) 2012-03-15 2012-11-15 Трансформация прерывистых спецификаторов команд в непрерывные спецификаторы команд

Country Status (24)

Country Link
US (2) US9280347B2 (ru)
EP (1) EP2769301B1 (ru)
JP (1) JP6108362B2 (ru)
KR (1) KR101643065B1 (ru)
CN (1) CN104169877B (ru)
AU (1) AU2012373735B2 (ru)
BR (1) BR112014022638B1 (ru)
CA (1) CA2867115C (ru)
DK (1) DK2769301T3 (ru)
ES (1) ES2779033T3 (ru)
HK (1) HK1201354A1 (ru)
HR (1) HRP20200393T1 (ru)
HU (1) HUE048409T2 (ru)
IL (1) IL232817A (ru)
LT (1) LT2769301T (ru)
MX (1) MX340050B (ru)
PL (1) PL2769301T3 (ru)
PT (1) PT2769301T (ru)
RU (1) RU2568241C2 (ru)
SG (1) SG11201404825SA (ru)
SI (1) SI2769301T1 (ru)
TW (1) TWI533207B (ru)
WO (1) WO2013136144A1 (ru)
ZA (1) ZA201406612B (ru)

Families Citing this family (46)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2012103359A2 (en) 2011-01-27 2012-08-02 Soft Machines, Inc. Hardware acceleration components for translating guest instructions to native instructions
CN103620547B (zh) 2011-01-27 2018-07-10 英特尔公司 使用处理器的转换后备缓冲器的基于客户指令到本机指令范围的映射
WO2012103245A2 (en) 2011-01-27 2012-08-02 Soft Machines Inc. Guest instruction block with near branching and far branching sequence construction to native instruction block
WO2012103367A2 (en) 2011-01-27 2012-08-02 Soft Machines, Inc. Guest to native block address mappings and management of native code storage
WO2012103253A2 (en) 2011-01-27 2012-08-02 Soft Machines, Inc. Multilevel conversion table cache for translating guest instructions to native instructions
WO2012103373A2 (en) 2011-01-27 2012-08-02 Soft Machines, Inc. Variable caching structure for managing physical storage
US9710266B2 (en) 2012-03-15 2017-07-18 International Business Machines Corporation Instruction to compute the distance to a specified memory boundary
US9459864B2 (en) 2012-03-15 2016-10-04 International Business Machines Corporation Vector string range compare
US9715383B2 (en) 2012-03-15 2017-07-25 International Business Machines Corporation Vector find element equal instruction
US9268566B2 (en) 2012-03-15 2016-02-23 International Business Machines Corporation Character data match determination by loading registers at most up to memory block boundary and comparing
US9454366B2 (en) 2012-03-15 2016-09-27 International Business Machines Corporation Copying character data having a termination character from one memory location to another
US9280347B2 (en) 2012-03-15 2016-03-08 International Business Machines Corporation Transforming non-contiguous instruction specifiers to contiguous instruction specifiers
US9459868B2 (en) 2012-03-15 2016-10-04 International Business Machines Corporation Instruction to load data up to a dynamically determined memory boundary
US9454367B2 (en) 2012-03-15 2016-09-27 International Business Machines Corporation Finding the length of a set of character data having a termination character
US9588762B2 (en) 2012-03-15 2017-03-07 International Business Machines Corporation Vector find element not equal instruction
US9459867B2 (en) 2012-03-15 2016-10-04 International Business Machines Corporation Instruction to load data up to a specified memory boundary indicated by the instruction
JP6218833B2 (ja) * 2012-08-20 2017-10-25 キャメロン，ドナルド，ケヴィン 処理リソース割り当て
US9513906B2 (en) 2013-01-23 2016-12-06 International Business Machines Corporation Vector checksum instruction
US9471308B2 (en) 2013-01-23 2016-10-18 International Business Machines Corporation Vector floating point test data class immediate instruction
US9804840B2 (en) 2013-01-23 2017-10-31 International Business Machines Corporation Vector Galois Field Multiply Sum and Accumulate instruction
US9823924B2 (en) 2013-01-23 2017-11-21 International Business Machines Corporation Vector element rotate and insert under mask instruction
US9715385B2 (en) 2013-01-23 2017-07-25 International Business Machines Corporation Vector exception code
WO2014151691A1 (en) 2013-03-15 2014-09-25 Soft Machines, Inc. Method and apparatus for guest return address stack emulation supporting speculation
WO2014151652A1 (en) 2013-03-15 2014-09-25 Soft Machines Inc Method and apparatus to allow early dependency resolution and data forwarding in a microprocessor
US9703562B2 (en) 2013-03-16 2017-07-11 Intel Corporation Instruction emulation processors, methods, and systems
US20140281398A1 (en) * 2013-03-16 2014-09-18 William C. Rash Instruction emulation processors, methods, and systems
US10120681B2 (en) 2014-03-14 2018-11-06 International Business Machines Corporation Compare and delay instructions
US9558032B2 (en) 2014-03-14 2017-01-31 International Business Machines Corporation Conditional instruction end operation
US9454370B2 (en) 2014-03-14 2016-09-27 International Business Machines Corporation Conditional transaction end instruction
US11281481B2 (en) 2014-07-25 2022-03-22 Intel Corporation Using a plurality of conversion tables to implement an instruction set agnostic runtime architecture
US10353680B2 (en) 2014-07-25 2019-07-16 Intel Corporation System converter that implements a run ahead run time guest instruction conversion/decoding process and a prefetching process where guest code is pre-fetched from the target of guest branches in an instruction sequence
CN106716363B (zh) * 2014-07-25 2021-04-09 英特尔公司 使用转换后备缓冲器来实现指令集不可知的运行时架构
US9792098B2 (en) * 2015-03-25 2017-10-17 International Business Machines Corporation Unaligned instruction relocation
US20170022314A1 (en) 2015-07-24 2017-01-26 Weyerhaeuser Nr Company Grafted crosslinked cellulose
US10055208B2 (en) * 2015-08-09 2018-08-21 Oracle International Corporation Extending a virtual machine instruction set architecture
US10235170B2 (en) * 2016-09-30 2019-03-19 International Business Machines Corporation Decimal load immediate instruction
CN110851345B (zh) * 2019-09-23 2023-04-14 上海辛格林纳新时达电机有限公司 一种系统参数的调用方法及调用装置
US11263131B2 (en) * 2020-04-08 2022-03-01 Alibaba Group Holding Limited System and method for allocating memory space
US11914997B2 (en) 2020-12-29 2024-02-27 Shanghai Zhaoxin Semiconductor Co., Ltd. Method and system for executing new instructions
US11803387B2 (en) 2020-12-29 2023-10-31 Shanghai Zhaoxin Semiconductor Co., Ltd. System for executing new instructions and method for executing new instructions
US11604643B2 (en) 2020-12-29 2023-03-14 Shanghai Zhaoxin Semiconductor Co., Ltd. System for executing new instructions and method for executing new instructions
US11669328B2 (en) 2020-12-29 2023-06-06 Shanghai Zhaoxin Semiconductor Co., Ltd. Method and system for converting instructions
US11789736B2 (en) 2020-12-29 2023-10-17 Shanghai Zhaoxin Semiconductor Co., Ltd. Method and system for executing new instructions
US11803381B2 (en) * 2020-12-29 2023-10-31 Shanghai Zhaoxin Semiconductor Co., Ltd. Instruction simulation device and method thereof
US11803383B2 (en) 2020-12-29 2023-10-31 Shanghai Zhaoxin Semiconductor Co., Ltd. Method and system for executing new instructions
US11625247B2 (en) 2020-12-29 2023-04-11 Shanghai Zhaoxin Semiconductor Co., Ltd. System for executing new instructions and method for executing new instructions

Family Cites Families (92)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62276668A (ja) 1985-07-31 1987-12-01 Nec Corp ベクトルマスク演算制御ユニツト
US5073864A (en) 1987-02-10 1991-12-17 Davin Computer Corporation Parallel string processor and method for a minicomputer
US5222225A (en) 1988-10-07 1993-06-22 International Business Machines Corporation Apparatus for processing character string moves in a data processing system
JPH0831032B2 (ja) 1990-08-29 1996-03-27 三菱電機株式会社 データ処理装置
US5465374A (en) 1993-01-12 1995-11-07 International Business Machines Corporation Processor for processing data string by byte-by-byte
WO1994027215A1 (en) 1993-05-07 1994-11-24 Apple Computer, Inc. Method for decoding guest instructions for a host computer
CA2162115A1 (en) 1993-06-14 1994-12-22 David V. James Method and apparatus for finding a termination character within a variable-length character string on a processor
JPH0721034A (ja) 1993-06-28 1995-01-24 Fujitsu Ltd 文字列複写処理方法
US5509129A (en) 1993-11-30 1996-04-16 Guttag; Karl M. Long instruction word controlling plural independent processor operations
US6185629B1 (en) 1994-03-08 2001-02-06 Texas Instruments Incorporated Data transfer controller employing differing memory interface protocols dependent upon external input at predetermined time
US5551013A (en) 1994-06-03 1996-08-27 International Business Machines Corporation Multiprocessor for hardware emulation
KR100206669B1 (ko) 1994-09-27 1999-07-01 야마오카 요지로 아연계 도금강판 및 그 제조방법
US5790825A (en) 1995-11-08 1998-08-04 Apple Computer, Inc. Method for emulating guest instructions on a host computer through dynamic recompilation of host instructions
US5812147A (en) 1996-09-20 1998-09-22 Silicon Graphics, Inc. Instruction methods for performing data formatting while moving data between memory and a vector register file
US5931940A (en) 1997-01-23 1999-08-03 Unisys Corporation Testing and string instructions for data stored on memory byte boundaries in a word oriented machine
DE69804495T2 (de) 1997-11-24 2002-10-31 British Telecomm Informationsmanagement und wiedergewinnung von schlüsselbegriffen
US6009261A (en) 1997-12-16 1999-12-28 International Business Machines Corporation Preprocessing of stored target routines for emulating incompatible instructions on a target processor
US6041402A (en) * 1998-01-05 2000-03-21 Trw Inc. Direct vectored legacy instruction set emulation
US6094695A (en) 1998-03-11 2000-07-25 Texas Instruments Incorporated Storage buffer that dynamically adjusts boundary between two storage areas when one area is full and the other has an empty data register
US6334176B1 (en) 1998-04-17 2001-12-25 Motorola, Inc. Method and apparatus for generating an alignment control vector
US6308255B1 (en) 1998-05-26 2001-10-23 Advanced Micro Devices, Inc. Symmetrical multiprocessing bus and chipset used for coprocessor support allowing non-native code to run in a system
US7100026B2 (en) 2001-05-30 2006-08-29 The Massachusetts Institute Of Technology System and method for performing efficient conditional vector operations for data parallel architectures involving both input and conditional vector values
US6463582B1 (en) 1998-10-21 2002-10-08 Fujitsu Limited Dynamic optimizing object code translator for architecture emulation and dynamic optimizing object code translation method
CN1134734C (zh) 1998-11-27 2004-01-14 松下电器产业株式会社 地址生成装置以及运动矢量检测装置
US6192466B1 (en) 1999-01-21 2001-02-20 International Business Machines Corporation Pipeline control for high-frequency pipelined designs
US8127121B2 (en) 1999-01-28 2012-02-28 Ati Technologies Ulc Apparatus for executing programs for a first computer architechture on a computer of a second architechture
US6189088B1 (en) 1999-02-03 2001-02-13 International Business Machines Corporation Forwarding stored dara fetched for out-of-order load/read operation to over-taken operation read-accessing same memory location
US6499116B1 (en) 1999-03-31 2002-12-24 International Business Machines Corp. Performance of data stream touch events
US6802056B1 (en) 1999-06-30 2004-10-05 Microsoft Corporation Translation and transformation of heterogeneous programs
US6381691B1 (en) 1999-08-13 2002-04-30 International Business Machines Corporation Method and apparatus for reordering memory operations along multiple execution paths in a processor
US6513109B1 (en) 1999-08-31 2003-01-28 International Business Machines Corporation Method and apparatus for implementing execution predicates in a computer processing system
US6449706B1 (en) 1999-12-22 2002-09-10 Intel Corporation Method and apparatus for accessing unaligned data
JP2001236249A (ja) 2000-02-24 2001-08-31 Nec Corp メモリ管理装置およびメモリ管理方法
US6625724B1 (en) 2000-03-28 2003-09-23 Intel Corporation Method and apparatus to support an expanded register set
US6349361B1 (en) 2000-03-31 2002-02-19 International Business Machines Corporation Methods and apparatus for reordering and renaming memory references in a multiprocessor computer system
US6701424B1 (en) 2000-04-07 2004-03-02 Nintendo Co., Ltd. Method and apparatus for efficient loading and storing of vectors
US6408383B1 (en) 2000-05-04 2002-06-18 Sun Microsystems, Inc. Array access boundary check by executing BNDCHK instruction with comparison specifiers
DE60132633T2 (de) 2000-10-18 2009-01-15 Koninklijke Philips Electronics N.V. Digitale signalprozessorvorrichtung
US7487330B2 (en) 2001-05-02 2009-02-03 International Business Machines Corporations Method and apparatus for transferring control in a computer system with dynamic compilation capability
JP3900863B2 (ja) 2001-06-28 2007-04-04 シャープ株式会社 データ転送制御装置、半導体記憶装置および情報機器
US6839828B2 (en) 2001-08-14 2005-01-04 International Business Machines Corporation SIMD datapath coupled to scalar/vector/address/conditional data register file with selective subpath scalar processing mode
US6907443B2 (en) 2001-09-19 2005-06-14 Broadcom Corporation Magnitude comparator
US6570511B1 (en) 2001-10-15 2003-05-27 Unisys Corporation Data compression method and apparatus implemented with limited length character tables and compact string code utilization
US20100274988A1 (en) 2002-02-04 2010-10-28 Mimar Tibet Flexible vector modes of operation for SIMD processor
US7089371B2 (en) 2002-02-12 2006-08-08 Ip-First, Llc Microprocessor apparatus and method for prefetch, allocation, and initialization of a block of cache lines from memory
US7441104B2 (en) 2002-03-30 2008-10-21 Hewlett-Packard Development Company, L.P. Parallel subword instructions with distributed results
US7373483B2 (en) * 2002-04-02 2008-05-13 Ip-First, Llc Mechanism for extending the number of registers in a microprocessor
US7376812B1 (en) 2002-05-13 2008-05-20 Tensilica, Inc. Vector co-processor for configurable and extensible processor architecture
US20040049657A1 (en) * 2002-09-10 2004-03-11 Kling Ralph M. Extended register space apparatus and methods for processors
US6918010B1 (en) 2002-10-16 2005-07-12 Silicon Graphics, Inc. Method and system for prefetching data
US7103754B2 (en) 2003-03-28 2006-09-05 International Business Machines Corporation Computer instructions for having extended signed displacement fields for finding instruction operands
US20040215924A1 (en) 2003-04-28 2004-10-28 Collard Jean-Francois C. Analyzing stored data
US7035986B2 (en) 2003-05-12 2006-04-25 International Business Machines Corporation System and method for simultaneous access of the same line in cache storage
US20040250027A1 (en) 2003-06-04 2004-12-09 Heflinger Kenneth A. Method and system for comparing multiple bytes of data to stored string segments
US7610466B2 (en) 2003-09-05 2009-10-27 Freescale Semiconductor, Inc. Data processing system using independent memory and register operand size specifiers and method thereof
US7904905B2 (en) 2003-11-14 2011-03-08 Stmicroelectronics, Inc. System and method for efficiently executing single program multiple data (SPMD) programs
GB2411973B (en) 2003-12-09 2006-09-27 Advanced Risc Mach Ltd Constant generation in SMD processing
US20060095713A1 (en) 2004-11-03 2006-05-04 Stexar Corporation Clip-and-pack instruction for processor
US7421566B2 (en) 2005-08-12 2008-09-02 International Business Machines Corporation Implementing instruction set architectures with non-contiguous register file specifiers
US9436468B2 (en) 2005-11-22 2016-09-06 Intel Corporation Technique for setting a vector mask
US8010953B2 (en) 2006-04-04 2011-08-30 International Business Machines Corporation Method for compiling scalar code for a single instruction multiple data (SIMD) execution engine
US7565514B2 (en) 2006-04-28 2009-07-21 Freescale Semiconductor, Inc. Parallel condition code generation for SIMD operations
CN101097488B (zh) 2006-06-30 2011-05-04 2012244安大略公司 从接收的文本中学习字符片段的方法及相关手持电子设备
US9069547B2 (en) 2006-09-22 2015-06-30 Intel Corporation Instruction and logic for processing text strings
US7536532B2 (en) 2006-09-27 2009-05-19 International Business Machines Corporation Merge operations of data arrays based on SIMD instructions
US7991987B2 (en) 2007-05-10 2011-08-02 Intel Corporation Comparing text strings
EP2160692A1 (en) 2007-05-21 2010-03-10 Incredimail Ltd Interactive message editing system and method
US20090063410A1 (en) 2007-08-29 2009-03-05 Nils Haustein Method for Performing Parallel Data Indexing Within a Data Storage System
US7739434B2 (en) 2008-01-11 2010-06-15 International Business Machines Corporation Performing a configuration virtual topology change and instruction therefore
US7870339B2 (en) 2008-01-11 2011-01-11 International Business Machines Corporation Extract cache attribute facility and instruction therefore
US7895419B2 (en) 2008-01-11 2011-02-22 International Business Machines Corporation Rotate then operate on selected bits facility and instructions therefore
US7877582B2 (en) 2008-01-31 2011-01-25 International Business Machines Corporation Multi-addressable register file
EP2245529A1 (en) 2008-02-18 2010-11-03 Sandbridge Technologies, Inc. Method to accelerate null-terminated string operations
DK176835B1 (da) 2008-03-07 2009-11-23 Jala Aps Fremgangsmåde til skanning, medium indeholdende et program til udövelse af fremgangsmåden samt system til udövelse af fremgangsmåden
US8386547B2 (en) 2008-10-31 2013-02-26 Intel Corporation Instruction and logic for performing range detection
JP5500652B2 (ja) 2009-02-02 2014-05-21 日本電気株式会社 並列比較選択演算装置、プロセッサ及び並列比較選択演算方法
JP5471082B2 (ja) 2009-06-30 2014-04-16 富士通株式会社 演算処理装置および演算処理装置の制御方法
US8595471B2 (en) 2010-01-22 2013-11-26 Via Technologies, Inc. Executing repeat load string instruction with guaranteed prefetch microcode to prefetch into cache for loading up to the last value in architectural register
JP2011212043A (ja) 2010-03-31 2011-10-27 Fujifilm Corp 医用画像再生装置および方法並びにプログラム
US20110314263A1 (en) 2010-06-22 2011-12-22 International Business Machines Corporation Instructions for performing an operation on two operands and subsequently storing an original value of operand
US8972698B2 (en) 2010-12-22 2015-03-03 Intel Corporation Vector conflict instructions
US9009447B2 (en) 2011-07-18 2015-04-14 Oracle International Corporation Acceleration of string comparisons using vector instructions
US9459864B2 (en) 2012-03-15 2016-10-04 International Business Machines Corporation Vector string range compare
US9588762B2 (en) 2012-03-15 2017-03-07 International Business Machines Corporation Vector find element not equal instruction
US9710266B2 (en) 2012-03-15 2017-07-18 International Business Machines Corporation Instruction to compute the distance to a specified memory boundary
US9454366B2 (en) 2012-03-15 2016-09-27 International Business Machines Corporation Copying character data having a termination character from one memory location to another
US9268566B2 (en) 2012-03-15 2016-02-23 International Business Machines Corporation Character data match determination by loading registers at most up to memory block boundary and comparing
US9459867B2 (en) 2012-03-15 2016-10-04 International Business Machines Corporation Instruction to load data up to a specified memory boundary indicated by the instruction
US9454367B2 (en) 2012-03-15 2016-09-27 International Business Machines Corporation Finding the length of a set of character data having a termination character
US9280347B2 (en) 2012-03-15 2016-03-08 International Business Machines Corporation Transforming non-contiguous instruction specifiers to contiguous instruction specifiers
US9459868B2 (en) 2012-03-15 2016-10-04 International Business Machines Corporation Instruction to load data up to a dynamically determined memory boundary
US9715383B2 (en) 2012-03-15 2017-07-25 International Business Machines Corporation Vector find element equal instruction

Also Published As

Publication number Publication date
EP2769301A4 (en) 2014-11-19
ES2779033T3 (es) 2020-08-13
CA2867115A1 (en) 2013-09-19
US9280347B2 (en) 2016-03-08
LT2769301T (lt) 2020-05-25
US20130246768A1 (en) 2013-09-19
AU2012373735B2 (en) 2016-06-02
TW201403468A (zh) 2014-01-16
PT2769301T (pt) 2020-03-26
HUE048409T2 (hu) 2020-07-28
MX2014010948A (es) 2014-10-13
AU2012373735A1 (en) 2014-09-11
PL2769301T3 (pl) 2020-06-01
IL232817A0 (en) 2014-07-31
BR112014022638A2 (ru) 2017-06-20
BR112014022638B1 (pt) 2022-01-04
EP2769301B1 (en) 2020-02-19
RU2568241C2 (ru) 2015-11-10
TWI533207B (zh) 2016-05-11
EP2769301A1 (en) 2014-08-27
KR101643065B1 (ko) 2016-07-26
BR112014022638A8 (pt) 2021-12-14
JP6108362B2 (ja) 2017-04-05
SI2769301T1 (sl) 2020-06-30
HK1201354A1 (en) 2015-08-28
CN104169877B (zh) 2017-10-13
MX340050B (es) 2016-06-22
WO2013136144A1 (en) 2013-09-19
IL232817A (en) 2017-07-31
US9454374B2 (en) 2016-09-27
KR20140104974A (ko) 2014-08-29
CA2867115C (en) 2020-12-08
DK2769301T3 (da) 2020-03-16
HRP20200393T1 (hr) 2020-06-12
JP2015514242A (ja) 2015-05-18
CN104169877A (zh) 2014-11-26
US20130246766A1 (en) 2013-09-19
ZA201406612B (en) 2016-05-25
SG11201404825SA (en) 2014-09-26

Similar Documents

Publication Publication Date Title
RU2012148583A (ru) Трансформация прерывистых спецификаторов команд в непрерывные спецификаторы команд
JP2014513373A5 (ru)
RU2010149255A (ru) Экземпляры планировщика в процессе
JP2006107481A5 (ru)
RU2012148585A (ru) Сохранение/восстановление выбранных регистров при транзакционной обработке
RU2012148402A (ru) Преобразование из зонного формата в десятичный формат с плавающей точкой
RU2014107726A (ru) Проецирование собственных интерфейсов прикладного программирования операционной системы в другие языки программирования
US20180373514A1 (en) Application binary interface cross compilation
RU2012149006A (ru) Средство функциональной виртуализации для блокировки командной функции многофункциональной команды виртуального процесса
TW202236089A (zh) 用於異質ｓｏｃ設計之使用者空間仿真框架
Basler et al. Boom: Taking boolean program model checking one step further
Williams et al. Evaluation of autoparallelization toolkits for commodity gpus
US10409602B2 (en) Vector operand bitsize control
JP2014013570A (ja) 再構成可能プロセッサのソースレベルデバッギング装置及び方法
Laurenzano et al. A static binary instrumentation threading model for fast memory trace collection
JP2012022580A (ja) 情報処理装置、情報処理方法
Yang et al. Opencl 2.0 compiler adaptation on llvm for ptx simulators
JP2010529540A5 (ru)
ATE373845T1 (de) Dmac-ausgabemechanismus über ein steaming-id- verfahren
Liu et al. Dynamically translating binary code for multi-threaded programs using shared code cache
Chen et al. Full system emulation of embedded heterogeneous multicores based on qemu
Nepomuceno et al. An opencl-compliant multi-core platform and its companion compiler
Alonso et al. Runtime scheduling of the LU factorization: performance and energy
Afshar et al. Per processor spin-lock priority for partitioned multiprocessor real-time systems
Kim Scaling Theory and Machine Abstractions