KR970072844A - 중앙처리장치의 인터럽트 신호 공급회로 - Google Patents

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KR970072844A
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Abstract

구성이 단순하고 중앙처리장치의 인터럽트 제어 신뢰성이 높은 회로를 제공하기 위해 상기 중앙처리장치(U3)의 M1신호와 IORQ신호를 논리합하는 오아게이트(U2)와, 1KHz를 클럭으로 하여 상기 오아게이트(U2)의 출력 즉 상기 중앙처리장치의 M1 또 IORQ 신호중 어느 하나의 신호가 발생되더라도 인터럽트 신호를 발생하는 디플립폴롭(U1)으로 구성됨을 특징으로 하고 있다.

Description

중앙처리장치의 인터럽트 신호 공급회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 회로도.

Claims (1)

  1. 중앙처리장치(CPU)를 구비한 통신시스템의 인터럽트 발생회로에 있어서, 상기 중앙처리장치(U3)의 M1신호와 IORQ신호를 논리합하는 오아게이트(U2)와, 1KHz를 클럭으로 하여 상기 오아게이트(U2)의 출력 즉, 상기 중앙처리장치의 M1 또 IORQ 신호중 어느 하나의 신호가 발생되더라도 인터럽트 신호를 발생하는 디플립폴롭(U1)으로 구성됨을 특징으로 하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019960013088A 1996-04-26 1996-04-26 중앙처리장치의 인터럽트 신호 공급회로 KR100189248B1 (ko)

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