KR970063618A - 반도체기판의 제조방법 및 반도체기판의 검사방법 - Google Patents
반도체기판의 제조방법 및 반도체기판의 검사방법 Download PDFInfo
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 72
- 239000000758 substrate Substances 0.000 title claims abstract description 71
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 46
- 238000000034 method Methods 0.000 title claims abstract description 30
- 238000007689 inspection Methods 0.000 title claims 2
- 238000010438 heat treatment Methods 0.000 claims abstract 113
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims abstract 41
- 239000013078 crystal Substances 0.000 claims abstract 41
- 229910052710 silicon Inorganic materials 0.000 claims abstract 41
- 239000010703 silicon Substances 0.000 claims abstract 41
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims abstract 37
- 229910052760 oxygen Inorganic materials 0.000 claims abstract 37
- 239000001301 oxygen Substances 0.000 claims abstract 37
- 238000001556 precipitation Methods 0.000 claims abstract 27
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 claims abstract 15
- 229910052796 boron Inorganic materials 0.000 claims abstract 15
- 239000002244 precipitate Substances 0.000 claims abstract 7
- 230000007547 defect Effects 0.000 claims abstract 3
- 230000015572 biosynthetic process Effects 0.000 claims 23
- 229910021421 monocrystalline silicon Inorganic materials 0.000 claims 6
- 238000001739 density measurement Methods 0.000 claims 2
- 238000009792 diffusion process Methods 0.000 claims 1
- 230000002411 adverse Effects 0.000 abstract 1
- 230000000694 effects Effects 0.000 abstract 1
- 238000010998 test method Methods 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/322—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
- H01L21/3221—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections of silicon bodies, e.g. for gettering
- H01L21/3225—Thermally inducing defects using oxygen present in the silicon body for intrinsic gettering
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- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
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- General Physics & Mathematics (AREA)
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Abstract
(과제)
P+웨이퍼를 사용하여 반도체장치를 제조하는 경우에, 소자특성으로 악영향을 방지하기에 충분한 폭의 무결함층을 고온열처리과정을 회피하면서 형성가능한 반도체기판의 제조방법과, 아울러 반도체기판내의 산소석출물밀도의 적정한 검사방법을 제공한다.
(해결수단)
소정영역내에 석출하는 산소석출핵(2)이 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 보론을 함유하는 영역을 갖춘 실리콘단결정(1)에, 산소석출핵이 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는 온도범위에서 가열처리를 행하며, 더욱이 이후의 열처리로서 상기 가열처리의 온도범위보다도 고온이고, 또한 산소석출핵(1)이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행한다.
이 구성에 의해, 고온열처리과정을 회피하면서 충분한 폭의 무결함층(4)을 형성할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 반도체기판의 제조방법에 의한 제조공정을 모식적으로 나타낸 설명도.
Claims (58)
- 소정영역내에 석출하는 산소석출핵이 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 보론을 함유하는 영역을 갖춘 실리콘단결정에, 상기 산소석출핵이 상기 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는 온도범위에서 가열처리를 행하는 제1열처리공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 소정영역내에 석출하는 산소석출핵이 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 보론을 함유하는 영역을 갖춘 실리콘단결정판의 상기 보론을 함유하는 영역이 존재하는 측의 면 위에, 상기 고농도보다도 낮은 농도로 보론을 함유하는 실리콘단결정층을 형성하는 실리콘단결정층 형성공정과, 상기 산소석출핵이 상기 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는 온도범위에서 가열처리를 행하는 제1열처리공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제2항에 있어서, 상기 실리콘단결정층 형성공정은, 애피택셜성장법에 의한 형성공정인 것을 특징으로 하는 반도체기판의 제조방법.
- 제1항에 있어서, 상기 제1열처리공정은, 상기 산소석출핵이 상기 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는데 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제2항에 있어서, 상기 제1열처리공정은, 상기 산소석출핵이 상기 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는데 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제3항에 있어서, 상기 제1열처리공정은, 상기 산소석출핵이 상기 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는데 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제1항에 있어서, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요한 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제2항에 있어서, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제3항에 있어서, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제4항에 있어서, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제5항에 있어서, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제6항에 있어서, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제7항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제8항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제9항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제10항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제11항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제12항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제1항에 있어서, 상기 제1열처리공정이후에, 상기 실리콘단결정으로 이루어진 기판의 상기 보론을 함유하는 영역이 존재하는 측의 면 위에, 상기 고농도보다도 낮은 농도로 보론을 함유하는 다른 단결정실리콘층을 형성하는 단결정실리콘층 형성공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제19항에 있어서, 상기 다른 단결정실리콘층의 형성은, 에피택셜성장법에 의한 형성인 것을 특징으로 하는 반도체기판의 제조방법.
- 제19항 또는 제20항의 어느 한 항에 있어서, 상기 제1열처리공정후, 상기 다른 단결정실리콘층 형성공정전에, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다도 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제21항에 있어서, 상기 제2열처리공정은, 상기 산소석출핵이 축소되는데 필요하면서 충분한 시간 이상의 시간동안 행하여지는 것을 특징으로 하는 반도체기판의 제조방법.
- 제1항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제2항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제3항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제4항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제5항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제6항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제7항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제8항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제9항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제10항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제11항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제12항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제13항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제14항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제15항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제16항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제17항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제18항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제19항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제20항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제21항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 제22항에 있어서, 상기 소정영역은, 상기 반도체기판의 소자형성영역인 것을 특징으로 하는 반도체기판의 제조방법.
- 소정영역내에 석출하는 산소석출핵이 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 보론을 함유하는 영역을 갖춘 실리콘단결정에, 상기 산소석출핵이 상기 이후의 열처리공정에서 축소될 수 있는 정도의 고농도로 석출되는 온도범위에서 가열처리를 행하는 제1열처리공정과, 상기 이후의 열처리로서, 상기 제1열처리공정에서의 가열처리의 온도조건보다 고온이고, 또한 상기 산소석출핵이 축소되는데 필요하면서 충분한 낮은 범위내의 온도에서 가열처리를 행하는 제2열처리공정 및, 상기 제1 및 제2열처리공정후에, 상기 실리콘단결정내에 석출한 산소석출핵중 산소석출물로 성장한 것의 밀도를 측정하는 산소석출물밀도 측정공정을 구비한 것을 특징으로 하는 반도체기판의 검사방법.
- 제45항에 있어서, 상기 제1및 제2열처리공정과 완성후의 반도체기판을 이용한 반도체장치 제조공정중에서의 모든 열처리공정에 의한 산소학산깊이가, 필요로되는 무결함층 깊이를 확보할 수 있는 것으로 되도록, 상기 제2열처리공정의 시간을 설정하는 것을 특징으로 하는 반도체기판의 검사방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 실리콘단결정에, 450~750˚C의 온도영역에서 열처리를 행하는 제1열처리공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 제1실리콘단결정층 위에 제2실리콘단결정층을 형성하는 실리콘단결정층 형성공정과, 상기 제1 및 제2실리콘단결정층으로 이루어진 실리콘단결정에, 450~750˚C의 온도영역에서의 열처리를 행하는 제1열처리공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제48항에 있어서, 상기 제1실리콘단결정층은 CZ(Czochralski)법에 의해 형성된 단결정실리콘으로부터 베어 낸 기판이고, 상기 실리콘단결정층 형성공정은 에피택셜성장법에 의한 형성공정인 것을 특징으로 하는 반도체기판의 제조방법.
- 제47항에 있어서, 상기 제1열처리공정후에, 900~1100˚C의 온도영역에서 열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제48항에 있어서, 상기 제1열처리공정후에, 900~1100˚C의 온도영역에서 열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 제49항에 있어서, 상기 제1열처리공정후에, 900~1100˚C의 온도영역에서 열처리를 행하는 제2열처리공정을 더 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 실리콘단결정판에, 450~750˚C 온도영역에서 열처리를 행하는 제1열처리공정과, 상기 실리콘단결정 위에 에피택셜성장법에 의해 실리콘단결정층을 형성하는 실리콘단결정층 형성공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 실리콘단결정판에, 450~750˚C의 온도영역에서 열처리를 행하는 제1열처리공정과, 상기 실리콘단결정판에 900~1100˚C의 온도영역에서 열처리를 행하는 제2열처리공정 및, 상기 실리콘단 결정 위에 에피택셜성장법에 의해 실리콘단결정층을 형성하는 실리콘단결정층형성공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 실리콘단결정판에, 에피택셜성장법에 의해 실리콘단결정층을 형성하는 실리콘단결정층 형성공정과, 상기 실리콘단결정판 및 상기 실리콘단결정층에, 450~750˚C의 온도영역에서 열처리를 행하는 제1열처리공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 실리콘단결정판에, 에피택셜성장법에 의해 실리콘단결정층을 형성하는 실리콘단결정층 형성공정과, 상기 실리콘단결정판 및 상기 실리콘단결정층에, 450~750˚C의 온도영역에서 열처리를 행하는 제1열처리공정 및, 상기 실리콘단결정판 및 상기 실리콘단결정층에, 900~11 00˚C의 온도영역에서 열처리를 행하는 제2열처리공정을 구비한 것을 특징으로 하는 반도체기판의 제조방법.
- 보론농도가 1018atoms/㎤ 이상인 영역을 포함하고 있는 실리콘단결정에, 450 ~750˚C의 온도영역에서 열처리를 행하는 제1열처리공정과, 상기 실리콘단결정에, 900~1100˚C의 온도영역에서 열처리를 행하는 제2열처리공정 및 상기실리콘단결정내의 산소석출밀도를 측정하는 산소석출밀도 측정공정을 구비한 것을 특징으로 하는 반도체기판의 검사방법.
- 제57항에 있어서, 상기 제1및 제2열처리공정과 완성후의 반도체기판을 이용한 반도체장치 제조공정중에서의 모든 열처리공정에 의한 산소확산깊이가, 필요로되는 무결함층 깊이를 확보할 수 있는 것으로 되도록, 상기 제2열처리공정의 시간을 설정하는 것을 특징으로 하는 반도체기판의 검사방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2797096 | 1996-02-15 | ||
JP96-027970 | 1996-02-15 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR970063618A true KR970063618A (ko) | 1997-09-12 |
Family
ID=12235749
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019970004426A KR970063618A (ko) | 1996-02-15 | 1997-02-14 | 반도체기판의 제조방법 및 반도체기판의 검사방법 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5951755A (ko) |
KR (1) | KR970063618A (ko) |
TW (1) | TW331017B (ko) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP4615161B2 (ja) * | 2001-08-23 | 2011-01-19 | 信越半導体株式会社 | エピタキシャルウエーハの製造方法 |
JP2005051040A (ja) * | 2003-07-29 | 2005-02-24 | Matsushita Electric Ind Co Ltd | 半導体装置の製造方法及び半導体基板 |
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- 1997-02-01 TW TW086101197A patent/TW331017B/zh not_active IP Right Cessation
- 1997-02-14 US US08/801,113 patent/US5951755A/en not_active Expired - Fee Related
- 1997-02-14 KR KR1019970004426A patent/KR970063618A/ko active Search and Examination
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---|---|
US5951755A (en) | 1999-09-14 |
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A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
AMND | Amendment | ||
E601 | Decision to refuse application | ||
AMND | Amendment | ||
J201 | Request for trial against refusal decision | ||
B601 | Maintenance of original decision after re-examination before a trial | ||
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